JP3117128B2 - 基準電圧発生回路 - Google Patents
基準電圧発生回路Info
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- JP3117128B2 JP3117128B2 JP09031477A JP3147797A JP3117128B2 JP 3117128 B2 JP3117128 B2 JP 3117128B2 JP 09031477 A JP09031477 A JP 09031477A JP 3147797 A JP3147797 A JP 3147797A JP 3117128 B2 JP3117128 B2 JP 3117128B2
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- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F1/00—Automatic systems in which deviations of an electric quantity from one or more predetermined values are detected at the output of the system and fed back to a device within the system to restore the detected quantity to its predetermined value or values, i.e. retroactive systems
- G05F1/10—Regulating voltage or current
- G05F1/46—Regulating voltage or current wherein the variable actually regulated by the final control device is dc
- G05F1/468—Regulating voltage or current wherein the variable actually regulated by the final control device is dc characterised by reference voltage circuitry, e.g. soft start, remote shutdown
Description
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は基準電圧発生回路に
関し、特にパワー制御信号により制御される基準電圧発
生回路に関する。
関し、特にパワー制御信号により制御される基準電圧発
生回路に関する。
【０００２】
【従来の技術】外部回路に基準電圧を供給する回路にお
いて、基準電圧投入時の立ち上がりを速やかに行うため
に、例えば特開平４−２５２３１２号公報記載のような
基準電圧発生回路が知られている。図５は従来の基準電
圧発生回路の一例を示す構成図である。図５において、
基準電圧発生源１の基準電圧出力線Ａと、電源ＶDDとの
間に直列接続した抵抗Ｒ1と第１のキャパシタＣ1を、ま
た基準電圧出力線Ａとグランドとの間に第２のキャパシ
タＣ2を常時接続しておくことにより、電源立ち上がり
時の基準電圧出力ＶOを、抵抗Ｒ1及び第１のキャパシタ
Ｃ1の合成インピーダンスと第２のキャパシタＣ2のイン
ピーダンスとの比で決まる電圧値まで急速に立ち上げ、
基準電圧出力ＶOが目的の基準電圧値まで立ち上がるま
での時間を早くしている。また、抵抗Ｒ1と第１及び第
２のキャパシタＣ1、Ｃ2とによってＬＰＦが構成されて
おり、電源から基準電圧出力端子Ａに回り込んでくる高
周波ノイズを除去している。
いて、基準電圧投入時の立ち上がりを速やかに行うため
に、例えば特開平４−２５２３１２号公報記載のような
基準電圧発生回路が知られている。図５は従来の基準電
圧発生回路の一例を示す構成図である。図５において、
基準電圧発生源１の基準電圧出力線Ａと、電源ＶDDとの
間に直列接続した抵抗Ｒ1と第１のキャパシタＣ1を、ま
た基準電圧出力線Ａとグランドとの間に第２のキャパシ
タＣ2を常時接続しておくことにより、電源立ち上がり
時の基準電圧出力ＶOを、抵抗Ｒ1及び第１のキャパシタ
Ｃ1の合成インピーダンスと第２のキャパシタＣ2のイン
ピーダンスとの比で決まる電圧値まで急速に立ち上げ、
基準電圧出力ＶOが目的の基準電圧値まで立ち上がるま
での時間を早くしている。また、抵抗Ｒ1と第１及び第
２のキャパシタＣ1、Ｃ2とによってＬＰＦが構成されて
おり、電源から基準電圧出力端子Ａに回り込んでくる高
周波ノイズを除去している。
【０００３】
【発明が解決しようとする課題】上記構成の基準電圧発
生回路においては、抵抗Ｒ1と第１及び第２のキャパシ
タＣ1、Ｃ2とで構成されるＬＰＦが電源立ち上がり後も
常時電源ＶDDと基準電圧出力端子Ａとの間に接続されて
いるため、その回路定数によっては除去できない周波数
のノイズが基準電圧出力端子Ａに回り込み、基準電圧立
ち上がり後の電源ノイズの除去が必ずしも十分ではなか
った。
生回路においては、抵抗Ｒ1と第１及び第２のキャパシ
タＣ1、Ｃ2とで構成されるＬＰＦが電源立ち上がり後も
常時電源ＶDDと基準電圧出力端子Ａとの間に接続されて
いるため、その回路定数によっては除去できない周波数
のノイズが基準電圧出力端子Ａに回り込み、基準電圧立
ち上がり後の電源ノイズの除去が必ずしも十分ではなか
った。
【０００４】また、基準電圧出力端子とグランドの間に
は負荷容量ＣLが接続されるので、キャパシタＣ1、Ｃ2
の値は、この負荷容量ＣLが無視できるような十分大き
な値とする必要があるが、負荷容量ＣLの値が大きくな
ると、キャパシタＣ1、Ｃ2を集積回路上で実現すること
が困難となるという問題があった。
は負荷容量ＣLが接続されるので、キャパシタＣ1、Ｃ2
の値は、この負荷容量ＣLが無視できるような十分大き
な値とする必要があるが、負荷容量ＣLの値が大きくな
ると、キャパシタＣ1、Ｃ2を集積回路上で実現すること
が困難となるという問題があった。
【０００５】本発明の目的は、基準電圧の立ち上がり後
の電源ノイズの回り込みを防止しつつ、基準電圧の立ち
上がりを早くすることである。
の電源ノイズの回り込みを防止しつつ、基準電圧の立ち
上がりを早くすることである。
【０００６】本発明の他の目的は、基準電圧出力端子に
大きな負荷容量がついた場合でも、回路定数を集積回路
上での実現が不可能なレベルにまで増大させることな
く、基準電圧の立ち上がりを早くする効果を得ることで
ある。
大きな負荷容量がついた場合でも、回路定数を集積回路
上での実現が不可能なレベルにまで増大させることな
く、基準電圧の立ち上がりを早くする効果を得ることで
ある。
【０００７】
【課題を解決するための手段】本発明は、パワー制御信
号により動作／非動作する基準電圧発生回路において、
基準電圧出力となる基準電圧発生源と、前記パワー制御
信号により制御されるタイマー回路と、基準電圧出力端
子に接続され、前記タイマー回路の動作／非動作により
ＯＮ／ＯＦＦ制御されるスイッチと、該スイッチを介し
て前記基準電圧発生源に接続される電荷供給回路とを有
し、前記パワー制御信号により決定されるタイミングで
前記タイマー回路が動作し、前記スイッチをＯＮして前
記基準電圧発生源を前記電荷供給回路に接続する手段を
有している。
号により動作／非動作する基準電圧発生回路において、
基準電圧出力となる基準電圧発生源と、前記パワー制御
信号により制御されるタイマー回路と、基準電圧出力端
子に接続され、前記タイマー回路の動作／非動作により
ＯＮ／ＯＦＦ制御されるスイッチと、該スイッチを介し
て前記基準電圧発生源に接続される電荷供給回路とを有
し、前記パワー制御信号により決定されるタイミングで
前記タイマー回路が動作し、前記スイッチをＯＮして前
記基準電圧発生源を前記電荷供給回路に接続する手段を
有している。
【０００８】本発明においては、パワー制御信号による
パワーオンタイミングの直後からタイマーが動作する一
定期間だけスイッチがオンし、基準電圧出力端子に電
源、抵抗分割回路等からなる電荷供給回路が接続され
る。また、一定時間経過後タイマーの動作が終了すると
スイッチがオフし、基準電圧出力端子から電荷供給回路
が切り離される。このため、パワーオン時に基準電圧出
力端子に接続される負荷容量に対する充電電流が増加
し、基準電圧が急速に立ち上がる。立ち上がり後は、ス
イッチにより基準電圧出力端子と電源などの電荷供給回
路とが切り離されるため、電源からのノイズの影響をほ
とんどなくすことができる。また、電荷供給回路の回路
定数は、負荷容量を含めた時定数が十分に早い時間で立
ち上がるような値となっていればよく、集積回路上で実
現困難な大容量のキャパシタ等を設ける必要はない。
パワーオンタイミングの直後からタイマーが動作する一
定期間だけスイッチがオンし、基準電圧出力端子に電
源、抵抗分割回路等からなる電荷供給回路が接続され
る。また、一定時間経過後タイマーの動作が終了すると
スイッチがオフし、基準電圧出力端子から電荷供給回路
が切り離される。このため、パワーオン時に基準電圧出
力端子に接続される負荷容量に対する充電電流が増加
し、基準電圧が急速に立ち上がる。立ち上がり後は、ス
イッチにより基準電圧出力端子と電源などの電荷供給回
路とが切り離されるため、電源からのノイズの影響をほ
とんどなくすことができる。また、電荷供給回路の回路
定数は、負荷容量を含めた時定数が十分に早い時間で立
ち上がるような値となっていればよく、集積回路上で実
現困難な大容量のキャパシタ等を設ける必要はない。
【０００９】
【発明の実施の形態】本発明の第１の実施の形態につい
て図１を参照して説明する。図１において、基準電圧発
生源１は基準電圧ＶOを出力し、外部回路に与えてい
る。このとき、基準電圧出力端子Ａには外部回路や配線
などの影響による負荷容量ＣLが付いている。タイマー
回路２は、クロック信号ＣLKとパワー制御信号ＳPSを入
力し、タイマーのカウント動作中であるか否かに応じて
オン／オフの状態を示すタイマー出力信号ＳTMを出力す
る。パワー制御信号ＳPSは、パワーオフ時にＬレベル、
パワーオン時にＨレベルが入力される。また、タイマー
出力信号ＳTMは、タイマ動作オフ時（タイマ停止中）に
Ｌレベル、タイマ動作オン時（タイマーカウント中）に
Ｈレベルを出力する。電荷供給回路３は、電源ＶDDとグ
ランドとの間に抵抗Ｒ1、Ｒ2、及びスイッチＳ1、Ｓ2を
直列に接続した抵抗分割回路の構成をとっている。スイ
ッチＳ1、Ｓ2には、制御信号としてタイマ出力信号ＳTM
が入力されており、ＳTMがＨレベルの時オンし、Ｌレベ
ルの時はオフ状態となる。電荷供給回路３の出力は抵抗
分割回路の中点から取り出され、該中点と接続されてい
る基準電圧出力端子Ａに供給される。
て図１を参照して説明する。図１において、基準電圧発
生源１は基準電圧ＶOを出力し、外部回路に与えてい
る。このとき、基準電圧出力端子Ａには外部回路や配線
などの影響による負荷容量ＣLが付いている。タイマー
回路２は、クロック信号ＣLKとパワー制御信号ＳPSを入
力し、タイマーのカウント動作中であるか否かに応じて
オン／オフの状態を示すタイマー出力信号ＳTMを出力す
る。パワー制御信号ＳPSは、パワーオフ時にＬレベル、
パワーオン時にＨレベルが入力される。また、タイマー
出力信号ＳTMは、タイマ動作オフ時（タイマ停止中）に
Ｌレベル、タイマ動作オン時（タイマーカウント中）に
Ｈレベルを出力する。電荷供給回路３は、電源ＶDDとグ
ランドとの間に抵抗Ｒ1、Ｒ2、及びスイッチＳ1、Ｓ2を
直列に接続した抵抗分割回路の構成をとっている。スイ
ッチＳ1、Ｓ2には、制御信号としてタイマ出力信号ＳTM
が入力されており、ＳTMがＨレベルの時オンし、Ｌレベ
ルの時はオフ状態となる。電荷供給回路３の出力は抵抗
分割回路の中点から取り出され、該中点と接続されてい
る基準電圧出力端子Ａに供給される。
【００１０】次に、その動作について図２を参照して説
明する。基準電圧投入前には、パワー制御信号はＬレベ
ルとされており、回路全体がパワーオフしている。この
ときタイマ回路２は停止し、タイマ出力信号ＳPSはＬレ
ベルとなっている。したがって、スイッチＳ1、Ｓ2はオ
フ状態であり、電荷供給回路３は基準電圧出力端子Ａか
ら切り離されている。また、基準電圧ＶOは負荷容量ＣL
が放電された状態であるのでグランドレベルに落ちてい
る。
明する。基準電圧投入前には、パワー制御信号はＬレベ
ルとされており、回路全体がパワーオフしている。この
ときタイマ回路２は停止し、タイマ出力信号ＳPSはＬレ
ベルとなっている。したがって、スイッチＳ1、Ｓ2はオ
フ状態であり、電荷供給回路３は基準電圧出力端子Ａか
ら切り離されている。また、基準電圧ＶOは負荷容量ＣL
が放電された状態であるのでグランドレベルに落ちてい
る。
【００１１】基準電圧発生源１から基準電圧が投入され
るとパワー制御信号ＳPSが立ち上がり、その立ち上がり
時点からタイマ回路２のカウント動作が開始され、タイ
マ出力信号ＳTMはＨレベルとなる。したがって、スイッ
チＳ1、Ｓ2はオンとなり、電荷供給回路３の出力が基準
電圧出力端子Ａに供給されるので、負荷容量ＣLは、基
準電圧発生源１の出力と電荷供給回路３の出力が加算さ
れた出力によって急速に充電される。基準電圧の目標値
をＶRとし抵抗分割回路の分圧値がこの目標値ＶRとなる
ように抵抗Ｒ1、Ｒ2の値を ＶR＝Ｒ2／（Ｒ1＋Ｒ2）・ＶDD のように選ぶと、基準電圧ＶOは図２の実線で示されて
いるようにＶRに向かって急速に立ち上がってゆく。タ
イマ回路２があらかじめ設定された時間（基準電圧ＶO
が目標値ＶRに十分に近づくような時間）に相当するカ
ウント値をカウントすると、タイマ回路２はカウントを
停止し、タイマ出力信号ＳTMはＬレベルとなり、スイッ
チＳ１、Ｓ２がオフして電荷供給回路３（抵抗分割回
路）が基準電圧出力端子Ａから切り離される。その結
果、負荷容量ＣLへの電荷供給源は基準電圧発生源１の
みとなるが、基準電圧ＶOはすでに目標値ＶR付近にまで
達しているので、その後基準電圧ＶOは速やかに目標値
ＶRに達して安定する。
るとパワー制御信号ＳPSが立ち上がり、その立ち上がり
時点からタイマ回路２のカウント動作が開始され、タイ
マ出力信号ＳTMはＨレベルとなる。したがって、スイッ
チＳ1、Ｓ2はオンとなり、電荷供給回路３の出力が基準
電圧出力端子Ａに供給されるので、負荷容量ＣLは、基
準電圧発生源１の出力と電荷供給回路３の出力が加算さ
れた出力によって急速に充電される。基準電圧の目標値
をＶRとし抵抗分割回路の分圧値がこの目標値ＶRとなる
ように抵抗Ｒ1、Ｒ2の値を ＶR＝Ｒ2／（Ｒ1＋Ｒ2）・ＶDD のように選ぶと、基準電圧ＶOは図２の実線で示されて
いるようにＶRに向かって急速に立ち上がってゆく。タ
イマ回路２があらかじめ設定された時間（基準電圧ＶO
が目標値ＶRに十分に近づくような時間）に相当するカ
ウント値をカウントすると、タイマ回路２はカウントを
停止し、タイマ出力信号ＳTMはＬレベルとなり、スイッ
チＳ１、Ｓ２がオフして電荷供給回路３（抵抗分割回
路）が基準電圧出力端子Ａから切り離される。その結
果、負荷容量ＣLへの電荷供給源は基準電圧発生源１の
みとなるが、基準電圧ＶOはすでに目標値ＶR付近にまで
達しているので、その後基準電圧ＶOは速やかに目標値
ＶRに達して安定する。
【００１２】したがって、トータルの立ち上がり時間
は、電荷供給回路３による急速充電により、図２の点線
で示されている基準電圧発生源１単独での立ち上がり時
間に比べて十分に早くなる。また、急速充電後はスイッ
チＳ1、Ｓ2により電荷供給回路３の電流パスが遮断され
るため、立ち上がり後に不要な動作電流を消費せずに済
む。さらに、急速充電後は、スイッチＳ1、Ｓ2によって
電源ＶDDと基準電圧出力端子Ａとが切り離されるため、
電源ノイズの影響が少なくて済む。加えて、立ち上がり
時間は抵抗Ｒ1、Ｒ2と負荷容量ＣLとで決まる時定数に
よって決まるので、抵抗Ｒ1、Ｒ2の値を調整することに
より、立ち上がり時間を最適に設定することができる。
は、電荷供給回路３による急速充電により、図２の点線
で示されている基準電圧発生源１単独での立ち上がり時
間に比べて十分に早くなる。また、急速充電後はスイッ
チＳ1、Ｓ2により電荷供給回路３の電流パスが遮断され
るため、立ち上がり後に不要な動作電流を消費せずに済
む。さらに、急速充電後は、スイッチＳ1、Ｓ2によって
電源ＶDDと基準電圧出力端子Ａとが切り離されるため、
電源ノイズの影響が少なくて済む。加えて、立ち上がり
時間は抵抗Ｒ1、Ｒ2と負荷容量ＣLとで決まる時定数に
よって決まるので、抵抗Ｒ1、Ｒ2の値を調整することに
より、立ち上がり時間を最適に設定することができる。
【００１３】なお、図１においては、電荷供給回路３
は、電源ＶDDとグランドとの間に、抵抗Ｒ1、スイッチ
Ｓ1、スイッチＳ2、抵抗Ｒ2の順に直列に接続している
が、この接続関係は例えば、スイッチＳ１、抵抗Ｒ１、
抵抗Ｒ２、スイッチＳ２の順に直列接続する等適宜変更
して実施することができる。
は、電源ＶDDとグランドとの間に、抵抗Ｒ1、スイッチ
Ｓ1、スイッチＳ2、抵抗Ｒ2の順に直列に接続している
が、この接続関係は例えば、スイッチＳ１、抵抗Ｒ１、
抵抗Ｒ２、スイッチＳ２の順に直列接続する等適宜変更
して実施することができる。
【００１４】図３は、本発明において使用可能なタイマ
ー回路の一例を示すものであり、バイナリカウンタ１１
及びＤ型フリップフロップ１２によって構成されてい
る。図３において、フリップフロップ１２のＤ端子をＨ
レベル状態としてＣ端子にスタート信号ＳＴを入力する
とＱ端子からＨレベルが出力され、バイナリカウンタ１
１を起動し、その出力ＣＲＹを反転するとともにＣ端子
に供給されているクロック信号のカウントを開始する。
設定されたカウント値に達するとバイナリカウンタ１１
の出力が再度反転し、その反転出力によってＤ型フリッ
プフロップをリセットし、タイマー動作を終了する。な
お、タイマー回路としては、図３の例に限られるもので
はなく、任意のものを採用することができることはいう
までもなく、例えばアナログ的に時間設定ができる単安
定マルチバイブレータ等を用いて構成してもよい。
ー回路の一例を示すものであり、バイナリカウンタ１１
及びＤ型フリップフロップ１２によって構成されてい
る。図３において、フリップフロップ１２のＤ端子をＨ
レベル状態としてＣ端子にスタート信号ＳＴを入力する
とＱ端子からＨレベルが出力され、バイナリカウンタ１
１を起動し、その出力ＣＲＹを反転するとともにＣ端子
に供給されているクロック信号のカウントを開始する。
設定されたカウント値に達するとバイナリカウンタ１１
の出力が再度反転し、その反転出力によってＤ型フリッ
プフロップをリセットし、タイマー動作を終了する。な
お、タイマー回路としては、図３の例に限られるもので
はなく、任意のものを採用することができることはいう
までもなく、例えばアナログ的に時間設定ができる単安
定マルチバイブレータ等を用いて構成してもよい。
【００１５】次に、本発明の第２の実施の形態を図４を
参照して説明する。本実施の形態は、第１の実施の形態
における電荷供給回路３の回路構成を変更し、電源ＶDD
にソース端子を、基準電圧出力端子Ａにドレイン端子
を、タイマー出力端子ＳTMをゲート端子に接続したＰｃ
ｈ−ＭＯＳトランジスタＴｒ１のみによって構成してい
る。
参照して説明する。本実施の形態は、第１の実施の形態
における電荷供給回路３の回路構成を変更し、電源ＶDD
にソース端子を、基準電圧出力端子Ａにドレイン端子
を、タイマー出力端子ＳTMをゲート端子に接続したＰｃ
ｈ−ＭＯＳトランジスタＴｒ１のみによって構成してい
る。
【００１６】本実施の形態の動作は第１の実施の形態と
基本的には同様であるが、タイマー出力端子ＳTMの論理
が第１の実施の形態とは逆になっている。基準電圧投入
前には、パワー制御信号ＳPSはＬレベルとなっており、
回路全体がパワーオフしている。このときタイマ回路２
は停止し、タイマ出力信号ＳTMからはＨレベルが出力さ
れ、Ｐｃｈ−ＭＯＳトランジスタＴｒ１はオフし、電荷
供給回路３は基準電圧出力端子Ａから切り離されてい
る。また、基準電圧ＶOは負荷容量ＣLが放電された状態
となっているのでグランドレベルに落ちている。
基本的には同様であるが、タイマー出力端子ＳTMの論理
が第１の実施の形態とは逆になっている。基準電圧投入
前には、パワー制御信号ＳPSはＬレベルとなっており、
回路全体がパワーオフしている。このときタイマ回路２
は停止し、タイマ出力信号ＳTMからはＨレベルが出力さ
れ、Ｐｃｈ−ＭＯＳトランジスタＴｒ１はオフし、電荷
供給回路３は基準電圧出力端子Ａから切り離されてい
る。また、基準電圧ＶOは負荷容量ＣLが放電された状態
となっているのでグランドレベルに落ちている。
【００１７】基準電圧発生源１から基準電圧が投入さ
れ、パワー制御信号ＳPSが立ち上がると、タイマー回路
３がカウント動作を開始し、タイマー出力信号ＳTMがＨ
レベルからＬレベルに変化するのでＰｃｈ−ＭＯＳトラ
ンジスタＴｒ１がオンし、電荷供給回路３が基準電圧出
力端子Ａに接続される。したがって、負荷容量ＣLは、
基準電圧発生源１の出力と電荷供給回路３の出力が加算
された出力によって電源電圧ＶDDに向かって急速に充電
される。タイマー回路２があらかじめ設定された時間
（基準電圧ＶOが目標値ＶRに十分に近づくような時間）
に相当するカウント値をカウントすると、タイマ回路２
はカウントを停止し、タイマ出力信号ＳTMはＬレベルか
らＨレベルに変化し、Ｐｃｈ−ＭＯＳトランジスタＴｒ
１がオフして電荷供給回路３が基準電圧出力端子Ａから
切り離される。その結果、負荷容量ＣLへの電荷供給源
は基準電圧発生源１のみとなるが、基準電圧ＶOはすで
に目標値ＶR付近にまで達しているので、その後基準電
圧ＶOは速やかに目標値ＶRに達して安定する。 本実施
の形態においては、電荷供給回路３が接続されている
時、基準電圧ＶOは目標値ＶRではなく電源電圧ＶDDに向
かって急速に立ち上がっていくので、立ち上がり速度を
より速くすることができる。そして、目標値ＶR付近に
達したときにその立ち上がりを止めるようにタイマー２
の動作時間を設定しておけば、その後は速やかに目標値
ＶRの基準電圧が得られる。
れ、パワー制御信号ＳPSが立ち上がると、タイマー回路
３がカウント動作を開始し、タイマー出力信号ＳTMがＨ
レベルからＬレベルに変化するのでＰｃｈ−ＭＯＳトラ
ンジスタＴｒ１がオンし、電荷供給回路３が基準電圧出
力端子Ａに接続される。したがって、負荷容量ＣLは、
基準電圧発生源１の出力と電荷供給回路３の出力が加算
された出力によって電源電圧ＶDDに向かって急速に充電
される。タイマー回路２があらかじめ設定された時間
（基準電圧ＶOが目標値ＶRに十分に近づくような時間）
に相当するカウント値をカウントすると、タイマ回路２
はカウントを停止し、タイマ出力信号ＳTMはＬレベルか
らＨレベルに変化し、Ｐｃｈ−ＭＯＳトランジスタＴｒ
１がオフして電荷供給回路３が基準電圧出力端子Ａから
切り離される。その結果、負荷容量ＣLへの電荷供給源
は基準電圧発生源１のみとなるが、基準電圧ＶOはすで
に目標値ＶR付近にまで達しているので、その後基準電
圧ＶOは速やかに目標値ＶRに達して安定する。 本実施
の形態においては、電荷供給回路３が接続されている
時、基準電圧ＶOは目標値ＶRではなく電源電圧ＶDDに向
かって急速に立ち上がっていくので、立ち上がり速度を
より速くすることができる。そして、目標値ＶR付近に
達したときにその立ち上がりを止めるようにタイマー２
の動作時間を設定しておけば、その後は速やかに目標値
ＶRの基準電圧が得られる。
【００１８】
【発明の効果】本発明は、基準電圧の立ち上がりの時の
み立ち上がりを早くするための電荷供給回路をスイッチ
を介して接続し、立ち上がり後は電荷供給回路を切り離
しているので、基準電圧の立ち上がりを早くするととも
に、立ち上がり後に電荷供給回路からの電源ノイズの回
り込みを防止することができる。さらに、電荷供給後
は、スイッチにより電荷供給回路３の電流パスも遮断さ
れるため、基準電圧が立ち上がった後の動作に不要な電
流を消費することはない。
み立ち上がりを早くするための電荷供給回路をスイッチ
を介して接続し、立ち上がり後は電荷供給回路を切り離
しているので、基準電圧の立ち上がりを早くするととも
に、立ち上がり後に電荷供給回路からの電源ノイズの回
り込みを防止することができる。さらに、電荷供給後
は、スイッチにより電荷供給回路３の電流パスも遮断さ
れるため、基準電圧が立ち上がった後の動作に不要な電
流を消費することはない。
【００１９】また、本発明の回路定数は負荷容量と組み
合わせて十分早い時間で立ち上がるように抵抗値を設定
すればよいから、基準電圧出力に大きな負荷容量が付い
た場合でも、回路定数を集積回路上での実現が不可能な
レベルにまで増大させることなく、基準電圧の立ち上が
りを早くすることができる。
合わせて十分早い時間で立ち上がるように抵抗値を設定
すればよいから、基準電圧出力に大きな負荷容量が付い
た場合でも、回路定数を集積回路上での実現が不可能な
レベルにまで増大させることなく、基準電圧の立ち上が
りを早くすることができる。
【００２０】
【図１】本発明の第１の実施の形態を示す図である。
【図２】図１の動作を示すタイムチャートである。
【図３】本発明で用いられるタイマー回路の一例を示す
図である。
図である。
【図４】本発明の第２の実施の形態を示す図である。
【図５】従来例を示す図である。
１ 基準電圧発生源 ２ タイマー回路 ３ 電荷供給回路 １１ バイナリカウンタ １２ フリップフロップ Ｒ1，Ｒ2 抵抗 Ｃ1，Ｃ2 キャパシタ ＣL 負荷容量 Ｓ1，Ｓ2 スイッチ ＶDD 電源 ＣLK クロック信号 ＳPS パワー制御信号 ＳTM タイマー出力信号 ＶO 基準電圧 Ａ 基準電圧出力端子
Claims (5)
- 【請求項１】基準電圧を発生する基準電圧発生源と、電
荷供給回路と、タイマー回路とを備え、前記電荷供給回
路は、前記基準電圧発生源が起動された時点から所定時
間だけその出力を前記基準電圧発生源の基準電圧出力端
子に供給するように前記タイマー回路によって制御され
ることを特徴とする基準電圧発生回路。 - 【請求項２】前記電荷供給回路は、電源端子と、該電源
端子の電圧を分圧して出力する抵抗分割回路と、前記タ
イマー回路によりＯＮ／ＯＦＦ制御されるスイッチとに
よって構成されていることを特徴とする請求項１記載の
基準電圧発生回路。 - 【請求項３】前記電荷供給回路は、電源端子と、該電源
端子とグランドとの間に第１の抵抗、第１のスイッチ、
第２のスイッチ及び第２の抵抗の順に直列接続された前
記電源端子の電圧を分圧する抵抗分割回路によって構成
され、前記第１及び第２のスイッチは、前記タイマー回
路によりＯＮ／ＯＦＦ制御されるとともに、前記第１及
び第２のスイッチの接続点は前記基準電圧発生源の基準
電圧出力点に接続されていることを特徴とする請求項２
記載の基準電圧発生回路。 - 【請求項４】前記電荷供給回路は、電源端子と、該電源
端子と前記基準電圧発生源の基準電圧出力端子間に接続
され前記タイマー回路によりＯＮ／ＯＦＦ制御されるス
イッチとによって構成されていることを特徴とする請求
項１記載の基準電圧発生回路。 - 【請求項５】前記スイッチは、ＰチャンネルＭＯＳトラ
ンジスタであることを特徴とする請求項４記載の基準電
圧発生回路。
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