JP3091324B2 - 印字素子駆動装置の駆動方法 - Google Patents
印字素子駆動装置の駆動方法Info
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Description
【０００１】
【産業上の利用分野】この発明はサーマルプリントヘッ
ド（サーマルヘッド）、ＬＥＤプリントヘッド等の印字
素子駆動装置の駆動方法に関する。
ド（サーマルヘッド）、ＬＥＤプリントヘッド等の印字
素子駆動装置の駆動方法に関する。
【０００２】
【従来の技術】サーマルヘッド等の印字素子駆動装置を
駆動するのに、いわゆるラッチレス制御の駆動方法があ
る。この種の駆動方法には、例えば図５に示すように、
ｎ個の発熱素子１-1、１-2、…、１-nに対し、ｎ個の記
憶セルＤ1 、Ｄ2 、…Ｄn を有するシフトレジスタ２
と、このシフトレジスタ２の各記憶セル出力とストロー
ブ信号ＳＴＢ１（反転）あるいはストローブ信号ＳＴＢ
２（反転）を入力に受けるドライブ素子３-1、３-2、
…、３-nからなる駆動回路が使用される。この駆動回路
では、先ずｎ個のクロックパルスＣＬＫがシフトレジス
タ２に加えられて、ｎビットのシリアル印字データＤＩ
が、シフトレジスタ２に記憶され、次にストローブ信号
ＳＴＢ１（反転）のオンで、ドライブ素子３-1、…、３
-n/2が動作し、発熱素子１-1、…、１-nが駆動され、さ
らに次のストローブ信号ＳＴＢ２（反転）のオンでドラ
イブ素子３-(n/2+1)、…、３-nが動作し、発熱素子１
-(n/2+1)、…、１-nが駆動される。
駆動するのに、いわゆるラッチレス制御の駆動方法があ
る。この種の駆動方法には、例えば図５に示すように、
ｎ個の発熱素子１-1、１-2、…、１-nに対し、ｎ個の記
憶セルＤ1 、Ｄ2 、…Ｄn を有するシフトレジスタ２
と、このシフトレジスタ２の各記憶セル出力とストロー
ブ信号ＳＴＢ１（反転）あるいはストローブ信号ＳＴＢ
２（反転）を入力に受けるドライブ素子３-1、３-2、
…、３-nからなる駆動回路が使用される。この駆動回路
では、先ずｎ個のクロックパルスＣＬＫがシフトレジス
タ２に加えられて、ｎビットのシリアル印字データＤＩ
が、シフトレジスタ２に記憶され、次にストローブ信号
ＳＴＢ１（反転）のオンで、ドライブ素子３-1、…、３
-n/2が動作し、発熱素子１-1、…、１-nが駆動され、さ
らに次のストローブ信号ＳＴＢ２（反転）のオンでドラ
イブ素子３-(n/2+1)、…、３-nが動作し、発熱素子１
-(n/2+1)、…、１-nが駆動される。
【０００３】なお、ｎは通常１０５６、２０４８といっ
た値であり、シフトレジスタ２及びドライブ素子３-1、
…、３-nは、１チップが６４ビット、９６ビット等のＩ
Ｃが複数個使用される。そのため、駆動すべきサーマル
ヘッドのドット数ｎを、使用されるＩＣのドット数Ｎで
割っても、割り切れない場合がある。この場合、従来
は、ドット数のＩＣをｍ個使用すると、端数が余るが、
（ｍ−１）個では、逆に足りないとすると、図６に示す
ようにｍ個のＩＣを使用してｍＮの記憶ビットセルを持
つシフトレジスタ２を構成し、ｍＮの記憶セルのうち、
端数の（ｍＮ−ｎ）個は、ドライブ素子をノンコンタク
ト、つまり、発熱素子に非接続とし、この記憶セルに
は、印字しないダミービットを入れていた。
た値であり、シフトレジスタ２及びドライブ素子３-1、
…、３-nは、１チップが６４ビット、９６ビット等のＩ
Ｃが複数個使用される。そのため、駆動すべきサーマル
ヘッドのドット数ｎを、使用されるＩＣのドット数Ｎで
割っても、割り切れない場合がある。この場合、従来
は、ドット数のＩＣをｍ個使用すると、端数が余るが、
（ｍ−１）個では、逆に足りないとすると、図６に示す
ようにｍ個のＩＣを使用してｍＮの記憶ビットセルを持
つシフトレジスタ２を構成し、ｍＮの記憶セルのうち、
端数の（ｍＮ−ｎ）個は、ドライブ素子をノンコンタク
ト、つまり、発熱素子に非接続とし、この記憶セルに
は、印字しないダミービットを入れていた。
【０００４】
【発明が解決しようとする課題】上記した従来のラッチ
レス制御の駆動方法は、図７に示すようにデータ転送時
間をストローブ信号オン時以外に設けている。これはス
トローブ信号オン時にデータ転送すると印字中に発熱ド
ットが変化してしまい、正常な印字ができないためであ
る。
レス制御の駆動方法は、図７に示すようにデータ転送時
間をストローブ信号オン時以外に設けている。これはス
トローブ信号オン時にデータ転送すると印字中に発熱ド
ットが変化してしまい、正常な印字ができないためであ
る。
【０００５】ところで、転送を含む１印字周期ＳＬＴ
は、通常１０ｍｍｓｅｃ程度とされる。この周期期間の
制約下では、データ転送時間をストローブ信号オン時以
外とすると、ストローブ信号オン時間をどうしても短く
せざるを得ない。しかし、印字濃度を確保するためにス
トローブ信号オン時間は、極力短くしないことが望まし
い。そこで、転送速度を従来（例えば１ＭＨＺ）から上
げる（例えば４ＭＨＺ）と、ノイズ等の影響も出て来る
という問題がある。
は、通常１０ｍｍｓｅｃ程度とされる。この周期期間の
制約下では、データ転送時間をストローブ信号オン時以
外とすると、ストローブ信号オン時間をどうしても短く
せざるを得ない。しかし、印字濃度を確保するためにス
トローブ信号オン時間は、極力短くしないことが望まし
い。そこで、転送速度を従来（例えば１ＭＨＺ）から上
げる（例えば４ＭＨＺ）と、ノイズ等の影響も出て来る
という問題がある。
【０００６】また、印字素子のドット数と、ＩＣの個数
配置で端数が出た場合、従来のように、一方のストロー
ブ信号側のＩＣにのみ、ノンコンタクト部を設けたので
は、第１と第２のストローブ信号オン時のドライブ電流
に差が生じ、印字濃度むらが生じるという問題がある。
配置で端数が出た場合、従来のように、一方のストロー
ブ信号側のＩＣにのみ、ノンコンタクト部を設けたので
は、第１と第２のストローブ信号オン時のドライブ電流
に差が生じ、印字濃度むらが生じるという問題がある。
【０００７】この発明は、上記問題点に着目してなされ
たものであって、印字濃度を確保でき、ノイズの影響を
受けず、しかも印字濃度むらの生じにくい印字素子駆動
装置の駆動方法を提供することを目的としている。
たものであって、印字濃度を確保でき、ノイズの影響を
受けず、しかも印字濃度むらの生じにくい印字素子駆動
装置の駆動方法を提供することを目的としている。
【０００８】
【課題を解決するための手段及び作用】この発明の請求
項１記載の印字素子駆動装置の駆動方法は、ｎ個の印字
素子と、クロックパルスによってシフトされ、ビットシ
リアルな印字データを記憶する少なくともｎ個の記憶セ
ルを有するシフトレジスタと、このシフトレジスタに記
憶される印字データに応じて、前記印字素子を駆動する
少なくともｎ個のドライブ素子とを備え、かつ前記シフ
トレジスタ及びドライブ素子が、それぞれにＮ個 の記憶
セルからなるシフトレジスタ及びＮ個のドライブ素子か
らなるｍ個（ただしｍは偶数）のＩＣが使用されて構成
され、（ｍ−１）Ｎ＜ｎ＜ｍＮの関係にある印字素子駆
動装置において、前記ＩＣはｍ／２個ずつの２グループ
に分け、各グループのｍ／２個のシフトレジスタはシリ
アルに接続して第１と第２のシフトレジスタを形成し、
前記第１と第２のグループのｍ／２個のＩＣのうち、そ
れぞれ１個のＩＣの（ｍＮ−ｎ）／２のドライブ素子を
印字素子に非接続とし、かつ前記第１と第２のシフトレ
ジスタには、前記非接続のドライブ素子に対応する記憶
セルにストアされるデータを含むビットシリアルな印字
データを同時に入力するとともに、クロックパルスを選
択的に入力可能に構成し、第１の段階でクロックパルス
を第１のシフトレジスタに与えて、第１のシフトレジス
タにｎ／２ビットの印字データと（ｍＮ−ｎ）／２ビッ
トのダミーデータを記憶し、次の第２の段階でクロック
パルスを第２のシフトレジスタに与えて第２のシフトレ
ジスタに（ｍＮ−ｎ）／２ビットのダミーデータとｎ／
２ビットの印字データを記憶するようにしている。
項１記載の印字素子駆動装置の駆動方法は、ｎ個の印字
素子と、クロックパルスによってシフトされ、ビットシ
リアルな印字データを記憶する少なくともｎ個の記憶セ
ルを有するシフトレジスタと、このシフトレジスタに記
憶される印字データに応じて、前記印字素子を駆動する
少なくともｎ個のドライブ素子とを備え、かつ前記シフ
トレジスタ及びドライブ素子が、それぞれにＮ個 の記憶
セルからなるシフトレジスタ及びＮ個のドライブ素子か
らなるｍ個（ただしｍは偶数）のＩＣが使用されて構成
され、（ｍ−１）Ｎ＜ｎ＜ｍＮの関係にある印字素子駆
動装置において、前記ＩＣはｍ／２個ずつの２グループ
に分け、各グループのｍ／２個のシフトレジスタはシリ
アルに接続して第１と第２のシフトレジスタを形成し、
前記第１と第２のグループのｍ／２個のＩＣのうち、そ
れぞれ１個のＩＣの（ｍＮ−ｎ）／２のドライブ素子を
印字素子に非接続とし、かつ前記第１と第２のシフトレ
ジスタには、前記非接続のドライブ素子に対応する記憶
セルにストアされるデータを含むビットシリアルな印字
データを同時に入力するとともに、クロックパルスを選
択的に入力可能に構成し、第１の段階でクロックパルス
を第１のシフトレジスタに与えて、第１のシフトレジス
タにｎ／２ビットの印字データと（ｍＮ−ｎ）／２ビッ
トのダミーデータを記憶し、次の第２の段階でクロック
パルスを第２のシフトレジスタに与えて第２のシフトレ
ジスタに（ｍＮ−ｎ）／２ビットのダミーデータとｎ／
２ビットの印字データを記憶するようにしている。
【０００９】この駆動方法では、先ず第１のシフトレジ
スタにクロックパルスを与えて、ｎ／２ビットとダミー
データを含む印字データを入力して記憶し、次に第２の
シフトレジスタにクロックパルスを与えて、残りのｎ／
２ビットとダミーデータを含む印字データを入力して記
憶する。そしてこの記憶動作に入っている間に、第１の
シフトレジスタに記憶されている印字データ分の印字動
作を行う。印字データの記憶とストローブ信号オンを重
ねることができるので、ストローブ信号オン期間を短く
することなく、それでいて、印字データの転送（入力）
時間を、それほど速くする必要がない。したがって、印
字濃度を確保し、かつノイズの影響も受けにくい。
スタにクロックパルスを与えて、ｎ／２ビットとダミー
データを含む印字データを入力して記憶し、次に第２の
シフトレジスタにクロックパルスを与えて、残りのｎ／
２ビットとダミーデータを含む印字データを入力して記
憶する。そしてこの記憶動作に入っている間に、第１の
シフトレジスタに記憶されている印字データ分の印字動
作を行う。印字データの記憶とストローブ信号オンを重
ねることができるので、ストローブ信号オン期間を短く
することなく、それでいて、印字データの転送（入力）
時間を、それほど速くする必要がない。したがって、印
字濃度を確保し、かつノイズの影響も受けにくい。
【００１０】この駆動方法では、印字素子のドット数ｎ
と、ｍ個のＩＣによる接続可能なドット数ｍＮが合致し
ない場合において、２グループに分けて第１と第２のシ
フトレジスタを形成するＩＣ群のうち、各グループの、
それぞれに１個ずつ非接続部（ノンコンタクト）を持つ
ＩＣを割当てるので、ストローブ信号オン時のドライ ブ
電流に大きな差が出ず、印字濃度むらが起こりにくい。
と、ｍ個のＩＣによる接続可能なドット数ｍＮが合致し
ない場合において、２グループに分けて第１と第２のシ
フトレジスタを形成するＩＣ群のうち、各グループの、
それぞれに１個ずつ非接続部（ノンコンタクト）を持つ
ＩＣを割当てるので、ストローブ信号オン時のドライ ブ
電流に大きな差が出ず、印字濃度むらが起こりにくい。
【００１１】この発明の請求項２記載の印字素子駆動装
置の駆動方法は、請求項１に係る駆動方法において、さ
らに、前記印字素子に非接触な（ｍＮ−ｎ）／２個のド
ライブ素子の前記第１と第２グループＩＣは、いずれも
ヘッドの主走査方向中央側に配置されており、かつ前記
第１のグループを構成する複数個のＩＣと、第２のグル
ープを構成する複数個のＩＣとが対応する発熱素子に対
して、主走査方向中央よりに備え付けられている。この
駆動方法では、非接続部を、印字ヘッドの中央部のＩＣ
に設けるので、印字ヘッドの両端に、コネクタを設ける
ものにおいても、両端に、非接続部を設ける場合に比
し、ＩＣと印字素子間の接続パターンの幅が、小さくな
ることはない。
置の駆動方法は、請求項１に係る駆動方法において、さ
らに、前記印字素子に非接触な（ｍＮ−ｎ）／２個のド
ライブ素子の前記第１と第２グループＩＣは、いずれも
ヘッドの主走査方向中央側に配置されており、かつ前記
第１のグループを構成する複数個のＩＣと、第２のグル
ープを構成する複数個のＩＣとが対応する発熱素子に対
して、主走査方向中央よりに備え付けられている。この
駆動方法では、非接続部を、印字ヘッドの中央部のＩＣ
に設けるので、印字ヘッドの両端に、コネクタを設ける
ものにおいても、両端に、非接続部を設ける場合に比
し、ＩＣと印字素子間の接続パターンの幅が、小さくな
ることはない。
【００１２】
【実施例】以下、実施例により、この発明をさらに詳細
に説明する。図１は、この発明が実施例の前提となるサ
ーマルヘッド駆動回路の概略構成を示す回路図である。
このサーマルヘッド駆動回路は、１７２８個の発熱素子
（印字素子）１１-1、１１-2、…、１１-1728 と、８６
４個の記憶セルＤ1 、Ｄ2 、…、Ｄ864 がシリアルに接
続されてなる第１のシフトレジスタ１２と、８６４個の
記憶セルＤ864 、Ｄ865 、…、Ｄ1728がシリアルに接続
されてなる第２のシフトレジスタ１３と、各発熱素子１
１-1、１１-2、…、１１-1728 を個別にドライブするた
めのドライブ素子１４-1、１４-2、…、１４-1728 とか
ら構成されている。
に説明する。図１は、この発明が実施例の前提となるサ
ーマルヘッド駆動回路の概略構成を示す回路図である。
このサーマルヘッド駆動回路は、１７２８個の発熱素子
（印字素子）１１-1、１１-2、…、１１-1728 と、８６
４個の記憶セルＤ1 、Ｄ2 、…、Ｄ864 がシリアルに接
続されてなる第１のシフトレジスタ１２と、８６４個の
記憶セルＤ864 、Ｄ865 、…、Ｄ1728がシリアルに接続
されてなる第２のシフトレジスタ１３と、各発熱素子１
１-1、１１-2、…、１１-1728 を個別にドライブするた
めのドライブ素子１４-1、１４-2、…、１４-1728 とか
ら構成されている。
【００１３】このサーマルヘッド駆動回路は、Ａ４サイ
ズ用の駆動回路であり、第１と第２のシフトレジスタ１
２、１３及びドライブ素子１４-1、１４-2、…、１４
-1728は、１チップに９６ビットの記憶セルを持つシリ
アルシフトレジスタと９６ドット分のドライブ素子を内
蔵する１８個のＩＣが使用されている。そして、９個の
ＩＣのシフトレジスタが直列に接続されて、第１のシフ
トレジスタ１２が形成され、他の残りの９個のＩＣのシ
フトレジスタが直列に接続されて第２のシフトレジスタ
１３が形成されている。これら第１と第２のシフトレジ
スタ１２、１３の入力には、１系統の印字データＤＩが
同時に加えられている。しかし、第１のシフトレジスタ
１２にはクロックパルスＣＬＫ１が、第２のシフトレジ
スタ１３には、クロックパルスＣＬＫ２が、それぞれ、
独立して加えられるようになっている。ドライブ素子１
４-1、１４-2、…、１４-864には、ストローブ信号ＳＴ
Ｂ１（反転）が、またドライブ素子１４-865、１
４-866、…、１４-1728にはストローブ信号ＳＴＢ２
（反転）がそれぞれ、加えられるようになっている。
ズ用の駆動回路であり、第１と第２のシフトレジスタ１
２、１３及びドライブ素子１４-1、１４-2、…、１４
-1728は、１チップに９６ビットの記憶セルを持つシリ
アルシフトレジスタと９６ドット分のドライブ素子を内
蔵する１８個のＩＣが使用されている。そして、９個の
ＩＣのシフトレジスタが直列に接続されて、第１のシフ
トレジスタ１２が形成され、他の残りの９個のＩＣのシ
フトレジスタが直列に接続されて第２のシフトレジスタ
１３が形成されている。これら第１と第２のシフトレジ
スタ１２、１３の入力には、１系統の印字データＤＩが
同時に加えられている。しかし、第１のシフトレジスタ
１２にはクロックパルスＣＬＫ１が、第２のシフトレジ
スタ１３には、クロックパルスＣＬＫ２が、それぞれ、
独立して加えられるようになっている。ドライブ素子１
４-1、１４-2、…、１４-864には、ストローブ信号ＳＴ
Ｂ１（反転）が、またドライブ素子１４-865、１
４-866、…、１４-1728にはストローブ信号ＳＴＢ２
（反転）がそれぞれ、加えられるようになっている。
【００１４】このサーマルヘッド駆動回路において、印
字データＤＩの転送（入力）は、１７２８ドット分がシ
リアルに順次行われる。頭初は８６４発分のクロックパ
ルスＣＬＫ１が第１のシフトレジスタ１２に加えられ、
８６４ドット分の印字データが第１のシフトレジスタ１
２に記憶される。この記憶完了で、今度は８６４発のク
ロックパルスＣＬＫ２が第２のシフトレジスタ１３に加
えられ、残りの８６４ドット分の印字データが第２のシ
フトレジスタ１３に記憶される。
字データＤＩの転送（入力）は、１７２８ドット分がシ
リアルに順次行われる。頭初は８６４発分のクロックパ
ルスＣＬＫ１が第１のシフトレジスタ１２に加えられ、
８６４ドット分の印字データが第１のシフトレジスタ１
２に記憶される。この記憶完了で、今度は８６４発のク
ロックパルスＣＬＫ２が第２のシフトレジスタ１３に加
えられ、残りの８６４ドット分の印字データが第２のシ
フトレジスタ１３に記憶される。
【００１５】この第２のシフトレジスタ１３への印字デ
ータの転送中に、ストローブ信号ＳＴＢ１（反転）がオ
ンされ、ドライブ素子１４-1、…１４-864が動作し、第
１のシフトレジスタ１２に記憶されている印字データに
応じ、発熱素子１１-1、…、１１-864が印字動作を行
う。さらに、次のクロックパルスＣＬＫ１の印加で、第
１のシフトレジスタ１２に、次の８６４ドット分の印字
データが入力され、記憶される。このタイミングでは、
ストローブ信号ＳＴＢ２（反転）がオンされ、第２のシ
フトレジスタ１３に、記憶されている印字データに応
じ、発熱素子１１-865、…、１１-1728 が印字動作を行
う（図４参照）。
ータの転送中に、ストローブ信号ＳＴＢ１（反転）がオ
ンされ、ドライブ素子１４-1、…１４-864が動作し、第
１のシフトレジスタ１２に記憶されている印字データに
応じ、発熱素子１１-1、…、１１-864が印字動作を行
う。さらに、次のクロックパルスＣＬＫ１の印加で、第
１のシフトレジスタ１２に、次の８６４ドット分の印字
データが入力され、記憶される。このタイミングでは、
ストローブ信号ＳＴＢ２（反転）がオンされ、第２のシ
フトレジスタ１３に、記憶されている印字データに応
じ、発熱素子１１-865、…、１１-1728 が印字動作を行
う（図４参照）。
【００１６】図２は、この発明が実施されるサーマルヘ
ッド駆動回路の概略構成を示す回路図である。この実施
例は、Ｂ４サイズ用の駆動回路であり、２０４８個の発
熱素子２１-1、２１-2、…、２１-2048 と、１０５６個
の記憶セルＤ1 、Ｄ2 、…、Ｄ1056がシリアルに接続さ
れてなる第１のシフトレジスタ２２と、１０５６個の記
憶セルＤ1057、Ｄ1058、…Ｄ2112がシリアルに接続され
てなる第２のシフトレジスタ２３と、発熱素子をドライ
ブするためのドライブ素子２４-1、２４-2、…、２４
-2112 とから構成されている。
ッド駆動回路の概略構成を示す回路図である。この実施
例は、Ｂ４サイズ用の駆動回路であり、２０４８個の発
熱素子２１-1、２１-2、…、２１-2048 と、１０５６個
の記憶セルＤ1 、Ｄ2 、…、Ｄ1056がシリアルに接続さ
れてなる第１のシフトレジスタ２２と、１０５６個の記
憶セルＤ1057、Ｄ1058、…Ｄ2112がシリアルに接続され
てなる第２のシフトレジスタ２３と、発熱素子をドライ
ブするためのドライブ素子２４-1、２４-2、…、２４
-2112 とから構成されている。
【００１７】この実施例回路では、第１と第２のシフト
レジスタ２２、２３及びドライブ素子２４-1、２４-2、
…、２４-2112 は、１チップ９６ドット分の記憶セルを
持つシフトレジスタと、９６ドット分のドライブ素子を
内蔵する２２個のＩＣが使用されている。もっとも、Ｂ
４サイズは、２０４８ドットであり、これをドライブす
るために９６ドットのＩＣを２２個使用すると、２１１
２−２０４８＝６４ドット分の余りができる。これを、
従来のように、一方のストローブ信号オン時に１１個の
ＩＣは全ピン使用で１０５６ドット、他方のストローブ
信号オン時に、１１個のＩＣのうち、１個の６４ピンを
ノンコンタクトで、９９２ドットとすると、アンバラン
スとなり、濃度印字むらを生じる原因となる。
レジスタ２２、２３及びドライブ素子２４-1、２４-2、
…、２４-2112 は、１チップ９６ドット分の記憶セルを
持つシフトレジスタと、９６ドット分のドライブ素子を
内蔵する２２個のＩＣが使用されている。もっとも、Ｂ
４サイズは、２０４８ドットであり、これをドライブす
るために９６ドットのＩＣを２２個使用すると、２１１
２−２０４８＝６４ドット分の余りができる。これを、
従来のように、一方のストローブ信号オン時に１１個の
ＩＣは全ピン使用で１０５６ドット、他方のストローブ
信号オン時に、１１個のＩＣのうち、１個の６４ピンを
ノンコンタクトで、９９２ドットとすると、アンバラン
スとなり、濃度印字むらを生じる原因となる。
【００１８】それゆえ、この実施例では、第１のシフト
レジスタ２２等を構成する１１個のＩＣのうち、最入力
側の１個のＩＣの、入力側３２ドット分のドライブ素子
１４-1025 、…、１４-1056 と、第２のシフトレジスタ
２３等を構成する１１個のＩＣのうち、最出力側の１個
のＩＣの出力側３２ドット分のドライブ素子１
４-1057 、…、１４-1088 とを、発熱素子に非接続、つ
まりオープンとしている。
レジスタ２２等を構成する１１個のＩＣのうち、最入力
側の１個のＩＣの、入力側３２ドット分のドライブ素子
１４-1025 、…、１４-1056 と、第２のシフトレジスタ
２３等を構成する１１個のＩＣのうち、最出力側の１個
のＩＣの出力側３２ドット分のドライブ素子１
４-1057 、…、１４-1088 とを、発熱素子に非接続、つ
まりオープンとしている。
【００１９】この実施例駆動回路において、印字データ
ＤＩの転送は、２１１２ビット分が順次行われる。最初
の１０２４ビットが真の印字データ、次に３２ビット＋
３２ビットのダミーデータ、最後に１０２４ビットの真
の印字データとなる。頭初は、１０５６発分のクロック
パルスＣＬＫ１で、第１のシフトレジスタ２２に印字デ
ータと３２ビットのダミーデータが記憶される。次にク
ロックパルスの切替で、１０５６発分のクロックパルス
ＣＬＫ２の印加で、第２のシフトレジスタ２３に３２ビ
ットのダミーデータと印字データが記憶される。
ＤＩの転送は、２１１２ビット分が順次行われる。最初
の１０２４ビットが真の印字データ、次に３２ビット＋
３２ビットのダミーデータ、最後に１０２４ビットの真
の印字データとなる。頭初は、１０５６発分のクロック
パルスＣＬＫ１で、第１のシフトレジスタ２２に印字デ
ータと３２ビットのダミーデータが記憶される。次にク
ロックパルスの切替で、１０５６発分のクロックパルス
ＣＬＫ２の印加で、第２のシフトレジスタ２３に３２ビ
ットのダミーデータと印字データが記憶される。
【００２０】この第２のシフトレジスタ２３へのデータ
の転送中に、ストローブ信号ＳＴＢ１（反転）がオンさ
れ、発熱素子２１-1、…、２１-1024 が接続されたドラ
イブ素子２４-1、…、２４-1024 が動作し、第１のシフ
トレジスタ２２に記憶されている印字データに応じ、発
熱素子２１-1、…、２１-1024 が印字動作を行う。この
実施例によれば、発熱素子への非接続、つまりオープン
のドライブ素子をそれぞれ分割印字する際に、それぞれ
分割して割当てているので、印字むらが生じない。ま
た、第１のシフトレジスタへの印字データ記憶から第２
のシフトレジスタへの印字データ記憶を、データ分割し
て行うために、クロックパルスを切替えているが、分割
境界線に、３２ドット＋３２ドットの空白部を設けてい
るので、切替に必要な時間を得ることができる。
の転送中に、ストローブ信号ＳＴＢ１（反転）がオンさ
れ、発熱素子２１-1、…、２１-1024 が接続されたドラ
イブ素子２４-1、…、２４-1024 が動作し、第１のシフ
トレジスタ２２に記憶されている印字データに応じ、発
熱素子２１-1、…、２１-1024 が印字動作を行う。この
実施例によれば、発熱素子への非接続、つまりオープン
のドライブ素子をそれぞれ分割印字する際に、それぞれ
分割して割当てているので、印字むらが生じない。ま
た、第１のシフトレジスタへの印字データ記憶から第２
のシフトレジスタへの印字データ記憶を、データ分割し
て行うために、クロックパルスを切替えているが、分割
境界線に、３２ドット＋３２ドットの空白部を設けてい
るので、切替に必要な時間を得ることができる。
【００２１】また、一般に、図３に示すように、両端に
ピンコネクタ３１を設けるタイプのサーマルヘッド３２
において、発熱素子（列）３３とＩＣ３４間を接続する
接続パターン３５と、ＩＣ３４となす角度θが、接続パ
ターン３５の各個別ラインの幅に大きく影響する。各個
別ライン幅は、大きい程好ましい。しかしながら、ノン
コンタクト部を図３のａのように、端部のＩＣ３４に設
けると、角度θがより、小さくなり、接続パターン３５
の各ラインの幅が小さくなる。これに代え、この実施例
の駆動回路を適用すると、図３のｂのように、中央部の
ＩＣ３４にノンコンタクト部を設けるので、角度θを大
きく取ることができ、その分、各ライン幅の大きいもの
を得ることができる。
ピンコネクタ３１を設けるタイプのサーマルヘッド３２
において、発熱素子（列）３３とＩＣ３４間を接続する
接続パターン３５と、ＩＣ３４となす角度θが、接続パ
ターン３５の各個別ラインの幅に大きく影響する。各個
別ライン幅は、大きい程好ましい。しかしながら、ノン
コンタクト部を図３のａのように、端部のＩＣ３４に設
けると、角度θがより、小さくなり、接続パターン３５
の各ラインの幅が小さくなる。これに代え、この実施例
の駆動回路を適用すると、図３のｂのように、中央部の
ＩＣ３４にノンコンタクト部を設けるので、角度θを大
きく取ることができ、その分、各ライン幅の大きいもの
を得ることができる。
【００２２】
【発明の効果】請求項１記載の発明によれば、印字素子
のドット数ｎと、ｍ個のＩＣによる接続可能なドット数
ｍＮ（Ｎ：１個のＩＣの駆動可能ドット数）が一致しな
い場合に、２グループに分けて第１と第２のシフトレジ
スタを形成するＩＣ群のうち、各グループのそれぞれに
１個ずつ非接続部を持つＩＣを割当てるので、両グルー
プのストローブ信号オン時のドライブ電流に大きな差が
出ず、印字濃度むらが起こりにくい。
のドット数ｎと、ｍ個のＩＣによる接続可能なドット数
ｍＮ（Ｎ：１個のＩＣの駆動可能ドット数）が一致しな
い場合に、２グループに分けて第１と第２のシフトレジ
スタを形成するＩＣ群のうち、各グループのそれぞれに
１個ずつ非接続部を持つＩＣを割当てるので、両グルー
プのストローブ信号オン時のドライブ電流に大きな差が
出ず、印字濃度むらが起こりにくい。
【００２３】また、請求項２記載の発明によれば、ヘッ
ド基板の中央部分に非接続部がくるようにしているの
で、分割境界線に印字空白部を設けることとなり、切り
替えに必要な時間を得ることができる。また、印字素子
とＩＣ間の各接続パターンの幅を広く保つことができ
る。
ド基板の中央部分に非接続部がくるようにしているの
で、分割境界線に印字空白部を設けることとなり、切り
替えに必要な時間を得ることができる。また、印字素子
とＩＣ間の各接続パターンの幅を広く保つことができ
る。
【図１】この発明の実施例の前提となるサーマルヘッド
駆動回路の概略構成を示す回路図である。
駆動回路の概略構成を示す回路図である。
【図２】この発明が実施されるサーマルヘッド駆動回路
の概略構成を示す回路図である。
の概略構成を示す回路図である。
【図３】同サーマルヘッド駆動回路のＩＣの非接続部の
位置を説明する図である。
位置を説明する図である。
【図４】図１のサーマルヘッド駆動回路の動作を説明す
るためのタイムチャートである。
るためのタイムチャートである。
【図５】従来のラッチレス制御のサーマルヘッド駆動回
路側の概略構成を示す回路図である。
路側の概略構成を示す回路図である。
【図６】従来のラッチレス制御の他のサーマルヘッド駆
動回路側を示す回路図である。
動回路側を示す回路図である。
【図７】従来のサーマルヘッド駆動回路の動作を説明す
るためのタイムチャートである。
るためのタイムチャートである。
１１-1、…、１１-1728 発熱素子 １２ 第１のシフトレジスタ １３ 第２のシフトレジスタ １４-1、…、１４-1728 ドライブ素子 ＤＩ 印字データ ＣＬＫ１、ＣＬＫ２ クロックパルス
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) B41J 2/35 - 2/37 B41J 2/45
Claims (2)
- 【請求項１】ｎ個の印字素子と、クロックパルスによっ
てシフトされ、ビットシリアルな印字データを記憶する
少なくともｎ個の記憶セルを有するシフトレジスタと、
このシフトレジスタに記憶される印字データに応じて、
前記印字素子を駆動する少なくともｎ個のドライブ素子
とを備え、かつ前記シフトレジスタ及びドライブ素子
が、それぞれにＮ個の記憶セルからなるシフトレジスタ
及びＮ個のドライブ素子からなるｍ個（ただしｍは偶
数）のＩＣが使用されて構成され、（ｍ−１）Ｎ＜ｎ＜
ｍＮの関係にある印字素子駆動装置において、 前記ＩＣはｍ／２個ずつの２グループに分け、各グルー
プのｍ／２個のシフトレジスタはシリアルに接続して第
１と第２のシフトレジスタを形成し、前記第１と第２のグループのｍ／２個のＩＣのうち、そ
れぞれ１個のＩＣの（ｍＮ−ｎ）／２のドライブ素子を
印字素子に非接続とし、 かつ前記第１と第２のシフトレ
ジスタには、前記非接続のドライブ素子に対応する記憶
セルにストアされるデータを含むビットシリアルな印字
データを同時に入力するとともに、クロックパルスを選
択的に入力可能に構成し、第１の段階でクロックパルス
を第１のシフトレジスタに与えて、第１のシフトレジス
タにｎ／２ビットの印字データと（ｍＮ−ｎ）／２ビッ
トのダミーデータを記憶し、次の第２の段階でクロック
パルスを第２のシフトレジスタに与えて第２のシフトレ
ジスタに（ｍＮ−ｎ）／２ビットのダミーデータとｎ／
２ビットの印字データを記憶するようにしたことを特徴
とする印字素子駆動装置の駆動方法。 - 【請求項２】前記印字素子に非接続な（ｍＮ−ｎ）／２
個のドライブ素子の前記第１と第２グループＩＣは、い
ずれもヘッドの主走査方向中央側に配置されており、か
つ前記第１のグループを構成する複数個のＩＣと、第２
のグループを構成する複数個のＩＣとが対応する発熱素
子に対して、主走査方向中央よりに備え付けられている
ことを特徴とする請求項１記載の印字素子駆動装置の駆
動方法。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20484192A JP3091324B2 (ja) | 1992-07-31 | 1992-07-31 | 印字素子駆動装置の駆動方法 |
| US08/086,501 US5488403A (en) | 1992-07-31 | 1993-07-01 | Printing element drive device having separately operating shift registers |
| TW082105507A TW219414B (en) | 1992-07-31 | 1993-07-10 | Printing element drive device having separately operating shift registers |
| DE4324313A DE4324313A1 (de) | 1992-07-31 | 1993-07-20 | Druckelement-Ansteuereinrichtung |
| FR9309430A FR2694234B1 (fr) | 1992-07-31 | 1993-07-30 | Dispositif d'attaque d'elements d'impression equipe de registres a decalage fonctionnant separement. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20484192A JP3091324B2 (ja) | 1992-07-31 | 1992-07-31 | 印字素子駆動装置の駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0647947A JPH0647947A (ja) | 1994-02-22 |
| JP3091324B2 true JP3091324B2 (ja) | 2000-09-25 |
Family
ID=16497282
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20484192A Expired - Fee Related JP3091324B2 (ja) | 1992-07-31 | 1992-07-31 | 印字素子駆動装置の駆動方法 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5488403A (ja) |
| JP (1) | JP3091324B2 (ja) |
| DE (1) | DE4324313A1 (ja) |
| FR (1) | FR2694234B1 (ja) |
| TW (1) | TW219414B (ja) |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AU567487B2 (en) * | 1982-01-25 | 1987-11-26 | Sony Corporation | Thermal printer |
| JPS5910073A (ja) * | 1982-07-09 | 1984-01-19 | Canon Inc | 記録装置 |
| JPS5964965A (ja) * | 1982-10-05 | 1984-04-13 | Sanyo Electric Co Ltd | サ−マルヘツド駆動方法 |
| US4689694A (en) * | 1983-01-12 | 1987-08-25 | Canon Kabushiki Kaisha | Image recording apparatus utilizing linearly arranged recording elements |
| JPS6072756A (ja) * | 1983-09-30 | 1985-04-24 | Ishida Scales Mfg Co Ltd | 発熱ヘツドの制御回路 |
| EP0228708B1 (en) * | 1985-12-27 | 1991-11-06 | Kanzaki Paper Manufacturing Company Limited | Thermal printer for printing regular and irregular characters and method for printing therewith |
-
1992
- 1992-07-31 JP JP20484192A patent/JP3091324B2/ja not_active Expired - Fee Related
-
1993
- 1993-07-01 US US08/086,501 patent/US5488403A/en not_active Expired - Lifetime
- 1993-07-10 TW TW082105507A patent/TW219414B/zh active
- 1993-07-20 DE DE4324313A patent/DE4324313A1/de not_active Ceased
- 1993-07-30 FR FR9309430A patent/FR2694234B1/fr not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US5488403A (en) | 1996-01-30 |
| FR2694234A1 (fr) | 1994-02-04 |
| FR2694234B1 (fr) | 1995-12-22 |
| DE4324313A1 (de) | 1994-02-10 |
| JPH0647947A (ja) | 1994-02-22 |
| TW219414B (en) | 1994-01-21 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |