JP3015388B2 - 電源用モノリシック集積回路 - Google Patents

電源用モノリシック集積回路

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Description

【発明の詳細な説明】 ［発明の目的］ （産業上の利用分野） 本発明は、マイクロコンピュータにより制御される電
子機器で用いられる電源用モノリシック集積回路に係
り、特にマイクロコンピュータからの信号をデコードし
て複数の電源を選択制御するシステム電源に関する。
（従来の技術） 従来、例えばオーディオセットでは、その内部に多数
の独立した部分、例えばチューナ部、アンプ部等を持
ち、それぞれに対して独立した電源回路を設けている。
一方、近年、マイクロコンピュータの使用が一般化
し、マイクロコンピュータによる電子機器のシステム制
御が一般化してきている。そして、第３図に示す電源用
モノリシック集積回路（システム電源用モノリシック集
積回路）30のように、マイクロコンピュータ31の出力信
号をデコードするデコーダ32と、このデコーダ32により
選択制御される複数の安定化電源回路33a、33b、…33n
を１チップ化したシステム電源が普及し始めており、こ
のシステム電源30をオーディオセットに使用することが
考えられている。
ここで、電源回路33a、33b、…33nのうち１個の電源
回路33aがマイクロコンピュータ31の電源として用いら
れており、システム電源30に過電圧サージが印加された
時とか、デコーダ部32および電源回路33a、33b、…33n
のいずれかに異常が発生した時を検知してシステム電源
全体のバイアスをカットオフする（つまり、デコーダ32
および電源回路33a、33b、…33nをそれぞれオフ状態に
制御する）ための保護回路（電流リミッタ等）34も内蔵
されている。
上記システム電源30においては、過電圧サージが印加
された時に保護回路34が検知してシステム電源全体のバ
イアスをカットオフすることにより、マイクロコンピュ
ータ31により制御される電子機器（図示せず）を保護す
ることが可能になっている。また、電源回路33a、33b、
…33nの一部が出力短絡を起こした時にも、これを保護
回路34が検知してシステム電源全体のバイアスをカット
オフすることにより、他の部分に損傷を与えずに済むよ
うになる。
しかし、上記したような従来のシステム電源30は保護
回路34の制御動作に際して、マイクロコンピュータ用電
源回路33aもオフ状態に制御してしまうので、マイクロ
コンピュータ31の動作が停止してしまい、電子機器の全
体の動作が異常となってしまい、異常事態が解放された
後にシステム全体の電源を一度リセットして正常な動作
状態に戻すためにはマイクロコンピュータ31を一度リセ
ットする等の必要があった。
（発明が解決しようとする課題） 上記したように従来の電源用モノリシック集積回路
は、保護回路の制御動作に際して、マイクロコンピュー
タ用電源もオフ状態に制御してしまうので、このマイク
ロコンピュータにより制御される電子機器の全体の動作
が異常となってしまうという問題がある。
本発明は、上記問題点を解決すべくなされたもので、
その目的は、保護回路がマイクロコンピュータ用電源以
外の回路部分の異常を検知した時の制御動作に際して、
マイクロコンピュータが動作し続けることが可能にな
り、このマイクロコンピュータにより制御される電気機
器の一部の動作を継続することが可能になる電源用モノ
リシック集積回路を提供することにある。
［発明の構成］ （課題を解決するための手段） 本発明の電源用モノリシック集積回路は、マイクロコ
ンピュータ用電源と、外部のマイクロコンピュータから
の信号をデコードするデコーダと、このデコーダの出力
により選択制御される複数の電源と、この複数の電源の
いずれかに異常が発生したことを検知し、この複数の電
源をオフ状態に制御する第１の保護回路とを内蔵するこ
とを特徴とする。
（作 用） 第１の保護回路がマイクロコンピュータ用電源以外の
回路部分の異常を検知した時の制御動作に際して、マイ
クロコンピュータ用電源は第１の保護回路の制御から独
立しているのでマイクロコンピュータに電力を供給し続
けることが可能になり、マイクロコンピュータが動作し
続ける。従って、このマイクロコンピュータにより制御
される電子機器は、第１の保護回路によりオフ制御され
た電源に接続されている部分以外の動作を継続すること
が可能になる。
（実施例） 以下、図面を参照して本発明の一実施例を詳細に説明
する。
第１図は、オーディオセットで使用されるシステム電
源（電源用モノリシック集積回路）10を示しており、第
３図を参照して前述した従来のシステム電源30と比べ
て、（ａ）マイクロコンピュータ用の電源回路33aはデ
コーダ32の制御から独立しており、その他の電源回路33
b、…33nはデコーダ32の出力により選択制御されている
点、（ｂ）保護回路（第１の保護回路）11は、システム
電源10に過電圧サージが印加された時とか、デコーダ32
およびマイクロコンピュータ用電源以外の電源回路33
b、…33nに異常（例えば出力短絡）が発生した時を検知
してこれらをオフ状態に制御する点が異なり、その他は
第３図中と同じであるので、第３図中と同一符号を付し
ている。なお、マイクロコンピュータ用電源以外の電源
回路33b、…33nは、例えばチューナ部、アンプ部等に各
対応して供給される。
上記システム電源10においては、例えば過電圧サージ
が印加された時に、これを第１の保護回路11が検知して
デコーダ32およびマイクロコンピュータ用電源以外の電
源回路33b、…33nをオフ制御するので、オフ制御された
電源回路33b、…33nに接続されているセット部分が保護
されるようになる。また、マイクロコンピュータ用電源
以外の電源回路33b、…33nの一部が出力短絡を起こした
時にも、これを第１の保護回路11が検知し、電源回路33
b、…33nをオフ制御することにより、他の電源回路を与
えずに済む。
このような第１の保護回路11による制御動作に際し
て、マイクロコンピュータ用の電源回路33aは第１の保
護回路11の制御から独立しているので、マイクロコンピ
ュータ31に電力を供給し続けることが可能になり、マイ
クロコンピュータ31が動作し続ける。
従って、このマイクロコンピュータ31により制御され
るオーディオセットは、上記第１の保護回路11によりオ
フ制御された電源回路に接続されている部分以外の動作
を継続することが可能になる。換言すれば、オーディオ
セットの全体の動作が異常となっなり停止したりするこ
とはなく、あるいは、異常事態が解放された後にシステ
ム全体の電源を一度リセットして正常な動作状態に戻す
ためにマイクロコンピュータを一度リセットする等の必
要はなくなる。
なお、マイクロコンピュータ31から出力信号は、図示
のパラレルデータに限らず、シリアルデータ、その他の
信号でもよい。
ところで、上記実施例のシステム電源10では、第１の
保護回路11による制御動作に際してオーディオセットの
全体の動作が異常となったり停止したりすることを防止
しているが、マイクロコンピュータ用の電源回路33aに
異常が発生した時にマイクロコンピュータ31が異常動作
を起こす（暴走する）と、このマイクロコンピュータ31
により誤って制御されるオーディオセットの全体の動作
が異常となるおそれがある。
このような問題点に解決した本発明の他の実施例に係
るシステム電源20を第２図に示している。このシステム
電源20は、前記実施例のシステム電源10と比べて、マイ
クロコンピュータ用の電源回路33aに異常が発生した時
を検知してすべての電源回路電源33a、33b、…33nおよ
びデコーダ32をオフ状態に制御する第２の保護回路（電
流リミッタ等）21が付加されている点が異なり、その他
は第１図中と同じであるので、第１図中と同一符号を付
している。
上記システム電源20においては、前記実施例と同様の
効果が得られるばかりでなく、第２の保護回路21がマイ
クロコンピュータ用の電源回路33aに異常が発生した時
を検知すると、すべての電源回路33a、33b、…33nおよ
びデコーダ32をオフ状態に制御するので、オーディオセ
ットのチューナ部、アンプ部等に電源が供給されなくな
ると共にマイクロコンピュータ31にも電源が供給されな
くなるので、マイクロコンピュータ31が異常動作を起こ
すこともなく、オーディオセットの全体の動作が異常と
なることはない。
［発明の効果］ 上述したように本発明の電源用モノリシック集積回路
によれば、第１の保護回路がマイクロコンピュータ用電
源以外の回路部分の異常を検知した時の制御動作に際し
て、マイクロコンピュータが動作し続けることが可能に
なり、このマイクロコンピュータにより制御される電子
機器が一部の動作を継続することが可能になる。
また、本発明の電源用モノリシック集積回路によれ
ば、第２の保護回路がマイクロコンピュータ用電源に異
常が発生した時を検知すると、すべての電源をオフ状態
に制御するので、電子機器の各部に電源が供給されなく
なると共にマイクロコンピュータにも電源が供給されな
くなるので、マイクロコンピュータが異常動作を起こす
こともなく、電気機器の全体の動作が異常となることは
ない。
【図面の簡単な説明】
第１図は本発明の電源用モノリシック集積回路の一実施
例を示すブロック図、第２図は本発明の他の実施例を示
すブロック図、第３図は従来の電源用モノリシック集積
回路を示すブロック図である。 10、20……システム電源（電源用モノリシック集積回
路）、11……第１の保護回路、21……第２の保護回路、
31……マイクロコンピュータ、32……デコーダ、33a,33
b,…33n……電源回路。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ Ｈ０２Ｈ 7/20 Ｇ０６Ｆ 1/00 ３４１Ｑ

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項１】マイクロコンピュータからの信号をデコー
    ドするデコーダと、前記マイクロコンピュータのための
    第１の電源と、前記デコーダの出力により選択制御さ
    れ、前記マイクロコンピュータ以外の電子機器のための
    複数の第２の電源と、前記複数の第２の電源のいずれか
    に異常が発生したことを検知すると、前記複数の第２の
    電源の全てをオフ状態に制御する第１の保護回路とをモ
    ノリシックに内蔵したことを特徴とする電源用モノリシ
    ック集積回路。
  2. 【請求項２】前記電子機器が前記マイクロコンピュータ
    により制御される場合に、前記第１の電源に異常が発生
    したことを検知すると、前記第１の電源及び前記複数の
    第２の電源の全てをオフ状態に制御する第２の保護回路
    を、前記モノリシックにさらに内蔵したことを特徴とす
    る請求項１記載の電源用モノリシック集積回路。
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