JP2537394B2 - シリアル・ドット・プリンタの印字制御方式 - Google Patents
シリアル・ドット・プリンタの印字制御方式Info
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- JP2537394B2 JP2537394B2 JP1039040A JP3904089A JP2537394B2 JP 2537394 B2 JP2537394 B2 JP 2537394B2 JP 1039040 A JP1039040 A JP 1039040A JP 3904089 A JP3904089 A JP 3904089A JP 2537394 B2 JP2537394 B2 JP 2537394B2
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Description
【発明の詳細な説明】 〔概要〕 シリアル・ドット・プリンタの印字制御方式に関し、 印字処理のためのマイクロプログラムを簡単化できる
ようにすることを目的とし、 通常データと通常データのMSB/LSB反転データとが入
力される入力セレクタと、入力セレクタの出力が印加さ
れるＱ個のラッチと、Ｑ個のグループに分けられた白黒
データ線と、Ｑ個のラッチの出力が入力される出力セレ
クタ装置と入力セレクタおよび出力セレクタに対して制
御信号を出力する制御レジスタとを具備し、入力セレク
タは、制御信号が所定値のときは通常データを出力し、
制御信号が他の所定値のときは上記反転データを出力
し、出力セレクタ装置は、制御信号が所定値のときはｉ
番目のラッチのデータをｉ番目の白黒データ線グループ
上に出力し、制御信号が他の所定値のときはｉ番目のラ
ッチのデータをＱ−ｉ−１番目の白黒データ線グループ
上に出力する。
ようにすることを目的とし、 通常データと通常データのMSB/LSB反転データとが入
力される入力セレクタと、入力セレクタの出力が印加さ
れるＱ個のラッチと、Ｑ個のグループに分けられた白黒
データ線と、Ｑ個のラッチの出力が入力される出力セレ
クタ装置と入力セレクタおよび出力セレクタに対して制
御信号を出力する制御レジスタとを具備し、入力セレク
タは、制御信号が所定値のときは通常データを出力し、
制御信号が他の所定値のときは上記反転データを出力
し、出力セレクタ装置は、制御信号が所定値のときはｉ
番目のラッチのデータをｉ番目の白黒データ線グループ
上に出力し、制御信号が他の所定値のときはｉ番目のラ
ッチのデータをＱ−ｉ−１番目の白黒データ線グループ
上に出力する。
本発明は、用紙を通常方向に送りながら正方向印字及
び逆方向印字を行い得ると共に、用紙を反対方向に送り
ながら正方向印字及び逆方向印字を行い得るようになっ
たシリアル・ドット・プリンタ、特にこの種のプリンタ
における印字制御方式に関するものである。
び逆方向印字を行い得ると共に、用紙を反対方向に送り
ながら正方向印字及び逆方向印字を行い得るようになっ
たシリアル・ドット・プリンタ、特にこの種のプリンタ
における印字制御方式に関するものである。
第７図はシリアル・ドット・プリンタの用紙送り方向
と印字方向を説明する図である。第７図（ａ）において
は用紙は左から右に送りながら印字を行っている。図示
しないが、用紙を右から左へ送りながら印字を行うこと
も出来る。左から右への用紙送りを通常方向の用紙送
り、右から左への用紙送りを反転方向の用紙送りと言
う。
と印字方向を説明する図である。第７図（ａ）において
は用紙は左から右に送りながら印字を行っている。図示
しないが、用紙を右から左へ送りながら印字を行うこと
も出来る。左から右への用紙送りを通常方向の用紙送
り、右から左への用紙送りを反転方向の用紙送りと言
う。
第７図（ｂ）においては、用紙が下から上に送られ、
印字ヘッドが左から右に移動しながら印字が行われてい
る。用紙送り方向を基準にして、印字ヘッドを左から右
に移動しながら行う印字を正方向印字と呼び、印字ヘッ
ドを右から左に移動しながら行う印字を逆方向印字と呼
ぶ。
印字ヘッドが左から右に移動しながら印字が行われてい
る。用紙送り方向を基準にして、印字ヘッドを左から右
に移動しながら行う印字を正方向印字と呼び、印字ヘッ
ドを右から左に移動しながら行う印字を逆方向印字と呼
ぶ。
第６図は従来の印字制御を説明する図である。同図に
おいて、６−Ａないし６−Ｃは１バイトのラッチを示
す。なお、下記の説明においては、１文字が24×24ドッ
トであると仮定する。
おいて、６−Ａないし６−Ｃは１バイトのラッチを示
す。なお、下記の説明においては、１文字が24×24ドッ
トであると仮定する。
通常印字方向（用紙送りが通常方向で正方向印字）の
場合には、CGから読み出された最初の（０番目の）デー
タDnはライン・バッファのアドレスｎにセットされ、１
番目のデータDn+1はライン・バッファのアドレスｎ＋１
にセットされ、２番目のデータDn+2はライン・バッファ
のアドレスｎ＋２にセットされ、CGから読み出された最
後から２番目のデータDm-2はライン・バッファのアドレ
スｍ−２にセットされ、最後から１番目のデータDm-1は
ライン・バッファのアドレスｍ−１にセットされ、最後
のデータDmはライン・バッファのアドレスｍにセットさ
れる。なお、CGからの読出し単位は１バイトである。
場合には、CGから読み出された最初の（０番目の）デー
タDnはライン・バッファのアドレスｎにセットされ、１
番目のデータDn+1はライン・バッファのアドレスｎ＋１
にセットされ、２番目のデータDn+2はライン・バッファ
のアドレスｎ＋２にセットされ、CGから読み出された最
後から２番目のデータDm-2はライン・バッファのアドレ
スｍ−２にセットされ、最後から１番目のデータDm-1は
ライン・バッファのアドレスｍ−１にセットされ、最後
のデータDmはライン・バッファのアドレスｍにセットさ
れる。なお、CGからの読出し単位は１バイトである。
この場合の白黒データの送出は、下記のようにして行
われる。左から右に印字ヘッドが移動するときに最初の
ドット・パルスに同期して、ライン・バッファのアドレ
スｎのデータがラッチ６−Ａにセットされ、アドレスｎ
＋１のデータがラッチ６−Ｂにセットされ、アドレスｎ
＋２のデータがラッチ６−Ｃにセットされる。次のドッ
ト・パルスに同期して、ライン・バッファのアドレスｎ
＋３のデータ，アドレスｎ＋４のデータ，アドレスｎ＋
５のデータがラッチ６−A,6−B,6−Ｃにセットされる。
以下、同様な動作が繰り返される。
われる。左から右に印字ヘッドが移動するときに最初の
ドット・パルスに同期して、ライン・バッファのアドレ
スｎのデータがラッチ６−Ａにセットされ、アドレスｎ
＋１のデータがラッチ６−Ｂにセットされ、アドレスｎ
＋２のデータがラッチ６−Ｃにセットされる。次のドッ
ト・パルスに同期して、ライン・バッファのアドレスｎ
＋３のデータ，アドレスｎ＋４のデータ，アドレスｎ＋
５のデータがラッチ６−A,6−B,6−Ｃにセットされる。
以下、同様な動作が繰り返される。
反対方向印字（用紙送り方向が反対方向で正方向印
字）の場合には、データのライン・バッファへのセット
の方法には、次の２通りがある。
字）の場合には、データのライン・バッファへのセット
の方法には、次の２通りがある。
第１の方法（の方法）は、CGから出力されたデータ
をMSB/LSB反転処理部に入力し、この反転処理部から出
力されるデータの列Dn,Dn+1,Dn+2,…,Dm-2,Dm-1,Dmをラ
イン・バッファのアドレスm,m−1,m−2,…,n＋2,n＋1,n
にセットする方法である。なお、MSB/LSB反転処理部と
は、データが１バイトの場合には、入力データの27の重
みを持つビットの値を出力データの20の重みを持つビッ
トの値とし、入力データの26の重みを持つビットの値を
出力データの21の重みを持つビットの値とし、入力デー
タの2iの重みを持つビットの値を出力データの27-iの重
みを持つビットの値とすることを意味している。
をMSB/LSB反転処理部に入力し、この反転処理部から出
力されるデータの列Dn,Dn+1,Dn+2,…,Dm-2,Dm-1,Dmをラ
イン・バッファのアドレスm,m−1,m−2,…,n＋2,n＋1,n
にセットする方法である。なお、MSB/LSB反転処理部と
は、データが１バイトの場合には、入力データの27の重
みを持つビットの値を出力データの20の重みを持つビッ
トの値とし、入力データの26の重みを持つビットの値を
出力データの21の重みを持つビットの値とし、入力デー
タの2iの重みを持つビットの値を出力データの27-iの重
みを持つビットの値とすることを意味している。
を採用した場合における印字ヘッドへの白黒データ
の送出は下記のようにして行われる。用紙送り方向を基
準として左から右に印字ヘットが移動するときの最初の
ドット・パルスに同期して、ライン・バッファのアドレ
スｍのデータがラッチ６−Ｃにセットされ、アドレスｍ
−１のデータがラッチ６−Ｂにセットされ、アドレスｍ
−２のデータがラッチ６−Ａにセットされる。次のドッ
ト・パルスに同期して、ライン・バッファのアドレスｍ
−３のデータ，アドレスｍ−４のデータ，アドレスｍ−
５のデータがラッチ６−C,6−B,6−Ａにセットされる。
以下、同様な動作が繰り返される。
の送出は下記のようにして行われる。用紙送り方向を基
準として左から右に印字ヘットが移動するときの最初の
ドット・パルスに同期して、ライン・バッファのアドレ
スｍのデータがラッチ６−Ｃにセットされ、アドレスｍ
−１のデータがラッチ６−Ｂにセットされ、アドレスｍ
−２のデータがラッチ６−Ａにセットされる。次のドッ
ト・パルスに同期して、ライン・バッファのアドレスｍ
−３のデータ，アドレスｍ−４のデータ，アドレスｍ−
５のデータがラッチ６−C,6−B,6−Ａにセットされる。
以下、同様な動作が繰り返される。
第２の方法（の方法）は、CGから出力されたデータ
をMSB/LSB反転処理部に入力し、この反転処理部から出
力されるデータの列Dn,Dn+1,Dn+2,…,Dm-2,Dm-1,Dmをラ
イン・バッファのアドレスｎ＋2,n＋1,n,…m,m−1,m−
２にセットする方法である。
をMSB/LSB反転処理部に入力し、この反転処理部から出
力されるデータの列Dn,Dn+1,Dn+2,…,Dm-2,Dm-1,Dmをラ
イン・バッファのアドレスｎ＋2,n＋1,n,…m,m−1,m−
２にセットする方法である。
を採用した場合における印字ヘッドへの白黒データ
の送出は下記のようにして行われる。用紙送り方向を基
準として左から右へ印字ヘッドが移動するときの最初の
ドット・パルスに同期してライン・バッファのアドレス
ｎ＋２のデータがラッチ６−Ｃにセットされ、アドレス
ｎ＋１のデータがラッチ６−Ｂにセットされ、アドレス
ｎのデータがラッチ６−Ａにセットされる。次のドット
・パルスに同期して、ライン・バッファのアドレスｎ＋
５のデータがラッチ６−Ｃにセットされ、アドレスｎ＋
４のデータがラッチ６−Ｂにセットされ、アドレスｎ＋
３のデータがラッチ６−Ａにセットされる。以下、同様
な動作が繰り返される。
の送出は下記のようにして行われる。用紙送り方向を基
準として左から右へ印字ヘッドが移動するときの最初の
ドット・パルスに同期してライン・バッファのアドレス
ｎ＋２のデータがラッチ６−Ｃにセットされ、アドレス
ｎ＋１のデータがラッチ６−Ｂにセットされ、アドレス
ｎのデータがラッチ６−Ａにセットされる。次のドット
・パルスに同期して、ライン・バッファのアドレスｎ＋
５のデータがラッチ６−Ｃにセットされ、アドレスｎ＋
４のデータがラッチ６−Ｂにセットされ、アドレスｎ＋
３のデータがラッチ６−Ａにセットされる。以下、同様
な動作が繰り返される。
従来の技術においては、MSB/LSB反転処理やライン・
バッファへのデータの展開処理、ライン・バッファから
の読出データをラッチにセットする処理は全てマイクロ
プログラムが制御していた。そのため、マイクロプログ
ラムが用紙送り方向や印字方向を意識する必要があり、
マイクロプログラムが複雑化すると共に、印字のための
マイクロプログラム走行時間が大きくなると言う欠点が
あった。
バッファへのデータの展開処理、ライン・バッファから
の読出データをラッチにセットする処理は全てマイクロ
プログラムが制御していた。そのため、マイクロプログ
ラムが用紙送り方向や印字方向を意識する必要があり、
マイクロプログラムが複雑化すると共に、印字のための
マイクロプログラム走行時間が大きくなると言う欠点が
あった。
本発明は、この点に鑑みて創作されたものであって、
印字処理のためのマイクロプログラムを簡単化し、印字
のためのマイクロプログラム走行時間を短縮できるよう
になったシリアル・ドット・プリンタの印字制御方式を
提供することを目的としている。
印字処理のためのマイクロプログラムを簡単化し、印字
のためのマイクロプログラム走行時間を短縮できるよう
になったシリアル・ドット・プリンタの印字制御方式を
提供することを目的としている。
第１図は本発明の原理説明図である。本発明のシリア
ル・ドット・プリンタの印字制御方式は、 用紙を正方向に送りながら正方向印字と逆方向印字を
行い得ると共に、用紙を逆方向に送りながら正方向印字
と逆方向印字を行い得るシリアル・ドット・プリンタの
印字制御方式であって、 １回のリード・アクセスでＰビットの読出データ（d
p-1,dp-2,…,d0）が出力されるライン・バッファ・メモ
リと、 ライン・バッファ・メモリに格納されているドット形
式の印字データを、アップ・モードまたはダウン・モー
ドで読み出すマイクロプログラム制御の制御手段と、 ライン・バッファ・メモリから出力された読出データ
（dp-1,dp-2,…,d0）と、該読出データのMSB/LSB反転デ
ータ（d0,d1,…,dp-1）とが入力される入力セレクタ
と、 入力セレクタの出力が印加されるＱ個のＰビット構成
のラッチと、 Ｑ個のＰビット構成のラッチにセット信号を供給する
セット信号源と、 Ｑ個のＰビット構成のグループにグループ分けされた
Ｐ×Ｑビット構成の白黒データ線と、 Ｑ個のＰビット構成のラッチの出力が入力される出力
セレクタ装置と、 入力セレクタの入力を切り替える入力セレクタ制御信
号および出力セレクタの入力を切り替える出力セレクタ
制御信号を出力する制御レジスタと を具備し、 ｊ番目（ｊ＝0,1,…,P×Ｑ−１）の白黒データ線は印
字ヘッドにおけるｊ番目の印字素子と対応付けられ、ｊ
番目の白黒データ線の信号がオンのときにはｊ番目の印
字素子が印字を行い、ｊ番目の白黒データ線の信号がオ
フのときにはｊ番目の印字素子が印字を行わず、 入力セレクタは、入力セレクタ制御信号が所定値のと
きには、ライン・バッファの読出データを出力し、入力
セレクタ制御信号が他の所定値のときには、MSB/LSB反
転データを出力し、 出力セレクタ装置は、出力セレクタ制御信号が所定値
のときにはｉ番目（ｉ＝0,1,…,Q−１）のラッチのデー
タをｉ番目の白黒データ線グループ上に出力し、出力セ
レクタ制御信号が他の所定値のときにはｉ番目のラッチ
のデータをＱ−ｉ−１番目の白黒データ線グループ上に
出力し、 制御レジスタには、用紙送り方向と印字方向によって
定まる値が設定されることを特徴とするものである。
ル・ドット・プリンタの印字制御方式は、 用紙を正方向に送りながら正方向印字と逆方向印字を
行い得ると共に、用紙を逆方向に送りながら正方向印字
と逆方向印字を行い得るシリアル・ドット・プリンタの
印字制御方式であって、 １回のリード・アクセスでＰビットの読出データ（d
p-1,dp-2,…,d0）が出力されるライン・バッファ・メモ
リと、 ライン・バッファ・メモリに格納されているドット形
式の印字データを、アップ・モードまたはダウン・モー
ドで読み出すマイクロプログラム制御の制御手段と、 ライン・バッファ・メモリから出力された読出データ
（dp-1,dp-2,…,d0）と、該読出データのMSB/LSB反転デ
ータ（d0,d1,…,dp-1）とが入力される入力セレクタ
と、 入力セレクタの出力が印加されるＱ個のＰビット構成
のラッチと、 Ｑ個のＰビット構成のラッチにセット信号を供給する
セット信号源と、 Ｑ個のＰビット構成のグループにグループ分けされた
Ｐ×Ｑビット構成の白黒データ線と、 Ｑ個のＰビット構成のラッチの出力が入力される出力
セレクタ装置と、 入力セレクタの入力を切り替える入力セレクタ制御信
号および出力セレクタの入力を切り替える出力セレクタ
制御信号を出力する制御レジスタと を具備し、 ｊ番目（ｊ＝0,1,…,P×Ｑ−１）の白黒データ線は印
字ヘッドにおけるｊ番目の印字素子と対応付けられ、ｊ
番目の白黒データ線の信号がオンのときにはｊ番目の印
字素子が印字を行い、ｊ番目の白黒データ線の信号がオ
フのときにはｊ番目の印字素子が印字を行わず、 入力セレクタは、入力セレクタ制御信号が所定値のと
きには、ライン・バッファの読出データを出力し、入力
セレクタ制御信号が他の所定値のときには、MSB/LSB反
転データを出力し、 出力セレクタ装置は、出力セレクタ制御信号が所定値
のときにはｉ番目（ｉ＝0,1,…,Q−１）のラッチのデー
タをｉ番目の白黒データ線グループ上に出力し、出力セ
レクタ制御信号が他の所定値のときにはｉ番目のラッチ
のデータをＱ−ｉ−１番目の白黒データ線グループ上に
出力し、 制御レジスタには、用紙送り方向と印字方向によって
定まる値が設定されることを特徴とするものである。
第２図は本発明の１実施例のブロック図である。同図
において、１はマイクロプロセッサ、２はDMAコントロ
ーラ、３はライン・バッファ・メモリ、４はキャラクタ
・ジェネレータ、５−Ａないし５−Ｃはセレクタ、６−
Ａないし６−Ｃはラッチ、７はレジスタをそれぞれ示し
ている。
において、１はマイクロプロセッサ、２はDMAコントロ
ーラ、３はライン・バッファ・メモリ、４はキャラクタ
・ジェネレータ、５−Ａないし５−Ｃはセレクタ、６−
Ａないし６−Ｃはラッチ、７はレジスタをそれぞれ示し
ている。
マイクロプロセッサ１は、ROM（図示せず）に格納さ
れているマイクロプログラムを実行するものである。DM
Aコントローラ２は、例えばライン・バッファ・メモリ
３のデータをセセレクタ５−Ａに転送する処理を行う。
キャラクタ・ジェネレータ４には、複数個の文字のドッ
ト・パターンが格納されている。セレクタ５−Ａは、Ｓ
端子に論理“0"が入力された時には０側データ入力端子
に印加されているd7ないしd0を出力し、Ｓ端子に論理
“1"が入力された時には１側のデータ入力端子に印加さ
れているd0ないしd7を出力する。セレクタ５−Ａの出力
は、ラッチ６−ＡのＤ入力，ラッチ６−ＢのＤ入力，ラ
ッチ６−ＣのＤ入力に印加されている。ラッチ６−Ａの
クロック端子にはセット信号１が印加され、ラッチ６−
Ｂのクロック端子にはセット信号２が印加され、ラッチ
６−Ｃのクロック端子にはセット信号３が印加されてい
る。セット信号１のパルスが１番早く生成され、次にセ
ット信号２のパルスが生成され、最後にセット信号３の
パルスが生成される。ラッチ６−Ａの出力はセレクタ５
−Ｂの０側入力端子およびセレクタ５−Ｃの１側入力端
子に印加され、ラッチ６−Ｃの出力はセレクタ５−Ｂの
１側入力端子およびセレクタ５−Ｃの０側入力端子に印
加されている。セレクタ５−Ｂは、Ｓ端子が論理“0"の
ときは０側入力端子のデータを出力し、Ｓ端子が論理
“1"のときは１側入力端子のデータを出力する。セレク
タ５−Ｃは、５−Ｂと同様な構成を持つ。セレクタ５−
Ｂの出力，ラッチ６−Ｂの出力およびセレクタ５−Ｃの
出力が白黒データとなる。白黒データは、図示の例では
24ビット構成である。レジスタ７は、モード・セレクト
・ビット１とモード・セレクト・ビット２を有してい
る。モード・セレクト・ビット１は、セレクタ５−Ａを
制御するものであり、モード・セレクト・ビット２はセ
レクタ５−Ｂと５−Ｃとを制御するものである。レジス
タ７の値は、マイクロプログラムによって書替可能であ
る。
れているマイクロプログラムを実行するものである。DM
Aコントローラ２は、例えばライン・バッファ・メモリ
３のデータをセセレクタ５−Ａに転送する処理を行う。
キャラクタ・ジェネレータ４には、複数個の文字のドッ
ト・パターンが格納されている。セレクタ５−Ａは、Ｓ
端子に論理“0"が入力された時には０側データ入力端子
に印加されているd7ないしd0を出力し、Ｓ端子に論理
“1"が入力された時には１側のデータ入力端子に印加さ
れているd0ないしd7を出力する。セレクタ５−Ａの出力
は、ラッチ６−ＡのＤ入力，ラッチ６−ＢのＤ入力，ラ
ッチ６−ＣのＤ入力に印加されている。ラッチ６−Ａの
クロック端子にはセット信号１が印加され、ラッチ６−
Ｂのクロック端子にはセット信号２が印加され、ラッチ
６−Ｃのクロック端子にはセット信号３が印加されてい
る。セット信号１のパルスが１番早く生成され、次にセ
ット信号２のパルスが生成され、最後にセット信号３の
パルスが生成される。ラッチ６−Ａの出力はセレクタ５
−Ｂの０側入力端子およびセレクタ５−Ｃの１側入力端
子に印加され、ラッチ６−Ｃの出力はセレクタ５−Ｂの
１側入力端子およびセレクタ５−Ｃの０側入力端子に印
加されている。セレクタ５−Ｂは、Ｓ端子が論理“0"の
ときは０側入力端子のデータを出力し、Ｓ端子が論理
“1"のときは１側入力端子のデータを出力する。セレク
タ５−Ｃは、５−Ｂと同様な構成を持つ。セレクタ５−
Ｂの出力，ラッチ６−Ｂの出力およびセレクタ５−Ｃの
出力が白黒データとなる。白黒データは、図示の例では
24ビット構成である。レジスタ７は、モード・セレクト
・ビット１とモード・セレクト・ビット２を有してい
る。モード・セレクト・ビット１は、セレクタ５−Ａを
制御するものであり、モード・セレクト・ビット２はセ
レクタ５−Ｂと５−Ｃとを制御するものである。レジス
タ７の値は、マイクロプログラムによって書替可能であ
る。
第３図は白黒データ線と印字ヘッドの接続関係を説明
するものである。出力セレクタ装置から出力される白黒
データは、タイミング制御部およびドライバ部を介し
て、印字ヘッドの印字ピン駆動部に送られる。ドライバ
部から出力される第ｉ番目（ｉ＝1,2,…,24）のピン駆
動信号は、第ｉ番目の印字ヘッド・ピンを駆動する。白
黒データは、ピン駆動信号そのものではなく、印字周期
（ドット・パルスに相当）毎に該当する印字ヘッド・ピ
ンを駆動するか否かを指示するものである。各白黒デー
タは、印字周期期間は０又は１の固定値を取り、その後
段のタイミング制御部にたいして、印字ピン駆動信号生
成用のタイミング・パルス（オンタイム１）の発生のオ
ン／オフ情報を与えるものである。
するものである。出力セレクタ装置から出力される白黒
データは、タイミング制御部およびドライバ部を介し
て、印字ヘッドの印字ピン駆動部に送られる。ドライバ
部から出力される第ｉ番目（ｉ＝1,2,…,24）のピン駆
動信号は、第ｉ番目の印字ヘッド・ピンを駆動する。白
黒データは、ピン駆動信号そのものではなく、印字周期
（ドット・パルスに相当）毎に該当する印字ヘッド・ピ
ンを駆動するか否かを指示するものである。各白黒デー
タは、印字周期期間は０又は１の固定値を取り、その後
段のタイミング制御部にたいして、印字ピン駆動信号生
成用のタイミング・パルス（オンタイム１）の発生のオ
ン／オフ情報を与えるものである。
印字ピンに対しては、図示のような番号付けが成され
ている。即ち、左側の12本のピンのそれぞれに対しては
1,3,5,…23の番号が与えられ、右側の12本のピンのそれ
ぞれに対しては2,4,6,…24の番号が与えられる。用紙送
り方向は、23番のピンから１番のピンに向かう方向が正
方向とされ、反対方向が逆方向とされる。
ている。即ち、左側の12本のピンのそれぞれに対しては
1,3,5,…23の番号が与えられ、右側の12本のピンのそれ
ぞれに対しては2,4,6,…24の番号が与えられる。用紙送
り方向は、23番のピンから１番のピンに向かう方向が正
方向とされ、反対方向が逆方向とされる。
第４図は印字駆動信号の説明図である。印字ヘッドを
駆動する信号がピン駆動信号であり、ドライバ部によっ
て生成される。このドライバ部は、１ピン当たり２本の
タイミング信号（オンタイム１とオンタイム２）を入力
し、駆動波形を生成している。
駆動する信号がピン駆動信号であり、ドライバ部によっ
て生成される。このドライバ部は、１ピン当たり２本の
タイミング信号（オンタイム１とオンタイム２）を入力
し、駆動波形を生成している。
タイミング信号は、タイミング制御部によって生成さ
れる。入力信号には、白黒データの他に、印字周期信号
やオンタイム１およびオンタイム２の基本タイミングを
与えるタイミング基準信号など（図示せず）があり、出
力としてオンタイム１とオンタイム２を生成出力する。
つまり、出力セレクタ装置から出力される白黒データに
応じてオンタイム１とオンタイム２の出力を制御してい
る（黒ならパルス出力、白ならパルス出力せず）。但
し、オンタイム２は、各ピン毎ではなく、千鳥配列の列
単位で共通信号として出力するのが一般的な方法であ
る。
れる。入力信号には、白黒データの他に、印字周期信号
やオンタイム１およびオンタイム２の基本タイミングを
与えるタイミング基準信号など（図示せず）があり、出
力としてオンタイム１とオンタイム２を生成出力する。
つまり、出力セレクタ装置から出力される白黒データに
応じてオンタイム１とオンタイム２の出力を制御してい
る（黒ならパルス出力、白ならパルス出力せず）。但
し、オンタイム２は、各ピン毎ではなく、千鳥配列の列
単位で共通信号として出力するのが一般的な方法であ
る。
印字ヘッドのピン配列は、図示のように12ピン×２列
の千鳥ピン配列となっているのが一般的である。千鳥配
列ヘッドのようなピン配列が列方向に段差を持つ印字ヘ
ッドの場合、物理ピン間隔分のデータ遅延を行うことが
必要であるが、タイミング制御部に入力シフトレジスタ
（印字周期信号によってシフト）を用いてピン間隔分の
調整を行う方法が一般的である。
の千鳥ピン配列となっているのが一般的である。千鳥配
列ヘッドのようなピン配列が列方向に段差を持つ印字ヘ
ッドの場合、物理ピン間隔分のデータ遅延を行うことが
必要であるが、タイミング制御部に入力シフトレジスタ
（印字周期信号によってシフト）を用いてピン間隔分の
調整を行う方法が一般的である。
第５図は本発明のマイクロプログラムの処理フローの
例を示す図である。マイクロプログラムはライン・バッ
ファにデータを展開する。ライン・バッファへのデータ
展開は、用紙送り方向および印字方向に関係なく、第６
図の通常方向印字で説明した方法によって行われる。前
ラインのDMA動作が終了すると、モード・セレクト・ビ
ットがセットされる。次に、DMA動作が開始される。
例を示す図である。マイクロプログラムはライン・バッ
ファにデータを展開する。ライン・バッファへのデータ
展開は、用紙送り方向および印字方向に関係なく、第６
図の通常方向印字で説明した方法によって行われる。前
ラインのDMA動作が終了すると、モード・セレクト・ビ
ットがセットされる。次に、DMA動作が開始される。
用紙送り方向が通常方向で、印字方向が正方向の場合
には、レジスタ７のモード・セレクト・ビット１及びモ
ード・セレクト・ビット２は、0,0とされる。この場
合、マイクロプロセッサ１は、DMAコントローラ３に対
して、ｎ番地を先頭アドレスとしてＭバイト（Ｍはライ
ン・バッファ・メモリ３の容量）のデータをアップモー
ドで転送せよと言う指示を与える。この指示を受け取る
と、DMAコントローラ２は、最初のドット・パルスに同
期して、ライン・バッファ・メモリ３のアドレスn,n＋
1,n＋２のデータを順番に読み出し、セレクタ５−Ａに
送る。モード・セレクト・ビット１が０であるので、ラ
イン・バッファのアドレスｎのデータはラッチ６−Ａに
セットされ、ライン・バッファのアドレスｎ＋１のデー
タはラッチ６−Ｂにセットされ、ライン・バッファのア
ドレスｎ＋２のデータはラッチ６−Ｃにセットされる。
モード・セレクト・ビット２が０であるので、ラッチ６
−Ａにセットされているアドレスｎのデータがセレクタ
５−Ｂを介して出力され、ラッチ６−Ｂにセットされて
いるアドレスｎ＋１のデータがそのまま出力され、ラッ
チ６−Ｃにセットされているアドレスｎ＋２のデータが
セレクタ５−Ｃを介して出力される。次のドット・パル
スに同期して、ライン・バッファ・メモリ３のアドレス
ｎ＋3,n＋4,n＋５のデータが順番に読み出され、読出デ
ータがセレクタ５−Ａに送られ、同様な処理が行われ
る。
には、レジスタ７のモード・セレクト・ビット１及びモ
ード・セレクト・ビット２は、0,0とされる。この場
合、マイクロプロセッサ１は、DMAコントローラ３に対
して、ｎ番地を先頭アドレスとしてＭバイト（Ｍはライ
ン・バッファ・メモリ３の容量）のデータをアップモー
ドで転送せよと言う指示を与える。この指示を受け取る
と、DMAコントローラ２は、最初のドット・パルスに同
期して、ライン・バッファ・メモリ３のアドレスn,n＋
1,n＋２のデータを順番に読み出し、セレクタ５−Ａに
送る。モード・セレクト・ビット１が０であるので、ラ
イン・バッファのアドレスｎのデータはラッチ６−Ａに
セットされ、ライン・バッファのアドレスｎ＋１のデー
タはラッチ６−Ｂにセットされ、ライン・バッファのア
ドレスｎ＋２のデータはラッチ６−Ｃにセットされる。
モード・セレクト・ビット２が０であるので、ラッチ６
−Ａにセットされているアドレスｎのデータがセレクタ
５−Ｂを介して出力され、ラッチ６−Ｂにセットされて
いるアドレスｎ＋１のデータがそのまま出力され、ラッ
チ６−Ｃにセットされているアドレスｎ＋２のデータが
セレクタ５−Ｃを介して出力される。次のドット・パル
スに同期して、ライン・バッファ・メモリ３のアドレス
ｎ＋3,n＋4,n＋５のデータが順番に読み出され、読出デ
ータがセレクタ５−Ａに送られ、同様な処理が行われ
る。
用紙送り方向が通常方向で、印字方向が逆方向の場合
には、レジスタ７のモード・セレクト・ビット１及びモ
ード・セレクト・ビット２は、0,1とされる。この場
合、マイクロプロセッサ１は、DMAコントローラ２に対
して、ｍ番地を先頭アドレスとしてＭバイト（Ｍはライ
ン・パターン３のメモリ容量）のデータをダウン・モー
ドで転送せよと言う指示を与える。この指示を受け取る
と、DMAコントローラ２は、最初のドット・パルスに同
期して、ライン・バッファ３のアドレスm,m−1,m−２の
データを順番に読み出し、セレクタ５−Ａに送る。モー
ド・セレクト・ビット１が０であるので、ライン・バッ
ファのアドレスｍのデータはラッチ６−Ａにセットさ
れ、ライン・バッファのアドレスｍ−１のデータはラッ
チ６−Ｂにセットされ、ライン・バッファのアドレスｍ
−２のデータはラッチ６−Ｃにセットされる。モード・
セレクト・ビット２が１であるので、ラッチ６−Ａにセ
ットされているアドレスｍのデータはセレクタ５−Ｃを
介して出力され、ラッチ６−Ｂにセットされているアド
レスｍ−１のデータはそのまま出力され、ラッチ６−Ｃ
にセットされているアドレスｍ−２のデータはセレクタ
５−Ｂを介して出力される。次のドット・パルスに同期
して、ライン・バッファ・メモリ３のアドレスｍ−3,m
−4,m−５のデータが順番に読み出され、読出データが
セレクタ５−Ａに送られ、同様な処理が行われる。
には、レジスタ７のモード・セレクト・ビット１及びモ
ード・セレクト・ビット２は、0,1とされる。この場
合、マイクロプロセッサ１は、DMAコントローラ２に対
して、ｍ番地を先頭アドレスとしてＭバイト（Ｍはライ
ン・パターン３のメモリ容量）のデータをダウン・モー
ドで転送せよと言う指示を与える。この指示を受け取る
と、DMAコントローラ２は、最初のドット・パルスに同
期して、ライン・バッファ３のアドレスm,m−1,m−２の
データを順番に読み出し、セレクタ５−Ａに送る。モー
ド・セレクト・ビット１が０であるので、ライン・バッ
ファのアドレスｍのデータはラッチ６−Ａにセットさ
れ、ライン・バッファのアドレスｍ−１のデータはラッ
チ６−Ｂにセットされ、ライン・バッファのアドレスｍ
−２のデータはラッチ６−Ｃにセットされる。モード・
セレクト・ビット２が１であるので、ラッチ６−Ａにセ
ットされているアドレスｍのデータはセレクタ５−Ｃを
介して出力され、ラッチ６−Ｂにセットされているアド
レスｍ−１のデータはそのまま出力され、ラッチ６−Ｃ
にセットされているアドレスｍ−２のデータはセレクタ
５−Ｂを介して出力される。次のドット・パルスに同期
して、ライン・バッファ・メモリ３のアドレスｍ−3,m
−4,m−５のデータが順番に読み出され、読出データが
セレクタ５−Ａに送られ、同様な処理が行われる。
用紙送り方向が反転方向で、印字方向が逆方向の場合
には、レジスタ７のモード・セレクト・ビット１及びモ
ード・セレクト・ビット２は、1,0とされる。この場
合、マイクロプロセッサ１は、DMAコントローラ２に対
して、ｍ番地を先頭アドレスとしてＭバイト（Ｍはライ
ン・バッファ・メモリ３の容量）のデータをダウン・モ
ードで転送せよと言う指示を与える。この指示を受け取
ると、最初のドット・パルスに同期して、ライン・バッ
ファ・メモリ３のアドレスm,m−1,m−２のデータを順番
に読み出し、セレクタ５−Ａに送る。モード・セレクト
１が１であるので、ライン・バッファのアドレスｍのデ
ータのMSB/LSB反転がラッチ６−Ａにセットされ、ライ
ン・バッファのアドレスｍ−１のデータのMSB/LSB反転
がラッチ６−Ｂにセットされ、ライン・バッファのアド
レスｍ−２のデータのMSB/LSB反転がラッチ６−Ｃにセ
ットされる。モード・セレクト・ビット２が０であるの
で、ラッチ６−Ａにセットされているアドレスｍのデー
タのMSB/LSB反転がセレクタ５−Ｂを介して出力され、
ラッチ６−Ｂにセットされているアドレスｍ−１のデー
タのMSB/LSB反転がそのまま出力され、ラッチ６−Ｃに
セットされているアドレスｍ−２のデータのMSB/LSB反
転がセレクタ５−Ｃを介して出力される。次のドット・
パルスに同期して、ライン・バッファ・メモリ３のアド
レスｍ−3,m−4,m−５のデータが順番に読み出され、読
出データがセレクタ５−Ａに送られ、同様な処理が行わ
れる。
には、レジスタ７のモード・セレクト・ビット１及びモ
ード・セレクト・ビット２は、1,0とされる。この場
合、マイクロプロセッサ１は、DMAコントローラ２に対
して、ｍ番地を先頭アドレスとしてＭバイト（Ｍはライ
ン・バッファ・メモリ３の容量）のデータをダウン・モ
ードで転送せよと言う指示を与える。この指示を受け取
ると、最初のドット・パルスに同期して、ライン・バッ
ファ・メモリ３のアドレスm,m−1,m−２のデータを順番
に読み出し、セレクタ５−Ａに送る。モード・セレクト
１が１であるので、ライン・バッファのアドレスｍのデ
ータのMSB/LSB反転がラッチ６−Ａにセットされ、ライ
ン・バッファのアドレスｍ−１のデータのMSB/LSB反転
がラッチ６−Ｂにセットされ、ライン・バッファのアド
レスｍ−２のデータのMSB/LSB反転がラッチ６−Ｃにセ
ットされる。モード・セレクト・ビット２が０であるの
で、ラッチ６−Ａにセットされているアドレスｍのデー
タのMSB/LSB反転がセレクタ５−Ｂを介して出力され、
ラッチ６−Ｂにセットされているアドレスｍ−１のデー
タのMSB/LSB反転がそのまま出力され、ラッチ６−Ｃに
セットされているアドレスｍ−２のデータのMSB/LSB反
転がセレクタ５−Ｃを介して出力される。次のドット・
パルスに同期して、ライン・バッファ・メモリ３のアド
レスｍ−3,m−4,m−５のデータが順番に読み出され、読
出データがセレクタ５−Ａに送られ、同様な処理が行わ
れる。
用紙送りが反転方向で印字方向が正方向の場合には、
レジスタ７のモード・セレクト・ビット１及びモード・
セレクト・ビット２は、1,1とされる。この場合、マイ
クロプロセッサ１は、DMAコントローラ２に対して、ｎ
番地を先頭アドレスとしてＭバイト（Ｍはライン・バッ
ファ・メモリ３の容量）のデータをアップ・モードで転
送せよと言う指示を与える。この指示を受け取ると、DM
Aコントローラ２は、最初のドット・パルスに同期し
て、ライン・バッファ・メモリ３のアドレスn,n＋1,n＋
２のデータを順番に読み出し、セレクタ５−Ａに送る。
モード・セレクト・ビット１が１であるので、ライン・
バッファのアドレスｎのデータのMSB/LSBの反転がラッ
チ６−Ａにセットされ、ライン・バッファのアドレスｎ
＋１のデータのMSB/LSBの反転がラッチ６−Ｂにセット
され、ライン・バッファのアドレスｎ＋２のデータのMS
B/LSBの反転がラッチ６−Ｃにセットされる。モード・
セレクト・ビット２が１であるので、ラッチ６−Ａにセ
ットされているアドレスｎのデータがMSB/LSB反転がセ
レクタ５−Ｃを介して出力され、ラッチ６−Ｂにセット
されているアドレスｎ＋１のデータのMSB/LSB反転がそ
のまま出力され、ラッチ６−ＣにセットされているMSB/
LSB反転がセレクタ５−Ｂを介して出力される。次のド
ット・パルスに同期して、ライン・バッファ・メモリ３
のアドレスｎ＋3,n＋4,n＋５のデータが順番に読み出さ
れ、読出データがセレクタ５−Ａに送られ、同様な処理
が行われる。
レジスタ７のモード・セレクト・ビット１及びモード・
セレクト・ビット２は、1,1とされる。この場合、マイ
クロプロセッサ１は、DMAコントローラ２に対して、ｎ
番地を先頭アドレスとしてＭバイト（Ｍはライン・バッ
ファ・メモリ３の容量）のデータをアップ・モードで転
送せよと言う指示を与える。この指示を受け取ると、DM
Aコントローラ２は、最初のドット・パルスに同期し
て、ライン・バッファ・メモリ３のアドレスn,n＋1,n＋
２のデータを順番に読み出し、セレクタ５−Ａに送る。
モード・セレクト・ビット１が１であるので、ライン・
バッファのアドレスｎのデータのMSB/LSBの反転がラッ
チ６−Ａにセットされ、ライン・バッファのアドレスｎ
＋１のデータのMSB/LSBの反転がラッチ６−Ｂにセット
され、ライン・バッファのアドレスｎ＋２のデータのMS
B/LSBの反転がラッチ６−Ｃにセットされる。モード・
セレクト・ビット２が１であるので、ラッチ６−Ａにセ
ットされているアドレスｎのデータがMSB/LSB反転がセ
レクタ５−Ｃを介して出力され、ラッチ６−Ｂにセット
されているアドレスｎ＋１のデータのMSB/LSB反転がそ
のまま出力され、ラッチ６−ＣにセットされているMSB/
LSB反転がセレクタ５−Ｂを介して出力される。次のド
ット・パルスに同期して、ライン・バッファ・メモリ３
のアドレスｎ＋3,n＋4,n＋５のデータが順番に読み出さ
れ、読出データがセレクタ５−Ａに送られ、同様な処理
が行われる。
以上の説明から明らかなように、本発明によれば、用
紙送り方向や印字方向を意識することなくライン・バッ
ファにデータを展開できるので、マイクロプログラムを
簡単化できると共に、印字のためのマイクロプログラム
の走行時間を短くすることが出来る。
紙送り方向や印字方向を意識することなくライン・バッ
ファにデータを展開できるので、マイクロプログラムを
簡単化できると共に、印字のためのマイクロプログラム
の走行時間を短くすることが出来る。
第１図は本発明の原理説明図、第２図は本発明の１実施
例のブロック図、第３図は印字ヘッドとの接続説明図、
第４図は印字駆動信号の説明図、第５図は本発明におけ
るマイクロプログラムの処理フローを示す図、第６図は
従来の印字制御を説明する図、第７図は用紙送り方向と
印字方向を説明する図である。 １……マイクロプロセッサ、２……DMAコントローラ、
３……ライン・バッファ・メモリ、４……キャラクタ・
ジェネレータ、５−Ａないし５−Ｃ……セレクタ、６−
Ａないし６−Ｃ……ラッチ、７……レジスタ。
例のブロック図、第３図は印字ヘッドとの接続説明図、
第４図は印字駆動信号の説明図、第５図は本発明におけ
るマイクロプログラムの処理フローを示す図、第６図は
従来の印字制御を説明する図、第７図は用紙送り方向と
印字方向を説明する図である。 １……マイクロプロセッサ、２……DMAコントローラ、
３……ライン・バッファ・メモリ、４……キャラクタ・
ジェネレータ、５−Ａないし５−Ｃ……セレクタ、６−
Ａないし６−Ｃ……ラッチ、７……レジスタ。
フロントページの続き (56)参考文献 特開 昭64−24763（ＪＰ，Ａ) 特開 昭59−119440（ＪＰ，Ａ) 特開 昭64−16665（ＪＰ，Ａ) 特開 昭63−209952（ＪＰ，Ａ) 実開 昭52−50027（ＪＰ，Ｕ)
Claims (1)
- 【請求項１】用紙を正方向に送りながら正方向印字と逆
方向印字を行い得ると共に、用紙を逆方向に送りながら
正方向印字と逆方向印字を行い得るシリアル・ドット・
プリンタの印字制御方式であって、 １回のリード・アクセスでＰドットの読出データ
（dp-1,dp-2,…,d0）が出力されるライン・バッファ・
メモリと、 ライン・バッファ・メモリに格納されているドット形式
の印字データを、アップ・モードまたはダウン・モード
で読み出すマイクロプログラム制御の制御手段と、 ライン・バッファ・メモリから出力された読出データ
（dp-1,dp-2,…,d0）と、該読出データのMSB/LSB反転デ
ータ（d0,d1,…,dp-1）とが入力される入力セレクタ
と、 入力セレクタの出力が印加されるＱ個のＰビット構成の
ラッチと、 Ｑ個のＰビット構成のラッチにセット信号を供給するセ
ット信号源と、 Ｑ個のＰビット構成のグループにグループ分けされたＰ
×Ｑビット構成の白黒データ線と、 Ｑ個のＰビット構成のラッチの出力が入力される出力セ
レクタ装置と、 入力セレクタの入力を切り替える入力セレクタ制御信号
および出力セレクタの入力を切り替える出力セレクタ制
御信号を出力する制御レジスタと を具備し、 ｊ番目（ｊ＝0,1,…,P×Ｑ−１）の白黒データ線は印字
ヘッドにおけるｊ番目の印字素子と対応付けられ、ｊ番
目の白黒データ線の信号がオンのときにはｊ番目の印字
素子が印字を行い、ｊ番目の白黒データ線の信号がオフ
のときにはｊ番目の印字素子が印字を行わず、 入力セレクタは、入力セレクタ制御信号が所定値のとき
には、ライン・バッファの読出データを出力し、入力セ
レクタ制御信号が他の所定値のときには、MSB/LSB反転
データを出力し、 出力セレクタ装置は、出力セレクタ制御信号が所定値の
ときにはｉ番目（ｉ＝0,1,…,Q−１）のラッチのデータ
をｉ番目の白黒データ線グループ上に出力し、出力セレ
クタ制御信号が他の所定値のときにはｉ番目のラッチの
データをＱ−ｉ−１番目の白黒データ線グループ上に出
力し、 制御レジスタには、用紙送り方向と印字方向によって定
まる値が設定されることを特徴とするシリアル・ドット
・プリンタの印字制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1039040A JP2537394B2 (ja) | 1989-02-18 | 1989-02-18 | シリアル・ドット・プリンタの印字制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1039040A JP2537394B2 (ja) | 1989-02-18 | 1989-02-18 | シリアル・ドット・プリンタの印字制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02217271A JPH02217271A (ja) | 1990-08-30 |
| JP2537394B2 true JP2537394B2 (ja) | 1996-09-25 |
Family
ID=12542013
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1039040A Expired - Fee Related JP2537394B2 (ja) | 1989-02-18 | 1989-02-18 | シリアル・ドット・プリンタの印字制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2537394B2 (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59119440A (ja) * | 1982-12-25 | 1984-07-10 | Toshiba Corp | 印字制御方式 |
| JPH0747326B2 (ja) * | 1987-07-21 | 1995-05-24 | 富士通株式会社 | 文字パターン変換装置 |
-
1989
- 1989-02-18 JP JP1039040A patent/JP2537394B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02217271A (ja) | 1990-08-30 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313532 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
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| LAPS | Cancellation because of no payment of annual fees |