JP2523210Y2 - 電子式キャッシュレジスタ - Google Patents
電子式キャッシュレジスタInfo
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- JP2523210Y2 JP2523210Y2 JP1991011886U JP1188691U JP2523210Y2 JP 2523210 Y2 JP2523210 Y2 JP 2523210Y2 JP 1991011886 U JP1991011886 U JP 1991011886U JP 1188691 U JP1188691 U JP 1188691U JP 2523210 Y2 JP2523210 Y2 JP 2523210Y2
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Description
【０００１】
【産業上の利用分野】本考案はＲＡＭカードを使用する
電子式キャッシュレジスタに関する。
電子式キャッシュレジスタに関する。
【０００２】
【従来の技術】最近の電子式キャッシュレジスタ（以下
ＥＣＲと称す）では、集計したデータを半導体メモリで
構成されたＲＡＭカードに転送して記憶させ、各々のＥ
ＣＲのＲＡＭカードのデータを集計することにより、店
全体の売上げデータをレポートとして出力できるよう構
成されたものが開発されている（例えば特開昭６３−５
９６９７号公報参照）。
ＥＣＲと称す）では、集計したデータを半導体メモリで
構成されたＲＡＭカードに転送して記憶させ、各々のＥ
ＣＲのＲＡＭカードのデータを集計することにより、店
全体の売上げデータをレポートとして出力できるよう構
成されたものが開発されている（例えば特開昭６３−５
９６９７号公報参照）。
【０００３】そしてこの様なＥＣＲでは、何等かの原因
でＥＣＲのデータが破壊されたとしても、ＲＡＭカード
に記憶していたデータをＥＣＲにロードすることによ
り、データを復活できる等の効果がある。
でＥＣＲのデータが破壊されたとしても、ＲＡＭカード
に記憶していたデータをＥＣＲにロードすることによ
り、データを復活できる等の効果がある。
【０００４】
【考案が解決しようとする課題】ところで、ＥＣＲから
ＲＡＭカードへデータをセーブする際、或いはＲＡＭカ
ードからＥＣＲへデータをロードする際に、データ量の
関係から複数枚のＲＡＭカードを使用する場合が有り、
ＲＡＭカードを順次交換して装着する必要が有る。しか
し従来のＥＣＲではＲＡＭカードの交換時期を明確に指
示する手段がなかった為、データ転送中か終了かの判断
が出来ず操作者が適当に行なっていたので、交換のタイ
ミングが悪かった場合データ転送が正確に行なわれない
という問題が有った。
ＲＡＭカードへデータをセーブする際、或いはＲＡＭカ
ードからＥＣＲへデータをロードする際に、データ量の
関係から複数枚のＲＡＭカードを使用する場合が有り、
ＲＡＭカードを順次交換して装着する必要が有る。しか
し従来のＥＣＲではＲＡＭカードの交換時期を明確に指
示する手段がなかった為、データ転送中か終了かの判断
が出来ず操作者が適当に行なっていたので、交換のタイ
ミングが悪かった場合データ転送が正確に行なわれない
という問題が有った。
【０００５】
【課題を解決するための手段】本考案は上述の問題点を
解消すべくなされたもので、データを入力する入力手段
と、入力されたデータ及び演算処理されたデータを表示
する表示手段と、入力されたデータ及び演算処理された
データを記憶する記憶手段と、記憶手段とデータ転送を
行なうＲＡＭカードと、入力データの演算処理及びデー
タ転送を制御する制御手段よりなり、制御手段がデータ
転送の実行状態に応じ表示手段に表示を行ない指示する
よう構成したものである。
解消すべくなされたもので、データを入力する入力手段
と、入力されたデータ及び演算処理されたデータを表示
する表示手段と、入力されたデータ及び演算処理された
データを記憶する記憶手段と、記憶手段とデータ転送を
行なうＲＡＭカードと、入力データの演算処理及びデー
タ転送を制御する制御手段よりなり、制御手段がデータ
転送の実行状態に応じ表示手段に表示を行ない指示する
よう構成したものである。
【０００６】
【作用】本考案は上述の如く構成したので、データ転送
中の状態が表示器に指示されるので、ＲＡＭカードの交
換時期が明確となり、データ転送を確実に行なうことが
できる。
中の状態が表示器に指示されるので、ＲＡＭカードの交
換時期が明確となり、データ転送を確実に行なうことが
できる。
【０００７】
【実施例】以下本考案の実施例を図面に基づき説明す
る。
る。
【０００８】図１は本考案のＥＣＲの回路構成を示し、
（１）はマイクロプロセッサで構成される制御回路で、
予め処理プログラムが記憶されているプログラムメモリ
（２）のプログラムに従い全体の制御を司る。（３）は
置数キー、商品部門別キー、取引キー等の複数のキース
イッチで構成されるキーボードで、信号バス（４）を介
して制御回路（１）と接続されている。（５）はキーボ
ード（３）より入力されたデータ或いは制御回路（１）
により処理されたデータ等が記憶されるデータメモリ
で、キーボード（３）より入力されたデータを記憶する
領域、商品部門別にデータを記憶する領域、客毎のデー
タを記憶する領域及び各々の合計データを記憶する領域
等で構成されている。（６）はキーボード（３）より入
力されたデータ或いは制御回路（１）により処理された
データが表示される表示器で、図２に示すように数置デ
ータを表示する複数桁の日の字セグメント（６ａ）と、
ドットセグメント（６ｂ）と、動作モードを指示する三
角形状の指標セグメント（６ｃ）で構成されており、制
御回路（１）の制御の下に点灯駆動される。（７）はキ
ーボード（３）より入力されたデータ或いは制御回路
（１）により処理されたデータが印字される印字装置
で、制御回路（１）の制御の下にレシート印字とジャー
ナル印字を行なう。（８）はＲＡＭカード（９）が接続
されるコネクタで、信号バス（４）に接続され制御回路
（１）の制御の下にデータメモリ（５）間でデータ転送
を行なう。
（１）はマイクロプロセッサで構成される制御回路で、
予め処理プログラムが記憶されているプログラムメモリ
（２）のプログラムに従い全体の制御を司る。（３）は
置数キー、商品部門別キー、取引キー等の複数のキース
イッチで構成されるキーボードで、信号バス（４）を介
して制御回路（１）と接続されている。（５）はキーボ
ード（３）より入力されたデータ或いは制御回路（１）
により処理されたデータ等が記憶されるデータメモリ
で、キーボード（３）より入力されたデータを記憶する
領域、商品部門別にデータを記憶する領域、客毎のデー
タを記憶する領域及び各々の合計データを記憶する領域
等で構成されている。（６）はキーボード（３）より入
力されたデータ或いは制御回路（１）により処理された
データが表示される表示器で、図２に示すように数置デ
ータを表示する複数桁の日の字セグメント（６ａ）と、
ドットセグメント（６ｂ）と、動作モードを指示する三
角形状の指標セグメント（６ｃ）で構成されており、制
御回路（１）の制御の下に点灯駆動される。（７）はキ
ーボード（３）より入力されたデータ或いは制御回路
（１）により処理されたデータが印字される印字装置
で、制御回路（１）の制御の下にレシート印字とジャー
ナル印字を行なう。（８）はＲＡＭカード（９）が接続
されるコネクタで、信号バス（４）に接続され制御回路
（１）の制御の下にデータメモリ（５）間でデータ転送
を行なう。
【０００９】次に斯る構成よりなる本考案の動作につき
図７乃至図９のフローチャートに基づき説明する。
図７乃至図９のフローチャートに基づき説明する。
【００１０】先ず通常の登録モードに於いて、キーボー
ド（３）より置数キーにてデータを入力すると、入力さ
れたデータが表示器（６）に順次表示されると共に、印
字装置（７）で印字が行なわれ、又データメモリ（５）
に記憶される。これらの動作はＥＣＲでは周知であり、
ここでは詳細な説明は省略し、本考案の特徴であるデー
タ転送につき説明する。
ド（３）より置数キーにてデータを入力すると、入力さ
れたデータが表示器（６）に順次表示されると共に、印
字装置（７）で印字が行なわれ、又データメモリ（５）
に記憶される。これらの動作はＥＣＲでは周知であり、
ここでは詳細な説明は省略し、本考案の特徴であるデー
タ転送につき説明する。
【００１１】先ずデータメモリ（５）のデータをＲＡＭ
カード（９）に転送する場合には、ＲＡＭカード（９）
をコネクタ（８）に接続した後、ステップ（Ｓ１）に於
いてキーボード（３）でデータ転送を開始する所定のキ
ー操作を行なうと、キー信号を検出した制御回路（１）
は、ステップ（Ｓ２）〜（Ｓ５）でＲＡＭカード（９）
の状態をチェックし、正しくなければエラー処理に進む
が、正常である場合ステップ（Ｓ５）よりステップ（Ｓ
６）へ進み図３に示すように転送スタンバイ状態である
ことを指示する表示を行なう。続いて制御回路（１）は
ステップ（Ｓ７）でデータメモリ（５）に記憶されてい
るデータを順次読み出しＲＡＭカード（９）にデータ転
送を開始する。データの転送中制御回路（１）は図４に
示すように日の字セグメント（６ａ）の中央のセグメン
トを点灯させる駆動信号を表示器（６）に出力し、デー
タ転送中である事を指示する。データ転送中制御回路
（１）は、ステップ（Ｓ８）でデータメモリ（５）内の
残りデータをチェックし、データ転送の終了をチェック
する。又データ転送中制御回路（１）は、転送開始から
の転送データ量をチェックしており、ステップ（Ｓ９）
で１枚のＲＡＭカード（９）に記憶可能なデータ量を転
送したか否か判定し、転送していなければステップ（Ｓ
７）に戻りデータ転送を継続するけれども、所定量のデ
ータ転送を行なっていた場合には、ステップ（Ｓ１０）
に進みデータメモリ（５）の残りのデータ量をチェック
し、次のＲＡＭカード（９）が必要か否かの判断を行な
う。そこで次のＲＡＭカード（９）が必要でない場合、
ステップ（Ｓ１１）に進み図３に示すスタンバイ表示を
行なってデータ転送を終了する。
カード（９）に転送する場合には、ＲＡＭカード（９）
をコネクタ（８）に接続した後、ステップ（Ｓ１）に於
いてキーボード（３）でデータ転送を開始する所定のキ
ー操作を行なうと、キー信号を検出した制御回路（１）
は、ステップ（Ｓ２）〜（Ｓ５）でＲＡＭカード（９）
の状態をチェックし、正しくなければエラー処理に進む
が、正常である場合ステップ（Ｓ５）よりステップ（Ｓ
６）へ進み図３に示すように転送スタンバイ状態である
ことを指示する表示を行なう。続いて制御回路（１）は
ステップ（Ｓ７）でデータメモリ（５）に記憶されてい
るデータを順次読み出しＲＡＭカード（９）にデータ転
送を開始する。データの転送中制御回路（１）は図４に
示すように日の字セグメント（６ａ）の中央のセグメン
トを点灯させる駆動信号を表示器（６）に出力し、デー
タ転送中である事を指示する。データ転送中制御回路
（１）は、ステップ（Ｓ８）でデータメモリ（５）内の
残りデータをチェックし、データ転送の終了をチェック
する。又データ転送中制御回路（１）は、転送開始から
の転送データ量をチェックしており、ステップ（Ｓ９）
で１枚のＲＡＭカード（９）に記憶可能なデータ量を転
送したか否か判定し、転送していなければステップ（Ｓ
７）に戻りデータ転送を継続するけれども、所定量のデ
ータ転送を行なっていた場合には、ステップ（Ｓ１０）
に進みデータメモリ（５）の残りのデータ量をチェック
し、次のＲＡＭカード（９）が必要か否かの判断を行な
う。そこで次のＲＡＭカード（９）が必要でない場合、
ステップ（Ｓ１１）に進み図３に示すスタンバイ表示を
行なってデータ転送を終了する。
【００１２】しかしながら残りデータが有り次のＲＡＭ
カード（９）が必要と判断した場合には、ステップ（Ｓ
１０）よりステップ（Ｓ１２）に進み図５に示すように
三角形状の指標セグメント（６ｃ）を点灯駆動し、ＲＡ
Ｍカード（９）を交換するよう指示する。そこで交換指
示に基づきステップ（Ｓ１３）で操作者が次のＲＡＭカ
ード（９）をコネクタ（８）に接続し、キーボード
（３）で転送開始のキー操作を行なうと、制御回路
（１）は前述と同様にしてステップ（Ｓ１４）〜ステッ
プ（Ｓ１７）により、交換されたＲＡＭカード（９）が
正しいか否かの判定を行なう。交換されたＲＡＭカード
（９）が正しければ、ステップ（Ｓ１７）よりステップ
（Ｓ７）に進み交換されたＲＡＭカード（９）にデータ
転送が行なわれるが、ステップ（Ｓ１４）〜ステップ
（Ｓ１７）の判定に於いて、交換されたＲＡＭカード
（９）が正しくないと判定した場合には、ステップ（Ｓ
１８）に進み警報音を発生すると共に図６に示すように
日の字セグメント（６ａ）を点灯させエラー表示を行な
う。交換されたＲＡＭカード（９）に対しても前述と同
様にステップ（Ｓ７）〜（Ｓ１０）の処理が行なわれ、
転送すべきデータが終了すればステップ（Ｓ８）よりス
テップ（Ｓ１１）に進み、図３に示すスタンバイ表示を
行なって転送を終了する。この結果データメモリ（５）
のデータが２枚のＲＡＭカード（９）に記憶される。し
かし２枚のＲＡＭカードでも転送し切れない場合、ステ
ップ（Ｓ１０）よりステップ（Ｓ１２）に進み前述と同
様にして次のＲＡＭカード（９）の交換を促す。
カード（９）が必要と判断した場合には、ステップ（Ｓ
１０）よりステップ（Ｓ１２）に進み図５に示すように
三角形状の指標セグメント（６ｃ）を点灯駆動し、ＲＡ
Ｍカード（９）を交換するよう指示する。そこで交換指
示に基づきステップ（Ｓ１３）で操作者が次のＲＡＭカ
ード（９）をコネクタ（８）に接続し、キーボード
（３）で転送開始のキー操作を行なうと、制御回路
（１）は前述と同様にしてステップ（Ｓ１４）〜ステッ
プ（Ｓ１７）により、交換されたＲＡＭカード（９）が
正しいか否かの判定を行なう。交換されたＲＡＭカード
（９）が正しければ、ステップ（Ｓ１７）よりステップ
（Ｓ７）に進み交換されたＲＡＭカード（９）にデータ
転送が行なわれるが、ステップ（Ｓ１４）〜ステップ
（Ｓ１７）の判定に於いて、交換されたＲＡＭカード
（９）が正しくないと判定した場合には、ステップ（Ｓ
１８）に進み警報音を発生すると共に図６に示すように
日の字セグメント（６ａ）を点灯させエラー表示を行な
う。交換されたＲＡＭカード（９）に対しても前述と同
様にステップ（Ｓ７）〜（Ｓ１０）の処理が行なわれ、
転送すべきデータが終了すればステップ（Ｓ８）よりス
テップ（Ｓ１１）に進み、図３に示すスタンバイ表示を
行なって転送を終了する。この結果データメモリ（５）
のデータが２枚のＲＡＭカード（９）に記憶される。し
かし２枚のＲＡＭカードでも転送し切れない場合、ステ
ップ（Ｓ１０）よりステップ（Ｓ１２）に進み前述と同
様にして次のＲＡＭカード（９）の交換を促す。
【００１３】尚前述の説明はＥＣＲのデータメモリ
（５）からＲＡＭカード（９）へのデータ転送の場合で
あったが、ＲＡＭカード（９）からデータメモリ（５）
にデータ転送する場合も同様にしてデータ転送中及びＲ
ＡＭカード（９）の交換時期を表示器（６）に表示する
ことが出来る。
（５）からＲＡＭカード（９）へのデータ転送の場合で
あったが、ＲＡＭカード（９）からデータメモリ（５）
にデータ転送する場合も同様にしてデータ転送中及びＲ
ＡＭカード（９）の交換時期を表示器（６）に表示する
ことが出来る。
【００１４】又前述の実施例では、日の字セグメント
（６ａ）の中央のセグメント並びに指標セグメント（６
ｃ）の点灯で動作状態を指示するよう構成したが、これ
に限らず他のセグメントを点灯させるように構成しても
良い。
（６ａ）の中央のセグメント並びに指標セグメント（６
ｃ）の点灯で動作状態を指示するよう構成したが、これ
に限らず他のセグメントを点灯させるように構成しても
良い。
【００１５】
【考案の効果】上述の如く本考案の電子式キャッシュレ
ジスタでは、データメモリとＲＡＭカード間のデータ転
送を行なう際に、動作状態並びにＲＡＭカードの交換時
期を表示器の表示セグメントを点灯制御して識別可能に
構成したことにより、ＲＡＭカードの交換時期が明確と
なり、従来のようにデータ転送中にＲＡＭカードを誤っ
て着脱しデータを破壊することがなくなるもので、確実
にデータ転送を行うことができる。また、データ転送の
実行状態は入力されたデータ及び演算処理されたデータ
を表示する複数の日の字セグメントからなる表示手段の
特定のセグメントを点灯駆動するので、別途表示手段を
設ける必要がなくコストアップを抑えることができる。
ジスタでは、データメモリとＲＡＭカード間のデータ転
送を行なう際に、動作状態並びにＲＡＭカードの交換時
期を表示器の表示セグメントを点灯制御して識別可能に
構成したことにより、ＲＡＭカードの交換時期が明確と
なり、従来のようにデータ転送中にＲＡＭカードを誤っ
て着脱しデータを破壊することがなくなるもので、確実
にデータ転送を行うことができる。また、データ転送の
実行状態は入力されたデータ及び演算処理されたデータ
を表示する複数の日の字セグメントからなる表示手段の
特定のセグメントを点灯駆動するので、別途表示手段を
設ける必要がなくコストアップを抑えることができる。
【図１】本考案の構成を示すブロック図である。
【図２】図１の表示器の構成を示す図である。
【図３】図２の表示器の表示状態を示す図である。
【図４】図２の表示器の表示状態を示す図である。
【図５】図２の表示器の表示状態を示す図である。
【図６】図２の表示器の表示状態を示す図である。
【図７】図１の動作状態を示すフローチャートである。
【図８】図１の動作状態を示すフローチャートである。
【図９】図１の動作状態を示すフローチャートである。
１ 制御回路 ３ キーボード ５ データメモリ ６ 表示器 ９ ＲＡＭカード
Claims (1)
- 【請求項１】 データを入力する手段と、入力されたデ
ータ及び演算処理されたデータを表示する複数の日の字
セグメントからなる表示手段と、入力されたデータ及び
演算処理されたデータを記憶する記憶手段と、記憶手段
とデータ転送を行なうＲＡＭカードと、入力データの演
算処理及びデータ転送を制御する制御手段とを備え、制
御手段はデータ転送の実行状態に応じ表示手段の特定の
セグメントを点灯駆動することを特徴とする電子式キャ
ッシュレジスタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1991011886U JP2523210Y2 (ja) | 1991-03-06 | 1991-03-06 | 電子式キャッシュレジスタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1991011886U JP2523210Y2 (ja) | 1991-03-06 | 1991-03-06 | 電子式キャッシュレジスタ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04108282U JPH04108282U (ja) | 1992-09-18 |
| JP2523210Y2 true JP2523210Y2 (ja) | 1997-01-22 |
Family
ID=31900946
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1991011886U Expired - Lifetime JP2523210Y2 (ja) | 1991-03-06 | 1991-03-06 | 電子式キャッシュレジスタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2523210Y2 (ja) |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54152636U (ja) * | 1978-04-14 | 1979-10-24 | ||
| JPH0661086B2 (ja) * | 1986-10-30 | 1994-08-10 | 三菱電機株式会社 | 商品情報レジスタ |
| JPS63165984A (ja) * | 1986-12-27 | 1988-07-09 | Nec Corp | 着脱式ｒａｍカ−ドの電源制御インタフエ−ス回路 |
-
1991
- 1991-03-06 JP JP1991011886U patent/JP2523210Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04108282U (ja) | 1992-09-18 |
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