JP2501888B2 - 故障監視装置 - Google Patents
故障監視装置Info
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- JP2501888B2 JP2501888B2 JP63300989A JP30098988A JP2501888B2 JP 2501888 B2 JP2501888 B2 JP 2501888B2 JP 63300989 A JP63300989 A JP 63300989A JP 30098988 A JP30098988 A JP 30098988A JP 2501888 B2 JP2501888 B2 JP 2501888B2
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Description
【発明の詳細な説明】 ［産業上の利用分野］ この発明は，故障監視装置，特に中央処理装置（以
下,CPUと呼ぶ）および電源装置の故障を監視し，故障検
出時にシステムとして故障処理をする故障監視装置に関
するものである。
下,CPUと呼ぶ）および電源装置の故障を監視し，故障検
出時にシステムとして故障処理をする故障監視装置に関
するものである。
［従来の技術］ 第３図は，従来の故障監視システムの構成を示すブロ
ック図である。図において，（１）は故障監視装置であ
って,CPU（２）および電源装置（３）の各故障を検出
し，監視する。（４）は故障表示装置であって，故障監
視装置（１）と接続され，故障監視装置（１）の故障内
容を表示する。（５）はCPU故障監視回路であって，そ
の入力側がCPU（２）と，その出力側が後述の部分故障
メモリ（７）とそれぞれ接続され,CPU（２）の故障を検
出し，監視する。（６）は電源故障監視回路であって，
その入力側が電源装置（３）と，その出力側が後述の部
分故障メモリ（７）とそれぞれ接続され，電源装置
（３）の故障を検出し，監視する。前記部分故障メモリ
（７）は，その出力側が故障表示装置（４）および後述
の故障処理回路（８）並びに他の故障監視装置（１）の
故障処理回路（８）のそれぞれの入力側と接続され,CPU
（２）および電源装置（３）の各故障情報を記憶する。
前記故障処理回路（８）は部分故障メモリ（７）に記憶
されている故障情報に基づいて故障を処理する。
ック図である。図において，（１）は故障監視装置であ
って,CPU（２）および電源装置（３）の各故障を検出
し，監視する。（４）は故障表示装置であって，故障監
視装置（１）と接続され，故障監視装置（１）の故障内
容を表示する。（５）はCPU故障監視回路であって，そ
の入力側がCPU（２）と，その出力側が後述の部分故障
メモリ（７）とそれぞれ接続され,CPU（２）の故障を検
出し，監視する。（６）は電源故障監視回路であって，
その入力側が電源装置（３）と，その出力側が後述の部
分故障メモリ（７）とそれぞれ接続され，電源装置
（３）の故障を検出し，監視する。前記部分故障メモリ
（７）は，その出力側が故障表示装置（４）および後述
の故障処理回路（８）並びに他の故障監視装置（１）の
故障処理回路（８）のそれぞれの入力側と接続され,CPU
（２）および電源装置（３）の各故障情報を記憶する。
前記故障処理回路（８）は部分故障メモリ（７）に記憶
されている故障情報に基づいて故障を処理する。
なお，故障監視装置（１）は，上述のCPU故障監視回
路（５），電源故障監視回路（６），部分故障メモリ
（７），故障処理回路（８）とから構成されている。ま
た，この図では故障監視装置（１）を複数接続した場合
を示している。
路（５），電源故障監視回路（６），部分故障メモリ
（７），故障処理回路（８）とから構成されている。ま
た，この図では故障監視装置（１）を複数接続した場合
を示している。
従来の故障監視装置は上記のように構成され,CPU
（２）の故障監視をCPU故障監視回路（５）で行い，電
源装置（３）の電源出力断および電圧レベルのチェック
を電源故障監視回路（６）で行っている。CPU故障監視
回路（５）および電源故障監視回路（6a）の故障検出信
号は，部分故障メモリ（７）に入力され，ここで合成さ
れ,No.1故障として故障監視装置（１）より出力され
る。他の故障監視装置（１）の故障検出信号であるNo.2
故障と上記No.1故障の信号が故障処理回路（８）に入力
され，装置間の結合度が強ければ,No.1故障とNo.2故障
のどちらかが検出されてもCPU（２）の出力信号を強制
断するなどの故障処理が故障処理回路（８）にて行われ
る。
（２）の故障監視をCPU故障監視回路（５）で行い，電
源装置（３）の電源出力断および電圧レベルのチェック
を電源故障監視回路（６）で行っている。CPU故障監視
回路（５）および電源故障監視回路（6a）の故障検出信
号は，部分故障メモリ（７）に入力され，ここで合成さ
れ,No.1故障として故障監視装置（１）より出力され
る。他の故障監視装置（１）の故障検出信号であるNo.2
故障と上記No.1故障の信号が故障処理回路（８）に入力
され，装置間の結合度が強ければ,No.1故障とNo.2故障
のどちらかが検出されてもCPU（２）の出力信号を強制
断するなどの故障処理が故障処理回路（８）にて行われ
る。
また,No.1故障,No.2の故障の表示が故障表示装置
（４）にて行われる。
（４）にて行われる。
［発明が解決しようとする課題］ 上記のような従来の故障監視装置では，他の故障監視
装置の内容を数点の信号でしか収集することができず，
故障処理をするには他のCPUの故障内容が分からず，故
障表示をするには装置全体の故障表示だけになり，複数
の装置間の故障処理や故障表示が概略的であるなどの問
題点があった。
装置の内容を数点の信号でしか収集することができず，
故障処理をするには他のCPUの故障内容が分からず，故
障表示をするには装置全体の故障表示だけになり，複数
の装置間の故障処理や故障表示が概略的であるなどの問
題点があった。
この発明は，かかる問題点を解決するためになされた
もので，複数の装置間の故障内容を詳細に通信すること
により，他の装置の故障内容により故障処理内容を正確
に決定できると共に全装置の詳細な故障の表示を一括し
てできる故障監視装置を得ることを目的とする。
もので，複数の装置間の故障内容を詳細に通信すること
により，他の装置の故障内容により故障処理内容を正確
に決定できると共に全装置の詳細な故障の表示を一括し
てできる故障監視装置を得ることを目的とする。
［課題を解決するための手段］ この発明に係る故障監視装置は，中央処理装置の故障
を検出し，監視する中央処理装置故障監視回路と，電源
装置の故障を検出し，監視する電源故障監視回路と，前
記中央処理装置および前記電源装置の故障情報を格納す
る部分故障メモリと，前記故障情報に基づいて故障を処
理する故障処理回路とを有する故障監視装置において，
前記故障情報を送信する送信回路と，他の故障監視装置
の故障情報を受信する受信回路と，この受信回路により
受信される全故障監視装置の故障情報を格納する全体故
障メモリとを備えたものである。
を検出し，監視する中央処理装置故障監視回路と，電源
装置の故障を検出し，監視する電源故障監視回路と，前
記中央処理装置および前記電源装置の故障情報を格納す
る部分故障メモリと，前記故障情報に基づいて故障を処
理する故障処理回路とを有する故障監視装置において，
前記故障情報を送信する送信回路と，他の故障監視装置
の故障情報を受信する受信回路と，この受信回路により
受信される全故障監視装置の故障情報を格納する全体故
障メモリとを備えたものである。
［作用］ この発明においては，通信路により各故障監視装置に
て検出した部分故障の詳細を互いに送受信でき，故障処
理を実行する時に全体の故障内容により，より細かく正
確に処理を決定でき，通信路により全故障監視装置の詳
細な故障内容を表示することができる。
て検出した部分故障の詳細を互いに送受信でき，故障処
理を実行する時に全体の故障内容により，より細かく正
確に処理を決定でき，通信路により全故障監視装置の詳
細な故障内容を表示することができる。
［実施例］ 第１図はこの発明の一実施例による故障監視システム
の構成を示すブロツク図である。図において，（２）〜
（８）は従来のものと同様である。（1A）は故障監視装
置であって，第３図の故障監視装置（１）の他に全体故
障メモリ（９），送信回路（10），受信回路（11）が新
たに設けられている。全体故障メモリ（９）は，その入
力側が受信回路（11）と，その出力側が故障処理回路
（８）と，それぞれ接続され，後述の通信路（12）を介
して受信回路（11）により受信される全故障監視装置の
故障情報を記憶する。通信回路（10）は，その入力側が
部分故障メモリ（７）の出力側と接続され，その出力側
が後述の通信路（12）を介して故障表示装置（４）およ
び他の受信回路（11）の入力側とそれぞれ接続され，部
分故障メモリ（７）に記憶されている故障情報を通信路
（12）に送信する。通信路（12）は各故障監視装置（1
A）の故障情報を後述の第２図に示す伝送フレーム構成
で送受信する。なお，この図でも従来例と同様に故障監
視装置を複数接続した場合を示している。
の構成を示すブロツク図である。図において，（２）〜
（８）は従来のものと同様である。（1A）は故障監視装
置であって，第３図の故障監視装置（１）の他に全体故
障メモリ（９），送信回路（10），受信回路（11）が新
たに設けられている。全体故障メモリ（９）は，その入
力側が受信回路（11）と，その出力側が故障処理回路
（８）と，それぞれ接続され，後述の通信路（12）を介
して受信回路（11）により受信される全故障監視装置の
故障情報を記憶する。通信回路（10）は，その入力側が
部分故障メモリ（７）の出力側と接続され，その出力側
が後述の通信路（12）を介して故障表示装置（４）およ
び他の受信回路（11）の入力側とそれぞれ接続され，部
分故障メモリ（７）に記憶されている故障情報を通信路
（12）に送信する。通信路（12）は各故障監視装置（1
A）の故障情報を後述の第２図に示す伝送フレーム構成
で送受信する。なお，この図でも従来例と同様に故障監
視装置を複数接続した場合を示している。
第２図は故障情報フレーム構成を示す図である。図に
おいて，（13）は通信フレームの開始を示すオープンフ
ラグ，（14）は各装置単位のCPU故障情報，（15）は各
装置単位の電源故障情報，（16）は通信フレームの終了
を示すクローズフラグである。
おいて，（13）は通信フレームの開始を示すオープンフ
ラグ，（14）は各装置単位のCPU故障情報，（15）は各
装置単位の電源故障情報，（16）は通信フレームの終了
を示すクローズフラグである。
上記のように構成された故障監視システムにおいて,C
PU故障監視回路（５）と電源故障監視回路（６）によっ
て検出された故障情報は，部分故障メモリ（８）に入力
され，送信回路（10）により第２図の故障情報フレーム
構成における各装置単位のCPU故障情報（14）と電源故
障情報（15）として通信路（12）に送信されている。さ
らに，第２図の故障情報フレーム構成は，各故障監視装
置（１）の受信回路（11）にて受信され，全故障監視装
置（１）の故障情報として全体故障メモリ（９）に格納
され，故障処理回路（８）の入力となる。この故障処理
回路（８）では，装置間の結合度，各装置のCPU故障情
報（14），電源故障情報（15）の内容により，各装置の
CPU（２）に対する故障処理を行う。
PU故障監視回路（５）と電源故障監視回路（６）によっ
て検出された故障情報は，部分故障メモリ（８）に入力
され，送信回路（10）により第２図の故障情報フレーム
構成における各装置単位のCPU故障情報（14）と電源故
障情報（15）として通信路（12）に送信されている。さ
らに，第２図の故障情報フレーム構成は，各故障監視装
置（１）の受信回路（11）にて受信され，全故障監視装
置（１）の故障情報として全体故障メモリ（９）に格納
され，故障処理回路（８）の入力となる。この故障処理
回路（８）では，装置間の結合度，各装置のCPU故障情
報（14），電源故障情報（15）の内容により，各装置の
CPU（２）に対する故障処理を行う。
また，第２図の故障情報フレーム構成は，故障表示装
置（４）にて受信され，各装置単位に詳細な故障情報と
して表示される。
置（４）にて受信され，各装置単位に詳細な故障情報と
して表示される。
なお，上記実施例では通信路（12）を現在比較的安価
でコンパクトにできるシリアル通信にて説明したが，デ
ータ部が８ビットや16ビットにて構成されるパラレル通
信でも上記実施例と同様の効果を奏する。
でコンパクトにできるシリアル通信にて説明したが，デ
ータ部が８ビットや16ビットにて構成されるパラレル通
信でも上記実施例と同様の効果を奏する。
［発明の効果］ この発明は以上説明したとおり，中央処理装置の故障
を検出し，監視する中央処理装置故障監視回路と，電源
装置の故障を検出し，監視する電源故障監視回路と，前
記中央処理装置および前記電源装置の故障情報を格納す
る部分故障メモリと，前記故障情報に基づいて故障を処
理する故障処理回路とを有する故障監視装置において，
前記故障情報を送信する送信回路と，他の故障監視装置
の故障情報を受信する受信回路と，この受信回路により
受信される全故障監視装置の故障情報を格納する全体故
障メモリとを備え，故障監視装置は故障情報を専用に通
信できる送受信回路を含んだ構成にしたので，各故障監
視装置間にて故障情報を詳細に送受信でき，複数のCPU
から構成されるシステムにおいて，各CPUの故障処理を
細かく正確に決定でき，各装置の故障情報を詳細に一括
表示できる効果がある。
を検出し，監視する中央処理装置故障監視回路と，電源
装置の故障を検出し，監視する電源故障監視回路と，前
記中央処理装置および前記電源装置の故障情報を格納す
る部分故障メモリと，前記故障情報に基づいて故障を処
理する故障処理回路とを有する故障監視装置において，
前記故障情報を送信する送信回路と，他の故障監視装置
の故障情報を受信する受信回路と，この受信回路により
受信される全故障監視装置の故障情報を格納する全体故
障メモリとを備え，故障監視装置は故障情報を専用に通
信できる送受信回路を含んだ構成にしたので，各故障監
視装置間にて故障情報を詳細に送受信でき，複数のCPU
から構成されるシステムにおいて，各CPUの故障処理を
細かく正確に決定でき，各装置の故障情報を詳細に一括
表示できる効果がある。
第１図はこの発明の一実施例による故障監視装置の構成
ブロック図，第２図は通信フォーマットである故障情報
フレーム構成図，第３図は従来の故障監視装置の構成ブ
ロック図である。 図において，（1A）……故障監視装置，（２）……CPU,
（３）……電源装置，（４）……故障表示装置，（５）
……CPU故障監視回路，（６）……電源故障監視回路，
（７）……部分故障メモリ，（８）……故障処理回路，
（９）……全体故障メモリ，（10）……送信回路，（1
1）……受信回路，（12）……通信路である。 なお，各図中同一符号は同一又は相当部分を示す。
ブロック図，第２図は通信フォーマットである故障情報
フレーム構成図，第３図は従来の故障監視装置の構成ブ
ロック図である。 図において，（1A）……故障監視装置，（２）……CPU,
（３）……電源装置，（４）……故障表示装置，（５）
……CPU故障監視回路，（６）……電源故障監視回路，
（７）……部分故障メモリ，（８）……故障処理回路，
（９）……全体故障メモリ，（10）……送信回路，（1
1）……受信回路，（12）……通信路である。 なお，各図中同一符号は同一又は相当部分を示す。
Claims (1)
- 【請求項１】中央処理装置の故障を検出し，監視する中
央処理装置故障監視回路と，電源装置の故障を検出し，
監視する電源故障監視回路と，前記中央処理装置および
前記電源装置の故障情報を格納する部分故障メモリと，
前記故障情報に基づいて前記故障を処理する故障処理回
路とを有する故障監視装置において，前記故障情報を送
信する送信回路と，他の故障監視装置の故障情報を受信
する受信回路と，この受信回路により受信される全故障
監視装置の故障情報を格納する全体故障メモリとを備
え，前記送信回路から送信される情報は通信路を介して
シリアルあるいはパラレルに送信され，前記全体故障メ
モリからの全体故障情報は前記故障処理回路に入力さ
れ，複数の故障監視装置の前記部分故障メモリの内容を
全て故障表示装置に送信するようにしたことを特徴とす
る故障監視装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63300989A JP2501888B2 (ja) | 1988-11-30 | 1988-11-30 | 故障監視装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63300989A JP2501888B2 (ja) | 1988-11-30 | 1988-11-30 | 故障監視装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02148232A JPH02148232A (ja) | 1990-06-07 |
| JP2501888B2 true JP2501888B2 (ja) | 1996-05-29 |
Family
ID=17891488
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63300989A Expired - Lifetime JP2501888B2 (ja) | 1988-11-30 | 1988-11-30 | 故障監視装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2501888B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0439041U (ja) * | 1990-07-26 | 1992-04-02 | ||
| JP4814484B2 (ja) * | 2003-10-06 | 2011-11-16 | ヤンマー株式会社 | 枝豆引抜収穫機 |
-
1988
- 1988-11-30 JP JP63300989A patent/JP2501888B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02148232A (ja) | 1990-06-07 |
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Legal Events
| Date | Code | Title | Description |
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