JP2020150018A - 半導体装置 - Google Patents
半導体装置 Download PDFInfo
- Publication number
- JP2020150018A JP2020150018A JP2019043884A JP2019043884A JP2020150018A JP 2020150018 A JP2020150018 A JP 2020150018A JP 2019043884 A JP2019043884 A JP 2019043884A JP 2019043884 A JP2019043884 A JP 2019043884A JP 2020150018 A JP2020150018 A JP 2020150018A
- Authority
- JP
- Japan
- Prior art keywords
- main
- main terminal
- terminal
- heat sink
- heat radiating
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/34—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
- H01L23/36—Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
- H01L23/373—Cooling facilitated by selection of materials for the device or materials for thermal expansion adaptation, e.g. carbon
- H01L23/3735—Laminates or multilayers, e.g. direct bond copper ceramic substrates
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/34—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
- H01L23/36—Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
- H01L23/367—Cooling facilitated by shape of device
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/02—Containers; Seals
- H01L23/04—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls
- H01L23/043—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls the container being a hollow construction and having a conductive base as a mounting as well as a lead for the semiconductor body
- H01L23/051—Containers; Seals characterised by the shape of the container or parts, e.g. caps, walls the container being a hollow construction and having a conductive base as a mounting as well as a lead for the semiconductor body another lead being formed by a cover plate parallel to the base plate, e.g. sandwich type
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/34—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
- H01L23/42—Fillings or auxiliary members in containers or encapsulations selected or arranged to facilitate heating or cooling
- H01L23/433—Auxiliary members in containers characterised by their shape, e.g. pistons
- H01L23/4334—Auxiliary members in encapsulations
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49517—Additional leads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49517—Additional leads
- H01L23/49531—Additional leads the additional leads being a wiring board
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49537—Plurality of lead frames mounted in one device
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49541—Geometry of the lead-frame
- H01L23/49562—Geometry of the lead-frame for devices being provided for in H01L29/00
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/34—Strap connectors, e.g. copper straps for grounding power devices; Manufacturing methods related thereto
- H01L24/39—Structure, shape, material or disposition of the strap connectors after the connecting process
- H01L24/40—Structure, shape, material or disposition of the strap connectors after the connecting process of an individual strap connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/07—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/18—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different subgroups of the same main group of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/33—Structure, shape, material or disposition of the layer connectors after the connecting process of a plurality of layer connectors
- H01L2224/331—Disposition
- H01L2224/3318—Disposition being disposed on at least two different sides of the body, e.g. dual array
- H01L2224/33181—On opposite sides of the body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49503—Lead-frames or other flat leads characterised by the die pad
- H01L23/49513—Lead-frames or other flat leads characterised by the die pad having bonding material between chip and die pad
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1305—Bipolar Junction Transistor [BJT]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1306—Field-effect transistor [FET]
- H01L2924/13091—Metal-Oxide-Semiconductor Field-Effect Transistor [MOSFET]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Chemical & Material Sciences (AREA)
- Materials Engineering (AREA)
- Ceramic Engineering (AREA)
- Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
【課題】インダクタンスを低減できる半導体装置を提供すること。【解決手段】ヒートシンク50Eは、主端子61Eを介して、半導体素子40に接続されている。主端子61Eは、エミッタ電極41Eに接続された接続部62Eと、接続部に連なり、ヒートシンク50Cと対向する対向部64Eと、接続部62Eとは反対で対向部64Eに連なり、主端子61Cと並んで配置された非対向部65Eを有している。リードフレーム60は、主端子61C及び非対向部65Cの少なくとも一方を複数有している。主端子61C及び非対向部65Cは、側面が互いに対向するように交互に並んで配置され、互いに対向する側面の組を複数有している。【選択図】図6
Description
この明細書における開示は、半導体装置に関する。
特許文献1には、半導体装置が開示されている。半導体装置は、第1主電極及び第2主電極を有する半導体素子と、半導体素子を挟むように配置された放熱部材と、対応する主電極に電気的に接続された主端子を備えている。
半導体装置は、放熱部材として、第1主電極側に配置された第1放熱部材と、第2主電極側に配置された第2放熱部材を備えている。半導体装置は、主端子として、第1主電極に電気的に接続された第1主端子と、第2主電極に電気的に接続された第2主端子を備えている。
特許文献1の半導体装置では、第1主端子が第1放熱部材から延設され、第2主端子が第2放熱部材から延設されている。そして、第1放熱部材が第1主電極に接続され、第2放熱部材がターミナルを介して第2主電極に接続されている。第1放熱部材と第2放熱部材との間には、半導体素子及びターミナルが介在している。また、半導体装置は、第1主端子及び第2主端子をそれぞれ1つ有している。インダクタンスのさらなる低減が求められている。
開示されるひとつの目的は、インダクタンスを低減できる半導体装置を提供することにある。
ここに開示された半導体装置は、
主電極(41)として一面側に第1主電極(41C)を有し、一面とは厚み方向において反対の裏面側に第2主電極(41E)を有する少なくともひとつの半導体素子(40)と、
半導体素子を挟むように配置された放熱部材(50)であって、一面側に配置され、第1主電極に接続された第1放熱部材(50C)、及び、裏面側に配置された第2放熱部材(50E)と、
対応する主電極に電気的に接続された主端子(61)であって、第1放熱部材に接続された第1主端子(61C)、及び、第2主電極に接続された第2主端子(61E)を含むリードフレーム(60)と、
を備えている。
主電極(41)として一面側に第1主電極(41C)を有し、一面とは厚み方向において反対の裏面側に第2主電極(41E)を有する少なくともひとつの半導体素子(40)と、
半導体素子を挟むように配置された放熱部材(50)であって、一面側に配置され、第1主電極に接続された第1放熱部材(50C)、及び、裏面側に配置された第2放熱部材(50E)と、
対応する主電極に電気的に接続された主端子(61)であって、第1放熱部材に接続された第1主端子(61C)、及び、第2主電極に接続された第2主端子(61E)を含むリードフレーム(60)と、
を備えている。
この半導体装置において、第2主端子は、第2主電極との接続部(62E)と、接続部から延設された部分であって、接続部に連なり、第1放熱部材と対向する対向部(64E)、及び、接続部とは反対で対向部に連なり、厚み方向に直交する一方向において第1主端子と並んで配置された非対向部(65E)を有し、
第2放熱部材は、第2主端子を介して、半導体素子に接続されており、
リードフレームは、第1主端子及び第2主端子の非対向部の少なくとも一方を複数有し、
第1主端子及び第2主端子の非対向部は、側面が互いに対向するように交互に並んで配置され、互いに対向する側面の組を複数有している。
第2放熱部材は、第2主端子を介して、半導体素子に接続されており、
リードフレームは、第1主端子及び第2主端子の非対向部の少なくとも一方を複数有し、
第1主端子及び第2主端子の非対向部は、側面が互いに対向するように交互に並んで配置され、互いに対向する側面の組を複数有している。
開示された半導体装置によると、主端子を含むリードフレームが、放熱部材とは別部材として設けられている。第2主端子は、第2放熱部材と半導体素子の間に配置され、第2電極に接続されている。第1放熱部材は、第1主電極と同電位の部分である。第1放熱部材と対向する第2主電極と同電位の部分として、第2主端子の対向部がもっとも近くなる。また、第1主端子と第2主端子の非対向部とは、側面が互いに対向するように交互に配置されている。第1主端子と第2主端子(非対向部)とは、対向する側面の組を複数有している。この結果、インダクタンスを低減できる半導体装置を提供することができる。
この明細書における開示された複数の態様は、それぞれの目的を達成するために、互いに異なる技術的手段を採用する。請求の範囲及びこの項に記載した括弧内の符号は、後述する実施形態の部分との対応関係を例示的に示すものであって、技術的範囲を限定することを意図するものではない。この明細書に開示される目的、特徴、及び効果は、後続の詳細な説明、及び添付の図面を参照することによってより明確になる。
図面を参照しながら、複数の実施形態を説明する。複数の実施形態において、機能的に及び/又は構造的に対応する部分には同一の参照符号を付与する。以下において、半導体素子の厚み方向をZ方向、Z方向に直交する一方向をX方向と示す。また、Z方向及びX方向の両方向に直交する方向をY方向と示す。特に断わりのない限り、上記したX方向及びY方向により規定されるXY面に沿う形状を平面形状とする。
(第1実施形態)
先ず、図1に基づき、半導体装置が適用される電力変換装置について説明する。
先ず、図1に基づき、半導体装置が適用される電力変換装置について説明する。
<電力変換装置の概略構成>
図1に示す電力変換装置1は、たとえば電気自動車やハイブリッド自動車に搭載される。電力変換装置1は、車両に搭載された直流電源2から供給される直流電圧を、三相交流に変換して、三相交流方式のモータ3に出力する。モータ3は、車両の走行駆動源として機能する。電力変換装置1は、モータ3により発電された電力を、直流に変換して直流電源2に充電することもできる。発電機能を有するモータ3は、モータジェネレータと称されることがある。電力変換装置1は、双方向の電力変換が可能となっている。
図1に示す電力変換装置1は、たとえば電気自動車やハイブリッド自動車に搭載される。電力変換装置1は、車両に搭載された直流電源2から供給される直流電圧を、三相交流に変換して、三相交流方式のモータ3に出力する。モータ3は、車両の走行駆動源として機能する。電力変換装置1は、モータ3により発電された電力を、直流に変換して直流電源2に充電することもできる。発電機能を有するモータ3は、モータジェネレータと称されることがある。電力変換装置1は、双方向の電力変換が可能となっている。
電力変換装置1は、平滑コンデンサ4と、電力変換器であるインバータ5を有している。平滑コンデンサ4の正極側端子は、直流電源2の高電位側の電極である正極に接続され、負極側端子は、直流電源2の低電位側の電極である負極に接続されている。インバータ5は、入力された直流電力を所定周波数の三相交流に変換し、モータ3に出力する。インバータ5は、モータ3により発電された交流電力を、直流電力に変換する。インバータ5は、DC−AC変換部である。
インバータ5は、三相分の上下アーム回路6を備えて構成されている。各相の上下アーム回路6は、正極側の電源ラインである高電位電源ライン7と、負極側の電源ラインである低電位電源ライン8の間で、2つのアームが直列に接続されてなる。各相の上下アーム回路6において、上アームと下アームの接続点は、モータ3への出力ライン9に接続されている。
本実施形態では、各アームを構成するスイッチング素子として、nチャネル型の絶縁ゲートバイポーラトランジスタ6i(以下、IGBT6iと示す)を採用している。IGBT6iのそれぞれには、還流用のダイオードであるFWD6dが逆並列に接続されている。一相分の上下アーム回路6は、2つのIGBT6iを有して構成されている。上アームにおいて、IGBT6iのコレクタ電極が、高電位電源ライン7に接続されている。下アームにおいて、IGBT6iのエミッタ電極が、低電位電源ライン8に接続されている。そして、上アームにおけるIGBT6iのエミッタ電極と、下アームにおけるIGBT6iのコレクタ電極が相互に接続されている。
電力変換装置1は、上記した平滑コンデンサ4及びインバータ5に加えて、インバータ5とは別の電力変換器であるコンバータ、インバータ5やコンバータを構成するスイッチング素子の駆動回路などを備えてもよい。コンバータは、直流電圧を異なる値の直流電圧に変換するDC−DC変換部である。
<半導体装置>
図2〜図9に示すように、半導体装置20は、封止樹脂体30と、半導体素子40と、ヒートシンク50と、主端子61及び信号端子67を含むリードフレーム60を備えている。図3では、図2に対して封止樹脂体30内の要素を示している。図5では、便宜上、封止樹脂体30を省略して図示している。図8では、リードフレーム60の接続状態、具体的には半導体素子40や後述するヒートシンク50Cとの接続状態を示している。図9では、各ヒートシンク50とリードフレーム60の位置関係を示している。図8及び図9では、リードフレーム60として、タイバーカット前の状態を示している。
図2〜図9に示すように、半導体装置20は、封止樹脂体30と、半導体素子40と、ヒートシンク50と、主端子61及び信号端子67を含むリードフレーム60を備えている。図3では、図2に対して封止樹脂体30内の要素を示している。図5では、便宜上、封止樹脂体30を省略して図示している。図8では、リードフレーム60の接続状態、具体的には半導体素子40や後述するヒートシンク50Cとの接続状態を示している。図9では、各ヒートシンク50とリードフレーム60の位置関係を示している。図8及び図9では、リードフレーム60として、タイバーカット前の状態を示している。
封止樹脂体30は、半導体装置20を構成する他の要素の一部を封止している。他の要素の残りの部分は、封止樹脂体30の外に露出されている。封止樹脂体30は、たとえば半導体素子40を封止している。封止樹脂体30は、半導体装置20を構成する他の要素間に形成された接続部分を封止している。封止樹脂体30は、半導体素子40とリードフレーム60との接続部分を封止している。封止樹脂体30は、ヒートシンク50とリードフレーム60との接続部分を封止している。封止樹脂体30は、モールド樹脂と称されることがある。
封止樹脂体30は、たとえばエポキシ系樹脂からなる。封止樹脂体30は、たとえばトランスファモールド法により成形されている。図2、図3、及び図4に示すように、封止樹脂体30は、Z方向において、一面300と、一面310と反対の裏面301を有している。一面300及び裏面301は、たとえば平坦面となっている。封止樹脂体30は、一面300と裏面301とをつなぐ側面を有している。本実施形態では、封止樹脂体30が、平面略矩形状をなしている。封止樹脂体30は、主端子61が外部に突出する側面302と、信号端子67が外部に突出する側面303を有している。側面303は、Y方向において側面302とは反対の面である。
半導体素子40は、Si、SiC、GaNなどの半導体基板に、素子が形成されてなる。半導体装置20は、少なくともひとつの半導体素子40を備えている。本実施形態では、半導体素子40を構成する半導体基板に、IGBT6i及びFWD6dが形成されている。このように、半導体素子40として、RC(Reverse Conducting)−IGBTを採用している。半導体素子40は、上記したアームのひとつを構成する。半導体素子40は、半導体チップと称されることがある。
半導体素子40は、Z方向に主電流が流れるように縦型構造をなしている。図示を省略するが、半導体素子40は、ゲート電極を有している。ゲート電極は、たとえばトレンチ構造をなしている。図6及び図7に示すように、半導体素子40は、自身の厚み方向、すなわちZ方向における両面に、主電極41を有している。主電極41間に、主電流が流れる。具体的には、主電極41として、一面側にコレクタ電極41Cを有し、一面と反対の裏面側にエミッタ電極41Eを有している。コレクタ電極41CはFWD6dのカソード電極も兼ねており、エミッタ電極41EはFWD6dのアノード電極も兼ねている。コレクタ電極41Cは、一面のほぼ全域に形成されている。エミッタ電極41Eは、裏面の一部に形成されている。コレクタ電極41Cが第1主電極に相当し、エミッタ電極41Eが第2主電極に相当する。
図3及び図6に示すように、半導体素子40は、エミッタ電極41Eの形成面に、信号用の電極であるパッド42を有している。パッド42は、エミッタ電極41Eとは別の位置に形成されている。パッド42は、エミッタ電極41Eと電気的に分離されている。半導体素子40は、平面略矩形状をなしている。パッド42は、Y方向において、エミッタ電極41Eの形成領域とは反対側の端部に形成されている。
半導体素子40は、たとえば5つのパッド42を有している。具体的には、パッド42として、ゲート電極用、エミッタ電極41Eの電位検出用、電流センス用、半導体素子40の温度検出用を有している。温度検出用のパッド42として、温度検出素子である感温ダイオードのアノード電位用と、カソード電位用を有している。5つのパッド42は、X方向に並んで形成されている。
主電極41、パッド42など電極の構成材料としては、たとえばAl系の材料を用いることができる。はんだなどによって接合される場合には、材料としてCuを含むとよい。たとえばAlCuSiを用いることができる。
ヒートシンク50は、Z方向において半導体素子40を挟むように配置された放熱部材である。ヒートシンク50は、半導体素子40の生じた熱を放熱する機能を果たす。ヒートシンク50は、Z方向において半導体素子40を挟むように、対をなして設けられている。半導体装置20は、一対のヒートシンク50として、コレクタ電極41C側に配置されたヒートシンク50Cと、エミッタ電極41E側に配置されたヒートシンク50Eを有している。ヒートシンク50Cが第1放熱部材に相当し、ヒートシンク50Eが第2放熱部材に相当する。
ヒートシンク50C,50Eは、Z方向からの平面視において、半導体素子40を内包するように設けられている。ヒートシンク50Cは、Z方向において、半導体素子40側の実装面500Cと、実装面500Cとは反対の放熱面501Cを有している。ヒートシンク50Eは、Z方向において、半導体素子40側の実装面500Eと、実装面500Eとは反対の放熱面501Eを有している。実装面500C,500Eは、Z方向において互いに対向している。実装面500C,500Eは、互いに略平行とされている。実装面500Cが、第1放熱部材における対向面に相当する。
本実施形態では、ヒートシンク50C,50Eが、平面略矩形状をなしている。X方向の長さは、ヒートシンク50C,50Eでほぼ一致している。Y方向の長さは、ヒートシンク50Cのほうがヒートシンク50Eよりも長い。図3、図5、図6などに示すように、ヒートシンク50Cは、Y方向においてヒートシンク50Eを跨いでいる。ヒートシンク50Cは、重なり部51Cと、非重なり部52Cを有している。重なり部51Cは、Z方向からの平面視において、ヒートシンク50Eと重なる部分である。重なり部51Cは、Z方向においてヒートシンク50Eの実装面500Eと対向する領域である。非重なり部52Cは、重なり部51Cに対して、Y方向であって主端子61側に連なっている。非重なり部52Cは、ヒートシンク50Eと重なっていない部分である。
ヒートシンク50Cの実装面500Cには、接合部材80を介して、コレクタ電極41Cが接続されている。コレクタ電極41Cは、ヒートシンク50Cの重なり部51Cに接続されている。ヒートシンク50Cには、コレクタ電極41Cに対応する主端子61(主端子61C)が接続されている。主端子61Cは、ヒートシンク50Cの非重なり部52Cに接続されている。主端子61Cは、ヒートシンク50Cを介して、コレクタ電極41Cと電気的に接続されている。ヒートシンク50Cは、コレクタ電極41Cと主端子61Cとをつなぐ配線としての機能も果たす。
ヒートシンク50Eの実装面500Eには、接合部材81を介して、エミッタ電極41Eに対応する主端子61(主端子61E)が接続されている。主端子61Eには、接合部材82を介して、エミッタ電極41Eが接続されている。ヒートシンク50Eは、接合部材81,82及び主端子61Eを介して、エミッタ電極41Eに接続されている。主端子61Eは、ヒートシンク50Eを介さずに、エミッタ電極41Eと電気的に接続されている。
ヒートシンク50C,50Eそれぞれの少なくとも一部は、封止樹脂体30によって封止されている。本実施形態では、ヒートシンク50Cの放熱面501Cが、封止樹脂体30から露出されている。放熱面501Cは、一面300と略面一とされている。ヒートシンク50Cの表面のうち、コレクタ電極41Cとの接続部、放熱面501C、主端子61Cとの接続部、を除く部分が、封止樹脂体30によって覆われている。同様に、ヒートシンク50Eの放熱面501Eが、封止樹脂体30から露出されている。放熱面501Eは、裏面301と略面一とされている。ヒートシンク50Eの表面のうち、主端子61Eとの接続部、放熱面501E、を除く部分が、封止樹脂体30によって覆われている。
ヒートシンク50としては、たとえば金属板、金属体と絶縁体の複合材、を採用することができる。複合材として、たとえばDBC(Direct Bonded Copper)基板がある。ヒートシンク50Cとヒートシンク50Eとで、同じ種類の部材を用いてもよいし、互いに異なる部材を用いてもよい。本実施形態では、図3、図6、図7などに示すように、ヒートシンク50C,50EとしてDBC基板を採用している。
ヒートシンク50は、絶縁体50xと、絶縁体50xを挟むように配置された金属体50y,50zを有している。絶縁体50xは、セラミックス基板である。金属体50y,50zは、たとえばCuを含んで形成されている。金属体50y,50zは、絶縁体50xに対して直接的に接合されている。ヒートシンク50は、半導体素子40側から、金属体50y、絶縁体50x、金属体50zの順に積層されている。ヒートシンク50は、3層構造をなしている。
金属体50y,50zの平面形状及び大きさは、互いに略一致している。中間層である絶縁体50xの平面形状は、金属体50y,50zと相似とされている。絶縁体50cの大きさは、金属体50y,50zよりも大きくされている。絶縁体50xは、全周で金属体50y,50zよりも外側まで延設されている。ヒートシンク50C,50Eにおいて、金属体50yの一面が、実装面500C,500Eをなしている。ヒートシンク50C,50Eにおいて、金属体50zの一面が、放熱面501C,501Eをなしている。
リードフレーム60は、外部接続端子を備えている。外部接続端子は、上記したアームを、半導体装置20の外部と電気的に接続する。半導体装置20の外部とは、たとえば他の半導体装置20、平滑コンデンサ4などである。リードフレーム60は、外部接続端子として、主端子61と、信号端子67を備えている。リードフレーム60は、ヒートシンク50とは別部材として構成されている。リードフレーム60は、Z方向において、ヒートシンク50C,50Eの間に配置されている。リードフレーム60は、Cuなどを材料とする金属板を、プレスなどによって加工してなる。
主端子61は、主電流が流れる外部接続端子である。リードフレーム60には、複数の主端子61が設けられている。主端子61は、対応する主電極41に電気的に接続されている。半導体装置20は、主端子61として、コレクタ電極41Cに電気的に接続された主端子61Cと、エミッタ電極41Eに電気的に接続された主端子61Eを有している。主端子61Cが第1主端子に相当し、主端子61Eが第2主端子に相当する。主端子61Cは、コレクタ端子と称されることがある。主端子61Eは、エミッタ端子と称されることがある。
主端子61における主電極41との電気的な接続部分は、封止樹脂体30によって封止されている。主端子61のそれぞれは、主電極41との電気的な接続部分から、Y方向であって半導体素子40に対して遠ざかる方向に延びている。すべての主端子61は、封止樹脂体30の側面302から外部に突出している。
図3、図5、図7などに示すように、主端子61Cは、接続部62Cと、延設部63Cを有している。接続部62Cは、主端子61Cのうち、ヒートシンク50Cとの接続部分である。主端子61Cは、はんだなどの接合部材を介して、ヒートシンク50Cに接続されてもよい。主端子61Cは、超音波接合、摩擦撹拌接合、レーザ溶接などにより、ヒートシンク50Cに直接的に接続されてもよい。延設部63Cは、接続部62Cから延設された部分である。延設部63Cは、接続部62Cに一体的に連なっている。
図3、図5、図6などに示すように、主端子61Eは、接続部62Eと、延設部63Eを有している。接続部62Eは、主端子61Eのうち、エミッタ電極41Eとの接続部分である。上記したように、主端子61Eの接続部62Eは、接合部材82を介して、エミッタ電極41Eに接続されている。接続部62Eは、Z方向からの平面視において、エミッタ電極41Eと重なる部分である。主端子61Eは、接続部62Eを含んでヒートシンク50Eに接続されている。接続部62Eにおいて、一面側に接合部材81が配置され、一面と反対側に接合部材82が配置されている。Z方向からの平面視において、接合部材81,82の少なくとも一部が、互いに重なっている。
延設部63Eは、接続部62Eから延設された部分である。延設部63Eは、接続部62Eに一体的に連なっている。延設部63Cは、対向部64Eと、非対向部65Eを有している。対向部64Eは、ヒートシンク50Cと対向する部分である。対向部64Eは、Z方向においてヒートシンク50Cの実装面500Cと対向している。対向部64Eの一端に接続部62Eが連なり、他端に非対向部65Eが連なっている。
非対向部65Eは、ヒートシンク50Cと対向していない部分である。非対向部65Eは、対向部64Eから、半導体素子40に対して遠ざかる方向に延設されている。非対向部65Eは、Z方向に直交する一方向において、主端子61Cの延設部63Cと並んで配置されている。主端子61Cの延設部63Cと主端子61Eの非対向部65Eは、側面610C,610Eが互いに対向するように配置されている。延設部63Cの一部及び非対向部65Eの一部が、外部との接続部分として提供される。延設部63C及び非対向部65Eは、端子部と称されることがある。リードフレーム60は、主端子61C及び非対向部65Eの少なくとも一方を複数有している。
主端子61C及び非対向部65Eは、並び方向において交互に配置されている。交互とは、並び方向において、主端子61Cと主端子61Eとが隣り合う配置である。主端子61C及び非対向部65Eは、板面同士が対向するのではなく、側面610C,610E同士が対向している。交互配置により、リードフレーム60は、対向する側面610C,610Eを複数組有している。側面610C,610Eは、主端子61の板厚方向において少なくとも一部が対向すればよい。たとえば板厚方向にずれて設けられてもよい。好ましくは、互いに対向する側面710C,710Eのひとつが、他のひとつと厚み方向の全域で対向する配置がよい。
なお、交互の最小構成は、2本の主端子61Cと1本の非対向部65Eの組み合わせ、又は、1本の主端子61Cと2本の非対向部65Eの組み合わせである。たとえば2本の主端子61Cと1本の非対向部65Eの場合、並び方向において、主端子61C、非対向部65E、主端子61Cの配置となる。互いに対向する側面610C,610Eが2組形成される。
本実施形態では、リードフレーム60が4本の主端子61Cと、5本の非対向部65Eを有している。リードフレーム60の板厚は、全域でほぼ均一とされている。複数の主端子61Cは、互いに略同一構造とされている。主端子61Cの接続部62Cは、ヒートシンク50Cの実装面500Cのうち、非重なり部52Cに超音波接合されている。接続部62Cは、ヒートシンク50Cを構成する金属体50yに接続されている。接続部62Cは、Y方向における一端付近で、実装面500Cに接続されている。
延設部63Cは、Z方向の平面視において、Y方向に沿って延びている。すなわち、主端子61Cが、同平面視において、Y方向に沿って延びている。主端子61Cは、幅をほぼ一定として延設されている。延設部63Cは、屈曲部を有している。延設部63Cは、Z方向において接続部62Cよりも実装面500Eに近い位置で、封止樹脂体30から突出している。主端子61Cは、YZ平面においてクランク形状をなしている。
主端子61Eは、接続部62Eをひとつのみ有している。主端子61Eは、複数の非対向部65Eに対して一体的に設けられた共通の接続部62Eを有している。リードフレーム60は、5本の延設部63Eを有している。非対向部65Eを含む延設部63Eのそれぞれは、互いに共通するひとつの接続部62Eから延設されている。延設部63Eは、実装面500C,500Eに対して略平行に延設されている延設部63Eの板面が、実装面500C,500Eと対向している。複数の対向部64Eは、互いに離間しつつX方向に並んでいる。対向部64Eは、ヒートシンク50Eの実装面500Eとの間に所定のギャップを有しつつ、延設されている。対向部64Eと実装面500Eとの間には、封止樹脂体30が介在している。
複数の非対向部65Eは、互いに略同一構造とされている。非対向部65Eは、幅をほぼ一定として、Y方向に延設されている。非対向部65Eの幅は、主端子61Eの幅とほぼ同じとされている。非対向部65E及び主端子61は、X方向において交互に配置されている。非対向部65Eは、並び方向の両端に配置されている。主端子61Cの屈曲部よりも先端側において、主端子61C及び非対向部65Eは、Z方向においてほぼ同じ位置に配置されている。そして、側面610C,610Eのほぼ全面が、対向している。リードフレーム60は、図4に示すように、互いに対向する側面610C,610Eの組を、8組有している。側面610C,610Eの対向距離、換言すれば主端子61と非対向部65E(第2主端子61E)とのピッチは、ほぼ一定とされている。
主端子61C,61Eは、図8に示すように、X方向において、半導体素子40の素子的中心を通る中心線CLに対して線対称配置とされている。素子的中心とは、本実施形態のように半導体素子40がひとつの場合、半導体素子40の中心である。半導体素子40がたとえば2つの場合、2つの半導体素子40の並び方向において中心間の中央位置である。中心線CLは、X方向に直交し、素子的中心を通る仮想線である。
信号端子67は、対応する半導体素子40のパッド42に電気的に接続されている。リードフレーム60は、複数の信号端子67を有している。信号端子67は、封止樹脂体30の内部でパッド42に接続されている。各パッド42に接続された5つの信号端子67は、それぞれY方向であって半導体素子40から離れる方向に延びている。信号端子67は、X方向に並んで配置されている。すべての信号端子67は、封止樹脂体30の側面303から外部に突出している。
本実施形態では、図6に示すように、信号端子67が、接合部材83を介してパッド42に接続されている。上記した接合部材80,81,82,83としては、はんだや、Agなどを含む導電性ペーストを用いることができる。本実施形態では、接合部材80,81,82,83として、はんだを用いている。
リードフレーム60は、吊りリード68を有している。図8及び図9に示すリードフレーム60は、タイバーカット前の状態で、外周フレーム69と、タイバー70,71を有している。外周フレーム69は、外周枠体と称されることがある。タイバー70は、X方向に延設されており、その両端で外周フレーム69に連なっている。複数の信号端子67は、タイバー70によって外周フレーム69に支持されている。吊りリード68の一端は接続部62Eに連なり、他端はタイバー70に連なっている。X方向において信号端子67を挟むように、2本の吊りリード68が設けられている。
タイバー71は、Y方向においてタイバー70との間に半導体素子40が配置されるように、半導体素子40に対してタイバー70とは反対側に設けられている。タイバー71は、X方向に延設されており、その両端で外周フレーム69に連なっている。複数の主端子61Cは、タイバー71によって外周フレーム69に支持されている。タイバー71は、延設部63Cに連なっている。複数の非対向部65Eは、タイバー71によって外周フレーム69に支持されている。主端子61C,61Eの延設部63C,63Eの先端は、Y方向において外周フレーム69に連なっている。接続部62Eは、吊りリード68を介してタイバー70に連なり、延設部63Eを介してタイバー71に連なっている。
封止樹脂体30の成形後、外周フレーム69及びタイバー70,71など、リードフレーム60の不要部分が除去される。これにより、半導体装置20において、主端子61C,61Eは、互いに電気的に分離される。また、複数の信号端子67も電気的に分離される。半導体装置20は、リードフレーム60として、外周フレーム69及びタイバー70,71を有さず、主端子61、信号端子67、及び吊りリード68を有している。
以上のように構成される半導体装置10では、封止樹脂体30により、半導体素子40、ヒートシンク50それぞれの一部、主端子61それぞれの一部、及び信号端子67それぞれの一部が、一体的に封止されている。すなわち、1つのアームを構成する要素が封止されている。このような半導体装置20は、1in1パッケージと称されることがある。
また、ヒートシンク50Cの放熱面501Cが、封止樹脂体30の一面300と略面一とされている。ヒートシンク50Eの放熱面501Eが、封止樹脂体30の裏面301と略面一とされている。半導体装置20は、放熱面501C,501Eがともに封止樹脂体30から露出された両面放熱構造をなしている。このような半導体装置20は、たとえば、ヒートシンク50を、封止樹脂体30とともに切削加工することで形成することができる。また、放熱面501C,501Eを、封止樹脂体30を成形する型のキャビティ壁面に接触させた状態で、封止樹脂体30を成形してもよい。
<第1実施形態のまとめ>
図10は、半導体装置の従来構造を示す比較例である。比較例では、関連する要素について、本実施形態の要素に付与した符号の末尾に、rを付加して示している。図10に示すように、比較例の半導体装置20rは、ボンディングワイヤ85rと、ターミナル90rを備えている。信号端子67rは、ボンディングワイヤ85rを介して、半導体素子40rの図示しないパッドに接続されている。ターミナル90rは、半導体素子40rの図示しないエミッタ電極と、ヒートシンク50Erとの間に介在している。ターミナル90rは、ボンディングワイヤ85rの高さを確保するスペーサとしての機能を果たす。
図10は、半導体装置の従来構造を示す比較例である。比較例では、関連する要素について、本実施形態の要素に付与した符号の末尾に、rを付加して示している。図10に示すように、比較例の半導体装置20rは、ボンディングワイヤ85rと、ターミナル90rを備えている。信号端子67rは、ボンディングワイヤ85rを介して、半導体素子40rの図示しないパッドに接続されている。ターミナル90rは、半導体素子40rの図示しないエミッタ電極と、ヒートシンク50Erとの間に介在している。ターミナル90rは、ボンディングワイヤ85rの高さを確保するスペーサとしての機能を果たす。
ヒートシンク50Erは、ターミナル90rを介して、エミッタ電極と熱的且つ電気的に接続されている。主端子61Erは、ヒートシンク50Erに連なっている。主端子61Erは、たとえばヒートシンク50Erに接続されている。ヒートシンク50Erは、半導体素子40の生じた熱を放熱する機能と、エミッタ電極と主端子61Erとをつなぐ配線としての機能を果たす。
このような構成では、エミッタ電極と同電位の部分として、主としてヒートシンク50Erが、コレクタ電極と同電位のヒートシンク50Crに対向している。ヒートシンク50Erの実装面500Erが、ヒートシンク50Crの実装面500Crの大部分と対向している。図10に破線矢印で示すように、ヒートシンク50Cr,50Erで主電流の向きは略逆向きとなる。これにより、主電流が流れたときに生じる磁束を互いに打ち消し、インダクタンスを低減することができる。インダクタンスの低減に寄与する対向距離Drは、実装面500Cr,500Er間の距離である。
これに対し、本実施形態では、主端子61を含むリードフレーム60が、ヒートシンク50とは別部材として設けられている。主端子61Eは、ヒートシンク50Eと半導体素子40との間に配置され、エミッタ電極41Eに接続されている。これにより、図6に示すように、ヒートシンク50Cと対向するエミッタ電極41Eと同電位の部分として、主端子61Eの対向部64Eがもっとも近くなる。エミッタ電極と同電位の部分として、主として主端子61Eが、ヒートシンク50Cに対向している。対向部64Eとヒートシンク50Cの実装面500Cとの対向距離D1は、上記した対向距離Drよりも短い。これにより、磁束打ち消しの効果を比較例よりも高めることができる。この結果、図11に示すように、比較例よりもインダクタンスを低減することができる。図11は、ヒートシンク50C(50Cr)とエミッタ電位側の対向部分とのインダクタンスについて、磁場解析(シミュレーション)を行った結果を示している。
また、主端子61C(延設部63C)と主端子61Eの非対向部65Eとが、交互に配置されている。そして、隣り合う主端子61Cと非対向部65Eの側面610C,610E同士が対向している。主端子61Cと非対向部65Eとで、主電流の向きは略逆向きとなる。これにより、主電流が流れたときに生じる磁束を互いに打ち消し、インダクタンスを低減することができる。しかしながら、側面は板面に較べて小さい。これに対し、リードフレーム60は、対向する側面610C,610Eを、複数組有している。したがって、インダクタンスを効果的に低減することができる。また、同じ種類の主端子61C、対向部65Eをそれぞれ複数本にして並列化している。これによっても、インダクタンスを低減することができる。
以上により、本実施形態の半導体装置20によれば、インダクタンスを低減することができる。
図12は、対向する側面610C,610Eを複数組有する効果を示す図である。図12は、主端子61の端子部の合計本数とインダクタンスとの関係を示す磁場解析結果である。端子部は、上記したように、主端子61において外部との接続として提供される部分である。リードフレーム60は、端子部として、主端子61Cの延設部63Cと、主端子61Eの非対向部65Eを含む。
端子部が2本、すなわち主端子61Cと非対向部65Eを1本ずつ備える構成を基準とする。図12に示すように、端子部の合計本数を3本以上にすると、2本に較べて、インダクタンスを低減できることが明らかである。本実施形態では、主端子61C及び非対向部65Eの少なくとも一方を複数本有しているため、インダクタンスを低減することができる。また、端子部の本数を増やすほど、インダクタンスを低減できることが明らかである。本実施形態では、主端子61Cを4本、主端子61Eの非対向部65Eを5本有している。よって、インダクタンスを効果的に低減することができる。
主端子61の構成は、主端子61Cを4本、主端子61Eの非対向部65Eを5本有する例に限定されない。主端子61Cの本数を、主端子61E(非対向部65E)の本数より多くしてもよい。たとえば主端子61Cを5本、非対向部65Eを4本としてもよい。この場合、主端子61Cが、並び方向の両端に配置されることとなる。端子部の合計本数は奇数に限定されない。偶数としてもよい。図13に示す変形例では、主端子61Cが3本、非対向部65Eが3本の計6本とされている。
主端子61Eは、複数の接続部62Eを有してもよい。たとえば接続部62Eを非対向部65Eと同数とすれば、主端子61Eは、主端子61C同様、1本ずつ独立した構造となる。図14に示す変形例では、主端子61Eが、4本の非対向部65Eを有している。主端子61Eは接続部62Eを2つ有しており、接続部62Eのそれぞれから延設部63Eが2本ずつ延びている。2つの接続部62EはX方向に並んで配置され、この配置状態で、半導体素子40のエミッタ電極41Eに接続されている。
これに対し、本実施形態では、主端子61Eが、接続部62Eをひとつのみ有している。接続部62Eがひとつなので、半導体素子40のエミッタ電極41Eに対して位置決めしやすい。ひとつの接続部62Eを位置決めすれば、すべての対向部64Eが、ヒートシンク50Cに対して所望の位置関係となる。これにより、インダクタンスを効果的に低減することができる。また、接続部62Eを複数に分割する構成に較べて、エミッタ電極41Eからヒートシンク50Eまでの伝熱経路において、熱抵抗を低減することができる。さらには、生産性を向上することができる。
なお、リードフレーム60の接続部62Eに、Auめっきなど、濡れ性をよくする処理をしてもよい。たとえば、半導体素子40側の面にAuめっきを施すことで、半導体素子40がリードフレーム60に対してセルフアラインする。これにより、製造工程を簡素化することができる。
図示を省略するが、信号端子67は、ボンディングワイヤを介して、半導体素子40のパッド42に電気的に接続されてもよい。この場合、リードフレーム60の板厚を厚くすることで、ボンディングワイヤの高さを稼ぐこととなる。しかしながら、対向部64Eがヒートシンク50Cの実装面500Cに対して近いため、上記した比較例に較べてインダクタンスを低減することができる。
これに対し、本実施形態では、信号端子67が、接合部材83を介してパッド42に接続されている。半導体装置20は、ボンディングレス構造とされている。半導体素子40とヒートシンク50Eとの間に、ボンディングワイヤの高さを確保しなくてもよい。リードフレーム60が薄いため、比較例に較べて、エミッタ電極41Eからヒートシンク50Eまでの距離を短くすることができる。よって、図15に示すように、比較例に較べて熱抵抗を小さくすることができる。すなわち、放熱性を向上することができる。
リードフレーム60が薄いため、図6に示す実装面500C,500E間の対向距離D2は、参考例の対向距離Drよりも短くなる。したがって、半導体装置20を、Z方向において小型化することができる。さらには、ボンディングワイヤが不要であるため、接合部材80,81,82,83の一括リフローが可能である。これにより、製造工程を簡素化することができる。図15は熱解析(シミュレーション)の結果を示している。
ヒートシンク50Cに対する主端子61Cの接続位置は特に限定されない。たとえば、主端子61Cが、ヒートシンク50Cの側面に接続されてもよい。本実施形態では、ヒートシンク50Cのほうが、ヒートシンク50EよりもY方向において長くされている。これにより、ヒートシンク50Cが、重なり部51Cと、非重なり部52Cを有している。そして、主端子61Cの接続部62Cが、ヒートシンク50Cの実装面500Cのうち、非重なり部52Cに接続されている。したがって、リフロー後に、主端子61Cをヒートシンク50Cに接続することができる。はんだなどの接合部材を用いない接続手法を採用することができる。エレクトロマイグレーションの発生を抑制することができる。
本実施形態では、主端子61C,61Eは、X方向において、半導体素子40の中心線CLに対して線対称配置とされている。これにより、主電流は、中心線CLに対して線対称となるように流れる。主電流は、中心線CLの左右でほぼ均等に流れる。これにより、インダクタンスをさらに低減することができる。また局所的な発熱を抑制することができる。
(第2実施形態)
この実施形態は、先行する実施形態を基礎的形態とする変形例である。上記実施形態では、主端子61Eの対向部64Eを、非対向部65Eごとに完全に分けていた。これに代えて、対向部64Eの少なくとも一部を、複数の非対向部65Eで一体化してもよい。
この実施形態は、先行する実施形態を基礎的形態とする変形例である。上記実施形態では、主端子61Eの対向部64Eを、非対向部65Eごとに完全に分けていた。これに代えて、対向部64Eの少なくとも一部を、複数の非対向部65Eで一体化してもよい。
図16は、本実施形態の半導体装置20を示す図であり、図5に対応している。図5同様、便宜上、封止樹脂体30を省略している。主端子61Eは、対向部64Eとして、共通部640Eと、分枝部641Eを有している。主端子61Eは、先行実施形態同様、ひとつの接続部62Eを有している。共通部640Eは、接続部62Eに連なっている。共通部640Eは、延設部63Eにおける接続部62E側の根元部分に設けられている。延設部63Eの延びる方向において、接続部62Eから所定範囲の部分が、共通部640Eとされている。
共通部640Eは、複数の非対向部65Eに対して共通化されている。共通部640Eは、接続部62Eから、複数本に分かれることなく、一枚の板部としてY方向に延びている。共通部640Eは、主端子61Cとヒートシンク50Cとの接続を妨げないように設けられている。接続部62Cは、先行実施形態同様、ヒートシンク50Cの実装面500Cであって非重なり部52Cに接続されている。共通部640Eは、Z方向からの平面視において、ヒートシンク50Eと重なる範囲内で設けられている。共通部640Eは、ヒートシンク50Cの重なり部51Cに対向している。
分枝部641Eは、共通部640Eから複数に枝分かれした部分である。分枝部641Eは、共通部640Eと非対向部65Eとをつないでいる。分枝部641Eは、非対向部65Eと同数設けられている。分枝部641Eは、対応する非対向部65Eと一体的に、Y方向に沿って延設されている。分枝部641Eは、少なくともヒートシンク50Cの非重なり部52Cに対向している。
<第2実施形態のまとめ>
本実施形態では、主端子61Eが、対向部64Eとして共通部640Eを有している。したがって、先行実施形態に示したように、共通部640Eを有さない構成に較べて、主端子61EのXY平面に沿う面積が拡大されている。これにより、ヒートシンク50Cと主端子61Eとの対向面積を大きくし、インダクタンスをより低減することができる。また、熱抵抗を低減することができる。これにより、放熱性を向上することができる。
本実施形態では、主端子61Eが、対向部64Eとして共通部640Eを有している。したがって、先行実施形態に示したように、共通部640Eを有さない構成に較べて、主端子61EのXY平面に沿う面積が拡大されている。これにより、ヒートシンク50Cと主端子61Eとの対向面積を大きくし、インダクタンスをより低減することができる。また、熱抵抗を低減することができる。これにより、放熱性を向上することができる。
共通部640Eは、延設部63Eの延設の方向において、対向部64Eの一部分に設けられれば良い。たとえば、接続部62Eから離れた位置に共通部640Eを設けることもできる。本実施形態では、共通部640Eが接続部62Eに連なっている。すなわち、エミッタ電極41Eの近傍で、主端子61Eの面積が拡大されている。これにより、放熱性をさらに向上することができる。
(第3実施形態)
この実施形態は、先行する実施形態を基礎的形態とする変形例である。上記実施形態では、リードフレーム60の厚みを、全域でほぼ一定としていた。これに代えて、リードフレーム60の厚みを部分的に異ならせてもよい。異形条のリードフレーム60を用いてもよい。
この実施形態は、先行する実施形態を基礎的形態とする変形例である。上記実施形態では、リードフレーム60の厚みを、全域でほぼ一定としていた。これに代えて、リードフレーム60の厚みを部分的に異ならせてもよい。異形条のリードフレーム60を用いてもよい。
図17は、本実施形態の半導体装置20のうち、半導体素子40周辺を示す断面図である。図17では、便宜上、封止樹脂体30、主電極41、パッド42を省略している。図17に示すように、リードフレーム60において、信号端子67は、主端子61Eに較べて厚みが薄くされている。そして、信号端子67とヒートシンク50Cの実装面500Cとの対向距離D3は、主端子61Eと実装面500Cとの対向距離D1よりも長くされている。リードフレーム60において、信号端子67が薄肉部であり、それ以外の部分は厚肉部である。信号端子67の板面は、ヒートシンク50E側において主端子61Eと略面一とされている。
<第3実施形態のまとめ>
本実施形態では、リードフレーム60の信号端子67部分を局所的に薄くしている。これにより、コレクタ電極41Cに接続されたヒートシンク50Cと信号端子67との間で、電気絶縁性を確保することができる。このように、異形条のリードフレーム60を採用することで、異電位間の絶縁性を確保することもできる。
本実施形態では、リードフレーム60の信号端子67部分を局所的に薄くしている。これにより、コレクタ電極41Cに接続されたヒートシンク50Cと信号端子67との間で、電気絶縁性を確保することができる。このように、異形条のリードフレーム60を採用することで、異電位間の絶縁性を確保することもできる。
異形条のリードフレーム60は、上記例に限定されない。たとえば図18に示す変形例のように、リードフレーム60のうち、主端子61Eの接続部62Eを局所的に厚くしてもよい。リードフレーム60において、接続部62Eが厚肉部であり、それ以外の部分が薄肉部である。接続部62Eの板面は、半導体素子40側において延設部63Eなどと略面一とされている。
これによれば、リードフレーム60とヒートシンク50Eの実装面500Eとの対向距離D4を、先行実施形態に示した例よりも長くすることができる。したがって、封止樹脂体30の成形時において、リードフレーム60と実装面500Eとの間に樹脂が流れ込みやすくなる。これにより、インダクタンス低減の効果を奏しつつ、封止樹脂体30の成形不良を抑制することができる。なお、ボンディングワイヤを介して信号端子67をパッド42に接続する構成にも適用できる。
接続部62Eの板面が、ヒートシンク50E側において延設部63Eなどと略面一とされてもよい。この場合、主端子61Eが実装面500Cから遠ざかるものの、上記した比較例に較べてインダクタンスを低減することができる。また、リードフレーム60と実装面500Cと間に樹脂が流れ込みやすくなり、成形不良を抑制することができる。
(他の実施形態)
この明細書および図面等における開示は、例示された実施形態に制限されない。開示は、例示された実施形態と、それらに基づく当業者による変形態様を包含する。たとえば開示は、実施形態において示された部品及び/又は要素の組み合わせに限定されない。開示は、多様な組み合わせによって実施可能である。開示は、実施形態に追加可能な追加的な部分をもつことができる。開示は、実施形態の部品及び/又は要素が省略されたものを包含する。開示は、ひとつの実施形態と他の実施形態との間における部品及び/又は要素の置き換え、又は組み合わせを包含する。開示される技術的範囲は、実施形態の記載に限定されない。開示されるいくつかの技術的範囲は、請求の範囲の記載によって示され、さらに請求の範囲の記載と均等の意味及び範囲内での全ての変更を含むものと解されるべきである。
この明細書および図面等における開示は、例示された実施形態に制限されない。開示は、例示された実施形態と、それらに基づく当業者による変形態様を包含する。たとえば開示は、実施形態において示された部品及び/又は要素の組み合わせに限定されない。開示は、多様な組み合わせによって実施可能である。開示は、実施形態に追加可能な追加的な部分をもつことができる。開示は、実施形態の部品及び/又は要素が省略されたものを包含する。開示は、ひとつの実施形態と他の実施形態との間における部品及び/又は要素の置き換え、又は組み合わせを包含する。開示される技術的範囲は、実施形態の記載に限定されない。開示されるいくつかの技術的範囲は、請求の範囲の記載によって示され、さらに請求の範囲の記載と均等の意味及び範囲内での全ての変更を含むものと解されるべきである。
明細書および図面等における開示は、請求の範囲の記載によって限定されない。明細書および図面等における開示は、請求の範囲に記載された技術的思想を包含し、さらに請求の範囲に記載された技術的思想より多様で広範な技術的思想に及んでいる。よって、請求の範囲の記載に拘束されることなく、明細書および図面等の開示から、多様な技術的思想を抽出することができる。
半導体装置20をインバータ5に適用する例を示したが、これに限定されない。たとえばコンバータに適用することもできる。また、インバータ5及びコンバータの両方に適用することもできる。
半導体素子40に、IGBT6iとFWD6dが形成される例を示したが、これに限定されない。FWD6dを別チップとしてもよい。
スイッチング素子としてIGBT6iの例を示したが、これに限定されない。たとえばMOSFETを採用することもできる。
放熱面501C,501Eが、封止樹脂体30から露出される例を示したが、これに限定されない。放熱面501C,501Eの少なくとも一方が、封止樹脂体30によって覆われた構成としてもよい。封止樹脂体30とは別の図示しない絶縁部材によって覆われた構成としてもよい。
図示を省略するが、リードフレーム60において、ヒートシンク50との対向部分に貫通孔を設けてもよい。これにより、成形不良を抑制することができる。主端子61に貫通孔を設けてもよい。たとえば共通部640Eに設けてもよい。信号端子67に貫通孔を設けてもよい。吊りリード68に貫通孔を設けてもよい。
1…電力変換装置、2…直流電源、3…モータ、4…平滑コンデンサ、5…インバータ、6…上下アーム回路、6d…FWD、6i…IGBT、7…高電位電源ライン、8…低電位電源ライン、9…出力ライン、20…半導体装置、30…封止樹脂体、300…一面、301…裏面、302,303…側面、40…半導体素子、41,41C,41E…主電極、42…パッド、50,50C,50E…ヒートシンク、50x…絶縁体、50y,50z…金属体、500C,500E…実装面、501C,501E…放熱面、51C…重なり部、52C…非重なり部、60…リードフレーム、61,61C,61E…主端子、610C,610E…側面、62C,62E…接続部、63C,63E…延設部、64E…対向部、640E…共通部、641E…分枝部、65E…非対向部、67…信号端子、68…吊りリード、69…外周フレーム、70,71…タイバー、80〜84…接合部材
Claims (7)
- 主電極(41)として一面側に第1主電極(41C)を有し、前記一面とは厚み方向において反対の面である裏面側に第2主電極(41E)を有する少なくともひとつの半導体素子(40)と、
前記半導体素子を挟むように配置された放熱部材(50)であって、前記一面側に配置され、前記第1主電極に接続された第1放熱部材(50C)、及び、前記裏面側に配置された第2放熱部材(50E)と、
対応する前記主電極に電気的に接続された主端子(61)であって、前記第1放熱部材に接続された第1主端子(61C)、及び、前記第2主電極に接続された第2主端子(61E)を含むリードフレーム(60)と、
を備え、
前記第2主端子は、前記第2主電極との接続部(62E)と、前記接続部から延設された部分であって、前記接続部に連なり、前記第1放熱部材と対向する対向部(64E)、及び、前記接続部とは反対で前記対向部に連なり、前記厚み方向に直交する一方向において前記第1主端子と並んで配置された非対向部(65E)を有し、
前記第2放熱部材は、前記第2主端子を介して、前記半導体素子に接続されており、
前記リードフレームは、前記第1主端子及び前記第2主端子の前記非対向部の少なくとも一方を複数有し、
前記第1主端子及び前記第2主端子の前記非対向部は、側面が互いに対向するように交互に並んで配置され、互いに対向する前記側面の組を複数有している半導体装置。 - 前記第2主端子は、複数の前記非対向部と、複数の前記非対向部に対して一体的に設けられたひとつの前記接続部と、を有している請求項1に記載の半導体装置。
- 前記対向部は、前記延設の方向における少なくとも一部の範囲において、複数の前記非対向部に対して一体的に設けられている請求項2に記載の半導体装置。
- 前記半導体素子は、前記裏面側に形成された信号用のパッド(42)を有し、
前記リードフレームは、前記パッドに電気的に接続された信号端子(67)を含んでいる請求項1〜3いずれか1項に記載の半導体装置。 - 前記信号端子は、接合部材(83)を介して、前記パッドに接続されている請求項4に記載の半導体装置。
- 前記リードフレームにおいて、前記信号端子は、前記第2主端子に較べて薄くされ、
前記第1放熱部材との対向距離は、前記信号端子のほうが前記第2主端子よりも長くされている請求項4又は請求項5に記載の半導体装置。 - 前記第1放熱部材は、前記厚み方向からの平面視において、第2放熱部材と重なる重なり部(51C)と、前記重なり部に連なり、前記第2放熱部材と重ならない非重なり部(52C)と、を有し、
前記第1主端子は、前記第1放熱部材における前記第2放熱部材との対向面(500C)のうち、前記非重なり部に接続されている請求項1〜6いずれか1項に記載の半導体装置。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2019043884A JP7095632B2 (ja) | 2019-03-11 | 2019-03-11 | 半導体装置 |
CN202080027821.8A CN113661567B (zh) | 2019-03-11 | 2020-02-13 | 半导体装置 |
PCT/JP2020/005569 WO2020184051A1 (ja) | 2019-03-11 | 2020-02-13 | 半導体装置 |
US17/469,091 US11996344B2 (en) | 2019-03-11 | 2021-09-08 | Semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2019043884A JP7095632B2 (ja) | 2019-03-11 | 2019-03-11 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2020150018A true JP2020150018A (ja) | 2020-09-17 |
JP7095632B2 JP7095632B2 (ja) | 2022-07-05 |
Family
ID=72427846
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2019043884A Active JP7095632B2 (ja) | 2019-03-11 | 2019-03-11 | 半導体装置 |
Country Status (4)
Country | Link |
---|---|
US (1) | US11996344B2 (ja) |
JP (1) | JP7095632B2 (ja) |
CN (1) | CN113661567B (ja) |
WO (1) | WO2020184051A1 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7059970B2 (ja) * | 2019-03-11 | 2022-04-26 | 株式会社デンソー | 半導体装置 |
JP7156105B2 (ja) | 2019-03-11 | 2022-10-19 | 株式会社デンソー | 半導体モジュール |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007251076A (ja) * | 2006-03-20 | 2007-09-27 | Hitachi Ltd | パワー半導体モジュール |
JP2016066700A (ja) * | 2014-09-25 | 2016-04-28 | 株式会社日立製作所 | パワー半導体モジュール |
Family Cites Families (30)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2000150762A (ja) * | 1998-11-09 | 2000-05-30 | Fuji Electric Co Ltd | リードフレームおよび半導体装置 |
EP2244289B1 (en) * | 2000-04-19 | 2014-03-26 | Denso Corporation | Coolant cooled type semiconductor device |
JP4158738B2 (ja) * | 2004-04-20 | 2008-10-01 | 株式会社デンソー | 半導体モジュール実装構造、カード状半導体モジュール及びカード状半導体モジュール密着用受熱部材 |
DE112009005537B3 (de) * | 2008-04-09 | 2022-05-12 | Fuji Electric Co., Ltd. | Verfahren zum Herstellen einer Halbleitervorrichtung |
JP2010225720A (ja) * | 2009-03-23 | 2010-10-07 | Mitsubishi Electric Corp | パワーモジュール |
US20120228757A1 (en) * | 2009-11-25 | 2012-09-13 | Toyota Jidosha Kabushiki Kaisha | Cooling structure of semiconductor device |
US8497572B2 (en) | 2010-07-05 | 2013-07-30 | Denso Corporation | Semiconductor module and method of manufacturing the same |
JP5585518B2 (ja) * | 2011-04-08 | 2014-09-10 | 株式会社デンソー | 半導体装置及び半導体装置の製造方法 |
US8772895B2 (en) * | 2011-11-28 | 2014-07-08 | Taiwan Semiconductor Manufacturing Company, Ltd. | Dark current reduction for back side illuminated image sensor |
JP5904041B2 (ja) * | 2012-07-10 | 2016-04-13 | 株式会社デンソー | 半導体装置 |
US8653626B2 (en) * | 2012-07-18 | 2014-02-18 | Taiwan Semiconductor Manufacturing Company, Ltd. | Package structures including a capacitor and methods of forming the same |
WO2014050389A1 (ja) * | 2012-09-27 | 2014-04-03 | 富士電機株式会社 | パワー半導体モジュール |
JP6102676B2 (ja) | 2013-10-23 | 2017-03-29 | 株式会社デンソー | 半導体装置 |
JP6256145B2 (ja) * | 2014-03-26 | 2018-01-10 | 株式会社デンソー | 半導体装置及びその製造方法 |
JP6299441B2 (ja) * | 2014-06-02 | 2018-03-28 | 株式会社デンソー | 半導体装置 |
JP6344215B2 (ja) * | 2014-11-21 | 2018-06-20 | 株式会社デンソー | 半導体装置及びパワーモジュール |
JP6349275B2 (ja) | 2015-03-05 | 2018-06-27 | 日立オートモティブシステムズ株式会社 | 電力変換装置 |
EP3163608A4 (en) * | 2015-04-28 | 2017-11-01 | Shindengen Electric Manufacturing Co., Ltd. | Semiconductor module and production method for semiconductor module |
JP2017069352A (ja) * | 2015-09-29 | 2017-04-06 | サンケン電気株式会社 | 半導体装置 |
JP6517682B2 (ja) * | 2015-12-17 | 2019-05-22 | トヨタ自動車株式会社 | 半導体装置 |
JP6439750B2 (ja) * | 2016-05-20 | 2018-12-19 | 株式会社デンソー | 半導体装置 |
JP6708066B2 (ja) * | 2016-09-05 | 2020-06-10 | 株式会社デンソー | 半導体装置 |
US10002821B1 (en) * | 2017-09-29 | 2018-06-19 | Infineon Technologies Ag | Semiconductor chip package comprising semiconductor chip and leadframe disposed between two substrates |
JP2019067949A (ja) * | 2017-10-02 | 2019-04-25 | トヨタ自動車株式会社 | 半導体装置 |
JP6969501B2 (ja) * | 2018-05-28 | 2021-11-24 | 株式会社デンソー | 半導体装置 |
JP2019212833A (ja) * | 2018-06-07 | 2019-12-12 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
JP7010167B2 (ja) * | 2018-07-25 | 2022-01-26 | 株式会社デンソー | 半導体装置 |
JP7156105B2 (ja) | 2019-03-11 | 2022-10-19 | 株式会社デンソー | 半導体モジュール |
JP7059970B2 (ja) * | 2019-03-11 | 2022-04-26 | 株式会社デンソー | 半導体装置 |
JP7103279B2 (ja) * | 2019-03-11 | 2022-07-20 | 株式会社デンソー | 半導体装置 |
-
2019
- 2019-03-11 JP JP2019043884A patent/JP7095632B2/ja active Active
-
2020
- 2020-02-13 WO PCT/JP2020/005569 patent/WO2020184051A1/ja active Application Filing
- 2020-02-13 CN CN202080027821.8A patent/CN113661567B/zh active Active
-
2021
- 2021-09-08 US US17/469,091 patent/US11996344B2/en active Active
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007251076A (ja) * | 2006-03-20 | 2007-09-27 | Hitachi Ltd | パワー半導体モジュール |
JP2016066700A (ja) * | 2014-09-25 | 2016-04-28 | 株式会社日立製作所 | パワー半導体モジュール |
Also Published As
Publication number | Publication date |
---|---|
US20210407881A1 (en) | 2021-12-30 |
WO2020184051A1 (ja) | 2020-09-17 |
CN113661567A (zh) | 2021-11-16 |
JP7095632B2 (ja) | 2022-07-05 |
CN113661567B (zh) | 2024-01-05 |
US11996344B2 (en) | 2024-05-28 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP7010167B2 (ja) | 半導体装置 | |
US10056309B2 (en) | Electronic device | |
US10720383B2 (en) | Semiconductor device configuring upper and lower arms including auxiliary terminals | |
JP6969501B2 (ja) | 半導体装置 | |
US11908778B2 (en) | Semiconductor module | |
US20210407875A1 (en) | Semiconductor device | |
US11996344B2 (en) | Semiconductor device | |
JP2018200953A (ja) | 電子装置 | |
WO2022024567A1 (ja) | 半導体装置 | |
US11887905B2 (en) | Semiconductor device | |
JP2022152703A (ja) | 半導体装置 | |
WO2021065736A1 (ja) | 半導体装置 | |
JP2022123611A (ja) | 半導体装置 | |
JP2021061393A (ja) | 半導体装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20210416 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20220524 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20220606 |
|
R151 | Written notification of patent or utility model registration |
Ref document number: 7095632 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R151 |