JP2016186541A - 記憶装置、表示ドライバー、電気光学装置及び電子機器 - Google Patents
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Abstract
Description
図1に、本実施形態のドライバーと記憶装置の構成例を示す。ドライバー100は、記憶装置180と、記憶装置180から読み出された表示データに基づいて表示パネル200を駆動する駆動回路140と、を含む。記憶装置180は、モノクロの表示データが書き込まれるメモリーセルアレイ120と、メモリーセルアレイ120に表示データを書き込む書き込み回路110と、その書き込まれた表示データをメモリーセルアレイ120から読み出す読み出し回路130と、を含む。
以下、上記で説明したメモリーアクセスを行う詳細構成を説明する。図9に、ドライバー100の詳細な構成例を示す。ドライバー100は、書き込み回路110、メモリーセルアレイ120、読み出し回路130、駆動回路140、制御回路150、リード・ライト制御回路160、ロウデコーダー170を含む。ドライバー100は、例えば集積回路装置として構成される。
図10に、読み出し回路130の詳細な構成例を示す。読み出し回路130は、セレクター131、カラムアドレスデコーダー133、センスアンプ群135、第1のカラム選択回路136(縦書き用カラム選択回路)、第2のカラム選択回路138(横書き用カラム選択回路)、第1のラッチ回路LTCA、第2のラッチ回路LTCBを含む。図9のパネル側カラムデコーダー134には、カラムアドレスデコーダー133、第1のカラム選択回路136、第2のカラム選択回路138が対応し、図9のパネル側リード回路132には、センスアンプ群135、セレクター131、第1のラッチ回路LTCA、第2のラッチ回路LTCBが対応する。
図12に、センスアンプ部の詳細な構成例を示す。センスアンプ部は、センスアンプAMP、インバーターIN1〜IN3(論理反転回路)、論理反転入力のアンド回路AN1、AN2(論理積回路)、ナンド回路ND1、ND2(否定論理積回路)、N型トランジスターNT1、NT2、P型トランジスターPT1、PT2を含む。
図13に、本実施形態のドライバー100を適用できる電気光学装置と電子機器の構成例を示す。本実施形態の電子機器として、例えばプロジェクターや、テレビション装置、情報処理装置(コンピューター)、携帯型情報端末、カーナビゲーションシステム、携帯型ゲーム端末等の、表示装置を搭載する種々の電子機器を想定できる。
114 CPU側カラムデコーダー、115 ライトバッファー・センスアンプ群、
120 メモリーセルアレイ、130 読み出し回路、131 セレクター、
132 パネル側リード回路、133 カラムアドレスデコーダー、
134 パネル側カラムデコーダー、135 センスアンプ群、
136 第1のカラム選択回路、138 第2のカラム選択回路、140 駆動回路、
142 データドライバー、144 ゲートドライバー、150 制御回路
160 リード・ライト制御回路、170 ロウデコーダー、180 記憶装置、
200 表示パネル、300 表示コントローラー、310 CPU、
320 記憶部、330 ユーザーインターフェース部、
340 データインターフェース部、350 電気光学装置、400 処理部、
BL1 ビット線、BUSA 第1のバス、BUSB 第2のバス、
DL1 データ線、NQA 第1の出力線、NQB 第2の出力線、
SA1 センスアンプ部、SC1 走査線、WL1 ワード線、
WMD モード設定信号、WS1 ライトバッファー・センスアンプ部
Claims (9)
- モノクロの表示データが書き込まれるメモリーセルアレイと、
前記メモリーセルアレイに前記表示データを書き込む書き込み回路と、
書き込まれた前記表示データを前記メモリーセルアレイから読み出す読み出し回路と、
を含み、
前記書き込み回路は、
第1のモードでは、選択ワード線に接続される複数のメモリーセルに対して、表示パネルにおいてデータ線が同じで走査線が異なる画素データで各第1画素データユニットが構成される複数の第1画素データユニットを書き込み、
第2のモードでは、選択ワード線に接続される複数のメモリーセルに対して、前記表示パネルにおいて走査線が同じでデータ線が異なる画素データで各第2画素データユニットが構成される複数の第2画素データユニットを書き込むことを特徴とする記憶装置。 - 請求項1において、
前記読み出し回路は、
前記第1のモードでは、前記複数の第1画素データユニットから走査線が同じ画素データを選択して読み出すことを特徴とする記憶装置。 - 請求項1又は2において、
前記読み出し回路は、
前記第1のモードと前記第2のモードのモード設定信号を受けて、
前記モード設定信号により前記第1のモードが設定された場合には、前記複数の第1画素データユニットから走査線が同じ画素データを選択する第1のビット線選択処理を行い、
前記モード設定信号により前記第2のモードが設定された場合には、前記各第2画素データユニットの画素データを選択する第2のビット線選択処理を行うことを特徴とする記憶装置。 - 請求項3において、
前記読み出し回路は、
カラムアドレスデコーダーと、
前記カラムアドレスデコーダーの出力信号と前記モード設定信号を受けて、前記第1のモード用の前記第1のビット線選択処理を行う第1のカラム選択回路と、
前記カラムアドレスデコーダーの前記出力信号と前記モード設定信号を受けて、前記第2のモード用の前記第2のビット線選択処理を行う第2のカラム選択回路と、
を含むことを特徴とする記憶装置。 - 請求項1乃至4のいずれかにおいて、
前記読み出し回路は、
前記メモリーセルアレイからの読み出し信号を増幅する複数のセンスアンプ部を有し、
前記複数のセンスアンプ部の各センスアンプ部は、
前記第1のモード用の第1の出力線と、前記第2のモード用の第2の出力線と、を有することを特徴とする記憶装置。 - 請求項5において、
前記読み出し回路は、
複数の前記第1の出力線からなる第1のバスと、
複数の前記第2の出力線からなる第2のバスと、
前記第1のモードにおいて前記第1のバスを選択し、前記第2のモードにおいて前記第2のバスを選択するセレクターと、
を含むことを特徴とする記憶装置。 - 請求項1乃至6のいずれかに記載された記憶装置と、
前記記憶装置から読み出された前記表示データに基づいて前記表示パネルを駆動する駆動回路と、
を含むことを特徴とする表示ドライバー。 - 請求項7に記載された表示ドライバーと、
前記表示パネルと、
を含むことを特徴とする電気光学装置。 - 請求項1乃至6のいずれかに記載された記憶装置を含むことを特徴とする電子機器。
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