JP2016167597A - トレンチ・ショットキー・バリア・ショットキーダイオードを備える半導体装置 - Google Patents

トレンチ・ショットキー・バリア・ショットキーダイオードを備える半導体装置 Download PDF

Info

Publication number
JP2016167597A
JP2016167597A JP2016045747A JP2016045747A JP2016167597A JP 2016167597 A JP2016167597 A JP 2016167597A JP 2016045747 A JP2016045747 A JP 2016045747A JP 2016045747 A JP2016045747 A JP 2016045747A JP 2016167597 A JP2016167597 A JP 2016167597A
Authority
JP
Japan
Prior art keywords
semiconductor
semiconductor device
trench
schottky
layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2016045747A
Other languages
English (en)
Other versions
JP6649813B2 (ja
Inventor
クゥ ニン
Ning Dr Qu
クゥ ニン
ゲアラッハ アルフレート
Gerlach Alfred
ゲアラッハ アルフレート
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Robert Bosch GmbH
Original Assignee
Robert Bosch GmbH
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Robert Bosch GmbH filed Critical Robert Bosch GmbH
Publication of JP2016167597A publication Critical patent/JP2016167597A/ja
Application granted granted Critical
Publication of JP6649813B2 publication Critical patent/JP6649813B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/86Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by variation of the electric current supplied, or only the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched
    • H01L29/861Diodes
    • H01L29/872Schottky diodes
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/04Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
    • H01L27/08Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind
    • H01L27/0814Diodes only
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0603Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
    • H01L29/0607Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration
    • H01L29/0611Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices
    • H01L29/0615Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices by the doping profile or the shape or the arrangement of the PN junction, or with supplementary regions, e.g. junction termination extension [JTE]
    • H01L29/0619Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices by the doping profile or the shape or the arrangement of the PN junction, or with supplementary regions, e.g. junction termination extension [JTE] with a supplementary region doped oppositely to or in rectifying contact with the semiconductor containing or contacting region, e.g. guard rings with PN or Schottky junction
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0603Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
    • H01L29/0607Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration
    • H01L29/0611Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices
    • H01L29/0615Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices by the doping profile or the shape or the arrangement of the PN junction, or with supplementary regions, e.g. junction termination extension [JTE]
    • H01L29/0619Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices by the doping profile or the shape or the arrangement of the PN junction, or with supplementary regions, e.g. junction termination extension [JTE] with a supplementary region doped oppositely to or in rectifying contact with the semiconductor containing or contacting region, e.g. guard rings with PN or Schottky junction
    • H01L29/0623Buried supplementary region, e.g. buried guard ring
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/16Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic Table
    • H01L29/1608Silicon carbide
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/20Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only AIIIBV compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/47Schottky barrier electrodes
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/47Schottky barrier electrodes
    • H01L29/475Schottky barrier electrodes on AIII-BV compounds

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Ceramic Engineering (AREA)
  • Electrodes Of Semiconductors (AREA)

Abstract

【課題】約100Vを上回る逆方向電圧に対して適しているショットキーダイオードを備えている半導体装置を提供する。【解決手段】金属膜によって被覆されている第1の面と、該第1の面に延在し且つ少なくとも部分的に金属で充填されている少なくとも1つのトレンチとを有する第1の導電型の半導体ブロックを含む半導体装置において、トレンチの少なくとも1つの壁部、及び/又は、金属膜によって被覆されている第1の面の、トレンチに隣接する少なくとも1つの領域が、金属膜と半導体ブロックとの間に位置する、第2の導電型の第1の半導体材料から成る半導体層を備えている。【選択図】図2

Description

本発明は、請求項1の上位概念に記載されている半導体装置に関する。
その種の半導体装置は、トレンチ・ショットキー・バリア・ショットキーダイオードの形態で、独国特許出願公開第102004059640号明細書(特許文献1)から公知であり、また、第1の導電型の、体積を有する半導体、即ち、半導体ブロックを有しており、この半導体ブロックは、金属膜によって被覆されている第1の面と、その第1の面に延在し、且つ、少なくとも部分的に金属によって充填されている少なくとも1つのトレンチとを有している。
独国特許出願公開第102004059640号明細書
ショットキーダイオードは通常の場合、金属半導体コンタクト又はシリコン半導体コンタクトを有している。ショットキーダイオードでは、導通動作時に高注入は行われず、従って、スイッチオフ時に少数キャリアの除去は行われない。ショットキーダイオードではスイッチングが比較的高速に行われ、損失が少ない。ここで、高注入という用語は、注入される少数キャリアの密度が多数キャリアの規模に達する状態を意味している。
もっとも、ショットキーダイオードは、比較的高い漏れ電流を示し、特に比較的高い温度では、いわゆる「障壁低下効果(Barrier-Lowering-Effect)」に起因して高い電圧依存性を有している。更には、一般的に、高い逆方向電圧に対しては、低ドープの厚い半導体層が必要になり、これによって、大電流では比較的高い順方向電圧が生じる。従って、シリコン技術における電力ショットキーダイオードは、スイッチング特性が良好であるにもかかわらず、約100Vを上回る逆方向電圧に対しては適しておらず又はほとんど適していない。
本発明に係る半導体装置は、請求項1の特徴部分に記載されている構成によって、冒頭で述べたような従来技術とは異なっており、従って、トレンチの少なくとも1つの壁部、及び/又は、金属膜によって被覆されている第1の面の、トレンチに隣接する少なくとも1つの領域が、金属膜と半導体ブロックとの間に位置する、第2の導電型の第1の半導体材料から成る半導体層を備えているという特徴を備えている。
本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオード(下記において更に説明するように、以下では「TSBS−P」又は「TSBS−PN−P」又はダイオードとも記す。)は、比較的低い順方向電圧及び比較的少ないスイッチング損失を実現する。更には、第2の導電型の第1の半導体材料から成る比較的薄い層は、金属膜を使用して形成されるショットキーコンタクトの付加的な遮蔽を実現する。これによって、特に高い温度において、順方向電圧を比較的低く維持し、且つ、スイッチング損失を比較的少なく維持しながら、逆方向電流を著しく低減することができる。
そのように配置されている、第1の半導体材料から成る層によって、半導体ブロックの導電率が高注入によって大幅に高められているので、慣例の高電圧ショットキーダイオードと比較して、電流密度が高い領域での非常に低い順方向電圧を実現することができる。この利点を、集積PNダイオードによって更に拡大することができる。更には、そのように配置されている、第1の半導体材料から成る層によって、トレンチ構造を用いてショットキー効果が遮断されることより、漏れ電流は比較的低くなる。また、この構想は、集積PNダイオードの電圧制限クランプ機能によって比較的高いロバスト性がもたらされる変形形態に適している。
従来の高電圧PiNダイオードと比較すると、高い電流密度での高注入との組み合わせにおいて、ショットキーコンタクトの適切な障壁高さを用いて、高い電流密度での比較的低い順方向電圧の利点がもたらされる。更には、導通動作時にはショットキーコンタクトシステム(例えば、ショットキーコンタクトの直下にある、薄いp型層と組み合わせられたショットキーコンタクト)によって、少数のキャリアが弱くドープされた領域に注入され蓄積されるので、スイッチオフ損失が少なくなる。従来技術から「クールSBD」ダイオードとして公知である別のダイオードと比較すると、比較的強い高注入によって高い電流密度での比較的低い順方向電圧がもたらされ、また、ショットキー効果の効率的な遮蔽によって比較的低い漏れ電流がもたらされる。
そのように配置されている半導体層(例えば、ショットキーコンタクトの直下にある薄いp型層としての半導体層)を備えていない従来のTSBS又はTSBS−PNと比較すると、スイッチオフ損失はやや高くなるが、高い電流密度での比較的低い順方向電圧並びに非常に低い漏れ電流が生じる。集積PNダイオードを備えている実施の形態においては、高い電流密度及びほぼ等しいスイッチオフ損失で、ほぼ等しい順方向電圧において非常に低い漏れ電流がもたらされる。
有利な発展形態は従属請求項に記載されている。更に、有利な構成は図面及び下記に記載されている。それらの特徴は単独でも有利であると考えられ、また種々の組み合わせにおいても、それらの組み合わせを改めて明示的に示さなくとも、やはり本発明にとって有利であると考えられる。
本発明に係るダイオードを、ダイオードの降伏電圧が例えば10Vよりも高い、特に100Vよりも高い、とりわけ200Vよりも高い、又は、それどころか600Vよりも高い値を有するように形成することも可能である。従って、本発明に係るショットキーダイオードは、特に、高電圧の用途に適しており、またそれと同時に、低い順方向電圧、低い漏れ電圧、少ないスイッチング損失電力及び高いロバスト性を有している。更に本発明に係るショットキーダイオードは、有利には、特に変換器用の電力ダイオードとして、例えば光電装置又は自動車用途のための電力ダイオードとして有利である。例えば、ダイオードをいわゆる「還流ダイオード」としても使用することができる。
半導体装置の1つの構成においては、半導体ブロックが少なくとも2つのトレンチを有している。これによって、トレンチ・ショットキー・バリア・ショットキーダイオードの有利な特性を更に改善することができる。
更には、第2の導電型の第1の半導体材料は、10nmから500nmまでの範囲の層厚を有することができる。また、第2の導電型の第1の半導体材料のドープ濃度は、1cm3あたり約1016原子から1cm3あたり約1017原子までの値を有することができる。そのような薄い層は、特に上述のドープ濃度と共に、本発明に係るダイオードの比較的小さい逆方向電流、比較的低い順方向電圧及び比較的少ないスイッチング損失を実現することに非常に適している。
本発明の1つの構成では、少なくとも1つのトレンチの底部の領域が第2の半導体材料で充填されている。この第2の半導体材料は、第2の導電型の多結晶半導体材料又は第2の導電型の半導体材料である。このことは有利には、第2の半導体材料及び第1の導電型の半導体ブロックを用いてPNダイオードが形成されているように行われる。これによって、本発明に係る半導体装置においてトレンチ・ショットキー・バリア・ショットキーダイオードに電気的に並列にPNダイオード(いわゆる「クランプ素子」)を集積することが実現される。
本発明の1つの構成においては、PNダイオードの降伏電圧が、金属膜と、第2の導電型の第1の半導体材料から成る層と、第1の導電型の半導体ブロックとによって形成されているトレンチ・ショットキー・バリア・ショットキーダイオードの降伏電圧よりも、低い。
有利には、半導体装置は、電気的な降伏を少なくとも1つのトレンチの底部部分の領域において行うことができるように形成されている。
有利には、半導体装置は、降伏状態において、比較的大きい電流で駆動できるように形成されている。
本発明の1つの構成においては、少なくとも1つのトレンチの底部の領域が、ホウ素(一般的に、第1の導電型の濃度よりも高い濃度の第2の導電型のドーパント)の注入によって、第2の導電型の半導体材料に変換されている。これによって、半導体装置の特性を総じて改善することができる。
更には、少なくとも部分的に金属で充填されているトレンチが、トレンチの深さに関して上下に重なって配置されている少なくとも2つの金属層を有しており、上側の金属層は、第1の導電型の半導体ブロックの第1の面を覆っている金属膜の一部を形成しており、また、それらの金属層は有利には互いに異なる金属を含んでいる。有利には、少なくとも1つのトレンチは、少なくとも1つの金属によって完全に充填されている。
補完的に、上側の金属層(金属膜に相当する)のポテンシャルレベル(ショットキー障壁)の高さを、その下に配置されている金属層のポテンシャルレベル(ショットキー障壁)の高さよりも低くすることができる。これによって、トレンチ・ショットキー・バリア・ショットキーダイオードの特性を改善し、且つ、それぞれの電気的な要求に適合させるための別の複数の有利な実現手段がもたらされる。
半導体装置の1つの別の構成では、金属膜によって被覆されている第1の面とは反対側に位置する半導体ブロックの第2の面が、導電性のコンタクト材料によって被覆されており、このコンタクト材料に接している半導体ブロックの部分ブロックは、半導体ブロックのその他の部分よりも強くドープされている。特に、部分ブロックは、従来技術から同様に公知であるように、いわゆる「n+型基板」(半導体装置が逆の導電型でドープされている場合には「p+型基板」)である。ここで、上記において説明した金属膜を第1の電極(アノード電極)として使用することができ、また、上述のコンタクト材料(有利には、やはり金属膜として形成されている)を第2の電極(カソード電極)として使用することができる。これによって、総じて、本発明に係るダイオードに非常に適した構造が表される。
本発明に係る半導体装置の1つの構成では、半導体装置がはんだ付け可能な電極又ははんだ付け可能な素子端子を有している。
半導体装置の1つの構成では、半導体装置が圧入ダイオードとして形成されており、且つ、相応のケーシングを有している。補完的に、半導体装置は自動車の整流装置の素子であってもよい。
更には、半導体装置を、少なくとも部分的に、エピタキシ法及び/又はエッチング法及び/又はイオン注入法を用いて製造することができる。これによって、本発明に係る半導体装置を製造するための有利な実現手段が表される。
半導体装置の1つの別の構成では、少なくとも1つのトレンチの深さが1μmから4μmまでの値、有利には約2μmの値を有している。この寸法によって、例えば、本発明に係るダイオードを自動車における整流装置に使用するために、非常に適したサイズが表される。例えば、本発明に係るダイオードの許容逆方向電圧は約600Vにも達することが可能である。半導体装置の別の有利な寸法は、トレンチの深さと、各2つのトレンチ間の内のりの間隔との比が約2以上である場合にもたらされる。
更には、少なくとも1つのトレンチは、実質的に帯状の形状及び/又は実質的に島状の形状を有することができる。帯状の形状は、実質的に真っ直ぐ延びる形状(線)を表し、また島状の形状は、実質的に局所的に集中した形状、特に円形、六角形等の形状を表す。有利には、トレンチは、実質的に矩形の横断面を有している。トレンチの底部を平坦に形成してもよいし、丸みをもたせるように(「U字の形状」)、例えば半球状に形成してもよい。
本発明に係る半導体装置の第1の変形形態では、第1の導電型が、n型にドープされた半導体材料に対応し、第2の導電型が、p型にドープされた半導体材料に対応する。本発明に係る半導体装置の第2の変形形態では、第1の導電型が、p型にドープされた半導体材料に対応し、第2の導電型が、n型にドープされた半導体材料に対応する。従って、半導体装置は原則として、考えられる2つのいずれの極性にも適している。
更に、半導体装置は、シリコン材料及び/又は炭化ケイ素材料及び/又はシリコンゲルマニウム材料及び/又はガリウムヒ素材料を含むことができる。従って、本発明を通常のあらゆる半導体材料に対して使用することができる。
以下では、添付の図面を参照しながら本発明の実施例を説明する。
トレンチ・ショットキー・バリア・ショットキーダイオードを備えた第1の実施の形態の半導体装置の略断面図を示す。 トレンチ・ショットキー・バリア・ショットキーダイオード及び集積PNダイオードを備えた第2の実施の形態の半導体装置の略断面図を示す。 トレンチ・ショットキー・バリア・ショットキーダイオードを備えた第3の実施の形態の半導体装置の略断面図を示す。 トレンチ・ショットキー・バリア・ショットキーダイオードを備えた第4の実施の形態の半導体装置の略断面図を示す。
全図中、機能的に等価の構成要素及び機能的に等価の大きさのものには、異なる実施の形態においても同一の参照番号を使用している。特に、以下の説明において、一部では以下の略語を使用している。
−「TSBS」は、公知の従来技術と同等のトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
−「TSBS−PN」は、公知の従来技術と同等の、いわゆる「クランプ素子」としての集積PNダイオードを備えたトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
−「TSBS−P」は、金属膜(金属膜14)と半導体ブロック(半導体ブロック12)との間に第2の導電型の第1の半導体材料(半導体材料26)から成る層(「薄いp型層」)が配置されている、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
−「TSBS−PN−P」は、「TSBS−P」の実施の形態を補完する形でクランプ素子としての集積PNダイオードが設けられている、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
図1には、トレンチ・ショットキー・バリア・ショットキーダイオードを備えている半導体装置10の第1の実施の形態(TSBS−P)が示されている。半導体装置10は、第1の導電型の半導体ブロック12を有しており、この半導体ブロック12は、金属膜14によって被覆されている第1の面16と、この第1の面16に延在し、且つ、少なくとも部分的に金属で充填されているトレンチ18と、を有しており、この実施の形態ではトレンチ18は2つ設けられている。
トレンチ18の深さ42はそれぞれ約2μmである。半導体装置10の別の実施の形態においては、トレンチ18の深さ42は1μmから4μmの間であってよい。トレンチ18の深さ42と、2つの各トレンチ18間の内のりの間隔46との比は約2である。半導体装置10の別の実施の形態においては、この比は2より大きくてもよいし、2より小さくてもよい。
ここでは、各トレンチ18が、(図1においては垂直方向において定義されている)トレンチ18の深さ42に関して上下に重なって配置されている2つの金属層20及び22を有しており、上側の金属層20は、第1の導電型の半導体ブロック12の第1の面16を覆っている金属膜14の一部を形成している。有利には、金属層20及び22は互いに異なる金属を含んでいる。ここでは、上側の金属層20(この実施の形態では金属膜14に相当する)のポテンシャルレベル(ショットキー障壁)の高さは、その下に配置されている金属層22のポテンシャルレベル(ショットキー障壁)の高さよりも低い。上側の金属膜14の上方には、例えばはんだ付け可能な表面を形成する、(図示していない)別の金属膜を複数設けることができる。
更に図1から見て取れるように、金属膜14によって被覆されている第1の面16の、トレンチ18に隣接する領域24は、金属膜14と半導体ブロック12との間に存在する、第2の導電型の第1の半導体材料から成る層26によって離隔されている。第1の半導体材料から成るこの層26は比較的薄い。この実施の形態では、層26は約10nmから約500nmまでの層厚を有している。例えば層厚は約70nmである。第2の導電型の半導体材料のドープ濃度は、1cm3あたり約1016原子から1cm3あたり約1017原子までである。
更にこの図から見て取れるように、トレンチ18は、金属層20及び22の金属によって完全に充填されている。これとは異なり、トレンチ18が、金属によって完全に充填されていなくてもよい。トレンチ18の壁面及びトレンチ18の各底部38が途切れなく金属層20又は22と接触していることのみが保証されていればよい。
金属膜14によって被覆されている第1の面16とは反対側に位置する半導体ブロック12の第2の面30は、導電性のコンタクト材料28によって被覆されている。コンタクト材料28に接している、半導体ブロック12の部分ブロック34は、半導体ブロック12のその他の部分よりも強くドープされている。有利には、導電性のコンタクト材料28は金属である。コンタクト材料28もまた、上下に重なって配置される複数の金属膜を含むことができる。
半導体装置10は、少なくとも部分的に、エピタキシ法及び/又はエッチング法及び/又はイオン注入法を用いて製造されている。半導体構造を作製するためのそれらの方法は、一般的に従来技術より公知である。
半導体装置10の1つの実施の形態においては、上述の第1の導電型はn型にドープされた半導体材料に相当し、上述の第2の導電型はp型にドープされた半導体材料に相当する。金属膜14はショットキーコンタクトの一部であり、またここではアノード電極である。従って、コンタクト材料28は対応するカソード電極を形成している。
半導体装置10の1つの別の実施の形態では、第1の導電型がp型にドープされた半導体材料に相当し、第2の導電型はn型にドープされた半導体材料に相当する。
この実施の形態では、半導体装置10が実質的にシリコン材料から作製されている。別の実施の形態では、半導体装置10が、炭化ケイ素材料及び/又はシリコンゲルマニウム材料及び/又はガリウムヒ素材料から作製されている。
また図1において、矢印又は両矢印によって表されている、半導体装置10における別の複数の寸法は、トレンチ18の幅44、図面において下側の金属層22の厚さ又は深さ方向の寸法48、上側の金属層20の厚さ又は深さ方向の寸法50、並びに、第2の導電型の第1の半導体材料26から成る層の厚さ又は深さ方向の寸法52を表している。
図2には、半導体装置10の第2の実施の形態(TSBS−PN−P)が示されている。図1に示した実施の形態を補完する態様で、図2においては、トレンチ18の底部38の領域36が、第2の導電型を有している第2の半導体材料40で充填されている。領域36は、ここでもまた両矢印によって表されている深さ方向の寸法54を有している。
第2の導電型の第2の半導体材料40と、図面においてその下に配置されている、第1の導電型の半導体ブロック12とによって、PNダイオードが形成される。このPNダイオードは、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードと電気的に並列に接続されている。特に、半導体ブロック12のドープは、半導体装置10の動作時に、順方向の大電流によってキャリアの高注入を行うことができるように実施されている。
この実施の形態では、半導体装置10は、サイズ、材料及びドープに関して、PNダイオードの降伏電圧が、金属膜14と、第2の導電型の第1の半導体材料26から成る層と、第1の導電型の半導体ブロック12とによって形成されているトレンチ・ショットキー・バリア・ショットキーダイオードの降伏電圧よりも、低いように寸法設計されている。
半導体装置10の1つの実施の形態では、第2の半導体材料40は多結晶半導体材料である。この場合、トレンチ18の底部38は、例えば化学元素ホウ素を用いるイオン注入によって、第1の導電型から第2の導電型に変換される。このようにして同様にPNダイオードが形成される。
図2に示されているように、TSBS−PN−Pは、n+型基板(部分ブロック34)と、n型エピ層(半導体ブロック12)と、n型エピ層をエッチングすることにより形成された少なくとも2つのトレンチ18と、オーミックコンタクト又はカソード電極としての、チップ(半導体装置10)の第2の面30(「裏面」)における金属膜(導電性のコンタクト材料28)とから形成されている。
トレンチ18の下側の領域36は、図2に示した深さ方向の寸法54に応じて、p型にドープされた半導体材料40(例えばp型シリコン)又はポリ半導体材料(ポリシリコン)で充填されている。続いて、深さ方向の寸法48に応じて、トレンチ18は下側の金属(金属層22)で充填され、これに伴いp型にドープされた第2の半導体材料40(特にp型にドープされたシリコン又はポリシリコン)に対するオーミックコンタクト及び半導体ブロック12(n型エピ層)に対するショットキーコンタクトが形成され、また最後にトレンチ18は上側の金属(金属層20)によって被覆される。上側の金属は、深さ方向の寸法50に応じてトレンチ18の一部を充填し、これに伴いn型エピ層に対するショットキーコンタクトが形成され、また下側の金属のようにやはりアノード電極として使用される。特に、n型エピ層のドープは、順方向の大電流での動作時には高注入が行われているように選定されている。
TSBS−Pの場合のように(図1を参照されたい)、薄いp型層(第2の導電型の第1の半導体材料26)はドープ濃度「Np-」に応じてショットキーコンタクト(金属膜14)の直下に設けられている。この際、金属膜14は、半導体装置10の第1の面16において、従来技術から既に公知であるTSBS−PNのように単純なショットキーコンタクトを形成しているのではなく、図2から見て取れるように、「ショットキーコンタクトシステム」を形成している。
TSBS−P(図1を参照されたい)に対するTSBS−PN−P(図2を参照されたい)の利点は、集積PNダイオードの付加的なクランプ機能並びにそれに付随するロバスト性である。電圧制限クランプ機能は、PNダイオードの降伏電圧がショットキーダイオードの降伏電圧よりも低いことからもたらされる。この相対的な改善(PNを有している場合/PNを有していない場合)は、TSBS−PNとTSBSとが比較される従来技術と同じようにしてもたらされる。
図1に示したTSBS−Pの場合においても、図2に示したTSBS−PN−Pの場合においても、上記の領域24は半導体ブロック12の「上面」にのみ設けることができるのではなく、それらの領域24を(下記において図3及び図4を参照して説明するように)トレンチ18の各壁部56及び/又は各底部38にも付加的に配置することができる。
TSBS−P(図1を参照されたい)も、TSBS−PN−P(図2を参照されたい)も、本発明に係る半導体装置10の縁部領域において、縁部電界強度を低減するための付加的な構造を更に有することができる。この付加的な構造は、例えば、低ドープされたp型の領域、フィールドプレート又は従来技術に対応する類似の構造であってよい。
機能的な側面に関する以下の説明では、分かり易くするために、第1の導電型をそれぞれnドープとし、第2の導電型をそれぞれpドープとする。上記において既に述べたように、択一的に、各ドープを逆に実施することも可能である。このことは、上記において各図を参照しながら説明した実施例についても当てはまる。
上記においてやはり一部説明したように、本発明に係るダイオードの実施例は、電気的なコンタクト材料28(カソード電極)と、その上に形成された、部分ブロック34としてのn+型基板と、その上に形成された、半導体ブロック12に対する部分ブロック34を補完する、ここでは真性半導体材料としてのn型エピ層(即ちエピタキシャルに形成された半導体材料)と、エッチングによってn型エピ層に実現された、有利には少なくとも2つのトレンチ18と、半導体装置10の第1の面16におけるショットキーコンタクトの一部又はアノード電極としての金属膜14とを含んでいる。作製時には、先ずトレンチ18が有利には、図1においては下側にある第1の金属層22(以下では「第1の金属」又は「下側の金属」とも記す)によって、所定の深さ48まで充填され、続いて第2の金属層20(以下では「第2の金属」又は「上側の金属」とも記す)によって被覆される。第2の金属層20は、トレンチ18を有利にはトレンチ18の上端まで充填する。
第1の金属及び第2の金属は、有利には、第2の金属が第1の金属よりも低い障壁高さを有するように選定されている。従って、電気的にみると、TSBSは、異なる障壁高さを有している2つのショットキーダイオード、即ち、アノードとしての第1の金属とカソードとしてのn型エピ層との間にショットキー障壁を有している第1のショットキーダイオードと、アノードとしての第2の金属とカソードとしてのn型エピ層との間にショットキー障壁を有している第2のショットキーダイオードとが組み合わせられたものである。
2つの金属の障壁高さが著しく異なる場合、流れ方向(順方向)での動作時に、電流が主として、比較的低い障壁を有している上側の金属へと流れ、その際、電流はトレンチ18の対応する側方の壁部も越えて流れる。従って、流れ方向において流れる電流の有効面は、TSBSでは比較的大きい。
逆方向では、第1の金属が自身の比較的高い障壁高さによって、空間電荷領域を比較的大きく拡大させる。空間電荷領域は電圧の上昇と共に拡大し、また、TSBSの降伏電圧よりも低い電圧では、直接的に隣り合う2つのトレンチ18間の領域の中央において衝突する。これによって、大きい逆方向電流の原因となるショットキー効果が遮蔽され、逆方向電流が低減される。この遮蔽効果は、構造パラメータ(例えばトレンチ18の深さ42)、トレンチ18間の内のりの間隔46、トレンチ18の幅44並びに第1の金属の層厚に強く依存する。トレンチ18間のいわゆる「メサ領域」における空間電荷領域の拡大は、トレンチ18の深さ42が上述の内のりの間隔46よりも著しく大きい限りは、ほぼ1次元である。
TSBSの利点は、2つの金属が組み合わせられることであり、これによって、順方向電圧に対する要求に関して上述の種々の構造をある程度離隔させることができ、また遮蔽作用が実現される。順方向電圧及び逆方向電流の初期値は、主として、(比較的低い障壁を有している)第2の金属の影響を受ける。第2の金属の層厚が大きくなるにつれ、順方向電圧は低くなり、且つ、逆方向電流の初期値は高くなる。
他方では、(比較的高い障壁を有している)第1の金属は、逆方向電流の電圧依存性、並びに、高い逆方向電流での降伏電圧及び電流分布を決定する。従って、TSBSは、2つの金属を組み合わせることによる最適化を実現する。2つの金属の障壁高さも各層厚も、パラメータとして設定することができる。
ショットキーダイオードに対して電気的に並列に作用する半導体装置10にPNダイオードが集積されている場合(上記において既に説明した)には、上記のようにして形成されたダイオードを改善することができる。この場合には、特にいわゆる「正孔注入」を行うことができる。このダイオードを以下では差し当たり「TSBS−PN」と記す。
このTSBS−PNもまた、n+型基板と、n型エピ層と、そのn型エピ層をエッチングすることにより形成された少なくとも2つのトレンチ18と、半導体装置10の第2の面30(図面においては下側、つまり裏面)における導電性のコンタクト材料28と、を有しており、これによってオーミックコンタクト又はカソード電極が形成される。トレンチ18の下側の領域は、p型にドープされたシリコン又はポリシリコンによって、第1の高さ(深さ方向における寸法54)まで充填されている。トレンチ18は、続いて、それぞれ層厚を有している第1の金属により充填される。第1の金属は、p型にドープされたシリコン又はポリシリコンに対するオーミックコンタクトを有している。更に、第1の金属は、n型エピ層に対するショットキーコンタクトを形成しており、従って、アノード電極の一部を同時に成している。更には、第1の金属は第2の金属によって被覆されている。第2の金属はトレンチ18を、有利には少なくともトレンチ18の上端まで充填する。更には、第2の金属は、第1の面16においてトレンチ18に接している領域では、同様にn型エピ層に対するショットキーコンタクトを形成しているので、やはり、アノード電極の一部を成している。
電気的にみて、図示されているTSBS−PNは、異なる障壁高さを有している2つのショットキーダイオードと、トレンチ18の底部38に配置されている、アノードとしての「p型ウェル」及びカソードとしてのn型エピ層を有しているPNダイオードとが組み合わせられたものである。特に、n型エピ層のドープは、順方向の大電流での動作時にキャリアの高注入を行うことができるように選定されている。
TSBS−PNでは、電流が差し当たり順方向(PNダイオードを有していないTSBSと同等)に流れる。つまり、電圧が差し当たり比較的低い場合には、流れ方向では上側の金属層20のショットキーダイオードにのみ電流が流れる。電流が大きくなるにつれ、順方向電流は大きくなってPN接合部にも流れ、また場合によっては、下側の金属層22のショットキーダイオードにも流れ、しかも、各障壁高さに依存して流れる。
即ち、TSBS−PNは、ショットキーダイオードとPN−ダイオードが並列に接続されているトレンチ構造を有している。この組み合わせによって、導通動作時には、弱くドープされた領域におけるキャリア濃度はショットキーダイオードにおけるキャリア濃度よりも遙かに高くなるが、しかしながら、例えばPiNダイオードにおけるキャリア濃度よりも遙かに低くなる。これによって、順方向電圧とスイッチング特性との間での最適化が達成される。
逆方向においては、ショットキー障壁においても、PN接合部においても空間電荷領域が生じる。この遮蔽効果は、構造パラメータ、特にトレンチ18間の内のりの間隔46、トレンチ18の幅44又は上述のp型ウェルの幅、p型にドープされたシリコン又はポリシリコンのそれぞれに割り当てられた層厚(p型ウェルの層厚に応じる)、並びに、第1の金属の層厚に強く依存する。
TSBS−PNは更に、PNダイオードの「クランプ機能」が集積されていることによって、比較的高いロバスト性を提供する。PNダイオードの降伏電圧(BV_pn)は、BV_pnがショットキーダイオードの降伏電圧(BV_schottky)よりも低くなるように設定されている。降伏は有利にはトレンチの底部において行われ、またTSBS−PNの降伏電圧はBV_pnによって決定される。従って、ショットキーコンタクトの近傍では高い電界強度は存在せず、また降伏動作時の逆方向電流はPN接合部にしか流れず、TSBSの場合のようにショットキーコンタクトには流れない。つまりTSBS−PNは、PNダイオードと同等のロバスト性を有している。従って、TSBS−PNは例えばツェナーダイオードとしても非常に適している。しかしながらそれにもかかわらず、ショットキーダイオードの特性は、TSBSの場合のように、部分的には存続する。特に高温時のTSBS−PNの漏れ電流は、PiNダイオードに比べて遙かに大きい。
トレンチ・ショットキー・バリア・ショットキーダイオードは、(上記において既に説明したように)本発明によれば、トレンチ18の少なくとも1つの壁部56(図3及び図4を参照されたい)、及び/又は、金属膜14によって被覆されている第1の面16の、トレンチ18に隣接する少なくとも1つの領域24が、金属膜14と半導体ブロック12との間において領域24に存在する、第2の導電型の第1の半導体材料26から成る層によって離隔されている(「TSBS−P」又は「TSBS−PN−P」)ことによって、著しく改善される。この場合、例えば、従来のPiN電力ダイオードと比較して、比較的低い順方向電圧においてスイッチング損失を大幅に低くすることができ、また、TSBS又はTSBS−PNと比較して、同等の順方向電圧及びスイッチング損失において逆方向電流を大幅に小さくすることができる。
更には、(例えばドープ濃度「Np-」を有している)第2の導電型の第1の半導体材料26から成る比較的薄いp型層によって、ショットキーコンタクトを形成している(1番上の)金属膜14の直下において、ショットキーコンタクトの付加的な遮蔽が提供される。これによって、特に高い温度において、順方向電圧を比較的低く維持し、且つ、スイッチング損失を比較的少なく維持しながら、逆方向電流を著しく低減することができる。総じて、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードは、p型層が薄いことから、唯一の単純なショットキーコンタクトを形成しているのではなく、「ショットキーコンタクトシステム」を形成している。
注記:本明細書では、全体として、各電流経路においては薄いp型層を1つだけしか通過しないことを示唆するために、「薄いp型層」を単数で記した。このことは、本発明に係る半導体装置10は、特に複数のトレンチ18に起因して、有利にはその種の薄いp型層を(平行に)複数有しており、それらの薄いp型の層が1つ又は複数のトレンチ18によって相互に離隔されていると解される。
例1:第2の導電型の第1の半導体材料26から成る上述の薄いp型層が比較的厚く形成されており、且つ、比較的強くドープされている場合には、ショットキーコンタクトはほぼ完全に遮蔽される。本発明に係る半導体装置10の第1の面16(「表面」)における上側の金属膜14は、薄いp型層と共に、オーミックコンタクトを形成している。それにより生じる、上下に重なって配置された一連の層、即ち、上側の金属膜14、薄いp型層(半導体材料26)、n型エピ層及びn+型基板は、PiNダイオードと同様に機能する。この例では、確かに、比較的小さい逆方向電流が生じるが、しかしながら、低い電流密度での比較的高い順方向電圧及び比較的高いスイッチング損失も生じる。
例2:しかしながら、薄いp型層が薄く形成されており、且つ、弱く十分にドープされている場合には、薄いp型層はショットキーコンタクトに対してほぼ完全に透明である。半導体装置10の第1の面16(「表面」)における金属膜14は、「金属膜14/薄いp型層(半導体材料26)/n型エピ層(半導体ブロック12)」から成る積層体と共にショットキーコンタクトを形成している。「金属膜14/薄いp型層(半導体材料26)/n型エピ層(半導体ブロック12)/n+型基板(部分ブロック34)」から成る積層体は、ショットキーダイオードと同等に機能する。ここでは、比較的高い逆方向電流、高い電流密度での比較的高い順方向電圧及び比較的少ないスイッチング損失が生じる。
本明細書において、薄いp型層が少数キャリアに対して、ここでのp型エミッタの場合には電子に対して透過性である場合、薄いp型層を透明と称する。このために一方では、電子をショットキーコンタクトから半導体材料26又は半導体ブロック12(例えばシリコン)へと注入できるようにするために、薄いp型層のドープ濃度及び厚さ(深さ方向の寸法52)によって決定される、薄いp型層も含めたショットキーコンタクトシステムの障壁は十分に低く且つ薄いものでなくてはならない。他方では、少数キャリア(電子)が薄いp型層を通る過程においてほとんど再結合されないことが必要になる。即ち、電子の走行時間はその少数キャリアの寿命よりも遙かに短いものでなければならない。
例3:薄いp型層の厚さ及びドープ濃度が(本発明に従い)適切に設定される場合には、例えば、高い電流密度での順方向電圧、逆方向電流及びスイッチング損失のような重要な特性量を設定又は最適化することができる。この場合、「金属膜14/薄いp型層(半導体材料26)/n型エピ層(半導体ブロック12)/n+型基板(部分ブロック34)」から成る積層体は、部分的に透明なp型層を有しているショットキーダイオードのように機能する。p型層の最適化パラメータは、p型層の層厚(深さ方向の寸法54)並びにp型層のドープ濃度「Np-」である。
特に本発明は、ショットキーコンタクトの直下に薄いp型層を形成することによって、特に高い温度での逆方向電流を著しく低減することができ、またそれと同時に順方向電圧及びスイッチング損失に顕著な影響を及ぼさないようにすることができる。即ち、一方では、導通動作時にはp型層からの正孔注入がほとんど行われないか又は極僅かにしか行われないように、従って、キャリア分布が実質的にTSBSに相当するように、p型層が有利には薄く形成され且つ弱くドープされるべきである。他方では、逆方向においてショットキーコンタクトを少なくとも部分的に遮蔽するために、薄いp型層が比較的厚く形成され、且つ、比較的強くドープされるべきである。従って、用途の要求に応じて、p型層は、上記において既に述べたように、10nmから500nmまでの範囲の厚さを有するように、且つ、1cm3あたり1016原子から1017原子までの範囲のドープ濃度を有するように形成される。
同様に上記において説明したように、本発明にはTSBS−PNダイオードも含まれ、このダイオードは、本発明による薄いp型層が設けられていることから、以下では「TSBS−PN−P」(クランプ素子としての集積PNダイオードとショットキーコンタクトの直下に薄いp型層とが設けられているトレンチ・ショットキー・バリア・ショットキーダイオード)と記す。
上記において述べた「TSBS−P」ダイオードと同等に、「TSBS−PN−P」ダイオードにおいても、(例えばドープ濃度「Np-」を有している)第2の導電型の第1の半導体材料26から成る比較的薄いp型層が、ショットキーコンタクトを形成している(上側の)金属膜14の直下に配置されている。相応に、本発明に係るTSBS−PN−Pダイオードも、p型層が薄いことから、唯一の単純なショットキーコンタクトを形成しているのではなく、「ショットキーコンタクトシステム」を形成している。
上記の要約として、以下では本発明の利点を挙げ、また幾つかの利点は再度述べる。
慣例の高電圧ショットキーダイオードとの比較:
−弱くドープされた領域の導電率が高注入によって大幅に高められているので、電流密度が高い領域での非常に低い順方向電圧が実現される。このことは、「TSBS−P」の実施の形態では、ショットキーコンタクトの直下にある薄いp型層によってもたらされる。「TSBS−PN−P」の実施の形態では、このことは付加的に集積PNダイオードによってもたらされる。
−ショットキーコンタクトの直下にある薄いp型層との組み合わせにおいて、トレンチ構造を用いてショットキー効果を遮蔽することによる比較的低い漏れ電流。更に、「TSBS−PN−P」の実施の形態では、PNダイオードのクランプ機能による比較的高いロバスト性がもたらされる。
従来の高電圧PiNダイオードとの比較:
−高い電流密度での高注入との組み合わせにおいて、ショットキーコンタクトの適切な障壁高さを用いることによる、高い電流密度での比較的低い順方向電圧。
−導通動作時にショットキーコンタクトシステム(ショットキーコンタクトの直下にある、薄いp型層と組み合わせられたショットキーコンタクト)によって、少数のキャリアが弱くドープされた領域に注入され蓄積されることによる、比較的低いスイッチオフ損失。
従来技術の別の解決手段(いわゆる「クールSBD」ダイオード)との比較:
−比較的強い高注入による高い電流密度での比較的低い順方向電圧。ショットキー効果を効率的に遮蔽することによる比較的低い漏れ電流。
ショットキーコンタクトの直下に薄いp型層が設けられていない従来のTSBS又はTSBS−PNとの比較
−TSBS−Pの実施の形態では、スイッチオフ損失はやや高くなるが、非常に低い漏れ電流、並びに、高い電流密度での比較的低い順方向電圧が実現される。
−TSBS−PN−Pの実施の形態では、高い電流密度及びほぼ等しいスイッチオフ損失で、ほぼ等しい順方向電圧において非常に低い漏れ電流が実現される。
図3及び図4には、本発明に係る半導体装置10の別の実施の形態が示されている。図1に示した実施の形態とは異なり、図3の実施の形態においては、第2の導電型の(比較的薄い)第1の半導体材料26が付加的に、トレンチ18の少なくとも1つの壁部56において所定の深さ(参照番号無し)まで少なくとも部分的に配置されている。
図4の実施の形態においては、第1の半導体材料26が付加的に、トレンチ18の各壁面全体並びにトレンチ18の底部38に配置されている。従って、図4においては、金属膜14又は金属層20及び22はそれぞれ、第1の半導体材料26に直接的に接しているが、しかしながら半導体ブロック12には直接的に接していない。
本発明は、請求項1の上位概念に記載されている半導体装置に関する。
その種の半導体装置は、トレンチ・ショットキー・バリア・ショットキーダイオードの形態で、独国特許出願公開第102004059640号明細書(特許文献1)から公知であり、また、第1の導電型の、体積を有する半導体、即ち、半導体ブロックを有しており、この半導体ブロックは、金属膜によって被覆されている第1の面と、その第1の面に延在し、且つ、少なくとも部分的に金属によって充填されている少なくとも1つのトレンチとを有している。
独国特許出願公開第102004059640号明細書
ショットキーダイオードは通常の場合、金属半導体コンタクト又はシリコン半導体コンタクトを有している。ショットキーダイオードでは、導通動作時に高注入は行われず、従って、スイッチオフ時に少数キャリアの除去は行われない。ショットキーダイオードではスイッチングが比較的高速に行われ、損失が少ない。ここで、高注入という用語は、注入される少数キャリアの密度が多数キャリアの規模に達する状態を意味している。
もっとも、ショットキーダイオードは、比較的高い漏れ電流を示し、特に比較的高い温度では、いわゆる「障壁低下効果(Barrier-Lowering-Effect)」に起因して高い電圧依存性を有している。更には、一般的に、高い逆方向電圧に対しては、低ドープの厚い半導体層が必要になり、これによって、大電流では比較的高い順方向電圧が生じる。従って、シリコン技術における電力ショットキーダイオードは、スイッチング特性が良好であるにもかかわらず、約100Vを上回る逆方向電圧に対しては適しておらず又はほとんど適していない。
本発明に係る半導体装置は、請求項1の特徴部分に記載されている構成によって、冒頭で述べたような従来技術とは異なっており、従って、トレンチの少なくとも1つの壁部、及び/又は、金属膜によって被覆されている第1の面の、トレンチに隣接する少なくとも1つの領域が、金属膜と半導体ブロックとの間に位置する、第2の導電型の第1の半導体材料から成る半導体層を備えているという特徴を備えている。
本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオード(下記において更に説明するように、以下では「TSBS−P」又は「TSBS−PN−P」又はダイオードとも記す。)は、比較的低い順方向電圧及び比較的少ないスイッチング損失を実現する。更には、第2の導電型の第1の半導体材料から成る比較的薄い層は、金属膜を使用して形成されるショットキーコンタクトの付加的な遮蔽を実現する。これによって、特に高い温度において、順方向電圧を比較的低く維持し、且つ、スイッチング損失を比較的少なく維持しながら、逆方向電流を著しく低減することができる。
そのように配置されている、第1の半導体材料から成る層によって、半導体ブロックの導電率が高注入によって大幅に高められているので、慣例の高電圧ショットキーダイオードと比較して、電流密度が高い領域での非常に低い順方向電圧を実現することができる。この利点を、集積PNダイオードによって更に拡大することができる。更には、そのように配置されている、第1の半導体材料から成る層によって、トレンチ構造を用いてショットキー効果が遮断されることより、漏れ電流は比較的低くなる。また、この構想は、集積PNダイオードの電圧制限クランプ機能によって比較的高いロバスト性がもたらされる変形形態に適している。
従来の高電圧PiNダイオードと比較すると、高い電流密度での高注入との組み合わせにおいて、ショットキーコンタクトの適切な障壁高さを用いて、高い電流密度での比較的低い順方向電圧の利点がもたらされる。更には、導通動作時にはショットキーコンタクトシステム(例えば、ショットキーコンタクトの直下にある、薄いp型層と組み合わせられたショットキーコンタクト)によって、少数のキャリアが弱くドープされた領域に注入され蓄積されるので、スイッチオフ損失が少なくなる。従来技術から「クールSBD」ダイオードとして公知である別のダイオードと比較すると、比較的強い高注入によって高い電流密度での比較的低い順方向電圧がもたらされ、また、ショットキー効果の効率的な遮蔽によって比較的低い漏れ電流がもたらされる。
そのように配置されている半導体層(例えば、ショットキーコンタクトの直下にある薄いp型層としての半導体層)を備えていない従来のTSBS又はTSBS−PNと比較すると、スイッチオフ損失はやや高くなるが、高い電流密度での比較的低い順方向電圧並びに非常に低い漏れ電流が生じる。集積PNダイオードを備えている実施の形態においては、高い電流密度及びほぼ等しいスイッチオフ損失で、ほぼ等しい順方向電圧において非常に低い漏れ電流がもたらされる。
有利な発展形態は従属請求項に記載されている。更に、有利な構成は図面及び下記に記載されている。それらの特徴は単独でも有利であると考えられ、また種々の組み合わせにおいても、それらの組み合わせを改めて明示的に示さなくとも、やはり本発明にとって有利であると考えられる。
本発明に係るダイオードを、ダイオードの降伏電圧が例えば10Vよりも高い、特に100Vよりも高い、とりわけ200Vよりも高い、又は、それどころか600Vよりも高い値を有するように形成することも可能である。従って、本発明に係るショットキーダイオードは、特に、高電圧の用途に適しており、またそれと同時に、低い順方向電圧、低い漏れ電圧、少ないスイッチング損失電力及び高いロバスト性を有している。更に本発明に係るショットキーダイオードは、有利には、特に変換器用の電力ダイオードとして、例えば光電装置又は自動車用途のための電力ダイオードとして有利である。例えば、ダイオードをいわゆる「還流ダイオード」としても使用することができる。
半導体装置の1つの構成においては、半導体ブロックが少なくとも2つのトレンチを有している。これによって、トレンチ・ショットキー・バリア・ショットキーダイオードの有利な特性を更に改善することができる。
更には、第2の導電型の第1の半導体材料は、10nmから500nmまでの範囲の層厚を有することができる。また、第2の導電型の第1の半導体材料のドープ濃度は、1cm3あたり約1016原子から1cm3あたり約1017原子までの値を有することができる。そのような薄い層は、特に上述のドープ濃度と共に、本発明に係るダイオードの比較的小さい逆方向電流、比較的低い順方向電圧及び比較的少ないスイッチング損失を実現することに非常に適している。
本発明の1つの構成では、少なくとも1つのトレンチの底部の領域が第2の半導体材料で充填されている。この第2の半導体材料は、第2の導電型の多結晶半導体材料又は第2の導電型の半導体材料である。このことは有利には、第2の半導体材料及び第1の導電型の半導体ブロックを用いてPNダイオードが形成されているように行われる。これによって、本発明に係る半導体装置においてトレンチ・ショットキー・バリア・ショットキーダイオードに電気的に並列にPNダイオード(いわゆる「クランプ素子」)を集積することが実現される。
本発明の1つの構成においては、PNダイオードの降伏電圧が、金属膜と、第2の導電型の第1の半導体材料から成る層と、第1の導電型の半導体ブロックとによって形成されているトレンチ・ショットキー・バリア・ショットキーダイオードの降伏電圧よりも、低い。
有利には、半導体装置は、電気的な降伏を少なくとも1つのトレンチの底部部分の領域において行うことができるように形成されている。
有利には、半導体装置は、降伏状態において、比較的大きい電流で駆動できるように形成されている。
本発明の1つの構成においては、少なくとも1つのトレンチの底部の領域が、ホウ素(一般的に、第1の導電型の濃度よりも高い濃度の第2の導電型のドーパント)の注入によって、第2の導電型の半導体材料に変換されている。これによって、半導体装置の特性を総じて改善することができる。
更には、少なくとも部分的に金属で充填されているトレンチが、トレンチの深さに関して上下に重なって配置されている少なくとも2つの金属層を有しており、上側の金属層は、第1の導電型の半導体ブロックの第1の面を覆っている金属膜の一部を形成しており、また、それらの金属層は有利には互いに異なる金属を含んでいる。有利には、少なくとも1つのトレンチは、少なくとも1つの金属によって完全に充填されている。
補完的に、上側の金属層(金属膜に相当する)のポテンシャルレベル(ショットキー障壁)の高さを、その下に配置されている金属層のポテンシャルレベル(ショットキー障壁)の高さよりも低くすることができる。これによって、トレンチ・ショットキー・バリア・ショットキーダイオードの特性を改善し、且つ、それぞれの電気的な要求に適合させるための別の複数の有利な実現手段がもたらされる。
半導体装置の1つの別の構成では、金属膜によって被覆されている第1の面とは反対側に位置する半導体ブロックの第2の面が、導電性のコンタクト材料によって被覆されており、このコンタクト材料に接している半導体ブロックの部分ブロックは、半導体ブロックのその他の部分よりも強くドープされている。特に、部分ブロックは、従来技術から同様に公知であるように、いわゆる「n+型基板」(半導体装置が逆の導電型でドープされている場合には「p+型基板」)である。ここで、上記において説明した金属膜を第1の電極(アノード電極)として使用することができ、また、上述のコンタクト材料(有利には、やはり金属膜として形成されている)を第2の電極(カソード電極)として使用することができる。これによって、総じて、本発明に係るダイオードに非常に適した構造が表される。
本発明に係る半導体装置の1つの構成では、半導体装置がはんだ付け可能な電極又ははんだ付け可能な素子端子を有している。
半導体装置の1つの構成では、半導体装置が圧入ダイオードとして形成されており、且つ、相応のケーシングを有している。補完的に、半導体装置は自動車の整流装置の素子であってもよい。
更には、半導体装置を、少なくとも部分的に、エピタキシ法及び/又はエッチング法及び/又はイオン注入法を用いて製造することができる。これによって、本発明に係る半導体装置を製造するための有利な実現手段が表される。
半導体装置の1つの別の構成では、少なくとも1つのトレンチの深さが1μmから4μmまでの値、有利には約2μmの値を有している。この寸法によって、例えば、本発明に係るダイオードを自動車における整流装置に使用するために、非常に適したサイズが表される。例えば、本発明に係るダイオードの許容逆方向電圧は約600Vにも達することが可能である。半導体装置の別の有利な寸法は、トレンチの深さと、各2つのトレンチ間の内のりの間隔との比が約2以上である場合にもたらされる。
更には、少なくとも1つのトレンチは、実質的に帯状の形状及び/又は実質的に島状の形状を有することができる。帯状の形状は、実質的に真っ直ぐ延びる形状(線)を表し、また島状の形状は、実質的に局所的に集中した形状、特に円形、六角形等の形状を表す。有利には、トレンチは、実質的に矩形の横断面を有している。トレンチの底部を平坦に形成してもよいし、丸みをもたせるように(「U字の形状」)、例えば半球状に形成してもよい。
本発明に係る半導体装置の第1の変形形態では、第1の導電型が、n型にドープされた半導体材料に対応し、第2の導電型が、p型にドープされた半導体材料に対応する。本発明に係る半導体装置の第2の変形形態では、第1の導電型が、p型にドープされた半導体材料に対応し、第2の導電型が、n型にドープされた半導体材料に対応する。従って、半導体装置は原則として、考えられる2つのいずれの極性にも適している。
更に、半導体装置は、シリコン材料及び/又は炭化ケイ素材料及び/又はシリコンゲルマニウム材料及び/又はガリウムヒ素材料を含むことができる。従って、本発明を通常のあらゆる半導体材料に対して使用することができる。
以下では、添付の図面を参照しながら本発明の実施例を説明する。
トレンチ・ショットキー・バリア・ショットキーダイオードを備えた第1の実施の形態の半導体装置の略断面図を示す。 トレンチ・ショットキー・バリア・ショットキーダイオード及び集積PNダイオードを備えた第2の実施の形態の半導体装置の略断面図を示す。 トレンチ・ショットキー・バリア・ショットキーダイオードを備えた第3の実施の形態の半導体装置の略断面図を示す。 トレンチ・ショットキー・バリア・ショットキーダイオードを備えた第4の実施の形態の半導体装置の略断面図を示す。
全図中、機能的に等価の構成要素及び機能的に等価の大きさのものには、異なる実施の形態においても同一の参照番号を使用している。特に、以下の説明において、一部では以下の略語を使用している。
−「TSBS」は、公知の従来技術と同等のトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
−「TSBS−PN」は、公知の従来技術と同等の、いわゆる「クランプ素子」としての集積PNダイオードを備えたトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
−「TSBS−P」は、金属膜(金属膜14)と半導体ブロック(半導体ブロック12)との間に第2の導電型の第1の半導体材から成る層26(「薄いp型層」)が配置されている、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
−「TSBS−PN−P」は、「TSBS−P」の実施の形態を補完する形でクランプ素子としての集積PNダイオードが設けられている、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードを表す。
図1には、トレンチ・ショットキー・バリア・ショットキーダイオードを備えている半導体装置10の第1の実施の形態(TSBS−P)が示されている。半導体装置10は、第1の導電型の半導体ブロック12を有しており、この半導体ブロック12は、金属膜14によって被覆されている第1の面16と、この第1の面16に延在し、且つ、少なくとも部分的に金属で充填されているトレンチ18と、を有しており、この実施の形態ではトレンチ18は2つ設けられている。
トレンチ18の深さ42はそれぞれ約2μmである。半導体装置10の別の実施の形態においては、トレンチ18の深さ42は1μmから4μmの間であってよい。トレンチ18の深さ42と、2つの各トレンチ18間の内のりの間隔46との比は約2である。半導体装置10の別の実施の形態においては、この比は2より大きくてもよいし、2より小さくてもよい。
ここでは、各トレンチ18が、(図1においては垂直方向において定義されている)トレンチ18の深さ42に関して上下に重なって配置されている2つの金属層20及び22を有しており、上側の金属層20は、第1の導電型の半導体ブロック12の第1の面16を覆っている金属膜14の一部を形成している。有利には、金属層20及び22は互いに異なる金属を含んでいる。ここでは、上側の金属層20(この実施の形態では金属膜14に相当する)のポテンシャルレベル(ショットキー障壁)の高さは、その下に配置されている金属層22のポテンシャルレベル(ショットキー障壁)の高さよりも低い。上側の金属膜14の上方には、例えばはんだ付け可能な表面を形成する、(図示していない)別の金属膜を複数設けることができる。
更に図1から見て取れるように、金属膜14によって被覆されている第1の面16の、トレンチ18に隣接する領域24は、金属膜14と半導体ブロック12との間に存在する、第2の導電型の第1の半導体材料から成る層26によって離隔されている。第1の半導体材料から成るこの層26は比較的薄い。この実施の形態では、層26は約10nmから約500nmまでの層厚を有している。例えば層厚は約70nmである。第2の導電型の半導体材料のドープ濃度は、1cm3あたり約1016原子から1cm3あたり約1017原子までである。
更にこの図から見て取れるように、トレンチ18は、金属層20及び22の金属によって完全に充填されている。これとは異なり、トレンチ18が、金属によって完全に充填されていなくてもよい。トレンチ18の壁面及びトレンチ18の各底部38が途切れなく金属層20又は22と接触していることのみが保証されていればよい。
金属膜14によって被覆されている第1の面16とは反対側に位置する半導体ブロック12の第2の面30は、導電性のコンタクト材料28によって被覆されている。コンタクト材料28に接している、半導体ブロック12の部分ブロック34は、半導体ブロック12のその他の部分よりも強くドープされている。有利には、導電性のコンタクト材料28は金属である。コンタクト材料28もまた、上下に重なって配置される複数の金属膜を含むことができる。
半導体装置10は、少なくとも部分的に、エピタキシ法及び/又はエッチング法及び/又はイオン注入法を用いて製造されている。半導体構造を作製するためのそれらの方法は、一般的に従来技術より公知である。
半導体装置10の1つの実施の形態においては、上述の第1の導電型はn型にドープされた半導体材料に相当し、上述の第2の導電型はp型にドープされた半導体材料に相当する。金属膜14はショットキーコンタクトの一部であり、またここではアノード電極である。従って、コンタクト材料28は対応するカソード電極を形成している。
半導体装置10の1つの別の実施の形態では、第1の導電型がp型にドープされた半導体材料に相当し、第2の導電型はn型にドープされた半導体材料に相当する。
この実施の形態では、半導体装置10が実質的にシリコン材料から作製されている。別の実施の形態では、半導体装置10が、炭化ケイ素材料及び/又はシリコンゲルマニウム材料及び/又はガリウムヒ素材料から作製されている。
また図1において、矢印又は両矢印によって表されている、半導体装置10における別の複数の寸法は、トレンチ18の幅44、図面において下側の金属層22の厚さ又は深さ方向の寸法48、上側の金属層20の厚さ又は深さ方向の寸法50、並びに、第2の導電型の第1の半導体材から成る層26の厚さ又は深さ方向の寸法52を表している。
図2には、半導体装置10の第2の実施の形態(TSBS−PN−P)が示されている。図1に示した実施の形態を補完する態様で、図2においては、トレンチ18の底部38の領域36が、第2の導電型を有している第2の半導体材料40で充填されている。領域36は、ここでもまた両矢印によって表されている深さ方向の寸法54を有している。
第2の導電型の第2の半導体材料40と、図面においてその下に配置されている、第1の導電型の半導体ブロック12とによって、PNダイオードが形成される。このPNダイオードは、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードと電気的に並列に接続されている。特に、半導体ブロック12のドープは、半導体装置10の動作時に、順方向の大電流によってキャリアの高注入を行うことができるように実施されている。
この実施の形態では、半導体装置10は、サイズ、材料及びドープに関して、PNダイオードの降伏電圧が、金属膜14と、第2の導電型の第1の半導体材料ら成る層26と、第1の導電型の半導体ブロック12とによって形成されているトレンチ・ショットキー・バリア・ショットキーダイオードの降伏電圧よりも、低いように寸法設計されている。
半導体装置10の1つの実施の形態では、第2の半導体材料40は多結晶半導体材料である。この場合、トレンチ18の底部38は、例えば化学元素ホウ素を用いるイオン注入によって、第1の導電型から第2の導電型に変換される。このようにして同様にPNダイオードが形成される。
図2に示されているように、TSBS−PN−Pは、n+型基板(部分ブロック34)と、n型エピ層(半導体ブロック12)と、n型エピ層をエッチングすることにより形成された少なくとも2つのトレンチ18と、オーミックコンタクト又はカソード電極としての、チップ(半導体装置10)の第2の面30(「裏面」)における金属膜(導電性のコンタクト材料28)とから形成されている。
トレンチ18の下側の領域36は、図2に示した深さ方向の寸法54に応じて、p型にドープされた半導体材料40(例えばp型シリコン)又はポリ半導体材料(ポリシリコン)で充填されている。続いて、深さ方向の寸法48に応じて、トレンチ18は下側の金属(金属層22)で充填され、これに伴いp型にドープされた第2の半導体材料40(特にp型にドープされたシリコン又はポリシリコン)に対するオーミックコンタクト及び半導体ブロック12(n型エピ層)に対するショットキーコンタクトが形成され、また最後にトレンチ18は上側の金属(金属層20)によって被覆される。上側の金属は、深さ方向の寸法50に応じてトレンチ18の一部を充填し、これに伴いn型エピ層に対するショットキーコンタクトが形成され、また下側の金属のようにやはりアノード電極として使用される。特に、n型エピ層のドープは、順方向の大電流での動作時には高注入が行われているように選定されている。
TSBS−Pの場合のように(図1を参照されたい)、薄いp型層26(第2の導電型の第1の半導体材料はドープ濃度「Np-」に応じてショットキーコンタクト(金属膜14)の直下に設けられている。この際、金属膜14は、半導体装置10の第1の面16において、従来技術から既に公知であるTSBS−PNのように単純なショットキーコンタクトを形成しているのではなく、図2から見て取れるように、「ショットキーコンタクトシステム」を形成している。
TSBS−P(図1を参照されたい)に対するTSBS−PN−P(図2を参照されたい)の利点は、集積PNダイオードの付加的なクランプ機能並びにそれに付随するロバスト性である。電圧制限クランプ機能は、PNダイオードの降伏電圧がショットキーダイオードの降伏電圧よりも低いことからもたらされる。この相対的な改善(PNを有している場合/PNを有していない場合)は、TSBS−PNとTSBSとが比較される従来技術と同じようにしてもたらされる。
図1に示したTSBS−Pの場合においても、図2に示したTSBS−PN−Pの場合においても、上記の領域24は半導体ブロック12の「上面」にのみ設けることができるのではなく、それらの領域24を(下記において図3及び図4を参照して説明するように)トレンチ18の各壁部56及び/又は各底部38にも付加的に配置することができる。
TSBS−P(図1を参照されたい)も、TSBS−PN−P(図2を参照されたい)も、本発明に係る半導体装置10の縁部領域において、縁部電界強度を低減するための付加的な構造を更に有することができる。この付加的な構造は、例えば、低ドープされたp型の領域、フィールドプレート又は従来技術に対応する類似の構造であってよい。
機能的な側面に関する以下の説明では、分かり易くするために、第1の導電型をそれぞれnドープとし、第2の導電型をそれぞれpドープとする。上記において既に述べたように、択一的に、各ドープを逆に実施することも可能である。このことは、上記において各図を参照しながら説明した実施例についても当てはまる。
上記においてやはり一部説明したように、本発明に係るダイオードの実施例は、電気的なコンタクト材料28(カソード電極)と、その上に形成された、部分ブロック34としてのn+型基板と、その上に形成された、半導体ブロック12に対する部分ブロック34を補完する、ここでは真性半導体材料としてのn型エピ層(即ちエピタキシャルに形成された半導体材料)と、エッチングによってn型エピ層に実現された、有利には少なくとも2つのトレンチ18と、半導体装置10の第1の面16におけるショットキーコンタクトの一部又はアノード電極としての金属膜14とを含んでいる。作製時には、先ずトレンチ18が有利には、図1においては下側にある第1の金属層22(以下では「第1の金属」又は「下側の金属」とも記す)によって、所定の深さ48まで充填され、続いて第2の金属層20(以下では「第2の金属」又は「上側の金属」とも記す)によって被覆される。第2の金属層20は、トレンチ18を有利にはトレンチ18の上端まで充填する。
第1の金属及び第2の金属は、有利には、第2の金属が第1の金属よりも低い障壁高さを有するように選定されている。従って、電気的にみると、TSBSは、異なる障壁高さを有している2つのショットキーダイオード、即ち、アノードとしての第1の金属とカソードとしてのn型エピ層との間にショットキー障壁を有している第1のショットキーダイオードと、アノードとしての第2の金属とカソードとしてのn型エピ層との間にショットキー障壁を有している第2のショットキーダイオードとが組み合わせられたものである。
2つの金属の障壁高さが著しく異なる場合、流れ方向(順方向)での動作時に、電流が主として、比較的低い障壁を有している上側の金属へと流れ、その際、電流はトレンチ18の対応する側方の壁部も越えて流れる。従って、流れ方向において流れる電流の有効面は、TSBSでは比較的大きい。
逆方向では、第1の金属が自身の比較的高い障壁高さによって、空間電荷領域を比較的大きく拡大させる。空間電荷領域は電圧の上昇と共に拡大し、また、TSBSの降伏電圧よりも低い電圧では、直接的に隣り合う2つのトレンチ18間の領域の中央において衝突する。これによって、大きい逆方向電流の原因となるショットキー効果が遮蔽され、逆方向電流が低減される。この遮蔽効果は、構造パラメータ(例えばトレンチ18の深さ42)、トレンチ18間の内のりの間隔46、トレンチ18の幅44並びに第1の金属の層厚に強く依存する。トレンチ18間のいわゆる「メサ領域」における空間電荷領域の拡大は、トレンチ18の深さ42が上述の内のりの間隔46よりも著しく大きい限りは、ほぼ1次元である。
TSBSの利点は、2つの金属が組み合わせられることであり、これによって、順方向電圧に対する要求に関して上述の種々の構造をある程度離隔させることができ、また遮蔽作用が実現される。順方向電圧及び逆方向電流の初期値は、主として、(比較的低い障壁を有している)第2の金属の影響を受ける。第2の金属の層厚が大きくなるにつれ、順方向電圧は低くなり、且つ、逆方向電流の初期値は高くなる。
他方では、(比較的高い障壁を有している)第1の金属は、逆方向電流の電圧依存性、並びに、高い逆方向電流での降伏電圧及び電流分布を決定する。従って、TSBSは、2つの金属を組み合わせることによる最適化を実現する。2つの金属の障壁高さも各層厚も、パラメータとして設定することができる。
ショットキーダイオードに対して電気的に並列に作用する半導体装置10にPNダイオードが集積されている場合(上記において既に説明した)には、上記のようにして形成されたダイオードを改善することができる。この場合には、特にいわゆる「正孔注入」を行うことができる。このダイオードを以下では差し当たり「TSBS−PN」と記す。
このTSBS−PNもまた、n+型基板と、n型エピ層と、そのn型エピ層をエッチングすることにより形成された少なくとも2つのトレンチ18と、半導体装置10の第2の面30(図面においては下側、つまり裏面)における導電性のコンタクト材料28と、を有しており、これによってオーミックコンタクト又はカソード電極が形成される。トレンチ18の下側の領域は、p型にドープされたシリコン又はポリシリコンによって、第1の高さ(深さ方向における寸法54)まで充填されている。トレンチ18は、続いて、それぞれ層厚を有している第1の金属により充填される。第1の金属は、p型にドープされたシリコン又はポリシリコンに対するオーミックコンタクトを有している。更に、第1の金属は、n型エピ層に対するショットキーコンタクトを形成しており、従って、アノード電極の一部を同時に成している。更には、第1の金属は第2の金属によって被覆されている。第2の金属はトレンチ18を、有利には少なくともトレンチ18の上端まで充填する。更には、第2の金属は、第1の面16においてトレンチ18に接している領域では、同様にn型エピ層に対するショットキーコンタクトを形成しているので、やはり、アノード電極の一部を成している。
電気的にみて、図示されているTSBS−PNは、異なる障壁高さを有している2つのショットキーダイオードと、トレンチ18の底部38に配置されている、アノードとしての「p型ウェル」及びカソードとしてのn型エピ層を有しているPNダイオードとが組み合わせられたものである。特に、n型エピ層のドープは、順方向の大電流での動作時にキャリアの高注入を行うことができるように選定されている。
TSBS−PNでは、電流が差し当たり順方向(PNダイオードを有していないTSBSと同等)に流れる。つまり、電圧が差し当たり比較的低い場合には、流れ方向では上側の金属層20のショットキーダイオードにのみ電流が流れる。電流が大きくなるにつれ、順方向電流は大きくなってPN接合部にも流れ、また場合によっては、下側の金属層22のショットキーダイオードにも流れ、しかも、各障壁高さに依存して流れる。
即ち、TSBS−PNは、ショットキーダイオードとPN−ダイオードが並列に接続されているトレンチ構造を有している。この組み合わせによって、導通動作時には、弱くドープされた領域におけるキャリア濃度はショットキーダイオードにおけるキャリア濃度よりも遙かに高くなるが、しかしながら、例えばPiNダイオードにおけるキャリア濃度よりも遙かに低くなる。これによって、順方向電圧とスイッチング特性との間での最適化が達成される。
逆方向においては、ショットキー障壁においても、PN接合部においても空間電荷領域が生じる。この遮蔽効果は、構造パラメータ、特にトレンチ18間の内のりの間隔46、トレンチ18の幅44又は上述のp型ウェルの幅、p型にドープされたシリコン又はポリシリコンのそれぞれに割り当てられた層厚(p型ウェルの層厚に応じる)、並びに、第1の金属の層厚に強く依存する。
TSBS−PNは更に、PNダイオードの「クランプ機能」が集積されていることによって、比較的高いロバスト性を提供する。PNダイオードの降伏電圧(BV_pn)は、BV_pnがショットキーダイオードの降伏電圧(BV_schottky)よりも低くなるように設定されている。降伏は有利にはトレンチの底部において行われ、またTSBS−PNの降伏電圧はBV_pnによって決定される。従って、ショットキーコンタクトの近傍では高い電界強度は存在せず、また降伏動作時の逆方向電流はPN接合部にしか流れず、TSBSの場合のようにショットキーコンタクトには流れない。つまりTSBS−PNは、PNダイオードと同等のロバスト性を有している。従って、TSBS−PNは例えばツェナーダイオードとしても非常に適している。しかしながらそれにもかかわらず、ショットキーダイオードの特性は、TSBSの場合のように、部分的には存続する。特に高温時のTSBS−PNの漏れ電流は、PiNダイオードに比べて遙かに大きい。
トレンチ・ショットキー・バリア・ショットキーダイオードは、(上記において既に説明したように)本発明によれば、トレンチ18の少なくとも1つの壁部56(図3及び図4を参照されたい)、及び/又は、金属膜14によって被覆されている第1の面16の、トレンチ18に隣接する少なくとも1つの領域24が、金属膜14と半導体ブロック12との間において領域24に存在する、第2の導電型の第1の半導体材料ら成る層26によって離隔されている(「TSBS−P」又は「TSBS−PN−P」)ことによって、著しく改善される。この場合、例えば、従来のPiN電力ダイオードと比較して、比較的低い順方向電圧においてスイッチング損失を大幅に低くすることができ、また、TSBS又はTSBS−PNと比較して、同等の順方向電圧及びスイッチング損失において逆方向電流を大幅に小さくすることができる。
更には、(例えばドープ濃度「Np-」を有している)第2の導電型の第1の半導体材料ら成る比較的薄いp型層26によって、ショットキーコンタクトを形成している(1番上の)金属膜14の直下において、ショットキーコンタクトの付加的な遮蔽が提供される。これによって、特に高い温度において、順方向電圧を比較的低く維持し、且つ、スイッチング損失を比較的少なく維持しながら、逆方向電流を著しく低減することができる。総じて、本発明に係るトレンチ・ショットキー・バリア・ショットキーダイオードは、p型層26が薄いことから、唯一の単純なショットキーコンタクトを形成しているのではなく、「ショットキーコンタクトシステム」を形成している。
注記:本明細書では、全体として、各電流経路においては薄いp型層26を1つだけしか通過しないことを示唆するために、「薄いp型層」を単数で記した。このことは、本発明に係る半導体装置10は、特に複数のトレンチ18に起因して、有利にはその種の薄いp型層26を(平行に)複数有しており、それらの薄いp型層26が1つ又は複数のトレンチ18によって相互に離隔されていると解される。
例1:第2の導電型の第1の半導体材料ら成る上述の薄いp型層26が比較的厚く形成されており、且つ、比較的強くドープされている場合には、ショットキーコンタクトはほぼ完全に遮蔽される。本発明に係る半導体装置10の第1の面16(「表面」)における上側の金属膜14は、薄いp型層26と共に、オーミックコンタクトを形成している。それにより生じる、上下に重なって配置された一連の層、即ち、上側の金属膜14、薄いp型層26、n型エピ層及びn+型基板は、PiNダイオードと同様に機能する。この例では、確かに、比較的小さい逆方向電流が生じるが、しかしながら、低い電流密度での比較的高い順方向電圧及び比較的高いスイッチング損失も生じる。
例2:しかしながら、薄いp型層26が薄く形成されており、且つ、弱く十分にドープされている場合には、薄いp型層26はショットキーコンタクトに対してほぼ完全に透明である。半導体装置10の第1の面16(「表面」)における金属膜14は、「金属膜14/薄いp型層26/n型エピ層(半導体ブロック12)」から成る積層体と共にショットキーコンタクトを形成している。「金属膜14/薄いp型層26/n型エピ層(半導体ブロック12)/n+型基板(部分ブロック34)」から成る積層体は、ショットキーダイオードと同等に機能する。ここでは、比較的高い逆方向電流、高い電流密度での比較的高い順方向電圧及び比較的少ないスイッチング損失が生じる。
本明細書において、薄いp型層26が少数キャリアに対して、ここでのp型エミッタの場合には電子に対して透過性である場合、薄いp型層26を透明と称する。このために一方では、電子をショットキーコンタクトから薄いp型層26又は半導体ブロック12(例えばシリコン)へと注入できるようにするために、薄いp型層26のドープ濃度及び厚さ(深さ方向の寸法52)によって決定される、薄いp型層26も含めたショットキーコンタクトシステムの障壁は十分に低く且つ薄いものでなくてはならない。他方では、少数キャリア(電子)が薄いp型層26を通る過程においてほとんど再結合されないことが必要になる。即ち、電子の走行時間はその少数キャリアの寿命よりも遙かに短いものでなければならない。
例3:薄いp型層26の厚さ及びドープ濃度が(本発明に従い)適切に設定される場合には、例えば、高い電流密度での順方向電圧、逆方向電流及びスイッチング損失のような重要な特性量を設定又は最適化することができる。この場合、「金属膜14/薄いp型層26/n型エピ層(半導体ブロック12)/n+型基板(部分ブロック34)」から成る積層体は、部分的に透明なp型層を有しているショットキーダイオードのように機能する。p型層26の最適化パラメータは、p型層26の層厚(深さ方向の寸法54)並びにp型層26のドープ濃度「Np-」である。
特に本発明は、ショットキーコンタクトの直下に薄いp型層26を形成することによって、特に高い温度での逆方向電流を著しく低減することができ、またそれと同時に順方向電圧及びスイッチング損失に顕著な影響を及ぼさないようにすることができる。即ち、一方では、導通動作時にはp型層26からの正孔注入がほとんど行われないか又は極僅かにしか行われないように、従って、キャリア分布が実質的にTSBSに相当するように、p型層26が有利には薄く形成され且つ弱くドープされるべきである。他方では、逆方向においてショットキーコンタクトを少なくとも部分的に遮蔽するために、薄いp型層26が比較的厚く形成され、且つ、比較的強くドープされるべきである。従って、用途の要求に応じて、p型層26は、上記において既に述べたように、10nmから500nmまでの範囲の厚さを有するように、且つ、1cm3あたり1016原子から1017原子までの範囲のドープ濃度を有するように形成される。
同様に上記において説明したように、本発明にはTSBS−PNダイオードも含まれ、このダイオードは、本発明による薄いp型層26が設けられていることから、以下では「TSBS−PN−P」(クランプ素子としての集積PNダイオードとショットキーコンタクトの直下に薄いp型層26とが設けられているトレンチ・ショットキー・バリア・ショットキーダイオード)と記す。
上記において述べた「TSBS−P」ダイオードと同等に、「TSBS−PN−P」ダイオードにおいても、(例えばドープ濃度「Np-」を有している)第2の導電型の第1の半導体材料ら成る比較的薄いp型層26が、ショットキーコンタクトを形成している(上側の)金属膜14の直下に配置されている。相応に、本発明に係るTSBS−PN−Pダイオードも、p型層26が薄いことから、唯一の単純なショットキーコンタクトを形成しているのではなく、「ショットキーコンタクトシステム」を形成している。
上記の要約として、以下では本発明の利点を挙げ、また幾つかの利点は再度述べる。
慣例の高電圧ショットキーダイオードとの比較:
−弱くドープされた領域の導電率が高注入によって大幅に高められているので、電流密度が高い領域での非常に低い順方向電圧が実現される。このことは、「TSBS−P」の実施の形態では、ショットキーコンタクトの直下にある薄いp型層26によってもたらされる。「TSBS−PN−P」の実施の形態では、このことは付加的に集積PNダイオードによってもたらされる。
−ショットキーコンタクトの直下にある薄いp型層26との組み合わせにおいて、トレンチ構造を用いてショットキー効果を遮蔽することによる比較的低い漏れ電流。更に、「TSBS−PN−P」の実施の形態では、PNダイオードのクランプ機能による比較的高いロバスト性がもたらされる。
従来の高電圧PiNダイオードとの比較:
−高い電流密度での高注入との組み合わせにおいて、ショットキーコンタクトの適切な障壁高さを用いることによる、高い電流密度での比較的低い順方向電圧。
−導通動作時にショットキーコンタクトシステム(ショットキーコンタクトの直下にある、薄いp型層26と組み合わせられたショットキーコンタクト)によって、少数のキャリアが弱くドープされた領域に注入され蓄積されることによる、比較的低いスイッチオフ損失。
従来技術の別の解決手段(いわゆる「クールSBD」ダイオード)との比較:
−比較的強い高注入による高い電流密度での比較的低い順方向電圧。ショットキー効果を効率的に遮蔽することによる比較的低い漏れ電流。
ショットキーコンタクトの直下に薄いp型層が設けられていない従来のTSBS又はTSBS−PNとの比較
−TSBS−Pの実施の形態では、スイッチオフ損失はやや高くなるが、非常に低い漏れ電流、並びに、高い電流密度での比較的低い順方向電圧が実現される。
−TSBS−PN−Pの実施の形態では、高い電流密度及びほぼ等しいスイッチオフ損失で、ほぼ等しい順方向電圧において非常に低い漏れ電流が実現される。
図3及び図4には、本発明に係る半導体装置10の別の実施の形態が示されている。図1に示した実施の形態とは異なり、図3の実施の形態においては、第2の導電型第1の半導体材料から成る比較的薄い層26が付加的に、トレンチ18の少なくとも1つの壁部56において所定の深さ(参照番号無し)まで少なくとも部分的に配置されている。
図4の実施の形態においては、第1の半導体材料から成る比較的薄い層26が付加的に、トレンチ18の各壁面全体並びにトレンチ18の底部38に配置されている。従って、図4においては、金属膜14又は金属層20及び22はそれぞれ、第1の半導体材料から成る比較的薄い層26に直接的に接しているが、しかしながら半導体ブロック12には直接的に接していない。

Claims (15)

  1. トレンチ・ショットキー・バリア・ショットキーダイオードを備えている半導体装置(10)であって、
    前記半導体装置(10)は、第1の導電型の半導体ブロック(12)を含み、該半導体ブロック(12)は、金属膜(14)によって被覆されている第1の面(16)と、該第1の面(16)に延在し、且つ、少なくとも部分的に金属で充填されている、少なくとも1つのトレンチ(18)と、を有している、半導体装置(10)において、
    前記トレンチ(18)の少なくとも1つの壁部(56)、及び/又は、前記金属膜(14)によって被覆されている前記第1の面(16)の、前記トレンチ(18)に隣接する少なくとも1つの領域(24)は、前記金属膜(14)と前記半導体ブロック(12)との間に位置する、第2の導電型の第1の半導体材料から成る層(26)を備えていることを特徴とする、半導体装置(10)。
  2. 前記半導体ブロック(12)は、少なくとも2つのトレンチ(18)を有している、請求項1に記載の半導体装置(10)。
  3. 前記第2の導電型の前記第1の半導体材料(26)は、約10nmから約500nmまでの範囲の層厚を有している、請求項1又は2に記載の半導体装置(10)。
  4. 前記第2の導電型の前記第1の半導体材料(26)のドープ濃度は、1cm3体積あたり約1016原子から1cm3体積あたり約1017原子までの値を有している、請求項1乃至3の少なくとも1項に記載の半導体装置(10)。
  5. 前記少なくとも1つのトレンチ(18)の底部(38)の領域(36)は、第2の半導体材料(40)で充填されており、
    前記第2の半導体材料(40)は、多結晶半導体材料又は前記第2の導電型の半導体材料である、請求項1乃至4の少なくとも1項に記載の半導体装置(10)。
  6. 少なくとも部分的に金属で充填されている前記トレンチ(18)は、当該トレンチ(18)の深さ(42)に関して上下に重なって配置されている少なくとも2つの金属層(20,22)を有しており、
    上側の金属層(20)は、前記金属膜(14)の一部を形成しており、該金属膜(14)によって、前記第1の導電型の前記半導体ブロック(12)の前記第1の面(16)は被覆されており、
    前記金属層(20,22)は、有利には互いに異なる金属を含む、請求項1乃至5の少なくとも1項に記載の半導体装置(10)。
  7. 前記少なくとも1つのトレンチ(18)は、少なくとも1つの金属によって完全に充填されている、請求項1乃至6の少なくとも1項に記載の半導体装置(10)。
  8. 前記金属膜(14)によって被覆されている前記第1の面(16)とは反対側に位置する、前記半導体ブロック(12)の第2の面(30)は、導電性のコンタクト材料(28)によって被覆されており、
    前記コンタクト材料(28)に接している、前記半導体ブロック(12)の部分ブロック(34)は、半導体ブロック(12)のその他の部分よりも強くドープされている、請求項1乃至7の少なくとも1項に記載の半導体装置(10)。
  9. 前記半導体装置(10)は、少なくとも部分的に、エピタキシ法及び/又はエッチング法及び/又はイオン注入法を用いて製造されている、請求項1乃至8の少なくとも1項に記載の半導体装置(10)。
  10. 前記金属膜(14)に相当する前記上側の金属層(20)のポテンシャルレベル即ちショットキー障壁の高さは、前記上側の金属層(20)の下に配置されている金属層(22)のポテンシャルレベル即ちショットキー障壁の高さよりも低い、請求項6乃至9の少なくとも1項に記載の半導体装置(10)。
  11. 前記少なくとも1つのトレンチ(18)の深さ(42)は、1μmから4μmまで、有利には約2μmである、請求項1乃至10の少なくとも1項に記載の半導体装置(10)。
  12. 前記トレンチ(18)の深さ(42)と、各2つのトレンチ間の内のりの間隔(46)との比は約2以上である、請求項1乃至11の少なくとも1項に記載の半導体装置(10)。
  13. 前記第1の導電型は、n型にドープされた半導体材料に対応し、前記第2の導電型は、p型にドープされた半導体材料に対応する、請求項1乃至12の少なくとも1項に記載の半導体装置(10)。
  14. 前記第1の導電型は、p型にドープされた半導体材料に対応し、前記第2の導電型は、n型にドープされた半導体材料に対応する、請求項1乃至12の少なくとも1項に記載の半導体装置(10)。
  15. 前記半導体装置(10)は、シリコン材料及び/又は炭化ケイ素材料及び/又はシリコンゲルマニウム材料及び/又はガリウムヒ素材料を含む、請求項1乃至14の少なくとも1項に記載の半導体装置(10)。
JP2016045747A 2015-03-09 2016-03-09 トレンチ・ショットキー・バリア・ショットキーダイオードを備える半導体装置 Active JP6649813B2 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
DE102015204137.9A DE102015204137A1 (de) 2015-03-09 2015-03-09 Halbleitervorrichtung mit einer Trench-Schottky-Barrier-Schottky-Diode
DE102015204137.9 2015-03-09

Publications (2)

Publication Number Publication Date
JP2016167597A true JP2016167597A (ja) 2016-09-15
JP6649813B2 JP6649813B2 (ja) 2020-02-19

Family

ID=56800865

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2016045747A Active JP6649813B2 (ja) 2015-03-09 2016-03-09 トレンチ・ショットキー・バリア・ショットキーダイオードを備える半導体装置

Country Status (4)

Country Link
US (1) US9748230B2 (ja)
JP (1) JP6649813B2 (ja)
CN (1) CN105957901B (ja)
DE (1) DE102015204137A1 (ja)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10693057B2 (en) 2016-05-04 2020-06-23 Tdk-Micronas Gmbh Sensor component with cap over trench and sensor elements
CN111799336B (zh) * 2020-07-27 2021-09-24 西安电子科技大学 一种SiC MPS二极管器件及其制备方法

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10335679A (ja) * 1997-06-02 1998-12-18 Fuji Electric Co Ltd ダイオードとその製造方法
JP2006352028A (ja) * 2005-06-20 2006-12-28 Sumitomo Electric Ind Ltd 整流素子およびその製造方法
JP2008523596A (ja) * 2004-12-10 2008-07-03 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング 半導体デバイスおよび半導体デバイスの製造方法
JP2013545295A (ja) * 2010-10-21 2013-12-19 ヴィシェイ ジェネラル セミコンダクター,エルエルシー 改良されたショットキー整流器
JP2014120685A (ja) * 2012-12-18 2014-06-30 Toshiba Corp 半導体装置
JP2014241345A (ja) * 2013-06-12 2014-12-25 住友電気工業株式会社 炭化珪素半導体装置の製造方法
JP2015504610A (ja) * 2011-12-01 2015-02-12 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツングRobert Bosch Gmbh 高電圧トレンチ接合ショットキーバリアダイオード

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6426541B2 (en) * 2000-07-20 2002-07-30 Apd Semiconductor, Inc. Schottky diode having increased forward current with improved reverse bias characteristics and method of fabrication
DE10259373B4 (de) * 2002-12-18 2012-03-22 Infineon Technologies Ag Überstromfeste Schottkydiode mit niedrigem Sperrstrom
US7737522B2 (en) * 2005-02-11 2010-06-15 Alpha & Omega Semiconductor, Ltd. Trench junction barrier controlled Schottky device with top and bottom doped regions for enhancing forward current in a vertical direction
JP2007036052A (ja) * 2005-07-28 2007-02-08 Toshiba Corp 半導体整流素子
DE102008002270A1 (de) * 2008-06-06 2009-12-17 Robert Bosch Gmbh Multispektraler Sensor
TWI497602B (zh) * 2011-02-15 2015-08-21 Tzu Hsiung Chen 溝渠式蕭基二極體及其製作方法

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH10335679A (ja) * 1997-06-02 1998-12-18 Fuji Electric Co Ltd ダイオードとその製造方法
JP2008523596A (ja) * 2004-12-10 2008-07-03 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング 半導体デバイスおよび半導体デバイスの製造方法
JP2006352028A (ja) * 2005-06-20 2006-12-28 Sumitomo Electric Ind Ltd 整流素子およびその製造方法
JP2013545295A (ja) * 2010-10-21 2013-12-19 ヴィシェイ ジェネラル セミコンダクター,エルエルシー 改良されたショットキー整流器
JP2015504610A (ja) * 2011-12-01 2015-02-12 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツングRobert Bosch Gmbh 高電圧トレンチ接合ショットキーバリアダイオード
JP2014120685A (ja) * 2012-12-18 2014-06-30 Toshiba Corp 半導体装置
JP2014241345A (ja) * 2013-06-12 2014-12-25 住友電気工業株式会社 炭化珪素半導体装置の製造方法

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
W.R. THURBER, R.L. MATTIS, Y.M. LIU, J.J. FILLIBEN: "The relationship between resistivity and dopant density for phosphorus-and boron-doped silicon", SEMICONDUCTOR MEASUREMENT TECHNOLOGY, JPN7019000313, May 1981 (1981-05-01), US, pages 42, ISSN: 0004096749 *

Also Published As

Publication number Publication date
DE102015204137A1 (de) 2016-09-15
US20160268449A1 (en) 2016-09-15
CN105957901A (zh) 2016-09-21
JP6649813B2 (ja) 2020-02-19
CN105957901B (zh) 2021-07-23
US9748230B2 (en) 2017-08-29

Similar Documents

Publication Publication Date Title
JP6651390B2 (ja) トレンチmosバリアショットキーダイオードを備える半導体装置
JP5787853B2 (ja) 電力用半導体装置
JP6080023B2 (ja) 逆導通型igbt
KR101774124B1 (ko) 반도체 장치들 및 그것을 제조하는 방법
CN109314143B (zh) 半导体装置
US9263515B2 (en) Super-junction schottky PIN diode
US9577117B2 (en) Super-junction schottky oxide pin diode having thin P-type layers under the schottky contact
US20110024791A1 (en) Bipolar semiconductor device and manufacturing method
US20130320500A1 (en) A bipolar semiconductor component with a fully depletable channel zone
CN103563087A (zh) 凹陷终端结构和带有凹陷终端结构的电子器件的制备方法
TWI593119B (zh) 高壓渠溝接合屏障肖特基二極體
US8836072B2 (en) Semiconductor system including a schottky diode
TWI543381B (zh) 半導體裝置
US20220406896A1 (en) Cellular structure of silicon carbide mosfet device, and silicon carbide mosfet device
JP6077309B2 (ja) ダイオード及びダイオードを内蔵した半導体装置
JP6649813B2 (ja) トレンチ・ショットキー・バリア・ショットキーダイオードを備える半導体装置
JP2020047683A (ja) 半導体装置
US20120187521A1 (en) Schottky diode having a substrate p-n diode
JP2005512329A (ja) 整流ダイオード
JP2010199480A (ja) 超接合ショットキーダイオード
CN115336007B (zh) 用于更软的反向恢复且有载流子的逐渐注入的半导体器件
US11437471B2 (en) Power semiconductor device
US9147757B2 (en) Power semiconductor device and method for manufacturing the same

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20160519

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20181129

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20190813

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20190819

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20191115

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20200107

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20200117

R150 Certificate of patent or registration of utility model

Ref document number: 6649813

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250