JP2015043421A - 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置 - Google Patents

振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置 Download PDF

Info

Publication number
JP2015043421A
JP2015043421A JP2014161655A JP2014161655A JP2015043421A JP 2015043421 A JP2015043421 A JP 2015043421A JP 2014161655 A JP2014161655 A JP 2014161655A JP 2014161655 A JP2014161655 A JP 2014161655A JP 2015043421 A JP2015043421 A JP 2015043421A
Authority
JP
Japan
Prior art keywords
power
modulated
plasma
waveform
khz
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2014161655A
Other languages
English (en)
Other versions
JP5988317B2 (ja
Inventor
フィリップ, エー. クラウス,
A Kraus Philip
フィリップ, エー. クラウス,
タイ チェン チュア,
Thai Cheng Chua
タイ チェン チュア,
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Applied Materials Inc
Original Assignee
Applied Materials Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Applied Materials Inc filed Critical Applied Materials Inc
Publication of JP2015043421A publication Critical patent/JP2015043421A/ja
Application granted granted Critical
Publication of JP5988317B2 publication Critical patent/JP5988317B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
    • H01L21/28008Making conductor-insulator-semiconductor electrodes
    • H01L21/28017Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
    • H01L21/28158Making the insulator
    • H01L21/28167Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
    • H01L21/28202Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation in a nitrogen-containing ambient, e.g. nitride deposition, growth, oxynitridation, NH3 nitridation, N2O oxidation, thermal nitridation, RTN, plasma nitridation, RPN
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02296Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02321Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer
    • H01L21/02323Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer introduction of oxygen
    • H01L21/02326Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer introduction of oxygen into a nitride layer, e.g. changing SiN to SiON
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02296Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02337Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour
    • H01L21/0234Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour treatment by exposure to a plasma
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/314Inorganic layers
    • H01L21/3143Inorganic layers composed of alternated layers or of mixtures of nitrides and oxides or of oxinitrides, e.g. formation of oxinitride by oxidation of nitride layers
    • H01L21/3144Inorganic layers composed of alternated layers or of mixtures of nitrides and oxides or of oxinitrides, e.g. formation of oxinitride by oxidation of nitride layers on silicon
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/49Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
    • H01L29/51Insulating materials associated therewith
    • H01L29/517Insulating materials associated therewith the insulating material comprising a metallic compound, e.g. metal oxide, metal silicate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/49Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
    • H01L29/51Insulating materials associated therewith
    • H01L29/518Insulating materials associated therewith the insulating material containing nitrogen, e.g. nitride, oxynitride, nitrogen-doped material

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Power Engineering (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Manufacturing & Machinery (AREA)
  • General Chemical & Material Sciences (AREA)
  • Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Plasma & Fusion (AREA)
  • Ceramic Engineering (AREA)
  • Formation Of Insulating Films (AREA)
  • Insulated Gate Type Field-Effect Transistor (AREA)
  • Plasma Technology (AREA)
  • Chemical Vapour Deposition (AREA)

Abstract

【課題】プラズマチャンバー内で誘電体膜をプラズマ窒化する方法を提供する。【解決手段】変調された高周波(RF)電力を用いて基板を窒素含有プラズマに露出することにより、基板上に形成された誘電体膜をプラズマ窒化処理にかける。変調されたRF電力は、約2%から約50%の間のデューティーサイクルを有し、変調されたRF電力は、2つの隣接する変調されたRF波形の間に電力オフ時間を有する。【選択図】図10A

Description

発明の分野
[0001]本発明の実施形態は、一般に、ゲート誘電体を形成する方法及び装置に関する。より詳細には、本発明の実施形態は、窒化ゲート誘電体層を形成する方法に関する。
関連技術の説明
[0002]集積回路は、多数の、例えば、数百万の、トランジスタ、キャパシタ及び抵抗器等のデバイスで構成される。電界効果トランジスタのようなトランジスタは、通常、ソース、ドレイン及びゲートスタックを含む。ゲートスタックは、通常、シリコン基板のような基板と、ゲート誘電体と、該ゲート誘電体に設けられた多結晶シリコンのようなゲート電極とを備えている。ゲート誘電体層は、二酸化シリコン(SiO)のような誘電体材料、或いは誘電率が4.0より大きな高Kの誘電体材料、例えば、SiON、SiN、酸化ハフニウム(HfO)、珪酸ハフニウム(HfSiO)、ハフニウムシリコンオキシニトライド(HfSiON)、酸化ジルコニウム(ZrO)、珪酸ジルコニウム(ZrSiO)、バリウムストロンチウムチタネート(BaSrTiO、又はBST)、鉛ジルコネートチタネート(Pb(ZrTi)O、又はPZT)等で形成される。しかしながら、この膜スタックは、他の材料で形成された層を含んでもよいことに注意されたい。
[0003]図1は、ゲート誘電体層104を合体したFET(電界効果トランジスタ)100の断面図である。図示したように、基板102の上にゲート誘電体104が配置され、ゲート電極106がゲート誘電体104の上に横たわる。ゲート誘電体104及びゲート電極106の垂直側壁に隣接して側壁スペーサ108が示されている。基板102には、ゲート電極106の両垂直側壁に実質的に隣接してソース/ドレイン接合110が形成される。
[0004]集積回路のサイズ及びその上のトランジスタのサイズが減少するにつれて、トランジスタの速度を高めるために必要なゲート駆動電流が増加する。駆動電流は、ゲートキャパシタンスの増加と共に増加し、ゲートの誘電率をkとし、誘電体厚みをdとし、デバイスの面積をAとすれば、キャパシタンス=kA/dである。ゲート誘電体の誘電体厚みを減少し且つ誘電率を増加することが、ゲートキャパシタンス及び駆動電流を増加する方法である。
[0005]SiOゲート誘電体の厚みを20Å未満に減少するための試みがなされている。しかしながら、20Å未満のSiOゲート誘電体を使用すると、ゲートの性能及び耐久性に望ましからぬ影響がしばしば生じることが分かった。例えば、ホウ素ドープのゲート電極からのホウ素が薄いSiOゲート誘電体を貫通してその下に横たわるシリコン基板に到達し得る。また、通常、薄い誘電体ではゲート漏洩電流即ちトンネル電流が増加して、ゲートにより消費される電力量を増大させる。薄いSiOゲート誘電体は、NMOSホットキャリア劣化を受け易く、この場合、誘電体を横切って進む高エネルギーキャリアがチャンネルにダメージを及ぼし又はそれを破壊することがある。また、薄いSiOゲート誘電体は、PMOS負バイアス温度不安定性(NBTI)も受け易く、この場合は、ゲートの動作でスレッシュホールド電圧又は駆動電流がドリフトする。
[0006]MOSFET(金属酸化物半導体電界効果トランジスタ)のゲート誘電体層として使用するのに適した誘電体層を形成する方法は、薄い酸化シリコンを窒素含有プラズマで窒化することを含む。ゲート酸化物の正味の窒素含有量を増加して誘電率を高めることは、多数の理由で望ましい。例えば、酸化物誘電体のバルクにプラズマ窒化プロセス中に窒素を軽く合体させて、出発酸化物上の等価酸化物厚み(EOT)を減少することができる。これは、未窒化の酸化物誘電体と同じEOTにおいて、FETの動作中のトンネル作用によるゲート漏洩を減少することができる。同時に、このように高い窒素含有量は、その後の処理動作中にファウラー・ノルトハイム(F−N)トンネル電流により誘起されるダメージも減少できる。但し、誘電体の厚みがF−N範囲内にある場合に限る。ゲート酸化物の正味の窒素含有量を増加する別の利点は、窒化たゲート誘電体が、ゲートエッチングアンダーカットの問題にもっと耐え、ひいては、ゲートのエッジにおける欠陥状態及び電流漏洩を減少することである。
[0007]2003年8月26日に発行されたマックファデン氏等の「PlasmaNitridation For Reduced Leakage Gate Dielectric Layers」と題する米国特許第6,610,615号では、熱及びプラズマの両窒化プロセスに対して酸化シリコン膜の窒素プロフィールが比較されている(図2を参照)。窒化された酸化物膜は、シリコン基板上に配置される。図2は、酸化物膜の下の結晶シリコンにおける窒素プロフィールも示している。熱窒化酸化物に対する窒素プロフィールデータ202は、酸化物層の上面における第1の窒素濃度と、酸化物の深部に向かって一般的に降下する窒素濃度と、酸化物−シリコンの界面における窒素の界面累積と、最後に、基板への距離と共に一般的に降下する窒素濃度勾配とを示している。これに対して、プラズマ窒化プロセスは、酸化物層の上面から酸化物−シリコンの界面を経て基板へと本質的に単調に減少する窒素プロフィール204を形成することが明らかである。熱窒化プロセスで見られる窒素の望ましからぬ界面累積は、窒素プラズマのオン衝撃では生じない。更に、基板における窒素濃度は、あらゆる深さにおいて、熱窒化プロセスで得られるものより低い。
[0008]先に述べたように、ゲート電極−ゲート酸化物界面における窒素濃度を高める利点は、ポリシリコンゲート電極からゲート酸化物へ、又はゲート酸化物を通して外部拡散するホウ素のようなドーパントが減少されることである。これは、例えば、ホウ素ドープのポリシリコンゲート電極からの内部拡散ホウ素によりゲート酸化物のバルクに生じる欠陥状態を減少することによりデバイスの信頼性を改善する。ゲート酸化物−シリコンチャンネル界面における窒素含有量を減少する別の利点は、固定電荷及び界面状態密度の減少である。これは、チャンネルの移動度及びトランスコンダクタンスを改善する。それ故、プラズマ窒化プロセスは、熱窒化プロセスに勝る効果を有する。
[0009]プラズマ窒化プロセスのプラズマは、種々のイオン化電源により形成することができ、これは、例えば、誘導性結合電源、容量性結合電源、表面波電源、電子サイクロトロン共振電源(ECR電源)、マグネトロン又は変更型マグネトロン形式の電源、或いは処理チャンバー内でのプラズマ発生を容易にするために使用できる他のイオン化電源を含むことができる。表面波電源は、非常に高い周波数(100MHz−10GHz)のプラズマ電源で、ガス衝突周波数が電磁波の周波数より著しく低く、「表面波」又は「波加熱」をベースとするエネルギー伝達メカニズムにより電磁電力がプラズマへと吸収される。このような電源は、通常、非常に高い周波数の電源と、電源をチャンバーへ接続する導波器と、誘電体チャンバー壁と、非常に高い周波数の電力がチャンバーへ結合されるところの誘電体壁に隣接した開口又はスロットの配列体とを含む。マイクロ波イオン化電源は、表面波電源の一形式である。
[0010]電源の形式に関わりなく、電源からプラズマへの著しい容量性結合が生じて、数十ボルト程度の比較的大きなプラズマ電位を形成する。このような大きなプラズマ電位は、窒素イオンによる二酸化シリコンの過剰な衝撃を引き起こすことがあり、二酸化シリコン層にダメージを生じさせる。また、大きなプラズマ電位は、窒素をその下に横たわるシリコンへ合体させることもあって、ゲート酸化物における窒素合体の効果を低減させる。
[0011]それ故、この技術では、二酸化シリコン層及びシリコン基板を窒素イオンで過剰にダメージを生じさせることのないプラズマ窒化プロセスのための方法及び装置が要望される。
[0012]本発明は、一般に、プラズマ電子温度スパイクを減少するための滑らかに変化する変調の電源によりゲート誘電体をプラズマ窒化する方法及び装置に係る。
[0013]本発明の実施形態は、ゲート誘電体をプラズマ窒化する方法において、ゲート誘電体膜を含む基板をプラズマチャンバーに入れるステップと、滑らかに変化する変調の電源によりイオン化された窒素含有プラズマに基板を露出して、窒化されたゲート誘電体を基板に形成するステップと、を備えた方法を提供する。
[0014]本発明の実施形態は、更に、ゲート誘電体をプラズマ窒化する方法において、ゲート誘電体膜を含む基板を、誘導性結合されたプラズマチャンバーに入れるステップと、滑らかに変化する変調の電源によりイオン化された窒素含有プラズマに基板を露出して、窒化されたゲート誘電体を基板に形成するステップであって、滑らかに変化する変調の電源は、パルスのデューティサイクルを、約1kHzから約100kHzの周波数において約5%から約90%の間で変化させると共に、イオン化電力をピーク電力の約0%から約100%の間で変化させ、更に、窒素含有プラズマのプロセスガスは、窒素(N)及びアンモニア(NH)ガスの少なくとも1つを約50sccmから約20slmの流量で含むようなステップと、を備えた方法を提供する。
[0015]本発明の実施形態は、更に、ゲート誘電体をプラズマ窒化する方法において、ゲート誘電体膜を含む基板をプラズマチャンバーに入れるステップと、電力の大きさの時間導関数に不連続性のない変調電源によりイオン化された窒素含有プラズマに基板を露出して、窒化されたゲート誘電体を基板に形成するステップと、を備えた方法を提供する。
[0016]本発明の実施形態は、更に、ゲート誘電体をプラズマ窒化する方法において、ゲート誘電体膜を含む基板をプラズマチャンバーに入れるステップと、方形波変調RF波形を抵抗器−キャパシタでフィルタして、滑らかに変化する変調のRF波形電源となるようにしたものによりイオン化された窒素含有プラズマに基板を露出して、窒化されたゲート誘電体を基板に形成するステップと、を備えた方法を提供する。
[0017]また、本発明の実施形態は、ゲート誘電体をプラズマ処理する装置において、プラズマ窒化プロセスチャンバーと、滑らかに変化する変調の電源電力を発生できる電力発生器と、を備えた装置も提供する。
[0018]本発明の上述した特徴を詳細に理解できるように、前記で簡単に要約した本発明を、添付図面に幾つか示された実施形態を参照して、より詳細に説明する。しかしながら、添付図面は、本発明の典型的な実施形態を示すに過ぎず、それ故、本発明の範囲を何ら限定するものではなく、本発明は、他の等しく有効な実施形態も受け入れられることに注意されたい。
本発明により製造できる従来のFETを示す概略断面図である。 従来の熱窒化プロセス及びプラズマ窒化プロセスに対し、二次イオン質量分光データに基づく窒素濃度プロフィールを示すグラフである。 本発明によるプロセスフローチャートである。 本発明の実施形態によるプラズマリアクタの概略図である。 周波数が正しい縮尺でないが、高周波における非変調イオン化電源電力を示す図である。 周波数が正しい縮尺でないが、kHz周波数における方形波変調RFを示す図である。 NMOSの場合に非窒化ゲート誘電体に対する窒化ゲート誘電体の最大トランスコンダクタンスシフトを窒素含有量の関数として示すグラフである。 PMOSの場合に非窒化ゲート誘電体に対する窒化ゲート誘電体の最大トランスコンダクタンスシフトを窒素含有量の関数として示すグラフである。 非変調電源電力のケースと、方形波変調電源電力のケースとに対する時間分析電子温度を示す図である。 窒素プラズマに対する最大電子温度(MaxkTe)及び時間平均化電子温度(<kTe>)を、方形波変調電源電力に対する変調サイクル当りのオフ時間の関数として示すグラフである。 窒素プラズマに対する最大電子温度(MaxkTe)及び時間平均化電子温度(<kTe>)を、滑らかに変化する変調電源電力に対する変調サイクル当りのオフ時間の関数として示すグラフである。 滑らかに変化する変調のRF電源電力の概略図である。 2kHzのパルス周波数において方形波変調及び滑らかに変化する変調のRF窒素含有プラズマに対する時間分析電子温度の測定値を示すグラフである。 10kHzのパルス周波数において方形波変調及び滑らかに変化する変調のRF窒素含有プラズマに対する時間分析電子温度の測定値を示すグラフである。 RCフィルタによる方形波変調RF電源電力を、滑らかに変化する変調のRF電源電力に変換する概略フローチャートである。 滑らかに変化する変調のRF電源電力の形成を示す概略フローチャートである。 滑らかに変化する変調のRF電源を例示する図である。 滑らかに変化する変調のRF電源を例示する図である。 滑らかに変化する変調のRF、方形波変調RF、及び非変調プラズマに対する時間平均化kTe(<kTe>)を変調サイクル当りのオフ時間の関数として示すグラフである。 滑らかに変化する変調のRF、方形波変調RF、及び非変調プラズマに対する最大kTeを変調サイクル当りのオフ時間の関数として示すグラフである。 NMOSの場合に、非変調RF及び滑らかに変化する変調のRFプラズマのチャンネル導電率対ゲート漏洩磁束を示すグラフである。 PMOSの場合に、非変調RF及び滑らかに変化する変調のRFプラズマのチャンネル導電率対ゲート漏洩磁束を示すグラフである。
[0035]本発明の実施形態は、ゲート誘電体をプラズマ窒化する方法及び装置を包含する。より詳細には、本発明は、滑らかに変化する変調(又はパルス化)の電源電力を使用することにより窒化プラズマの電子温度におけるスパイクを減少するための方法及び装置を包含する。
[0036]図3は、プラズマ窒化されたゲート誘電体を形成するためのプロセスフローの実施例を示す。プロセスは、ステップ300においてシリコン基板を用意することでスタートする。第1に、ステップ302において、炉又は急速熱処理チャンバーのいずれかでSiウェハ上に約5Åから約40Åの熱酸化物膜が成長される。ここでは、一実施例として、二酸化シリコン(SiO)ゲート誘電体について説明する。本発明は、誘電率が4.0より大きな高Kの誘電体材料である他の形式のゲート誘電体、例えば、SiON、SiN、酸化ハフニウム(HfO)、珪酸ハフニウム(HfSiO)、ハフニウムシリコンオキシニトライド(HfSiON)、酸化ジルコニウム(ZrO)、珪酸ジルコニウム(ZrSiO)、バリウムストロンチウムチタネート(BaSrTiO、又はBST)、鉛ジルコネートチタネート(Pb(ZrTi)O、又はPZT)、等に適用することもできる。第2に、ステップ304において、プラズマ窒化のために少なくとも窒素含有ガスを収容するプラズマチャンバーに基板が移送される。プラズマ窒化プロセスは、ステップ304で、SiO形成における窒化ドーズを制御するために約2秒から約20分間続けられる。その後、ステップ306において、SiO膜の任意の窒化後アニールのために、急速熱処理チャンバーへ基板を移送することができる。この窒化後アニールは、不活性又は酸化周囲環境において約700−1100℃の温度で行うことができる。或いはまた、この任意の窒化後アニールは、不活性又は還元ステップの後に酸化ステップが続く2段階プロセスで構成されてもよい。ゲート誘電体を形成した後に、ステップ308において、ポリシリコンのようなゲート電極が低圧力化学気相堆積(LPCVD)により堆積される。ゲート電極は、金属層であってもよい。
[0037]プラズマ窒化処置の間に高エネルギーイオンが当たることによりゲート酸化物及びシリコンチャンネルに生じるダメージは、チャンネル移動度の減少に貢献し得る。電子温度(kTe)とは、プラズマにおける自由電子のエネルギー分布を記述するエネルギースケールである。電子温度が低いことは、高エネルギー電子が少なく、従って、高エネルギー窒素イオンが少ないことを意味する。プラズマ窒化SiOゲート誘電体をもつトランジスタのチャンネル移動度の改善は、窒素プラズマが低い電子温度を有するときに生じる。電子温度の低下は、イオン化電源電力を「変調」(又はパルス化)するか、イオン化電源電力をkHz周波数でターンオン及びオフすることにより可能となる。
[0038]2003年6月12日に出願された「PlasmaMethod and Apparatus for Processing a Substrate」と題する共通に譲渡された米国特許出願第10/461,083号では、窒素含有プラズマをプラズマ変調シーケンスを経て制御して、従来のプラズマ処理により与えられるものより低い電子温度を発生するという発明が説明されている。プラズマに対する制御は、低い電子温度を与えるように構成され、これは、例えば、ゲート窒化プロセスに使用してデバイス特性を改善し、即ちトランスコンダクタンスがあまり低下しないようにすることができ、これは、ゲート誘電体型のデバイスではチャンネル移動度の改善を表わす。
[0039]米国特許出願第10/461,083号は、一般に、窒素含有プラズマを短い時間周期中付勢するように動作し、次いで、プラズマがある時間周期中弛緩又は消散するのを許容するプラズマ変調(又はパルス化)シーケンスを説明している。この消散時間周期(又は残光周期)は、窒素含有プラズマを維持しながら、電子温度が低下するのを許容する。イオン化電源変調のオフ又は弛緩部分の間に、プラズマ内の電子が自由に拡散する。しかしながら、電子がいかに速く拡散するかは、電子のエネルギーに直接関係していることが知られている。それ故、高エネルギーの電子、即ちホット電子は、低エネルギーの電子よりもプラズマから急速に拡散し、その結果、プラズマの構成成分の平均エネルギーが低くなり、即ち電子温度が低くなると共にプラズマの温度が低くなる。また、前記特許出願には、イオン化電源により与えられる変調(又はパルス)のデューティサイクルも、プラズマの構成成分の平均温度に影響することが開示されている。デューティサイクルは、各サイクル中にRF電力がオンである時間のパーセンテージとして定義される。特に、長い変調オン(又はパルスオン)時間に対応する大きなデューティサイクルは、変調オン時間中のより長い時間周期にプラズマの電子が励起されるので、よりホットなプラズマを発生する。
[0040]図4Aは、カリフォルニア州サンタクララに所在するアプライド・マテリアルズにより製造された減結合プラズマ窒化プロセスリアクタ400の概略断面図である。本発明を実施するのに使用できるリアクタの一実施例は、誘導プラズマ電源リアクタである。リアクタ400は、ウェハ支持ペデスタル416を導電性本体(壁)430内に有するプロセスチャンバー410と、コントローラ440とを備えている。チャンバー410は、実質的にフラットな誘電体天井420と共に供給される。チャンバー410の他の変形例は、他の形式の天井、例えば、ドーム形状の天井を有してもよい。天井420の上には、少なくとも1つの誘導性コイル要素412を含むアンテナが配置されている(2つの同軸要素412が示されている)。誘導性コイル要素412は、第1マッチング回路網419を経てプラズマ電源418に結合される。このプラズマ電源418は、通常、50kHzから13.56MHzの範囲の同調可能な周波数において3000Wまで発生することができる。
[0041]支持ペデスタル(カソード)416は、第2のマッチング回路網424を経てバイアス電源422に結合される。このバイアス電源422は、一般に、50kHzから13.56MHzの同調可能な周波数及び0から5000ワットの電力をもつRF信号を発生することができる。しかしながら、これは、処理中には切断される。任意であるが、バイアス電源422は、DC又はパルス化DC電源でよい。コントローラ440は、中央処理ユニット(CPU)444と、メモリ442と、CPU444のサポート回路446とを備え、以下に述べるように、チャンバー410の要素、ひいては、窒化プロセスの制御を容易にする。
[0042]運転中に、半導体ウェハ414がペデスタル416にのせられると共に、ガスパネル438から導入ポート426を経てプロセスガスが供給されて、混合ガス450を形成する。この混合ガス450は、プラズマ電源418から電力を印加することにより点火されてチャンバー410にプラズマ455を形成する。チャンバー410の内部の圧力は、スロットルバルブ427及び真空ポンプ436を使用して制御される。通常、チャンバー壁430は、電気的接地点434に結合される。壁430の温度は、壁430を通して延びる液体含有コンジット(図示せず)を使用して制御される。
[0043]ウェハ414の温度は、支持ペデスタル416の温度を安定化することにより制御される。一実施形態では、ガス源448からのヘリウムガスが、ガスコンジット449を経て、ウェハ414の下のペデスタル面に形成されたチャンネル(図示せず)に供給される。ヘリウムガスは、ペデスタル416とウェハ414との間の熱伝達を容易にするために使用される。処理中に、ペデスタル416は、ペデスタル内の抵抗性ヒータ(図示せず)により定常温度に加熱することができ、次いで、ヘリウムガスがウェハ414の均一加熱を容易にする。このような熱制御を使用して、ウェハ414は、約20℃から350℃の温度に維持される。
[0044]上述したプロセスチャンバー410の制御を容易にするために、コントローラ440は、種々のチャンバー及びサブプロセッサを制御するための工業用設定に使用できる何らかの形式の汎用コンピュータプロセッサの1つでよい。CPU444のメモリ442又はコンピュータ読み取り可能な媒体は、入手容易なメモリ、例えば、ランダムアクセスメモリ(RAM)、リードオンリメモリ(ROM)、フロッピーディスク、ハードディスク、或いは他の形式のローカル又はリモートのデジタル記憶装置の1つ以上でよい。サポート回路346は、プロセッサを従来の仕方でサポートするためにCPU444に結合される。これらの回路は、キャッシュ、電源、クロック回路、入力/出力回路及びサブシステム、等を含む。本発明の方法は、一般に、ソフトウェアルーチンとしてメモリ442に記憶される。また、ソフトウェアルーチンは、CPU444により制御されるハードウェアからリモート位置にある第2のCPU(図示せず)により記憶及び/又は実行されてもよい。
[0045]図4Bは、図4Aのプラズマ電源418により発生される非変調のイオン化電源電力波形の一実施例を示す。この電力は、高周波(RF)で動作される。図4Cは、方形波変調(又はパルス化)イオン化電源電力波形の一実施例を示す。電力変調周波数は、通常、kHz周波数においてターンオン及びオフされる。図4B及び図4CにおけるAC電力の発振周波数(RF)は、正しいスケールで描かれていない。ピークRF電力は、通常、約50ワットから約3000ワットにセットされる。変調(又はパルス)のデューティサイクルは、約5%から約90%でよく、また、イオン化電力は、プラズマの構成成分の希望の平均温度を発生するために約0%から約100%の間で変化させてもよい。プラズマ窒化プロセスは、通常、約1ミリトールから約1トールの圧力で動作される。N又はNHのような窒素含有ガスについては、流量が約50sccmから約20slmである。窒素含有ガスに加えて、プロセスガスは、プラズマを維持すると共に電子温度を変更するために、He、Ar、Ne(ネオン)、Kr(クリプトン)又はXe(キセノン)のような不活性ガスを含むことができる。不活性ガスの流量は、約0sccmから約20slmである。プロセスを実行するのに使用できるプラズマリアクタの一実施例は、図4Aにおいて説明した、カリフォルニア州サンタクララに所在するアプライド・マテリアルズにより製造された減結合プラズマ窒化(DPN)チャンバーである。しかしながら、プラズマ窒化プロセスのプラズマは、例えば、誘導性結合電源、容量性結合電源、表面波電源、電子サイクロトロン共振電源(ECR電源)、マグネトロン又は変更型マグネトロン形式の電源、或いは処理チャンバー内でのプラズマ発生を容易にするために使用できる他のイオン化電源を含む種々のイオン化電源により形成できることに注意されたい。表面波電源は、非常に高い周波数(100MHz−10GHz)のプラズマ電源で、ガス衝突周波数が電磁波の周波数より著しく低く、「表面波」又は「波加熱」をベースとするエネルギー伝達メカニズムにより電磁電力がプラズマへと吸収される。このような電源は、通常、非常に高い周波数の電源と、電源をチャンバーへ接続する導波器と、誘電体チャンバー壁と、非常に高い周波数の電力がチャンバーへ結合されるところの誘電体壁に隣接した開
口又はスロットの配列体とを含む。マイクロ波イオン化電源は、表面波電源の一形式である。
[0046]図5Aは、NMOS(nチャンネル金属酸化物半導体)の場合に、最大チャンネルトランスコンダクタンス(gmmax)(対非ドープSiO)の変化を、膜内の窒素のパーセンテージの関数として表わすデータを示している。トランジスタの製造においては、トランスコンダクタンスの変化又はシフトの可能性が最低であるのが望ましいことに注意されたい。しかしながら、一般に、トランジスタ製造プロセスには窒素が導入される。というのは、トランジスタのゲート漏洩を減少し、ポリシリコンゲート電極からホウ素が拡散するのを防止し、且つ電気的な厚みを減少して、改善されたオフ状態制御を与えることが知られているからである。それ故、高い濃度の窒素合体が望まれる。最大チャンネルトランスコンダクタンスのシフト(又は低下)は、窒素を排除することで減少できるが、窒素を排除すると、ゲート漏洩、拡散及びオフ状態制御に著しい悪影響を及ぼすことになる。従って、目標は、充分な窒素の合体と、窒素の合体により与えられる利益とを維持しながら、最大チャンネルトランスコンダクタンスのシフトを減少することである。
[0047]より詳細には、図5Aは、非変調のRF構成により発生される窒素含有プラズマに対する最大チャンネルトランスコンダクタンス(501)と、方形波変調RF電源の場合(502)との相違を示す。非変調構成(501)及び方形波変調構成(502)に対するデータポイントの各々は、マッチング圧力(20ミリトール)、電力(500ワットから750ワット)、時間巾(10秒)、N流量(50sccmから20slm)、及びデューティサイクル(50%)を使用して収集される。このデータは、方形波変調電源を使用した窒素含有プラズマ(白丸及び曲線502)が、非変調構成により発生された窒素含有プラズマ(黒丸及び曲線501)よりも、最大チャンネルトランスコンダクタンスの低下を減少する(即ち改善する)ことを示している。また、図5Aに示されたgmmaxの変化における同様の改善が、スレッシュホールド電圧のシフト及び飽和ドレイン電流についても得られ、これは、2003年6月12日に出願された「Plasma Method and Apparatus for Processing a Substrate」と題する共通に譲渡された米国特許出願第10/461,083号に説明されている。図5Bに示すように、PMOS(pチャンネル金属酸化物半導体)トランジスタの場合にも、同様の改善(非変調については黒丸及び曲線503、方形波変調については白丸及び曲線504)を得ることができる。
[0048]方形波変調(又はパルス化)電源電力によるプラズマ窒化は、図5A及び図5Bに各々示すように、NMOS及びPMOSの場合に、ゲート酸化物の所与の窒素濃度においてチャンネル移動度の尺度である最大トランスコンダクタンスの低下について、非変調電源に勝る改善を示したが、時間の関数として電源電力が急激に変化すると、電源電力の方形波変調を使用するときに電子温度に短命であるが大きさの大きいスパイクを招く。方形波変調電源電力でのプラズマ窒化プロセスに対する時間の関数としての電子温度の測定(曲線602)が図6に示されている。また、図6に参照としてプロットされているのは、非変調の電源電力についてその他同じ条件で測定された電子温度(曲線601)である。電子温度の測定は、誘導性結合のRFプラズマリアクタにラングミュアプローブを使用して実行される。このラングミュアプローブは、プラズマ内の荷電粒子の密度及びエネルギーの測定を許容する。プローブは、チャンバーの中心においてウェハ上約4cmに位置される。プローブ収集の時定数は、パルス化RFの場合にRFオン及びRFオフの両周期にわたり平均化を行うに充分な長さである。方形波変調プロセスの場合の時間平均化電子温度は、非変調プロセスの場合より低いが、方形波変調プロセスは、電子温度に著しいスパイクを有する。方形波変調電源電力に対して図6に示された電子温度のオーバーシュートは、RF電力の急激な変化によるものである。RF電力の時間導関数が不連続性をこうむるときに電子温度がスパイク状になる。高い電子温度は、高いエネルギーをもつイオンを反射するので、電子温度のこれらスパイクは、チャンネル移動度にダメージを及ぼすことになる。10kHzの典型的な変調周波数において、ウェハは、毎秒10000個のこのようなスパイクを経験する。累積されるダメージは、甚だしいものとなる。
[0049]更に、図7Aは、方形波変調電源電力を使用するときに、時間平均化される電子温度(<kTe>)が望ましくは長いオフ時間(例えば、固定周波数においてパルスデューティを減少することによる)と共に低下することを示している。ここで、<kTe>は、パルス周期をτとすれば、式(1)において通常のやり方で定義される。
Figure 2015043421
しかしながら、図7Aに示すように、種々の方形波変調パラメータに対して最大電子温度スパイクを減少することができない。特に、図7Aは、方形波変調電源電力を使用するときに長いオフ時間を使用すると(例えば、固定周波数において変調デューティを減少することにより)、大きな電子温度スパイク(高いMax kTe)を生じることを示す。図7Aのデータは、10ミリトールのチャンバー圧力、100ワットの有効電力、10kHzの変調周波数、及び10−50%のデューティサイクルのもとで収集される。Nの流量は、50sccmから20slmである。有効電力は、デューティサイクルにピーク電力を乗算することにより計算される。
[0050]方形波変調(又はパルス化)電源電力の改善は、電子温度スパイクを減少することである。本発明は、滑らかに変化する変調(又はパルス化)電源電力の使用により電子温度のスパイクを減少して、チャンネル移動度を改善すると共に、トランスコンダクタンスシフト低下を減少する方法及び装置を包含する。
[0051]図8に示すような滑らかに変化する変調高周波(RF)波形は、窒素プラズマを発生するためのイオン化電源電力として使用される。図7Bは、滑らかに変化する変調のRF波形を使用してパーセント電力オフ時間(又は1−デューティサイクル)の関数として収集された最大電子温度(Max kTe)及び時間平均化電子温度(<kTe>)を示す。この結果は、低い<kTe>の利益に加えて、最大電子温度が長い電力オフ時間と共にフラットのままであることを示している。また、図7Aのデータは、図7Bのデータと同様のプロセス条件のもとでも収集される。
[0052]2kHzのパルス周波数及び50%デューティサイクルにおける滑らかに変化する変調及び方形波変調RFプラズマの時間分析電子温度測定が図9Aに示されている。曲線901は、方形波変調RFプラズマに対する測定をトレースしたもので、電力が約100μsにターンオンされたときに大きなスパイクを示している。曲線902は、滑らかに変化する変調のRFプラズマに対する測定をトレースするもので、電力がターンオンされたときに非常に小さなスパイクを示している。その結果は、滑らかに変化する変調電源電力プラズマに対して小さな最大値kTeを指示する。10kHzパルス周波数及び50%デューティサイクルにおける方形波変調RFプラズマと滑らかに変化する変調のRFプラズマとの間の同様の比較が図9Bに示されている。曲線903は、方形波変調RFプラズマに対する測定をトレースし、一方、曲線904は、滑らかに変化する変調のRFプラズマに対する測定をトレースする。また、図9Bの結果も、方形波変調RFプラズマに比して、滑らかに変化する変調のRFプラズマに対する小さな電子温度スパイクを示している。両方の場合に、電子温度におけるオーバーシュート又はスパイクは、滑らかに変化する変調プロセスを方形波変調プロセスと比較したときに著しく減少される。特に、本発明は、比較的長い電力オフ時間、例えば、曲線902に示す2kHzデータの場合に250μsの電力オフ時間の場合でも、電子温度のオーバーシュートを制御する能力を立証した。低いパルス周波数を使用するか、低いデューティサイクルを使用するか、又はその両方により長い電力オフ時間を達成することは、最小の平均電子温度(<kTe>)を得るために望ましい。滑らかに変化する変調がないと、最大電子温度(Max kTe)は、2kHzプロセスに対して非常に高くなる(曲線901を参照)。滑らかに変化する変調は、Max kTeを増加せずに、長いオフ時間が<kTe>を減少できるようにする。
[0053]図8に示すような滑らかに変化する変調電力波形は、図4Aのプラズマ電源418において、方形波変調RF波形をRC(抵抗器−キャパシタ)フィルタに送給し、該フィルタが高周波を減衰して波形を平滑化し、滑らかに変化する変調のRF波形(図10Aを参照)とすることにより、発生することができる。フィルタの抵抗(R)及びキャパシタンス(C)を調整することにより、滑らかに変化するパルス高周波波形を発生することができる。また、滑らかに変化する変調のRF波形は、関数発生器によるか、或いはRCフィルタ及び/又はブロードバンド増幅器との組み合せにより発生することもできる。滑らかに変化する変調のRF電力を発生するのに必要な要素の一実施例が図10Bに示されている。関数発生器、RCフィルタ及びブロードバンド増幅器により発生された滑らかに変化する変調のRF電源電力は、RFマッチング回路及びコイルに送給される。関数発生器、RCフィルタ及びブロードバンド増幅器は、図4Aのプラズマ電源418の要素である。
[0054]図8に示す滑らかに変化する変調波形は、非変調の波形又は方形波変調の波形に勝る改善を与える唯一の波形ではないことに注意されたい。他の一般的な波形属性も著しい改善を与えることができる。一般に、イオン化電源電力の大きさの時間導関数に不連続性がなくて、時間の関数としてのイオン化電源の大きさが区分的に滑らかであることで、電子温度のスパイクを防止することができる。更に、イオン化電力の大きさがゼロである限定部分を伴う滑らかに変化する変調のRF波形は、電子温度の時間平均値を減少することができる。他の形式の滑らかに変化する変調のRF波形の2つの実施例が図11A及び11Bに示されている。図11A及び図11Bにおける上方傾斜及び下方傾斜時間並びに勾配は、等しくてもよいし異なってもよい。図11A及び図11Bにおける電力オフ時間は、電力オン時間より長くてもよいし短くてもよい。
[0055]図12は、他の点では同一の処理条件にある3つのケース、即ち非変調、方形波変調、及び滑らかに変化する変調のRF電源に対して、サイクル当りのオフ時間の関数として時間平均化電子温度(<kTe>)をプロットしたものである。両変調RFプロセスは、非変調プロセスより低い<kTe>を有する。方形波変調RFプロセスについて図7Aに示された結果と同様に、図12も、滑らかに変化する変調のRFプロセスに対してオフ時間の増加に伴い<kTe>が減少されることを示している。しかしながら、図13は、方形波変調RFプロセスが、滑らかに変化する変調のRFプロセスと比較したときに、ほぼ2倍も大きな最大電子温度(Max kTe)を有することを示している。図12及び13の両方において、滑らかに変化する変調のRFプロセスに対して、傾向を示す破線が引かれ、減少する<kTe>と、オフ時間の増加に伴いほぼ一定の最大電子温度とを示している。これらの傾向に続いて、滑らかに変化する変調のRFプロセスでは、長い電力オフ時間において、改善されたチャンネル移動度が期待される。
[0055]図14A及び14Bは、1.2nmの固定EOT(有効酸化物厚み)を有する誘電体の場合に、NMOS(図13A)及びPMOS(図13B)について、チャンネル導電率(Ko)対ゲート漏洩磁束(Jg)のデータプロットを示す。チャンネル導電率(Ko)は、移動度をEOTで除算したものに等しく、チャンネル移動度の尺度である。固定EOTにおいてコンダクタンス(Ko)が増加することは、移動度の増加を反映する。NMOS及びPMOSの両方に対して、このデータは、滑らかに変化する変調のRF波形が、方形波変調のRFプロセスよりもチャンネル移動度を改善する(高くする)ことを示している。ゲート漏洩磁束(Jg)については、NMOS及びPMOSの両方の結果は、滑らかに変化する変調のプロセスが方形波変調プロセスより若干の改善を与える(ゲート漏洩を少なくする)ことを示している。
[0057]以上、本発明の実施形態を説明したが、本発明の基本的な範囲から逸脱せずに、他の及び更に別の実施形態を案出することができ、それ故、本発明の範囲は、特許請求の範囲により決定されるものとする。
100・・・電界効果トランジスタFET、102・・・基板、104・・・ゲート誘電体、106・・・ゲート電極、108・・・スペーサ、110・・・ソース/ドレイン接合、400・・・プロセスリアクタ、410・・・プロセスチャンバー、412・・・誘導性コイル要素、414・・・半導体ウェハ、416・・・ウェハ支持ペデスタル、418・・・プラズマ電源、419、424・・・マッチング回路網、420・・・誘電体天井、422・・・バイアス電源、427・・・スロットルバルブ、430・・・導電性本体、434・・・電気的接地点、438・・・ガスパネル、440・・・コントローラ、442・・・メモリ、444・・・中央処理ユニット、446・・・サポート回路、448・・・ガス源、450・・・混合ガス、455・・・プラズマ

Claims (15)

  1. プラズマチャンバー内で誘電体膜をプラズマ窒化する方法において、
    変調された高周波(RF)電力を用いて基板を窒素含有プラズマに露出することにより、前記基板上に形成された誘電体膜をプラズマ窒化処理にかけることを含み、前記変調されたRF電力は、約2%から約50%の間のデューティーサイクルを有し、前記変調されたRF電力は、2つの隣接する変調されたRF波形の間に電力オフ時間を有する変調されたRF波形を生成する、方法。
  2. 前記変調されたRF電力は、2kHzから20kHzの間の繰り返し周波数を有する、請求項1に記載の方法。
  3. 前記電力オフ時間は、250μsである、請求項1に記載の方法。
  4. 各変調されたRF波形は、方形波変調RF波形を抵抗器−キャパシタフィルタに通して送り高周波を減衰して前記方形波変調RF波形を平滑化させることにより得られた、滑らかに変化する変調されたRF波形である、請求項1に記載の方法。
  5. 前記滑らかに変化する変調されたRF波形は、前記変調されたRF電力により形成されたイオン化電源電力の大きさがゼロであるような限定部分を有する、請求項3に記載の方法。
  6. ゲート誘電体をプラズマ処理する装置において、
    プラズマ窒化プロセスチャンバーと、
    約2%から約50%の間のデューティーサイクルを有する変調された高周波(RF)電力を発生するように構成された電力発生器と、を備え、前記変調されたRF電力は、2つの隣接する変調されたRF波形の間に電力オフ時間を有する変調されたRF波形を生成する、装置。
  7. 前記電力発生器は抵抗器−キャパシタフィルタを含む、請求項6に記載の装置。
  8. 前記電力発生器は関数発生器を含む、請求項6に記載の装置。
  9. 前記電力発生器は、関数発生器、RCフィルタ、及びブロードバンド増幅器を含む、請求項6に記載の装置。
  10. 前記電力発生器は、1kHzから100kHzの間の繰り返し周波数で、前記変調されたRF電力を発生するように構成される、請求項6に記載の装置。
  11. 前記変調されたRF電力は前記変調されたRF電力の大きさの時間導関数に不連続性がなく、時間の関数としてのイオン化電力の大きさは区分的に滑らかである、請求項6に記載の装置。
  12. 前記変調されたRF電力は、2kHzから20kHzの間の繰り返し周波数を有し、イオン化電力をピーク電力の0%から100%の間で変化させる、請求項11に記載の装置。
  13. 各変調されたRF波形は、方形波変調RF波形を抵抗器−キャパシタフィルタに通して送り高周波を減衰して前記方形波変調RF波形を平滑化させることにより得られた、滑らかに変化する変調されたRF波形である、請求項6に記載の装置。
  14. 前記滑らかに変化する変調されたRF波形は、前記変調されたRF電力により形成されたイオン化電源電力の大きさがゼロであるような限定部分を有する、請求項13に記載の装置。
  15. 各変調されたRF波形が、三角の波形輪郭を有する、請求項6に記載の装置。
JP2014161655A 2003-05-28 2014-08-07 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置 Expired - Lifetime JP5988317B2 (ja)

Applications Claiming Priority (4)

Application Number Priority Date Filing Date Title
US47412503P 2003-05-28 2003-05-28
US60/474,125 2003-05-28
US10/819,392 2004-04-06
US10/819,392 US7179754B2 (en) 2003-05-28 2004-04-06 Method and apparatus for plasma nitridation of gate dielectrics using amplitude modulated radio-frequency energy

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP2012161707A Division JP2012256900A (ja) 2003-05-28 2012-07-20 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置

Publications (2)

Publication Number Publication Date
JP2015043421A true JP2015043421A (ja) 2015-03-05
JP5988317B2 JP5988317B2 (ja) 2016-09-07

Family

ID=33457548

Family Applications (3)

Application Number Title Priority Date Filing Date
JP2006533375A Withdrawn JP2007516605A (ja) 2003-05-28 2004-05-25 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置
JP2012161707A Withdrawn JP2012256900A (ja) 2003-05-28 2012-07-20 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置
JP2014161655A Expired - Lifetime JP5988317B2 (ja) 2003-05-28 2014-08-07 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置

Family Applications Before (2)

Application Number Title Priority Date Filing Date
JP2006533375A Withdrawn JP2007516605A (ja) 2003-05-28 2004-05-25 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置
JP2012161707A Withdrawn JP2012256900A (ja) 2003-05-28 2012-07-20 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置

Country Status (5)

Country Link
US (2) US7179754B2 (ja)
EP (1) EP1634324A1 (ja)
JP (3) JP2007516605A (ja)
KR (1) KR101062057B1 (ja)
WO (1) WO2004107420A1 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2022540745A (ja) * 2019-05-23 2022-09-20 コメット アーゲー 無線周波数発生器

Families Citing this family (80)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7067439B2 (en) * 2002-06-14 2006-06-27 Applied Materials, Inc. ALD metal oxide deposition process using direct oxidation
JP2004247528A (ja) * 2003-02-14 2004-09-02 Sony Corp 半導体装置の製造方法
US7521000B2 (en) * 2003-08-28 2009-04-21 Applied Materials, Inc. Process for etching photomasks
JP5101103B2 (ja) * 2004-03-03 2012-12-19 東京エレクトロン株式会社 プラズマ処理方法及びコンピュータ記憶媒体
US6921691B1 (en) * 2004-03-18 2005-07-26 Infineon Technologies Ag Transistor with dopant-bearing metal in source and drain
US8119210B2 (en) * 2004-05-21 2012-02-21 Applied Materials, Inc. Formation of a silicon oxynitride layer on a high-k dielectric material
US8399934B2 (en) 2004-12-20 2013-03-19 Infineon Technologies Ag Transistor device
US8178902B2 (en) 2004-06-17 2012-05-15 Infineon Technologies Ag CMOS transistor with dual high-k gate dielectric and method of manufacture thereof
US7592678B2 (en) * 2004-06-17 2009-09-22 Infineon Technologies Ag CMOS transistors with dual high-k gate dielectric and methods of manufacture thereof
JP4745247B2 (ja) * 2004-11-05 2011-08-10 株式会社日立国際電気 半導体装置の製造方法
US20070196011A1 (en) * 2004-11-22 2007-08-23 Cox Damon K Integrated vacuum metrology for cluster tool
US20070134821A1 (en) * 2004-11-22 2007-06-14 Randhir Thakur Cluster tool for advanced front-end processing
WO2006055984A2 (en) * 2004-11-22 2006-05-26 Applied Materials, Inc. Substrate processing apparatus using a batch processing chamber
US7344934B2 (en) 2004-12-06 2008-03-18 Infineon Technologies Ag CMOS transistor and method of manufacture thereof
US7879510B2 (en) * 2005-01-08 2011-02-01 Applied Materials, Inc. Method for quartz photomask plasma etching
JP4554378B2 (ja) * 2005-01-21 2010-09-29 富士通セミコンダクター株式会社 窒化膜の形成方法、半導体装置の製造方法及びキャパシタの製造方法
US20060166433A1 (en) * 2005-01-26 2006-07-27 Min-Soo Kim Recessed collar etch for buried strap window formation without poly2
US8293430B2 (en) 2005-01-27 2012-10-23 Applied Materials, Inc. Method for etching a molybdenum layer suitable for photomask fabrication
US7829243B2 (en) * 2005-01-27 2010-11-09 Applied Materials, Inc. Method for plasma etching a chromium layer suitable for photomask fabrication
JP2006260857A (ja) * 2005-03-16 2006-09-28 Nagano Japan Radio Co プラズマ処理装置
US7160781B2 (en) 2005-03-21 2007-01-09 Infineon Technologies Ag Transistor device and methods of manufacture thereof
US7361538B2 (en) * 2005-04-14 2008-04-22 Infineon Technologies Ag Transistors and methods of manufacture thereof
US7429538B2 (en) * 2005-06-27 2008-09-30 Applied Materials, Inc. Manufacturing method for two-step post nitridation annealing of plasma nitrided gate dielectric
US20070010103A1 (en) * 2005-07-11 2007-01-11 Applied Materials, Inc. Nitric oxide reoxidation for improved gate leakage reduction of sion gate dielectrics
US7550381B2 (en) * 2005-07-18 2009-06-23 Applied Materials, Inc. Contact clean by remote plasma and repair of silicide surface
US20070049043A1 (en) * 2005-08-23 2007-03-01 Applied Materials, Inc. Nitrogen profile engineering in HI-K nitridation for device performance enhancement and reliability improvement
US20070049048A1 (en) * 2005-08-31 2007-03-01 Shahid Rauf Method and apparatus for improving nitrogen profile during plasma nitridation
US20070052036A1 (en) * 2005-09-02 2007-03-08 Hongfa Luan Transistors and methods of manufacture thereof
US20070052037A1 (en) * 2005-09-02 2007-03-08 Hongfa Luan Semiconductor devices and methods of manufacture thereof
US8188551B2 (en) 2005-09-30 2012-05-29 Infineon Technologies Ag Semiconductor devices and methods of manufacture thereof
US7462538B2 (en) * 2005-11-15 2008-12-09 Infineon Technologies Ag Methods of manufacturing multiple gate CMOS transistors having different gate dielectric materials
US7495290B2 (en) * 2005-12-14 2009-02-24 Infineon Technologies Ag Semiconductor devices and methods of manufacture thereof
US7510943B2 (en) * 2005-12-16 2009-03-31 Infineon Technologies Ag Semiconductor devices and methods of manufacture thereof
US7964514B2 (en) 2006-03-02 2011-06-21 Applied Materials, Inc. Multiple nitrogen plasma treatments for thin SiON dielectrics
KR101117450B1 (ko) * 2006-03-09 2012-03-13 어플라이드 머티어리얼스, 인코포레이티드 낮은 에너지 플라즈마 시스템을 이용하여 하이 유전상수 트랜지스터 게이트를 제조하는 방법 및 장치
US7837838B2 (en) * 2006-03-09 2010-11-23 Applied Materials, Inc. Method of fabricating a high dielectric constant transistor gate using a low energy plasma apparatus
US7678710B2 (en) 2006-03-09 2010-03-16 Applied Materials, Inc. Method and apparatus for fabricating a high dielectric constant transistor gate using a low energy plasma system
US7645710B2 (en) * 2006-03-09 2010-01-12 Applied Materials, Inc. Method and apparatus for fabricating a high dielectric constant transistor gate using a low energy plasma system
US20080050898A1 (en) * 2006-08-23 2008-02-28 Hongfa Luan Semiconductor devices and methods of manufacture thereof
TWI435376B (zh) * 2006-09-26 2014-04-21 Applied Materials Inc 用於缺陷鈍化之高k閘極堆疊的氟電漿處理
KR100944846B1 (ko) * 2006-10-30 2010-03-04 어플라이드 머티어리얼스, 인코포레이티드 마스크 에칭 프로세스
US20080237694A1 (en) * 2007-03-27 2008-10-02 Michael Specht Integrated circuit, cell, cell arrangement, method for manufacturing an integrated circuit, method for manufacturing a cell, memory module
US8614124B2 (en) * 2007-05-25 2013-12-24 Cypress Semiconductor Corporation SONOS ONO stack scaling
US8110490B2 (en) * 2007-08-15 2012-02-07 Taiwan Semiconductor Manufacturing Company, Ltd. Gate oxide leakage reduction
JP5514413B2 (ja) * 2007-08-17 2014-06-04 東京エレクトロン株式会社 プラズマエッチング方法
US7846793B2 (en) * 2007-10-03 2010-12-07 Applied Materials, Inc. Plasma surface treatment for SI and metal nanocrystal nucleation
US20090162570A1 (en) * 2007-12-19 2009-06-25 Applied Materials, Inc. Apparatus and method for processing a substrate using inductively coupled plasma technology
US8062472B2 (en) * 2007-12-19 2011-11-22 Applied Materials, Inc. Method of correcting baseline skew by a novel motorized source coil assembly
US8999106B2 (en) * 2007-12-19 2015-04-07 Applied Materials, Inc. Apparatus and method for controlling edge performance in an inductively coupled plasma chamber
US8137463B2 (en) * 2007-12-19 2012-03-20 Applied Materials, Inc. Dual zone gas injection nozzle
JP5104373B2 (ja) * 2008-02-14 2012-12-19 日本ゼオン株式会社 位相差板の製造方法
US7871942B2 (en) * 2008-03-27 2011-01-18 Applied Materials, Inc. Methods for manufacturing high dielectric constant film
JP5390846B2 (ja) 2008-12-09 2014-01-15 東京エレクトロン株式会社 プラズマエッチング装置及びプラズマクリーニング方法
US8481433B2 (en) * 2009-03-31 2013-07-09 Applied Materials, Inc. Methods and apparatus for forming nitrogen-containing layers
JP5395491B2 (ja) * 2009-03-31 2014-01-22 東京エレクトロン株式会社 基板処理装置及び基板処理方法
US20100297854A1 (en) * 2009-04-22 2010-11-25 Applied Materials, Inc. High throughput selective oxidation of silicon and polysilicon using plasma at room temperature
US8173531B2 (en) * 2009-08-04 2012-05-08 International Business Machines Corporation Structure and method to improve threshold voltage of MOSFETS including a high K dielectric
US8441078B2 (en) * 2010-02-23 2013-05-14 Texas Instruments Incorporated Semiconductor device including SiON gate dielectric with portions having different nitrogen concentrations
US9054048B2 (en) 2011-07-05 2015-06-09 Applied Materials, Inc. NH3 containing plasma nitridation of a layer on a substrate
US20130115773A1 (en) * 2011-11-04 2013-05-09 Globalfoundries Inc. Prevention of ILD Loss in Replacement Gate Technologies by Surface Treatmen
JP5808012B2 (ja) * 2011-12-27 2015-11-10 東京エレクトロン株式会社 プラズマ処理装置
DE102012200878B4 (de) * 2012-01-23 2014-11-20 Forschungsverbund Berlin E.V. Verfahren und Vorrichtung zum Erzeugen von Plasmapulsen
CN104106128B (zh) 2012-02-13 2016-11-09 应用材料公司 用于基板的选择性氧化的方法和设备
JP6009171B2 (ja) * 2012-02-14 2016-10-19 東京エレクトロン株式会社 基板処理装置
US9373516B2 (en) 2012-08-31 2016-06-21 Applied Materials, Inc. Method and apparatus for forming gate stack on Si, SiGe or Ge channels
US9177787B2 (en) * 2013-03-15 2015-11-03 Applied Materials, Inc. NH3 containing plasma nitridation of a layer of a three dimensional structure on a substrate
US20140273530A1 (en) * 2013-03-15 2014-09-18 Victor Nguyen Post-Deposition Treatment Methods For Silicon Nitride
JP2014220059A (ja) * 2013-05-07 2014-11-20 株式会社ダイヘン 高周波電源
US9401263B2 (en) * 2013-09-19 2016-07-26 Globalfoundries Inc. Feature etching using varying supply of power pulses
US9076651B1 (en) * 2013-12-20 2015-07-07 Intermolecular, Inc. Gate stacks and ohmic contacts for SiC devices
JP2015142034A (ja) * 2014-01-29 2015-08-03 ルネサスエレクトロニクス株式会社 半導体装置の製造方法
US10062693B2 (en) * 2016-02-24 2018-08-28 International Business Machines Corporation Patterned gate dielectrics for III-V-based CMOS circuits
US10593600B2 (en) 2016-02-24 2020-03-17 International Business Machines Corporation Distinct gate stacks for III-V-based CMOS circuits comprising a channel cap
US10510545B2 (en) 2016-06-20 2019-12-17 Applied Materials, Inc. Hydrogenation and nitridization processes for modifying effective oxide thickness of a film
US10103027B2 (en) 2016-06-20 2018-10-16 Applied Materials, Inc. Hydrogenation and nitridization processes for modifying effective oxide thickness of a film
US11170981B2 (en) * 2019-09-17 2021-11-09 Tokyo Electron Limited Broadband plasma processing systems and methods
US11295937B2 (en) * 2019-09-17 2022-04-05 Tokyo Electron Limited Broadband plasma processing systems and methods
US11830725B2 (en) 2020-01-23 2023-11-28 Applied Materials, Inc. Method of cleaning a structure and method of depositing a capping layer in a structure
CN114864395B (zh) * 2022-07-05 2022-09-23 北京屹唐半导体科技股份有限公司 控制氮掺杂深度分布的方法和半导体器件
CN116031141A (zh) * 2022-12-25 2023-04-28 北京屹唐半导体科技股份有限公司 工件处理方法、工件处理设备及半导体器件

Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63209129A (ja) * 1987-02-25 1988-08-30 Plasma Haitetsuku:Kk プラズマ処理方法
JPH0847252A (ja) * 1994-07-29 1996-02-16 Sharp Corp スイッチングレギュレータ
JPH0981249A (ja) * 1995-09-12 1997-03-28 Jeol Ltd 高周波電源
JPH1074598A (ja) * 1996-04-30 1998-03-17 Samsung Electron Co Ltd Rf発生装置及びこれを用いたパルスプラズマ形成方法
JPH1116892A (ja) * 1997-06-24 1999-01-22 Nec Corp プラズマ処理方法
WO2002029849A2 (en) * 2000-10-06 2002-04-11 Lam Research Corporation System, apparatus, and method for processing wafer using single frequency rf power in plasma processing chamber
JP2002324795A (ja) * 2001-04-24 2002-11-08 Sekisui Chem Co Ltd シリコンウェハの窒化処理方法
JP2003009521A (ja) * 2001-05-04 2003-01-10 Power Integrations Inc エネルギ伝達エレメントの入力にわたる電圧から導かれた電流に応答するスイッチ・モード電源
JP2003077915A (ja) * 2001-09-04 2003-03-14 Matsushita Electric Ind Co Ltd 絶縁膜の形成方法及びその形成装置
JP2004296603A (ja) * 2003-03-26 2004-10-21 Sony Corp プラズマ表面処理装置およびプラズマ表面処理方法

Family Cites Families (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR930004713B1 (ko) * 1990-06-18 1993-06-03 삼성전자 주식회사 변조방식을 이용한 플라즈마 발생장치 및 방법
JPH0734399B2 (ja) * 1992-05-01 1995-04-12 日新電機株式会社 ラジカルビームの発生方法
JP3162245B2 (ja) * 1994-04-20 2001-04-25 東京エレクトロン株式会社 プラズマ処理方法及びプラズマ処理装置
JP3546977B2 (ja) * 1994-10-14 2004-07-28 富士通株式会社 半導体装置の製造方法と製造装置
JPH09129398A (ja) * 1995-10-31 1997-05-16 Kokusai Electric Co Ltd プラズマ処理方法及び装置
EP0847079A3 (en) * 1996-12-05 1999-11-03 Texas Instruments Incorporated Method of manufacturing an MIS electrode
US6041734A (en) 1997-12-01 2000-03-28 Applied Materials, Inc. Use of an asymmetric waveform to control ion bombardment during substrate processing
US6472822B1 (en) * 2000-04-28 2002-10-29 Applied Materials, Inc. Pulsed RF power delivery for plasma processing
US20050230047A1 (en) * 2000-08-11 2005-10-20 Applied Materials, Inc. Plasma immersion ion implantation apparatus
US6610615B1 (en) 2000-11-15 2003-08-26 Intel Corporation Plasma nitridation for reduced leakage gate dielectric layers
US6770166B1 (en) * 2001-06-29 2004-08-03 Lam Research Corp. Apparatus and method for radio frequency de-coupling and bias voltage control in a plasma reactor
US7018879B2 (en) 2002-03-20 2006-03-28 Taiwan Semiconductor Manufacturing Co., Ltd. Method of making an ultrathin silicon dioxide gate with improved dielectric properties using NH3 nitridation and post-deposition rapid thermal annealing
WO2003107382A2 (en) 2002-06-12 2003-12-24 Applied Materials, Inc. Plasma method and apparatus for processing a substrate
JP2004022902A (ja) * 2002-06-18 2004-01-22 Fujitsu Ltd 半導体装置の製造方法
US6919251B2 (en) * 2002-07-31 2005-07-19 Texas Instruments Incorporated Gate dielectric and method
US6869821B2 (en) * 2002-12-30 2005-03-22 Xerox Corporation Method for producing organic electronic devices on deposited dielectric materials
US7018925B2 (en) * 2003-01-06 2006-03-28 Texas Instruments Incorporated Post high voltage gate oxide pattern high-vacuum outgas surface treatment
US7049242B2 (en) * 2003-01-06 2006-05-23 Texas Instruments Incorporated Post high voltage gate dielectric pattern plasma surface treatment
US6921703B2 (en) * 2003-05-13 2005-07-26 Texas Instruments Incorporated System and method for mitigating oxide growth in a gate dielectric

Patent Citations (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63209129A (ja) * 1987-02-25 1988-08-30 Plasma Haitetsuku:Kk プラズマ処理方法
JPH0847252A (ja) * 1994-07-29 1996-02-16 Sharp Corp スイッチングレギュレータ
JPH0981249A (ja) * 1995-09-12 1997-03-28 Jeol Ltd 高周波電源
JPH1074598A (ja) * 1996-04-30 1998-03-17 Samsung Electron Co Ltd Rf発生装置及びこれを用いたパルスプラズマ形成方法
JPH1116892A (ja) * 1997-06-24 1999-01-22 Nec Corp プラズマ処理方法
US6054063A (en) * 1997-06-24 2000-04-25 Nec Corporation Method for plasma treatment and apparatus for plasma treatment
WO2002029849A2 (en) * 2000-10-06 2002-04-11 Lam Research Corporation System, apparatus, and method for processing wafer using single frequency rf power in plasma processing chamber
US6562190B1 (en) * 2000-10-06 2003-05-13 Lam Research Corporation System, apparatus, and method for processing wafer using single frequency RF power in plasma processing chamber
JP2004511097A (ja) * 2000-10-06 2004-04-08 ラム リサーチ コーポレーション プラズマ処理チャンバにおける単周波rf電力を用いたウェハ処理システム、処理装置、および処理方法
JP2002324795A (ja) * 2001-04-24 2002-11-08 Sekisui Chem Co Ltd シリコンウェハの窒化処理方法
JP2003009521A (ja) * 2001-05-04 2003-01-10 Power Integrations Inc エネルギ伝達エレメントの入力にわたる電圧から導かれた電流に応答するスイッチ・モード電源
JP2003077915A (ja) * 2001-09-04 2003-03-14 Matsushita Electric Ind Co Ltd 絶縁膜の形成方法及びその形成装置
JP2004296603A (ja) * 2003-03-26 2004-10-21 Sony Corp プラズマ表面処理装置およびプラズマ表面処理方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2022540745A (ja) * 2019-05-23 2022-09-20 コメット アーゲー 無線周波数発生器
JP7428728B2 (ja) 2019-05-23 2024-02-06 コメット アーゲー 無線周波数発生器、プラズマ処理システム、無線周波数発生器コントローラを動作させる方法、コンピュータプログラム要素、及びコンピュータ読み取り可能媒体

Also Published As

Publication number Publication date
JP5988317B2 (ja) 2016-09-07
JP2012256900A (ja) 2012-12-27
KR20060014424A (ko) 2006-02-15
US20040242021A1 (en) 2004-12-02
US7179754B2 (en) 2007-02-20
US20060216944A1 (en) 2006-09-28
US7514373B2 (en) 2009-04-07
KR101062057B1 (ko) 2011-09-02
JP2007516605A (ja) 2007-06-21
WO2004107420A1 (en) 2004-12-09
EP1634324A1 (en) 2006-03-15

Similar Documents

Publication Publication Date Title
JP5988317B2 (ja) 振幅変調された高周波エネルギーを使用してゲート誘電体をプラズマ窒化するための方法及び装置
US6831021B2 (en) Plasma method and apparatus for processing a substrate
JP5466756B2 (ja) プラズマエッチング方法、半導体デバイスの製造方法、及びプラズマエッチング装置
KR101163264B1 (ko) 플라즈마 프로세싱을 사용하여 하이-k 층을 포함하는 게이트 유전체 스택을 변형하는 방법
US8021987B2 (en) Method of modifying insulating film
KR100645306B1 (ko) 기판 처리 방법
US6902681B2 (en) Method for plasma etching of high-K dielectric materials
US20070049043A1 (en) Nitrogen profile engineering in HI-K nitridation for device performance enhancement and reliability improvement
US20040007561A1 (en) Method for plasma etching of high-K dielectric materials
CN1926670B (zh) 等离子体处理方法
CN101401194B (zh) 使用低能量等离子体系统制造高介电常数晶体管栅极的方法和装置
US7000565B2 (en) Plasma surface treatment system and plasma surface treatment method
KR102538040B1 (ko) 박막 처리 프로세스
JP4931939B2 (ja) 半導体デバイスを形成する方法
JPWO2003098678A1 (ja) 基板処理方法
CN100461341C (zh) 使用调幅射频能量的栅极介电层的等离子体氮化方法和设备
WO2004049423A1 (ja) 半導体装置の製造方法

Legal Events

Date Code Title Description
A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20150709

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20150804

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20151030

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20151201

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20160330

A911 Transfer to examiner for re-examination before appeal (zenchi)

Free format text: JAPANESE INTERMEDIATE CODE: A911

Effective date: 20160407

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20160705

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20160803

R150 Certificate of patent or registration of utility model

Ref document number: 5988317

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250