JP2014123772A5 - - Google Patents

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上記の課題を解決するために、本発明は、パッケージ基板であって、対向する第1の表面及び第2の表面を有するコア層と、前記コア層の前記第1の表面に設けられ、第1の電気接触パッドを有する第1の回路層と、前記コア層の前記第2の表面に設けられ、第2の電気接触パッドを有する第2の回路層と、前記コア層に設けられ、前記第1及び第2の回路層に電気的に接続される導電ビアと、前記コア層の前記第1の表面及び前記第1の回路層に設けられ、前記第1の電気接触パッドが露出される第1の絶縁保護層と、前記第1の電気接触パッドの露出表面に形成される第1の表面処理層と、前記コア層の前記第2の表面及び前記第2の回路層に設けられ、前記第2の電気接触パッドが露出される第2の絶縁保護層と、前記第2の電気接触パッドの露出表面に形成される第2の表面処理層と、前記第1の絶縁保護層に接着層により結合される搭載部材と、を備え、前記パッケージ基板の厚さから前記搭載部材の厚さを減じてなる残りの厚さは、150μmよりも小さいことを特徴とするパッケージ基板を提供する。

Claims (2)

  1. パッケージ基板であって、
    対向する第1の表面及び第2の表面を有するコア層と、
    前記コア層の前記第1の表面に設けられ、第1の電気接触パッドを有する第1の回路層と、
    前記コア層の前記第2の表面に設けられ、第2の電気接触パッドを有する第2の回路層と、
    前記コア層に設けられ、前記第1及び第2の回路層に電気的に接続される導電ビアと、
    前記コア層の前記第1の表面及び前記第1の回路層に設けられ、前記第1の電気接触パッドが露出される第1の絶縁保護層と、
    前記第1の電気接触パッドの露出表面に形成される第1の表面処理層と、
    前記コア層の前記第2の表面及び前記第2の回路層に設けられ、前記第2の電気接触パッドが露出される第2の絶縁保護層と、
    前記第2の電気接触パッドの露出表面に形成される第2の表面処理層と、
    前記第1の絶縁保護層に接着層により結合される搭載部材と、
    を備え
    前記パッケージ基板の厚さから前記搭載部材の厚さを減じてなる残りの厚さは、150μmよりも小さいことを特徴とするパッケージ基板。
  2. 前記接着層の材質は、スーパーグルー又は離型剤であることを特徴とする請求項1に記載のパッケージ基板。
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* Cited by examiner, † Cited by third party
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JP3921124B2 (ja) * 2002-04-30 2007-05-30 日本特殊陶業株式会社 配線基板の製造方法
JP4211350B2 (ja) * 2002-10-18 2009-01-21 東レ株式会社 多層回路基板用部材および多層回路基板の製造方法
JP4981712B2 (ja) * 2008-02-29 2012-07-25 新光電気工業株式会社 配線基板の製造方法及び半導体パッケージの製造方法
JP5577760B2 (ja) * 2009-03-09 2014-08-27 新光電気工業株式会社 パッケージ基板および半導体装置の製造方法
TWI390692B (zh) * 2009-06-23 2013-03-21 欣興電子股份有限公司 封裝基板與其製法暨基材
JP5700241B2 (ja) * 2009-11-09 2015-04-15 日立化成株式会社 多層配線基板及びその製造方法

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