JP2011070761A - シフト・レジスタおよびゲートライン駆動装置 - Google Patents
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Abstract
【解決手段】前記シフト・レジスタは、第1の薄膜トランジスタと、第2の薄膜トランジスタと、第3の薄膜トランジスタと、コンデンサと、フィードバックモジュールと、オン/オフモジュールと、を備える。前記フィードバックモジュールは上段のフィードバックモジュールのトリガー信号とクロック信号を受信して、プルアップノードとなる第1のノードのレベルをプルアップし、且つ上段のシフト・レジスタにフィードバック信号を出力し、下段のフィードバックモジュールにトリガー信号を出力する。前記オン/オフモジュールは、本段のシフト・レジスタが動作しない時に、本段のシフト・レジスタの出力端子をローレベルに保持する。本発明は液晶パネルに適用することができる。
【選択図】図4
Description
シフト・レジスタは、
ゲートがプルアップノードとなる第1のノードに接続され、ソースがクロック信号端子に接続され、ドレーンが本段の出力端子に接続される第1の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースが前記第1のノードに接続され、ドレーンがローレベル信号端子に接続される第2の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースがプルダウンノードとなる第2のノードに接続され、ドレーンがローレベル信号端子に接続される第3の薄膜トランジスタと、
前記第1のノードと本段の出力端子との間に接続されるコンデンサと、
上段のトリガー信号端子とクロック信号端子と前記第1のノードとの間に接続され、且つ本段のフィードバック信号端子と本段のトリガー信号端子とに接続されるフィードバックモジュールと、
クロック信号端子と前記フィードバックモジュールと本段の出力端子との間に接続され、且つローレベル信号端子に接続されるオン/オフモジュールと、を備え、
前記フィードバックモジュールは上段のフィードバックモジュールのトリガー信号とクロック信号を受信して前記第1のノードのレベルをプルアップし、且つ上段のシフト・レジスタにフィードバック信号を出力し、下段のフィードバックモジュールにトリガー信号を出力し、前記オン/オフモジュールは、本段のシフト・レジスタが動作しない時に、本段のシフト・レジスタの出力端子をローレベルに保持される。
直列に接続された複数のシフト・レジスタを備えるゲートライン駆動装置であって、
前記シフト・レジスタは、
ゲートがプルアップノードとなる第1のノードに接続され、ソースがクロック信号端子に接続され、ドレーンが本段の出力端子に接続される第1の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースが前記第1のノードに接続され、ドレーンがローレベル信号端子に接続される第2の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースがプルダウンノードとなる第2のノードに接続され、ドレーンがローレベル信号端子に接続され、前述第2のノードが本段の出力端に接続される第3の薄膜トランジスタと、
前記第1のノードと本段の出力端子との間に接続されるコンデンサと、
上段のトリガー信号端子とクロック信号端子と前記第1のノードとの間に接続され、且つ本段のフィードバック信号端子と本段のトリガー信号端子とに接続されるフィードバックモジュールと、
クロック信号端子、前記フィードバックモジュールと本段の出力端子に接続され、且つローレベル信号端子に接続されるオン/オフモジュールと、を備え、
前記フィードバックモジュールは上段のフィードバックモジュールのトリガー信号とクロック信号を受信して前記第1のノードのレベルをプルアップし、且つ上段のシフト・レジスタにフィードバック信号を出力し、下段のフィードバックモジュールにトリガー信号を出力し、前記オン/オフモジュールは、本段のシフト・レジスタが動作しない時に、本段のシフト・レジスタの出力端子をローレベルに保持することを特徴とするゲートライン駆動装置。
以下は図面と実施例を通じて本発明の技術方案をさらに詳細に説明する。
図6は本実施例に係わる信号の概略図である。T1、T2、T3、及びT4という四つの段階に分けることができる。
図7における太くされた部分に示すように、Qa(n-1)=1、即ち第1のトリガー信号端子がハイレベルであるため、第4の薄膜トランジスタがオンされると共に、CLKB=1、即ち第2のクロック信号がハイレベルであるため、第5の薄膜トランジスタM5がオンされ、又Qb(n-1)=1、即ち第2のトリガー信号端子がハイレベルであるので、第1のノードQaがハイレベルにプルアップされ、即ちQa=1となり、且つ記憶コンデンサC1によって第1のノードQaがハイレベルに保持される。しかしながら、この時にCLKB=1となるので、第10の薄膜トランジスタM10がオンされて、本段の出力端子outputをそのままローレベルに保持させ、即ちOUTN=0にする。この時に、本段のシフト・レジスタはオフ状態となる。
図8における太くされた部分に示すように、T1段階においてQa=1であるので、第1の薄膜トランジスタM1がオンされ、この時にCLK=1となるので、本段の出力端子outputがハイレベルとなり、即ちOUTN=1となる。この時に本段のシフト・レジスタはオン状態となる。それと同時に、第1のノードQa=1となるので、第6の薄膜トランジスタM6がオンされ、それにCLK=1となるので、フィードバックノードQbがハイレベルとなる、即ちQb=1となる。この段階において、ノードQaとQbが下段のシフト・レジスタに二つのトリガー信号を出力することで、下段のシフト・レジスタがこの二つのトリガー信号によってオンされることができる。更に、上段のシフト・レジスタをオフにするように、ノードQbを通じて上段のシフト・レジスタにフィードバック信号を出力することができる。
図9における太くされた部分に示すように、Qb(n+1)=1、即ち下段のフィードバック信号端子がハイレベルであるので、この時に第2の薄膜トランジスタM2と第3の薄膜トランジスタM3がオンされることができる。第3の薄膜トランジスタM3のオンによって本段の出力端子outputがローレベルになり、即ちOUTN=0になる。この時に本段のシフト・レジスタはオフ状態となる。第2の薄膜トランジスタM2のオンによって第1のノードQaがローレベルになり、即Qa=0になる。このように、第1の薄膜トランジスタM1をそのままオフさせて、本段の出力端子outputがローレベルとなることを保証する。これだけでなく、CLKB=1となるので、第7の薄膜トランジスタM7がオンされて、第12の薄膜トランジスタM12と第14の薄膜トランジスタM14とがオンされる。この時にQb(n-1)=0となるので、第12の薄膜トランジスタM12がオンされた後にも、第1のノードQaをローレベルにすることができる。更に、第14の薄膜トランジスタM14がローレベル信号端子VGLに接続されるため、第14の薄膜トランジスタM14がオンされた後に、第3のノードQbをローレベルにすることができる。このように、ノードQaとQbは、下段のシフト・レジスタのオンと上段のシフト・レジスタのオフをトリガーすることができない。
図10における太くされた部分に示すように、CLK=1なので、第9の薄膜トランジスタM9をオンして、第11の薄膜トランジスタM11、第13の薄膜トランジスタM13、及び第15の薄膜トランジスタM15をオンさせる。第11の薄膜トランジスタM11がローレベル信号端子VGLに接続されるので、本段の出力端子outputをローレベルに保持し、即ちOUTN=0に保持する。この時に本段のシフト・レジスタはオフ状態となる。しかも、第13の薄膜トランジスタM13をオンした後に第1のノードQaをローレベルに保持し、第15の薄膜トランジスタM15をオンした後に第3のノードQbをローレベルに保持して、更に本段の出力端子outputがローレベルを安定に出力することを保持する。
以上は本発明の具体的な実施形態にすぎない。本発明が保護した範囲はこれに限定されなく、当業者は本発明に記載の技術範囲内で、その変更又は取替えを容易に想到しうる。その変更又は取替えは本発明が保護した範囲内にある。従って、本発明が保護した範囲は請求項に記載の保護範囲を基本とするのである。
Q 第2のノード
M1 第1の薄膜トランジスタ
M2 第2の薄膜トランジスタ
M3 第3の薄膜トランジスタ
C1 コンデンサ
1 フィードバックモジュール
2 オン/オフモジュール
Claims (10)
- シフト・レジスタであって、
ゲートがプルアップノードとなる第1のノードに接続され、ソースがクロック信号端子に接続され、ドレーンが本段の出力端子に接続される第1の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースが前記第1のノードに接続され、ドレーンがローレベル信号端子に接続される第2の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースがプルダウンノードとなる第2のノードに接続され、ドレーンがローレベル信号端子に接続され、前述第2のノードが本段の出力端に接続される第3の薄膜トランジスタと、
前記第1のノードと本段の出力端子との間に接続されるコンデンサと、
上段のトリガー信号端子とクロック信号端子と前記第1のノードとの間に接続され、且つ本段のフィードバック信号端子と本段のトリガー信号端子とに接続されるフィードバックモジュールと、
クロック信号端子、前記フィードバックモジュールと本段の出力端子に接続され、且つローレベル信号端子に接続されるオン/オフモジュールと、を備え、
前記フィードバックモジュールは上段のフィードバックモジュールのトリガー信号とクロック信号を受信して前記第1のノードのレベルをプルアップし、且つ上段のシフト・レジスタにフィードバック信号を出力し、下段のフィードバックモジュールにトリガー信号を出力し、前記オン/オフモジュールは、本段のシフト・レジスタが動作しない時に、本段のシフト・レジスタの出力端子をローレベルに保持することを特徴とするシフト・レジスタ。 - 前記フィードバックモジュールは、
ゲートが上段のフィードバックモジュールの第1のトリガー信号端子に接続され、ソースが第5の薄膜トランジスタのゲートに接続され、ドレーンがクロック信号端子に接続される第4の薄膜トランジスタと、
ゲートが第4の薄膜トランジスタのソースに接続され、ソースが前記第1のノードに接続され、ドレーンが上段のフィードバックモジュールの第2のトリガー信号端子に接続される第5の薄膜トランジスタと、
ゲートが前記第1のノードに接続され、ソースがクロック信号端子に接続され、ドレーンが本段のフィードバックノードとなる第3のノードに接続される第6の薄膜トランジスタとをさらに備えることを特徴とする請求項1に記載のシフト・レジスタ。 - 前記オン/オフモジュールは、
ゲートとドレーンとが共に接続されてクロック信号端子に接続され、ソースが第2のオン/オフモジュールと第3のオン/オフモジュールとに接続される第7の薄膜トランジスタと、ゲートがクロック信号端子に接続され、ソースがインターロックノードとなる第4のノードに接続され、ドレーンがローレベル信号端子に接続される第8の薄膜トランジスタと、ゲートとソースとが共に接続されてクロック信号端子に接続され、ドレーンが前記第4のノードに接続される第9の薄膜トランジスタとを有し、後述の第1のオン/オフモジュール、第2のオン/オフモジュールおよび第3のオン/オフモジュールを制御する第1段のオン/オフモジュールと、
ゲートがクロック信号端子に接続され、ソースが前記第2のノードに接続され、ドレーンがローレベル信号端子に接続される第10の薄膜トランジスタと、ゲートが前記第4のノードに接続され、ソースが前記第2のノードに接続され、ドレーンがローレベル信号端子に接続される第11の薄膜トランジスタとを有し、本段のシフト・レジスタが動作しない時に、本段の出力端子をローレベルに保持する第1のオン/オフモジュールと、
ゲートが第7の薄膜トランジスタのソースに接続され、ソースが前記第1のノードに接続され、ドレーンが上段のフィードバックモジュールに接続される第12の薄膜トランジスタと、ゲートが前記第4のノードに接続され、ソースが前記第2のノードに接続され、ドレーンが前記第1のノードに接続される第13の薄膜トランジスタとを有し、本段のシフト・レジスタが動作しない時に、前記第1のノードをローレベルに保持する第2のオン/オフモジュールと、
ゲートが第7の薄膜トランジスタのソースに接続され、ソースが前記第3のノードに接続され、ドレーンがローレベル信号端子に接続される第14の薄膜トランジスタと、ゲートが前記第4のノードに接続され、ソースが前記第3のノードに接続され、ドレーンがローレベル信号端子に接続される第15の薄膜トランジスタとを有し、本段のシフト・レジスタが動作しない時に前記第3のノードをローレベルに保持する第3のオン/オフモジュールと、備えることを特徴とする請求項2に記載のシフト・レジスタ。 - ゲートがオン/オフ信号端子に接続され、ソースが前記第1のノードに接続され、ドレーンがローレベル信号端子に接続される第16の薄膜トランジスタをさらに備えることを特徴とする請求項1ないし3の何れかに記載のシフト・レジスタ。
- ゲートがオン/オフ信号端子に接続され、ソースがリセット信号端子に接続され、ドレーンが前記第2のノードに接続される第17の薄膜トランジスタを更に備えることを特徴とする請求項1ないし3のいずれかに記載のシフト・レジスタ。
- 直列に接続された複数のシフト・レジスタを備えるゲートライン駆動装置であって、
前記シフト・レジスタは、
ゲートがプルアップノードとなる第1のノードに接続され、ソースがクロック信号端子に接続され、ドレーンが本段の出力端子に接続される第1の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースが前記第1のノードに接続され、ドレーンがローレベル信号端子に接続される第2の薄膜トランジスタと、
ゲートが下段のフィードバック信号端子に接続され、ソースがプルダウンノードとなる第2のノードに接続され、ドレーンがローレベル信号端子に接続される第3の薄膜トランジスタと、
前記第1のノードと本段の出力端子との間に接続されるコンデンサと、
上段のトリガー信号端子とクロック信号端子と前記第1のノードとの間に接続され、且つ本段のフィードバック信号端子と本段のトリガー信号端子とに接続されるフィードバックモジュールと、
クロック信号端子と前記フィードバックモジュールと本段の出力端子との間に接続され、且つローレベル信号端子に接続されるオン/オフモジュールと、を備え、
前記フィードバックモジュールは上段のフィードバックモジュールのトリガー信号とクロック信号を受信して前記第1のノードのレベルをプルアップし、且つ上段のシフト・レジスタにフィードバック信号を出力し、下段のフィードバックモジュールにトリガー信号を出力し、前記オン/オフモジュールは、本段のシフト・レジスタが動作しない時に、本段のシフト・レジスタの出力端子をローレベルに保持することを特徴とするゲートライン駆動装置。 - 前記フィードバックモジュールは、
ゲートが上段のフィードバックモジュールの第1のトリガー信号端子に接続され、ソースが第5の薄膜トランジスタのゲートに接続され、ドレーンがクロック信号端子に接続される第4の薄膜トランジスタと、
ゲートが第4の薄膜トランジスタのソースに接続され、ソースが前記第1のノードに接続され、ドレーンが上段のフィードバックモジュールの第2のトリガー信号端子に接続される第5の薄膜トランジスタと、
ゲートが前記第1のノードに接続され、ソースがクロック信号端子に接続され、ドレーンが本段のフィードバックノードとなる第3のノードに接続される第6の薄膜トランジスタとをさらに備えることを特徴とする請求項6に記載のゲートライン駆動装置。 - 前記オン/オフモジュールは、
ゲートとドレーンとが共に接続されてクロック信号端子に接続され、ソースが第2段のオン/オフモジュールと第3段のオン/オフモジュールとに接続される第7の薄膜トランジスタと、ゲートがクロック信号端子に接続され、ソースがインターロックノードとなる第4のノードに接続され、ドレーンがローレベル信号端子に接続される第8の薄膜トランジスタと、ゲートとソースとが共に接続されてクロック信号端子に接続され、ドレーンが前記第4のノードに接続される第9の薄膜トランジスタとを有し、後続の第1のオン/オフモジュール、第2のオン/オフモジュールおよび第3のオン/オフモジュールを制御する第1段のオン/オフモジュールと、
ゲートがクロック信号端子に接続され、ソースが前記第2のノードに接続され、ドレーンがローレベル信号端子に接続される第10の薄膜トランジスタと、ゲートが前記第4のノードに接続され、ソースが前記第2のノードに接続され、ドレーンがローレベル信号端子に接続される第11の薄膜トランジスタとを有し、本段のシフト・レジスタが動作しない時に、本段の出力端子をローレベルに保持する第1のオン/オフモジュールと、
ゲートが第7の薄膜トランジスタのソースに接続され、ソースが前記第1のノードに接続され、ドレーンが上段のフィードバックモジュールに接続される第12の薄膜トランジスタと、ゲートが前記第4のノードに接続され、ソースが前記第2のノードに接続され、ドレーンが前記第1のノードに接続される第13の薄膜トランジスタとを有し、本段のシフト・レジスタが動作しない時に、前記第1のノードをローレベルに保持する第2のオン/オフモジュールと、
ゲートが第7の薄膜トランジスタのソースに接続され、ソースが前記第3のノードに接続され、ドレーンがローレベル信号端子に接続される第14の薄膜トランジスタと、ゲートが前記第4のノードに接続され、ソースが前記第3のノードに接続され、ドレーンがローレベル信号端子に接続される第15の薄膜トランジスタとを有し、本段のシフト・レジスタが動作しない時に前記第3のノードをローレベルに保持する第3のオン/オフモジュールと、備えることを特徴とする請求項7に記載のゲートライン駆動装置。 - 前記シフト・レジスタは、
ゲートがオン/オフ信号端子に接続され、ソースが前記第1のノードに接続され、ドレーンがローレベル信号端子に接続される第16の薄膜トランジスタをさらに備えることを特徴とする請求項6ないし8の何れかに記載のゲートライン駆動装置。 - 前記シフト・レジスタは、
ゲートがオン/オフ信号端子に接続され、ソースがリセット信号端子に接続され、ドレーンが前記第2のノードに接続される第17の薄膜トランジスタを更に備えることを特徴とする請求項6ないし8のいずれかに記載のゲートライン駆動装置。
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