JP2010041139A - クロック再生回路およびそれを用いる受信機 - Google Patents
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Abstract
【解決手段】4値FSK復調信号をシンボルクロックよりも高い周波数でオーバーサンプリングし、シンボル点Pに近い点T2と、前後の点T1,T3との3点のサンプルデータについて、シンボル点Pにて得られるべき理想の振幅レベルとの差分値の大きさV1〜V3を求め、前後の点T1,T3の内、その大きさV1,V3が小さい方の測定(サンプル)点側に、かつ点T2の差分値V2に対応した時間だけ、自走するタイマのサンプリングタイミングを移動させる。したがって、サンプリングタイミングは、最大でオーバーサンプリングの周期ずつでずれが修正されてゆき、安定したシンボルクロックを再生できる。また、タイミング演算は、3つの点T1,T2,T3で行えばよく、演算量を削減できる。
【選択図】図14
Description
3 アンテナ
4,8,12,224 バンドパスフィルタ
5,9,13,40 アンプ
6,10;222,241,242 混合器
7,11;223,243 局部発振回路
14 アナログ/デジタル変換器
15,17,39 デジタル/アナログ変換器
16 スピーカ
21,61 復調回路
22 周波数変換器
221 ハイパスフィルタ
23,25,26,37,45 コンバータ
24 直交変換器
244 移相器
245,246,27,28,38,507 ローパスフィルタ
29 位相検出器
30 周波数検出器
301 加算器
302 遅延器
31 逆Sincフィルタ
32 ルート・レイズド・コサインフィルタ
33 4値FSKシンボル再生回路
330,336−1〜3,502 引算器
331−1〜3,334−1〜3 シフトレジスタ
332 ゲート回路
333 タイマ
335 シンボル判定部
337 セレクタ
338 タイミング補正回路
339 ループフィルタ
34 同期ワードパターン検出回路
340 シンボル比較器
341,346 メモリ
342 平均値算出部
343,348 レジスタ
344,345 引算器
347 相関演算器
349 比較器
35 フレーム生成回路
36 音声復調部
41 スピーカ
42 AGC演算回路
46 RSSI回路
50 DCオフセット補正回路
501 サンプラ
503,504 サンプルホールド回路
505 加算器
506 割り算器
508 変換回路
51,52 補正制御回路
511,62 引算器
512,521 閾値判定部
513,522 ゲート
Claims (4)
- 変調波における周波数または位相の偏差に対応した振幅を有する復調信号を、予め定めるシンボル点でサンプリングし、得られたシンボルデータの振幅値から復調データを再生するにあたって、前記サンプリングタイミングを規定するシンボルクロックを再生するクロック再生回路において、
前記シンボルクロックを発生するタイマと、
前記シンボルクロックよりも高い周波数で前記復調信号をオーバーサンプリングするオーバーサンプリング手段と、
前記オーバーサンプリングによって得られたシンボルデータの内、前記シンボル点と、その前後2点の計3点のシンボルデータについて、シンボル点にて得られるべき理想の振幅レベルとの差分値を演算する演算手段と、
前記シンボル点の前後の測定点の内、前記差分値が小さい方の測定点を選択する選択手段と、
前記タイマに、前記選択手段で選択された測定点側に、前記シンボル点における差分値に対応した時間だけ、次回のシンボル点のサンプリングタイミングを移動させるタイミング補正手段とを含むことを特徴とするクロック再生回路。 - 前記タイマは、同期ワードパターン検出器からのシンボルクロックの検出タイミングでリセットされることを特徴とする請求項1記載のクロック再生回路。
- 前記同期ワードパターン検出器では、前記シンボルクロックの検出によって、送受信周波数のずれに起因するDCオフセットが検出されており、
前記演算手段に入力される前記復調信号から、前記DCオフセットの補正を行う引算器をさらに備えることを特徴とする請求項2記載のクロック再生回路。 - 前記請求項1〜3のいずれか1項に記載のクロック再生回路を用いることを特徴とする受信機。
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