JP5304090B2 - クロック再生回路およびそれを用いる受信機 - Google Patents
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- H04L7/02—Speed or phase control by the received code signals, the signals containing no special synchronisation information
- H04L7/033—Speed or phase control by the received code signals, the signals containing no special synchronisation information using the transitions of the received signal to control the phase of the synchronising-signal-generating means, e.g. using a phase-locked loop
- H04L7/0334—Processing of samples having at least three levels, e.g. soft decisions
Description
3 アンテナ
4,8,12,224 バンドパスフィルタ
5,9,13,40 アンプ
6,10;222,241,242 混合器
7,11;223,243 局部発振回路
14 アナログ/デジタル変換器
15,17,39 デジタル/アナログ変換器
16 スピーカ
21,61 復調回路
22 周波数変換器
221 ハイパスフィルタ
23,25,26,37,45 コンバータ
24 直交変換器
244 移相器
245,246,27,28,38,507 ローパスフィルタ
29 位相検出器
30 周波数検出器
301 加算器
302 遅延器
31 逆Sincフィルタ
32 ルート・レイズド・コサインフィルタ
33 4値FSKシンボル再生回路
330,336−1〜3,502 引算器
331−1〜3,334−1〜3 シフトレジスタ
332 ゲート回路
333 タイマ
335 シンボル判定部
337 セレクタ
338 タイミング補正回路
339 ループフィルタ
34 同期ワードパターン検出回路
340 シンボル比較器
341,346 メモリ
342 平均値算出部
343,348 レジスタ
344,345 引算器
347 相関演算器
349 比較器
35 フレーム生成回路
36 音声復調部
41 スピーカ
42 AGC演算回路
46 RSSI回路
50 DCオフセット補正回路
501 サンプラ
503,504 サンプルホールド回路
505 加算器
506 割り算器
508 変換回路
51,52 補正制御回路
511,62 引算器
512,521 閾値判定部
513,522 ゲート
Claims (4)
- 変調波における周波数または位相の偏差に対応した振幅を有する復調信号を、予め定めるシンボル点でサンプリングし、得られたシンボルデータの振幅値から復調データを再生するにあたって、前記サンプリングタイミングを規定するシンボルクロックを再生するクロック再生回路において、
前記シンボルクロックを発生するタイマと、
前記シンボルクロックよりも高い周波数で前記復調信号をオーバーサンプリングするオーバーサンプリング手段と、
前記オーバーサンプリングによって得られたシンボルデータの内、新しいシンボルデータから古い方へ計3点の第1ないし第3シンボルデータそれぞれについて、前記予め定めるシンボル点にて得られるべき理想の振幅レベルとの差分値をそれぞれ演算する演算手段と、
前記第1シンボルデータに対応する第1差分値および第3シンボルデータに対応する第3差分値において、小さい方の差分値に対応するオーバーサンプリングの測定点を選択する選択手段と、
前記タイマに、前記選択手段で選択された測定点側に、前記第2シンボル点における第2差分値に対応した時間だけ、次回のシンボル点のサンプリングタイミングを移動させるタイミング補正手段とを含むことを特徴とするクロック再生回路。 - 前記タイマは、同期ワードパターン検出器からの同期ワードパターンの検出タイミングでリセットされることを特徴とする請求項1記載のクロック再生回路。
- 前記同期ワードパターン検出器では、前記シンボルクロックの検出によって、送受信周波数のずれに起因するDCオフセットが検出されており、
前記演算手段に入力される前記復調信号から、前記DCオフセットの補正を行う引算器をさらに備えることを特徴とする請求項2記載のクロック再生回路。 - 前記請求項1〜3のいずれか1項に記載のクロック再生回路を用いることを特徴とする受信機。
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US6735260B1 (en) * | 2000-04-17 | 2004-05-11 | Texas Instruments Incorporated | Adaptive data slicer |
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JP2007013620A (ja) | 2005-06-30 | 2007-01-18 | Kenwood Corp | クロック再生装置、クロック再生方法、クロック再生プログラム及び記録媒体 |
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