JP2008058941A5 - - Google Patents
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Claims (10)
- 複数の画素からなる表示パネルにおいて、
前記各画素は、
1H期間の間、ゲートオン電圧を維持するゲートパルスが入力されるゲートラインと、
前記ゲートラインと絶縁された状態で交差し、データ電圧が入力されるデータラインと、
前記ゲートパルス及び前記データ電圧の極性に連動して電圧レベルが変わる第1共通電圧が入力されるメインストレージ電極と、
一定の電圧レベルを維持する第2共通電圧が入力されるサブストレージ電極と、
前記ゲートラインと前記データラインに接続され、前記1H期間の間、前記ゲートパルスに応答して前記データ電圧を出力する薄膜トランジスタと、
前記薄膜トランジスタの第1ドレイン電極に電気的に接続され、前記1H期間の間、前記データ電圧が入力され、前記1H期間が経過した後、前記第1共通電圧によって前記データ電圧より高い電圧をメインピクセル電圧で充電する第1液晶キャパシタと、
前記薄膜トランジスタの第2ドレイン電極に電気的に接続され、前記データ電圧をサブピクセル電圧で充電する第2液晶キャパシタと
を含むことを特徴とする表示パネル。 - 前記第1共通電圧は2つのフレームを1周期にして基準電圧より低い第1電圧と前記基準電圧より高い第2電圧との間でスイングし、
前記第2共通電圧は前記基準電圧と同一の電圧レベルを有することを特徴とする請求項1に記載の表示パネル。 - 前記第1共通電圧は前記ゲートパルスが前記ゲートオン電圧からゲートオフ電圧に下がる第1地点から1フレームが経過された第2地点までの範囲内に存在するある一時点で上昇または下降することを特徴とする請求項2に記載の表示パネル。
- 前記データ電圧の極性が前記第2共通電圧に対して正極性であれば、前記第1共通電圧は前記第1電圧から前記第2電圧に上昇し、前記データ電圧の極性が前記第2共通電圧に対して負極性であれば、前記第1共通電圧は前記第2電圧から前記第1電圧に下降することを特徴とする請求項2に記載の表示パネル。
- 前記メインストレージ電極は前記メイン画素電極とオーバーラップされて前記第1液晶キャパシタと並列接続された第1ストレージキャパシタを形成し、前記サブストレージ電極は前記サブ画素電極とオーバーラップされて前記第2液晶キャパシタと並列接続された第2ストレージキャパシタを形成することを特徴とする請求項1に記載の表示パネル。
- 前記メインピクセル電圧は前記第1共通電圧のシフト時点で昇圧されることを特徴とする請求項5に記載の表示パネル。
- 前記メインピクセル電圧は、
- 前記第1共通電圧の変化量は1V乃至2Vの範囲内に存在することを特徴とする請求項7に記載の表示パネル。
- 複数の画素が具備されたアレイ基板と、
前記アレイ基板と対向して結合し、共通電極が具備された対向基板と、
前記アレイ基板と前記対向基板との間に介在された液晶層とを含み、
前記各画素は、1H期間の間、ゲートオン電圧で維持されるゲートパルスが入力されるゲートラインと、
前記ゲートラインと絶縁された状態で交差し、データ電圧が入力されるデータラインと、
前記ゲートラインと前記データラインに接続され、前記ゲートパルスに応答して前記1H期間の間前記データ電圧を出力する薄膜トランジスタと、
前記ゲートパルス及び前記データ電圧の極性に連動して電圧レベルが変わる第1共通電圧が入力されるメインストレージ電極と、
一定の電圧レベルを維持する第2共通電圧が入力されるサブストレージ電極と、
前記薄膜トランジスタに電気的に接続され、前記1H期間の間前記データ電圧がメインピクセル電圧として入力され、前記メインストレージ電極とオーバーラップされて前記1H期間が経過した後、前記第1共通電圧によって前記データ電圧より高い電圧が前記メインピクセル電圧として入力されるメイン画素電極と、
前記薄膜トランジスタの第2ドレイン電極に電気的に接続され、前記サブストレージ電極とオーバーラップされて前記データ電圧がサブピクセル電圧として入力されるサブ画素電極と
を含むことを特徴とする表示パネル。 - 前記第1共通電圧は2つのフレームを1周期にして基準電圧より低い第1電圧と前記基準電圧より高い第2電圧との間でスイングし、
前記第2共通電圧は前記基準電圧と同一の電圧レベルを有することを特徴とする請求項9に記載の表示パネル。
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