JP2006221501A - アンテナ内蔵半導体メモリモジュール - Google Patents
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Abstract
【解決手段】半導体記憶素子34と、制御用半導体素子32と、半導体記憶素子34および制御用半導体素子32と接続する接続端子、外部機器と接続するための外部接続端子30、外周領域に形成されたループ状のアンテナ16、アンテナ16の形成面とは反対側の面に形成された磁性体層18、および接続端子、外部接続端子30およびアンテナ16をそれぞれ接続する配線が形成された配線基板12と、外装ケース36とを有し、半導体記憶素子34と制御用半導体素子32とは配線基板12に実装され、配線基板12は外部接続端子30が表面に露出する状態で外装ケース36に収納され、半導体記憶素子34および制御用半導体素子32の少なくとも一方がアンテナ16の内側に配設された構成からなる。
【選択図】図1
Description
図1は、本発明の第1の実施の形態にかかるアンテナ内蔵半導体メモリモジュールの一例としてのSDメモリカード10の断面図であり、図2は制御用半導体素子32と半導体記憶素子34とが実装された配線基板12の斜視図である。
図3は、本発明の第2の実施の形態にかかるアンテナ内蔵半導体メモリモジュールの一例としてのSDメモリカード40の断面図である。本実施の形態のSDメモリカード40は、制御用半導体素子32と半導体記憶素子34とが実装され、アンテナ16および磁性体層18が形成された配線基板42と、外部接続端子50が形成された端子基板44とを別々に設けた構成としたことが特徴である。すなわち、配線基板42の接続電極38と端子基板44の基板接続用電極48とを、例えば導電性接着剤52により接着接合した後、外装ケース36により封止することで、本実施の形態のSDメモリカード40が作製される。なお、外形は第1の実施の形態のSDメモリカード10と全く同じである。
図5は、本発明の第3の実施の形態にかかるアンテナ内蔵半導体メモリモジュールの一例としてのSDメモリカード60の断面図である。本実施の形態のSDメモリカード60は、第1の実施の形態のSDメモリカード10の配線基板12に対して、さらに可撓性を有する薄いシート状のアンテナモジュール62を実装し、配線基板56のアンテナ16とアンテナモジュール62のアンテナ66とを直列接続した構成を特徴とする。なお、アンテナモジュール62のアンテナ66の表面には絶縁保護層70を設けているが、取扱い等でアンテナ66の配線パターンを損傷しなければ特に設けなくてもよい。
図9は、本発明の第4の実施の形態にかかるアンテナ内蔵半導体メモリモジュールの一例としてのSDメモリカード100の断面図である。本実施の形態のSDメモリカード100は、第3の実施の形態のSDメモリカード60とほとんど同様な構成であるが、以下の点が異なる。すなわち、配線基板561は端子基板44と同じ形状分だけ図5に示す配線基板56より小さい。また、樹脂基材144の磁性体層18の側に接続電極38が設けられている。そして、この接続電極38が端子基板44の基板接続用電極48に接続される。このような点が異なるが、それ以外についてはSDメモリカード60と同じである。配線基板561の接続電極38と端子基板44の基板接続用電極48とは、例えば導電性接着剤52により接着接続される。これにより、本実施の形態のSDメモリカード100が得られる。
図11は、本発明の第5の実施の形態にかかるアンテナ内蔵半導体メモリモジュールの一例としてのSDメモリカード120の断面図である。本実施の形態のSDメモリカード120は、以下の構成に特徴を有する。第1は、配線基板132に対して制御用半導体素子130と半導体記憶素子126とがそれぞれ異なる面上に実装されていることである。第2は、半導体記憶素子126がメモリ実装基板124の両面に実装されたメモリモジュール122が複数積層して配線基板132上に実装されていることである。
12,42,56,82,132,162,561,821 配線基板
14,46,134,141,142,143,144,145 樹脂基材
16,66,136,166,908 アンテナ
18,68,148 磁性体層
20,144,168 配線形成部
22,24,26,72,138,140,142,170 貫通電極
28,70,146,172 絶縁保護層
30,50,150,174 外部接続端子
32,130,178 制御用半導体素子
34,126,176 半導体記憶素子
36 外装ケース
38 接続電極
44 端子基板
48 基板接続用電極
52 導電性接着剤
54,74,84,86 電極端子
62,88,902 アンテナモジュール
64 シート状基板
122 メモリモジュール
124 メモリ実装基板
128 接合部材
164 磁性基材
201,202,203,204 配線
904 無線制御部
906 接続部
910 フラッシュメモリ
Claims (5)
- 半導体記憶素子と、
前記半導体記憶素子および外部機器との情報の制御を行う制御用半導体素子と、
前記半導体記憶素子および前記制御用半導体素子と接続する接続端子、前記外部機器と接続するための外部接続端子、外周領域に形成されたループ状のアンテナ、前記アンテナの形成面とは反対側の面に形成された磁性体層、および前記接続端子、前記外部接続端子および前記アンテナをそれぞれ接続する配線が形成された配線基板と、
外装ケースとを有し、
前記半導体記憶素子と前記制御用半導体素子とは前記配線基板に実装され、前記配線基板は前記外部接続端子が表面に露出する状態で前記外装ケースに収納され、
前記半導体記憶素子および前記制御用半導体素子の少なくとも一方がループ状の前記アンテナの内側に配設されていることを特徴とするアンテナ内蔵半導体メモリモジュール。 - 半導体記憶素子と、
前記半導体記憶素子および外部機器との情報の制御を行う制御用半導体素子と、
前記外部機器と接続するための外部接続端子および基板接続用電極が形成された端子基板と、
前記半導体記憶素子および前記制御用半導体素子と接続する接続端子、前記端子基板の前記基板接続用電極と接続するための接続電極、外周領域に形成されたループ状のアンテナ、前記アンテナの形成面とは反対側の面に形成された磁性体層、および前記接続端子、前記接続電極および前記アンテナをそれぞれ接続する配線が形成された配線基板と、
外装ケースとを有し、
前記半導体記憶素子と前記制御用半導体素子とは前記配線基板に実装され、かつ前記半導体記憶素子および前記制御用半導体素子の少なくとも一方が前記配線基板のループ状の前記アンテナの内側に配設されており、
前記配線基板の前記接続電極と前記端子基板の前記基板接続電極とを接続して一体化した状態で前記外装ケースに収納され、かつ前記外部接続端子が前記外装ケースから露出していることを特徴とするアンテナ内蔵半導体メモリモジュール。 - 可撓性を有するシート状基板の一方の面の外周領域にループ状のアンテナが形成されたアンテナモジュールをさらに有し、前記アンテナモジュールのアンテナと前記配線基板のアンテナとが直列あるいは並列に接続されていることを特徴とする請求項1または請求項2に記載のアンテナ内蔵半導体メモリモジュール。
- 前記アンテナモジュールは、前記シート状基板のアンテナが形成された面とは反対側の面に磁性体層が形成されたものであることを特徴とする請求項3に記載のアンテナ内蔵半導体メモリモジュール。
- 前記半導体記憶素子は、メモリ実装基板上に複数個実装されてメモリモジュールを構成しており、前記メモリモジュールが前記配線基板上に実装されていることを特徴とする請求項1から請求項4までのいずれかに記載のアンテナ内蔵半導体メモリモジュール。
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