JP2005517997A - データ中継装置、データ中継方法、データ表示システム及びデータシステム - Google Patents

データ中継装置、データ中継方法、データ表示システム及びデータシステム Download PDF

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Abstract

【課題】ソース機器と表示ユニットの間の正確なデータ中継を実現する。
【解決手段】リピータ１９は、制御データを記憶するＥＤＩＤメモリ２７とメモリ制御ユニット９１，９３からなる。メモリ制御ユニット９１，９３は、ＥＤＩＤメモリ８から制御データを読み出すためにＥＤＩＤメモリ８にアクセスし、その読み出された制御データをＥＤＩＤメモリ２７に記憶し、セットトップボックス１によりＥＤＩＤメモリ２７にアクセスがされたとき、ＥＤＩＤメモリ２７に記憶された制御データをセットトップボックス１に伝送する。この場合、メモリ制御ユニット９１，９３は、ＥＤＩＤメモリ８からＥＤＩＤメモリ２７に制御データを記憶する動作が完了するまで、禁止信号をセットトップボックス１に出力し、ＥＤＩＤメモリ２７にアクセスするのを禁止する。

Description

【０００１】
関連出願の相互参照
この出願は、２００２年２月１９日の先行する特願２００２−０４１１６７号日本特許出願からの優先権の利益に基づき主張し、その出願のすべての内容は参考のためここに組み込まれる。
【０００２】
技術分野
本発明は、映像データ及び音声データをソース機器から表示装置に伝送するのに用いられるデータ表示システム、データ中継装置及びデータ中継方法に関する。
【０００３】
背景技術
従来のデータ表示システムは、例えば特許２６３５８３７号（１９９７年７月３０日発行）に開示されている。
【０００４】
この従来のデータ表示システムでは、表示端末の表示属性を示す制御データが、表示端末からソース機器に伝送されることが重要である。
【０００５】
発明の開示
本発明のある観点によれば、表示属性を表す制御データを格納する表示ユニットと、前記表示ユニットにアクセスして前記制御ユニットから前記制御データを読み出し、該読出制御データを第１のメモリに格納し、第１のソース機器により前記第１のメモリへアクセスがなされた時に、前記表示ユニットから前記読出制御データを前記第１のメモリに格納した後に前記第１のメモリに格納された前記読出制御データを前記第１のソース機器に伝送するデータ中継装置とを備えたデータ表示システムが提供される。
【０００６】
本発明の別の観点によれば、表示属性を表す制御データを記憶する表示ユニットと第１のソース機器との間に設けられたデータ中継装置であって、前記表示ユニットの表示属性を表す前記制御データを記憶する第１のメモリと、前記表示ユニットにアクセスすることにより前記制御データを前記表示ユニットから読み出し、前記読出制御データを前記第１のメモリに記憶し、前記第１のソース機器により前記第１のメモリにアクセスがされた場合に、前記表示ユニットから前記第１のメモリへの前記制御データの記憶が完了した後に前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する第１の制御ユニットとを備えたデータ中継装置が提供される。
【０００７】
本発明のさらに別の観点によれば、表示属性を表す制御データを記憶する表示ユニットと第１のソース機器との間のデータを中継するデータ中継方法であって、前記表示ユニットにアクセスして前記表示ユニットから前記制御データを読み出し、第１のメモリに前記読出制御データを記憶し、前記第１のソース機器による前記第１のメモリに対するアクセスに応答して、前記表示ユニットから前記第１のメモリへの前記制御データの記憶の完了の後に前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送するデータ中継方法が提供される。
【０００８】
本発明のさらに別の観点によれば、デジタル信号を出力するソース機器と、表示識別データを記憶するメモリを有し、前記ソース機器により前記メモリにアクセスされた場合に、前記表示識別データを記憶した後に前記メモリに記憶された前記表示識別データを前記ソース機器に伝送するシンク機器を備えたデータシステムが提供される。
【０００９】
本発明のさらに別の観点によれば、表示識別データを記憶するメモリと、ソース機器からのデータを入力し、前記ソース機器により前記メモリにアクセスされた場合に前記表示識別データの記憶の後に前記メモリに記憶された前記表示識別データを前記ソース機器に伝送する制御ユニットを備えたシンク機器が提供される。
【００１０】
本発明のさらに別の観点によれば、メモリにデータを書き込み、前記メモリへの前記データの書き込みの後に、前記メモリからの前記データの読み出しをソース機器に許可するデータ読み出し方法が提供される。
【００１１】
本発明のさらに別の観点によれば、メモリにデータを書き込み、ソース機器が前記メモリから前記データを読み出すことを禁止し、前記メモリへの前記データの書き込みが完了した後に、前記ソース機器による前記メモリからの前記データの読み出しを許可するデータ読み出し方法が提供される。
【００１２】
【発明の実施の形態】
以下、図面を参照して本発明の実施形態を説明する。
【００１３】
本発明の一実施形態に係るデータ表示システムは、ソース機器及び表示装置の間にデータ中継装置（リピータ）を介在させたコンピュータシステムである。
【００１４】
このデータ表示システムでは、データ中継装置はソース機器へ制御データを伝送する。この制御データにより、ソース機器における復号方法が設定される。
【００１５】
図１は本実施形態に係るデータ表示システムの基本構成を説明するための図である。図１は、ＤＶＩ（Digital Video Interactive）規格を採用したグラフィックスホスト及びデジタル表示装置の回路ブロック図である。
【００１６】
ＤＶＩ規格は、グラフィックスホストとデジタル表示ユニットとの間を高速シリアルデジタル伝送を行う規格である。ＤＶＩ規格は、グラフィックスホスト側における符号化方式、デジタル表示ユニット側における復号化方式、トランスミッタＴｘやレシーバＲｘの電気的特性等を規定する。
【００１７】
このＤＶＩ規格はさらに、ディスプレイユニット等のデジタル表示ユニットに記憶されたＥＤＩＤ規格の制御データをグラフィックスホスト側で読み取るための通信制御方式も規定する。
【００１８】
図１に示すデータ表示システムは、セットトップボックス１とテレビジョン受信装置２から構成される。セットトップボックス１は、例えばグラフィックスホストとしての有線放送や衛星放送の受信器等により実現される。テレビジョン受信装置２は、セットトップボックス１からのデータに基づき放送映像を表示する。図１に示すように、セットトップボックス１はソース機器に対応し、テレビジョン受信装置２はシンク機器に対応する。ソース機器はデジタル信号及び音声信号をシンク機器に出力する。
【００１９】
セットトップボックス１のチューナ復号ユニット３から復号されたデジタル映像信号は、トランスミッタ４により高速シリアルデジタル信号に変換される。この変換信号は、デジタル伝送路９を介してテレビジョン受信器２に伝送される。
【００２０】
テレビジョン受信器２内では、レシーバ７が高速シリアルデジタル信号を受信する。このデジタル映像信号は、表示ユニット６に送られる。表示ユニット６は受信したデジタル映像信号に基づき映像を表示する。
【００２１】
ＤＶＩ規格では、ＩＩＣ（フィリップス社提唱の２線式通信規格）通信バス規格が採用されている。セットトップボックス１のマイクロプロセッサ５は、指令信号を生成する。また、マイクロプロセッサ５は、この指令信号に基づき制御データを通信する通信ロジックを有する。
【００２２】
この図１に示すデータ表示システムでは、Ｅ−ＥＤＩＤ（Enhanced Extended Display Identification Data）規格が定義されている。このＥ−ＥＤＩＤ規格は、デジタルディスプレイ等の表示ユニットと、パソコン、デジタルビデオディスクプレーヤ等のソース機器との互換性を保証するための規格である。
【００２３】
この規格に基づいた制御（ＥＤＩＤ）データは、パソコンやデジタルビデオディスクプレーヤ等に接続されるデジタル表示ユニットの表示属性を示すデータとして規定されている。
【００２４】
ＥＤＩＤメモリ８は、表示装置の表示属性を示す制御データを保持する。具体的には、制御データは、映像信号の形態を示すデータ、音声信号の形態を示すデータ等を有する。
【００２５】
映像信号の形態を示すデータは、例えば解像度、映像フレーム周期、画素数、ライン数、信号の形式（ＲＧＢ信号式あるいは輝度・色差信号式）等である。音声信号の形態を示すデータは、例えば音声データのサンプルビット数、サンプリング周波数、スピーカ数に相当するチャネル数等である。
【００２６】
この制御データは、ソース機器側のデコードシステムを設定する際に用いられる。この制御データの値がソース機器で誤って取得された場合、ソース機器は誤動作する。
【００２７】
ＥＤＩＤメモリ８に記憶された制御データは、セットトップボックス１のマイクロプロセッサ５で読み取られる。この制御データに含まれる表示属性データに基づき、チューナ復号部３の映像信号の画角仕様（水平画素数、垂直ライン数等）や、フレーム周波数等の復号パラメータが設定される。
【００２８】
また、この図１に示すデータ表示システムでは、映像信号の記憶を未然に防止すべく、映像信号に対してスクランブル処理が施される。このスクランブル処理を規定した規格として、ＨＤＣＰ（High-band Digital Content Protection）規格がある。
【００２９】
ＨＤＣＰ規格は、グラフィックスホストとデジタル表示ユニットとの間の映像信号のデジタル伝送における、映像信号のスクランブル／デスクランブルや共有鍵配送等を規定する。
【００３０】
ＤＶＩ規格は、映像信号の暗号化／復号化方式として、ＨＤＣＰ規格を推奨する。
【００３１】
ＨＤＣＰ規格に規定された共有鍵の配送については、図１の通信制御バス１０が利用される。
【００３２】
図２は、図１の回路ブロックにＨＤＣＰ規格に準拠したスクランブラとデスクランブラを適用したシステムのブロック図である。図２において、図１と同一の構成には同一符号を付し、詳細な説明は省略する。
【００３３】
セットトップボックス１のチューナ復号ユニット３で復号されたデジタル映像信号は、ＨＤＣＰスクランブラ１１で暗号処理される。この暗号処理データはトランスミッタ４で高速シリアルデジタル信号に変換される。この高速シリアルデジタル信号は、デジタル伝送路９を介してテレビジョン受信装置２に伝送される。
【００３４】
テレビジョン受信装置２では、レシーバ７が高速シリアルデジタル信号を受信する。ＨＤＣＰデスクランブラ１２はこの受信信号を変換し、オリジナルデジタル映像信号として表示ユニット６に伝送する。
【００３５】
ＨＤＣＰスクランブラ１１による暗号処理と、ＨＤＣＰデスクランブラ１２による復号処理に用いられる共有鍵の配送制御は、通信制御バス１０を介して実行される。
【００３６】
このＨＤＣＰ規格は、ソース機器及びデジタル表示装置の間の伝送路上に介在するデータ中継装置としてのリピータと、このリピータに関する機能を規定する。
【００３７】
複数のグラフィックスホストとデジタル表示装置の接続例を図３を用いて説明する。
【００３８】
リピータ１９は、セットトップボックス１と、デジタルビデオディスク（ＤＶＤ）プレーヤ１８の２つのグラフィックスホストとテレビジョン受信装置２との間に配置されている。
【００３９】
ＤＶＤプレーヤ１８は、マイクロプロセッサ１７と、再生ユニット１３と、トランスミッタ１４と、ＨＤＣＰスクランブラ１５からなる。ＤＶＤプレーヤ１８とリピータ１９との間の伝送動作は、セットトップボックス１とリピータ１９との動作とほぼ共通するので詳細な説明は省略する。
【００４０】
リピータ１９では、２つのレシーバ２０及び２１が２つのグラフィックスホストに対応して配置される。レシーバ２０は、セットトップボックス１からの高速シリアルデジタル信号を受信し、レシーバ２１は、ＤＶＤプレーヤ１８からの高速シリアルデジタル信号を受信する。
【００４１】
リピータ１９では、ＨＤＣＰデスクランブラ２４がレシーバ２０により受信された高速シリアルデジタル信号（暗号化された信号）を復号処理し、ＨＤＣＰデスクランブラ２６がレシーバ２１により受信された高速シリアルデジタル信号（暗号化された信号）を復号化処理する。
【００４２】
リピータ１９では、ＨＤＣＰスクランブラ２５が、ＨＤＣＰデスクランブラ２４あるいは２５のいずれか一方で復号処理された映像信号を暗号化処理する。
【００４３】
トランスミッタ２２は、暗号化処理された映像信号を高速シリアルデジタル信号に変換しテレビジョン受信装置２に伝送する。
【００４４】
図３に示すように、図１と同様に、セットトップボックス１はソース機器に対応し、テレビジョン受信装置２は、シンク機器に対応する。リピータ１９は、セットトップボックス１に対するソース機器である一方、リピータ１９はテレビジョン受信装置２に対するシンク機器である。
【００４５】
代替的な実施形態では、チューナ復号ユニット３がリピータ１９に含まれ得る。この場合、ＤＶＤプレーヤ１８とデジタル表示ユニットとの間には、リピータ機能を有するデータ中継装置が配置される構成は上記実施形態と共通する。
【００４６】
この図３に示すデータ表示システムに、前述のＥＤＩＤ規格の制御データを適用する例を以下説明する。
【００４７】
図４は、グラフィックスホストとデジタル表示ユニットとの間のリピータ１９を介在した図３のデータ表示システムにＥＤＩＤデータの処理機能を追加したデータ表示システムのブロック図である。図４において、図３と同一の構成には同一符号を付し、詳細な説明は省略する。
【００４８】
前述したＤＶＩ規格の場合、リピータの定義は無く、リピータがシステムで用いられることは想定されていない。同様に、ＨＤＣＰ規格の場合、ＥＤＩＤ規格の制御データの処理は規定されていない。リピータが用いられる場合、ソース機器及びリピータ間、リピータ及び表示装置間でのデータの送受信の条件を一定に保持し、各構成要素間で正しくデータが伝送されるようにする必要がある。
【００４９】
この課題を解決する方法として、ソース機器及びデジタル表示装置の間に介在するリピータ１９に、デジタル表示ユニットが記憶するＥＤＩＤ規格の制御データを伝送し、ＥＤＩＤ規格の制御データを記憶するためのメモリを設ける手法が考えられる。
【００５０】
この手法では、リピータ１９内のメモリに制御データをバッファリングする。このバッファリングにより、ソース機器側にＥＤＩＤ規格の制御データを伝送する。
【００５１】
図４に示されるリピータ１９には、トランスミッタ２２とレシーバ２０及び２１が設けられる。リピータ１９には、テレビジョン受信装置２のＥＤＩＤメモリ８に記憶されたＥＤＩＤ規格の制御データを記憶するためのＥＤＩＤメモリ２７及び２８がさらに配置される。
【００５２】
リピータ１９では、マイクロプロセッサ２３がテレビジョン受信装置２内のメモリ８からＥＤＩＤ規格の制御データを読み取りＥＤＩＤメモリ２７及び２８に記憶する。
【００５３】
一方、ソース機器側のセットトップボックス１は、ＥＤＩＤメモリ２７にアクセスする。同様に、ソース機器側のＤＶＤプレーヤ１８は、ＥＤＩＤメモリ２８にアクセスする。これにより、テレビジョン受信装置２が記憶するＥＤＩＤ規格の制御データをソース機器が取得することができる。その結果、伝送路上で正しくデータが伝送される。
【００５４】
しかしながら、この図４の構成の場合、各機器の電源がどのような順でオン状態になるかは決定されない。
【００５５】
例えば、マイクロプロセッサ２３がテレビジョン受信装置２のＥＤＩＤメモリ８を読み出しＥＤＩＤメモリ２７に書き込んでいる間、あるいは書込む以前に、セットトップボックス１のマイクロプロセッサ５がＥＤＩＤメモリ２７にアクセスして制御データの読み出しを行う可能性がある。この場合、その読み出しデータは、ＥＤＩＤメモリ８が記憶する値とは異なる可能性がある。
【００５６】
読み出しデータがテレビジョン受信装置２のＥＤＩＤメモリ８の制御データと異なる場合、セットトップボックス１のマイクロプロセッサ５は、表示ユニット６の実際の表示属性に適合しない誤ったパラメータでチューナ復号ユニット３を設定するおそれがある。
【００５７】
この場合、誤った復号信号がテレビジョン受信装置２に伝送される。しかしながら、テレビジョン受信装置２はその復号形式の映像信号を表示することができない。その結果、表示ユニット６の表示イメージは乱れる。
【００５８】
この問題点を解決すべく、図５に示すデータ表示システムが適用される。図５には、図４に示すマイクロプロセッサに、ＥＤＩＤメモリの読み出し及び書込みを制御するメモリ制御ユニットが設けられている。
【００５９】
より具体的には、マイクロプロセッサ５は、ＥＤＩＤメモリ２７を制御するメモリ制御ユニット７１を有する。マイクロプロセッサ１７は、ＥＤＩＤメモリ２８を制御するメモリ制御ユニット８１を有する。マイクロプロセッサ２３は、ＥＤＩＤメモリ２７を制御するメモリ制御ユニット９１と、ＥＤＩＤメモリ２８を制御するメモリ制御ユニット９２と、ＥＤＩＤメモリ８を制御するメモリ制御ユニット９３を有する。
【００６０】
ＥＤＩＤメモリ２７は、２つのメモリ制御ユニット７１及び９１により制御され、これによりマルチマスタが実現される。ＥＤＩＤメモリ２８は、２つのメモリ制御ユニット８１及び９２により制御され、これによりマルチマスタが実現される。
【００６１】
このように、各ＥＤＩＤメモリは、メモリ制御ユニットにより制御される。これにより、リピータ１９内のＥＤＩＤメモリ２７及び２８に対する制御データの書込動作が完了するまでは、このＥＤＩＤメモリ２７及び２８に対するソース機器からのアクセスが禁止される。
【００６２】
この図５に示すデータ表示システムの構成要素間の接続関係の詳細を図６を用いて説明する。
【００６３】
図６に示すように、リピータ１９は、セットトップボックス１、ＤＶＤプレーヤ１８及びテレビジョン受信装置２と、ＤＶＩ規格で規定されたコネクタとケーブルで結合されている。
【００６４】
セットトップボックス１とリピータ１９の間は、ＩＩＣバス３６と、パワーオンライン３０とホットプラグライン３３で接続される。ＩＩＣバス３６は双方向バスである。このＩＩＣバス３６は、マイクロプロセッサ５側のメモリ制御ユニット７１と、マイクロプロセッサ２３側のメモリ制御ユニット９１と、ＥＤＩＤメモリ２７とを接続する。パワーオンライン３０は、セットトップボックス１の状態を示すためにマイクロプロセッサ５とマイクロプロセッサ２３を接続する。ホットプラグライン３３は、リピータ１９の状態を示すためにマイクロプロセッサ５とマイクロプロセッサ２３を接続する。
【００６５】
ＤＶＤプレーヤ１８とリピータ１９の間は、ＩＩＣバス３８と、パワーオンライン３２と、ホットプラグライン３５で接続される。ＩＩＣバス３８は、マイクロプロセッサ１７側のメモリ制御ユニット８１と、マイクロプロセッサ２３側のメモリ制御ユニット９２と、ＥＤＩＤメモリ２８とを接続する。パワーオンライン３２は、ＤＶＤプレーヤ１８の状態を示す為にマイクロプロセッサ１７とマイクロプロセッサ２３を接続する。ホットプラグライン３５は、リピータ１９の状態を示すためにマイクロプロセッサ１７とマイクロプロセッサ２３を接続する。
【００６６】
リピータ１９とテレビジョン受信装置２の間は、ＩＩＣバス３７と、パワーオンライン３１と、ホットプラグライン３４で接続される。ＩＩＣバス３７は、マイクロプロセッサ２３側のメモリ制御ユニット９３とＥＤＩＤメモリ８を接続する。パワーオンライン３１は、リピータ１９の状態を示すためにマイクロプロセッサ２３とＥＤＩＤメモリ８を接続する。ホットプラグライン３４は、テレビジョン受信装置２の状態を示すためにマイクロプロセッサ２３とＥＤＩＤメモリ８を接続する。
【００６７】
セットトップボックス１、ＤＶＤプレーヤ１８、リピータ１９及びテレビジョン受信装置２の接続関係は上述した例に限定されない。上述した接続関係では、テレビジョン受信装置２のパワーオンライン３１は、ホットプラグライン３４と接続される。また、これらパワーオンライン３１及びホットプラグライン３４は、ＥＤＩＤメモリ８に接続される。ＥＤＩＤメモリ８にはテレビジョン受信装置２の表示属性情報を含むＥＤＩＤデータが記憶される。
【００６８】
マイクロプロセッサ５、１７及び２３の各々は、システムの状態検出や状態制御を司る回路ブロックである。
【００６９】
次に、図６のデータ表示システムの動作を図７のタイムチャートを用いて説明する。図７は、セットトップボックス１及びリピータ１９間の、リピータ１９及びテレビジョン受信装置２間の信号の送受信状態を示す。
【００７０】
まず、タイミングＡで、セットトップボックス１の電源がオンになる。これにより、パワーオンライン３０がアクティブとなる。
【００７１】
リピータ１９のマイクロプロセッサ２３は、セットトップボックス１の電源の状態を検出し、テレビジョン受信装置２側のパワーオンライン３１を、タイミングＡから時間Ｔ１経過後のタイミングＢでアクティブとする。
【００７２】
これにより、テレビジョン受信装置２のＥＤＩＤメモリ８の電源がリピータ１９側から供給される。この電源供給と同時に、ホットプラグライン３４を経由してＥＤＩＤメモリ８の電源の状態がリピータ１９のマイクロプロセッサ２３に伝送される。さらにこのタイミングＢに、マイクロプロセッサ２３はセットトップボックス１にリピータ１９の状態を知らしめるホットプラグライン３３を非アクティブに保持する。この状態において、マイクロプロセッサ２３のメモリ制御ユニット９３はＥＤＩＤメモリ８のデータ読み出しを開始する。
【００７３】
同じマイクロプロセッサ２３内のメモリ制御ユニット９１は、タイミングＢから時間Ｔ２の間に、メモリ制御ユニット９３が読み出したＥＤＩＤメモリ８の制御データをＥＤＩＤメモリ２７に記憶する処理を行う。この記憶処理の間、セットトップボックス１側のマイクロプロセッサ５は、ホットプラグライン３３の非アクティブ状態を検出している。従って、マイクロプロセッサ５は、ＥＤＩＤメモリ２７へのアクセスを停止するとともに、チューナ復号ユニット３への復号表示パラメータの設定動作や高速デジタル伝送動作等を停止状態に制御する。
【００７４】
ＥＤＩＤ制御データのＥＤＩＤメモリ２７への記憶処理が終了すると、マイクロプロセッサ２３は、セットトップボックス１にこの記憶処理が終了したことを知らしめるため、タイミングＣでホットプラグライン３３をアクティブにする。
【００７５】
ホットプラグライン３３がアクティブになったことにより、セットトップボックス１のマイクロプロセッサ５は、受信側の受信準備ができたと判定できる。
【００７６】
このタイミングＣ以降は、ＤＶＩ規格、ＥＤＩＤ規格及びＨＤＣＰ規格に基づいたデータ伝送が実行される。
【００７７】
さらに、マイクロプロセッサ５のメモリ制御ユニット７１は、ＥＤＩＤメモリ２７にアクセスし、ＥＤＩＤ制御データを取得する。マイクロプロセッサ５は、このＥＤＩＤ制御データに基づきチューナ復号ユニット３を制御する。
【００７８】
この実施形態では、ＥＤＩＤメモリ８から読み出されたＥＤＩＤ制御データのＥＤＩＤメモリ２７への記憶処理が行われている時間Ｔ２の間、セットトップボックス１のマイクロプロセッサ５（メモリ制御ユニット８１）は、リピータ１９のＥＤＩＤメモリ２７へのアクセスが禁止されている。
【００７９】
次に、２つのグラフィックスホストからのデジタル信号が順次伝送可能な状態になる場合の動作を図８を用いて説明する。図８は、ＤＶＤプレーヤ１８及びリピータ１９間、リピータ１９及びテレビジョン受信装置２の間の信号の送受信状態を示すタイムチャートである。
【００８０】
図８では、まずセットトップボックス１からのデジタル信号がリピータ１９を介してテレビジョン受信装置２に伝送されている。次に、ＤＶＤプレーヤ１８からのデジタル信号がリピータ１９を介してテレビジョン受信装置２で受信可能な状態になる。
【００８１】
図８に示すように、ＤＶＤプレーヤ１８がリピータ１９に接続された状態で電源をオンにする等により、パワーオンライン３２がタイミングＡでアクティブになる。リピータ１９のマイクロプロセッサ２３は、このラインのアクティブ状態を検出する。マイクロプロセッサ２３は、このアクティブ状態の検出から所定の時間経過したタイミングＤに、テレビジョン受信装置２へのパワーオンライン３１を非アクティブにする。このパワーオンライン３１の非アクティブへの変更を受けるとほぼ同時に、ホットプラグライン３４も非アクティブにされる。このホットプラグライン３４の状態により、マイクロプロセッサ２３は、テレビジョン受信装置２がリセットされたことを検出できる。これにより、セットトップボックス１からテレビジョン受信装置２へのデータ伝送が中断される。
【００８２】
マイクロプロセッサ２３は、タイミングＤから所定時間経過したタイミングＢに、パワーオンライン３１をアクティブにする。これにより、ＥＤＩＤメモリ８の電源がリピータ１９側から供給される。マイクロプロセッサ２３のメモリ制御ユニット９３は、タイミングＢから時間Ｔ３の間、ＥＤＩＤメモリ８の制御データを読み出す。また、同じマイクロプロセッサ２３内のメモリ制御ユニット９２は、この時間Ｔ３の間、読み出された制御データをリピータ１９側のＥＤＩＤメモリ２８に記憶する処理を行う。
【００８３】
この時間Ｔ３の間は、ＤＶＤプレーヤ１８のマイクロプロセッサ１７はホットプラグライン３５の状態が非アクティブであることを検出する。従って、マイクロプロセッサ１７のメモリ制御ユニット８１は、ＥＤＩＤメモリ２８へのアクセスを停止する。
【００８４】
ＥＤＩＤ制御データのＥＤＩＤメモリ２８への記憶処理が終了すると、リピータ１９のマイクロプロセッサ２３は、ＤＶＤプレーヤ１８にこの記憶処理が終了したことを知らしめるため、タイミングＣでホットプラグライン３５をアクティブにする。ホットプラグライン３５がアクティブになると、ＤＶＤプレーヤ１８のマイクロプロセッサ１７は、受信側の受信準備ができたと判定できる。
【００８５】
ＤＶＤプレーヤ１７内のマイクロプロセッサ１７のメモリ制御ユニット８１は、ＥＤＩＤメモリ２８にアクセスし、ＥＤＩＤ制御データを取得する。マイクロプロセッサ１７は、このＥＤＩＤ制御データに基づき再生ユニット１３を制御する。
【００８６】
この図８の例では、時間Ｔ３の間、マイクロプロセッサ１７は、リピータ１９のＥＤＩＤメモリ１８へのアクセスが禁止される。
【００８７】
図９はリピータ１９の構成の詳細を示す回路ブロック図の一例である。図９は、説明の便宜のため、リピータ１９とＤＶＤプレーヤ１８との間の接続関係は省略して示している。以下、図９に示すリピータ１９の機能を、リピータ１９内のＥＤＩＤメモリ２７からセットトップボックス１のマイクロプロセッサ５が読み出す場合を例に説明する。より具体的には、マイクロプロセッサ５とＥＤＩＤメモリ２７の間の制御データを通信するシリアルリンクを用いた通信を、リピータ１９のマイクロプロセッサ２３がＥＤＩＤメモリ２７への制御データ書込み時間中に停止する。
【００８８】
制御データを通信するシリアルリンクは、ＩＩＣバス規格に基づく通信バスである。このシリアルリンクは、ＩＩＣバス３６のシリアル伝送用クロックライン３６ＣＬとＩＩＣバス３６のシリアルデータライン３６ＤＴの２本の通信路からなる。
【００８９】
この規格では、クロック発生側がマスターとして機能し、他の機器がスレーブとして機能する。マスターは、スレーブに対して書き込み又は読み出しを行う。
【００９０】
ＩＩＣバス３６のクロックライン３６ＣＬやシリアルデータライン３６ＤＴは、マスターとスレーブの双方がオープンドレイン状態で駆動する。マスターとスレーブの双方が非駆動となった場合のみ、論理レベルがＨ（ハイ）レベルとなるように抵抗値が設定される。
【００９１】
マスターがスレーブに対してあるアドレスを指定した場合、スレーブ側がアクノウレジを生成する場合を想定する。この場合、スレーブ側から正常なアクノウレジが発行されなければ、次の書込みや読み出しの状態に移らない。
【００９２】
動作速度の遅い機器の場合、クロックの立ち上がりと立ち下がりの間の間の時間を標準の速度よりも遅らせて通信することができる。この時間を利用することにより、シリアルデータライン３６ＤＴの通信動作を停止することができる。
【００９３】
トランジスタ５１及び５２は、スイッチング素子として機能する。マスターとスレーブの双方を非導通とする方法は、トランジスタ５１及び５２のスイッチをオフにすればよい。具体的には、マイクロプロセッサ２３の端子６３及び６４がＬ（ロー）レベルに設定される。
【００９４】
このように、トランジスタ５１及び５２を非導通とすることにより、スレーブはマスターの要求に対して何ら応答しない。その結果、マスターは待機状態となる。この場合、スレーブがリピータ１９のマイクロプロセッサ２３に、マスターがセットトップボックス１のマイクロプロセッサ５に対応する。
【００９５】
ＩＩＣバス３６が非導通の間、リピータ１９のマイクロプロセッサ２３はＥＤＩＤメモリ８から制御データを読み出す。この制御データの読み出しは、ＩＩＣバス３７のクロックライン３７ＣＬとシリアルデータライン３７ＤＴのシリアルリンクを介して実行される。マイクロプロセッサ２３は、読み出した制御データを端子６１及び６２を介してＩＩＣバス規格に基づきＥＤＩＤメモリ２７に書き込む。
【００９６】
この書込み動作が終了すると、マイクロプロセッサ２３は端子６１及び６２をオープンに設定する。次に、マイクロプロセッサ２３は端子６３及び６４のレベルをＨレベルにする。これにより、トランジスタ５１及び５２のスイッチがオンになり、ＩＩＣバス３５のクロックライン３６ＣＬとシリアルデータライン３６が導通する。その結果、ＥＤＩＤメモリ２７からの制御データの読み出しが可能となる。
【００９７】
マイクロプロセッサ２３の端子６５をＨレベルにすれば、トランジスタ５３のスイッチがオンになる。これにより、ＩＩＣバス３６のＣＬがＬレベルに設定される。これにより、マスターとスレーブの通信を確実に停止することができる。すなわち、マスターとしてのセットトップボックス１のマイクロプロセッサ５のスレーブとしてのリピータ１９側にあるＥＤＩＤメモリ２７に対するアクセスが禁止される。
【００９８】
この場合、メモリ制御ユニットの機能は、マイクロプロセッサ２３に組み込まれたプログラムあるいは回路と、マイクロプロセッサ２３に設けられた各端子とスイッチングトランジスタ等の構成要素により実現される。
【００９９】
このように、マスターとスレーブの間の導通を制御するスイッチング素子をＩＩＣバスに設け、かつこのスイッチング素子のスイッチングを制御する機能をスレーブ側に設ける。これにより、マスターによるスレーブ側のメモリへのアクセスを禁止することができる。なお、スイッチング素子としてトランジスタを用いる場合を示したが、これに限定されない。他のスイッチング素子を用いてもよい。
【０１００】
また、メモリ制御ユニットの機能は、これらトランジスタや端子、プログラムの組合せにより実現される場合に限定されない。例えば、マイクロプロセッサ２３がＥＤＩＤメモリ２７に書込みを禁止する書込み禁止信号を出力し、この書込み禁止信号に基づきＥＤＩＤメモリ２７への書込みが禁止されるように制御してもよい。その他、メモリ制御ユニットを実現する構成は、ハードウェア、ソフトウェア、ファームウェアのいずれか単独の構成で実現されてもよいし、これらの組合せにより実現されてもよい。
【０１０１】
前述の図１〜図９の例では、グラフィックスホストとしてのセットトップボックス１やＤＶＤプレーヤ１８とテレビジョン受信装置２との間に、データ中継装置としてのリピータ１９が１つのみ配置されるが、これに限定されない。複数のデータ中継装置をグラフィックスホストと受信器側に配置してもよい。
【０１０２】
図１０は、多段構成のリピータを配置したデータ表示システムのブロック図である。図１０において、図２〜図９に示した構成と同一の構成には同一符号を付し、詳細な説明は省略する。
【０１０３】
セットトップボックス１とテレビジョン受信装置２の間には、３つのリピータ１９ａ、１９ｂ及び１９ｃが配置されており、これらを接続する。これらリピータは、マイクロプロセッサとＥＤＩＤメモリを有する機器であれば、例えばＤＶＤプレーヤ、ＶＴＲ、テレビジョン受信装置など、いかなる機器でもよい。
【０１０４】
セットトップボックス１はリピータ１９ａに対するソース機器である。リピータ１９ａはセットトップボックス１に対するシンク機器である一方、リピータ１９ｂに対するソース機器である。リピータ１９ｂはリピータ１９ａに対するシンク機器である一方、リピータ１９ｃに対するソース機器である。リピータ１９ｃはリピータ１９ｂに対するシンク機器である一方、テレビジョン受信装置２に対するソース機器である。
【０１０５】
リピータ１９ａは、マイクロプロセッサ２３ａとＥＤＩＤメモリ２７ａを有する。マイクロプロセッサ２３ａは、メモリ制御ユニット１０２ａ及び１０３ａを有する。
【０１０６】
リピータ１９ｂは、マイクロプロセッサ２３ｂとＥＤＩＤメモリ２７ｂを有する。マイクロプロセッサ２３ｂは、メモリ制御ユニット１０２ｂ及び１０３ｂを有する。
【０１０７】
リピータ１９ｃは、マイクロプロセッサ２３ｃとＥＤＩＤメモリ２７ｃを有する。マイクロプロセッサ２３ｃは、メモリ制御ユニット１０２ｃ及び１０３ｃを有する。
【０１０８】
セットトップボックス１のマイクロプロセッサ５は、メモリ制御ユニット７１を有する。
【０１０９】
セットトップボックス１とリピータ１９ａは、ＩＩＣバス３６ａ、パワーオンライン３０ａ及びホットプラグライン３３ａにより接続される。ＩＩＣバス３６ａは、メモリ制御ユニット７１とメモリ制御ユニット１０２ａと、ＥＤＩＤメモリ２７ａを接続する。パワーオンライン３０ａは、セットトップボックス１の状態を示すため、マイクロプロセッサ５と２３ａを接続する。ホットプラグライン３３ａは、リピータ１９ａの状態を示すためにマイクロプロセッサ５と２３ａを接続する。
【０１１０】
リピータ１９ａと１９ｂは、ＩＩＣバス３６ｂ、パワーオンライン３０ｂ及びホットプラグライン３３ｂにより接続される。ＩＩＣバス３６ｂは、メモリ制御ユニット１０３ａとＥＤＩＤメモリ２７ｂを接続する。メモリ制御ユニット１０３ｂとＥＤＩＤメモリ２７ｂはバス３６ｂ’により接続される。代替的には、ＩＩＣバス３６ｂがメモリ制御ユニット１０３ａ、１０２ｂ及びＥＤＩＤメモリ２７ｂを接続してもよい。パワーオンライン３０ｂは、リピータ１９ａの状態を示すため、マイクロプロセッサ２３ａと２３ｂを接続する。ホットプラグライン３３ｂは、リピータ１９ｂの状態を示すためにマイクロプロセッサ２３ａと２３ｂを接続する。
【０１１１】
リピータ１９ｂと１９ｃは、ＩＩＣバス３６ｃ、パワーオンライン３０ｃ及びホットプラグライン３３ｃにより接続される。ＩＩＣバス３６ｃは、メモリ制御ユニット１０３ｂとＥＤＩＤメモリ２７ｃを接続する。メモリ制御ユニット１０３ｃとＥＤＩＤメモリ２７ｃはバス３６ｃ’により接続される。代替的には、ＩＩＣバス３６ｃがメモリ制御ユニット１０３ｂ、１０２ｃ及びＥＤＩＤメモリ２７ｃを接続してもよい。パワーオンライン３０ｃは、リピータ１９ｂの状態を示すため、マイクロプロセッサ２３ｂと２３ｃを接続する。ホットプラグライン３３ｃは、リピータ１９ｃの状態を示すためにマイクロプロセッサ２３ｂと２３ｃを接続する。
【０１１２】
リピータ１９ｃとテレビジョン受信装置２は、ＩＩＣバス３６ｄ、パワーオンライン３１ｄ及びホットプラグライン３３ｄにより接続される。ＩＩＣバス３６ｄは、メモリ制御ユニット１０３ｃとＥＤＩＤメモリ８を接続する。パワーオンライン３１ｄは、リピータ１９ｃの状態を示すためマイクロプロセッサ２３ｃとＥＤＩＤメモリ８を接続する。ホットプラグライン３３ｄは、テレビジョン受信装置２の状態を示すためにマイクロプロセッサ２３ｃとＥＤＩＤメモリ８を接続する。
【０１１３】
図６の例と同様に、ＥＤＩＤメモリ８にはテレビジョン受信装置２の表示属性情報を含むＥＤＩＤデータが記憶される。
【０１１４】
ＥＤＩＤメモリ８に記憶された制御データは、マイクロプロセッサ２３ｃを経由してＥＤＩＤメモリ２７ｃに記憶される。この制御データの記憶が完了するまで、マイクロプロセッサ２３ｃは、ホットプラグライン３３ｃを介して、マイクロプロセッサ２３ｂからのＥＤＩＤメモリ２７ｃの制御データへのアクセスを禁止するためのアクセス禁止信号をマイクロプロセッサ２３ｂに出力し、これによりマイクロプロセッサ２３ｂがＥＤＩＤメモリ２７ｃの制御データへアクセスできないようにする。
【０１１５】
マイクロプロセッサ２３ｃによるこのアクセス禁止信号の出力が停止した後、リピータ１９ｂのマイクロプロセッサ２３ｂは、ＥＤＩＤメモリ２７ｂの制御データへのアクセスを開始する。これにより、ＩＩＣバス３６ｃを経由して、制御データが伝送される。マイクロプロセッサ２３ｂのメモリ制御ユニット１０２ｂは、伝送された制御データをＥＤＩＤメモリ２７ｂに書き込む。この制御データのＥＤＩＤメモリ２７ｂへの書込みが完了するまで、マイクロプロセッサ２３ｂはホットプラグライン３３ｂを介してマイクロプロセッサ２３ａにアクセス禁止信号を出力し、これにより、マイクロプロセッサ２３ａによりＥＤＩＤメモリ２７ｂに記憶された制御データへのアクセスができないようにする。
【０１１６】
マイクロプロセッサ２３ｂがアクセス禁止信号の出力を停止した後、マイクロプロセッサ２３ａはＥＤＩＤメモリ２７ｂの制御データへのアクセスを開始する。これにより、ＩＩＣバス３６ｂを経由して、制御データが伝送される。マイクロプロセッサ２３ａのメモリ制御ユニット１０２ａは、伝送された制御データをＥＤＩＤメモリ２７ａに書き込む。この制御データのＥＤＩＤメモリ２７ａへの書込みが完了するまで、マイクロプロセッサ２３ａはホットプラグライン３３ａを介してセットトップボックス１のマイクロプロセッサ５にアクセス禁止信号を出力する。この禁止信号は、マイクロプロセッサ５からのＥＤＩＤメモリ２７ａに記憶された制御データへのアクセスを禁止するための信号である。
【０１１７】
マイクロプロセッサ２３ａがアクセス禁止信号の出力を停止した後、セットトップボックス１のマイクロプロセッサ５は、ＥＤＩＤメモリ２７ａの制御データへのアクセスを開始する。これにより、ＩＩＣバス３６ａを経由して制御データがマイクロプロセッサ５に伝送される。
【０１１８】
マイクロプロセッサ５は、ＥＤＩＤメモリ２７ａへのアクセスにより取得した制御データに基づき、図１０には図示しないチューナ復号ユニット３の復号方法を設定する。
【０１１９】
以上により、セットトップボックス１によるテレビジョン受信装置２側の制御データの読み出し及び復号方法の設定が完了する。設定が完了した後、セットトップボックス１からリピータ１９ａ〜１９ｃを経由したテレビジョン受信装置２へのＤＶＩ規格、ＥＤＩＤ規格及びＨＤＣＰ規格に基づいたデータ伝送が実行される。
【０１２０】
この図１０の例でも、次段におけるマイクロプロセッサ５，２３ａ〜２３ｃからの前段におけるＥＤＩＤメモリ２７ａ〜２７ｃの制御データへのアクセスは、ＥＤＩＤメモリ２７ａ〜２７ｃへの制御データの記憶が完了するまで禁止される。
【０１２１】
従って、テレビジョン受信装置２のＥＤＩＤメモリ８に記憶された制御データは、各リピータでの記憶の途中で伝送されることなく、正確にセットトップボックス１に伝送される。
【０１２２】
図１０の例では、３つのリピータを配置したが、これに限定されない。リピータの数はグラフィックスホストとテレビジョン受信装置との間にいくつ配置されていてもよい。
【０１２３】
各リピータは、制御データの記憶中は、自身に内蔵されたメモリに対するアクセスを禁止する。これにより、誤った値の制御データがソース機器側のデコーダに伝送されることがない。ソース機器側のデコーダは、正しい値の制御データのみでデジタル信号のデコードを実行することができる。従って、デコーダが誤動作しない。
【０１２４】
このように本実施形態によれば、ソース機器であるセットトップボックスやＤＶＤプレーヤが、テレビジョン受信装置の表示属性に不適合な誤った設定でデータをデコードすることが無い。
【図面の簡単な説明】
【図１】 本発明の一実施形態に係るデータ表示システムの基本構成を説明するための図。
【図２】 同実施形態に係る図１の回路ブロックにＨＤＣＰ規格に準拠したスクランブラとデスクランブラを適用したシステムのブロック図。
【図３】 同実施形態に係る複数のグラフィックスホストのデジタル表示ユニットへの接続例を示す図。
【図４】 同実施形態に係るグラフィックスホストとデジタル表示ユニットとの間にリピータを介在した図３のデータ表示システムにＥＤＩＤデータの処理機能を追加したデータ表示システムのブロック図。
【図５】 同実施形態に係る図４に示すマイクロプロセッサに、メモリ制御ユニットを配置したデジタル表示システムを示す図。
【図６】 同実施形態に係る図５に示すデータ表示システムの接続関係の詳細を説明するための図。
【図７】 同実施形態に係る図６のデータ表示システムの動作を説明するためのタイムチャート。
【図８】 同実施形態に係る２つのグラフィックスホストからのデジタル信号が順次伝送可能な状態になる場合の図６のデータ表示システムの動作を説明するためのタイムチャート。
【図９】 同実施形態に係るリピータの構成の詳細を示す回路ブロック図。
【図１０】 同実施形態に係る多段構成のリピータを配置したデータ表示システムのブロック図。

Claims (27)

  1. 表示属性を表す制御データを格納する表示ユニットと、
    前記表示ユニットにアクセスして前記制御ユニットから前記制御データを読み出し、該読出制御データを第１のメモリに格納し、第１のソース機器により前記第１のメモリへアクセスがなされた時に、前記表示ユニットから前記読出制御データを前記第１のメモリに格納した後に前記第１のメモリに格納された前記読出制御データを前記第１のソース機器に伝送するデータ中継装置と
    を備えたデータ表示システム。
  2. 前記データ中継装置は、前記表示ユニットからの前記第１のメモリへの前記読出制御データの記憶が完了するまでは、前記第１のメモリに対するアクセスを禁止する禁止信号を前記第１のソース機器に出力する請求項１に記載のデータ表示システム。
  3. 前記第１のソース機器と前記表示ユニットの間には、前記データ中継装置が多段接続されてなる請求項１に記載のデータ表示システム。
  4. 前記表示ユニットから前記データ中継装置に前記表示ユニットに記憶された前記制御データを伝送する第１のデータバスと、
    前記データ中継装置の前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する第２のデータバスと
    をさらに備えた請求項１に記載のデータ表示システム。
  5. 前記表示ユニットから前記データ中継装置に前記表示ユニットに記憶された前記制御データを伝送する第１のデータバスと、
    前記第１のソース機器に前記データ中継装置の前記第１のメモリに記憶された前記読出制御データを伝送する第２のデータバスとをさらに備え、
    前記データ中継装置は、前記第１のメモリに対する前記データ中継装置によるアクセスの有無に応じて前記第２のデータバスの導通／非導通を制御し、前記第２のデータバスに接続される端子を有する請求項１に記載のデータ表示システム。
  6. 前記表示ユニットに記憶された前記制御データを前記データ中継装置に伝送する第１のシリアルリンクと、
    前記データ中継装置の前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する第２のシリアルリンクとをさらに備え、
    前記データ中継装置は、前記第１のメモリに対する前記データ中継装置によるアクセスの有無に応じて前記第２のシリアルリンクの導通／非導通を制御し、前記第２のシリアルリンクに接続される端子と、前記第２のシリアルリンクのオンオフ制御を行うスイッチング素子を有する請求項１に記載のデータ表示システム。
  7. 前記データ中継装置と前記第１のソース機器を接続し、前記データ中継装置のアクティブ／非アクティブ状態を示すホットプラグラインをさらに備え、前記データ中継装置は、前記ホットプラグラインが前記非アクティブ状態のときに前記第１のソース機器に前記禁止信号を出力する請求項２に記載のデータ表示システム。
  8. 前記第１のソース機器に設けられ、前記データ中継装置の前記第１のメモリにアクセスし、そこに格納された前記読出制御データを取得する制御ユニットをさらに備える請求項１に記載のデータ表示システム。
  9. 前記読出制御データに基づき第２のデジタル信号を符号化し、第２のシリアルデジタル信号を出力する第２のソース機器と、
    前記データ中継装置に設けられ、前記表示ユニットから伝送された前記制御データを記憶する第２のメモリと、
    前記データ中継装置に設けられ、前記表示ユニットにアクセスして、前記表示ユニットから取得した前記制御データを前記第２のメモリに記憶し、前記第２のソース機器からの前記第２のメモリに対するアクセスがあった場合に、前記表示ユニットからの前記制御データの前記第２のメモリへの記憶が完了した後に前記第２のメモリに記憶した前記制御データを前記第２のソース機器に伝送する制御ユニットと
    をさらに備える請求項１に記載のデータ表示システム。
  10. 前記データ中継装置は、前記第１のソース機器から前記表示ユニットへのデータ中継の間に前記第２のソース機器の電源状態がアクティブになったことを検知すると、前記表示ユニットへの前記第１のソース機器からのデータ伝送をリセットし、前記制御ユニットの動作を開始する請求項９に記載のデータ表示システム。
  11. 前記第１のソース機器は、前記読出制御データに基づき第１のデジタル信号を符号化してシリアルデジタル信号を出力し、前記データ中継装置は、前記第１のソース機器から前記表示ユニットへ前記シリアルデジタル信号を中継する請求項１に記載のデータ表示システム。
  12. 表示属性を表す制御データを記憶する表示ユニットと第１のソース機器との間に設けられたデータ中継装置であって、
    前記表示ユニットの表示属性を表す前記制御データを記憶する第１のメモリと、
    前記表示ユニットにアクセスすることにより前記制御データを前記表示ユニットから読み出し、前記読出制御データを前記第１のメモリに記憶し、前記第１のソース機器により前記第１のメモリにアクセスがされた場合に、前記表示ユニットから前記第１のメモリへの前記制御データの記憶が完了した後に前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する第１の制御ユニットと
    を備えたデータ中継装置。
  13. 前記第１の制御ユニットは、前記表示ユニットからの前記制御データの前記第１のメモリへの記憶が完了するまでは、前記第１のメモリに対するアクセスを禁止する禁止信号を前記第１のソース機器に出力する請求項１２に記載のデータ中継装置。
  14. 前記表示ユニットから前記データ中継装置に前記制御データを伝送する第１のデータバスと、
    前記データ中継装置の前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する第２のデータバスと
    をさらに備えた請求項１２に記載のデータ中継装置。
  15. 前記表示ユニットから前記第１のメモリに前記制御データを伝送する第１のデータバスと、
    前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する第２のデータバスとをさらに備え、
    前記第１の制御ユニットは、前記第１のメモリに対する前記第１の制御ユニットによるアクセスの有無に応じて前記第２のデータバスの導通／非導通を制御し、前記第２のデータバスに接続される端子を有する請求項１２に記載のデータ中継装置。
  16. 前記制御データを前記表示ユニットから前記第１のメモリに伝送する第１のシリアルリンクと、
    前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する第２のシリアルリンクとをさらに備え、
    前記第１の制御ユニットは、前記第１のメモリに対する前記第１の制御ユニットによるアクセスの有無に応じて前記第２のシリアルリンクの導通／非導通を制御し、前記第２のシリアルリンクに接続される端子と、前記第２のシリアルリンクのオンオフ制御を行うスイッチング素子を有する
    請求項１２に記載のデータ中継装置。
  17. 前記第１のソース機器に接続され、前記第１のメモリへのアクセスの有無を示すホットプラグラインとをさらに備え、前記禁止信号は、前記ホットプラグラインにより前記第１のソース機器に出力される請求項１３に記載のデータ中継装置。
  18. 表示属性を表す制御データを記憶する表示ユニットと第１のソース機器との間のデータを中継するデータ中継方法であって、
    前記表示ユニットにアクセスして前記表示ユニットから前記制御データを読み出し、
    第１のメモリに前記読出制御データを記憶し、
    前記第１のソース機器による前記第１のメモリに対するアクセスに応答して、前記表示ユニットから前記第１のメモリへの前記制御データの記憶の完了の後に前記第１のメモリに記憶された前記読出制御データを前記第１のソース機器に伝送する
    データ中継方法。
  19. 前記方法はさらに、
    前記表示ユニットからの前記制御データの取得の前に、前記第１のソース機器の電源状態を検出し、
    前記検出の後、前記表示ユニットがアクティブ状態であることを知らせる信号を出力する請求項１８に記載のデータ中継方法。
  20. 前記方法はさらに、
    前記第１のソース機器から前記表示ユニットへのデータ中継の間に第２のソース機器の電源状態がアクティブになったことを検知すると、前記表示ユニットへの前記第１のソース機器からのデータ伝送をリセットし、
    前記リセットの後、前記表示ユニットにアクセスして前記制御データを取得し、
    前記制御データを第２のメモリに記憶し、
    前記表示ユニットから前記第２のメモリへの前記制御データの記憶が完了した後に、前記第２のソース機器からの前記第２のメモリに対するアクセスに応答して前記第２のメモリに記憶した前記制御データを伝送する
    請求項１８に記載のデータ中継方法。
  21. 前記第１のソース機器による前記第１のメモリへのアクセスは、前記第１のメモリと第１のソース機器を接続するシリアルリンクを非導通にすることにより禁止される請求項１９に記載のデータ中継方法。
  22. デジタル信号を出力するソース機器と、
    表示識別データを記憶するメモリを有し、前記ソース機器により前記メモリにアクセスされた場合に、前記表示識別データを記憶した後に前記メモリに記憶された前記表示識別データを前記ソース機器に伝送するシンク機器
    を備えたデータシステム。
  23. 表示識別データを記憶するメモリと、
    ソース機器からのデータを入力し、前記ソース機器により前記メモリにアクセスされた場合に前記表示識別データの記憶の後に前記メモリに記憶された前記表示識別データを前記ソース機器に伝送する制御ユニット
    を備えたシンク機器。
  24. メモリにデータを書き込み、
    前記メモリへの前記データの書き込みの後に、前記メモリからの前記データの読み出しをソース機器に許可する
    データ読み出し方法。
  25. 前記データの前記ソース機器による読み出しの許可には、前記ソース機器に接続されたホットプラグラインが用いられる請求項２４に記載のデータ読み出し方法。
  26. メモリにデータを書き込み、
    ソース機器が前記メモリから前記データを読み出すことを禁止し、
    前記メモリへの前記データの書き込みが完了した後に、前記ソース機器による前記メモリからの前記データの読み出しを許可する
    データ読み出し方法。
  27. 前記ソース機器による前記データの読み出しの禁止と、前記ソース機器による前記データの読み出しの許可には、前記ソース機器に接続されたホットプラグラインが用いられる請求項２６に記載のデータ読み出し方法。
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