JP2003124262A - 半導体装置の製造方法 - Google Patents
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Links
- 239000004065 semiconductor Substances 0.000 title claims abstract description 61
- 238000004519 manufacturing process Methods 0.000 title claims description 28
- 239000000758 substrate Substances 0.000 claims abstract description 88
- 239000010931 gold Substances 0.000 claims description 30
- 238000000034 method Methods 0.000 claims description 21
- 239000010409 thin film Substances 0.000 claims description 15
- 239000011347 resin Substances 0.000 claims description 9
- 229920005989 resin Polymers 0.000 claims description 9
- 239000012212 insulator Substances 0.000 claims description 6
- 238000010438 heat treatment Methods 0.000 claims description 5
- 229910015363 Au—Sn Inorganic materials 0.000 claims description 4
- 230000005496 eutectics Effects 0.000 claims description 4
- 230000009477 glass transition Effects 0.000 claims description 4
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 claims description 4
- 229910052737 gold Inorganic materials 0.000 claims description 4
- 238000005304 joining Methods 0.000 claims description 3
- 239000004020 conductor Substances 0.000 claims description 2
- 238000003825 pressing Methods 0.000 claims 1
- 239000004973 liquid crystal related substance Substances 0.000 abstract description 46
- 239000010408 film Substances 0.000 description 109
- 239000010949 copper Substances 0.000 description 10
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 6
- 229910052802 copper Inorganic materials 0.000 description 6
- 238000012937 correction Methods 0.000 description 5
- 229920001721 polyimide Polymers 0.000 description 5
- 230000001186 cumulative effect Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 4
- 239000009719 polyimide resin Substances 0.000 description 4
- 230000008569 process Effects 0.000 description 4
- 230000009467 reduction Effects 0.000 description 4
- 230000007547 defect Effects 0.000 description 3
- 239000011521 glass Substances 0.000 description 3
- 230000002093 peripheral effect Effects 0.000 description 3
- 230000008859 change Effects 0.000 description 2
- 238000007772 electroless plating Methods 0.000 description 2
- 238000009713 electroplating Methods 0.000 description 2
- 238000010295 mobile communication Methods 0.000 description 2
- 238000004382 potting Methods 0.000 description 2
- 238000004080 punching Methods 0.000 description 2
- 229910000679 solder Inorganic materials 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- 238000007740 vapor deposition Methods 0.000 description 2
- 239000004593 Epoxy Substances 0.000 description 1
- 239000004642 Polyimide Substances 0.000 description 1
- 239000000853 adhesive Substances 0.000 description 1
- 230000001070 adhesive effect Effects 0.000 description 1
- 239000004760 aramid Substances 0.000 description 1
- 229920003235 aromatic polyamide Polymers 0.000 description 1
- 239000011247 coating layer Substances 0.000 description 1
- 230000008602 contraction Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 230000008018 melting Effects 0.000 description 1
- 238000002844 melting Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 1
- 238000001259 photo etching Methods 0.000 description 1
- 230000003014 reinforcing effect Effects 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
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- G—PHYSICS
- G02—OPTICS
- G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
- G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
- G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour
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- G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
- G02F1/1333—Constructional arrangements; Manufacturing methods
- G02F1/1345—Conductors connecting electrodes to cell terminals
- G02F1/13452—Conductors connecting driver circuitry and terminals of panels
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67138—Apparatus for wiring semiconductor or solid state device
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49838—Geometry or layout
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/4985—Flexible insulating substrates
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/50—Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
-
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/86—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using tape automated bonding [TAB]
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
- H01L21/563—Encapsulation of active face of flip-chip device, e.g. underfilling or underencapsulation of flip-chip, encapsulation preform on chip or mounting substrate
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/13144—Gold [Au] as principal constituent
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
- H01L2224/75—Apparatus for connecting with bump connectors or layer connectors
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
- H01L2224/75—Apparatus for connecting with bump connectors or layer connectors
- H01L2224/7525—Means for applying energy, e.g. heating means
- H01L2224/75251—Means for applying energy, e.g. heating means in the lower part of the bonding apparatus, e.g. in the apparatus chuck
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/74—Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
- H01L2224/75—Apparatus for connecting with bump connectors or layer connectors
- H01L2224/7525—Means for applying energy, e.g. heating means
- H01L2224/75252—Means for applying energy, e.g. heating means in the upper part of the bonding apparatus, e.g. in the bonding head
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/81—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
- H01L2224/818—Bonding techniques
- H01L2224/81801—Soldering or alloying
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/831—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus
- H01L2224/83102—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus using surface energy, e.g. capillary forces
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
- H01L2224/92—Specific sequence of method steps
- H01L2224/921—Connecting a surface with connectors of different types
- H01L2224/9212—Sequential connecting processes
- H01L2224/92122—Sequential connecting processes the first connecting process involving a bump connector
- H01L2224/92125—Sequential connecting processes the first connecting process involving a bump connector the second connecting process involving a layer connector
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
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- H01L2924/01—Chemical elements
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- H01L2924/0105—Tin [Sn]
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01078—Platinum [Pt]
-
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
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- H01L2924/01079—Gold [Au]
-
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- H01L2924/01—Chemical elements
- H01L2924/01082—Lead [Pb]
-
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
- H01L2924/01322—Eutectic Alloys, i.e. obtained by a liquid transforming into two solid phases
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Abstract
ードを高精度に接続する。 【解決手段】 半導体チップの突起電極とフィルム基板
のインナーリードを接続する際のリードピッチの変動を
考慮し、あらかじめインナーリードのピッチに補正を加
える。また、液晶基板の電極とフィルム基板のアウター
リードを接続する際のリードピッチの変動を考慮し、あ
らかじめアウターリードのピッチにも補正を加える。
Description
技術に関し、特に、突起電極を設けた半導体チップをフ
レキシブルフィルム基板にフェイスダウン実装する半導
体装置に適用して有効な技術に関するものである。
体チップをフレキシブルフィルム基板にフェイスダウン
実装する半導体装置として、TAB(Tape Automated B
onding)やTCP(Tape Carrier Package)が知られて
いる。
レキシブルフィルム基板は、一般に、ポリイミド樹脂な
どからなる絶縁フィルムの表面にCuからなる複数のリ
ードを形成したものであることから、雰囲気中の湿気な
どに起因して絶縁フィルムが伸縮し、リードのピッチに
誤差が生じることが知られている。
報は、湿度の変化による絶縁フィルムの伸縮によって、
リードのピッチが変動することを防止する対策として、
湿度を60%前後に維持することが重要であると指摘し
ている。
は、雰囲気中の湿気や熱による絶縁フィルムの膨張によ
ってリードのピッチに誤差が生じる対策として、あらか
じめ絶縁フィルムの膨張によるリードピッチの増加量に
相当する分だけ、リードのピッチを狭く補正する技術を
開示している。
ンや移動体通信端末の液晶基板に実装する液晶ドライバ
を開発中である。この液晶ドライバは、絶縁フィルムの
表面にCuのリードを形成したフィルム基板と液晶駆動
用の半導体チップとからなり、半導体チップは、Auバ
ンプを介してフィルム基板のリードに接続される構造に
なっている。
る工程では、ボンディング装置のステージ上に固定され
た半導体チップのAuバンプとフィルム基板の対応する
リードを位置合わせした後、500℃程度に加熱したボ
ンディングツールとステージとによって上下両方向から
半導体チップとフィルム基板とを挟み込み、所定の荷重
を加えることによって、半導体チップに形成された全て
のAuバンプとフィルム基板の対応するリードとを一括
して接続する作業が行われる。
接合時にリードの近傍の絶縁フィルムが高温に曝されて
熱膨張し、これに追随してリードのピッチが変動するた
めに、リードとAuバンプとが非接触になるオープン不
良や、隣り合った2個のAuバンプが1本のリードを介
して接触するショート不良などが発生することが問題と
なる。
00ピン前後と極めて多く、これに伴ってリードの幅や
ピッチが極めて狭くなっていることから、上記したリー
ドピッチの変動に起因するリードとAuバンプと接続不
良が発生し易いという問題がある。
とフィルム基板のリードを高精度に接続することのでき
る技術を提供することにある。
な特徴は、本明細書の記述および添付図面から明らかに
なるであろう。
発明のうち、代表的なものの概要を簡単に説明すれば、
次のとおりである。
を含む導体からなる複数の突起電極が形成された半導体
チップを用意する工程と、(b)有機樹脂を含む絶縁体
からなる薄膜ベースに、前記半導体チップの複数の突起
電極のそれぞれに対応する複数のリードが形成された配
線基板を用意する工程と、(c)前記半導体チップに形
成された前記複数の突起電極のそれぞれを、前記配線基
板に形成された前記複数のリードのそれぞれに接合する
工程とを有し、前記(b)工程で用意する前記配線基板
は、前記複数の突起電極のピッチが、前記複数の突起電
極のそれぞれに対応する箇所における前記リードのピッ
チよりも大きく、前記複数のリードのそれぞれは、前記
突起電極に接合される部分が、前記薄膜ベースに固着さ
れているものである。
に基づいて詳細に説明する。なお、実施の形態を説明す
るための全図において、同一の部材には原則として同一
の符号を付し、その繰り返しの説明は省略する。
ンターポーザ)となるフィルム基板と、このフィルム基
板に搭載された半導体チップとで構成されたチップオン
フィルム(Chip On Film;COF)構造の液晶ドライバで
あり、例えばパソコンや移動体通信端末の液晶基板に実
装して使用されるものである。
される半導体チップ(以下、単にチップという)1の平
面図である。
m×1.32mmの単結晶シリコン基板からなり、その
主面には図示しない液晶駆動回路が形成されている。ま
た、チップ1の主面の周辺部には、合計449個のAu
バンプ(突起電極)2が長辺方向および短辺方向に沿っ
て一列に形成されている。
子(ボンディングパッド)上に、電解メッキ、無電解メ
ッキ、蒸着あるいはスパッタリングなどの方法によって
形成されたものである。
面に区画された多数のチップ領域に周知の半導体製造技
術を使って液晶駆動回路や入出力端子(ボンディングパ
ッド)を形成し、次いで入出力端子上に上記の方法でA
uバンプ2を形成した後、半導体ウエハをダイシングし
てチップ領域を個片化することにより製造されたもので
ある。
基板3の一部を示す平面図、図3は、このフィルム基板
3の製品(液晶ドライバ)1個分の領域を示す拡大平面
図である。
ポリイミド樹脂からなる絶縁フィルム(薄膜ベース)4
の一面に、厚さ18〜25μmのCuからなる複数のリ
ード5を形成したものであり、絶縁フィルム4の周辺部
には、フィルム送り用の穴6が所定の間隔で形成されて
いる。実際のフィルム基板3は、図2に示したものより
も遙かに長尺の多連フィルムであり、液晶ドライバの製
造ラインでは、このフィルム基板3がリールに巻き取ら
れた状態で最初の工程から最終工程まで搬送される。
表面に銅膜を蒸着し、フォトケミカルエッチング法によ
ってパターンを形成したものである。これらのリード5
は、絶縁フィルム4の表面に接着剤を介さずに固着され
ている。
央部には、前記図1に示したチップ1を搭載する領域
(チップ搭載領域C)が設けられている。図4は、この
チップ搭載領域Cを拡大して示す平面図である。
5は、それらの一端がチップ搭載領域Cを取り囲むよう
に配置されており、チップ搭載領域Cの内側に突出した
先端部分がインナーリード5aを構成している。インナ
ーリード5aの表面には、電解めっき、無電解めっき、
蒸着あるいはスパッタリングなどの方法によってSnの
被覆層が形成されている。
の長辺とその両側の短辺に沿って配置されたインナーリ
ード5aは、出力側の端子を構成している。これらのイ
ンナーリード5aのピッチは、長辺の両端部近傍と短辺
に位置するインナーリード5aが60μmであり、長辺
の中央部に位置するインナーリード5aが44μmであ
る。また、チップ搭載領域Cの下側の長辺に沿って配置
されたインナーリード5aのうち、両端部近傍に位置す
るピッチが狭い(60μm)インナーリード5aは出力
側の端子を構成し、中央部に位置するインナーリード5
aは入力側の端子を構成している。液晶ドライバの入力
端子数は出力端子数よりも少ないため、入力側の端子を
構成するインナーリード5aは、出力側よりも広いピッ
チで配置されている。
ターリード5bを構成している。これらのアウターリー
ド5bの一部(出力側端子)は、図3に示すフィルム基
板3の左側端部に配置され、他の一部(入力側端子)
は、同図に示すフィルム基板3の右側端部に配置されて
いる。インナーリード5aとアウターリード5bを除い
たリード5の表面には、ソルダレジスト7が形成されて
いる。後述するように、本実施形態の液晶ドライバを液
晶基板に実装する際には、上記アウターリード5bを液
晶基板の電極に接続する。
onding)やTCP(Tape Carrier Package)の製造に用
いられるフィルム基板は、チップ搭載領域の絶縁フィル
ムを抜き金型で打ち抜くことによってデバイスホールを
形成し、このデバイスホールの内側にインナーリードを
配置した構造になっている。しかし、このような構造
は、インナーリードがフィルムに支持されないので、入
出力端子の増加に伴ってインナーリードの線幅やピッチ
が極めて狭くなると、インナーリードが変形したり、シ
ョートし易くなる欠点がある。そのため、本実施形態の
フィルム基板3は、チップ搭載領域Cの絶縁フィルム4
にデバイスホールを設けていない。すなわち、リード5
は、インナーリード5aおよびアウターリード5bを含
む全体が絶縁フィルム4の表面に固着されている。この
ような構造とすることにより、インナーリード5aの線
幅やピッチを極めて狭くした場合でも、インナーリード
5aの変形やショートが防止されるだけでなく、チップ
1をフィルム基板3に搭載した後においても、インナー
リード5aへの応力集中が緩和されるので、温度サイク
ルの信頼性が向上する。
ム4の表面に固着された構造は、後述するチップ1のボ
ンディング工程でボンディングツールの熱がフィルム基
板3に伝わり易い。また、デバイスホールを設けないた
めに、フィルム基板3に伝わった熱が放熱され難い。
ンナーリード5aの近傍の絶縁フィルム4が高温に曝さ
れて熱膨張し、これに追随して絶縁フィルム4に固着さ
れたインナーリード5aのピッチが変動する結果、イン
ナーリード5aとそれに対応するチップ1のAuバンプ
2とが合わせずれを引き起こす。
ウターリード5bが絶縁フィルム4の表面に固着されて
いるため、アウターリード5bを液晶基板の電極に接続
する際の熱によって、アウターリード5bの近傍の絶縁
フィルム4が熱膨張し、これに追随して絶縁フィルム4
に固着されたアウターリード5bのピッチが変動する結
果、アウターリード5bとそれに対応した液晶基板の電
極とが合わせずれを引き起こす。
ィルム4の熱膨張に起因するインナーリード5aとAu
バンプ2の合わせずれ、およびアウターリード5bと電
極の合わせずれを考慮し、フィルム基板3を設計する段
階でインナーリード5aのピッチおよびアウターリード
5bのピッチを、上記した合わせずれ量に相当する分だ
け補正しておく。この補正の内容については、以下に述
べる液晶ドライバの製造方法において説明する。
工程を示すフロー図である。この液晶ドライバを製造す
るには、まず前述したチップ1とフィルム基板3とを用
意し、COFボンダを使ってチップ1をフィルム基板3
に搭載する。
概略図である。このCOFボンダ100は、ヒータ10
1を内蔵したステージ102を備えており、ステージ1
02の上面には、真空吸着などによってチップ1が保
持、固定される。チップ1は、その主面を上に向けた状
態でステージ102の上面に保持、固定され、ヒータ1
01によって400℃程度に加熱される。このチップ1
の主面には、前記図1に示したような多数のAuバンプ
2が形成されている。ステージ102の上方には、位置
認識用のカメラ103と、ヒータ104を内蔵したボン
ディングツール105とが設置されている。
100に装着されたフィルム基板3は、図5の左側から
右側方向に送られ、チップ搭載領域Cがステージ102
の真上に来たときにクランパ(治具)106とガイド
(治具)107とによって上下両面から保持、固定され
る。図7の斜線で示す領域は、このとき、フィルム基板
3と治具(クランパ106、ガイド107)とが接触す
る領域である。図示のように、治具(クランパ106、
ガイド107)は、チップ搭載領域Cの周囲全体を保持
する。
2とフィルム基板3のインナーリード5aの正確な位置
認識が行われ、この認識結果に基づいて両者の正確な位
置補正が行われる。
バンプ2がフィルム基板3のインナーリードaに接触し
ないように間隔を設け、チップ1をフィルム基板3の直
下に配置する(ダウンセット)。このとき、Auバンプ
2とインナーリードaとの間に間隔を設けるのは、チッ
プ1をフィルム基板3の下に配置する過程で両者が接触
し、あらかじめ補正されたAuバンプ2とインナーリー
ドaの位置がずれるのを防ぐためである。
ンセットした状態でボンディングツール105をフィル
ム基板3の裏面(上面)に押し付け、200℃程度に加
熱されたボンディングツール105と500℃程度に加
熱されたステージ102とによって上下両方向からチッ
プ1とフィルム基板3とを挟み込む。そして、所定の荷
重を2秒程度加えることによって、チップ1に形成され
た全てのAuバンプ2とフィルム基板3の対応するイン
ナーリード5aとをAu−Sn共晶接合によって同時に
一括して接続する。
を400℃程度の高温で行うのは、Au−Sn共晶の融
点が285℃と高く、かつ絶縁性フィルム4が焼損しな
いような短時間で高速に接合を行う必要があるためであ
る。
転移点(Tg)を有するポリイミド樹脂製の絶縁性フィ
ルム4にとっては非常に高温であり、しかも前述したよ
うに、インナーリード5aが絶縁フィルム4の表面に固
着された構造は、ボンディングツール105の熱が絶縁
性フィルム4に伝わり易い。そのため、Auバンプ2と
インナーリード5aの接合時にインナーリード5aの近
傍の絶縁フィルム4が高温に曝されて熱膨張し、これに
追随して絶縁フィルム4に固着されたインナーリード5
aのピッチが変動する。
絶縁フィルム4が熱膨張する方向を矢印で示したもので
ある。
時には、チップ搭載領域Cの内側の絶縁フィルム4に高
温のボンディングツール105が接触するため、絶縁フ
ィルム4は、チップ搭載領域Cを中心としてその外側に
放射状に膨張しようとする。しかし、チップ搭載領域C
の周囲は治具(クランパ106、ガイド107)によっ
て保持、固定されており、かつ高温のボンディングツー
ル105によってチップ1が加熱されるため、絶縁フィ
ルム4は外側方向への膨張が制約され、チップ搭載領域
Cの中心方向に向かって膨張する。すなわち、チップ搭
載領域Cの内側では、見かけ上、絶縁フィルム4が収縮
するように見える。また、この見かけの収縮量は、チッ
プ搭載領域Cの中央部で最大となり、長辺方向の端部付
近では小さくなる。
は、絶縁フィルム4の収縮に追随して収縮し、チップ搭
載領域Cの中央部に近いインナーリード5a程、ピッチ
の縮小量が大きくなる。本発明者らの実測によると、チ
ップ搭載領域Cの長辺方向に沿ったインナーリード5a
の累積ピッチの縮小量は、2μmであった。また、チッ
プ搭載領域Cの中央部に近いインナーリード5aでは、
累積ピッチの縮小量が5μmであった。
おけるインナーリードピッチの縮小を考慮し、フィルム
基板3を設計する段階でインナーリード5aのピッチに
(+)の補正を加える。すなわち、チップ搭載領域Cの
長辺方向に沿ったインナーリード5a全体の累積ピッチ
を2μm増やし、中央部に近いインナーリード5aは、
さらに3μm増やして5μmとする。また、前記図9に
示したように、チップ1をダウンセットした状態でフィ
ルム基板3の裏面をボンディングツール105で押すた
め、チップ搭載領域Cの四隅の近傍では絶縁フィルム4
が引っ張られ、インナーリード5aのピッチがボンディ
ング前に比べて広くなる。すなわち、絶縁フィルム4の
熱膨張に伴う影響よりも、絶縁フィルム4が引っ張られ
ることによる影響の方が大きい。そこで、最終的なイン
ナーリード5aのピッチがボンディング前に比べて広く
なるチップ搭載領域Cの四隅の近傍では、インナーリー
ド5aのピッチに(−)の補正を加える。
ら加わる熱によってチップ搭載領域Cの絶縁フィルム4
が膨張、あるいは見かけ上収縮したときに、インナーリ
ード5aとそれに接続されるべきAuバンプ2の位置が
高い精度で一致するようになるので、インナーリード5
aとAuバンプ2とが非接触になるオープン不良や、隣
り合った2個のAuバンプ2が1本のインナーリード5
aを介して接触するショート不良を確実に防止すること
が可能となる。
搭載領域Cに一個ずつチップ1を搭載した後、図11に
示すように、接続部の補強のためにチップ1とフィルム
基板3との隙間にディスペンサ108などを使ってポッ
ティング樹脂8を充填する。その後、図5のフローに従
ってマーキング、テスティングを行うことにより、本実
施形態の液晶ドライバが完成する。図12は、液晶ドラ
イバの完成状態を示す断面図である。
板に実装する方法を図13のフローに従って説明する。
液晶ドライバを液晶基板に実装するには、まずリールに
巻き取られた長尺のフィルム基板3を抜き金型で打ち抜
くことによって、フィルム基板3を個片化する。
ィルム基板3をガラス製の液晶基板20上に位置決め
し、フィルム基板3のアウターリード5bと液晶基板2
0の対応する電極21との間に異方性導電性樹脂(AC
F)22を介在させる。そして、この状態でフィルム基
板3の上面に160〜190℃程度に加熱された加熱ヘ
ッド23を押し付け、異方性導電性樹脂(ACF)22
を軟化させることによって、アウターリード5bと電極
21とを電気的に接続する。
の接合時には、アウターリード5bの近傍の絶縁フィル
ム4が高温に曝されて熱膨張し、これに追随して絶縁フ
ィルム4に固着されたアウターリード4bのピッチが変
動する。
の近傍の絶縁フィルム4が熱膨張する方向を矢印で示し
たものである。前述したAuバンプ2とインナーリード
5aの接合時とは異なり、フィルム基板3はクランプな
どの治具で固定されていないので、絶縁フィルム4は、
フィルム基板3の周辺方向に膨張する。この結果、アウ
ターリード4bのピッチは、絶縁フィルム4の膨張に追
随して増加する。
bと電極21との接合時におけるアウターリードピッチ
の増加を考慮し、フィルム基板3を設計する段階でアウ
ターリード5bのピッチに(−)の補正を加える。すな
わち、アウターリード5b全体の累積ピッチを減らす補
正を行う。
によってアウターリード5bの近傍Cの絶縁フィルム4
が膨張したときに、アウターリード5bとそれに接続さ
れるべき電極21の位置が高い精度で一致するようにな
るので、アウターリード5bと電極21とを確実に接合
することが可能となる。
液晶ドライバは、チップ1から信号を出力して液晶パネ
ルの表示素子をオン/オフし、バックライトを透過ある
いは遮断する駆動を行う。
施の形態に基づき具体的に説明したが、本発明は前記実
施の形態に限定されるものではなく、その要旨を逸脱し
ない範囲で種々変更可能であることはいうまでもない。
接合に限定されるものではなく、例えばAu−Au接合
によって接続してもよい。
にCuリードを形成したものに限定されず、銅配線ガラ
スエポキシ基板、銅配線ガラスポリイミド基板、銅配線
BTレジン、銅配線フッ素樹脂基板、銅配線アラミド基
板など、可撓性を有する絶縁性の薄膜ベースにリードを
形成した各種ものが使用できる。
ではなく、一般に、突起電極を設けたチップをフレキシ
ブルフィルム基板にフェイスダウン実装する各種半導体
装置に適用することができる。
表的なものによって得られる効果を簡単に説明すれば以
下のとおりである。
ドを高精度に位置合わせできるので、突起電極とリード
の接続信頼性が向上する。
載される半導体チップの平面図である。
ィルム基板を示す要部平面図である。
す拡大平面図である。
造工程を示すフロー図である。
造に用いるCOFボンダの要部を示す概略図である。
基板とが接触する領域を示す平面図である。
造に用いるCOFボンダの要部を示す概略図である。
造に用いるCOFボンダの要部を示す概略図である。
方向を示する説明図である。
アンダーフィル塗布工程を示す概略断面図である。
完成状態を示す断面図である。
液晶基板に実装する工程を示すフロー図である。
液晶基板に実装する工程を示す要部断面図である。
する方向を示する説明図である。
Claims (13)
- 【請求項1】 (a)金を含む導体からなる複数の突起
電極が形成された半導体チップを用意する工程と、
(b)有機樹脂を含む絶縁体からなる薄膜ベースに、前
記半導体チップの複数の突起電極のそれぞれに対応する
複数のリードが形成された配線基板を用意する工程と、
(c)前記半導体チップに形成された前記複数の突起電
極のそれぞれを、前記配線基板に形成された前記複数の
リードのそれぞれに接合する工程とを有する半導体装置
の製造方法であって、 前記(b)工程で用意する前記配線基板は、前記複数の
突起電極のピッチが、前記複数の突起電極のそれぞれに
対応する箇所における前記リードのピッチよりも大き
く、 前記複数のリードのそれぞれは、前記突起電極に接合さ
れる部分が、前記薄膜ベースに固着されていることを特
徴とする半導体装置の製造方法。 - 【請求項2】 前記(c)工程における前記突起電極と
前記リードとの接合は、両者の間にAu−Sn共晶接合
を形成することによって行うことを特徴とする請求項1
記載の半導体装置の製造方法。 - 【請求項3】 前記(c)工程における前記突起電極と
前記リードとの接合は、両者の間にAu−Au接合を形
成することによって行うことを特徴とする請求項1記載
の半導体装置の製造方法。 - 【請求項4】 前記(c)工程における前記突起電極と
前記リードとの接合は、前記薄膜ベースを構成する前記
絶縁体のガラス転移温度以上の温度で行うことを特徴と
する請求項1記載の半導体装置の製造方法。 - 【請求項5】 前記薄膜ベースは、可撓性を有すること
を特徴とする請求項1記載の半導体装置の製造方法。 - 【請求項6】 前記(c)工程における前記突起電極と
前記リードとの接合は、接合を行う領域の周囲の前記配
線基板を治具で挟んだ状態で行うことを特徴とする請求
項1記載の半導体装置の製造方法。 - 【請求項7】 前記(c)工程における前記突起電極と
前記リードとの接合は、前記半導体チップを前記配線基
板よりも高温に加熱した状態で、前記突起電極と前記リ
ードとを接触させることによって行うことを特徴とする
請求項6記載の半導体装置の製造方法。 - 【請求項8】 前記(c)工程における前記突起電極と
前記リードとの接合は、前記半導体チップを治具によっ
て前記配線基板よりも高温に加熱し、前記突起電極と前
記リードとを接触させることによって行うことを特徴と
する請求項1記載の半導体装置の製造方法。 - 【請求項9】 前記半導体チップを加熱する前記治具の
温度は、前記薄膜ベースを構成する前記絶縁体のガラス
転移温度以上の温度であることを特徴とする請求項8記
載の半導体装置の製造方法。 - 【請求項10】 前記突起電極と前記リードとを接触さ
せる前の前記配線基板の温度は、前記薄膜ベースを構成
する前記絶縁体のガラス転移温度以下の温度であること
を特徴とする請求項9記載の半導体装置の製造方法。 - 【請求項11】 前記(c)工程は、前記配線基板を治
具によって押し、前記リードを前記突起電極に接触させ
る工程を含んでおり、前記配線基板を前記治具によって
押す工程は、前記リードと前記突起電極とが接触する部
分と、前記治具との間に前記配線基板を介在させた状態
で行うことを特徴とする請求項1記載の半導体装置の製
造方法。 - 【請求項12】 (a)長方形の主面と、前記主面上に
配置された複数の突起電極とを有する半導体チップを用
意する工程と、(b)絶縁体からなる薄膜ベースと、前
記半導体チップの複数の突起電極のそれぞれに対応する
複数のリードとを有する配線基板を用意する工程と、
(c)前記複数の突起電極のそれぞれを、前記複数のリ
ードのそれぞれに接合する工程とを有する半導体装置の
製造方法であって、 前記(b)工程で用意する前記配線基板は、前記複数の
突起電極のピッチが、前記複数の突起電極のそれぞれに
対応する箇所における前記リードのピッチよりも小さ
く、 前記複数のリードのそれぞれは、前記突起電極に接合さ
れる部分が、前記薄膜ベースに固着されており、 前記(c)工程は、前記配線基板と前記半導体チップと
が離間した状態で両者を所定の位置に位置決めする工程
と、前記配線基板と前記半導体チップとが離間した状態
で、前記突起電極と前記リードとを接合する領域の周囲
の前記配線基板を治具で挟む工程と、前記配線基板と前
記半導体チップとが離間した状態で、前記配線基板を前
記治具によって押し、前記リードを前記突起電極に接触
させる工程を含んでいることを特徴とする半導体装置の
製造方法。 - 【請求項13】 (a)長方形の主面と、前記長方形の
主面の角部の近傍に配置された金を含む第1の複数の突
起電極と、前記長方形の主面の長辺の中点の近傍に配置
された金を含む第2の複数の突起電極とを有する半導体
チップを準備する工程と、(b)有機樹脂を含む絶縁性
の薄膜基板と、前記第1および第2の複数の突起電極に
対応してそれぞれ形成された複数のリードとを有する配
線基板を準備する工程と、(c)前記第1および第2の
複数の突起電極のそれぞれを、前記複数のリードのそれ
ぞれと接合させる工程とを有する半導体装置の製造方法
であって、 前記(b)工程において準備する配線基板において、前
記第1の複数の突起電極のピッチは、前記複数のリード
の、それぞれの突起電極に対応する部分のピッチと比較
して小さくなっており、 前記(c)工程において、前記突起電極と接合を形成す
る部分のリードは、前記薄膜基板上に固定されており、 前記(c)工程は、前記配線基板と前記半導体チップを
離して配置する工程と、前記配線基板と前記半導体チッ
プが離れた状態で、前記半導体チップが配置された領域
の周囲の配線基板を挟む工程と、前記配線基板を挟む工
程の後に、前記配線基板と前記半導体チップが離れた状
態で前記配線基板を押し、前記複数のリードと前記複数
の突起電極とを接触させる工程とを有することを特徴と
する半導体装置の製造方法。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001311540A JP3645511B2 (ja) | 2001-10-09 | 2001-10-09 | 半導体装置の製造方法 |
US10/242,720 US6699737B2 (en) | 2001-10-09 | 2002-09-13 | Method of manufacturing a semiconductor device |
US10/754,545 US7262083B2 (en) | 2001-10-09 | 2004-01-12 | Method of manufacturing a semiconductor device |
US11/882,199 US7470568B2 (en) | 2001-10-09 | 2007-07-31 | Method of manufacturing a semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001311540A JP3645511B2 (ja) | 2001-10-09 | 2001-10-09 | 半導体装置の製造方法 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004060490A Division JP4053507B2 (ja) | 2004-03-04 | 2004-03-04 | 半導体装置の製造方法 |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2003124262A true JP2003124262A (ja) | 2003-04-25 |
JP2003124262A5 JP2003124262A5 (ja) | 2005-02-10 |
JP3645511B2 JP3645511B2 (ja) | 2005-05-11 |
Family
ID=19130360
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2001311540A Expired - Lifetime JP3645511B2 (ja) | 2001-10-09 | 2001-10-09 | 半導体装置の製造方法 |
Country Status (2)
Country | Link |
---|---|
US (3) | US6699737B2 (ja) |
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JP2008288622A (ja) * | 2008-09-05 | 2008-11-27 | Renesas Technology Corp | 半導体集積回路装置の製造方法 |
JP2011108849A (ja) * | 2009-11-17 | 2011-06-02 | Sharp Corp | 電子部品および表示モジュール |
Also Published As
Publication number | Publication date |
---|---|
US20080032453A1 (en) | 2008-02-07 |
US7262083B2 (en) | 2007-08-28 |
US20040142512A1 (en) | 2004-07-22 |
US20030068842A1 (en) | 2003-04-10 |
US7470568B2 (en) | 2008-12-30 |
JP3645511B2 (ja) | 2005-05-11 |
US6699737B2 (en) | 2004-03-02 |
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A521 | Written amendment |
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|
A621 | Written request for application examination |
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|
A871 | Explanation of circumstances concerning accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A871 Effective date: 20040304 |
|
A975 | Report on accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A971005 Effective date: 20040322 |
|
A131 | Notification of reasons for refusal |
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|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040528 |
|
A131 | Notification of reasons for refusal |
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|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20050118 |
|
A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
Ref document number: 3645511 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313117 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080210 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090210 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090210 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100210 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110210 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110210 Year of fee payment: 6 |
|
S111 | Request for change of ownership or part of ownership |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110210 Year of fee payment: 6 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110210 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120210 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130210 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140210 Year of fee payment: 9 |
|
R250 | Receipt of annual fees |
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|
S531 | Written request for registration of change of domicile |
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