JP2001268784A - 電源の逆接続防止回路 - Google Patents

電源の逆接続防止回路

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JP2001268784A
JP2001268784A JP2000081861A JP2000081861A JP2001268784A JP 2001268784 A JP2001268784 A JP 2001268784A JP 2000081861 A JP2000081861 A JP 2000081861A JP 2000081861 A JP2000081861 A JP 2000081861A JP 2001268784 A JP2001268784 A JP 2001268784A
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Hideki Tamura
英樹 田村
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    • H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
    • H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
    • H02H11/00—Emergency protective circuit arrangements for preventing the switching-on in case an undesired electric working condition might result
    • H02H11/002—Emergency protective circuit arrangements for preventing the switching-on in case an undesired electric working condition might result in case of inverted polarity or connection; with switching for obtaining correct connection
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    • H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
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Abstract

(57)【要約】 【課題】 負荷の消費電流が増大しても、サイズを大き
くする必要がなく、高価とならず、また、効率が悪くな
らない電源の逆接続防止回路を提供すること。 【解決手段】 外部電源の正極に接続される入力端子１
と、外部電源の負極に接続される入力端子２と、負荷が
接続される負荷端子３、４と、常開接点５ａと励磁コイ
ル５ｂとを有するリレー５と、励磁コイル５ｂに電流を
流す制御回路６とで構成し、入力端子１と負荷端子３と
の間又は入力端子２と負荷端子４との間のいずれか一方
を常開接点５ａを介して接続するとともに他方を直接接
続し、入力端子１に正極が接続されるとともに入力端子
２に負極が接続された時にのみ制御回路６のスイッチト
ランジスタ６ａがオンとなり、励磁コイル５ｂに電流を
流し、常開接点５ａを閉じるようにした。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、電源の逆接続防止
回路に関し、特に、車載の電気によって動作する装備機
器の制御回路などの負荷に、バッテリー等の外部電源が
逆接続されたことにより、逆電圧が印加されることを防
止するための電源の逆接続防止回路に関する。
【０００２】
【従来の技術】従来の電源の逆接続防止回路を、図６を
参照して説明する。図６において、電源の逆接続防止回
路は、外部電源（ＢＡＴＴ）の正極に接続される入力端
子１１と、外部電源の負極に接続される入力端子１２
と、負荷が接続される負荷端子１３、１４と、整流素子
（例えば、ダイオード）１５で構成されている。また、
ダイオード１５は、入力端子１１と負荷端子１３との間
に設置され、アノードが入力端子１１と接続され、カソ
ードが負荷端子１３と接続されている。そして、入力端
子１２と負荷端子１４との間は直接接続されている。
【０００３】この構成において、外部電源を正しく接続
した場合、すなわち、入力端子１１に外部電源から正極
の電圧（例えば、＋１２Ｖ）が印加され、かつ、入力端
子１２に負極の電圧（例えば、０Ｖ）が印加されると、
ダイオード１５は、導通状態となり、外部電源の供給す
る電圧は、ダイオード１５を介して、負荷端子１３、１
４間に印加される。この時、印加される電圧は、外部電
源の電圧からダイオード１５での電圧降下（０．６〜
０．７Ｖ）を差し引いた電圧となる。また、外部電源を
逆向きに接続した場合、すなわち、入力端子１１に負極
の電圧（例えば、０Ｖ）が印加され、かつ、入力端子１
２に正極の電圧（例えば、＋１２Ｖ）が印加された場合
には、ダイオード１５は非導通となり、入力端子１１と
負荷端子１３との間の電流は遮断され、負荷端子１３、
１４間に電圧が印加されない。以上のように、従来の電
源の逆接続防止回路は、ダイオード１５の整流作用によ
って、外部電源を逆向きに接続したときに負荷に逆電圧
が印加されることを防止していた。
【０００４】
【発明が解決しようとする課題】しかしながら、負荷の
消費電流が増大すると、整流素子（ダイオード１５）で
の消費電力が増大し、その解決の為、整流素子の絶対最
大定格を大きくする必要があるので、整流素子そのもの
のサイズを大きくする必要があり、整流素子の値段も高
くなり、また、放熱のための構造が複雑になって製品の
サイズに圧迫を与えていた。したがって、この電源の逆
接続防止回路を使用する製品価格も高くなっていた。更
に、この電源の逆接続防止回路では、回路内で整流素子
を介して負荷に電圧を印加しているので、整流素子のＰ
Ｎ接合による電圧降下（０．６〜０．７Ｖ）が発生する
ため、負荷回路の動作に支障を来すとともに大幅に効率
が低下していた。
【０００５】本発明は、この問題を解決するもので、そ
の目的は、負荷の消費電流が増大しても、負荷にかかる
電圧の低下を防ぐとともに放熱に対する配置を必要とせ
ず、また、値段が高価とならない電源の逆接続防止回路
を提供することである。
【０００６】
【課題を解決するための手段】前記課題を解決するた
め、本発明は、外部電源の正極に接続されるべき第１の
入力端子と、外部電源の負極に接続されるべき第２の入
力端子と、負荷の一端が接続される第１の負荷端子と、
負荷の他端が接続される第２の負荷端子と、常開接点と
励磁コイルとを有するリレーと、励磁コイルに電流を流
す制御回路とを備え、第１の入力端子と第１の負荷端子
との間又は第２の入力端子と第２の負荷端子との間のい
ずれか一方を常開接点を介して接続するとともに他方を
直接接続し、第１の入力端子に正極が接続されるととも
に第２の入力端子に負極が接続された時にのみ制御回路
が励磁コイルに電流を流すようにした。
【０００７】また、本発明は、外部電源の電圧が、所定
の電圧より低い時には、制御回路から励磁コイルに電流
を流さないようにした。
【０００８】また、本発明は、制御回路は、第１の入力
端子と第２の入力端子との間に接続された抵抗分圧回路
と、第１のスイッチトランジスタとを有し、第１のスイ
ッチトランジスタのコレクタとエミッタとは、第１のス
イッチトランジスタがオンになったときに第１の入力端
子から第１のスイッチトランジスタのコレクタとエミッ
タとを介して第２の入力端子に電流が流れるように第１
の入力端子と第２の入力端子とに各々対応して接続さ
れ、電流の流れる通路内に励磁コイルを介挿し、分圧回
路の分圧電圧を第１のスイッチトランジスタのベースに
印加した。
【０００９】また、本発明は、制御回路は、第１の入力
端子にカソードが接続されたツェナーダイオードと、ツ
ェナーダイオードのアノードと第２の入力端子との間に
接続されたバイアス抵抗と、コレクタが第１の入力端子
に接続されるとともにエミッタが第２の入力端子と接続
されるＮＰＮ型の第２のスイッチトランジスタとを有
し、第２のスイッチトランジスタのベースをツェナーダ
イオードとバイアス抵抗との接続点に接続し、第２のス
イッチトランジスタのコレクタと第１の入力端子との間
又は第２のスイッチトランジスタのエミッタと第２の入
力端子との間のいずれか一方に励磁コイルを介挿した。
【００１０】また、本発明は、制御回路は、第２の入力
端子にアノードが接続されたツェナーダイオードと、ツ
ェナーダイオードのカソードと第１の入力端子との間に
接続されたバイアス抵抗と、コレクタが第２の入力端子
に接続されるとともにエミッタが第１の入力端子と接続
されるＰＮＰ型の第３のスイッチトランジスタとを有
し、第３のスイッチトランジスタのベースをツェナーダ
イオードとバイアス抵抗との接続点に接続し、第３のス
イッチトランジスタのコレクタと第２の入力端子との間
又は第３のスイッチトランジスタのエミッタと第１の入
力端子との間のいずれか一方に励磁コイルを介挿した。
【００１１】また、本発明は、第１のスイッチトランジ
スタはＮＰＮ型であり、第１のスイッチトランジスタの
ベースと第２の入力端子との間にノイズ除去用のコンデ
ンサを接続し、第１のスイッチトランジスタがオンにな
ったときに第１の入力端子から第１のスイッチトランジ
スタのコレクタとエミッタとを介して第２の入力端子に
電流が流れる通路内に逆流防止用のダイオードを介挿し
た。
【００１２】また、本発明は、第１のスイッチトランジ
スタはＰＮＰ型であり、第１のスイッチトランジスタの
ベースと第１の入力端子との間にノイズ除去用のコンデ
ンサを接続し、第１のスイッチトランジスタがオンにな
ったときに第１の入力端子から第１のスイッチトランジ
スタのコレクタとエミッタとを介して第２の入力端子に
電流が流れる通路内に逆流防止用のダイオードを介挿し
た。
【００１３】また、本発明は、第２のスイッチトランジ
スタのベースと第２の入力端子との間にノイズ除去用の
コンデンサを接続し、第２のスイッチトランジスタがオ
ンになったときに第１の入力端子から第２のスイッチト
ランジスタのコレクタとエミッタとを介して第２の入力
端子に電流が流れる通路内に逆流防止用のダイオードを
介挿した。
【００１４】また、本発明は、第３のスイッチトランジ
スタのベースと第１の入力端子との間にノイズ除去用の
コンデンサを接続し、第３のスイッチトランジスタがオ
ンになったときに第１の入力端子から第３のスイッチト
ランジスタのコレクタとエミッタとを介して第２の入力
端子に電流が流れる通路内に逆流防止用のダイオードを
介挿した。
【００１５】
【発明の実施の形態】以下、本発明の電源の逆接続防止
回路の実施の形態を図１〜図５を参照して説明する。
【００１６】図１は、本発明の電源の逆接続防止回路の
第１の実施の形態を示す回路図である。第１の実施の形
態は、外部電源（ＢＡＴＴ）の正極に接続される第１の
入力端子１と、外部電源の負極に接続される第２の入力
端子２と、負荷の一端が接続される第１の負荷端子３
と、負荷の他端が接続される第２の負荷端子４と、常開
接点５ａと励磁コイル５ｂとを有するリレー５と、励磁
コイル５ｂに電流を流す制御回路６とで構成されてい
る。なお、リレー５は、小型で安価なものを使用してい
る。そして、入力端子１と負荷端子３との間は、常開接
点５ａを介して接続され、入力端子２と負荷端子４との
間は直接接続されている。
【００１７】また、制御回路６は、入力端子１と入力端
子２との間に接続されたバイアス抵抗７ａ、７ｂを有す
る分圧回路７と、第１のスイッチトランジスタ６ａとを
備えている。さらに、スイッチトランジスタ６ａのコレ
クタは、励磁コイル５ｂを介して入力端子１に接続さ
れ、エミッタは逆流防止用のダイオード６ｃのアノード
に接続され、ダイオード６ｃのカソードは入力端子２に
接続されている。そして、ベースはバイアス抵抗７ａ、
７ｂの接続点に接続されるとともにノイズ除去用のコン
デンサ６ｂを介して入力端子２と接続されている。な
お、励磁コイル５ｂ及びダイオード６ｃは、入力端子１
からスイッチトランジスタ６ａのコレクタとエミッタと
を介して入力端子２に流れる電流の通路内であればどこ
に配置しても機能は同じである。
【００１８】この構成において、外部電源を正しく接続
した場合、すなわち、入力端子１に外部電源から正極の
電圧（例えば、＋１２Ｖ）が印加され、かつ、入力端子
２に負極の電圧（例えば、０Ｖ）が印加されると、バイ
アス抵抗７ａと７ｂとで分圧された電圧がスイッチトラ
ンジスタ６ａのベースに印加され、スイッチトランジス
タ６ａはオンとなる。スイッチトランジスタ６ａがオン
すると、入力端子１からスイッチトランジスタ６ａのコ
レクタとエミッタとを介して入力端子２に電流が流れる
ようになり、すなわち、励磁コイル５ｂにも電流が流
れ、この結果、リレー５の常開接点５ａが閉じ、負荷端
子３、４間に外部電源からの電圧（１２Ｖ）が印加され
る。この時、ダイオード６ｃはスイッチトランジスタ６
ａの逆流防止用として働き、コンデンサ６ｂは入力端子
１に異常電圧（過渡電圧、サージ電圧）が印加されたと
きのスイッチトランジスタ６ａの誤作動防止用のフィル
タ用コンデンサとして働く。また、励磁コイル５ｂと並
列に接続されているダイオード６ｄは、コイル５ｂのオ
ン／オフ時に発生する逆起電圧吸収除去用である。
【００１９】また、外部電源を逆向きに接続した場合、
すなわち、入力端子１に外部電源から負極の電圧（例え
ば、０Ｖ）が印加され、かつ、入力端子２に正極の電圧
（例えば、＋１２Ｖ）が印加されると、スイッチトラン
ジスタ６ａのベースに印加される電圧はエミッタに加わ
る電圧よりも低くなる為、スイッチトランジスタ６ａは
オンしない（オフし続ける）。したがって、励磁コイル
５ｂに電流が流れず、常開接点５ａは開放されたままと
なり、負荷端子３、４間には逆極性の電圧が印加されな
い。
【００２０】ところで、本発明は、従来例の整流素子１
５に代えてリレー５を使用しているので、負荷の消費電
流が増大しても、発熱せず、外部電源の供給電圧と負荷
端子３、４の間に電圧降下を起こさない。したがって、
効率が悪くならない。また、価格も高くはならない。
【００２１】次に、図２は、本発明の電源の逆接続防止
回路の第２の実施の形態を示す回路図である。図２にお
いて、第１の実施の形態を示す図１と同じ構成について
は、図１と同じ符号を付け、詳細な説明は省略する。
【００２２】第２の実施の形態においては、制御回路６
は、第１の実施の形態のスイッチトランジスタ６ａに相
当する、ＮＰＮ型の第２のスイッチトランジスタ６ｅを
有している。また、第１の実施の形態の分圧回路７に相
当する回路として、第１の入力端子１にカソードが接続
されたツェナーダイオード８と、ツェナーダイオード８
のアノードとスイッチトランジスタ６ｅのベースとの間
に接続されたツェナーダイオード８の破壊防止用の抵抗
１０とで構成されている。ここで、ツェナーダイオード
８のツェナー電圧は、負荷が正常に動作するための電圧
範囲の最低値、例えば、７Ｖに設定されている。これに
より、入力端子１、２間にツェナーダイオード７ｃのツ
ェナー電圧以上の電圧が印加されないと、スイッチトラ
ンジスタ６ｅはオンしない。この結果、外部電源の電圧
が低い時（７Ｖ以下）は負荷に電圧が印加されないの
で、負荷の故障や誤動作、外部電源の寿命が短くなるこ
と等を防止することができる。
【００２３】次に、図３は、本発明の電源の逆接続防止
回路の第３の実施の形態を示す回路図である。図３にお
いて、第２の実施の形態を示す図２と同じ構成について
は、図２と同じ符号を付け、詳細な説明は省略する。
【００２４】図３において、制御回路６は、第２の実施
の形態のスイッチトランジスタ６ｅに相当する、ＰＮＰ
型の第３のスイッチトランジスタ６ｆを有している。ま
た、第２の実施の形態と相違して、スイッチトランジス
タ６ｆのベースにカソードが接続されたツェナーダイオ
ード８のアノードは破壊防止用の抵抗１０を介して入力
端子２と接続され、入力端子１とスイッチトランジスタ
６ｆのベースとの間にバイアス抵抗９が接続されてい
る。また、ノイズ除去用のコンデンサ６ｂは、入力端子
１とスイッチトランジスタ６ｆのベースとの間に接続さ
れている。
【００２５】次に、図４は、本発明の電源の逆接続防止
回路の他の実施の形態を示す回路図である。図４におい
て、第１の実施の形態を示す図１と同じ構成について
は、図１と同じ符号を付け、詳細な説明は省略する。
【００２６】図４において、制御回路６は、第１の実施
の形態のスイッチトランジスタ６ａに相当する、ＰＮＰ
型のスイッチトランジスタ６ｇを有している。また、第
１の実施の形態と相違して、ノイズ除去用のコンデンサ
６ｂは、入力端子１とスイッチトランジスタ６ｇのベー
スとの間に接続されている。
【００２７】次に、図５は、本発明の電源の逆接続防止
回路の他の実施の形態を示す回路図である。図５におい
て、電源の逆接続防止回路は、第２の実施の形態におけ
る常開接点５ａを、入力端子２と負荷端子４との間に設
置したものであり、構成及び動作は第２の実施の形態と
同様なので説明は省略する。
【００２８】なお、本発明では、リレー５は常開接点５
ａを採用しているが、常閉接点を採用し、常時は導通状
態で逆電圧が印加されたときにのみ接点を開放させて電
源を遮断する構成としても目的は達成可能である。しか
し、常閉接点では、逆電圧が印加されたときから、リレ
ーの励磁コイルが励磁され、接点が作動し、開放するま
で（一般的に数ミリ秒）は、負荷に逆電圧が印加される
ことになる。そして、負荷の構成が、半導体等であった
場合、数ミリ秒間、半導体の絶対最大定格を逸脱するこ
とがあり、更に、その半導体が、コンプリメンタリ・タ
イプやブリッジ構成の各種出力を持つ回路（又はＩＣ）
であった場合には、それら半導体の出力端子に寄生され
るダイオード（ＩＣの負極端子から出力端子に整流作用
を持ち、且つ、出力端子からＩＣの正極端子に整流作用
を持つ）を介して、大電流（短絡電流）が流れ、負荷の
回路（又はＩＣ）を破壊に至らしめる危険性がある。本
発明は、常開接点のため、負荷に瞬間的にも逆電圧が印
加されず、前述の回路（又はＩＣ）の破壊の危険性を確
実に回避するものである。
【００２９】
【発明の効果】以上説明してきたように、本発明によれ
ば、外部電源の正極に接続されるべき第１の入力端子
と、外部電源の負極に接続されるべき第２の入力端子
と、負荷の一端が接続される第１の負荷端子と、負荷の
他端が接続される第２の負荷端子と、常開接点と励磁コ
イルとを有するリレーと、励磁コイルに電流を流す制御
回路とを備え、第１の入力端子と第１の負荷端子との間
又は第２の入力端子と第２の負荷端子との間のいずれか
一方を常開接点を介して接続するとともに他方を直接接
続し、第１の入力端子に正極が接続されるとともに第２
の入力端子に負極が接続された時にのみ制御回路が励磁
コイルに電流を流すようにしたことにより、負荷の消費
電流が増大しても、負荷の消費電流が増大しても、発熱
せず、外部電源の供給電圧と負荷端子間に電圧降下を起
こさない。したがって、効率が悪くならない。また、価
格も高くはならない。
【００３０】また、本発明によれば、外部電源の電圧
が、所定の電圧より低い時には、制御回路から励磁コイ
ルに電流を流さないようにしたことにより、外部電源の
電圧が低い時は負荷に電圧が印加されないので、負荷の
故障や誤動作、外部電源の寿命が短くなること等を防止
することができる。
【００３１】また、本発明によれば、制御回路は、第１
の入力端子と第２の入力端子との間に接続された抵抗分
圧回路と、第１のスイッチトランジスタとを有し、第１
のスイッチトランジスタのコレクタとエミッタとは、第
１のスイッチトランジスタがオンになったときに第１の
入力端子から第１のスイッチトランジスタのコレクタと
エミッタとを介して第２の入力端子に電流が流れるよう
に第１の入力端子と第２の入力端子とに各々対応して接
続され、電流の流れる通路内に励磁コイルを介挿し、分
圧回路の分圧電圧を第１のスイッチトランジスタのベー
スに印加したことにより、電源の接続又は非接続のみ
で、スイッチトランジスタのオン／オフに連動して励磁
コイルの電流がオン／オフされるので、励磁コイルの電
流のオン／オフの切り替えが容易にできる。
【００３２】また、本発明によれば、制御回路は、第１
の入力端子にカソードが接続されたツェナーダイオード
と、ツェナーダイオードのアノードと第２の入力端子と
の間に接続されたバイアス抵抗と、コレクタが第１の入
力端子に接続されるとともにエミッタが第２の入力端子
と接続されるＮＰＮ型の第２のスイッチトランジスタと
を有し、第２のスイッチトランジスタのベースをツェナ
ーダイオードとバイアス抵抗との接続点に接続し、第２
のスイッチトランジスタのコレクタと第１の入力端子と
の間又は第２のスイッチトランジスタのエミッタと第２
の入力端子との間のいずれか一方に励磁コイルを介挿し
たことにより、外部電源の電圧がツェナー電圧以下の時
はスイッチトランジスタがオンしないので、負荷に印加
される電圧の許容最低電圧の設定が容易にできる。
【００３３】また、本発明によれば、制御回路は、第２
の入力端子にアノードが接続されたツェナーダイオード
と、ツェナーダイオードのカソードと第１の入力端子と
の間に接続されたバイアス抵抗と、コレクタが第２の入
力端子に接続されるとともにエミッタが第１の入力端子
と接続されるＰＮＰ型の第３のスイッチトランジスタと
を有し、第３のスイッチトランジスタのベースをツェナ
ーダイオードとバイアス抵抗との接続点に接続し、第３
のスイッチトランジスタのコレクタと第２の入力端子と
の間又は第３のスイッチトランジスタのエミッタと第１
の入力端子との間のいずれか一方に励磁コイルを介挿し
たことにより、スイッチトランジスタがＰＮＰ型であっ
ても、外部電源の電圧がツェナー電圧以下の時はスイッ
チトランジスタがオンしないので、負荷に印加される電
圧の許容最低電圧の設定が容易にできる。
【００３４】また、本発明によれば、第１のスイッチト
ランジスタはＮＰＮ型であり、第１のスイッチトランジ
スタのベースと第２の入力端子との間にノイズ除去用の
コンデンサを接続し、第１のスイッチトランジスタがオ
ンになったときに第１の入力端子から第１のスイッチト
ランジスタのコレクタとエミッタとを介して第２の入力
端子に電流が流れる通路内に逆流防止用のダイオードを
介挿したことにより、スイッチトランジスタが異常電圧
により誤動作することを防止するとともにスイッチトラ
ンジスタが逆電圧により破壊されることを防止すること
ができる。
【００３５】また、本発明によれば、第１のスイッチト
ランジスタはＰＮＰ型であり、第１のスイッチトランジ
スタのベースと第１の入力端子との間にノイズ除去用の
コンデンサを接続し、第１のスイッチトランジスタがオ
ンになったときに第１の入力端子から第１のスイッチト
ランジスタのコレクタとエミッタとを介して第２の入力
端子に電流が流れる通路内に逆流防止用のダイオードを
介挿したことにより、スイッチトランジスタがＰＮＰ型
であっても、スイッチトランジスタが異常電圧により誤
動作することを防止するとともにスイッチトランジスタ
が逆電圧により破壊されることを防止することができ
る。
【００３６】また、本発明によれば、第２のスイッチト
ランジスタのベースと第２の入力端子との間にノイズ除
去用のコンデンサを接続し、第２のスイッチトランジス
タがオンになったときに第１の入力端子から第２のスイ
ッチトランジスタのコレクタとエミッタとを介して第２
の入力端子に電流が流れる通路内に逆流防止用のダイオ
ードを介挿したことにより、スイッチトランジスタが異
常電圧により誤動作することを防止するとともにスイッ
チトランジスタが逆電圧により破壊されることを防止す
ることができる。
【００３７】また、本発明によれば、第３のスイッチト
ランジスタのベースと第１の入力端子との間にノイズ除
去用のコンデンサを接続し、第３のスイッチトランジス
タがオンになったときに第１の入力端子から第３のスイ
ッチトランジスタのコレクタとエミッタとを介して第２
の入力端子に電流が流れる通路内に逆流防止用のダイオ
ードを介挿したことにより、スイッチトランジスタが異
常電圧により誤動作することを防止するとともにスイッ
チトランジスタが逆電圧により破壊されることを防止す
ることができる。
【図面の簡単な説明】
【図１】本発明の電源の逆接続防止回路の第１の実施の
形態を示す回路図である。
【図２】本発明の電源の逆接続防止回路の第２の実施の
形態を示す回路図である。
【図３】本発明の電源の逆接続防止回路の第３の実施の
形態を示す回路図である。
【図４】本発明の電源の逆接続防止回路の他の実施の形
態を示す他の回路図である。
【図５】本発明の電源の逆接続防止回路の他の実施の形
態を示す他の回路図である。
【図６】従来の電源の逆接続防止回路の形態を示す回路
図である。
【符号の説明】
１ 第１の入力端子 ２ 第２の入力端子 ３ 第１の負荷端子 ４ 第２の負荷端子 ５ リレー ５ａ 常開接点 ５ｂ 励磁コイル ６ 制御回路 ６ａ 第１のスイッチトランジスタ ６ｂ ノイズ除去用コンデンサ ６ｃ 逆流防止用ダイオード ６ｅ 第２のスイッチトランジスタ ６ｆ 第３のスイッチトランジスタ ７ 分圧回路 ８ ツェナーダイオード ９ バイアス抵抗

Claims (9)

    【特許請求の範囲】
  1. 【請求項１】 外部電源の正極に接続されるべき第１の
    入力端子と、前記外部電源の負極に接続されるべき第２
    の入力端子と、負荷の一端が接続される第１の負荷端子
    と、前記負荷の他端が接続される第２の負荷端子と、常
    開接点と励磁コイルとを有するリレーと、前記励磁コイ
    ルに電流を流す制御回路とを備え、前記第１の入力端子
    と前記第１の負荷端子との間又は前記第２の入力端子と
    前記第２の負荷端子との間のいずれか一方を前記常開接
    点を介して接続するとともに他方を直接接続し、前記第
    １の入力端子に前記正極が接続されるとともに前記第２
    の入力端子に前記負極が接続された時にのみ前記制御回
    路が前記励磁コイルに電流を流すようにしたことを特徴
    とする電源の逆接続防止回路。
  2. 【請求項２】 前記外部電源の電圧が、所定の電圧より
    も低い時には、前記制御回路から前記励磁コイルに電流
    を流さないようにしたことを特徴とする請求項１に記載
    の電源の逆接続防止回路。
  3. 【請求項３】 前記制御回路は、前記第１の入力端子と
    前記第２の入力端子との間に接続された分圧回路と、第
    １のスイッチトランジスタとを有し、前記第１のスイッ
    チトランジスタのコレクタとエミッタとは、前記第１の
    スイッチトランジスタがオンになったときに前記第１の
    入力端子から前記第１のスイッチトランジスタのコレク
    タとエミッタとを介して前記第２の入力端子に電流が流
    れるように前記第１の入力端子と前記第２の入力端子と
    に各々対応して接続され、前記電流の流れる通路内に前
    記励磁コイルを介挿し、前記分圧回路の分圧電圧を前記
    第１のスイッチトランジスタのベースに印加したことを
    特徴とする請求項１に記載の電源の逆接続防止回路。
  4. 【請求項４】 前記制御回路は、前記第１の入力端子に
    カソードが接続されたツェナーダイオードと、前記ツェ
    ナーダイオードのアノードと前記第２の入力端子との間
    に接続されたバイアス抵抗と、コレクタが前記第１の入
    力端子に接続されるとともにエミッタが前記第２の入力
    端子と接続されるＮＰＮ型の第２のスイッチトランジス
    タとを有し、前記第２のスイッチトランジスタのベース
    を前記ツェナーダイオードと前記バイアス抵抗との接続
    点に接続し、前記第２のスイッチトランジスタのコレク
    タと前記第１の入力端子との間又は前記第２のスイッチ
    トランジスタのエミッタと前記第２の入力端子との間の
    いずれか一方に前記励磁コイルを介挿したことを特徴と
    する請求項２に記載の電源の逆接続防止回路。
  5. 【請求項５】 前記制御回路は、前記第２の入力端子に
    アノードが接続されたツェナーダイオードと、前記ツェ
    ナーダイオードのカソードと前記第１の入力端子との間
    に接続されたバイアス抵抗と、コレクタが前記第２の入
    力端子に接続されるとともにエミッタが前記第１の入力
    端子と接続されるＰＮＰ型の第３のスイッチトランジス
    タとを有し、前記第３のスイッチトランジスタのベース
    を前記ツェナーダイオードと前記バイアス抵抗との接続
    点に接続し、前記第３のスイッチトランジスタのコレク
    タと前記第２の入力端子との間又は前記第３のスイッチ
    トランジスタのエミッタと前記第１の入力端子との間の
    いずれか一方に前記励磁コイルを介挿したことを特徴と
    する請求項２に記載の電源の逆接続防止回路。
  6. 【請求項６】 前記第１のスイッチトランジスタはＮＰ
    Ｎ型であり、前記第１のスイッチトランジスタのベース
    と前記第２の入力端子との間にノイズ除去用のコンデン
    サを接続し、前記第１のスイッチトランジスタがオンに
    なったときに前記第１の入力端子から前記第１のスイッ
    チトランジスタのコレクタとエミッタとを介して前記第
    ２の入力端子に電流が流れる通路内に逆流防止用のダイ
    オードを介挿したことを特徴とする請求項３に記載の電
    源の逆接続防止回路。
  7. 【請求項７】 前記第１のスイッチトランジスタはＰＮ
    Ｐ型であり、前記第１のスイッチトランジスタのベース
    と前記第１の入力端子との間にノイズ除去用のコンデン
    サを接続し、前記第１のスイッチトランジスタがオンに
    なったときに前記第１の入力端子から前記第１のスイッ
    チトランジスタのコレクタとエミッタとを介して前記第
    ２の入力端子に電流が流れる通路内に逆流防止用のダイ
    オードを介挿したことを特徴とする請求項３に記載の電
    源の逆接続防止回路。
  8. 【請求項８】 前記第２のスイッチトランジスタのベー
    スと前記第２の入力端子との間にノイズ除去用のコンデ
    ンサを接続し、前記第２のスイッチトランジスタがオン
    になったときに前記第１の入力端子から前記第２のスイ
    ッチトランジスタのコレクタとエミッタとを介して前記
    第２の入力端子に電流が流れる通路内に逆流防止用のダ
    イオードを介挿したことを特徴とする請求項４に記載の
    電源の逆接続防止回路。
  9. 【請求項９】 前記第３のスイッチトランジスタのベー
    スと前記第１の入力端子との間にノイズ除去用のコンデ
    ンサを接続し、前記第３のスイッチトランジスタがオン
    になったときに前記第１の入力端子から前記第３のスイ
    ッチトランジスタのコレクタとエミッタとを介して前記
    第２の入力端子に電流が流れる通路内に逆流防止用のダ
    イオードを介挿したことを特徴とする請求項５に記載の
    電源の逆接続防止回路。
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