JP2001102484A - 半導体装置及びその製造方法並びにキャリア基板及びその製造方法 - Google Patents
半導体装置及びその製造方法並びにキャリア基板及びその製造方法Info
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Abstract
な半導体装置を提供する。 【解決手段】 半導体素子2と、該半導体素子2を底部
に搭載すると共に、該底部の周囲にその位置よりも高い
段部4aを形成した搭載部金属膜4と、該搭載部金属膜
4の周囲に離間して位置し、半導体素子2の信号用電極
部と電気的に接続した接続部金属膜5と、搭載部金属膜
4及び接続部金属膜5の実装面側を露出させて半導体素
子2、搭載部金属膜4及び接続部金属膜5を樹脂封止し
た樹脂封止部7とを具備し、搭載部金属膜4の段部4a
と半導体素子2のグランド用電極部とを電気的に接続し
た。
Description
製造方法並びにキャリア基板及びその製造方法に関す
る。
普及により、該電子機器に装備されている半導体装置に
も、小型化、低コスト化が求められている。従来のリー
ドフレームに半導体素子を搭載した樹脂封止してなる半
導体装置は、インナーリードからアウターリードへの引
き回し面積や、実装面積が大きい。また、BGA(Ball
・Grid・Array)タイプの半導体装置は、半導体素子を
搭載する基板を用いるため製造コストが高くなるなどの
課題があった。
を縮小し、低コスト化を図ることを意図して、例えば特
開平9−162348号公報に示す半導体装置が提案さ
れている。この特開平9−162348号公報に示す半
導体装置は、素子固定樹脂に搭載された半導体素子と、
該半導体素子がエポキシ樹脂により封止されてなる樹脂
パッケージと、該樹脂パッケージの実装面側に形成され
た樹脂突起を覆う金属膜とを有し、半導体素子の電極部
と金属膜とがワイヤボンディングにより電気的に接続さ
れている。この半導体装置は、リードフレームを用いた
場合のような、インナーリードやアウターリードが不要
であり、BGAタイプのような搭載基板が不要であり、
金属膜が熱放散性を向上させたり、基板実装する際に接
続端子と同様の機能を果たすため実装性が良い。
子を搭載するものにおいては、ノイズの混入等を防止し
て電気的特性を安定させるため半導体素子を搭載する搭
載部金属膜をグランド用端子として使用することが望ま
しい。よって、半導体素子のグランド用電極部と搭載部
金属膜とを電気的に接続する必要がある。例えば、図4
に示す半導体装置51において、半導体素子52を搭載
した搭載部金属膜53及び半導体素子52と電気的に接
続された接続部金属膜54は、実装面側に膨出して形成
されている。この搭載部金属膜53の周縁部には、グラ
ンド用接続部55が外側に延設して形成されている。半
導体素子52のグランド用電極部とグランド用接続部5
5とはワイヤ56により電気的に接続されており、信号
用電極部と接続部金属膜54とはワイヤ58により電気
的に接続されている。
パクトに設計し、ワイヤ56の長さを可能な限り短くす
るためには、グランド用接続部55を半導体素子52の
直近に設けることが好ましい。このため、搭載部金属膜
53を段状に形成したいという要望があった。この搭載
部金属膜53を段状に形成するため、半導体装置51の
製造用のキャリア基板の製造方法について、図5(a)
〜(h)及び図6(a)(b)を参照して説明する。
尚、図5においては、接続部金属膜54については、図
示を省略するものとし、搭載部金属膜53の形成工程を
中心に説明する。
属基材60の両面にエッチングレジスト(感光性レジス
ト)61を塗布する。次に、図5(b)において、所要
の大きさに中央抜きパターン62を形成すべくフォトマ
スクを重ね合わせて露光現像を行いレジストパターンを
形成する(図6(a)参照)。次に、図5(c)におい
て、1段目のハーフエッチングを行い(金属基材60の
板厚の約1/4)、接続用凹部63を形成する。この場
合、金属基材60に銅板を用いた場合には、エッチング
液は塩化第2鉄などが好適に用いられる。次に、図5
(d)において、エッチングレジスト61を剥離して、
金属基材60に接続用凹部63が形成される。
成された金属基材60に、再度エッチングレジスト(感
光性レジスト)61を塗布して、所要の大きさに中央抜
きパターン64を形成すべくフォトマスクをアライメン
トして重ね合わせて露光現像を行いレジストパターンを
形成する(図6(b)参照)。次に、図5(f)におい
て、2段目のハーフエッチングを行い(金属基材60の
板厚の約1/2)、搭載用凹部65を形成する。次に、
図5(g)において、エッチングレジスト61を剥離し
て、金属基材60に深さの異なる接続用凹部63と搭載
用凹部65が段状に形成される。尚、ハーフエッチング
の面積や深さはフォトマスクの中央抜きパターンのデザ
インを変えることで、自在に調整できる。
の接続用凹部63と搭載用凹部65以外の部位を図示し
ないレジストで覆って、電解めっき法、蒸着法或いはス
パッタリング法などにより金属膜を多層形成する。これ
によって、搭載部金属膜53が段状に形成されたキャリ
ア基板66が形成される。
ャリア基板66の搭載部金属膜53を段状に形成するた
めに、金属基材60に対してエッチングレジスト61の
塗布から露光現像を経てハーフエッチングを行うまでの
工程を複数回繰り返すのは、製造工程が複雑になり、製
造コストが増加する。また、例えばエッチングレジスト
61を露光現像して、大きさが異なる1回目の中央抜き
パターン62と2回目の中央抜きパターン64とを重な
る位置で形成する場合、高度なアライメント精度が要求
されるため、不良品が多発して歩留まりが低下するおそ
れがあった。
決し、製造工程を簡略化して、低コストで量産可能な半
導体装置を及びその製造方法並びに該半導体装置に用い
られるキャリア基板及びその製造方法を提供することに
ある。
め、本発明は次の構成を備える。即ち、半導体装置にお
いては、半導体素子と、該半導体素子を底部に搭載する
と共に、該底部の周囲にその位置よりも高い段部を形成
した搭載部金属膜と、該搭載部金属膜の周囲に離間して
位置し、半導体素子の信号用電極部と電気的に接続した
接続部金属膜と、搭載部金属膜及び接続部金属膜の実装
面側を露出させて半導体素子、搭載部金属膜及び接続部
金属膜を樹脂封止した樹脂封止部とを具備し、搭載部金
属膜の段部と半導体素子のグランド用電極部とを電気的
に接続したことを特徴とする。また、搭載部金属膜及び
接続部金属膜は、実装面側より金層、パラジウム層、ニ
ッケル層、及びパラジウム層の四層膜により形成されて
いることを特徴とする。
ア基板においては、金属基材の一面側に、中央部に向け
て段状に低くなるように形成された搭載用凹部と、該搭
載用凹部の周囲に離間して形成された接続用凹部とが形
成され、搭載用凹部及び接続用凹部内に搭載部金属膜及
び接続部金属膜がそれぞれ形成されていることを特徴と
する。また、キャリア基板の製造方法においては、金属
基材の両面にエッチングレジストを塗布する工程と、エ
ッチングレジストに、金属基材の搭載用凹部に対応する
部位に、中央抜きパターン及び該中央抜きパターンを囲
むリング状抜きパターンをそれぞれ形成すると共に、金
属基材の接続用凹部に対応する部位に、接続用抜きパタ
ーンを形成する工程と、エッチングレジストをマスクと
して金属基材をハーフエッチングし、リング状抜きパタ
ーンと中央抜きパターンとの間の金属基材をサイドエッ
チングにより除去して中央部よりも高い段部を有する搭
載用凹部を形成すると共に、該搭載用凹部の周囲に離間
して接続用凹部を形成する工程と、搭載用凹部及び接続
用凹部に、搭載部金属膜及び接続部金属膜をそれぞれ形
成する工程と、エッチングレジストを除去する工程とを
含むことを特徴とする。
置の製造方法においては、キャリア基板の搭載部金属膜
に半導体素子を搭載する工程と、半導体素子のグランド
用電極部と搭載部金属膜の段部とを電気的に接続すると
共に、半導体素子の信号用電極部と接続部金属膜とを電
気的に接続する工程と、搭載部金属膜、接続部金属膜及
び半導体素子を封止して樹脂封止部を形成する工程と、
キャリア基板から樹脂封止部を搭載部金属膜及び接続部
金属膜と共に分離する工程とを含むことを特徴とする。
導体素子を搭載部金属膜に搭載した後、キャリア基板の
搭載部金属膜及び接続部金属膜上にスタッドバンプを形
成する工程を有していても良い。また、キャリア基板か
ら樹脂封止部を搭載部金属膜及び接続部金属膜と共に分
離する場合、金属基材をエッチングにより除去してキャ
リア基板から樹脂封止部を分離したり、或いは樹脂封止
部をキャリア基板から引き剥がして分離しても良い。
について添付図面と共に詳述する。本実施例では、携帯
電話などの電子機器に用いられる高周波アナログ用IC
を搭載した半導体装置及びその製造方法について説明す
るものとする。図1(a)〜(j)は半導体装置の製造
工程を示す説明図、図2は金属膜の一例を示す断面説明
図、図3は図1(b)の矢印C−C矢視図である。
する。図1(j)において、1は半導体装置であり、以
下の構成を有する。半導体素子2は接着剤層3を介して
段状に形成された搭載部金属膜4の底部に搭載されてい
る。この接着剤層3としては、熱放散性及び導電性を有
する材料、例えば銀の粒子を含んだ導電性エポキシ樹脂
剤が好適に用いられる。半導体素子2の電極部2aのう
ちグランド用電極部は、搭載部金属膜4の底部の周囲に
形成された該底部よりも高い段部4aに金線などのワイ
ヤ6により電気的に接続されている。また、半導体素子
2の電極部2aのうち信号用電極部は、搭載部金属膜4
の周囲に離間して形成された接続部金属膜5と金線など
のワイヤ6により電気的に接続されている。半導体素子
2、該半導体素子2を搭載した搭載部金属膜4及び接続
部金属膜5はエポキシ樹脂による樹脂封止部7に封止さ
れている。搭載部金属膜4や接続部金属膜5は、樹脂封
止部7の実装面側に突出して露出形成されている。本実
施例では、搭載部金属膜4は半導体装置1のダイパッ
ド、放熱板及びグランド端子部を兼用しており、接続部
金属膜5は信号ラインとなる接続端子部として各々機能
している。
多層形成された金属膜により構成されている。本実施例
では、図2に示すように、外層となる実装面側より金層
9、パラジウム層10、ニッケル層11、及びパラジウ
ム層12の四層膜により形成されている。外層は基板端
子とのはんだ接合性、内層はワイヤ6との接合性を考慮
して様々な金属膜による組み合わせが適用可能である。
(a)〜(j)及び図3を参照して説明する。図1
(a)において、銅板などの金属基材13を用いてその
両面にエッチングレジスト14を塗布する。このエッチ
ングレジスト14には、例えば感光性樹脂が好適に用い
られる。このエッチングレジスト14上にフォトマスク
を重ね合わせて露光現像することにより、金属膜形成部
位に対応するエッチングレジスト14を除去して図1
(b)に示すレジストパターン15を形成する。具体的
には、図3に示すように、金属基材13の搭載用凹部1
6に対応する部位に、中央抜きパターン20及び該中央
抜きパターン20を囲むリング状抜きパターン21を各
々形成する。また、図1(b)に示すように、金属基材
13の接続用凹部17に対応する部位に、接続用抜きパ
ターン22を形成する。
ジスト14をマスクとして金属基材13をハーフエッチ
ングして搭載用凹部16と接続用凹部17を形成する。
具体的には、リング状抜きパターン21と中央抜きパタ
ーン20間の金属基材13をサイドエッチングにより除
去して中央部よりも一段高い段部を有する搭載用凹部1
6を形成すると共に、該搭載用凹部16の周囲に離間し
て接続用凹部17を形成する。このように、搭載用凹部
16とその周囲に離間して接続用凹部17が1回の露光
エッチング工程でそれぞれ形成される。この場合、ハー
フエッチングの面積や深さは、リング状抜きパターン2
1と中央抜きパターン20の大きさや形状などのフォト
マスクのデザインを変えることで自在に調整できる。ま
た、金属基材13として銅板を用いた場合には、エッチ
ング液には塩化第2鉄等が好適に用いられる。
ジスト14をマスクとして搭載用凹部16及び接続用凹
部17内に電解めっきにより金属膜を多層形成して、搭
載部金属膜4及び接続部金属膜5をそれぞれ形成する。
前述したように実装面側より金層9、パラジウム層1
0、ニッケル層11、及びパラジウム層12の四層膜に
て形成する。尚、エッチングレジスト14を除去した
後、別途めっき用レジストパターンを形成して上記搭載
用凹部16及び接続用凹部17内に電解めっきを行って
も良い。また、上記各金属膜は電解めっき法に限らず、
蒸着法或いはスパッタリング法により形成しても良い。
尚、各金属膜と金属基材13との分離性を高めるため、
予め、搭載用凹部16及び接続用凹部17に導電ペース
トなどの分離性を高める部材を塗布しておいても良い。
の両面を覆うエッチングレジストを除去してキャリア基
板18が形成される。キャリア基板18の中央部には搭
載部金属膜4が段状(本実施例では2段)に形成され、
その周囲には接続部金属膜5が離間して多数形成されて
いる。
18に形成された搭載部金属膜4に接着剤層3を介して
半導体素子2を搭載する。接着剤層3としては、熱放散
性及び導電性を考慮して銀の粒子を含んだエポキシ樹脂
剤(銀ペースト)が好適に用いられる。次いで、図1
(g)において、搭載部金属膜4の段部4a及び接続部
金属膜5に、例えば金バンプなどのスタッドバンプ19
を形成する。このスタッドバンプ19は、例えば特開平
10−79448号に開示されたように、キャピラリを
用いてパラジウム層12に超音波溶接により金ボールを
ボールボンディングし、該金ボールをキャピラリの下動
により一旦押し潰してから上動させて金ワイヤを切断す
ることにより形成される。このように金ボールを押し潰
すことにより、パラジウム層12に強固に接合させるこ
とができる。また、スタッドバンプ19とワイヤ6とは
同一材質であるため、接合性を向上させることができ
る。尚、このスタッドバンプ19は、ワイヤ6を直接接
続部金属膜5や段部4aに接合可能な場合には省略する
ことも可能である。
の電極部2aと、搭載部金属膜4及び接続部金属膜5に
形成されたスタッドバンプ19とをワイヤ6により電気
的に接続する。このとき、ワイヤボンディングはキャピ
ラリにより先ずワイヤ6の一端を電極部2a側に接合し
てから他端をスタッドバンプ19に接合する。或いは先
ずワイヤ6の一端をスタッドバンプ19に接合に接合し
てから他端を電極部2a側に接合しても良い。この場合
には、ワイヤループの低背化を図ることができる。尚、
高密度配線に伴うショート等の不具合を防止するため、
金ワイヤ6は、絶縁材料により被覆された被覆ワイヤで
あっても良い。
18を図示しない樹脂封止装置に搬入して、エポキシ樹
脂により樹脂封止する。キャリア基板18の一面側に搭
載された半導体素子2や搭載部金属膜4及び接続部金属
膜5の半導体素子搭載面側は樹脂封止部7により覆われ
ている。
18から樹脂封止部7を搭載部金属膜4及び接続部金属
膜5と共に分離する。分離工程は、搭載部金属膜4及び
接続部金属膜5に相当する各金属膜を残して金属基材1
3をエッチングにより除去することにより分離しても良
いし、或いは樹脂封止部7をキャリア基板18から機械
的に引き剥がすことにより分離しても良い。
4をハーフエッチングにより段状に形成したので、半導
体素子2の直近に形成された段部4aと半導体素子2の
グランド用電極部とをワイヤ6により最短距離で接続で
きる。これによって、搭載部金属膜4をグランド端子部
に形成することができ、半導体素子2へのノイズの侵入
を抑えてシールド効果を高めることができる。また、搭
載部金属膜4を1回の露光エッチング工程を経て段状に
形成できるので、半導体装置1の製造工程を大幅に簡略
化して、低コストで量産化を図ることが可能である。ま
た、半導体装置1に用いられるキャリア基板18及びそ
の製造方法によれば、搭載部金属膜4を1回の露光エッ
チング工程を経て段状に形成できるので、2回目以降の
露光エッチング工程を行う際に1回目に形成されたエッ
チングパターンに対してフォトマスクを高精度にアライ
メントする必要もないので、不良品の発生率を低減させ
て歩留まりを向上させることができる。
述べてきたが、本発明は上述した各実施例に限定される
のものではなく、例えば多層に形成した各金属膜の構成
や材質は適宜変更可能であり、段状に形成した搭載部金
属膜4の段部4aの数などは任意に変更可能である等、
発明の精神を逸脱しない範囲で多くの改変を施し得るの
はもちろんである。
法を用いると、半導体装置の搭載部金属膜をハーフエッ
チングにより段状に形成したので、半導体素子の直近に
形成された段部と半導体素子のグランド用電極部とをワ
イヤにより最短距離で接続できる。これによって、搭載
部金属膜をグランド端子部に形成することができ、半導
体素子へのノイズの侵入を抑えてシールド効果を高める
ことができる。また、搭載部金属膜を1回の露光エッチ
ング工程を経て段状に形成できるので、半導体装置の製
造工程を大幅に簡略化して、低コストで量産化を図るこ
とが可能である。また、半導体装置に用いられるキャリ
ア基板及びその製造方法によれば、搭載部金属膜を1回
の露光エッチング工程を経て段状に形成できるので、2
回目以降の露光エッチング工程を行う際に1回目に形成
されたエッチングパターンに対してフォトマスクを高精
度にアライメントする必要もないので、不良品の発生率
を低減させて歩留まりを向上させることができる。
ある。
る。
Claims (8)
- 【請求項1】 半導体素子と、 該半導体素子を底部に搭載すると共に、該底部の周囲に
その位置よりも高い段部を形成した搭載部金属膜と、 該搭載部金属膜の周囲に離間して位置し、前記半導体素
子の信号用電極部と電気的に接続した接続部金属膜と、 前記搭載部金属膜及び前記接続部金属膜の実装面側を露
出させて前記半導体素子、搭載部金属膜及び接続部金属
膜を樹脂封止した樹脂封止部とを具備し、 前記搭載部金属膜の段部と前記半導体素子のグランド用
電極部とを電気的に接続したことを特徴とする半導体装
置。 - 【請求項2】 前記搭載部金属膜及び前記接続部金属膜
は、実装面側より金層、パラジウム層、ニッケル層、及
びパラジウム層の四層膜により形成されていることを特
徴とする請求項1記載の半導体装置。 - 【請求項3】 請求項1又は2に記載の半導体装置の製
造に用いられるキャリア基板であって、金属基材の一面
側に、中央部に向けて段状に低くなるように形成された
搭載用凹部と、該搭載用凹部の周囲に離間して形成され
た接続用凹部とが形成され、前記搭載用凹部及び接続用
凹部内に搭載部金属膜及び接続部金属膜がそれぞれ形成
されていることを特徴とするキャリア基板。 - 【請求項4】 請求項3記載のキャリア基板の製造方法
において、 前記金属基材の両面にエッチングレジストを塗布する工
程と、 前記エッチングレジストに、前記金属基材の前記搭載用
凹部に対応する部位に、中央抜きパターン及び該中央抜
きパターンを囲むリング状抜きパターンをそれぞれ形成
すると共に、前記金属基材の前記接続用凹部に対応する
部位に、接続用抜きパターンを形成する工程と、 前記エッチングレジストをマスクとして前記金属基材を
ハーフエッチングし、前記リング状抜きパターンと中央
抜きパターンとの間の金属基材をサイドエッチングによ
り除去して中央部よりも高い段部を有する前記搭載用凹
部を形成すると共に、該搭載用凹部の周囲に離間して前
記接続用凹部を形成する工程と、 前記搭載用凹部及び前記接続用凹部に、搭載部金属膜及
び接続部金属膜をそれぞれ形成する工程と、 前記エッチングレジストを除去する工程とを含むことを
特徴とするキャリア基板の製造方法。 - 【請求項5】 請求項3記載のキャリア基板を用いた半
導体装置の製造方法において、 前記キャリア基板の搭載部金属膜に半導体素子を搭載す
る工程と、 前記半導体素子のグランド用電極部と前記搭載部金属膜
の段部とを電気的に接続すると共に、前記半導体素子の
信号用電極部と前記接続部金属膜とを電気的に接続する
工程と、 前記搭載部金属膜、前記接続部金属膜及び前記半導体素
子を封止して樹脂封止部を形成する工程と、 前記キャリア基板から前記樹脂封止部を前記搭載部金属
膜及び接続部金属膜と共に分離する工程とを含むことを
特徴とする半導体装置の製造方法。 - 【請求項6】 前記半導体素子を搭載部金属膜に搭載し
た後、前記キャリア基板の前記搭載部金属膜及び接続部
金属膜上にスタッドバンプを形成する工程を有すること
を特徴とする請求項5記載の半導体装置の製造方法。 - 【請求項7】 前記金属基材をエッチングにより除去し
て前記キャリア基板から前記樹脂封止部を分離すること
を特徴とする請求項5又は6記載の半導体装置の製造方
法。 - 【請求項8】 前記樹脂封止部を前記キャリア基板から
引き剥がして分離することを特徴とする請求項5又は6
記載の半導体装置の製造方法。
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Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003303920A (ja) * | 2002-04-10 | 2003-10-24 | Hitachi Cable Ltd | 配線板及びそれを用いた半導体装置の製造方法 |
JP2005197744A (ja) * | 2004-01-08 | 2005-07-21 | Internatl Business Mach Corp <Ibm> | 電子パッケージ |
JP2008010729A (ja) * | 2006-06-30 | 2008-01-17 | Hitachi Aic Inc | 実装基板 |
JP2009141054A (ja) * | 2007-12-05 | 2009-06-25 | Furukawa Electric Co Ltd:The | 半導体装置 |
KR101091889B1 (ko) * | 2004-01-17 | 2011-12-08 | 삼성테크윈 주식회사 | 연성회로기판 |
CN109285823A (zh) * | 2017-07-19 | 2019-01-29 | 大口电材株式会社 | 半导体元件搭载用基板以及其制造方法 |
JP2019057587A (ja) * | 2017-09-20 | 2019-04-11 | 大口マテリアル株式会社 | 半導体素子搭載用基板及びその製造方法 |
CN113791030A (zh) * | 2021-09-13 | 2021-12-14 | 国网山东省电力公司电力科学研究院 | 一种埋地金属构件土壤腐蚀原位检测传感器 |
Families Citing this family (42)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6143981A (en) | 1998-06-24 | 2000-11-07 | Amkor Technology, Inc. | Plastic integrated circuit package and method and leadframe for making the package |
KR100369393B1 (ko) | 2001-03-27 | 2003-02-05 | 앰코 테크놀로지 코리아 주식회사 | 리드프레임 및 이를 이용한 반도체패키지와 그 제조 방법 |
JP4054188B2 (ja) * | 2001-11-30 | 2008-02-27 | 富士通株式会社 | 半導体装置 |
US7368391B2 (en) * | 2002-04-10 | 2008-05-06 | Micron Technology, Inc. | Methods for designing carrier substrates with raised terminals |
JP2004103860A (ja) | 2002-09-10 | 2004-04-02 | Fujitsu Ltd | 半導体装置、カメラモジュール及びその製造方法 |
TW586677U (en) * | 2003-01-22 | 2004-05-01 | Via Tech Inc | Stack structure of chip package |
US7009286B1 (en) * | 2004-01-15 | 2006-03-07 | Asat Ltd. | Thin leadless plastic chip carrier |
US20060087010A1 (en) * | 2004-10-26 | 2006-04-27 | Shinn-Gwo Hong | IC substrate and manufacturing method thereof and semiconductor element package thereby |
US8163604B2 (en) * | 2005-10-13 | 2012-04-24 | Stats Chippac Ltd. | Integrated circuit package system using etched leadframe |
US7507603B1 (en) | 2005-12-02 | 2009-03-24 | Amkor Technology, Inc. | Etch singulated semiconductor package |
US7968998B1 (en) | 2006-06-21 | 2011-06-28 | Amkor Technology, Inc. | Side leaded, bottom exposed pad and bottom exposed lead fusion quad flat semiconductor package |
US8014154B2 (en) * | 2006-09-27 | 2011-09-06 | Samsung Electronics Co., Ltd. | Circuit substrate for preventing warpage and package using the same |
US7977774B2 (en) | 2007-07-10 | 2011-07-12 | Amkor Technology, Inc. | Fusion quad flat semiconductor package |
US7956453B1 (en) | 2008-01-16 | 2011-06-07 | Amkor Technology, Inc. | Semiconductor package with patterning layer and method of making same |
US8067821B1 (en) | 2008-04-10 | 2011-11-29 | Amkor Technology, Inc. | Flat semiconductor package with half package molding |
US7808084B1 (en) | 2008-05-06 | 2010-10-05 | Amkor Technology, Inc. | Semiconductor package with half-etched locking features |
US8184453B1 (en) | 2008-07-31 | 2012-05-22 | Amkor Technology, Inc. | Increased capacity semiconductor package |
US7847392B1 (en) | 2008-09-30 | 2010-12-07 | Amkor Technology, Inc. | Semiconductor device including leadframe with increased I/O |
US7989933B1 (en) | 2008-10-06 | 2011-08-02 | Amkor Technology, Inc. | Increased I/O leadframe and semiconductor device including same |
US8008758B1 (en) | 2008-10-27 | 2011-08-30 | Amkor Technology, Inc. | Semiconductor device with increased I/O leadframe |
US8089145B1 (en) | 2008-11-17 | 2012-01-03 | Amkor Technology, Inc. | Semiconductor device including increased capacity leadframe |
US8072050B1 (en) | 2008-11-18 | 2011-12-06 | Amkor Technology, Inc. | Semiconductor device with increased I/O leadframe including passive device |
US7875963B1 (en) | 2008-11-21 | 2011-01-25 | Amkor Technology, Inc. | Semiconductor device including leadframe having power bars and increased I/O |
US7982298B1 (en) | 2008-12-03 | 2011-07-19 | Amkor Technology, Inc. | Package in package semiconductor device |
US8487420B1 (en) | 2008-12-08 | 2013-07-16 | Amkor Technology, Inc. | Package in package semiconductor device with film over wire |
US8176628B1 (en) | 2008-12-23 | 2012-05-15 | Amkor Technology, Inc. | Protruding post substrate package structure and method |
US8680656B1 (en) | 2009-01-05 | 2014-03-25 | Amkor Technology, Inc. | Leadframe structure for concentrated photovoltaic receiver package |
US20170117214A1 (en) | 2009-01-05 | 2017-04-27 | Amkor Technology, Inc. | Semiconductor device with through-mold via |
US8058715B1 (en) | 2009-01-09 | 2011-11-15 | Amkor Technology, Inc. | Package in package device for RF transceiver module |
US8026589B1 (en) | 2009-02-23 | 2011-09-27 | Amkor Technology, Inc. | Reduced profile stackable semiconductor package |
US7960818B1 (en) | 2009-03-04 | 2011-06-14 | Amkor Technology, Inc. | Conformal shield on punch QFN semiconductor package |
US8575742B1 (en) | 2009-04-06 | 2013-11-05 | Amkor Technology, Inc. | Semiconductor device with increased I/O leadframe including power bars |
US8648450B1 (en) | 2011-01-27 | 2014-02-11 | Amkor Technology, Inc. | Semiconductor device including leadframe with a combination of leads and lands |
TWI557183B (zh) | 2015-12-16 | 2016-11-11 | 財團法人工業技術研究院 | 矽氧烷組成物、以及包含其之光電裝置 |
US9704725B1 (en) | 2012-03-06 | 2017-07-11 | Amkor Technology, Inc. | Semiconductor device with leadframe configured to facilitate reduced burr formation |
KR101486790B1 (ko) | 2013-05-02 | 2015-01-28 | 앰코 테크놀로지 코리아 주식회사 | 강성보강부를 갖는 마이크로 리드프레임 |
CN103346140A (zh) * | 2013-06-10 | 2013-10-09 | 孙青秀 | 一种基于框架采用镀银技术的封装件及其制作工艺 |
KR101563911B1 (ko) | 2013-10-24 | 2015-10-28 | 앰코 테크놀로지 코리아 주식회사 | 반도체 패키지 |
US9673122B2 (en) | 2014-05-02 | 2017-06-06 | Amkor Technology, Inc. | Micro lead frame structure having reinforcing portions and method |
JP6149072B2 (ja) | 2015-07-07 | 2017-06-14 | アオイ電子株式会社 | 半導体装置およびその製造方法 |
JP7134137B2 (ja) * | 2019-05-31 | 2022-09-09 | 三菱電機株式会社 | 半導体装置 |
JP7271337B2 (ja) * | 2019-06-27 | 2023-05-11 | 新光電気工業株式会社 | 電子部品装置及び電子部品装置の製造方法 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6072239A (en) | 1995-11-08 | 2000-06-06 | Fujitsu Limited | Device having resin package with projections |
JP3181229B2 (ja) * | 1996-07-12 | 2001-07-03 | 富士通株式会社 | 半導体装置及びその製造方法及びその実装方法及びリードフレーム及びその製造方法 |
JP3007833B2 (ja) | 1995-12-12 | 2000-02-07 | 富士通株式会社 | 半導体装置及びその製造方法及びリードフレーム及びその製造方法 |
JPH1167838A (ja) * | 1997-08-22 | 1999-03-09 | Matsushita Electric Ind Co Ltd | バンプ付電子部品の製造方法 |
JP3031323B2 (ja) * | 1997-12-26 | 2000-04-10 | 日本電気株式会社 | 半導体装置とその製造方法 |
JP2000195984A (ja) * | 1998-12-24 | 2000-07-14 | Shinko Electric Ind Co Ltd | 半導体装置用キャリア基板及びその製造方法及び半導体装置及びその製造方法 |
JP4362163B2 (ja) * | 1999-04-06 | 2009-11-11 | 富士通マイクロエレクトロニクス株式会社 | 半導体装置の製造方法 |
-
1999
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-
2000
- 2000-09-26 US US09/670,258 patent/US6423643B1/en not_active Expired - Lifetime
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- 2000-09-29 KR KR1020000057415A patent/KR100721839B1/ko active IP Right Grant
Cited By (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003303920A (ja) * | 2002-04-10 | 2003-10-24 | Hitachi Cable Ltd | 配線板及びそれを用いた半導体装置の製造方法 |
JP2005197744A (ja) * | 2004-01-08 | 2005-07-21 | Internatl Business Mach Corp <Ibm> | 電子パッケージ |
KR101091889B1 (ko) * | 2004-01-17 | 2011-12-08 | 삼성테크윈 주식회사 | 연성회로기판 |
JP2008010729A (ja) * | 2006-06-30 | 2008-01-17 | Hitachi Aic Inc | 実装基板 |
JP2009141054A (ja) * | 2007-12-05 | 2009-06-25 | Furukawa Electric Co Ltd:The | 半導体装置 |
CN109285823A (zh) * | 2017-07-19 | 2019-01-29 | 大口电材株式会社 | 半导体元件搭载用基板以及其制造方法 |
JP2019021815A (ja) * | 2017-07-19 | 2019-02-07 | 大口マテリアル株式会社 | 半導体素子搭載用基板及びその製造方法 |
JP2019057587A (ja) * | 2017-09-20 | 2019-04-11 | 大口マテリアル株式会社 | 半導体素子搭載用基板及びその製造方法 |
TWI787343B (zh) * | 2017-09-20 | 2022-12-21 | 日商大口電材股份有限公司 | 半導體元件搭載用基板及其製造方法 |
CN113791030A (zh) * | 2021-09-13 | 2021-12-14 | 国网山东省电力公司电力科学研究院 | 一种埋地金属构件土壤腐蚀原位检测传感器 |
CN113791030B (zh) * | 2021-09-13 | 2024-05-31 | 国网山东省电力公司电力科学研究院 | 一种埋地金属构件土壤腐蚀原位检测传感器 |
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