DE3604368C2 - - Google Patents
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Description
Die vorliegende Erfindung betrifft ein Verfahren zur
Herstellung eines Dünnfilm-Transistors (im folgenden
als TFT bezeichnet), der für eine Flüssigkristall-
Anzeigevorrichtung des Typs einer aktiven Matrix geeignet
ist.
Eine Flüssigkristall-Anzeigevorrichtung dieses Typs,
bei der die TFT auf einem Substrat einer Anzeige-Zelle
in Matrix-Form angeordnet sind, ermöglicht eine
Massenspeicher-Anzeige hoher Qualität.
Eine solche Vorrichtung
wird bei Fernsehgeräten und dergleichen intensiv
angewandt (Takechi, Yamazaki and Okita, Electronic
Communication Society, ED 84-71 [1984], S. 17-19).
Ein herkömmliches Verfahren zur Herstellung eines für
Flüssigkristall-Anzeigen geeigneten TFT-Feldes ist in
Fig. 14 (A) und 14 (B) erläutert. Fig. 14 (A) zeigt die
Draufsicht eines Elements des mittels eines konventionellen
Verfahrens hergestellten TFT-Feldes. Fig. 14 (B)
zeigt eine Schnittansicht des Bildelementes längs
der Geraden X-X′. Eine Schicht aus einem Metall wie
Aluminium und dergleichen wird auf ein transparentes
isolierendes Substrat 70 aufgebracht und durch Photoätzen
in die Form einer stabförmigen Gate-Elektrode 71
gebracht. Eine Gate-Isolierschicht 72 aus einem Oxid-
Film oder einem Nitrid-Film und eine Halbleiterschicht
73 aus Si, CdS oder dergleichen werden nacheinander
aufgebracht, anschließend wird die Halbleiterschicht 73
geätzt. Auf den Halbleiter 73 wird eine transparente
Elektrodenschicht aufgebracht und
geätzt, wodurch eine stabförmige Source-Elektrode 76
und eine Drain-Elektrode oder Anzeige-Elektrode 77 gebildet
wird.
Wie im vorstehenden beschrieben, erfordert das herkömmliche
Verfahren wenigstens zweimal eine Ausrichtung der
Masken, da es wenigstens drei Ätzmasken verwendet. Dies
macht das Fertigungsverfahren für das TFT-Feld
kompliziert und bedingt hohe Kosten und niedrige Ausbeuten.
Ziel der vorliegenden Erfindung ist es, das Verfahren
zur Herstellung von TFT-Feldern durch Einsatz
zweier Masken-Schichten und nur einer Masken-Ausrichtung
zu vereinfachen und dadurch die Herstellbarkeit zu
verbessern.
Die vorliegende Erfindung betrifft ein Verfahren zur Herstellung
eines Dünnfilm-Transistors, das die
folgenden Schritte umfaßt:
Herstellen von vier Schichten durch Aufbringen einer Metallschicht als Gate-Elektrode, einer ersten Isolierschicht als Gate-Isolierschicht, einer Halbleiterschicht und einer Elektrodenschicht, die einen Ohmschen Kontakt mit der Halbleiterschicht bildet, auf ein isolierendes Substrat,
Aufbringen einer Photolackschicht und Ätzen der vier Schichten zur Bildung eines Musters,
Aufbringen einer zweiten Isolierschicht, wobei die Photolackschicht verbleibt,
Entfernen der verbliebenen Photolackschicht zur Herstellung eines Musters mittels eines Abhebeverfahrens,
Aufbringen einer transparenten leitfähigen Schicht als Source-Elektrode und Drain-Elektrode oder Anzeige- Elektrode,
Ätzen der transparenten leitfähigen Schicht und der Elektrodenschicht.
Herstellen von vier Schichten durch Aufbringen einer Metallschicht als Gate-Elektrode, einer ersten Isolierschicht als Gate-Isolierschicht, einer Halbleiterschicht und einer Elektrodenschicht, die einen Ohmschen Kontakt mit der Halbleiterschicht bildet, auf ein isolierendes Substrat,
Aufbringen einer Photolackschicht und Ätzen der vier Schichten zur Bildung eines Musters,
Aufbringen einer zweiten Isolierschicht, wobei die Photolackschicht verbleibt,
Entfernen der verbliebenen Photolackschicht zur Herstellung eines Musters mittels eines Abhebeverfahrens,
Aufbringen einer transparenten leitfähigen Schicht als Source-Elektrode und Drain-Elektrode oder Anzeige- Elektrode,
Ätzen der transparenten leitfähigen Schicht und der Elektrodenschicht.
Eine weitere Ausführungsform der vorliegenden Erfindung
betrifft ein Verfahren zur Herstellung eines
Dünnfilm-Transistors, das die folgenden
Schritte umfaßt:
Herstellen von vier Schichten durch Aufbringen einer Metallschicht als Gate-Elektrode, einer ersten Isolierschicht als Gate-Isolierschicht, einer Halbleiterschicht und einer Elektrodenschicht, die einen Ohmschen Kontakt mit der Halbleiterschicht bildet, auf ein isolierendes Substrat,
Aufbringen einer Photolackschicht und Ätzen der vier Schichten zur Bildung eines Musters,
anodische Oxidation an den Kanten der Metallschicht zur Bildung einer zweiten Isolierschicht,
Aufbringen einer transparenten leitfähigen Schicht als Source-Elektrode und Drain-Elektrode oder Anzeige-Elektrode,
Ätzen der transparenten leitfähigen Schicht und der Elektrodenschicht, die einen Ohmschen Kontakt mit der Halbleiterschicht bildet.
Herstellen von vier Schichten durch Aufbringen einer Metallschicht als Gate-Elektrode, einer ersten Isolierschicht als Gate-Isolierschicht, einer Halbleiterschicht und einer Elektrodenschicht, die einen Ohmschen Kontakt mit der Halbleiterschicht bildet, auf ein isolierendes Substrat,
Aufbringen einer Photolackschicht und Ätzen der vier Schichten zur Bildung eines Musters,
anodische Oxidation an den Kanten der Metallschicht zur Bildung einer zweiten Isolierschicht,
Aufbringen einer transparenten leitfähigen Schicht als Source-Elektrode und Drain-Elektrode oder Anzeige-Elektrode,
Ätzen der transparenten leitfähigen Schicht und der Elektrodenschicht, die einen Ohmschen Kontakt mit der Halbleiterschicht bildet.
Ausführungsbeispiele der Erfindung werden
anhand der Zeichnungen näher erläutert.
Fig. 1 (A) und 1 (B) zeigen eine Draufsicht und eine
Schnittansicht längs der Geraden X-X′ der ersten Ausführungsform
des TFT der vorliegenden Erfindung;
Fig. 2 (A) und 2 (B) bis Fig. 7 (A) und 7 (B) zeigen Draufsichten
und Schnittansichten längs der Geraden X-X′ zur
Erläuterung der ersten Ausführungsform des Verfahrens
zur Herstellung des TFT der vorliegenden Erfindung;
Fig. 8 (A) und 8 (B) zeigen eine Draufsicht und eine
Schnittansicht längs der Geraden X-X′ der zweiten Ausführungsform
des TFT der vorliegenden Erfindung;
Fig. 9 (A) und 9 (B) bis Fig. 13 (A) und 13 (B) zeigen
Draufsichten und Schnittansichten längs der Geraden
X-X′ zur Erläuterung der zweiten Ausführungsform des
Verfahrens zur Herstellung des TFT der vorliegenden
Erfindung;
Fig. 14 (A) und 14 (B) zeigen eine Draufsicht und eine
Schnittansicht längs der Geraden X-X′ eines herkömmlichen
TFT.
Fig. 1 (A) und 1 (B) zeigen die Draufsicht und eine
Schnittansicht längs der Geraden X-X′ eines
Elements des TFT-Feldes, das mittels des Verfahrens
der vorliegenden Erfindung hergestellt ist. Die
Zahl der in dieser Ausführungsform eingesetzten Masken
beträgt zwei, von denen die eine zur Bildung der Muster
des Riegels der Gate-Elektrode 11, einer Gate-Isolierschicht
12, einer Halbleiterschicht 13 und einer Elektrodenschicht
14, die einen Ohmschen Kontakt mit der
Halbleiterschicht 13 bildet, dient und die andere zur
Bildung der Muster der Source-Elektrode 16,
der Drain-Elektrode oder Anzeige-Elektrode 17 und der
Elektrodenschicht 14 dient. Das Fertigungsverfahren und
der konkrete Aufbau werden in den Fig. 2 bis 7 erläutert.
Eine Al-Schicht 11′, die später die Gate-Elektrode
11 bildet, wird auf einem Glas-Substrat 10 in einer
Dicke von 200 nm durch Zerstäubung abgeschieden. Die
Gate-Isolierschicht 12′ aus Si₃N₄, die Halbleiterschicht
13′ aus amorphem, hydrierten Silicium (a-Si:H)
und die Elektrodenschicht 14′ aus mit Phosphor dotiertem
a-Si:H (n⁺a-Si:H), die einen Ohmschen Kontakt mit
dem a-Si:H 13′ herstellt, werden auf die Al-Schicht 11′
nacheinander mittels chemischer Abscheidung im Plasma
aus der Dampfphase (Plasma-CVD) aufgebracht. Die Dicke
dieser Schichten beträgt 200 nm, 200 nm bzw. 100 nm.
Nach dem Herstellen der vier Schichten wird ein Photolack
18 aufgetragen und unter Verwendung der ersten
Maske zur Entwicklung belichtet.
Die vermittels Schritt I hergestellten vier Schichten
werden geätzt, wodurch ein Muster gebildet wird. Das
Ätzmittel des n⁺a-Si:H 14′ und des a-Si:H 13′ ist eine
Mischlösung von HF und HNO₃, das Ätzmittel für
Si₃N₄ ist eine 5%ige HF-Lösung. Das Ätzmittel für die
Al-Schicht 11′ ist eine wäßrige H₃PO₄-Lösung. Das Ätzen
kann in der Weise durchgeführt werden, daß das beschichtete Substrat
in die verschiedenen Ätzmittel eingetaucht und mit immer der gleichen
Photolackmaske geätzt wird.
In diesem Schritt wird die zweite Isolierschicht 15 aus
Si₃N₄ ganzflächig, somit auch auf den verbleibenden Photolack 18 aufgebracht,
wodurch die strukturierte Gate-Elektrode 11 mit der Isolierschicht
bedeckt wird. Der Zweck dieses Schrittes besteht
darin, einen elektrischen Kontakt der
Gate-Elektrode 11 mit der Source-Elektrode 16
und der Drain-Elektrode oder Anzeige-Elektrode 17 zu
verhindern. Die zweite Isolierschicht 15 kann durch
Aufbringen einer Si₃N₄-Schicht in einer Dicke von 500 nm
bei 100°C mittels Plasma-CVD gebildet werden, wodurch
die Bedeckung vervollständigt wird.
In diesem Schritt wird die Si₃N₄-Isolierschicht 15 auf
dem Photolack 18 in einen Lackentferner getaucht,
wodurch sie zusammen mit dem Photolack 18 entfernt
wird, d. h., es wird ein Muster mittels des sogenannten
Abhebe-Verfahrens (Lift-off-Verfahren) gebildet. Durch
die Entfernung des Photolackes tritt die Oberfläche
der n⁺a-Si:H-Schicht 14′ in Erscheinung.
In diesem Schritt wird die transparente leitfähige
Schicht 17′ auf die gesamte
Oberfläche in einer Dicke von 300 nm durch
Vakuum-Aufdampfen aufgebracht, um die Source-
Elektrode 16 und die Drain-Elektrode oder Anzeige-Elektrode
17 zu bilden. Nach dem Aufbringen derselben wird
eine Photolackschicht 19 aufgetragen, durch eine
zweite Maske belichtet und zu einer gewünschten Form
entwickelt. Die Masken-Ausrichtung wird nur einmal in
diesem Schritt durchgeführt, was das Verfahren vereinfacht
und niedrige Produktionskosten zur Folge hat.
In diesem Schritt wird die transparente leitfähige
Schicht 17′ mit dem aufgebrachten Photolack 19 geätzt, wodurch die
Struktur der Source-Elektrode 16 und der
Drain-Elektrode oder Anzeige-Elektrode 17 hergestellt
wird, gefolgt vom Ätzen des n⁺a-Si:H 14′, das einen
Ohmschen Kontakt bildet. Das Ätzmittel für die transparente
leitfähige Schicht 17′ ist eine HCl-Lösung,
das Ätzmittel für das n⁺a-Si:H 14′ ist eine Mischlösung
von HF und HNO₃. Das Ätzen der transparenten leitfähigen
Schicht 17′ wird in der Weise durchgeführt, daß das
beschichtete Substrat in die verschiedenen Ätzmittel eingetaucht wird,
wodurch die Source-Elektrode 16 und die
Drain-Elektrode oder Anzeige-Elektrode 17 hergestellt
werden. Weiterhin wird die n⁺a-Si:H-Schicht 14′ zu der
Elektrode 14 geätzt, die einen Ohmschen Kontakt der
a-Si:H-Halbleiterschicht 13 mit der Source-Elektrode 16
und der Drain-Elektrode 17 bildet.
Der Photolack 19 wird entfernt, wodurch ein TFT
gebildet wird, wie er in Fig. 7 (A) und 7 (B) dargestellt
ist.
Die resultierenden TFTs werden in Form einer Matrix auf
dem Substrat angeordnet, wobei die Gate-Elektrode
11 und die Source-Elektrode 16
in Richtung der Matrix verlängert werden, so daß sie Kontakt
mit den anderen TFTs bekommen und ein TFT-Feld
bilden. Wenn das TFT-Feld als Zelle
einer Flüssigkristall-Anzeigevorrichtung eingesetzt
wird, vermag die Massenspeicher-Anzeige-Information
in dieser Anzeige als klares Bild zu erscheinen.
Gemäß der vorliegenden Erfindung werden TFTs unter Verwendung
von nur zwei Masken hergestellt, womit erreicht
wird, daß die Masken-Ausrichtung, die den
kompliziertesten Schritt der Behandlung darstellt, nur
ein einziges Mal durchgeführt werden muß. Dies führt zu
niedrigen Kosten und hohen Ausbeuten.
Fig. 8 (A) und 8 (B) zeigen die Draufsicht und eine
Schnittansicht längs der Geraden X-X′ eines Bildelementes
des TFT-Feldes, das mittels des Verfahrens
der vorliegenden Erfindung hergestellt ist. Die
Zahl der in dieser Ausführungsform eingesetzten Masken
beträgt zwei, von denen die eine zur Bildung der Muster
der Gate-Elektrode 11, einer Gate-Isolierschicht
12, einer Halbleiterschicht 13 und einer Elektrodenschicht
14, die einen Ohmschen Kontakt mit der
Halbleiterschicht 13 bildet, dient und die andere zur
Bildung der Muster der Source-Elektrode 16,
der Drain-Elektrode oder Anzeige-Elektrode 17 und der
Elektrodenschicht 14 dient. Das Fertigungsverfahren und
der konkrete Aufbau werden in den Fig. 9 bis 13 erläutert.
Eine Al-Schicht 11′, die später die Gate-Elektrode
11 bildet, wird auf einem Glas-Substrat 10 in einer
Dicke von 200 nm durch Zerstäubung abgeschieden. Die
Gate-Isolierschicht 12′ aus Si₃N₄, die Halbleiterschicht
13′ aus amorphem, hydriertem Silicium (a-Si:H)
und die Elektrodenschicht 14′ aus mit Phosphor dotiertem
a-Si:H (n⁺a-Si:H), die einen Ohmschen Kontakt mit
dem a-Si:H 13′ herstellt, werden auf die Al-Schicht 11′
nacheinander mittels chemischer Abscheidung im Plasma
aus der Dampfphase (Plasma-CVD) aufgebracht. Die Dicke
dieser Schichten beträgt 200 nm, 200 nm bzw. 100 nm.
Nach dem Herstellen der vier Schichten wird ein Photolack
18 aufgetragen und unter Verwendung der ersten
Maske zur Entwicklugn belichtet.
Die vermittels des obigen Schrittes I hergestellten vier
Schichten werden geätzt, wodurch ein Muster gebildet
wird. Das Ätzmittel des n⁺a-Si:H 14′ und des a-Si:H 13′
ist eine Mischlösung von HF und HNO₃, das Ätzmittel
für Si₃N₄ ist eine 5%ige HF-Lösung. Das Ätzmittel für
die Al-Schicht 11′ ist eine wäßrige H₃PO₄-Lösung. Das
Ätzen kann in der Weise durchgeführt werden, daß das beschichtete
Substrat in die verschiedenen Ätzmittel eingetaucht und mit immer der gleichen
Photolackmaske geätzt wird.
In diesem Schritt wird die Al-Schicht 11′, die später
die Gate-Elektrode 11 bildet, an den
Kanten des Musters anodisch oxidiert. Der Zweck dieses
Schrittes ist, einen elektrischen Kontakt
der Gate-Elektrode 11 mit der Source-
Elektrode 16 und der Drain-Elektrode oder Anzeige-Elektrode
17 zu verhindern. Die anodische Oxidation der
Kantenteile des Musters erfolgt in der Weise, daß sie
bei 40 V mit einer Ammoniumborat-Lösung behandelt wird,
wodurch eine Al₂O₃-Schicht 20 an den Kanten
der Gate-Elektrode 11 gebildet wird.
In dem vorstehenden Verfahren wird für die Gate-Elektrode
11 Al verwendet und an den Kanten des Musters
Al₂O₃ gebildet, jedoch können für die
Gate-Elektrode 11 auch andere Metalle wie Ta,
Nb, Hf und dergleichen eingesetzt werden, die durch anodische
Oxidation eine Isolierschicht bilden.
In diesem Schritt wird die transparente leitfähige
Schicht 17′ auf die gesamte
Oberfläche in einer Dicke von 300 nm durch
Vakuum-Aufdampfen aufgebracht, um die Source-
Elektrode 16 und die Drain-Elektrode oder Anzeige-Elektrode
17 auszubilden. Nach dem Aufbringen derselben
wird eine Photolackschicht 19 aufgetragen, durch
eine zweite Maske belichtet und zu einer gewünschten
Form entwickelt. Die Masken-Ausrichtung wird nur
einmal in diesem Schritt durchgeführt, was das Verfahren
vereinfacht und niedrige Produktionkosten zur Folge
hat.
In diesem Schritt wird die transparente leitfähige
Schicht 17′ mit dem aufgebrachten Photolack 19 geätzt, wodurch
die Struktur der Source-Elektrode 16 und der
Drain-Elektrode oder Anzeige-Elektrode 17 hergestellt
wird, gefolgt vom Ätzen des n⁺a-Si:H 14′, das einen
Ohmschen Kontakt bildet. Das Ätzmittel für die transparente
leitfähige Schicht 17′ ist eine HCl-Lösung,
das Ätzmittel für das n⁺a-Si:H 14′ ist eine Mischlösung
von HF und HNO₃. Das Ätzen der transparenten leitfähigen
Schicht 17′ wird in der Weise durchgeführt, daß das
beschichtete Substrat in die verschiedenen Ätzmittel eingetaucht wird,
wodurch die Source-Elektrode 16 und die
Drain-Elektrode oder Anzeige-Elektrode 17 hergestellt
werden. Weiterhin wird die n⁺a-Si:H-Schicht 14′ zu der
Elektrode 14 geätzt, die einen Ohmschen Kontakt der
a-Si:H-Halbleiterschicht 13 mit der Source-Elektrode 16
und der Drain-Elektrode 17 bildet.
Der Photolack 19 wird entfernt, wodurch ein TFT
gebildet wird, wie er in Fig. 8 (A) und 8 (B) dargestellt
ist.
Die resultierenden TFTs werden in Form einer Matrix auf
dem Substrat angeordnet, wobei die Gate-Elektrode
11 und die Source-Elektrode 16
in Richtung der Matrix verlängert werden, so daß sie Kontakt
mit den anderen TFTs bekommen und ein TFT-Feld
bilden. Wenn das TFT-Feld als Zelle
einer Flüssigkristall-Anzeigevorrichtung eingesetzt
wird, vermag die Massenspeicher-Anzeige-Information
in dieser Anzeige als klares Bild zu erscheinen.
Gemäß der vorliegenden Erfindung werden TFTs unter Verwendung
von nur zwei Masken hergestellt, womit
erreicht wird, daß die Masken-Ausrichtung, die den
kompliziertesten Schritt der Behandlung darstellt, nur
ein einziges Mal durchgeführt werden muß. Dieses verursacht
geringe Kosten und liefert hohe Ausbeuten.
Claims (3)
1. Verfahren zur Herstellung eines Dünnfilm-Transistors
durch
- a) Herstellen von vier Schichten durch Aufbringen einer Metallschicht als Gate-Elektrode (11), einer ersten Isolierschicht als Gate-Isolierschicht (12), einer Halbleiterschicht (13) und einer Elektrodenschicht (14), die einen Ohmschen Kontakt mit der Halbleiterschicht (13) bildet, auf ein isolierendes Substrat (10),
- b) Aufbringen einer Photolackschicht (18) und Ätzen der vier Schichten zu Bildung eines Musters,
- c) Aufbringen einer zweiten Isolierschicht (15), wobei die Photolackschicht (18) verbleibt,
- d) Entfernen der verbliebenen Photolackschicht (18) mittels eines Abhebeverfahrens,
- e) Aufbringen einer transparenten leitfähigen Schicht als Source-Elektrode (16) und Drain-Elektrode oder Anzeige- Elektrode (17),
- f) Ätzen der transparenten leitfähigen Schicht (16, 17) und der Elektrodenschicht (14), die einen Ohmschen Kontakt mit der Halbleiterschicht (13) bildet.
2. Verfahren zur Herstellung eines Dünnfilm-Transistors
nach Anspruch 1, gekennzeichnet durch
- c′) anodische Oxidation an den Kanten der Metallschicht (1) zur Bildung einer zweiten Isolierschicht (20)
anstelle der Schritte c und d.
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