DE1961739A1 - Halbleitervorrichtung und Verfahren zu ihrer Herstellung - Google Patents
Halbleitervorrichtung und Verfahren zu ihrer HerstellungInfo
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- 239000004065 semiconductor Substances 0.000 title claims description 60
- 238000000034 method Methods 0.000 title claims description 15
- 239000012535 impurity Substances 0.000 claims description 35
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 claims description 33
- 229910052737 gold Inorganic materials 0.000 claims description 32
- 239000010931 gold Substances 0.000 claims description 32
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 16
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 16
- 239000013078 crystal Substances 0.000 claims description 13
- 238000004519 manufacturing process Methods 0.000 claims description 12
- XEEYBQQBJWHFJM-UHFFFAOYSA-N Iron Chemical compound [Fe] XEEYBQQBJWHFJM-UHFFFAOYSA-N 0.000 claims description 6
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 claims description 6
- 229910052710 silicon Inorganic materials 0.000 claims description 4
- 239000010703 silicon Substances 0.000 claims description 4
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 3
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 3
- HCHKCACWOHOZIP-UHFFFAOYSA-N Zinc Chemical compound [Zn] HCHKCACWOHOZIP-UHFFFAOYSA-N 0.000 claims description 3
- 229910052802 copper Inorganic materials 0.000 claims description 3
- 239000010949 copper Substances 0.000 claims description 3
- 229910052742 iron Inorganic materials 0.000 claims description 3
- 229910052759 nickel Inorganic materials 0.000 claims description 3
- TWNQGVIAIRXVLR-UHFFFAOYSA-N oxo(oxoalumanyloxy)alumane Chemical compound O=[Al]O[Al]=O TWNQGVIAIRXVLR-UHFFFAOYSA-N 0.000 claims description 3
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 3
- 229910052725 zinc Inorganic materials 0.000 claims description 3
- 239000011701 zinc Substances 0.000 claims description 3
- 230000015572 biosynthetic process Effects 0.000 claims description 2
- 239000000463 material Substances 0.000 claims description 2
- 238000000151 deposition Methods 0.000 claims 2
- 239000000126 substance Substances 0.000 claims 2
- 241000251730 Chondrichthyes Species 0.000 claims 1
- 239000004020 conductor Substances 0.000 claims 1
- 230000008021 deposition Effects 0.000 claims 1
- 238000009792 diffusion process Methods 0.000 description 12
- 230000015556 catabolic process Effects 0.000 description 11
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 10
- 229910052796 boron Inorganic materials 0.000 description 10
- 238000002955 isolation Methods 0.000 description 8
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 5
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 4
- 239000003574 free electron Substances 0.000 description 4
- 239000011810 insulating material Substances 0.000 description 4
- 238000009413 insulation Methods 0.000 description 4
- 229910052698 phosphorus Inorganic materials 0.000 description 4
- 239000011574 phosphorus Substances 0.000 description 4
- 238000011282 treatment Methods 0.000 description 4
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 3
- 230000010354 integration Effects 0.000 description 3
- 238000013459 approach Methods 0.000 description 2
- 239000012141 concentrate Substances 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- 238000005530 etching Methods 0.000 description 2
- 239000000758 substrate Substances 0.000 description 2
- GYHNNYVSQQEPJS-UHFFFAOYSA-N Gallium Chemical compound [Ga] GYHNNYVSQQEPJS-UHFFFAOYSA-N 0.000 description 1
- BLRPTPMANUNPDV-UHFFFAOYSA-N Silane Chemical group [SiH4] BLRPTPMANUNPDV-UHFFFAOYSA-N 0.000 description 1
- 229910052787 antimony Inorganic materials 0.000 description 1
- WATWJIUSRGPENY-UHFFFAOYSA-N antimony atom Chemical compound [Sb] WATWJIUSRGPENY-UHFFFAOYSA-N 0.000 description 1
- 229910052785 arsenic Inorganic materials 0.000 description 1
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 1
- 230000009286 beneficial effect Effects 0.000 description 1
- 238000011109 contamination Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000010292 electrical insulation Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000002349 favourable effect Effects 0.000 description 1
- 229910052733 gallium Inorganic materials 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000011835 investigation Methods 0.000 description 1
- 230000003446 memory effect Effects 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 230000036316 preload Effects 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
- 229910052594 sapphire Inorganic materials 0.000 description 1
- 239000010980 sapphire Substances 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- 238000005979 thermal decomposition reaction Methods 0.000 description 1
- 235000012773 waffles Nutrition 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
- H01L27/06—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration
- H01L27/0611—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region
- H01L27/0641—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration integrated circuits having a two-dimensional layout of components without a common active region without components of the field effect type
- H01L27/0647—Bipolar transistors in combination with diodes, or capacitors, or resistors, e.g. vertical bipolar transistor and bipolar lateral transistor and resistor
- H01L27/0652—Vertical bipolar transistor in combination with diodes, or capacitors, or resistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02367—Substrates
- H01L21/0237—Materials
- H01L21/02373—Group 14 semiconducting materials
- H01L21/02381—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02521—Materials
- H01L21/02524—Group 14 semiconducting materials
- H01L21/02532—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02612—Formation types
- H01L21/02617—Deposition types
- H01L21/02636—Selective deposition, e.g. simultaneous growth of mono- and non-monocrystalline semiconductor materials
- H01L21/02639—Preparation of substrate for selective deposition
-
- H—ELECTRICITY
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02656—Special treatments
- H01L21/02658—Pretreatments
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/763—Polycrystalline semiconductor regions
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- Microelectronics & Electronic Packaging (AREA)
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- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
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- Chemical & Material Sciences (AREA)
- Crystallography & Structural Chemistry (AREA)
- Materials Engineering (AREA)
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Description
Patentanwalt·
Dlpl.-Inc. H. Deetz u.
Maho 81-15.199Ρ(15·2ΟΟΗ) 9-12.1969
HITACHI, LTD., Tokio (Japan)
Halbleitervorrichtung und Verfahren zu ihrer Herstellung
Die Erfindung bezieht sich auf Halbleitervorrichtungen mit Hochwideretandszonenf insbesondere auf eine Halbleitervorrichtung
mit einer Mehrzahl von elektrisch isolierten Zonen für Schaltkreiselemente in einem einstückigen
Halbleiterkörper, und außerdem auf ein Verfahren zu ihrer Herstellung·
Es ist gut bekannt, daß ein in einem Halbleiterkörper
durch Einführen einer Leitfähigkeitstyp-bestimmenden Verunreinigung erzeugter PN-Übergang unter Gegenvorspannungsbedingungen
einen hohen Widerstand zeigt* Bs ist ebenfalls bekannt, daß ein spannungsgeeteuertes negative«
Wideretandeelement unter Auenutzung eines quantenme-
81-Poe. 19 962)-Tp-r (7)
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chanischen Tunneleffekts (oft als Tunneldiode bezeichnet)
durch starkes Verunreinigungsdotieren in einem Halbleiterkörper vorgesehen werden kann. Weiter sind auch
solche Elemente wie ein PNPN-Blement und eine Doppelbasisdiode
bekannt, die einen stromgesteuerten negativen Widerstand zeigen.
In integrierten Halbleiterschaltungen erfordert die
Herstellung einer Mehrzahl von Schaltelementzonen in ei- ^ nem einstückigen Halbleiterkörper die Isolierung jedes
Schaltkreiselements, um eine gegenseitige elektrische Beeinflussung
mehrerer Elemente zu verhindern. Eine der grundsätzlichsten Lösungen zum Isolieren von Elementen
in einem Körper verwendet PN-Übergänge. Dabei tritt eine
Zone eines zweiten Leitfähigkeitstyps zwischen die Schaltelementzonen
des ersten Leitfähigkeitstyps. Andere Verfahren, wie z. B0 die dielektrische Isolierung und Luftspalt!
sollerung sind ebenfalls bekannt.
Diese Isolierverfahren erfordern jedoch mehr als einen Sohritt einer selektiven Diffusionsbehandlung oder
einer selektiven Ätzbehandlung eines Halbleiterkörpers, ψ und diese Behandlungen müssen mit großer Präzision durchgeführt
werden. So sind diese Verfahren in der Praxis störanfällig· Weiter erfordern Isolationszonen zum Isolieren
von Schaltkreiseleraenten viel Platz, wodurch die Integrationsdichte
und der Nutzen eines Halbleiterkörpers verringert werden· Sie haben außerdem den Nachteil, daß die
Herstellungskosten hoch werden, da die Hersteilverfahren
kompliziert aind*
Der Erfindung liegt daher dl« Aufgab« «ugrundej eine
Ho ciiwideret and« vorrichtung zn »chAff^n* >■■:.&>
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Isolationstechniken angewendet werden. Dabei geht es um die Schaffung einer stromgesteuerten negativen Widerstandsvorrichtung.
Außerdem soll durch die Erfindung eine integrierte Halbleiterschaltungsvorrichtung mit einer
Mehrzahl von Schaltelementen geschaffen werden, die integral in einem Halbleiterkörper mit hoher Dichte erzeugt
sind.
Diese Aufgabe wird erfindungsgemäß durch eine Halbleitervorrichtung
gelöst) die durch eine monokristalline Halbleiterzone und
eine polykristalline Halbleiterzone gekennzeichnet ist, die direkt an die monokristalline Zone angrenzt und
mit einer Verunreinigung dotiert ist, die eine tiefe Schwelle darin bildete
Nach einem Ausführungsbeispiel der Erfindung wird eine Halbleitervorrichtung durch Ausbilden von monokristallinen
und polykristallinen Zonen eines zweiten Leitfähigkeit styps in einem Halbleiter- oder Isolierstoffkörper
eines ersten Leitfähigkeitstyps,auf dem teilweise
ein Film aus Siliziumoxyd oder dgl· angebracht ist, und durch Einführen einer Tiefschwellenverunreinigung wie
Gold oder einer Mischung einer solchen Verunreinigung und einer Flachschwellenverunreinigung erzeugt, die den
ersten Leitfähigkeitstyp bestimmt.
Die Merkmale und Vorteile der Erfindung werden anhand der in der Zeichnung veranschaulichten Ausführungsbeispiele
näher erläutert} darin zelgent
Fig. 1a bis Ie im Querschnitt, wie eine Halbleiter-
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waffel in den verschiedenen Herstellverfahrensschritten
nach einem Ausführungsbeispiel der Erfindung aussieht;
Figo 2a bis 2e im Querschnitt, wie eine Halbleiterwaffel in den verschiedenen Herstellverfahrensschritten
einer integrierten Halbleiterschaltung gemäß einem weiteren Ausführungsbeispiel der Erfindung aussieht?
Fig. 3 eine Aufsicht der Halbleiterwaffel, deren
Querschnitt nach der Linie Ia-Ia in Fig. 1a dargestellt ist;
Fig. k eine Spannungs-Strom-Kurve, aufgenommen zwischen
einer monokristallinen Siliziumzone und einer angrenzenden polykristallinen Siliziumzone
;
Fig. 5 eine Spannungfs-Strom-Kurve eines entgegengesetzt
vorgespannten PN-Überganges;
Fig. 6 und 7 Spannungs-Strom-Kurven von integrierten Halbleiterschaltungen gemäß anderen Ausführungsbeispielen
der Erfindung; und
Fig. 8 und 9 Spannungs-Strom-Kurven von Halbleitervorrichtungen,
die eine monokristalline Halbleiterzone und eine angrenzende polykristalline
Halbleiterzone umfassen, worin Gold enthalten
ist, gemäß weiteren Aueführungsbeispielen der Erfindung.
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Um die Probleme zu lösen, die beim Isolieren von Halbleiterzonen in einer integrierten Schaltung auftreten,
wurde ein Verfahren in der TJS-Anmeldung Ser. Nr. 662 6k6
unter dem Titel "MANUFACTURE OF SEMICONDUCTOR DEVICE" von
Katsumi Ogiue, die auf die Anmelderin vorliegender Anmeldung übertragen wurde, vorgeschlagen, eine epitaxiale
Zone in eine Mehrzahl von Zonen unter der Ausnutzung der Tatsache zu trennen, daß, wenn ein Epitaxial-Einkristall
auf einem Halbleiter, der teilweise mit einem Siliziumoxydfilm bedeckt ist, aufwächst, ein Polykristall auf dem
Siliziumoxydfilm wächst und die Diffusionsgeschwindigkeit einer Verunreinigung in einem solchen Polykristall viel
größer als die eines Einkristalls ist, wobei dieses Verfahren den Schritt der Einführung einer Verunreinigung
eines dem des Epitaxial-Einkristalls entgegengesetzten Leitfähigkeitstyps in solche polykristalline Zonen umfaßt.
Dabei wurde ein PN-Übergang an einer solchen Stelle in der monokristallinen Zone gebildet, die in der Nachbarschaft
der polykristallinen Zone liegt. Dieser PN-Übergang zeigte unter Bedingungen negativer Vorspannung das
Spannung-Stromverhalten nach Fig. 5· Als Ergebnis weiterer Untersuchungen wurde gefunden, daß sich ein höherer
Widerstand, eine höhere Durchbruchspannung und ein spannungsgesteuerter
negativer Widerstand zwischen einer monokristallinen Zone und einer angrenzenden polykristallinen
Zone durch Einfüllen nur einer Tiefschwellen-Verunreinigung wie Gold in die polykristalline Zone erzielen lassen
und daß eine noch höhere Durchbruchspannung durch Einführen
einer Leitfähigkeitstyp-beatlmmenden Verunreinigung in die polykristalline Zone, die mit einer Tiefschwellen-Verunreinigung
wie Gold dotiert ist, erhalten werden kann. Verschiedene Ausführungsbeiepiele der Erfindung basieren
auf diesem Befund.
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Die Fig. 1a bis 1e zeigen ein typisches Beispiel der Herstellungsschritte einer Halbleitervorrichtung gemäß
der Erfindung. Zunächst wird ein Siliziumoxydfilm 22 in einer Gitterform auf einer in einer (111)-Kristallebene
liegenden Hauptoberfläche eines Halbleiterkörpers 21 gebildet, der z. B, aus einer P-Typ-Siliziumunterlage
von 200 /U Dicke besteht und einen spezifischen Widerstand
von 10 £X · cm hat, wie Fig. 1a zeigt. Fig. 3 zeigt ™ eine Aufsicht dieser Waffel. Dieser Sillziumoxydfilm 22
hat eine Dicke von 0,7 /U und eine Breite von 20 /u und
ist in einer Gitterform ausgebildet, wodurch Quadrate mit Seitenlängen von 124 /a. eingeschlossen werden.
Dann wird eine Epitaxialschicht 23 auf dem Körper 21 gebildet, wie Fig. 1b zeigt. Bei diesem Schritt wurde der
Körper 21 10 Minuten auf eine Temperatur von 1200 C erhitzt,
um eine Epitaxial-Siliziumschicht 23 mit einer Dicke von etwa 10 /U durch thermische Zersetzung von Monosilan
zu bilden. Die Epitaxialschicht 23 erhielt eine Verunreinigung von Phosphor, um einen N-Leitfähigkeits-
ψ typ mit einem spezifischen Widerstand von 1 Xi. · cm zu erzielen.
Die Epitaxialschicht 23 umfaßte monokristalline Siliziumzonen 24a und 24b, die direkt auf dem monokristalline
Siliziumzonen 24a und 24b, die direkt auf dem monokristallinen Siliziumkörper 21 aufwuchsen, und eine polykristalline
Zone 24c, die auf dem Siliziumoxydfilm 22 aufwuchs. Als das Spannungs-Stromverhalten zwischen einer monokristallinen
Siliziumzone 24a und der angrenzenden polykristallinen Zone 24c gemessen wurde, ergab sich für die
meisten Teile der polykristallinen Zone die in Fig. 4 gezeigte Kurve, und es wurde kein hoher Widerstand gefunden.
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Dann wurde ein Siliziumoxydfilm 25 auf der Oberfläche der Epitaxialschicht 23 erzeugt, wie Fig. 1c zeigt.
Der Körper 21 und die Epitaxialschicht 23 (diese beiden
sollen im folgenden als Körper 20 bezeichnet werden) wurden nämlich auf eine Temperatur von 1200 0 erhitzt, um
einen thermisch erzeugten Oxydfilm 25 von 1 yu Dicke auf der Epitaxialschicht 23 zu bilden.
Dann wurde eine Goldschicht 26 auf der anderen Hauptoberfläche des Körpers 20 bis zu einer Dicke von 5000 ü.
(Fig. Id) niedergeschlagen, und der Körper 20 wurde auf eine Temperatur von 900 bis 1200 °G erhitzt - und sollte
vorzugsweise 40 Hinuten auf 1200 C erhitzt werden - um
das Gold in den Körper 20 eindiffundieren zu lassen. Bei diesem Verfahrensschritt wird Gold vorzugsweise bis zu einer Konzentration von etwa 10 bis 10 Atome/cm eingeführt.
Als das Spannungs-Stromverhaiten zwischen den monokristallinen Zonen 24a, 24b und der polykristallinen Zone
24c, und zwar zwischen den Anschlüssen 31» 28 und 27 der Vorrichtung nach Fig. 1e mit einem Kurvenschreiber erfaßt
wurde, stellte man einen hohen Widerstand und eine hohe Durchbruchspannung von etwa 100 Volt beim Anlegen einer
positiven Spannung an der N-Typ-Einkristallzone 24a oder
24b fest, wie im dritten Quadranten der Fig. 6 gezeigt ist. Wenn die Polarität d r angelegten Spannung umgekehrt
wurde, zeigte dies·* Spannungs-Stromverhalten ebenfalls
einen hohen Widerstand und «ine Durchbruohspannung von
etwa 80 Volt, wie ie ersten Quadranten der Fig. 6 gezeigt
ist, woraus sich ein negativer Widerstand ergibt (Teil 61} diese Tatsache soll ±m einzelnen noch im Zusammenhang mit
den Fig. 8 und 9 erläutert werden). Dieses Verhalten hat
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angenähert ähnliche Merkmale für beide Richtungen, und ein hoher Widerstand für beide Richtungen zeigt an, daß
die polykristalline Zone und die monokristalline Zone
unabhängig von der Richtung der Vorspannung gegenseitig isoliert sind.
So wirkt die polykristalline Zone 24c praktisch als Hochwiderstandszone, um die Einkristallzonen 24a und 24b
elektrisch voneinander zu isolieren. Entsprechende Schaltkreiselemente, wie z. B. Transistoren, lassen sich in
diesen isolierten Einkristallzonen 24a und 24b ausbilden.
Ein anderes Ausiführungsbeispiel zur Herstellung einer
Halbleitervorrichtung nach der Erfindung ist in den Fig. 2a bis 2c erläutert, in denen gleiche Bezugsziffern gleiche
Teile wie in Fig. 1 bedeuten. Zunächst wurden die Behandlungsschritte,
die in den Fig. 1a bis 1c dargestellt sind, bei einem Halbleiterkörper 21 durchgeführt.
Dann wurde der Siliziumoxydfilm 25 teilweise entfernt,
um die Oberfläche der Epitaxialschicht 23 so weit freizulegen,
wie Fig. 2a zeigt, und Bor wurde auf der freigelegten Oberfläche der Epitaxialschicht 23 35 Minuten bei einer
Temperatur von 950 C niedergeschlagen. Dann wurde eine
Goldsohicht Z6 von 5000 A Dicke auf der anderen Hauptoberfläche
des Körpers 20 niedergeschlagen.
Anschließend wurde der Körper 20 40 Minuten auf «ine
Temperatur von 1200 0C erhitzt, um gleichzeitig das nieder-
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geschlagene Bor und das niedergeschlagene Gold in den
Körper 20 eindiffundieren zu lassen» Da Gold einen sehr großen Diffusionskoeffizienten in Silizium aufweist,
diffundierte es in den ganzen Körper ein. Bor dagegen diffundierte nur in den Teil ein, wo der Siliziumoxydfilm
25 entfernt war, und in dessen Nachbarschaft, und zwar bis auf eine Tiefe von 3 /U„
Nichtsdestoweniger hat Bor eine größere Diffusionsgeschwindigkeit in einem Polykristall, so daß es in die
ganze polykristalline Zone 24c und zusätzlich etwa in die monokristallinen Zonen 24a und 24b eindiffundierte, um
die entsprechenden PN-Übergänge 28a und 28b zu bilden,
18 während die P-Typ-Zone 30 (Oberflächendichte = 5 χ 10
Atome/cm ), die durch die Diffusion von Bor in den einkristallinen
Zonen 24a und 24b gebildet war, wie erwähnt, eine Diffusionstiefe von nur 3 /u hatte.
Als das Spannungs-Stromverhalten zwischen den Einkristallzonen
24a, 24b und der polykristallinen Zone 24c (der durch Diffusion von Bor eine P-Tendenz gegeben war)
mit einem Kurvenschreiber unter diesen Umständen gemessen wurde, ergab sich die Kurve nach Fig. 7· So wurde gefunden,
daß die Vorwärts-Durchbruchspannung etwa 50 Volt und
die Rückwärtsdurchbruchspannung etwa 230 Volt betrugen.
Anschließend wurde Phosphor selektiv in die P-Typ-Zone 30 (Basis), die mit Bor dotiert war, eipdiffundiert,
um eine N-Emitterzone zu erhalten« So wurden NPN-Transistoren
in den monokristallinen Zonen 24a und 24b gebildet,
die durch eine polykristalline Zone 24c isoliert waren·
Kein großer Widerstand wurde zwischen der polykristallinen Zone 24c, die eine Donor-.Verunreinigung enthielt und
009825/152?
auf dem Siliziumoxydfilm 22 erzeugt war, und der monokristallinen Zone 24a in direkter Naehbarschaft dazu festgestellt, doch trat ein großer Widerstand auf, wenn Gold
in den Körper 20 eindiffundiert war. Weiter wurde die
Rückwärtsdurehbruchspannung durch Eindiffundieren von Bor in die polykristalline Zone 24c sehr stark· In Fällen, wo Akzeptorverunreinigungen in eine polykristalline
Zone eindiffundiert wurden, stellte man negative Widerstände weder in Vorwärts- noch in Rückwärtsrichtung fest»
Ein Vorteil der vorstehenden Trenntechnik liegt darin, daß die elektrische Isolierung der entsprechenden
Schaltkreiselemente gleichzeitig mit der Diffusion einer Tiefschwellen-Verunreinigung, wie Gold, vorgenommen werden kann, die als Dauerunterdrücker zur Verringerung des
Minoritätsträger-Speichereffekts im Fall eines logischen Kreises (z. B. eines Transistor-Transistor-Logikkreises)
wirkt. Dies macht d ie Diffusionsbehandlung (Isolierungsdiffusion) einer Leitfähigkeitstyp-bestimmenden Verunreinigung zur Isolierung, die beim herkömmlichen Verfahren
erforderlich ist, unnötig, was für die Massenproduktion eines integrierten Logikkreises förderlich ist.
Fig. 8 zeigt das Spannungs-Stromverhalten, das an
den Anschlüssen 3t und 28 der Vorrichtung des ersten, in
Fig. 1e dargestellten Ausführungsbeispiels festgestellt
wurde. Wie diese Figur zeigt, 1st zwischen diesen Anschlüssen 31 und 28 festzustellen, daß ein hoher Widerstand auftritt, daß ein stromgesteuerter negativer Widerstand auf»
tritt (·. Teile 8t und 82) und daß diese hohen Widerstände und negativen Widerstände in beiden Richtungen auftreten«
Die Existenz des hohen Widerstandes zeigt, daß die Zonen
24a und 24b im wesentlichen elektrisch voneinander isoliert
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sind. Der negative Widerstand kann zur Bildung eines Generators ausgenutzt werden. Der hohe Widerstand in beiden
Richtungen zeigt auch, daß die Zonen 24a und 24b unabhängig von der Richtung der Vorspannung isoliert sind. Dies
kann mit einer herkömmlichen Isolation mit einem PN-Übergang verglichen werden, in welchem nur eine Richtung von
Vorspannung möglich ist«,
Fig. 9 zeigt das Spannungs-Stromverhalten bei einem
anderen Ausführungsbeispiel, ähnlich dem ersten Ausführungsbeispiel, jedoch dadurch modifiziert, daß die Schritte nach den Fig. 1a bis 1e an einem Körper vorgenommen
werden, der eine Hauptoberfläche der Kristallebenenorientierung (1OO) hat, und daß eine Epitaxialschicht 23 30 Minuten bei einer Temperatur im Bereich von 900 bis 1000 C
aufwächst. Ähnlich dem Fall nach Fig. 8 wird dieses Verhalten an Anschlüssen festgestellt, die an den benachbarten monokristallinen Zonen vorgesehen sind, zwischen denen
eine polykristalline Zone liegt« Bin hoher Widerstand und ein negativer Widerstand werden in beiden Richtungen ähnlich dem Fall nach Fig. 8 festgestellt. Weiter hat eine
polykristalline Zone, die auf einem Siliziumoxydfilm aufwächst, eine schwach wachsende Dimension, wenn der Abstand
vom Oxydfilm wächst. Wenn z. B. ein Siliziumoxydfilm 22 eine Breite von 20 yu hat, wird die Breite der Oberfläche
der polykristallinen Zone 24c 25 bis 30 /U im ersten Ausführungsbeispiel und 20 bis 21 /a im Fall der (100)-Kristall ebene. Außerdem kann die enge Breite der polykristallinen Xsolationszon· 24c z. B* zu 5 /U bestimmt werden,
wenn dl· Breite de» Siliziumoxydfilms 22 etwa 5 /u beträgt· Nach der herkömmlichen Isolationstechnik mit einem
PN-Übergang- oder Ätzschritt wird mindestens eine Breite
von 20 ax für eine Isolationszone benötigt· So ist die
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Breite einer Isolationszone, die erfindungsgemäß benötigt wird, viel geringer als die herkömmliche, und die Erfindung
ist sehr vorteilhaft zur Erhöhung der Integrationsdichte·
Insbesondere ist die Oberflächenorientierung nach (TOO) sehr günstig für die Verbesserung der Integrationsdichte·
Da die Rüekwärtsdurchbruchspannung zwischen der Unterlage
und einer monokristallinen Zone etwa 300 Volt ist, ist anzunehmen, daß die Verhaltenskurven nach Fig. 8 und
die Rüekwärtsdurchbruchspannung zwischen einer monokristallinen
und einer polykristallinen Zone zeigen.
Veiter haben die Durchbrucheigenschaften nach den
Fig* 6, 7> 8 und 9 ein Erholungspotential, und es wurde
bestätigt, daß ein thermischer Durchbruch bei einem Strom—
fluß von etwa 200 bis 300 mA nicht auftritt. Der Grund für
das Auftreten: von hohem Widerstand wird darauf zurückgeführt,,
daß Gold sich in der polykristallinen Zone Zh konzentriert
und dazu, führt»; daß die letztere als Hochwider—
standsζone wirkt»
Soldi vorhalt sich nämlich sowohl als Akzeptor- als
auch aus.«· Donori-VeruHreiiiigung; und reagiert sehr empfind—
lieh mit sowohl N- als auch F-Typenf da das
0*5% e¥ uMiftea? dem Leitband liegt und das Donorniveaw 0,35
&Ψ ü&ear dient besetzten oder gefÜLÜltes* Niveau liegt·
So liegt das Fermi-Niveau eines nur mit einer Flachniveau-N^Typ-.Veruä3?einiguiig
wi· Phosphor dotierten Η-^φ«
Silixiumkrietalls bei normalen Temperaturen in der Nähe
da« Bodena d»e Leitbande·. Venn Gold weiter ixt d«n SiIizlumkriatall
eindotiert wird, fallen freie Elektronen in
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das Akzeptorniveau von Gold, und die Zahl der freien Elektronen, die auf das Leitband erregt sind, nimmt ab·
Wenn die Goldeinfangkonzentration gleich der Flachniveau-Donor-Konzentration wird, nimmt die Dichte der freien
Elektronen rapid ab, wobei der Widerstand rapid steigt, wenn sich das Fermi-Niveau dem Eigenleit-Fermi-Niveau
nähert« Wenn Gold weiter.stark dotiert wird, fällt die Konzentration der freien Elektronen weiter, und das Fermi-Niveau
sinkt unter das Eigenleit-Fermi-Niveau. Der Widerstand zeigt den Maximalwert, wenn sich die Elektronen und
Löcher in solcher Weise verteilen, daß η /a = P/U- (nj
Zahl der Elektronen, p: Zahl der Löcher, /u t Beweglichkeit
eines Elektrons und yu, χ Beweglichkeit eines Loches)o
Wenn Gold noch weiter dotiert wird, wandelt sich N-SiIizium
in den P-Typ um, und der Widerstand fällt auf den Wert zurück, der bestimmt ist, wenn Gold die dominierende
Verunreinigung ist. Es versteht sich aus dem Vorstehenden, daß, wenn die niedergeschlagene Epitaxialschicht vom N-Typ
ist, die Konzentration des dotierten Goldes vorzugsweise gleich oder mehr als die Konzentration einer N-Typ-Verunreinigung
in der polykristallinen Zone ist. Da Gold in einer polykristallinen Zone eine merklich größere Diffusionsgeschwindigkeit
als in einer monokristallinen Zone hat und zur Segregation neigt, konzentriert es sich in der
polykristallinen Zone und übt insbesondere auf die polykristalline Zone einen Einfluß aus. Daher muß das Dotieren
des Goldes nloht selektiv an der polykristallinen Zone vorgenommen werden, sondern kann von der ganzen Unterseite
des Halbleiterkörpers oder von der Gesamtoberfläche mittels Dampf erfolgen.
Obwohl nur Gold als Beispiel in den Ausführungsbeispielen angegeben ist, können Zink, Eisen, Kupfer, Nickel
ORIGINAL INSPECTED
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usw. gleichfalle verwendet werden, die eine tiefe Schwelle
in einem Halbleiter bilden«
Wenn die polykristallinen Zonen außerdem mit Bor dotiert sind, wie in dem Fall des zweiten Ausführungsbeispiels beschrieben ist, werden PN-Übergänge in den
polykristallinen Zonen 24c oder in den monokristallinen
Zonen 24a und 24b in der Nachbarschaft der polykristallinen Zonen 24c gebildete Man nimmt an, daß diese PN-Übergänge dazu beitragen, mit der Wirksamkeit der Golddotierung die Durchbruchspannung zu erhöhen·
Als flachschwellenbildende Leitfähigkeitstyp-bestimmende Verunreinigung, die einen PN-Übergang bildet,
kann Gallium usw. ebensogut wie Bor als P-Typ-Verunreinigung und können Phosphor, Arsen, Antimon usw. als N-Typ-Verunreinigungen verwendet werden.
Weiter können Materialien, wie z. B. Siliziumnitrid, Aluminiumoxyd usw., worauf ein Halbleiter nicht in monokristalliner Form wächst, ebensogut wie Siliziumoxyd als
Isolierfilm 22 verwendet werden. Die Dicke, Breite und andere Abmessungen des Isolierfilms können auch geeignet
variiert werden. Weiter lassen sich für die Erzeugung einer polykristallinen Sohicht andere Verfahren zur Bildung von Keimen für Polykristalle ebenfalls anwenden»
Zum Beispiel kann die Oberfläche eines Einkristalls teilweise dem Sandstrahlen unterworfen werden. Der Körper 21
muß kein Halbleiter sein, sondern kann auch «in Isoliermaterial, wie z. B. Saphir sein, wenn ein monokristalliner Halbleiter epitaxial darauf aufwächst. Nach einem anderen Beispiel werden monokristalline und polykristalline
Zonen zunäohst auf einer Unterlage erzeugt, dann bringt
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man darauf ein Isoliermaterial, wie ζ« B0 Glas dick auf,
und schließlich, wird die erste Unterlage entfernt, um
das Isoliermaterial als Träger zu verwenden.
Claims (1)
- Patentansprüche(jl·· Halbleitervorrichtung, gekennzeichnet durcheine monokristalline Halbleiterzone (z. B. 24a) undeine polykristalline Halbleiterzone (z. B. 24c), die direkt an die monokristalline Zone angrenzt und mit einer Verunreinigung (26) dotiert ist, die eine tiefe Schwelle darin bildet.2. Halbleitervorrichtung nach Anspruch 1, dadurch gekennzeichnet, daß die Verunreinigung (26) aus wenigstens einem Element der Gruppe Gold, Zink, Eisen, Kupfer und Nickel besteht.3. Halbleitervorrichtung nach Anspruch 1, dadurch gekennzeichnet, daß die monokristalline Zone (z· B· 24a) mit einer Erstleitfähigkeitstyp-bestimmenden Verunreinigung und Gold dotiert ist, und daß die polykrietalline Zone (z. B. 24c) mit Gold und einer Zweitleitfähigkeitstyp-bestimmenden Verunreinigung dotiert ist.4· Halbleitervorrichtung mit negativem Widerstand in beiden Richtungen, gekennzeichnet durchein Paar von monokristallinen HaIbIeItersonen (24a, 24b),009825/1522eine polykristalline Halbleiter ζ one (24o), die direkt an die monokristallinen Zonen angrenzt,zwischen diesen liegt und mit Gold dotiert ist, undein Paar von an den einkristallinen Zonen angebrachten Anschlüssen (28, 31).5· Halbleitervorrichtung,'gekennzeichnet durcheinen monokristallinen Halbleiterkörper (21) mit einer Hauptoberfläche,eine monokristalline Halbleiterzone (z. B, 24a), die epitaxial auf der Hauptoberfläche aufgewachsen ist,eine polykristalline Halbleiterzone (z, B0 24c), die auf der Hauptoberfläche des Halbleiterkörpers direkt angrenzend an die monokristalline Zone und diese einfassend gebildet ist und in der eine tiefschwellenbildende Verunreinigung verteilt ist·6· Halbleitervorrichtung nach Anspruch 5» dadurch gekennzeichnet, daß sie einen Isolierfilm (22) zwischen der polykristallinen Zone (24c) und dem Halbleiterkörper (21) aufweist.7· Halbleitervorrichtung nach Anspruch 3t dadurch gekennzeichnet, daß der monokristalline Halbleiterkörper (21) eine Erstleitfähigkeitatyp-bestimmende Verunreinigung ent hält, die monokristallinen und die polykristallinen HaIb-009825/1522leiterzonen (24ar 24c) mit einer Zweitleitfähigkeitstypbestimmenden. Verunreinigung dotiert sind und die polykristalline Zone soviel Gold enthält, daß es über die Zweitieitfähigkeitstyp-bestimmende Verunreinigung dominiert.8. Halbleitervorrichtung nach Anspruch 6, dadurch gekennzeichnet, daß der Körper (21), die monokristalline Zone (24a) und die polykristalline Zone (24c) im wesentlichen aus Silizium bestehen, der Isolierfilm (22) aus mindestens einem Material der Gruppe Siliziumoxyd, Siliziumnitrid und Aluminiumoxyd besteht und die tiefschwellenbildende Verunreinigung Gold ist·9« Halbleitervorrichtung nach Anspruch 7» dadurch gekennzeichnet, daß die polykristalline Halbleiterzone (24c) mit der Erstleitfähigkeitstyp-bestimmenden Verunreinigung dotiert ist.10. Halbleitervorrichtung nach Anspruch 8, dadurch ge-14 kennzeichnet, daß die Konzentration an Gold 10 bis; 10 ^ Atome/cm ist."lie Verfahren zur Herstellung eier Halbleitervorrichtung, gekennzeichnet durch, die Verfahreneschritte»Herstellung «ines Halbleiterkörpers eines ersten Leitfähigkeitstype mit einer Hauptoberfläche,00 9 825/1522Bildung von Keimen für einen Polykristall auf der Hauptoberfläche in dem Teil, der eine bestimmte Zone umfaßt,Niederschlagen eines Halbleiters, der eine Zweitleitfähigkeitstyp-bestimmende Verunreinigung enthält, aus Dampf auf der Hauptoberflache, um eine Zweitleitfähigkeitstyp-Einkristallzone auf der bestimmten Zone und eine polykristalline Halbleiterzone mit einem Gehalt an der Zweitleitfähigkeitstypbestimmenden Verunreinigung auf den Keimen für einen Polykristall zu bilden, undDotieren einer tiefschwellenbildenden Verunreinigung mindestens in der polykristallinen Halbleiterzone bis zu einer Konzentration von wenigstens gleich jener der Zweitleitfähigkeitstyp-bestimmenden Verunreinigung, die darin enthalten ist.12. Verfahren nach Anspruch 11, dadurch gekennzeichnet, daß die tiefschwellenbildende Verunreinigung aus wenigstens einem Stoff der Gruppe Gold, Zink, Eisen, Kupfer und Nickel besteht·13· Verfahren nach /nspruch 11, dadurch gekennzeichnet, daß ea außerdea den Verfahreneschritt des Dotieren· der Krstleitfahigkeitstyp-beetimmenden Verunreinigung in die polykrietalline Halbleiterzone umfaßt.Verfahren nach Anspruch 11, dadurch gekennzeich-009825/1522net, daß die Keime für einen Polykristall erzeugt werden, indem man selektiv einen Isolierfilm aufbringt, der aus mindestens einem Stoff der Gruppe Siliziumoxyd, Siliziumnitrid und Aluminiumoxyd besteht.009825/1522
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP43090252A JPS501513B1 (de) | 1968-12-11 | 1968-12-11 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE1961739A1 true DE1961739A1 (de) | 1970-06-18 |
Family
ID=13993292
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19691961739 Pending DE1961739A1 (de) | 1968-12-11 | 1969-12-09 | Halbleitervorrichtung und Verfahren zu ihrer Herstellung |
Country Status (5)
Country | Link |
---|---|
US (1) | US4009484A (de) |
JP (1) | JPS501513B1 (de) |
DE (1) | DE1961739A1 (de) |
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