DE102013219959B4 - Halbleitervorrichtung und Verfahren zum Herstellen derselben - Google Patents
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Abstract
Halbleitervorrichtung, mit:einem plattenförmigen Elektrodenelement (5);einer integrierten Isolierschicht (3), die an dem Elektrodenelement (5) vorgesehen ist;einer Steuerplatte (1), die an der integrierten Isolierschicht (3) vorgesehen ist, wobei die Steuerplatte (1) an ihren beiden Seiten ein Schaltungsmuster (2) hat;einer in der Platte integrierten Elektrode (10), in der das Elektrodenelement (5) und die Steuerplatte (1) durch die integrierte Isolierschicht (3) einstückig ausgebildet sind;einem Halbleiterelement (12), das mit der in der Platte integrierten Elektrode (10) elektrisch verbunden ist;einer Resistlage (6) an der oberen Fläche, die an einer oberen Fläche der Steuerplatte (1) vorgesehen ist, wobei das Schaltungsmuster (2) abgedeckt ist; undeiner Resistlage an der unteren Fläche, die an einer unteren Fläche des plattenförmigen Elektrodenelements (5) entsprechend einer Position vorgesehen ist, an der die Resistlage (6) an der oberen Fläche vorgesehen ist.
Description
- Die vorliegende Erfindung bezieht sich auf eine Halbleitervorrichtung und auf ein Verfahren zum Herstellen der Halbleitervorrichtung.
- Eine Packung einer Halbleitervorrichtung, zum Beispiel ein Leistungs-MOSFET (Metal Oxide Semiconductor Field Effect Transistor), ein IGBT (Insulated Gate Bipolar Transistor), der eine Leistungshalbleitervorrichtung ist, oder dergleichen werden häufig durch Kunststoffversiegeln mittels Transfergießen im Hinblick auf die Herstellungskosten, einer Produktivität und dergleichen ausgebildet. Auch in dem Fall, bei dem Si (Silizium) und SiC (Silizium-Carbid) als gängige Basismaterialien bei der Leistungshalbleitervorrichtung angewendet werden, wird die Kunststoffversiegelung häufig durch das Transfergießen durchgeführt.
- Zum Beispiel offenbart das japanische Patent
JP S50-12 772 B1 JP 5012772 - In der japanischen Patentoffenlegungsschrift
JP 2012 074543 A - Unter Bezugnahme auf die Leistungshalbleitervorrichtung ist die Entwicklung kontinuierlich zu einer Anwendung eines Elementes fortgeschritten, das als ein Basismaterial jenes Material verwendet, das bei hoher Temperatur betrieben werden kann und durch SiC dargestellt wird. Somit wird eine Struktur gefordert, bei der ein Betrieb bei einer hohen Temperatur durchgeführt werden kann und bei der eine Kapazität vergrößert werden kann.
- Falls die Vergrößerung der Kapazität des Weiteren ohne eine Vergrößerung der Vorrichtungsgröße bei der Halbleitervorrichtung zu implementieren ist, ist es erforderlich, einen Raum in der Vorrichtung wirksam zu nutzen, indem die Elektrode des Halbleiterelements unter der Steuerplatte oder dergleichen angeordnet wird, wie dies in der japanischen Patentoffenlegungsschrift
JP 2006 303006 -
EP 0 598 914 A1 offenbart eine Vorrichtung mit einem Elektrodenelement, einer Isolierschicht und einem Schaltungsmuster, das an beiden Seiten der Isolierschicht vorgesehen ist. Das Elektrodenelement und das Schaltungsmuster sind durch die Isolierschicht einstückig ausgebildet. - Weitere Halbleitervorrichtungen sind aus
JP 2009 224 534 A JP 2005 129 624 A US 2003 / 0178 726 A1 - Es ist die Aufgabe der vorliegenden Erfindung, eine Halbleitervorrichtung vorzusehen, die einfach hergestellt werden kann, während eine Vergrößerung einer Kapazität implementiert wird, und ein Verfahren zum Herstellen der Halbleitervorrichtung.
- Diese Aufgabe wird gelöst durch die Halbleitervorrichtung mit den Merkmalen des Anspruchs 1 und durch das Verfahren mit den Merkmalen des Anspruchs 6 zum Herstellen einer Halbleitervorrichtung.
- Gemäß den Aspekten der vorliegenden Erfindung ist die in der Platte integrierte Elektrode vorgesehen, bei der das Elektrodenelement und die Steuerplatte durch die integrierte Isolierschicht einstückig ausgebildet sind. Folglich ist es durchzuführen, während eine Vergrößerung einer Kapazität implementiert wird.
- Diese und weitere Merkmale, Aspekte und Vorteile der vorliegenden Erfindung werden aus der folgenden, detaillierten Beschreibung der vorliegenden Erfindung im Zusammenhang mit den beigefügten Zeichnungen ersichtlich.
-
1 bis5 zeigen jeweils Ansichten eines Prozesses zum Herstellen einer in einer Platte integrierten Elektrode bei einer Halbleitervorrichtung gemäß einem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung; -
6 zeigt eine Draufsicht der Halbleitervorrichtung gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung; -
7 zeigt eine Schnittansicht der Halbleitervorrichtung gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung; -
8 bis17 zeigen jeweils Ansichten eines Prozesses zum Herstellen einer Halbleitervorrichtung gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung; -
18 bis29 zeigen jeweils Ansichten eines weiteren Prozessmodus zum Herstellen einer Halbleitervorrichtung gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung; -
30 zeigt eine Draufsicht einer Halbleitervorrichtung gemäß einer Variante des bevorzugten Ausführungsbeispiels gemäß der vorliegenden Erfindung; -
31 zeigt eine Schnittansicht der Halbleitervorrichtung gemäß der Variante des bevorzugten Ausführungsbeispiels gemäß der vorliegenden Erfindung; -
32 zeigt eine Draufsicht einer Halbleitervorrichtung gemäß einer technischen Vorgabe der vorliegenden Erfindung; und -
33 zeigt eine Schnittansicht der Halbleitervorrichtung gemäß der technischen Vorgabe der vorliegenden Erfindung. - Ein bevorzugtes Ausführungsbeispiel gemäß der vorliegenden Erfindung wird nachfolgend unter Bezugnahme auf die beigefügten Zeichnungen beschrieben.
- Auch wenn ein Begriff wie zum Beispiel eine obere Fläche, eine untere Fläche oder dergleichen bei der gegenwärtigen Beschreibung verwendet wird, wird zum besseren Verständnis der Begriff zum Unterscheiden der jeweiligen Flächen verwendet, und er bezieht sich nicht auf die tatsächliche vertikale und transversale Richtung.
- <Bevorzugtes Ausführungsbeispiel>
- <Verfahren zum Herstellen einer Elektrode mit integrierter Steuerplatte>
- Die
1 bis5 zeigen Ansichten eines Prozesses zum Herstellen einer in einer Platte integrierten Elektrode10 bei einer Halbleitervorrichtung gemäß dem gegenwärtig bevorzugten Ausführungsbeispiel der vorliegenden Erfindung. - Wie dies in der
1 dargestellt ist, wird zunächst ein Steuerschaltungsmuster2 an beiden Seiten einer doppelt bedruckten Platte1 erzeugt. Das Steuerschaltungsmuster2 wird zum Beispiel durch ein Kupfermaterial ausgebildet. - Wie dies in der
2 gezeigt ist, wird als nächstes eine Epoxidschicht3 , die durch einen Epoxidkunststoff gebildet ist, an einer unteren Flächenseite der doppelt bedruckten Platte1 vorgesehen, und darüber hinaus wird eine Plattenelektrode5 an einer unteren Flächenseite der Epoxidschicht3 vorgesehen. - Die Epoxidschicht
3 ist ein Epoxidprepreg, das zum Beispiel durch imprägnieren eines Glasgewebes, das für eine gedruckte Platte zu verwenden ist, mit einem Epoxidkunststoff erhalten wird, und sie wird durch eine Abschirmung4 verstärkt, die an einer Oberfläche oder einem inneren Teil der Epoxidschicht3 vorgesehen ist und durch eine Kupferplatte oder ein maschenartiges Kupfermaterial gebildet ist. Die Abschirmung4 ist keine unentbehrliche Struktur. Durch Vorsehen der Struktur ist es jedoch möglich, eine Störgröße zu reduzieren, die beim hochfrequenten Schalten einer SiC-Vorrichtung oder dergleichen erzeugt werden könnte. - Die Plattenelektrode
5 ist eine Elektrode, die durch ein Kupfermaterial gebildet ist und im Wesentlichen das Strömen eines elektrischen Stromes ermöglicht. - Zusätzlich ist ein Muster eines Lötresists
6 , das durch ein Resist, Polyamid, Polyamid-Imid oder Polyimid gebildet ist, an einer oberen Flächenseite der doppelt bedruckten Platte1 vorgesehen. Auch wenn das Lötresist6 derart vorgesehen ist, dass es das Steuerschaltungsmuster2 abdeckt, ist das Lötresist6 nicht an einem Drahtbondabschnitt W des Steuerschaltungsmusters2 und an einem Abschnitt vorgesehen, an dem das Stanzen in einem nachfolgenden Schritt durchzuführen ist. Das Steuerschaltungsmuster2 ist durch das Lötresist6 beschichtet, so dass ein Abschälen eines Gießkunststoffes17 verhindert werden kann, der bei einem nachfolgenden Schritt vorzusehen ist. In einem Heizzyklus beim Vorsehen des Gießkunststoffes17 durch das Transfergießen wirken folglich Spannungen aufgrund einer Differenz zwischen einem linearen Ausdehnungskoeffizienten des Gießkunststoffes17 , einem linearen Ausdehnungskoeffizienten eines Cu-Materials, das ein Material des Steuerschaltungsmusters2 ist, und einem linearen Ausdehnungskoeffizienten eines Epoxidkunststoffmaterials, das ein Material der Epoxidschicht3 ist, so dass das Auftreten eines Abschälens des Gießkunststoffes17 verhindert werden kann. Wenn das Abschälen auftritt, wird eine Charakteristik der Vorrichtung verschlechtert. - Andererseits ist das Lötresist
6 außerdem an einer unteren Flächenseite der Plattenelektrode5 entsprechend einer Position vorgesehen, an der das Lötresist6 an der oberen Flächenseite der doppelt bedruckten Platte1 vorgesehen ist. Durch Vorsehen des Lötresists6 an der unteren Flächenseite der Plattenelektrode5 ist es möglich, die Wirkung zum Unterdrücken des Abschälens noch stärker zu verbessern. Das Vorsehen des Lötresists6 , das an der unteren Flächenseite der Plattenelektrode5 anzuordnen ist, wird an jenem Abschnitt verhindert, an dem das Stanzen bei dem nachfolgenden Schritt durchzuführen ist. - Wie dies in der
3 gezeigt ist, wird die Epoxidschicht3 dann in einem Abschnitt, der dem Stanzen und Prägen bei einem nachfolgenden Schritt ausgesetzt wird, durch einen Fräser oder durch eine Laserverarbeitung beseitigt. - Wie dies in der
4 gezeigt ist, wird als nächstes ein Abschnitt zum Sicherstellen einer Lötleiste durch das Stanzen beseitigt. Somit wird ein Öffnungsabschnitt23 ausgebildet. - Wie dies in der
5 gezeigt ist, wird nachfolgend ein Bondingabschnitt26 für eine Leistungshalbleitervorrichtung12 , die nachfolgend beschrieben wird, dem Prägen ausgesetzt. Durch das Prägen nimmt die Plattenelektrode5 des Bondingabschnitts26 für die Leistungshalbleitervorrichtung12 eine konkave Form zu der unteren Flächenseite an (eine konvexe Form zu der Seite der Leistungshalbleitervorrichtung12 ). Das Prägen ist zum Beispiel in der japanischen PatentoffenlegungsschriftJP 2012 74543 5 wird dem Prägen ausgesetzt, so dass eine Zuverlässigkeit der elektrischen Verbindung mit der Leistungshalbleitervorrichtung12 verbessert werden kann. - Durch den vorstehend beschriebenen Herstellungsprozess ist es möglich, die Elektrode
10 mit integrierter Steuerplatte zu implementieren, bei der eine herkömmliche Steuerplatte zum Durchführen eines Gate-Antriebs für einen MOSFET oder einen IGBT der Leistungshalbleitervorrichtung12 mit der Plattenelektrode integriert ist, um hauptsächlich zu ermöglichen, dass ein elektrischer Strom durch die Epoxidschicht hindurch strömt. - <Struktur der Halbleitervorrichtung>
- Die
6 zeigt eine Draufsicht einer Halbleitervorrichtung100 gemäß dem gegenwärtig bevorzugten Ausführungsbeispiel der vorliegenden Erfindung. Außerdem zeigt die7 eine Schnittansicht der Halbleitervorrichtung100 gemäß dem gegenwärtig bevorzugten Ausführungsbeispiel der vorliegenden Erfindung. - Wie dies in der
7 gezeigt ist, ist eine Isolierlage15 an einer Basisplatte16 vorgesehen, die aus einem Metall mit einer hohen thermischen Leitfähigkeit wie zum Beispiel Kupfer oder AlSiC ausgebildet ist, und darüber hinaus ist ein Wärmestreuer14 an der Isolierlage15 angeordnet. - Die Leistungshalbleitervorrichtungen
12 werden mittels eines Werkzeugs an den Wärmestreuer14 durch ein Bondingmaterial24 wie zum Beispiel ein Lötmittel gebondet. Außerdem ist die Elektrode10 mit integrierter Steuerplatte (siehe1 bis5 ) über den Leistungshalbleitervorrichtungen12 vorgesehen. Die Elektrode10 mit integrierter Steuerplatte erstreckt sich außerdem über dem Wärmestreuer14 . Die Leistungshalbleitervorrichtung12 und die Elektrode10 mit integrierter Steuerplatte werden durch das Bondingmaterial24 wie zum Beispiel ein Lötmittel oder Silber in einem Bondabschnitt26 oder dergleichen elektrisch miteinander verbunden. Durch Anordnen der Elektrode10 mit integrierter Steuerplatte an einer oberen Flächenseite der Leistungshalbleitervorrichtung12 , nämlich an einer Kathodenseite, ist es möglich, eine elektrische Spannungsfestigkeit der Vorrichtung durch die Isolierlage15 anzuheben, die eine kleinere Dicke hat. Somit ist es möglich, die Kosten des Materials zu reduzieren. Falls die Isolierlage15 vorgesehen wird, die eine entsprechende Dicke für eine elektrische Steuerspannung hat, die ausreichend geringer als die Hauptspannung ist, wie zum Beispiel eine elektrische Potentialdifferenz von ungefähr ±15 V einer Gate-Elektrode, wird die erforderliche Funktion vollständig erfüllt, so dass die Kosten durch eine Verringerung der Dicke ebenfalls reduziert werden können. - Hierbei ist der Öffnungsabschnitt
23 in einem Randteil des Bondingabschnitts26 für die Leistungshalbleitervorrichtung12 in der Elektrode10 mit integrierter Steuerplatte vorgesehen. Folglich ist es einfach, visuell zu bestätigen, ob die elektrische Verbindung zwischen der Leistungshalbleitervorrichtung12 und der Elektrode10 mit integrierter Steuerplatte geeignet durchgeführt wurde oder nicht. Dementsprechend ist es möglich, in einfacher Weise die Qualität der Halbleitervorrichtung100 zu gewährleisten. Jedoch ist der Öffnungsabschnitt23 keine unentbehrliche Struktur, und es ist auch möglich, eine Halbleitervorrichtung101 anzunehmen, bei der der Öffnungsabschnitt23 nicht vorgesehen ist, wie dies in den30 und31 dargestellt ist, die nachfolgend beschrieben werden. - Die Elektrode
10 mit integrierter Steuerplatte und die Leistungshalbleitervorrichtung12 (ein MOSFET oder ein IGBT) werden durch einen elektrischen Leiter wie zum Beispiel ein Aluminiumdraht13 oder dergleichen elektrisch verbunden. Insbesondere werden die Elektrode10 mit integrierter Steuerplatte und ein Gatepad oder ein Emitterpad (Sourcepad) der Leistungshalbleitervorrichtung12 elektrisch miteinander verbunden. Folglich ist es möglich, die Leistungshalbleitervorrichtung12 von einer Außenseite durch die Elektrode10 mit integrierter Steuerplatte und einen Steueranschluss21 zu steuern. Der Steueranschluss21 ist mit einer oberen Flächenseite der Elektrode10 mit integrierter Steuerplatte elektrisch verbunden. - Wie dies außerdem in der
6 gezeigt ist, ist ein Elektrodenblock18 durch ein Bondingmaterial an dem Wärmestreuer14 angeordnet. Darüber hinaus ist der Elektrodenblock18 auch durch ein Bondingmaterial an der Elektrode10 mit integrierter Steuerplatte angeordnet, die sich über dem Wärmestreuer14 erstreckt. - Zusätzlich ist die gesamte Vorrichtung durch den Gießkunststoff
17 derart abgedeckt, dass der Elektrodenblock18 freiliegt, und ein Anodenanschluss19 und ein Kathodenanschluss20 sind mittels Ultraschall an dem Elektrodenblock18 gebondet, der an einer oberen Fläche des Gießkunststoffs17 entsprechend freiliegt. Somit ist eine Halbleitervorrichtung ausgebildet, die mit einer Busschiene einer Antriebsvorrichtung verbunden ist. - <Halbleitervorrichtungsherstellungsverfahren 1>
- Die
8 bis17 zeigen Ansichten eines Prozesses zum Herstellen der Halbleitervorrichtung100 gemäß dem gegenwärtig bevorzugten Ausführungsbeispiel der vorliegenden Erfindung. - Wie dies in den
8 und9 dargestellt ist, werden zuallererst die Leistungshalbleitervorrichtungen12 an dem Wärmestreuer14 durch die Bondingmaterialien24 angeordnet. - Wie dies in den
10 und11 gezeigt ist, wird als nächstes die Elektrode10 mit integrierter Steuerplatte, die mit der Leistungshalbleitervorrichtung12 elektrisch verbunden ist, durch das Bondingmaterial24 quer über der Leistungshalbleitervorrichtung12 angeordnet. Die Verbindung wird in dem Bondingabschnitt26 oder dergleichen durchgeführt. Die Elektrode10 mit integrierter Steuerplatte erstreckt sich außerdem über dem Wärmestreuer14 . - Außerdem wird der Elektrodenblock
18 durch das Bondingmaterial an dem Wärmestreuer14 angeordnet. Darüber hinaus wird der Elektrodenblock18 durch das Bondingmaterial an der Elektrode10 mit integrierter Steuerplatte angeordnet, die sich über dem Wärmestreuer14 erstreckt. - Zusätzlich wird der Steueranschluss
21 an der oberen Flächenseite der Elektrode10 mit integrierter Steuerplatte elektrisch verbunden. - Wie dies in den
12 und13 gezeigt ist, wird nachfolgend die Isolierlage15 an der unteren Flächenseite des Wärmestreuers14 ausgebildet, und darüber hinaus wird die Basisplatte16 an der unteren Flächenseite der Isolierlage15 vorgesehen. - Zusätzlich wird der Aluminiumdraht
13 angeordnet, um die Elektrode10 mit integrierter Steuerplatte mit der Leistungshalbleitervorrichtung12 elektrisch zu verbinden. Insbesondere verbindet der Aluminiumdraht13 die Elektrode10 mit integrierter Steuerplatte elektrisch mit dem Gatepad oder Emitterpad (Sourcepad) der Leistungshalbleitervorrichtung12 . - Wie dies in den
14 und15 gezeigt ist, wird dann der Gießkunststoff17 vorgesehen, um die gesamte Vorrichtung derart abzudecken, dass der Elektrodenblock18 freiliegt. - Wie dies in den
16 und17 gezeigt ist, werden danach der Anodenanschluss19 und der Kathodenanschluss20 mittels Ultraschall an den Elektrodenblock18 gebondet, der zu der oberen Fläche des Gießkunststoffes17 entsprechend freiliegt. Somit wird die Halbleitervorrichtung ausgebildet, die mit der Busschiene der Antriebsvorrichtung zu verbinden ist. - <Halbleitervorrichtungsherstellungsverfahren 2>
- Die
18 bis29 zeigen jeweils Ansichten eines weiteren Prozessmodus zum Herstellen der Halbleitervorrichtung100 gemäß dem gegenwärtig bevorzugten Ausführungsbeispiel der vorliegenden Erfindung. In der folgenden Beschreibung werden Schritte beschrieben, die sich von jenen des Halbleitervorrichtungsherstellungsverfahrens1 unterscheiden, und die Beschreibung von den gleichen Schritten zu dem Halbleitervorrichtungsherstellungsverfahren1 wird weggelassen. - Wie dies in den
18 und19 gezeigt ist, werden die Leistungshalbleitervorrichtungen12 durch die Bondingmaterialien24 an dem Wärmestreuer14 angeordnet. Wie dies in den20 und21 gezeigt ist, wird dann die Plattenelektrode5 , die mit der Leistungshalbleitervorrichtung12 durch das Bondingmaterial24 elektrisch verbunden ist, quer über der Leistungshalbleitervorrichtung12 angeordnet. Die Verbindung wird in dem Bondingabschnitt26 oder dergleichen durchgeführt. Die Plattenelektrode5 erstreckt sich außerdem über dem Wärmestreuer14 . - Wie dies in den
22 und23 gezeigt ist, wird als nächstes die doppelt bedruckte Platte1 oder dergleichen an der Plattenelektrode5 durch die Epoxidschicht3 angeordnet, so dass die Elektrode10 mit integrierter Steuerplatte ausgebildet wird. Außerdem wird der Elektrodenblock18 durch das Bondingmaterial an dem Wärmestreuer14 und die Elektrode10 mit integrierter Steuerplatte angeordnet, die sich über dem Wärmestreuer14 erstreckt. - Außerdem wird der Steueranschluss
21 an der oberen Flächenseite der Elektrode10 mit integrierter Steuerplatte elektrisch verbunden. - Die folgenden Schritte (
24 bis29 ) sind gleich wie bei dem Halbleitervorrichtungsherstellungsverfahren1 . - Falls die doppelt bedruckte Platte
1 oder dergleichen an der Plattenelektrode5 gemäß der vorstehenden Beschreibung angeordnet wird, werden zum Beispiel als Anordnungsverfahren ein Verfahren zum Durchführen einer Anordnung durch Bonden der doppelt bedruckten Platte1 durch ein Lötmittel oder dergleichen und ein Verfahren zum Durchführen einer Anordnung durch Kleben der doppelt bedruckten Platte1 mittels eines doppelt beschichteten Klebebands oder dergleichen angenommen. - Falls die doppelt bedruckte Platte
1 durch Bonden mit einem Lötmittel oder dergleichen angeordnet wird, wird jedoch angenommen, das Lötmittel oder dergleichen beim Bonden zwischen dem Wärmestreuer14 und der Leistungshalbleitervorrichtung12 zu verwenden. Aus diesem Grund ist ein Lötmittelrückfluss zweimal erforderlich, so dass die Bearbeitungskosten erhöht sind. In einigen Fällen, bei dem ein Lötmittelbonding über der oberen Fläche der Leistungshalbleitervorrichtung12 ausgeführt wird, wird das Lötmittel, das von deren Bondingfläche vorsteht, außerdem ballförmig und haftet an der Oberfläche der Leistungshalbleitervorrichtung12 . - Falls andererseits die doppelt bedruckte Platte
1 durch Bonden mit einem doppelt beschichteten Klebeband oder dergleichen angeordnet wird, ist es erforderlich, ein Drahtbonden durch Ultraschallbonden auszuführen, um die doppelt bedruckte Platte1 mit der Leistungshalbleitervorrichtung12 elektrisch zu verbinden. Jedoch kann eine erforderliche Festigkeit für das Drahtbonden an der doppelt bedruckten Platte1 zwischen der doppelt bedruckten Platte1 und der Plattenelektrode5 nicht erzielt werden. Aus diesem Grund kann die Zuverlässigkeit des Drahtbondens in einigen Fällen nicht gewährleistet werden. Außerdem kann ein Arbeitsgang zum Lagern und Ankleben eines Bandes nicht einfach durchgeführt werden, so dass die Bearbeitungskosten in einigen Fällen erhöht sind. - <Technische Vorgabe>
- Die
32 zeigt eine Draufsicht einer Halbleitervorrichtung102 gemäß der technischen Vorgabe der vorliegenden Erfindung. Außerdem zeigt die33 eine Schnittansicht der Halbleitervorrichtung101 gemäß der technischen Vorgabe der vorliegenden Erfindung. - Wie dies in den
32 und33 gezeigt ist, können nur vier Chips der Leistungshalbleitervorrichtung12 (ein MOSFET oder ein IGBT) montiert werden, falls ein Substrat22 an dem Wärmestreuer14 angeordnet wird. Bei der vorliegenden Erfindung können jedoch sechs Chips montiert werden, so dass eine hohe Montagedichte implementiert wird. - Bei dem gegenwärtig bevorzugten Ausführungsbeispiel werden das Substrat
22 und eine Plattenelektrode25 gemäß den32 und33 integriert, so dass es möglich ist, den Prozess zu vereinfachen, wie dies in den8 bis19 dargestellt ist, und darüber hinaus die Elektrode10 mit integrierter Steuerplatte zu implementieren, die das Drahtbonden der Leistungshalbleitervorrichtung12 an dem Substrat gemäß der vorliegenden Erfindung einfach durchführen kann. - <Variante>
- Die
30 zeigt eine Draufsicht der Halbleitervorrichtung101 gemäß einer Variante des gegenwärtig bevorzugten Ausführungsbeispiels gemäß der vorliegenden Erfindung. Außerdem zeigt die31 eine Schnittansicht der Halbleitervorrichtung101 gemäß der Variante des gegenwärtig bevorzugten Ausführungsbeispiels gemäß der vorliegenden Erfindung. - Bei der Halbleitervorrichtung
101 , die in den30 und31 gezeigt ist, ist der Öffnungsabschnitt23 nicht in dem Randteil des Bondingabschnitts der Elektrode10A mit integrierter Steuerplatte für die Leistungshalbleitervorrichtung12 vorgesehen. Da die anderen Strukturen gleich wie bei der Halbleitervorrichtung100 sind, wird die detaillierte Beschreibung weggelassen. - <Wirkung>
- Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung weist die Halbleitervorrichtung die Plattenelektrode
5 als ein plattenförmiges Elektrodenelement, die Epoxidschicht3 , die als eine integrierte Isolierschicht dient und an der Plattenelektrode5 vorgesehen ist, die doppelt bedruckte Platte1 , die als eine Steuerplatte dient und an der Epoxidschicht3 vorgesehen ist, und die Elektrode10 mit integrierter Steuerplatte auf, in der die Plattenelektrode5 und die doppelt bedruckte Platte1 durch die Epoxidschicht3 einstückig ausgebildet sind. - Gemäß der Struktur wird die Elektrode
10 mit integrierter Steuerplatte vorgesehen, bei der die Plattenelektrode5 und die doppelt bedruckte Platte1 durch die Epoxidschicht3 einstückig ausgebildet sind. Folglich ist es möglich, die Herstellung einfach durchzuführen, während ein Bauelementenmontagebereich vergrößert wird und eine Erhöhung der Kapazität implementiert wird. Da der Herstellungsprozess vereinfacht werden kann, können die Herstellungskosten ebenfalls reduziert werden. - Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung hat außerdem die doppelt bedruckte Platte
1 an seinen beiden Seiten das Steuerschaltungsmuster2 . Zusätzlich weist die Halbleitervorrichtung ein Lötmittelresist6 auf, das als eine Resistlage an der oberen Fläche dient und an der oberen Fläche der doppelt bedruckten Platte1 vorgesehen ist, wobei das Steuerschaltungsmuster2 abgedeckt ist. - Gemäß der Struktur wirkt bei dem Heizzyklus beim Vorsehen des Gießkunststoffs
17 durch das Transfergießen eine Spannung aufgrund einer Differenz zwischen dem linearen Ausdehnungskoeffizienten des Gießkunststoffs17 , dem linearen Ausdehnungskoeffizienten eines Cu-Materials als ein Material des Steuerschaltungsmusters2 und dem linearen Ausdehnungskoeffizienten eines Epoxidkunststoffmaterials als ein Material der Epoxidschicht3 , so dass das Auftreten einer Abschälung des Gießkunststoffs17 verhindert werden kann. - Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung hat außerdem die Epoxidschicht
3 die Abschirmung4 , die als eine plattenartige oder maschenartige Metallabschirmungslage an ihrer Oberfläche oder an ihrem inneren Teil dient. - Gemäß der Struktur ist es möglich, das Auftreten einer Störgröße zu unterdrücken, die beim Ausführen eines hochfrequenten Schaltens in einer SiC-Vorrichtung oder dergleichen erzeugt werden könnte.
- Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung ist außerdem die Elektrode
10 mit integrierter Steuerplatte an der Leistungshalbleitervorrichtung12 gebondet, die als ein Halbleiterelement dient, und der Öffnungsabschnitt23 ist um den Bondingabschnitt herum ausgebildet. - Gemäß der Struktur wird der Randteil des Bondingabschnitts der Leistungshalbleitervorrichtung
12 und der Elektrode10 mit integrierter Steuerplatte an dem Öffnungsabschnitt23 festgelegt. Folglich ist es möglich, einen Verbindungszustand des Bondingabschnitts durch eine visuelle Überprüfung oder dergleichen in einfacher Weise zu bestätigen. Somit ist es möglich, die Zuverlässigkeit der Halbleitervorrichtung zu verbessern. - Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung ist darüber hinaus die Elektrode
10 mit integrierter Steuerplatte an der Leistungshalbleitervorrichtung12 gebondet, so dass die konvexe Form an der Seite der Leistungshalbleitervorrichtung12 in dem Bondingabschnitt26 geschaffen wird, in dem sie aneinander gebondet werden. - Gemäß der Struktur wird die freiliegende Plattenelektrode
5 dem Prägen ausgesetzt. Folglich ist es möglich, die Zuverlässigkeit der elektrischen Verbindung mit der Leistungshalbleitervorrichtung12 zu verbessern. Indem die Form durch das Prägen gestaltet wird, ist es außerdem möglich, einen Zwischenraum zum Abschwächen des Einflusses eines elektrischen Feldes zwischen der Leistungshalbleitervorrichtung12 und der Plattenelektrode5 in einfacher Weise zu gewährleisten. Somit ist es möglich, die Dichte der Vorrichtung noch stärker zu erhöhen, wenn dies mit jenem Fall verglichen wird, bei dem die konvexe Form durch Biegen gestaltet wird. - Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung weist außerdem das Verfahren zum Herstellen einer Halbleitervorrichtung die Schritte auf zum (a) Vorsehen der Epoxidschicht
3 , die als eine integrierte Isolierschicht dient, an der Plattenelektrode5 als ein plattenförmiges Elektrodenelement, (b) Vorsehen der doppelt bedruckten Platte1 , die als eine Steuerplatte dient, an der Epoxidschicht3 und einstückiges Ausbilden der Plattenelektrode5 und der doppelt bedruckten Platte1 durch die Epoxidschicht3 , und (c) elektrisches Verbinden der Elektrode10 mit integrierter Steuerplatte, die bei dem Schritt (b) einstückig ausgebildet wurde, mit der Leistungshalbleitervorrichtung12 , die als ein Halbleiterelement dient. - Gemäß der Struktur wird die Elektrode
10 mit integrierter Steuerplatte in einem integral ausgebildeten Zustand mit der Leistungshalbleitervorrichtung12 verbunden. Daher kann die Verbindungsarbeit in einfacher Weise durchgeführt werden, so dass der Prozess zum Herstellen einer Halbleitervorrichtung vereinfacht werden kann. - Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung weist außerdem das Verfahren zum Herstellen einer Halbleitervorrichtung die Schritte auf zum (d) Ausbilden des Öffnungsabschnitts
23 um einen Abschnitt, in dem die Elektrode10 mit integrierter Steuerplatte an der Leistungshalbleitervorrichtung12 gebondet ist, und zwar vor dem Schritt (c). - Gemäß der Struktur ist es einfach, visuell zu bestätigen, ob die Verbindung zwischen der Leistungshalbleitervorrichtung
12 und die Elektrode10 mit integrierter Steuerplatte geeignet durchgeführt wurde oder nicht. Dementsprechend ist es möglich, die Qualität der Halbleitervorrichtung100 einfach zu gewährleisten. - Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung weist darüber hinaus das Verfahren zum Herstellen einer Halbleitervorrichtung die folgenden Schritte auf zum (e) Schaffen einer konvexen Form an der Seite der Leistungshalbleitervorrichtung
12 in dem Bondingabschnitt26 , in dem die Elektrode10 mit integrierter Steuerplatte an die Leistungshalbleitervorrichtung12 gebondet wird, und zwar vor dem Schritt (c). - Gemäß der Struktur wird die freiliegende Plattenelektrode
5 dem Prägen ausgesetzt. Folglich ist es möglich, die Zuverlässigkeit der elektrischen Verbindung mit der Leistungshalbleitervorrichtung12 zu verbessern. - Gemäß dem bevorzugten Ausführungsbeispiel der vorliegenden Erfindung weist außerdem das Verfahren zum Herstellen einer Halbleitervorrichtung die folgenden Schritte auf zum (f) Vorsehen des Steuerschaltungsmusters
2 an beiden Seiten der doppelt bedruckten Platte1 vor dem Schritt (c) und (g) zum Vorsehen des Lötresists6 , das als eine Resistlage an der oberen Fläche dient und das Steuerschaltungsmuster2 abdeckt, an der oberen Fläche der doppelt bedruckten Platte1 . - Gemäß der Struktur wirkt bei dem Heizzyklus beim Vorsehen des Gießkunststoffs
17 durch das Transfergießen eine Spannung aufgrund einer Differenz zwischen dem linearen Ausdehnungskoeffizienten des Gießkunststoffs17 , dem linearen Ausdehnungskoeffizienten eines Cu-Materials als ein Material des Steuerschaltungsmusters2 und dem linearen Ausdehnungskoeffizienten eines Epoxidkunststoffmaterials als ein Material der Epoxidschicht3 , so dass ein Auftreten einer Abschälung des Gießkunststoffs17 verhindert werden kann. - Auch wenn die Qualität der Materialien und die Materialien der jeweiligen Komponenten, der Ausführungsbedingungen und dergleichen ebenfalls bei dem bevorzugten Ausführungsbeispiel gemäß der vorliegenden Erfindung beschrieben wurden, sind diese darstellend und sollen die Beschreibung nicht einschränken.
- Es ist zu beachten, dass beliebige Komponenten bei dem bevorzugten Ausführungsbeispiel der Erfindung geändert oder weggelassen werden können, ohne dass der Umfang der Erfindung verlassen wird.
- Während die Erfindung im Einzelnen gezeigt und beschrieben wurde, ist die vorstehende Beschreibung in all ihren Aspekten darstellend und nicht einschränkend. Es ist daher klar, dass vielfältige Abwandlungen und Änderungen geschaffen werden können, ohne den Umfang der Erfindung zu verlassen.
Claims (8)
- Halbleitervorrichtung, mit: einem plattenförmigen Elektrodenelement (5); einer integrierten Isolierschicht (3), die an dem Elektrodenelement (5) vorgesehen ist; einer Steuerplatte (1), die an der integrierten Isolierschicht (3) vorgesehen ist, wobei die Steuerplatte (1) an ihren beiden Seiten ein Schaltungsmuster (2) hat; einer in der Platte integrierten Elektrode (10), in der das Elektrodenelement (5) und die Steuerplatte (1) durch die integrierte Isolierschicht (3) einstückig ausgebildet sind; einem Halbleiterelement (12), das mit der in der Platte integrierten Elektrode (10) elektrisch verbunden ist; einer Resistlage (6) an der oberen Fläche, die an einer oberen Fläche der Steuerplatte (1) vorgesehen ist, wobei das Schaltungsmuster (2) abgedeckt ist; und einer Resistlage an der unteren Fläche, die an einer unteren Fläche des plattenförmigen Elektrodenelements (5) entsprechend einer Position vorgesehen ist, an der die Resistlage (6) an der oberen Fläche vorgesehen ist.
- Halbleitervorrichtung gemäß
Anspruch 1 , dadurch gekennzeichnet, dass die integrierte Isolierschicht (3) eine platten- oder maschenartige Metallabschirmungslage (4) an ihrer Oberfläche oder an ihrem inneren Teil hat. - Halbleitervorrichtung gemäß
Anspruch 1 oder2 , dadurch gekennzeichnet, dass die in der Platte integrierte Elektrode (10) an dem Halbleiterelement (12) gebondet ist und dass ein Öffnungsabschnitt (23) um einen Abschnitt herum ausgebildet ist, in dem das Bonden durchgeführt ist. - Halbleitervorrichtung gemäß einem der
Ansprüche 1 bis3 , dadurch gekennzeichnet, dass die in der Platte integrierte Elektrode (10) an dem Halbleiterelement (12) gebondet ist und dass eine konvexe Form an der Seite des Halbleiterelements (12) in einem Bondingabschnitt (26) geschaffen ist, in dem das Bonden durchgeführt ist. - Halbleitervorrichtung gemäß einem der
Ansprüche 1 bis4 , dadurch gekennzeichnet, dass die in der Platte integrierte Elektrode (10) mit einer Kathodenseite des Halbleiterelements (12) elektrisch verbunden ist. - Verfahren zum Herstellen einer Halbleitervorrichtung, mit den folgenden Schritten: (a) Vorsehen einer integrierten Isolierschicht (3) an einem plattenförmigen Elektrodenelement (5); (b) Vorsehen einer Steuerplatte (1) an der integrierten Isolierschicht (3) und einstückiges Ausbilden des Elektrodenelements (5) und der Steuerplatte (1) durch die integrierte Isolierschicht (3); und (c) Elektrisches Verbinden einer in der Platte integrierten Elektrode (10), die bei dem Schritt (b) einstückig ausgebildet ist, mit einem Halbleiterelement (12); (f) Vorsehen eines Schaltungsmusters (2) an beiden Seiten der Steuerplatte (1) vor dem Schritt (c); (g) Vorsehen einer Resistlage (6) an der oberen Fläche zum Abdecken des Schaltungsmusters (2) an einer oberen Fläche der Steuerplatte (1); und (h) Vorsehen einer Resistlage (6) an der unteren Fläche an einer unteren Fläche des Elektrodenelements (5) entsprechend einer Position der Resistlage (6) an der oberen Fläche, die bei dem Schritt (g) vorgesehen wird.
- Verfahren zum Herstellen einer Halbleitervorrichtung gemäß
Anspruch 7 , des Weiteren gekennzeichnet durch einen Schritt (d) zum Ausbilden eines Öffnungsabschnitts (23) um einen Abschnitt herum, in dem die in der Platte integrierte Elektrode (10) und das Halbleiterelement (12) aneinander gebondet werden, und zwar vor dem Schritt (c). - Verfahren zum Herstellen einer Halbleitervorrichtung gemäß
Anspruch 6 oder7 , des Weiteren gekennzeichnet durch einen Schritt (e) zum Schaffen einer konvexen Form an der Seite des Halbleiterelements (12) in einem Bondingabschnitt (26), in dem die in der Platte integrierte Elektrode (10) an dem Halbleiterelement (12) gebondet wird, und zwar vor dem Schritt (c).
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013021036A JP5930980B2 (ja) | 2013-02-06 | 2013-02-06 | 半導体装置およびその製造方法 |
JP2013-021036 | 2013-02-06 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102013219959A1 DE102013219959A1 (de) | 2014-08-07 |
DE102013219959B4 true DE102013219959B4 (de) | 2019-04-18 |
Family
ID=51206143
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102013219959.7A Active DE102013219959B4 (de) | 2013-02-06 | 2013-10-01 | Halbleitervorrichtung und Verfahren zum Herstellen derselben |
Country Status (4)
Country | Link |
---|---|
US (1) | US9093277B2 (de) |
JP (1) | JP5930980B2 (de) |
CN (1) | CN103972277B (de) |
DE (1) | DE102013219959B4 (de) |
Families Citing this family (7)
Publication number | Priority date | Publication date | Assignee | Title |
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USD758372S1 (en) * | 2013-03-13 | 2016-06-07 | Nagrastar Llc | Smart card interface |
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-
2013
- 2013-02-06 JP JP2013021036A patent/JP5930980B2/ja not_active Expired - Fee Related
- 2013-10-01 DE DE102013219959.7A patent/DE102013219959B4/de active Active
- 2013-10-23 US US14/061,417 patent/US9093277B2/en not_active Expired - Fee Related
-
2014
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Publication number | Publication date |
---|---|
JP5930980B2 (ja) | 2016-06-08 |
US20140217600A1 (en) | 2014-08-07 |
DE102013219959A1 (de) | 2014-08-07 |
CN103972277B (zh) | 2017-06-27 |
US9093277B2 (en) | 2015-07-28 |
JP2014154613A (ja) | 2014-08-25 |
CN103972277A (zh) | 2014-08-06 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R020 | Patent grant now final |