CN111145678A - 一种移位寄存器、其驱动方法、驱动电路及显示装置 - Google Patents
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Abstract
本发明公开了一种移位寄存器、其驱动方法、驱动电路及显示装置，包括：控制电路、第一输出电路、第二输出电路以及第一开关晶体管。通过上述电路的相互配合，可以实现信号的移位输出。并且，通过设置了第一开关晶体管，可以将第二输出电路与第二节点隔离，从而降低漏电流对第一开关晶体管的第二端的信号，使第一开关晶体管的第二端的信号更加稳定，进而可以使第二输出电路可以稳定的将第二参考信号端的信号提供给输出信号端，以使输出信号端输出的信号更稳定。
Description
技术领域
本发明涉及显示技术领域，特别涉及一种移位寄存器、其驱动方法、驱动电路及显示装置。
背景技术
随着显示技术的飞速发展，显示面板越来越向着高集成度和低成本的方向发展。其中，阵列基板行驱动(Gate Driver on Array，GOA)技术将薄膜晶体管(Thin FilmTransistor，TFT)栅极开关电路集成在显示面板的阵列基板上以形成对显示面板的扫描驱动，从而可以省去栅极集成电路(Integrated Circuit，IC)的绑定(Bonding)区域以及扇出(Fan-out)区域的布线空间，不仅可以在材料成本和制备工艺两方面降低产品成本，而且可以使显示面板做到两边对称和窄边框的美观设计；并且，这种集成工艺还可以省去栅极扫描线方向的Bonding工艺，从而提高了产能和良率。
发明内容
本发明实施例提供一种移位寄存器、其驱动方法、驱动电路及显示装置，可以实现信号的移位输出。
因此，本发明实施例提供了一种移位寄存器，包括：
控制电路，被配置为根据第一时钟信号端的信号、第二时钟信号端的信号和输入信号端的信号，调整第一节点和第二节点的信号；
第一输出电路，被配置为响应于所述第一节点的信号，将第一参考信号端的信号提供给输出信号端；
第一开关晶体管，其中，所述第一开关晶体管的第一端与所述第二节点电连接，所述第一开关晶体管的控制端与第二参考信号端电连接，所述第一开关晶体管的第二端与所述第二输出电路电连接；
所述第二输出电路用于在所述第一开关晶体管的第二端的信号控制下，将所述第二参考信号端的信号提供给所述输出信号端。
可选地，所述控制电路包括：输入电路、第一节点控制电路、第二节点控制电路；其中：
所述输入电路被配置为响应于所述第二时钟信号端的信号和所述输入信号端的信号，将所述第一参考信号端的信号提供给第三节点；
所述第一节点控制电路被配置为根据所述第一时钟信号端的信号调整所述第三节点的信号，响应于所述第三节点的信号，将所述第一时钟信号端的信号提供给所述第一节点，以及响应于所述第二节点的信号，将所述第一参考信号端的信号提供给所述第一节点；
所述第二节点控制电路被配置为响应于所述第一时钟信号端的信号，将所述输入信号端的信号提供给所述第二节点。
可选地，所述输入电路包括：第二开关晶体管和第三开关晶体管；其中：
所述第二开关晶体管的第一端与所述第一参考信号端电连接，所述第二开关晶体管的控制端与所述输入信号端电连接，所述第二开关晶体管的第二端与所述第三节点电连接；
所述第三开关晶体管的第一端与所述第一参考信号端电连接，所述第三开关晶体管的控制端与所述第二时钟信号端电连接，所述第三开关晶体管的第二端与所述第三节点电连接。
可选地，所述第一节点控制电路包括：第四开关晶体管、第五开关晶体管以及第一电容；其中：
所述第四开关晶体管的第一端与所述第一时钟信号端电连接，所述第四开关晶体管的控制端与所述第三节点电连接，所述第四开关晶体管的第二端与所述第一节点电连接；
所述第五开关晶体管的第一端与所述第一参考信号端电连接，所述第五开关晶体管的控制端与所述第二节点电连接，所述第五开关晶体管的第二端与所述第一节点电连接；
所述第一电容的第一端与所述第一时钟信号端电连接，所述第一电容的第二端与所述第三节点电连接。
可选地，所述第二节点控制电路包括：第六开关晶体管；所述第六开关晶体管的第一端与所述输入信号端电连接，所述第六开关晶体管的控制端与所述第一时钟信号端电连接，所述第六开关晶体管的第二端与所述第二节点电连接。
可选地，所述第一输出电路包括：第七开关晶体管和第二电容；其中：
所述第七开关晶体管的第一端与所述第一参考信号端电连接，所述第七开关晶体管的控制端与所述第一节点电连接，所述第七开关晶体管的第二端与所述输出信号端电连接；
所述第二电容的第一端与所述第一节点电连接，所述第二电容的第二端与所述第一参考信号端电连接。
可选地，所述第二输出电路包括：第八开关晶体管和第三电容；其中：
所述第八开关晶体管的第一端与所述第二参考信号端电连接，所述第八开关晶体管的控制端与所述第一开关晶体管的第二端电连接，所述第八开关晶体管的第二端与所述输出信号端电连接；
所述第三电容的第一端与所述第一开关晶体管的第二端电连接，所述第三电容的第二端与所述输出信号端电连接。
相应地，本发明实施例还提供了一种驱动电路，包括上述任一种移位寄存器；其中：
第一级移位寄存器的输入信号端与触发信号端电连接；
每相邻两级移位寄存器中，下一级移位寄存器的输入信号端与上一级移位寄存器的输出信号端电连接。
相应地，本发明实施例还提供了一种显示装置，包括上述驱动电路。
相应地，本发明实施例还提供了一种上述任一种移位寄存器的驱动方法，包括：
第一阶段，对输入信号端加载第二电平的信号，对第一时钟信号端加载第一电平的信号，对第二时钟信号端加载第二电平的信号；
第二阶段，对输入信号端加载第二电平的信号，对第一时钟信号端加载第二电平的信号，对第二时钟信号端加载第一电平的信号；
第三阶段，对输入信号端加载第一电平的信号，对第一时钟信号端加载第一电平的信号，对第二时钟信号端加载第二电平的信号；
第四阶段，对输入信号端加载第一电平的信号，对第一时钟信号端加载第二电平的信号，对第二时钟信号端加载第一电平的信号。
本发明有益效果如下：
本发明实施例提供的上述移位寄存器，通过上述电路的相互配合，可以实现信号的移位输出。并且，通过设置了第一开关晶体管，可以将第二输出电路与第二节点隔离，从而降低漏电流对第一开关晶体管的第二端的信号，使第一开关晶体管的第二端的信号更加稳定，进而可以使第二输出电路可以稳定的将第二参考信号端的信号提供给输出信号端，以使输出信号端输出的信号更稳定。
附图说明
图1为本发明实施例提供的一种移位寄存器的结构示意图；
图2为本发明实施例提供的一种移位寄存器的结构示意图；
图3为本发明实施例提供的一种移位寄存器的具体结构示意图；
图4为本发明实施例提供的信号时序图；
图5为本发明实施例提供的驱动方法的流程图；
图6为本发明实施例提供的驱动电路的结构示意图。
具体实施方式
为使本发明实施例的目的、技术方案和优点更加清楚，下面将结合本发明实施例的附图，对本发明实施例的技术方案进行清楚、完整地描述。显然，所描述的实施例是本发明的一部分实施例，而不是全部的实施例。并且在不冲突的情况下，本发明中的实施例及实施例中的特征可以相互组合。基于所描述的本发明的实施例，本领域普通技术人员在无需创造性劳动的前提下所获得的所有其他实施例，都属于本发明保护的范围。
除非另外定义，本发明使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本发明中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。
需要注意的是，附图中各图形的尺寸和形状不反映真实比例，目的只是示意说明本发明内容。并且自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。
本发明实施例提供的一种移位寄存器，如图1所示，可以包括：
控制电路10，被配置为根据第一时钟信号端CK1的信号、第二时钟信号端CK2的信号和输入信号端IN的信号，调整第一节点N1和第二节点N2的信号；
第一输出电路20，被配置为响应于第一节点N1的信号，将第一参考信号端VGL的信号提供给输出信号端OUT；
第一开关晶体管T1，其中，第一开关晶体管T1的第一端与第二节点N2电连接，第一开关晶体管T1的控制端与第二参考信号端VGH电连接，第一开关晶体管T1的第二端与第二输出电路30电连接；
第二输出电路30用于在第一开关晶体管T1的第二端的信号控制下，将第二参考信号端VGH的信号提供给输出信号端OUT。
本发明实施例提供的上述移位寄存器，通过上述电路的相互配合，可以实现信号的移位输出。并且，通过设置了第一开关晶体管，可以将第二输出电路与第二节点隔离，从而降低漏电流对第一开关晶体管的第二端的信号，使第一开关晶体管的第二端的信号更加稳定，进而可以使第二输出电路可以稳定的将第二参考信号端的信号提供给输出信号端，以使输出信号端输出的信号更稳定。
并且，本发明实施例提供的上述移位寄存器输出的信号，可以作为发光控制晶体管的发光控制信号，也可以作为扫描控制晶体管的栅极扫描信号。
在具体实施时，在本发明实施例中，如图2所示，控制电路10可以包括：输入电路11、第一节点控制电路12、第二节点控制电路13；其中：
输入电路11被配置为响应于第二时钟信号端CK2的信号和输入信号端IN的信号，将第一参考信号端VGL的信号提供给第三节点N3；
第一节点控制电路12被配置为根据第一时钟信号端CK1的信号调整第三节点N3的信号，响应于第三节点N3的信号，将第一时钟信号端CK1的信号提供给第一节点N1，以及响应于第二节点N2的信号，将第一参考信号端VGL的信号提供给第一节点N1；
第二节点控制电路13被配置为响应于第一时钟信号端CK1的信号，将输入信号端IN的信号提供给第二节点N2。
在具体实施时，控制电路10通过输入电路11和第一节点控制电路12的相互配合，可以根据第一时钟信号端CK1的信号、第二时钟信号端CK2的信号和输入信号端IN的信号调整第三节点N3的信号，从而调整第一节点N1的信号。通过设置了第二节点控制电路13，可以响应于第一时钟信号端CK1的信号，将输入信号端IN的信号提供给第二节点N2。
在具体实施时，在本发明实施例中，如图3所示，输入电路11可以包括：第二开关晶体管T2和第三开关晶体管T3；其中：
第二开关晶体管T2的第一端与第一参考信号端VGL电连接，第二开关晶体管T2的控制端与输入信号端IN电连接，第二开关晶体管T2的第二端与第三节点N3电连接；
第三开关晶体管T3的第一端与第一参考信号端VGL电连接，第三开关晶体管T3的控制端与第二时钟信号端CK2电连接，第三开关晶体管T3的第二端与第三节点N3电连接。
在具体实施时，第二开关晶体管T2响应于输入信号端IN的信号处于导通状态时，可以将第一参考信号端VGL的信号提供给第三节点N3。
在具体实施时，第三开关晶体管T3响应于第二时钟信号端CK2的信号处于导通状态时，可以将第一参考信号端VGL的信号提供给第三节点N3。
在具体实施时，在本发明实施例中，如图3所示，第一节点控制电路12可以包括：第四开关晶体管T4、第五开关晶体管T5以及第一电容C1；其中：
第四开关晶体管T4的第一端与第一时钟信号端CK1电连接，第四开关晶体管T4的控制端与第三节点N3电连接，第四开关晶体管T4的第二端与第一节点N1电连接；
第五开关晶体管T5的第一端与第一参考信号端VGL电连接，第五开关晶体管T5的控制端与第二节点N2电连接，第五开关晶体管T5的第二端与第一节点N1电连接；
第一电容C1的第一端与第一时钟信号端CK1电连接，第一电容C1的第二端与第三节点N3电连接。
在具体实施时，第四开关晶体管T4响应于第三节点N3的信号处于导通状态时，可以将第一时钟信号端CK1的信号提供给第一节点N1。
在具体实施时，第五开关晶体管T5响应于第二节点N2的信号处于导通状态时，可以将第一参考信号端VGL的信号提供给第一节点N1。
在具体实施时，第一电容C1保持其两端电压差稳定，当第一时钟信号端CK1的信号的电压发生变化时，第一电容C1可以调整第三节点N3的信号的电压。
在具体实施时，在本发明实施例中，如图3所示，第二节点控制电路13可以包括：第六开关晶体管T6；第六开关晶体管T6的第一端与输入信号端IN电连接，第六开关晶体管T6的控制端与第一时钟信号端CK1电连接，第六开关晶体管T6的第二端与第二节点N2电连接。
在具体实施时，第六开关晶体管T6响应于第一时钟信号端CK1的信号处于导通状态时，可以将输入信号端IN的信号提供给第二节点N2。
在具体实施时，在本发明实施例中，如图3所示，第一输出电路20可以包括：第七开关晶体管T7和第二电容C2；其中：
第七开关晶体管T7的第一端与第一参考信号端VGL电连接，第七开关晶体管T7的控制端与第一节点N1电连接，第七开关晶体管T7的第二端与输出信号端OUT电连接；
第二电容C2的第一端与第一节点N1电连接，第二电容C2的第二端与第一参考信号端VGL电连接。
在具体实施时，第七开关晶体管T7响应于第一节点N1的信号处于导通状态时，可以将第一参考信号端VGL提供给输出信号端OUT。
在具体实施时，第二电容C2可以存储第一节点N1的信号，当第一节点N1处于浮接状态时，可以保持第一节点N1与第七开关晶体管T7的控制端之间电压差不变。
在具体实施时，在本发明实施例中，如图3所示，第二输出电路30可以包括：第八开关晶体管T8和第三电容C3；其中：
第八开关晶体管T8的第一端与第二参考信号端VGH电连接，第八开关晶体管T8的控制端与第一开关晶体管T1的第二端电连接，第八开关晶体管T8的第二端与输出信号端OUT电连接；
第三电容C3的第一端与第一开关晶体管T1的第二端电连接，第三电容C3的第二端与输出信号端OUT电连接。
在具体实施时，第八开关晶体管T8响应于第一开关晶体管T1的第二端的信号处于导通状态时，可以将第二参考信号端VGH的信号提供给输出信号端OUT。
在具体实施时，第三电容C3保持其两端电压差不变，当输入信号端IN的信号的电压发生变化时，第三电容C3可以调整第一开关晶体管T1的第二端的信号的电压。
以上仅是举例说明本发明实施例提供的移位寄存器中各电路的具体结构，在具体实施时，上述各电路的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作限定。
具体地，为了制作工艺统一，在本发明实施例提供的移位寄存器中，如图3所示，所有开关晶体管均为N型晶体管，当然，所有开关晶体管也可以均为P型晶体管，在此不作限定。
具体地，在本发明实施例提供的移位寄存器中，P型晶体管在低电平信号作用下导通，在高电平信号作用下截止；N型晶体管在高电平信号作用下导通，在低电平信号作用下截止。
具体地，在本发明实施例提供的移位寄存器中，上述各开关晶体管可以是薄膜晶体管(TFT，Thin Film Transistor)，也可以是金属氧化物半导体场效应管(MOS，MetalOxide Scmiconductor)，在此不作限定。并且根据上述各开关晶体管的类型不同以及各开关晶体管的控制端的信号的不同，将各开关晶体管的控制端作为栅极，并可以将上述开关晶体管的第一端作为源极，第二端作为漏极，或者将开关晶体管的第一端作为漏极，第二端作为源极，在此不作具体区分。
在具体实施时，如图3所示，在本发明实施例提供的移位寄存器中所有开关晶体管可以均为N型晶体管，则第一参考信号端VGL的信号可以为低电平信号，第二参考信号端VGH的信号可以为高电平信号。在本发明实施例提供的移位寄存器中所有开关晶体管也可以均为P型晶体管，则第一参考信号端VGL的信号可以为高电平信号，第二参考信号端VGH的信号可以为低电平信号。
在具体实施时，第一时钟信号端CK1的高电平的电压可以与第二参考信号端VGH的电压相同。第一时钟信号端CK1的低电平的电压可以与第一参考信号端VGL的电压相同。当然，第一时钟信号端CK1、第二时钟信号端CK2、第一参考信号端VGL和第二参考信号端VGH的具体电压值可以根据实际应用情况确定，在此不作限定。
下面结合具体实施例，对本发明进行详细说明。需要说明的是，本实施例中是为了更好的解释本发明，但不限制本发明。
下面结合电路时序图对本发明实施例提供的移位寄存器的工作过程作以描述。下述描述中以1表示高电平，0表示低电平。需要说明的是，1和0是逻辑电平，其仅是为了更好的解释本发明实施例的具体工作过程，而不是具体的电压值。
下面以图3所示的移位寄存器的结构为例，结合图4所示的信号时序图对本发明实施例提供的上述移位寄存器的工作过程进行描述，其中，第一参考信号端VGL的信号为低电平信号，第二参考信号端VGH的信号为高电平信号，具体地，选取如图4所示的信号时序图中的第一阶段t1、第二阶段t2、第三阶段t3、第四阶段t4。
在第一阶段t1，CK1＝0，CK2＝1，IN＝1。
由于CK1＝0，第六开关晶体管T6截止；由于CK2＝1，第三开关晶体管T3导通；由于IN＝1，第二开关晶体管T2导通。
第二开关晶体管T2和第三开关晶体管T3导通，将第一参考信号端VGL的低电平信号提供给第三节点N3，使第三节点N3为低电平信号，第四开关晶体管T4截止。
第六开关晶体管T6截止，则第二节点N2保持上一阶段的信号。第二节点N2为低电平信号，第五开关晶体管T5截止。第二参考信号端VGH的高电平信号使第一开关晶体管T1导通，将第二节点N2的低电平信号提供给第八开关晶体管T8的控制端，第八开关晶体管T8截止。
第一节点N1保持为高电平信号，第七开关晶体管T7导通，将第一参考信号端VGL的低电平信号提供给输出信号端OUT，使输出信号端OUT输出低电平信号。
在第二阶段t2，CK1＝1，CK2＝0，IN＝1。
由于CK1＝1，第六开关晶体管T6导通；由于CK2＝0，第三开关晶体管T3截止；由于IN＝1，第二开关晶体管T2导通。
第二开关晶体管T2导通，将第一参考信号端VGL的低电平信号提供给第三节点N3，使得第三节点N3的信号为低电平信号，第四开关晶体管T4截止。
第六开关晶体管T6导通，将输入信号端IN的高电平信号提供给第二节点N2，使第二节点N2为高电平。第五开关晶体管T5导通，将第一参考信号端VGL的低电平信号提供给第一节点N1，使第一节点N1的信号为低电平，第七开关晶体管T7截止。
第二参考信号端VGH的高电平信号使第一开关晶体管T1导通，将第二节点N2的高电平信号提供给第八开关晶体管T8的控制端，第八开关晶体管T8导通，将第二参考信号端VGH的高电平信号提供给输出信号端OUT，并且使第三电容C3的第二端由低电平变为高电平。由于第三电容C3的自举作用，第八开关晶体管T8的控制端的信号的电压被拉高。此时第一开关晶体管T1的第二端的信号电压高于第二参考信号端VGH的高电平信号的电压，第一开关晶体管T1的第一端和控制端的信号的电压等于第二参考信号端VGH的高电平信号的电压，使第一开关晶体管T1截止。第八开关晶体管T8的控制端的信号的电压高于第二参考信号端VGH的高电平信号的电压，从而使第八开关晶体管T8的导通程度提高。
并且，由于第一开关晶体管T1截止，可以将第八开关晶体管T8的控制端与第二节点N2隔离，降低漏电流对第八开关晶体管T8的控制端的信号的影响，从而使第八开关晶体管T8的控制端的信号更稳定，进而使第八开关晶体管T8可以稳定的将第二参考信号端VGH的高电平信号提供给输出信号端OUT，使输出信号端OUT输出的信号更加稳定。
在第三阶段t3，CK1＝0，CK2＝1，IN＝0。
由于CK1＝0，第六开关晶体管T6截止；由于CK2＝1，第三开关晶体管T3导通；由于IN＝0，第二开关晶体管T2截止。
第三开关晶体管T3导通，将第一参考信号端VGL的低电平信号提供给第三节点N3，使得第三节点N3的信号为低电平信号，第四开关晶体管T4截止。
第四开关晶体管T4和第六开关晶体管T6均截止，则第一节点N1和第二节点N2保持上一阶段的信号。第二节点N2保持为高电平信号，第五开关晶体管T5导通，将第一参考信号端VGL的低电平信号提供给第一节点N1。第一节点N1保持为低电平信号，第七开关晶体管T7截止。第八开关晶体管T8的控制端的信号的电压保持不变，则第一开关晶体管T1仍截止，第八开关晶体管T8导通，将第二参考信号端VGH的高电平信号提供给输出信号端OUT，输出信号端OUT输出高电平信号。
在第四阶段t4，CK1＝1，CK2＝0，IN＝0。
由于CK1＝1，第六开关晶体管T6导通；由于CK2＝0，第三开关晶体管T3截止；由于IN＝0，第二开关晶体管T2截止。
第一时钟信号端CK1的信号在第四阶段t4开始时由低电平变为高电平，由于第一电容C1的自举作用，将第三节点N3的信号的电压拉高，使得第三节点N3的信号为高电平信号，第四开关晶体管T4导通。
第六开关晶体管T6导通，将输入信号端IN的低电平信号提供给第二节点N2，使第二节点N2为低电平。第五开关晶体管T5截止。第二节点N2为低电平，第一开关晶体管T1的控制端为高电平，使第一开关晶体管T1导通，将低电平信号提供给第八开关晶体管T8的控制端，使第八开关晶体管T8截止。
第四开关晶体管T4导通，将第一时钟信号端CK1的高电平信号提供给第一节点N1，使第一节点N1为高电平，第七开关晶体管T7导通，将第一参考信号端VGL的低电平信号提供给输出信号端OUT，输出信号端OUT输出低电平信号。
基于同一发明构思，本发明实施例还提供了一种本发明实施例提供的上述任一种移位寄存器的驱动方法，如图5所示，包括：
S501、第一阶段，对输入信号端加载第二电平的信号，对第一时钟信号端加载第一电平的信号，对第二时钟信号端加载第二电平的信号；
S502、第二阶段，对输入信号端加载第二电平的信号，对第一时钟信号端加载第二电平的信号，对第二时钟信号端加载第一电平的信号；
S503、第三阶段，对输入信号端加载第一电平的信号，对第一时钟信号端加载第一电平的信号，对第二时钟信号端加载第二电平的信号；
S504、第四阶段，对输入信号端加载第一电平的信号，对第一时钟信号端加载第二电平的信号，对第二时钟信号端加载第一电平的信号。
本发明实施例提供的上述驱动方法，可以使移位寄存器稳定的输出信号。在具体实施时，在本发明实施例提供的上述驱动方法中，第一电平可以为低电平，对应地，第二电平为高电平；或者反之，第一电平可以为高电平，对应地，第二电平为低电平，具体需要根据移位寄存器中的晶体管是N型晶体管还是P型晶体管而定。具体地，图4示出了移位寄存器中的晶体管是N型晶体管的一种信号时序图，且第一电平为低电平，第二电平为高电平。
基于同一发明构思，本发明实施例还提供了一种驱动电路，如图6所示，包括级联的多个本发明实施例提供的任一种移位寄存器：SR(1)、SR(2)…SR(n-1)、SR(n)…，SR(N-1)、SR(N)(共N个移位寄存器，1≤n≤N)；其中，
第一级移位寄存器SR(1)的输入信号端IN与帧触发信号端STV电连接；
除第一级移位寄存器SR(1)之外，其余各级移位寄存器SR(n)的输入信号端IN分别与其相邻的上一级移位寄存器SR(n-1)的输出信号端OUT电连接。
具体地，上述驱动电路中的每个移位寄存器的具体结构与本发明实施例提供的上述任一种移位寄存器在功能和结构上均相同，重复之处不再赘述。
在具体实施时，在本发明提供的上述驱动电路中，各级移位寄存器的第一参考信号端VGL均与同一参考信号线Vgl相连，各级移位寄存器的第二参考信号端VGH均与同一参考信号线Vgh相连。
在具体实施时，在具体实施时，奇数级移位寄存器的第一时钟信号端CK1电连接第一时钟线clk1，第二时钟信号端CK2电连接第二时钟线clk2；偶数级移位寄存器的第一时钟信号端CK1电连接第二时钟线clk2，第二时钟信号端CK2电连接第一时钟线clk1。
在具体实施时，本发明实施例提供的驱动电路可以作为栅极驱动电路，应用于提供扫描控制晶体管的栅极扫描信号。
在具体实施时，本发明实施例提供的驱动电路可以作为发光驱动电路，应用于提供发光控制晶体管的发光控制信号。
基于同一发明构思，本发明实施例还提供了一种显示装置，包括本发明提供的上述驱动电路。其具体实施可参见上述移位寄存器的实施过程，相同之处不再赘述。
在具体实施时，本发明实施例提供的上述显示装置可以为有机发光显示装置，或者也可以为液晶显示装置，在此不作限定。
在有机发光显示装置中，一般设置有多个有机发光二极管以及与各有机发光二极管连接的像素电路。一般像素电路中设置有用于控制有机发光二极管发光的发光控制晶体管和用于控制数据信号输入的扫描控制晶体管。在具体实施时，在本发明实施例提供的上述显示装置为有机发光显示装置时，该有机发光显示装置可以包括一个本发明实施例提供的上述驱动电路，该驱动电路可以作为发光驱动电路，应用于提供发光控制晶体管的发光控制信号；或者，该驱动电路也可以作为栅极驱动电路，应用于提供扫描控制晶体管的栅极扫描信号。当然，该有机发光显示装置也可以包括两个本发明实施例提供的上述驱动控制电路，其中一个驱动电路可以作为发光驱动电路，应用于提供发光控制晶体管的发光控制信号；则另一个驱动电路作为栅极驱动电路，应用于提供扫描控制晶体管的栅极扫描信号，在此不作限定。
在液晶显示装置中，一般设置有多个像素电极，以及与各像素电极连接的开关晶体管。在具体实施时，在本发明实施例提供的上述显示装置为液晶显示装置时，本发明实施例提供的上述驱动电路可以作为栅极驱动电路，应用于提供开关晶体管的栅极扫描信号。
该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。对于该显示装置的其它必不可少的组成部分均为本领域的普通技术人员应该理解具有的，在此不做赘述，也不应作为对本发明的限制。
本发明实施例提供的一种移位寄存器，包括：控制电路、第一输出电路、第二输出电路。通过上述电路的相互配合，可以实现信号的移位输出，输出的信号可以作为发光控制晶体管的发光控制信号，也可以作为扫描控制晶体管的栅极扫描信号。本发明实施例提供的一种驱动电路，包括上述任一种移位寄存器，通过在显示面板上集成上述驱动电路以对显示面板提供扫描驱动信号或发光驱动信号，可以使显示面板做到两边对称和窄边框的美观设计，还可以省去栅极扫描线方向的Bonding工艺，从而提高了产能和良率。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。
Claims (10)
1.一种移位寄存器，其特征在于，包括：
控制电路，被配置为根据第一时钟信号端的信号、第二时钟信号端的信号和输入信号端的信号，调整第一节点和第二节点的信号；
第一输出电路，被配置为响应于所述第一节点的信号，将第一参考信号端的信号提供给输出信号端；
第一开关晶体管，其中，所述第一开关晶体管的第一端与所述第二节点电连接，所述第一开关晶体管的控制端与第二参考信号端电连接，所述第一开关晶体管的第二端与所述第二输出电路电连接；
所述第二输出电路用于在所述第一开关晶体管的第二端的信号控制下，将所述第二参考信号端的信号提供给所述输出信号端。
2.如权利要求1所述的移位寄存器，其特征在于，所述控制电路包括：输入电路、第一节点控制电路、第二节点控制电路；其中：
所述输入电路被配置为响应于所述第二时钟信号端的信号和所述输入信号端的信号，将所述第一参考信号端的信号提供给第三节点；
所述第一节点控制电路被配置为根据所述第一时钟信号端的信号调整所述第三节点的信号，响应于所述第三节点的信号，将所述第一时钟信号端的信号提供给所述第一节点，以及响应于所述第二节点的信号，将所述第一参考信号端的信号提供给所述第一节点；
所述第二节点控制电路被配置为响应于所述第一时钟信号端的信号，将所述输入信号端的信号提供给所述第二节点。
3.如权利要求2所述的移位寄存器，其特征在于，所述输入电路包括：第二开关晶体管和第三开关晶体管；其中：
所述第二开关晶体管的第一端与所述第一参考信号端电连接，所述第二开关晶体管的控制端与所述输入信号端电连接，所述第二开关晶体管的第二端与所述第三节点电连接；
所述第三开关晶体管的第一端与所述第一参考信号端电连接，所述第三开关晶体管的控制端与所述第二时钟信号端电连接，所述第三开关晶体管的第二端与所述第三节点电连接。
4.如权利要求2所述的移位寄存器，其特征在于，所述第一节点控制电路包括：第四开关晶体管、第五开关晶体管以及第一电容；其中：
所述第四开关晶体管的第一端与所述第一时钟信号端电连接，所述第四开关晶体管的控制端与所述第三节点电连接，所述第四开关晶体管的第二端与所述第一节点电连接；
所述第五开关晶体管的第一端与所述第一参考信号端电连接，所述第五开关晶体管的控制端与所述第二节点电连接，所述第五开关晶体管的第二端与所述第一节点电连接；
所述第一电容的第一端与所述第一时钟信号端电连接，所述第一电容的第二端与所述第三节点电连接。
5.如权利要求2所述的移位寄存器，其特征在于，所述第二节点控制电路包括：第六开关晶体管；所述第六开关晶体管的第一端与所述输入信号端电连接，所述第六开关晶体管的控制端与所述第一时钟信号端电连接，所述第六开关晶体管的第二端与所述第二节点电连接。
6.如权利要求1所述的移位寄存器，其特征在于，所述第一输出电路包括：第七开关晶体管和第二电容；其中：
所述第七开关晶体管的第一端与所述第一参考信号端电连接，所述第七开关晶体管的控制端与所述第一节点电连接，所述第七开关晶体管的第二端与所述输出信号端电连接；
所述第二电容的第一端与所述第一节点电连接，所述第二电容的第二端与所述第一参考信号端电连接。
7.如权利要求1所述的移位寄存器，其特征在于，所述第二输出电路包括：第八开关晶体管和第三电容；其中：
所述第八开关晶体管的第一端与所述第二参考信号端电连接，所述第八开关晶体管的控制端与所述第一开关晶体管的第二端电连接，所述第八开关晶体管的第二端与所述输出信号端电连接；
所述第三电容的第一端与所述第一开关晶体管的第二端电连接，所述第三电容的第二端与所述输出信号端电连接。
8.一种驱动电路，其特征在于，包括级联的多个如权利要求1-7任一项所述的移位寄存器；其中：
第一级移位寄存器的输入信号端与触发信号端电连接；
每相邻两级移位寄存器中，下一级移位寄存器的输入信号端与上一级移位寄存器的输出信号端电连接。
9.一种显示装置，其特征在于，包括如权利要求8所述的驱动电路。
10.一种如权利要求1-7任一项所述的移位寄存器的驱动方法，其特征在于，包括：
第一阶段，对输入信号端加载第二电平的信号，对第一时钟信号端加载第一电平的信号，对第二时钟信号端加载第二电平的信号；
第二阶段，对输入信号端加载第二电平的信号，对第一时钟信号端加载第二电平的信号，对第二时钟信号端加载第一电平的信号；
第三阶段，对输入信号端加载第一电平的信号，对第一时钟信号端加载第一电平的信号，对第二时钟信号端加载第二电平的信号；
第四阶段，对输入信号端加载第一电平的信号，对第一时钟信号端加载第二电平的信号，对第二时钟信号端加载第一电平的信号。
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Legal Events
| Date | Code | Title | Description |
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| PB01 | Publication | ||
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| SE01 | Entry into force of request for substantive examination | ||
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| GR01 | Patent grant | ||
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