CN108630141A - 像素电路、显示面板及其驱动方法 - Google Patents

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Abstract

本发明提供一种像素电路，包括驱动晶体管、补偿模块、数据写入模块、发光模块和数据电压存储模块。补偿模块的控制端接收到补偿控制信号时，该补偿模块的第一端与该补偿模块的第二端导通，以将驱动晶体管的第二极和驱动晶体管的栅极导通，并将驱动晶体管的阈值电压存储在补偿模块中，且补偿模块的控制端接收到补偿控制信号时，补偿模块的第四端与补偿模块的第三端导通。数据电压存储模块用于在数据写入阶段存储通过数据写入模块写入的数据电压；发光模块用于在驱动电流的驱动下发光。本发明还提供一种显示面板和该显示面板的驱动方法。像素电路在补偿阶段可以快速形成二极管连接，并且显示面板发光不受工艺均匀度影响。

Description

像素电路、显示面板及其驱动方法
技术领域
本发明涉及显示装置领域，具体地，涉及一种像素电路、包括该像素电路的显示面板和该显示面板的驱动方法。
背景技术
发光二极管显示装置已经广泛地应用于显示领域，目前，发光二极管显示装置多采用低温多晶硅工艺制得。由于工艺的不均匀性，可能会导致发光二极管显示装置的各个像素单元中的驱动晶体管的阈值电压不均一，从而导致了显示的不均匀。
因此，如何使得显示装置显示均匀成为本领域亟待解决的技术问题。
发明内容
本发明的目的在于提供一种像素电路、包括该像素电路的显示面板和该显示面板的驱动方法。驱动所述像素电路进行显示时，不再受到驱动晶体管阈值电压的影响，从而使得显示装置显示均匀。
为了实现上述目的，作为本发明的一个方面，提供一种像素电路，所述像素电路包括驱动晶体管、补偿模块、数据写入模块和发光模块，其中，所述像素电路还包括数据电压存储模块，
所述驱动晶体管的第一极与高压输入端电连接，所述驱动晶体管的第二极用于输出驱动所述发光模块发光的电流；
所述补偿模块的第一端与所述驱动晶体管的第二极电连接，所述补偿模块的第二端与所述驱动晶体管的栅极电连接，所述补偿模块的第三端与所述数据电压存储模块的第二端电连接，所述补偿模块的第四端与固定电压端电连接，所述补偿模块的控制端接收到补偿控制信号时，该补偿模块的第一端与该补偿模块的第二端导通，以将所述驱动晶体管的第二极和所述驱动晶体管的栅极导通，并将所述驱动晶体管的阈值电压存储在所述补偿模块中，且所述补偿模块的控制端接收到补偿控制信号时，所述补偿模块的第四端与所述补偿模块的第三端导通；
所述数据电压存储模块的第一端与高压输入端相连，所述数据电压存储模块的第二端还与所述数据写入模块的输出端电连接，所述数据电压存储模块用于在数据写入阶段存储通过所述数据写入模块写入的数据电压；
所述发光模块用于在接收到来自所述驱动晶体管的驱动电流后，在驱动电流的驱动下发光；
所述数据写入模块的输入端与数据信号输入端电连接，所述数据写入模块的输出端与所述数据电压存储模块的第二端电连接，所述数据写入模块能够在控制端接收到数据写入控制信号时，所述数据写入模块的输入端与该数据写入模块的输出端导通。
优选地，所述数据电压存储模块包括数据电压存储电容，所述数据电压存储电容的第一极板形成为所述数据电压存储模块的第一端，所述数据电压存储电容的第二极板形成为所述数据存储模块的第二端。
优选地，所述补偿模块包括补偿电容、第一补偿晶体管和第二补偿晶体管；
所述补偿电容的第一极板形成为所述补偿模块的第三端，所述补偿电容的第二极板形成为所述补偿模块的第二端；
所述第一补偿晶体管的第一极形成为所述补偿模块的第四端，所述第一补偿晶体管的第二极与所述补偿电容的第一极板电连接，所述第一补偿晶体管的栅极形成为所述补偿模块的控制端；
所述第二补偿晶体管的第一极形成为所述补偿模块的第二端，所述第二补偿晶体管的第二极形成为所述补偿模块的第一端，所述第一补偿晶体管的栅极与所述第二补偿晶体管的栅极电连接。
优选地，所述数据写入模块包括数据写入晶体管，所述数据写入晶体管的第一极与数据信号输入端电连接，所述数据写入晶体管的第二极形成为所述数据写入模块的输出端，所述数据写入晶体管的栅极形成为所述数据写入模块的控制端。
优选地，所述像素电路还包括发光控制模块，所述发光控制模块的第一端与所述驱动晶体管的第二极电连接，所述发光控制模块的第二端与所述发光模块的第一端电连接，当所述发光控制模块的控制端接收到发光控制信号时，将所述驱动晶体管的第二极与所述发光模块的第一端导通。
优选地，所述发光控制模块包括发光控制晶体管，所述发光控制晶体管的第一极形成为所述发光控制模块的第一端，所述发光控制晶体管的第二极形成为所述发光控制模块的第二端，所述发光控制晶体管的栅极形成为所述发光控制模块的控制端。
优选地，所述像素电路还包括放电模块，所述放电模块的第一端与参考电压输入端电连接，所述放电模块的第二端与所述发光模块的第一端电连接，所述放电模块能够在该放电模块的控制端接收到放电控制信号时，将该放电模块的第一端和第二端导通。
优选地，所述放电模块的控制端与所述补偿模块的控制端电连接。
优选地，所述放电模块包括放电晶体管，所述放电晶体管的第一极形成为所述放电模块的第一端，所述放电晶体管的第二极形成为所述放电模块的第二端，所述放电晶体管的栅极形成为所述放电模块的控制端。
优选地，所述像素电路还包括初始化模块，所述初始化模块的第一端与所述固定电压端电连接，所述初始化模块的第二端与所述补偿模块的第三端电连接，所述初始化模块的第三端与所述补偿模块的第二端电连接，所述初始化模块的第四端与参考电压输入端电连接，所述初始化模块能够在控制端接收到初始化控制信号时，将该初始化模块的第二端与所述初始化模块的第一端导通，并将该初始化模块的第三端分别与该初始化模块的第四端导通。
优选地，所述初始化模块包括第一初始化晶体管和第二初始化晶体管，
所述第一初始化晶体管的第一极形成为所述初始化模块的第四端，所述第一初始化晶体管的第二极形成为所述初始化模块的第三端，所述第一初始化晶体管的栅极形成为所述初始化模块的控制端；
所述第二初始化晶体管的第一极形成为所述初始化模块的第一端，所述第二初始化晶体管的第二极形成为所述初始化模块的第二端，所述第二初始化晶体管的栅极与所述第一初始化晶体管的栅极电连接。
优选地，所述固定电压端包括所述参考电压输入端或者所述高压输入端。
作为本发明的第二个方面，提供一种显示面板，所述显示面板包括多个像素单元，每个所述像素单元内均设置有像素电路，其中，所述像素电路为本发明所提供的上述像素电路，所述显示面板包括数据线和多组栅线，所述数据线与所述数据信号输入端电连接，
每组栅线都包括补偿控制栅线、数据写入控制栅线和初始化控制栅线，所述补偿控制栅线与所述补偿模块的控制端电连接，所述数据写入控制栅线与所述数据写入模块的控制端电连接，所述初始化控制栅线与所述初始化模块的控制端电连接。
优选地，每组所述栅线还包括发光控制栅线，所述像素电路还包括所述发光控制模块，所述发光控制模块的控制端与所述发光控制栅线电连接。
作为本发明的第三个方面，提供一种显示面板的驱动方法，其中，所述显示面板为本发明所提供的上述显示面板，所述驱动方法多个周期，每个周期都包括多个阶段，多个阶段包括：补偿阶段、数据写入阶段和发光阶段，所述驱动方法包括：
在补偿阶段，向所述补偿控制栅线提供补偿控制信号；
在数据写入阶段，向所述数据写入控制栅线提供数据写入控制信号，并向所述数据线提供数据信号，以使得发光阶段所述发光模块能够发光；
发光阶段，利用所述驱动晶体管产生的驱动电流控制所述发光模块发光。
优选地，所述像素电路还包括所述发光控制模块，在发光阶段，向所述发光控制栅线提供发光控制信号。
优选地，所述像素电路包括所述初始化阶段，多个阶段还包括在所述补偿阶段之前进行的初始化阶段：在所述初始化阶段，向所述初始化控制栅线提供初始化控制信号。
优选地，在所述工作周期的多个阶段中，至少一个阶段与和该阶段相邻的阶段之间存在时间间隔。
在本发明所提供的像素电路工作时，每个工作周期至少包括三个阶段：补偿阶段、数据写入阶段和发光阶段。在补偿阶段，驱动晶体管的驱动电压存储在补偿模块中。此时，补偿模块的第三端电压为固定电压端输入的固定电压，由于数据电压不在此阶段写入，因此，在不同工作周期的补偿阶段中，补偿模块的第三端电压均为稳定的固定电压端输入的固定电压，不受数据电压的影响，从而可以确保在补偿阶段可以快速地将驱动晶体管形成稳定的二极管连接，并确保各个工作周期都能够将精确的驱动晶体管的阈值电压存储在补偿模块中。由于驱动晶体管的阈值电压存储在补偿模块中，从而可以发光阶段消除驱动晶体管阈值电压的影响，提高显示面板发光的均匀性。
附图说明
附图是用来提供对本发明的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本发明，但并不构成对本发明的限制。在附图中：
图1是本发明所提供的像素电路的模块示意图；
图2是本发明所提供的像素电路的一种优选实施方式的示意图；
图3是本发明所提供的像素电路的另一种优选实施方式的示意图；
图4是驱动显示面板时，各个信号的时序信号图。
附图标记说明
100：初始化模块 200：补偿模块
300：数据写入模块 400：发光模块
500：数据电压存储模块 600：发光控制模块
700：放电模块
具体实施方式
以下结合附图对本发明的具体实施方式进行详细说明。应当理解的是，此处所描述的具体实施方式仅用于说明和解释本发明，并不用于限制本发明。
作为本发明的一个方面，提供一种像素电路，如图1中所示，所述像素电路包括初始化模块100、驱动晶体管M3、补偿模块200、数据写入模块300和发光模块400，其中，所述像素电路还包括数据电压存储模块500。
驱动晶体管M3的第一极与高压输入端VDD’电连接，驱动晶体管M3的第二极用于输出驱动发光模块400发光的电流。
补偿模块200的第一端与驱动晶体管M3的第二极电连接，补偿模块200的第二端与驱动晶体管M3的栅极电连接，补偿模块200的第三端与数据电压存储模块500的第二端电连接，补偿模块的第四端与固定电压端V0’电连接。补偿模块200的控制端接收到补偿控制信号时，该补偿模块200的第一端与该补偿模块200的第二端导通，进而将驱动晶体管M3的第二极和栅极导通，并将驱动晶体管M3的阈值电压Vth存储在补偿模块200中。此外，当补偿模块200的控制端接收到补偿控制信号时，该补偿模块200的第四端与补偿模块200的第三端导通。由于补偿模块200的第四端与固定电压端V0’电连接，因此，补偿模块200的第三端与该补偿模块200的第四端导通后，可以补偿模块200第三端电压维持在固定电压端V0’输入的固定电压。
需要指出的是，当补偿模块200的控制端接收到补偿控制信号时，补偿模块200中形成两条导电通路：补偿模块200的第一端与补偿模块200的第二端之间形成的导电通路；以及补偿模块200的第三端与补偿模块200的第四端之间形成的导电通路。这两条导电通路之间并没有导电连接。
除此之外，在本发明中，可以根据补偿模块200中的薄膜晶体管的类型来确定补偿控制信号的类型。例如，当补偿模块中200的晶体管为P型晶体管时，补偿控制信号为低电平信号；当补偿模块200中的薄膜晶体管为N型晶体管时，补偿控制信号为高电平信号。需要指出的是，当补偿模块200的控制端未接收到所述补偿控制信号时、或者接收到不同于所述补偿控制信号的信号时，补偿模块200的第一端与补偿模块200的第二端之间断开，补偿模块200的第三端与补偿模块200的第四端之间断开。
数据电压存储模块500的第一端与高压输入端VDD’相连，数据电压存储模块500的第二端还与数据写入模块300的输出端电连接，数据电压存储模块500用于在数据写入阶段存储通过数据写入模块300写入的数据电压。
发光模块400用于在发光阶段接收到来自驱动晶体管M3的驱动电流后，在该驱动电流的驱动下发光。
数据写入模块300的输入端与数据信号输入端data电连接，数据写入模块300的输出端与数据电压存储模块500的第二端电连接，数据写入模块300能够在控制端接收到数据写入控制信号时，数据写入模块300的输入端与数据写入模块300的输出端导通。
同样地，在本发明中，可以根据数据写入模块300中的晶体管的类型来确定数据写入控制信号的类型。当数据写入模块300中的晶体管为P型晶体管时，数据写入控制信号为低电平信号，当数据写入模块300中的晶体管为N型晶体管时，数据写入控制信号为高电平信号。
由于本发明所提供的像素电路中增加了数据电压存储模块500，因此，数据电压不再存储在补偿模块中。
具体地，在本发明所提供的像素电路工作时，每个工作周期至少包括三个阶段：补偿阶段t2、数据写入阶段t3和发光阶段t4。如图1所示，补偿模块200的控制端与补偿控制栅线G(N-1)电连接，数据写入模块300的控制端与数据写入控制栅线G(N)电连接。
在补偿阶段t2，驱动晶体管M3的驱动电压Vth存储在补偿模块200中。此时，补偿模块200的第三端电压为固定电压端输入的固定电压，由于数据电压不在此阶段写入，因此，在不同工作周期的补偿阶段t2中，补偿模块200的第三端电压均为稳定的固定电压端V0’输入的固定电压，不受数据电压的影响，从而可以确保在补偿阶段可以快速地将驱动晶体管M3形成稳定的二极管连接，并确保各个工作周期都能够将精确的驱动晶体管M3的阈值电压Vth存储在补偿模块200中。具体地，补偿模块200中的电压为(VDD+Vth)。
在数据写入阶段t3，数据写入到数据电压存储模块500中，此时，补偿模块200的第四端与补偿模块的第三端是断开的，补偿模块200的第一端与补偿模块的第二端也是断开的。数据写入模块300和补偿模块200形成串联。由于补偿模块200具有存储电能的功能，因此，补偿模块200中存在电容，或者存在与电容等效的器件。因此，在数据写入阶段，补偿模块200会产生自举现象。使得补偿模块200的第二端(即，驱动晶体管的栅极)电压由(VDD+Vth)变为(VDD+Vth)+(Vdata-V0)。
在发光阶段，可以按照以下公式计算发光模块的驱动电流：
I＝K*(Vgs-Vth)2
＝K*(V2-VDD-Vth)2
＝K*(VDD+Vth+Vdata-V0-VDD-Vth)2
＝K*(Vdata-V0)2 (1)
其中，K为与驱动晶体管M3的材料以及尺寸相关的常数；
V2为补偿模块的第二端的电压；
Vgs为驱动晶体管M3的栅漏电压；
VDD为通过高压输入端输入的高压信号；
Vdata为数据电压；
Vth为驱动晶体管M3的阈值电压；
V0为固定电压端输入的固定电压。
由此可知，发光二极管的驱动电流仅与数据电压以及固定电压有关，与驱动晶体管M3的阈值电压无关，因此，面板工艺上的不均匀不再影响显示亮度，从而可以提高显示亮度的均匀性，提高显示装置的画面质量。
在本发明中，对固定电压V0没有特殊的要求。例如，在图2所示的具体实施方式中，固定电压端为参考电压输入端Vref’，因此，固定电压V0为通过参考电压输入端Vref’输入的参考电压Vref。在这种情况中，驱动电流与高压输入端输入的电压的大小无关，从而可以消除像素电路中导线内阻带来的压降(即，IR drop)。
在图3中所示的具体实施方式中，固定电压端为高压输入端VDD’，在这种实施方式作用，固定电压V0为通过高压输入端输入的高压VDD。这种情况中，驱动电流也与驱动晶体管M3的阈值电压无关。
除此之外，由于在本发明所提供的像素单元工作时，补偿阶段与数据写入阶段分在两个不同阶段进行，驱动晶体管M3的阈值电压和数据电压分别存储在补偿模块200和数据电压存储模块500中，因此，在利用补偿模块200形成驱动晶体管M3的二极管连接时，不再受到不同工作周期的不同数据电压的影响，从而可以形成快速稳定的二极管连接，确保将阈值电压精确地写入补偿模块中，从而可以彻底消除工艺不均匀导致的阈值电压不同对显示画面的影响，提高包括所述像素单元的显示面板的显示质量。
为了使得显示更加精确，优选地，所述像素电路还包括初始化模块100，如图1中所示，该初始化模块100的第一端与固定电压端V0’电连接，该初始化模块100的第二端与补偿模块200的第三端电连接，初始化模块100的第三端与补偿模块200的第二端电连接，初始化模块100的第四端与参考电压输入端Vref’电连接。初始化模块100能够在控制端接收到初始化控制信号时，将该初始化模块100的第二端与该初始化模块100的第一端导通，并将该初始化模块100的第三端与该初始化模块100的第四端导通。
同样地，在本发明中，可以根据初始化模块100中的晶体管的类型来确定初始化控制信号的类型。当初始化模块100中的晶体管为P型晶体管时，初始化控制信号为低电平信号，当初始化控制模块100中的晶体管为N型晶体管时，初始化控制信号为高电平信号。
相应地，所述像素电路的工作周期还包括初始化阶段t1。在初始化阶段t1向初始化模块100的控制端提供初始化控制信号，从而将与该初始化模块100的第一端导通，并将该初始化模块100的第三端与该初始化模块100的第四端导通。即，将补偿模块的第三端与固定电压端V0’导通，并将补偿模块200的第二端分别与参考电压输入端Vref’导通，从而可以释放驱动晶体管M3栅极的残余电量，并确保补偿模块200第三端电压稳定。
在本发明中，对数据电压存储模块500的具体结构并没有特殊的限制，优选地，数据电压存储模块500可以包括数据电压存储电容C2，数据电压存储电容C2的第一极板形成为数据电压存储模块500的第一端，(即，数据电压存储电容C2的第一极板与高压输入端VDD’电连接)，数据电压存储电容C2的第二极板形成为数据电压存储模块500的第二端，即，数据存储电容C2的第二极板与补偿模块200的第三端电连接。
在补偿阶段t2，数据电压存储电容C2的第二极板的电压为参考电压输入端Vref’提供的参考电压Vref，补偿模块200的第一端电压为初始化模块100提供的固定电压。
在数据写入阶段t3，通过数据写入模块300输入的数据电压存储在数据电压存储电容C2中。
在本发明中，对补偿模块200的具体结构也没有特殊的限制，在图2所示的具体实施方式中，补偿模块200包括补偿电容C1、第一补偿晶体管M5和第二补偿晶体管M2。
如图中所示，补偿电容C1的第一极板形成为补偿模块200的第三端，补偿电容C1的第二极板形成为补偿模块200的第二端。
第一补偿晶体管M5的第一极形成为补偿模块200的第四端，即，与固定电压端(图2中固定电压端为参考电压输入端Vref’，图3中固定电压端为高压输入端VDD’)电连接。第一补偿晶体管M5的第二极与补偿电容C1的第一极板电连接，第一补偿晶体管M5的栅极形成为补偿模块200的控制端。
第二补偿晶体管M2的第一极形成为补偿模块200的第二端(即，与驱动晶体管M3的栅极电连接，同时还与补偿电容C1的第二极板电连接)，第二补偿晶体管M2的第二极形成为补偿模块200的第一端(即，与驱动晶体管M3第二极电连接)。
第一补偿晶体管M5的栅极与第二补偿晶体管M2的栅极电连接。
需要指出的是，第一补偿晶体管M5的类型与第二补偿晶体管M2的类型相同。即，第一补偿晶体管M5和第二补偿晶体管M2可以同为N型晶体管，也可以同为P型晶体管。在图2和图3所示的实施方式中，第一补偿晶体管M5和第二补偿晶体管M2同为P型晶体管，当栅极接收到低电平信号时导通。
在补偿阶段t2，第一补偿晶体管M5的栅极和第二补偿晶体管M2的栅极同时接收到初始化控制信号后导通，从而可以将固定电压端输入的固定电压输送至补偿电容C1的第一极板，并将驱动晶体管M3的栅极和第二极电连接，形成二极管连接。
同样地，在本发明中，对数据写入模块300的具体结构也没有特殊的限制。例如，在图2和图3中所示的具体实施方式中，数据写入模块300包括数据写入晶体管M6，该数据写入晶体管M6的第一极与数据信号输入端data电连接，数据写入晶体管M6的第二极形成为数据写入模块300的第二端，数据写入晶体管M6的栅极形成为数据写入模块300的控制端。
在数据写入阶段t3，向数据写入晶体管M6的栅极提供数据写入控制信号，因此，数据写入晶体管M6的第一极和第二极导通，从而将通过数据信号输入端data写入的信号存储在数据电压存储电容C2中。此时，数据存储电容C2和补偿模块200的补偿电容C1串联。
在发光阶段t4，根据公式(1)求得的电流驱动发光模块发光。
在本发明中，对初始化模块100的具体结构也没有特殊的限制，在图2和图3中所示的具体实施方式中，初始化模块100包括第一初始化晶体管M1和第二初始化晶体管M4。
第一初始化晶体管M1的第一极形成为初始化模块100的第四端(即，第一初始化晶体管M1的第一极与参考电压输入端Vref’电连接)，第一初始化晶体管M1的第二极与补偿模块200的第二端电连接，第一初始化晶体管M1的栅极形成为初始化模块100的控制端。
第二初始化晶体管M4的第一极形成为初始化模块100的第一端(即，与固定电压端电连接，在图2中所示的实施方式中，固定电压端包括参考电压输入端Vref’，在图3中所示的实施方式中，固定电压端包括高压输入端VDD’)，第二初始化晶体管M4的第二极形成为初始化模块100的第二端(即，与补偿模块200的第三端电连接)，第二初始化晶体管M4的栅极与第一初始化晶体管M1的栅极电连接(在图2中，均与补偿控制栅线G(N-1)电连接)。
第一初始化晶体管M1的类型与第二初始化晶体管M4的类型应当相同。即，第一初始化晶体管M1和第二初始化晶体管M4可以同为N型晶体管或者同为P型晶体管。在图2和图3中所示的具体实施方式中，第一初始化晶体管M1和第二初始化晶体管M4均为P型晶体管。
在初始化阶段t1，向第一初始化晶体管M1的栅极以及第二初始化晶体管M4的栅极提供初始化控制信号，第一初始化晶体管M1和第二初始化晶体管M4均导通。
为了节约电能、实现精确显示，优选地，发光模块400仅在发光阶段t4时发光，在其他阶段均不发光。相应地，所述像素电路还包括发光控制模块600，该发光控制模块600的第一端与驱动晶体管M3的第二极电连接，发光控制模块600的第二端与所述发光模块的第一端电连接。当发光控制模块600的控制端接收到发光控制信号时，将驱动晶体管M3的第二极与发光模块的输入端导通。
仅在发光阶段t4向发光控制模块600的控制端提供发光控制信号，因此，仅在发光阶段，驱动电流方可流向发光模块400。
同样地，在本发明中，可以根据发光控制模块600中的晶体管的类型来确定发光控制信号的类型。当发光控制模块600中的晶体管为P型晶体管时，发光控制信号为低电平信号，当发光控制模块600中的晶体管为N型晶体管时，发光控制信号为高电平信号。
在本发明中，对发光控制模块600的具体结构并不做特殊的限制，例如，在图2和图3所示的实施方式中，发光控制模块包括发光控制晶体管M7，该发光控制晶体管M7的第一极形成为发光控制模块600的第一端，即，与驱动晶体管M3的第二极电连接。发光控制晶体管M7的第二极形成为发光模块600的第一端，即，与发光模块400的第一端电连接。发光控制晶体管M7的栅极形成为发光控制模块600的控制端。
在发光阶段t4，向发光控制晶体管M7的栅极提供发光控制信号，发光控制晶体管M7导通，从而可以驱动晶体管M3的第二极与发光模块400导通。
为了实现更好的暗态显示，优选地，所述像素电路还包括放电模块700，该放电模块700的第一端与参考电压输入端Vref’电连接，放电模块700的第二端与发光模块400的第一端电连接，放电模块700能够在该控制端接收到放电控制信号时，将该放电模块700的第一端和第二端导通。
同样地，在本发明中，可以根据放电模块700中的晶体管的类型来确定放电控制信号的类型。当数据写入模块300中的晶体管为P型晶体管时，数据写入控制信号为低电平信号，当数据写入模块300中的晶体管为N型晶体管时，数据写入控制信号为高电平信号。
通常，像素电路中的发光模块400包括发光二极管。发光二极管具有层状结构，产生寄生电容。在放电模块700的第一端和第二端导通后，发光模块400的第一端与参考电压输入端Vref’导通，从而可以将发光模块400阳极中的残余电荷导出，有利于更好地实现暗态显示。
放电模块700的控制端可以与补偿模块200的控制端电连接，以在补偿阶段完成放电。
在图2和图3中所示的具体实施方式中，所述放电模块包括放电晶体管M8，该放电晶体管M8的第一极形成为放电模块700的第一端，即，与参考电压输入端Vref’电连接。放电晶体管M8的第二极形成为放电模块700的第二端，即，与所述发光模块400的第一端电连接，放电晶体管M8的栅极形成为放电模块700的控制端。在补偿阶段，向放电晶体管M8的栅极提供放电控制信号，放电晶体管M8导通，使得发光模块400的第一端与参考电压输入端Vref’导通，以对发光模块400的第一端进行放电。
作为本发明的第二个方面，提供一种显示面板，所述显示面板包括多个像素单元，每个所述像素单元内均设置有像素电路，其中，所述像素电路为本发明所提供的上述像素电路，所述显示面板包括数据线和多组栅线，所述数据线与所述数据信号输入端电连接，
每组栅线都包括补偿控制栅线G(N-1)、数据写入控制栅线G(N)和初始化控制栅线G(N-2)。如图1中所示，补偿控制栅线G(N-1)与补偿模块200的控制端电连接，数据写入控制栅线G(N)与数据写入模块300的控制端电连接，初始化控制栅线G(N-2)与初始化模块100的控制端电连接。
图4中所示的是一组栅线中不同栅线在一个工作周期内的时序信号图。
如图所示，在补偿阶段t2，向补偿控制栅线G(N-1)提供补偿控制信号。在数据写入阶段t3，向数据写入控制栅线G(N)提供数据写入控制信号。
如上文中所述，作为本发明的一种优选实施方式，像素电路还包括发光控制模块600，相应地，每组所述栅线还包括发光控制栅线E(N)，所述发光控制模块的控制端与所述发光控制栅线E(N)电连接。如图4中所示，在发光阶段t4向发光控制栅线E(N)提供发光控制信号。
所述像素电路还可以包括数字化模块100，在这种实施方式中，每组栅线还包括初始化控制栅线G(N-2)。如图4中所示，在初始化阶段，向初始化控制栅线G(N-2)提供初始化控制信号。
作为本发明的第三个方面，提供一种显示面板的驱动方法，所述显示面板为本发明所提供的上述显示面板，所述驱动方法多个周期，每个周期都包括多个阶段，多个阶段包括：补偿阶段、数据写入阶段和发光阶段，所述驱动方法包括：
在补偿阶段t2，向所述补偿控制栅线提供补偿控制信号；
在数据写入阶段t3，向所述数据写入控制栅线提供数据控制信号，并向所述数据线提供数据信号，以使得发光阶段所述发光模块能够发光；
发光阶段t4，利用所述驱动晶体管产生的驱动电流控制所述发光模块发光。
优选地，所述像素电路还包括所述发光控制模块，相应地，在发光阶段t4，向所述发光控制栅线E(N)提供发光控制信号。
所述像素电路还可以包括所述初始化阶段100，多个阶段还包括在所述补偿阶段之前进行的初始化阶段t1：在所述初始化阶段t1，向初始化控制栅线G(N-2)提供初始化控制信号。
为了确保在下一个阶段开始时上一个阶段打开的晶体管彻底关闭，优选地，在所述工作周期的多个阶段中，至少一个阶段与和该阶段相邻的阶段之间存在时间间隔。
如图4中所示，初始化阶段t1与补偿阶段t2之间存在时间间隔，补偿阶段t2与数据写入阶段t3之间存在时间间隔，数据写入阶段t3与发光阶段t4之间存在时间间隔。
下面结合图2和图4详细介绍本发明所提供的驱动方法。
在图2中所示的具体实施方式中，像素电路包括初始化模块、补偿模块、数据写入模块、数据电压存储模块、放电模块和发光控制模块。所述显示面板的每组栅线都包括初始化控制栅线G(N-2)、补偿控制栅线G(N-1)、数据写入控制栅线G(N)、发光控制栅线E(N)。
初始化模块包括第一初始化晶体管M1和第二初始化晶体管M4，第一初始化晶体管M1和第二初始化晶体管M4均为P型晶体管。因此，初始化控制信号为低电平信号。补偿模块包括补偿电容C1、第一补偿晶体管M5和第二补偿晶体管M2。第一补偿晶体管M5和第二补偿晶体管M2均为P型晶体管，因此，补偿控制信号为低电平信号。数据电压存储模块包括数据电压存储电容C2。数据写入模块包括数据写入晶体管M6，由于数据写入晶体管M6为P型晶体管，因此，数据写入控制信号为低电平信号。发光控制模块包括发光控制晶体管M7，由于发光控制晶体管M7为P型晶体管，因此，发光控制信号为低电平信号。放电模块包括放电晶体管M8，由于放电晶体管M8为P型晶体管，因此，放电控制信号为低电平信号。
第一初始化晶体管M1和第二初始化晶体管M4的栅极均与初始化控制栅极G(N-2)相连。第一初始化晶体管M1的第一极与参考电压输入端Vref’电连接，第一初始化晶体管M1的第二极与补偿电容C1的第二极板电连接。第二初始化晶体管M4的一极与参考电压输入端Vref’电连接，第二初始化晶体管M4的第二极与补偿电容C1的第一极板电连接。
第一补偿晶体管M5的栅极与第二补偿晶体管M2的栅极、以及放电晶体管M8的栅极电连接，且均与补偿控制栅线G(N-1)电连接。第一补偿晶体管M5的第一极与参考电压输入端Vref’电连接，第一补偿晶体管M5的第二极与补偿电容C1的第一极板电连接。第二补偿晶体管M2的第一极与补偿电容C1的第一极板电连接，第二补偿晶体管M2的第二极与驱动晶体管M3的第二极电连接。放电晶体管M8的第一极与参考电压输入端Vref’电连接，放电晶体管M8的第二极与发光模块400的第一端电连接。
数据写入晶体管M6的第一极与数据信号输入端data电连接，数据写入晶体管M6的第二极与补偿电容C1的第一极板电连接。数据写入晶体管M6的栅极与数据写入控制栅线G(N)电连接。
发光控制晶体管M7的栅极与发光控制栅线E(N)电连接。发光控制晶体管M7的第一极与驱动晶体管M3的第二极电连接，发光控制晶体管M7的第二极与发光模块400的阳极电连接。
在像素电路中，发光模块400为发光二极管，发光模块的阴极与第二电平信号端VSS电连接。通过高压信号输入端VDD’提供高电平信号，通过低压信号输入端VSS提供低电平信号。
在初始化阶段t1，向初始化控制栅线G(N-2)提供低电平的初始化控制信号，第一初始化晶体管M1和第二初始化晶体管M4均导通，其余晶体管均截止，将参考电压输入端Vref’输入的参考电压分别输入至补偿电容C1的第一极板和第二极板，以对补偿电容C1以及驱动晶体管M3的栅极进行初始化。
在补偿阶段t2，向补偿控制栅线G(N-1)提供低电平的补偿控制信号，第一补偿晶体管M5和第二补偿晶体管M2导通，第一补偿晶体管M5将补偿电容C1的第一极板的电压维持为参考电压，从而可以获得快速稳定的驱动晶体管M3的二极管连接，并将驱动晶体管M3的阈值电压Vth写入补偿电容C1中。在补偿阶段t2，放电晶体管M8页导通，将发光模块400的阳极与参考电压输入端Vref’导通，从而对反光模块400的阳极进行放电。
在数据写入阶段t3，向数据写入控制栅线G(N)提供低电平的数据写入控制信号，数据写入晶体管M6导通，通过数据线提供的数据信号从数据信号输入端data写入至数据电压存储电容C2中。
在发光阶段t4，向发光控制栅线E(N)提供低电平的发光控制信号，发光控制晶体管M7导通，驱动晶体管M3产生的电流驱动发光模块400发光。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (18)

1.一种像素电路，所述像素电路包括驱动晶体管、补偿模块、数据写入模块和发光模块，其特征在于，所述像素电路还包括数据电压存储模块，
所述驱动晶体管的第一极与高压输入端电连接，所述驱动晶体管的第二极用于输出驱动所述发光模块发光的电流；
所述补偿模块的第一端与所述驱动晶体管的第二极电连接，所述补偿模块的第二端与所述驱动晶体管的栅极电连接，所述补偿模块的第三端与所述数据电压存储模块的第二端电连接，所述补偿模块的第四端与固定电压端电连接，所述补偿模块的控制端接收到补偿控制信号时，该补偿模块的第一端与该补偿模块的第二端导通，以将所述驱动晶体管的第二极和所述驱动晶体管的栅极导通，并将所述驱动晶体管的阈值电压存储在所述补偿模块中，且所述补偿模块的控制端接收到补偿控制信号时，所述补偿模块的第四端与所述补偿模块的第三端导通；
所述数据电压存储模块的第一端与高压输入端相连，所述数据电压存储模块的第二端还与所述数据写入模块的输出端电连接，所述数据电压存储模块用于在数据写入阶段存储通过所述数据写入模块写入的数据电压；
所述发光模块用于在接收到来自所述驱动晶体管的驱动电流后，在驱动电流的驱动下发光；
所述数据写入模块的输入端与数据信号输入端电连接，所述数据写入模块的输出端与所述数据电压存储模块的第二端电连接，所述数据写入模块能够在控制端接收到数据写入控制信号时，所述数据写入模块的输入端与该数据写入模块的输出端导通。
2.根据权利要求1所述的像素电路，其特征在于，所述数据电压存储模块包括数据电压存储电容，所述数据电压存储电容的第一极板形成为所述数据电压存储模块的第一端，所述数据电压存储电容的第二极板形成为所述数据存储模块的第二端。
3.根据权利要求1所述的像素电路，其特征在于，所述补偿模块包括补偿电容、第一补偿晶体管和第二补偿晶体管；
所述补偿电容的第一极板形成为所述补偿模块的第三端，所述补偿电容的第二极板形成为所述补偿模块的第二端；
所述第一补偿晶体管的第一极形成为所述补偿模块的第四端，所述第一补偿晶体管的第二极与所述补偿电容的第一极板电连接，所述第一补偿晶体管的栅极形成为所述补偿模块的控制端；
所述第二补偿晶体管的第一极形成为所述补偿模块的第二端，所述第二补偿晶体管的第二极形成为所述补偿模块的第一端，所述第一补偿晶体管的栅极与所述第二补偿晶体管的栅极电连接。
4.根据权利要求1所述的像素电路，其特征在于，所述数据写入模块包括数据写入晶体管，所述数据写入晶体管的第一极与数据信号输入端电连接，所述数据写入晶体管的第二极形成为所述数据写入模块的输出端，所述数据写入晶体管的栅极形成为所述数据写入模块的控制端。
5.根据权利要求1至4中任意一项所述的像素电路，其特征在于，所述像素电路还包括发光控制模块，所述发光控制模块的第一端与所述驱动晶体管的第二极电连接，所述发光控制模块的第二端与所述发光模块的第一端电连接，当所述发光控制模块的控制端接收到发光控制信号时，将所述驱动晶体管的第二极与所述发光模块的第一端导通。
6.根据权利要求5所述的像素电路，其特征在于，所述发光控制模块包括发光控制晶体管，所述发光控制晶体管的第一极形成为所述发光控制模块的第一端，所述发光控制晶体管的第二极形成为所述发光控制模块的第二端，所述发光控制晶体管的栅极形成为所述发光控制模块的控制端。
7.根据权利要求1至4中任意一项所述的像素电路，其特征在于，所述像素电路还包括放电模块，所述放电模块的第一端与参考电压输入端电连接，所述放电模块的第二端与所述发光模块的第一端电连接，所述放电模块能够在该放电模块的控制端接收到放电控制信号时，将该放电模块的第一端和第二端导通。
8.根据权利要求7所述的像素电路，其特征在于，所述放电模块的控制端与所述补偿模块的控制端电连接。
9.根据权利要求7所述的像素电路，其特征在于，所述放电模块包括放电晶体管，所述放电晶体管的第一极形成为所述放电模块的第一端，所述放电晶体管的第二极形成为所述放电模块的第二端，所述放电晶体管的栅极形成为所述放电模块的控制端。
10.根据权利要求1至4中任意一项所述的像素电路，其特征在于，所述像素电路还包括初始化模块，所述初始化模块的第一端与所述固定电压端电连接，所述初始化模块的第二端与所述补偿模块的第三端电连接，所述初始化模块的第三端与所述补偿模块的第二端电连接，所述初始化模块的第四端与参考电压输入端电连接，所述初始化模块能够在控制端接收到初始化控制信号时，将该初始化模块的第二端与所述初始化模块的第一端导通，并将该初始化模块的第三端分别与该初始化模块的第四端导通。
11.根据权利要求10所述的像素电路，其特征在于，所述初始化模块包括第一初始化晶体管和第二初始化晶体管，
所述第一初始化晶体管的第一极形成为所述初始化模块的第四端，所述第一初始化晶体管的第二极形成为所述初始化模块的第三端，所述第一初始化晶体管的栅极形成为所述初始化模块的控制端；
所述第二初始化晶体管的第一极形成为所述初始化模块的第一端，所述第二初始化晶体管的第二极形成为所述初始化模块的第二端，所述第二初始化晶体管的栅极与所述第一初始化晶体管的栅极电连接。
12.根据权利要求1至4中任意一项所述的像素电路，其特征在于，所述固定电压端包括所述参考电压输入端或者所述高压输入端。
13.一种显示面板，所述显示面板包括多个像素单元，每个所述像素单元内均设置有像素电路，其特征在于，所述像素电路为权利要求1至12中任意一项所述的像素电路，所述显示面板包括数据线和多组栅线，所述数据线与所述数据信号输入端电连接，
每组栅线都包括补偿控制栅线、数据写入控制栅线和初始化控制栅线，所述补偿控制栅线与所述补偿模块的控制端电连接，所述数据写入控制栅线与所述数据写入模块的控制端电连接，所述初始化控制栅线与所述初始化模块的控制端电连接。
14.根据权利要求13所述的显示面板，其特征在于，每组所述栅线还包括发光控制栅线，所述像素电路还包括所述发光控制模块，所述发光控制模块的控制端与所述发光控制栅线电连接。
15.一种显示面板的驱动方法，其特征在于，所述显示面板为权利要求12至14中任意一项所述的显示面板，所述驱动方法多个周期，每个周期都包括多个阶段，多个阶段包括：补偿阶段、数据写入阶段和发光阶段，所述驱动方法包括：
在补偿阶段，向所述补偿控制栅线提供补偿控制信号；
在数据写入阶段，向所述数据写入控制栅线提供数据写入控制信号，并向所述数据线提供数据信号，以使得发光阶段所述发光模块能够发光；
发光阶段，利用所述驱动晶体管产生的驱动电流控制所述发光模块发光。
16.根据权利要求15所述的驱动方法，其特征在于，所述像素电路还包括所述发光控制模块，在发光阶段，向所述发光控制栅线提供发光控制信号。
17.根据权利要求15所述的驱动方法，其特征在于，所述像素电路包括所述初始化阶段，多个阶段还包括在所述补偿阶段之前进行的初始化阶段：在所述初始化阶段，向所述初始化控制栅线提供初始化控制信号。
18.根据权利要求15至17中任意一项所述的驱动方法，其特征在于，在所述工作周期的多个阶段中，至少一个阶段与和该阶段相邻的阶段之间存在时间间隔。
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