CN111477178A - 一种像素驱动电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明提供一种像素驱动电路及其驱动方法、显示装置，涉及显示技术领域，为解决像素驱动电路存在控制信号复杂，以及由于阈值电压漂移导致的显示器件的显示亮度均匀性较差的问题。该像素驱动电路中，第一存储子电路的第一端与控制端连接；电源控制子电路分别与发光控制信号线，第一电源线和驱动子电路的第一端连接；补偿子电路分别与第一栅线、驱动子电路的控制端和驱动子电路的第一端连接；数据写入子电路与第一存储子电路的第二端连接；第一复位子电路分别与复位信号线、第一电源线和驱动子电路的控制端连接；第一控制子电路分别与第一栅线、初始化信号线和驱动子电路的第二端连接。本发明提供的像素驱动电路用于驱动发光元件发光。

Description

一种像素驱动电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路及其驱动方法、显示装置。
背景技术
AMOLED(Active-matrix Organic Light-Emitting Diode，有源矩阵有机发光二极管)显示器件具有自发光、超薄、反应速度快、对比度高、视角广等诸多优点，是目前受到广泛关注的一种显示器件。
这种AMOLED显示器件包括多个像素驱动电路和多个发光元件，像素驱动电路用于驱动对应的发光元件发光，从而实现AMOLED显示器件的显示功能。但是现有的像素驱动电路存在所需要的控制信号复杂，以及像素驱动电路中驱动晶体管存在由于阈值电压漂移导致的显示器件的显示亮度均匀性较差的问题。
发明内容
本发明的目的在于提供一种像素驱动电路及其驱动方法、显示装置，用于解决现有的像素驱动电路存在所需要的控制信号复杂，以及像素驱动电路中驱动晶体管存在由于阈值电压漂移导致的显示器件的显示亮度均匀性较差的问题。
为了实现上述目的，本发明提供如下技术方案：
本发明的第一方面提供一种像素驱动电路，用于驱动发光元件，包括：
驱动子电路，所述驱动子电路用于在其控制端的控制下，控制导通或断开该驱动子电路的第一端与该驱动子电路的第二端之间的连接，所述驱动子电路的第二端与所述发光元件连接；
第一存储子电路，所述第一存储子电路的第一端与所述控制端连接；
电源控制子电路，分别与发光控制信号线，第一电源线和所述驱动子电路的第一端连接，用于在所述发光控制信号线的控制下，控制导通或断开所述第一电源线与所述驱动子电路的第一端之间的连接；
补偿子电路，分别与第一栅线、所述驱动子电路的控制端和所述驱动子电路的第一端连接，用于在所述第一栅线的控制下，控制导通或断开所述驱动子电路的控制端和所述驱动子电路的第一端之间的连接；
数据写入子电路，分别与第二栅线、数据线和所述第一存储子电路的第二端连接，用于在所述第二栅线的控制下，控制导通或断开所述数据线与所述第一存储子电路的第二端之间的连接；
第一复位子电路，分别与复位信号线、所述第一电源线和所述驱动子电路的控制端连接，用于在所述复位信号线的控制下，控制导通或断开所述第一电源线与所述驱动子电路的控制端之间的连接；
第一控制子电路，分别与所述第一栅线、初始化信号线和所述驱动子电路的第二端连接，用于在所述第一栅线的控制下，控制导通和断开所述初始化信号线与所述驱动子电路的第二端之间的连接。
可选的，所述像素驱动电路还包括发光控制子电路，所述驱动子电路的第二端通过所述发光控制子电路与所述发光元件连接；
所述发光控制子电路分别与所述发光控制信号线、所述驱动子电路的第二端和所述发光元件连接，用于在所述发光控制信号线的控制下，控制导通或断开所述驱动子电路的第二端与所述发光元件之间的连接。
可选的，所述像素驱动电路还包括：
第二存储子电路，所述第二存储子电路的第一端与所述驱动子电路的控制端连接，所述第二存储子电路的第二端与所述发光元件连接。
可选的，所述发光控制子电路包括：
第六晶体管，所述第六晶体管的栅极与所述发光控制信号线连接，所述第六晶体管的第一极与所述驱动子电路的第二端连接，所述第六晶体管的第二极与所述发光元件连接。
可选的，所述像素驱动电路还包括：
第二复位子电路，分别与所述复位信号线、所述初始化信号线和所述发光元件连接，用于在所述复位信号线的控制下，控制导通或断开所述初始化信号线与所述发光元件之间的连接。
可选的，所述第二复位子电路包括第七晶体管，所述第七晶体管的栅极与所述复位信号线连接，所述第七晶体管的第一极与所述初始化信号线连接，所述第七晶体管的第二极与所述发光元件连接。
可选的，所述像素驱动电路还包括：
第二控制子电路，分别与所述第一栅线、初始化信号线和所述第一存储子电路的第二端连接，用于在所述第一栅线的控制下，控制导通或断开所述初始化信号线与所述第一存储子电路的第二端之间的连接。
可选的，所述第二控制子电路包括第九晶体管，所述第九晶体管的栅极与所述第一栅线连接，所述第九晶体管的第一极与所述初始化信号线连接，所述第九晶体管的第二极与所述第一存储子电路的第二端连接。
可选的，所述驱动子电路包括第三晶体管；
所述第一存储子电路包括第一电容，所述第一电容的第一端与所述第三晶体管的栅极连接；
所述第一复位子电路包括第一晶体管，所述第一晶体管的栅极与所述复位信号线连接，所述第一晶体管的第一极与所述第一电源线连接，所述第一晶体管的第二极与所述第三晶体管的栅极连接；
所述补偿子电路包括第二晶体管，所述第二晶体管的栅极与所述第一栅线连接，所述第二晶体管的第一极与所述第三晶体管的第一极连接，所述第二晶体管的第二极与所述第三晶体管的栅极连接；
所述数据写入子电路包括第四晶体管，所述第四晶体管的栅极与所述第二栅线连接，所述第四晶体管的第一极与所述数据线连接，所述第四晶体管的第二极与所述第一电容的第二端连接；
所述电源控制子电路包括第五晶体管，所述第五晶体管的栅极与所述发光控制信号线连接，所述第五晶体管的第一极与所述第一电源线连接，所述第五晶体管的第二极与所述第三晶体管的第一极连接；
所述第一控制子电路包括第八晶体管，所述第八晶体管的栅极与所述第一栅线连接，所述第八晶体管的第一极与所述初始化信号线连接，所述第八晶体管的第二极与所述驱动子电路的第二端连接。
基于上述像素驱动电路的技术方案，本发明的第二方面提供一种显示装置，包括上述像素驱动电路。
可选的，所述显示装置包括阵列分布的多个所述像素驱动电路，多个所述像素驱动电路划分为多行像素驱动电路；所述显示装置还包括栅极驱动电路、发光信号控制电路，多条第一栅线、多条第二栅线、多条复位信号线和多条发光控制信号线；
所述栅极驱动电路包括与多行像素驱动电路一一对应的多个第一移位寄存器单元；
所述发光信号控制电路包括多个第二移位寄存器单元；
所述多条第一栅线与所述多个第一移位寄存器单元和所述多行像素驱动电路均一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的第一栅线连接，所述第一栅线与对应的第一移位寄存器单元的输出端连接；
所述多条第二栅线与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的第二栅线连接，当前行像素驱动电路对应的所述第二栅线与相邻的下一行像素驱动电路对应的第一移位寄存器单元的输出端连接；
所述多条复位信号线与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的复位信号线连接，当前行像素驱动电路对应的复位信号线与相邻的上一行像素驱动电路对应的第一移位寄存器单元的输出端连接；
所述多条发光控制信号线与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的发光控制信号线连接，每个第二移位寄存器单元的输出端与对应的至少一条所述发光控制信号线连接。
基于上述像素驱动电路的技术方案，本发明的第三方面提供一种像素驱动电路的驱动方法，应用于上述像素驱动电路，所述驱动方法包括：在每一工作周期，
在复位时段，第一电源线输入电源电压Vd，在复位信号线的控制下，第一复位子电路控制导通所述第一电源线与所述驱动子电路的控制端之间的连接；
在阈值补偿时段，在所述复位信号线的控制下，第一复位子电路控制断开所述第一电源线与所述驱动子电路的控制端之间的连接；初始化信号线输入初始化电压Vinit，在第一栅线的控制下，第一控制子电路控制导通所述初始化信号线与所述驱动子电路的第二端之间的连接，补偿子电路控制导通所述驱动子电路的控制端和所述驱动子电路的第一端之间的连接，以使所述驱动子电路的第一端与第二端之间由导通变为截止，使得所述驱动子电路的控制端的电位由Vd变为Vinit+Vth，Vth为所述驱动子电路对应的阈值电压；
在数据写入时段，在第一栅线的控制下，第一控制子电路控制断开所述初始化信号线与所述驱动子电路的第二端之间的连接，补偿子电路控制断开所述驱动子电路的控制端和所述驱动子电路的第一端之间的连接；数据线输入数据电压Vdata，在第二栅线的控制下，数据写入子电路控制导通所述数据线与所述第一存储子电路的第二端之间的连接，使所述第一存储子电路的第二端的电位变为Vdata，所述驱动子电路的控制端的电位在所述第一存储子电路的自举作用下相应改变；
在发光时段，所述电源信号输入端输入电源电压Vdd，在所述发光控制信号线的控制下，所述电源控制子电路控制导通所述第一电源线与所述驱动子电路的第一端之间的连接，在第二栅线的控制下，数据写入子电路控制断开所述数据线与所述第一存储子电路的第二端之间的连接，所述驱动子电路在其控制端的控制下，控制导通该驱动子电路的第一端与该驱动子电路的第二端之间的连接，以驱动发光元件发光。
可选的，所述像素驱动电路还包括发光控制子电路，所述驱动子电路的第二端通过所述发光控制子电路与所述发光元件连接；所述发光控制子电路分别与所述发光控制信号线、所述驱动子电路的第二端和所述发光元件连接；所述像素驱动电路还包括第二存储子电路，所述第二存储子电路的第一端与所述驱动子电路的控制端连接，所述第二存储子电路的第二端与所述发光元件连接；
所述驱动方法还包括：
在所述复位时段、所述阈值补偿时段和所述数据写入时段，在所述发光控制信号线的控制下，所述发光控制子电路控制断开所述驱动子电路的第二端与所述发光元件之间的连接；
在所述发光时段，在所述发光控制信号线的控制下，所述发光控制子电路控制导通所述驱动子电路的第二端与所述发光元件之间的连接，所述驱动子电路的控制端的电位在所述第二存储子电路的自举作用下相应改变。
可选的，所述像素驱动电路还包括第二复位子电路，所述第二复位子电路分别与所述复位信号线、所述初始化信号线和所述发光元件连接；
在所述复位时段，在所述复位信号线的控制下，所述像素驱动电路控制导通所述初始化信号线与所述发光元件之间的连接；
在所述阈值补偿时段、所述数据写入时段和所述发光时段，在所述复位信号线的控制下，所述像素驱动电路控制断开所述初始化信号线与所述发光元件之间的连接。
可选的，所述像素驱动电路还包括第二控制子电路，所述第二控制子电路分别与所述第一栅线、初始化信号线和所述第一存储子电路的第二端连接；
在所述复位时段、所述数据写入时段和所述发光时段，在所述第一栅线的控制下，所述第二控制子电路控制断开所述初始化信号线与所述第一存储子电路的第二端之间的连接；
所述阈值补偿时段，在所述第一栅线的控制下，所述第二控制子电路控制导通所述初始化信号线与所述第一存储子电路的第二端之间的连接。
本发明提供的技术方案中，驱动电流与驱动子电路对应的阈值电压，以及电源电压均没有关系；消除了阈值电压漂移和电源电压对驱动电流的影响，有效提升了驱动电流的均匀性，保证了显示器件显示亮度的均匀性。
另外，在将本发明提供的技术方案应用于显示装置中时，显示装置包括阵列分布的多个像素驱动电路，可设置当前行像素驱动电路对应连接的所述第一栅线输入第一扫描信号，该第一扫描信号能够复用为相邻的下一行像素驱动电路对应连接的复位信号线输入的复位信号；还可设置该第一扫描信号复用为相邻的上一行像素驱动电路对应连接的第二栅线输入的第二扫描信号；因此，在将本发明提供的技术方案应用于显示装置中时，所述像素驱动电路仅需要gateGOA和EMGOA来提供相应的信号，所需要的控制信号较少，且同时能够兼容现有的GOA设计。
附图说明
此处所说明的附图用来提供对本发明的进一步理解，构成本发明的一部分，本发明的示意性实施例及其说明用于解释本发明，并不构成对本发明的不当限定。在附图中：
图1为本发明实施例提供的像素驱动电路的第一结构示意图；
图2为本发明实施例提供的像素驱动电路的第二结构示意图；
图3为本发明实施例提供的像素驱动电路的第三结构示意图；
图4为本发明实施例提供的像素驱动电路的第四结构示意图；
图5为本发明实施例提供的像素驱动电路的第五结构示意图；
图6为本发明实施例提供的像素驱动电路的第一电路示意图；
图7为本发明实施例提供的像素驱动电路的工作时序图；
图8为本发明实施例提供的像素驱动电路在复位时段的工作示意图；
图9为本发明实施例提供的像素驱动电路在阈值补偿时段的工作示意图；
图10为本发明实施例提供的像素驱动电路在数据写入时段的工作示意图；
图11为本发明实施例提供的像素驱动电路在发光时段的工作示意图；
图12为本发明实施例提供的Gate GOA的连接示意图。
具体实施方式
为了进一步说明本发明实施例提供的像素驱动电路及其驱动方法、显示装置，下面结合说明书附图进行详细描述。
请参阅图1，本发明实施例提供了一种像素驱动电路，用于驱动发光元件EL，所述像素驱动电路包括：
驱动子电路1，所述驱动子电路1用于在其控制端的控制下，控制导通或断开该驱动子电路1的第一端与该驱动子电路1的第二端之间的连接，所述驱动子电路1的第二端与所述发光元件EL连接；
第一存储子电路21，所述第一存储子电路21的第一端与所述控制端连接；
电源控制子电路3，分别与发光控制信号线EM，第一电源线VDD和所述驱动子电路1的第一端连接，用于在所述发光控制信号线EM的控制下，控制导通或断开所述第一电源线VDD与所述驱动子电路1的第一端之间的连接；
补偿子电路4，分别与第一栅线GA1、所述驱动子电路1的控制端和所述驱动子电路1的第一端连接，用于在所述第一栅线GA1的控制下，控制导通或断开所述驱动子电路1的控制端和所述驱动子电路1的第一端之间的连接；
数据写入子电路5，分别与第二栅线GA2、数据线DA和所述第一存储子电路21的第二端连接，用于在所述第二栅线GA2的控制下，控制导通或断开所述数据线DA与所述第一存储子电路21的第二端之间的连接；
第一复位子电路61，分别与复位信号线RE、所述第一电源线VDD和所述驱动子电路1的控制端连接，用于在所述复位信号线RE的控制下，控制导通或断开所述第一电源线VDD与所述驱动子电路1的控制端之间的连接；
第一控制子电路71，分别与所述第一栅线GA1、初始化信号线Init和所述驱动子电路1的第二端连接，用于在所述第一栅线GA1的控制下，控制导通和断开所述初始化信号线Init与所述驱动子电路1的第二端之间的连接。
具体的，所述像素驱动电路应用于显示装置，显示装置包括基底，阵列分布在所述基底上的多个像素驱动电路，以及位于所述多个像素驱动电路背向所述基底的一侧，且与所述多个像素驱动电路一一对应的发光元件EL。示例性的，所述发光元件EL具体包括沿远离所述基底的方向上依次层叠设置的阳极、发光功能层和阴极，发光元件EL的阳极能够与对应的所述像素驱动电路连接，接收对应的所述像素驱动电路提供的驱动信号，所述阴极能够与显示装置中的负电源信号线VSS连接，接收所述负电源信号线VSS输入的负电源信号，发光功能层用于在所述阳极和所述阴极的共同作用下发光。
需要说明，所述初始化信号线Init输入的初始化信号，所述第一电源线VDD输入的第一电源信号，以及所述负电源信号线VSS输入的负电源信号均为恒压信号，其中初始化信号的电位Vinit小于负电源信号的电位，负电源信号的电位小于第一电源信号的电位Vd。示例性的，Vinit取-3V，负电源信号的电位取-2.4V，Vd取4.6V。
请参阅图1、图6～图11，上述像素驱动电路在一个驱动周期的工作过程为：
在复位时段P1，如图7和图8所示，第一电源线VDD输入电源电压Vd，在复位信号线RE输入的复位信号的控制下，第一复位子电路61控制导通所述第一电源线VDD与所述驱动子电路1的控制端之间的连接，使所述驱动子电路1的控制端(即N1节点)的电位变为Vd，实现对所述驱动子电路1的控制端复位。需要说明，图8～图11中的带箭头的虚线代表信号走向。
在阈值补偿时段P2，如图7和图9所示，在所述复位信号线RE输入的复位信号的控制下，第一复位子电路61控制断开所述第一电源线VDD与所述驱动子电路1的控制端之间的连接；初始化信号线Init输入初始化电压Vinit，在第一栅线GA1输入的第一扫描信号的控制下，第一控制子电路71控制导通所述初始化信号线Init与所述驱动子电路1的第二端(即N3节点)之间的连接，使所述驱动子电路1的第二端的电位变为Vinit；同时，在第一栅线GA1输入的第一扫描信号的控制下，补偿子电路4控制导通所述驱动子电路1的控制端和所述驱动子电路1的第一端之间的连接，由于在复位时段P1所述驱动子电路1的控制端的电位变为Vd，使得所述驱动子电路1能够将其包括的第一端和第二端导通连接，并使得所述驱动子电路1的第一端和第二端之间的连接关系经历由导通变为截止的过程，实现对N1节点的充电，使得N1节点的电位由Vd最终变为Vinit+Vth，Vth为所述驱动子电路1对应的阈值电压。
在数据写入时段P3，如图7和图10所示，在第一栅线GA1输入的第一扫描信号的控制下，第一控制子电路71控制断开所述初始化信号线Init与所述驱动子电路1的第二端之间的连接；在第一栅线GA1输入的第一扫描信号的控制下，补偿子电路4控制断开所述驱动子电路1的控制端和所述驱动子电路1的第一端之间的连接；数据线DA输入数据电压Vdata，在第二栅线GA2输入的第二扫描信号的控制下，数据写入子电路5控制导通所述数据线DA与所述第一存储子电路21的第二端之间的连接，使所述第一存储子电路21的第二端(即N2节点)的电位变为Vdata，由于在数据写入时段P3，所述驱动子电路1的控制端处于悬空状态，所述驱动子电路1的控制端的电位在所述第一存储子电路21的自举作用下相应改变。示例性的，所述第一存储子电路21的第二端的初始电位为0，则在写入数据电压Vdata之后，所述第一存储子电路21的第二端的电位的变化量为Vdata，在所述第一存储子电路21的自举作用下，所述驱动子电路1的控制端的电位相应变为Vinit+Vth+Vdata。
在发光时段P4，如图7和图11所示，所述电源信号输入端输入电源电压Vdd，在所述发光控制信号线EM输入的发光控制信号的控制下，所述电源控制子电路3控制导通所述第一电源线VDD与所述驱动子电路1的第一端之间的连接；在第二栅线GA2写入的第二扫描信号的控制下，数据写入子电路5控制断开所述数据线DA与所述第一存储子电路21的第二端之间的连接；所述驱动子电路1在其控制端的控制下，控制导通该驱动子电路1的第一端与该驱动子电路1的第二端之间的连接，以驱动发光元件EL发光。
根据上述像素驱动电路的具体结构和像素驱动电路在一个驱动周期的工作过程可知，本发明实施例提供的像素驱动电路中，在阈值补偿时段P2，实现对N1节点的充电，使得N1节点的电位由Vd变为Vinit+Vth；同时控制导通所述初始化信号线Init与所述驱动子电路1的第二端(即N3节点)之间的连接，使所述驱动子电路1的第二端的电位变为Vinit；在数据写入时段P3将数据电压Vdata写入，使所述驱动子电路1的控制端的电位变为Vinit+Vth+Vdata；在发光时段P4，所述电源控制子电路3控制导通所述第一电源线VDD与所述驱动子电路1的第一端之间的连接，使得所述驱动子电路1在其控制端的控制下，控制导通该驱动子电路1的第一端与该驱动子电路1的第二端之间的连接，此时所述驱动子电路1的控制端和第二端之间的电压Vgs为：
Vgs＝Vinit+Vth+Vdata-Voled 公式(1)
Voled为发光元件EL的工作电压，驱动子电路1将其第一端和第二端导通并工作在饱和状态时产生的驱动电流I为：
I＝k(Vgs-Vth)2 公式(2)
将公式(1)代入公式(2)得到：
I＝k(Vinit+Vdata-Voled)2 公式(3)
公式(3)中，k为与驱动子电路1中包括的晶体管的宽长比以及迁移率相关的常数。
由公式(3)可知驱动电流I与驱动子电路对应的阈值电压Vth，以及电源电压Vd均没有关系；因此，本发明实施例提供的像素驱动电路中，消除了阈值电压Vth漂移和电源电压Vd对驱动电流I的影响，有效提升了驱动电流的均匀性，保证了显示器件显示亮度的均匀性。
另外，在将本发明实施例提供的像素驱动电路应用于显示装置中时，显示装置包括阵列分布的多个像素驱动电路，可设置当前行像素驱动电路对应连接的所述第一栅线GA1输入第一扫描信号，该第一扫描信号能够复用为相邻的下一行像素驱动电路对应连接的复位信号线RE输入的复位信号；还可设置该第一扫描信号复用为相邻的上一行像素驱动电路对应连接的第二栅线GA2输入的第二扫描信号；因此，在将本发明实施例提供的像素驱动电路应用于显示装置中时，所述像素驱动电路仅需要gateGOA和EMGOA来提供相应的信号，所需要的控制信号较少，且同时能够兼容现有的GOA设计。
如图2和图6所示，在一些实施例中，所述像素驱动电路还包括发光控制子电路8，所述驱动子电路1的第二端通过所述发光控制子电路8与所述发光元件EL连接；所述发光控制子电路8分别与所述发光控制信号线EM、所述驱动子电路1的第二端和所述发光元件EL连接，用于在所述发光控制信号线EM的控制下，控制导通或断开所述驱动子电路1的第二端与所述发光元件EL之间的连接。
具体地，如图7和图11所示，在发光时段P4，在发光控制信号线EM的控制下，发光控制子电路8控制导通所述驱动子电路1的第二端与所述发光元件EL之间的连接。
如图7～图10所示，在复位时段P1、阈值补偿时段P2和数据写入时段P3，在发光控制信号线EM的控制下，发光控制子电路8控制断开所述驱动子电路1的第二端与所述发光元件EL之间的连接，从而很好的避免了在复位时段P1、阈值补偿时段P2和数据写入时段P3所述发光元件EL异常发光。
如图3和图6所示，在一些实施例中，所述像素驱动电路还包括：第二存储子电路22，所述第二存储子电路22的第一端与所述驱动子电路1的控制端连接，所述第二存储子电路22的第二端与所述发光元件EL连接。
示例性的，所述第二存储子电路22包括第二电容Cst2，所述第二电容Cst2的第一端与所述驱动子电路1的控制端连接，所述第二电容Cst2的第二端与所述发光元件EL连接。
如图11所示，在发光时段P4，发光元件EL发光，N4节点的电位由Vinit跳变至Voled，Voled为发光元件EL的工作电压，同时由于所述第二存储子电路22的耦合作用，N1节点的电位由Vinit+Vth+Vdata跳变至Vinit+Vth+Vdata+(Voled-Vinit)，即N1节点的电位变为Vth+Vdata+Voled。
此时所述驱动子电路1的控制端和第二端之间的电压Vgs为：
Vgs＝Vth+Vdata+Voled-Voled＝Vth+Vdata 公式(4)
Voled为发光元件EL的工作电压，驱动子电路1将其第一端和第二端导通并工作在饱和状态时产生的驱动电流I为：
I＝k(Vgs-Vth)2＝k(Vdata)2 公式(5)
由公式(5)可知驱动电流I与发光元件EL的工作电压Voled没有关系；因此，本发明实施例提供的像素驱动电路中，消除了Voled对驱动电流I的影响，保证了显示器件显示亮度的均匀性。另外，本发明实施例提供的像素驱动电路也消除了发光元件EL连接的负电源信号线VSS输入的负电源信号对驱动电流I的影响。
如图6所示，在一些实施例中，所述发光控制子电路8包括第六晶体管T6，所述第六晶体管T6的栅极与所述发光控制信号线EM连接，所述第六晶体管T6的第一极与所述驱动子电路1的第二端连接，所述第六晶体管T6的第二极与所述发光元件EL连接。
具体地，如图7和图11所示，在发光时段P4，在发光控制信号线EM的控制下，第六晶体管T6导通，从而控制导通所述驱动子电路1的第二端与所述发光元件EL之间的连接。
如图7～图10所示，在复位时段P1、阈值补偿时段P2和数据写入时段P3，在发光控制信号线EM的控制下，第六晶体管T6截止，从而控制断开所述驱动子电路1的第二端与所述发光元件EL之间的连接，从而很好的避免了在复位时段P1、阈值补偿时段P2和数据写入时段P3所述发光元件EL异常发光。
如图4和图6所示，在一些实施例中，所述像素驱动电路还包括：第二复位子电路62，第二复位子电路62分别与所述复位信号线RE、所述初始化信号线Init和所述发光元件EL连接，用于在所述复位信号线RE的控制下，控制导通或断开所述初始化信号线Init与所述发光元件EL之间的连接。
如图7和图8所示，在复位时段P1，在所述复位信号线RE的控制下，第二复位子电路62控制导通所述初始化信号线Init与所述发光元件EL的阳极之间的连接，实现对所述发光元件EL的阳极复位。
如图7、图9～图11所示，在阈值补偿时段P2、数据写入时段P3和发光时段P4，第二复位子电路62控制断开所述初始化信号线Init与所述发光元件EL的阳极之间的连接。
如图6所示，在一些实施例中，所述第二复位子电路62包括第七晶体管T7，所述第七晶体管T7的栅极与所述复位信号线RE连接，所述第七晶体管T7的第一极与所述初始化信号线Init连接，所述第七晶体管T7的第二极与所述发光元件EL连接。
如图7和图8所示，在复位时段P1，在所述复位信号线RE的控制下，第七晶体管T7导通，控制导通所述初始化信号线Init与所述发光元件EL的阳极之间的连接，实现对所述发光元件EL的阳极复位。
如图7、图9～图11所示，在阈值补偿时段P2、数据写入时段P3和发光时段P4，第七晶体管T7截止，控制断开所述初始化信号线Init与所述发光元件EL的阳极之间的连接。
如图5和图6所示，在一些实施例中，所述像素驱动电路还包括：
第二控制子电路72，分别与所述第一栅线GA1、初始化信号线Init和所述第一存储子电路21的第二端连接，用于在所述第一栅线GA1的控制下，控制导通或断开所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接。
具体的，如图7、图8、图10和图11所示，在复位时段P1、数据写入时段P3和发光时段P4，在所述第一栅线GA1的控制下，所述第二控制子电路72控制断开所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接。
如图7和图9所示，在阈值补偿时段P2，在所述第一栅线GA1的控制下，所述第二控制子电路72控制导通所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接，将N2节点的电位写入并保持在Vinit。
在数据写入时段P3，N2节点的电位变化量为Vdata-Vinit，在所述第一存储子电路21的自举作用下，N1节点的电位变为Vinit+Vth+Vdata-Vinit，即：Vth+Vdata。
当所述像素驱动电路包括所述发光控制子电路8和所述第二存储子电路22时，在发光时段P4，在所述第二存储子电路22的作用下，N1节点的电位变为Vth+Vdata+Voled-Vinit，Vgs＝Vth+Vdata+Voled-Vinit-Voled＝Vth+Vdata-Vinit。
驱动电流I为：
I＝k(Vgs-Vth)2＝I＝k(Vdata-Vinit)2 公式(6)
由公式(6)可知驱动电流I与发光元件EL的工作电压Voled，驱动子电路1对应的阈值电压Vth，以及电源电压Vd均没有关系。
上述设置所述像素驱动电路还包括第二控制子电路72，使得在数据写入时段P3开始之前，N2节点具有稳定的电位，这样更有利于数据信号的写入。
如图6所示，在一些实施例中，所述第二控制子电路72包括第九晶体管T9，所述第九晶体管T9的栅极与所述第一栅线GA1连接，所述第九晶体管T9的第一极与所述初始化信号线Init连接，所述第九晶体管T9的第二极与所述第一存储子电路21的第二端连接。
如图7、图8、图10和图11所示，在复位时段P1、数据写入时段P3和发光时段P4，在所述第一栅线GA1的控制下，所述第九晶体管T9截止，控制断开所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接。
如图7和图9所示，在阈值补偿时段P2，在所述第一栅线GA1的控制下，所述第九晶体管T9导通，控制导通所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接，将N2节点的电位写入并保持在Vinit。
如图6所示，在一些实施例中，所述驱动子电路1包括第三晶体管T3；所述第一存储子电路21包括第一电容Cst1，所述第一电容Cst1的第一端与所述第三晶体管T3的栅极连接；所述第一复位子电路61包括第一晶体管T1，所述第一晶体管T1的栅极与所述复位信号线RE连接，所述第一晶体管T1的第一极与所述第一电源线VDD连接，所述第一晶体管T1的第二极与所述第三晶体管T3的栅极连接；所述补偿子电路4包括第二晶体管T2，所述第二晶体管T2的栅极与所述第一栅线GA1连接，所述第二晶体管T2的第一极与所述第三晶体管T3的第一极连接，所述第二晶体管T2的第二极与所述第三晶体管T3的栅极连接；所述数据写入子电路5包括第四晶体管T4，所述第四晶体管T4的栅极与所述第二栅线GA2连接，所述第四晶体管T4的第一极与所述数据线DA连接，所述第四晶体管T4的第二极与所述第一电容Cst1的第二端连接；所述电源控制子电路3包括第五晶体管T5，所述第五晶体管T5的栅极与所述发光控制信号线EM连接，所述第五晶体管T5的第一极与所述第一电源线VDD连接，所述第五晶体管T5的第二极与所述第三晶体管T3的第一极连接；所述第一控制子电路71包括第八晶体管T8，所述第八晶体管T8的栅极与所述第一栅线GA1连接，所述第八晶体管T8的第一极与所述初始化信号线Init连接，所述第八晶体管T8的第二极与所述驱动子电路1的第二端连接。
具体地，所述驱动子电路1包括第三晶体管T3，所述第三晶体管T3的栅极作为所述驱动子电路1的控制端，所述第三晶体管T3的第一极作为所述驱动子电路1的第一端，所述第三晶体管T3的第二极作为所述驱动子电路1的第二端。
如图7和图8所示，在复位时段P1，所述第一晶体管T1、所述第三晶体管T3和所述第七晶体管T7导通，所述第二晶体管T2、所述第四晶体管T4、第五晶体管T5、第六晶体管T6、第八晶体管T8和第九晶体管T9均截止。
如图7和图9所示，在阈值补偿时段P2，所述第二晶体管T2、所述第三晶体管T3、所述第八晶体管T8和所述第九晶体管T9均导通，所述第一晶体管T1、所述第四晶体管T4、所述第五晶体管T5、所述第六晶体管T6、所述第七晶体管T7均截止。
如图7和图10所示，在数据写入时段P3，所述第四晶体管T4导通，其余晶体管均截止。
如图7和图11所示，在发光时段P4，所述第三晶体管T3、所述第五晶体管T5和所述第六晶体管T6均导通，所述第一晶体管T1、所述第二晶体管T2、所述第四晶体管T4、所述第七晶体管T7、所述第八晶体管T8和所述第九晶体管T9均截止。
上述实施例提供的像素驱动电路中，所包括的各晶体管均可选为N型晶体管，N型晶体管具有磁滞小，与氧化物薄膜晶体管设计兼容等优点。
本发明实施例还提供了一种显示装置，包括上述实施例提供的像素驱动电路。
上述实施例提供的像素驱动电路中，驱动电流I与驱动子电路对应的阈值电压Vth，以及电源电压Vd均没有关系；消除了阈值电压Vth漂移和电源电压Vd对驱动电流I的影响，有效提升了驱动电流的均匀性，保证了显示器件显示亮度的均匀性。因此，本发明实施例提供的显示装置在包括上述像素驱动电路时，同样具有上述有益效果，此处不再赘述。
需要说明的是，所述显示装置可以为：电视、显示器、数码相框、手机、平板电脑等任何具有显示功能的产品或部件。
如图12所示，在一些实施例中，所述显示装置包括阵列分布的多个所述像素驱动电路，多个所述像素驱动电路划分为多行像素驱动电路；所述显示装置还包括栅极驱动电路、发光信号控制电路，多条第一栅线GA1、多条第二栅线GA2、多条复位信号线RE和多条发光控制信号线EM；
所述栅极驱动电路包括与多行像素驱动电路一一对应的多个第一移位寄存器单元Gate GOA；所述发光信号控制电路包括多个第二移位寄存器单元；
所述多条第一栅线GA1与所述多个第一移位寄存器单元Gate GOA和所述多行像素驱动电路均一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的第一栅线GA1连接，所述第一栅线GA1与对应的第一移位寄存器单元Gate GOA的输出端连接；
所述多条第二栅线GA2与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的第二栅线GA2连接，当前行像素驱动电路(如图12中的A)对应的所述第二栅线GA2与相邻的下一行像素驱动电路(如图12中的C)对应的第一移位寄存器单元Gate GOA的输出端连接；
所述多条复位信号线RE与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的复位信号线RE连接，当前行像素驱动电路(如图12中的A)对应的复位信号线RE与相邻的上一行像素驱动电路(如图12中的B)对应的第一移位寄存器单元Gate GOA的输出端连接；
所述多条发光控制信号线EM与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的发光控制信号线EM连接，每个第二移位寄存器单元的输出端与对应的至少一条所述发光控制信号线连接。
具体的，所述显示装置包括阵列分布的多个所述像素驱动电路，多个所述像素驱动电路划分为多行像素驱动电路，示例性的，所述多行像素驱动电路沿Y方向依次排列，每行像素驱动电路均包括沿X方向依次排列的多个像素驱动电路。示例性的，所述X方向为水平方向，所述Y方向为竖直方向。
示例性的，所述第一栅线GA1的至少部分、所述第二栅线GA2的至少部分、所述复位信号线RE的至少部分和所述发光控制信号线EM的至少部分均沿X方向延伸。
所述栅极驱动电路包括与多行像素驱动电路一一对应的多个第一移位寄存器单元Gate GOA；所述发光信号控制电路包括多个第二移位寄存器单元EMGOA。
每行像素驱动电路中包括的各像素驱动电路复用该行像素驱动电路对应的一条第一栅线GA1。每行像素驱动电路中包括的各像素驱动电路复用该行像素驱动电路对应的一条第二栅线GA2。每行像素驱动电路中包括的各像素驱动电路复用该行像素驱动电路对应的一条复位信号线RE。每行像素驱动电路中包括的各像素驱动电路复用该行像素驱动电路对应的一条发光控制信号线EM。
每行像素驱动电路中包括的各像素驱动电路分别与对应的第二栅线GA2连接，当前行像素驱动电路对应的所述第二栅线GA2传输的信号，与相邻的下一行像素驱动电路对应的所述第一栅线GA1传输的信号相同，因此，可以将当前行像素驱动电路对应的所述第二栅线GA2与相邻的下一行像素驱动电路对应的第一栅线GA1，均与该相邻的下一行像素驱动电路对应的第一移位寄存器单元的输出端连接。
每行像素驱动电路中包括的各像素驱动电路分别与对应的复位信号线RE连接，当前行像素驱动电路对应的复位信号线RE与相邻的上一行像素驱动电路对应的所述第一栅线GA1传输的信号相同，因此，可以将当前行像素驱动电路对应的复位信号线RE与相邻的上一行像素驱动电路对应的第一栅线GA1，均与该相邻的上一行像素驱动电路对应的第一移位寄存器单元的输出端连接。
所述多条发光控制信号线EM与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的发光控制信号线连接，每个第二移位寄存器单元的输出端与对应的至少一条所述发光控制信号线连接。需要说明，当每个第二移位寄存器单元对应多条发光控制信号线时，所述多条发光控制信号线为相邻布局的多条发光控制信号线，且每一条发光控制信号线仅对应一个第二移位寄存器单元。
上述实施例提供的显示装置中，可设置当前行像素驱动电路对应连接的所述第一栅线GA1输入第一扫描信号，该第一扫描信号能够复用为相邻的下一行像素驱动电路对应连接的复位信号线RE输入的复位信号；还可设置该第一扫描信号复用为相邻的上一行像素驱动电路对应连接的第二栅线GA2输入的第二扫描信号；因此，上述实施例提供的显示装置中，仅需要设置gateGOA和EMGOA来为像素驱动电路提供相应的信号，所需要的控制信号较少，且同时能够兼容现有的GOA设计。
本发明实施例还提供了一种像素驱动电路的驱动方法，应用于上述实施例提供的像素驱动电路，所述驱动方法包括：在每一工作周期，
在复位时段P1，第一电源线VDD输入电源电压Vd，在复位信号线RE的控制下，第一复位子电路61控制导通所述第一电源线VDD与所述驱动子电路1的控制端之间的连接；
在阈值补偿时段P2，在所述复位信号线RE的控制下，第一复位子电路61控制断开所述第一电源线VDD与所述驱动子电路1的控制端之间的连接；初始化信号线Init输入初始化电压Vinit，在第一栅线GA1的控制下，第一控制子电路71控制导通所述初始化信号线Init与所述驱动子电路1的第二端之间的连接，补偿子电路4控制导通所述驱动子电路1的控制端和所述驱动子电路1的第一端之间的连接，以使所述驱动子电路1的第一端与第二端之间由导通变为截止，使得所述驱动子电路1的控制端的电位由Vd变为Vinit+Vth，Vth为所述驱动子电路1对应的阈值电压；
在数据写入时段P3，在第一栅线GA1的控制下，第一控制子电路71控制断开所述初始化信号线Init与所述驱动子电路1的第二端之间的连接，补偿子电路4控制断开所述驱动子电路1的控制端和所述驱动子电路1的第一端之间的连接；数据线DA输入数据电压Vdata，在第二栅线GA2的控制下，数据写入子电路5控制导通所述数据线DA与所述第一存储子电路21的第二端之间的连接，使所述第一存储子电路21的第二端的电位变为Vdata，所述驱动子电路1的控制端的电位在所述第一存储子电路21的自举作用下相应改变；
在发光时段P4，所述电源信号输入端输入电源电压Vdd，在所述发光控制信号线EM的控制下，所述电源控制子电路3控制导通所述第一电源线VDD与所述驱动子电路1的第一端之间的连接，在第二栅线GA2的控制下，数据写入子电路5控制断开所述数据线DA与所述第一存储子电路21的第二端之间的连接，所述驱动子电路1在其控制端的控制下，控制导通该驱动子电路1的第一端与该驱动子电路1的第二端之间的连接，以驱动发光元件EL发光。
采用本发明实施例提供的驱动方法驱动像素驱动电路时，驱动电流I与驱动子电路对应的阈值电压Vth，以及电源电压Vd均没有关系；因此，采用本发明实施例提供的驱动方法驱动像素驱动电路，消除了阈值电压Vth漂移和电源电压Vd对驱动电流I的影响，有效提升了驱动电流的均匀性，保证了显示器件显示亮度的均匀性。
在一些实施例中，所述像素驱动电路还包括发光控制子电路8，所述驱动子电路1的第二端通过所述发光控制子电路8与所述发光元件EL连接；所述发光控制子电路8分别与所述发光控制信号线EM、所述驱动子电路1的第二端和所述发光元件EL连接；所述像素驱动电路还包括第二存储子电路22，所述第二存储子电路22的第一端与所述驱动子电路1的控制端连接，所述第二存储子电路22的第二端与所述发光元件EL连接；
所述驱动方法还包括：
在所述复位时段P1、所述阈值补偿时段P2和所述数据写入时段P3，在所述发光控制信号线EM的控制下，所述发光控制子电路8控制断开所述驱动子电路1的第二端与所述发光元件EL之间的连接；
在所述发光时段P4，在所述发光控制信号线EM的控制下，所述发光控制子电路8控制导通所述驱动子电路1的第二端与所述发光元件EL之间的连接，所述驱动子电路1的控制端的电位在所述第二存储子电路22的自举作用下相应改变。
在发光时段P4，发光元件EL发光，N4节点的电位由Vinit跳变至Voled，Voled为发光元件EL的工作电压，同时由于所述第二存储子电路22的耦合作用，N1节点的电位由Vinit+Vth+Vdata跳变至Vinit+Vth+Vdata+(Voled-Vinit)，即N1节点的电位变为Vth+Vdata+Voled。此时所述驱动子电路1的控制端和第二端之间的电压Vgs为：Vgs＝Vth+Vdata+Voled-Voled＝Vth+Vdata，Voled为发光元件EL的工作电压，驱动子电路1将其第一端和第二端导通并工作在饱和状态时产生的驱动电流I为：I＝k(Vgs-Vth)2＝k(Vdata)2，因此，消除了Voled对驱动电流I的影响，保证了显示器件显示亮度的均匀性。另外，也消除了发光元件EL连接的负电源信号线VSS输入的负电源信号对驱动电流I的影响。
在一些实施例中，所述像素驱动电路还包括第二复位子电路62，所述第二复位子电路62分别与所述复位信号线RE、所述初始化信号线Init和所述发光元件EL连接；
在所述复位时段P1，在所述复位信号线RE的控制下，所述像素驱动电路控制导通所述初始化信号线Init与所述发光元件EL之间的连接；
在所述阈值补偿时段P2、所述数据写入时段P3和所述发光时段P4，在所述复位信号线RE的控制下，所述像素驱动电路控制断开所述初始化信号线Init与所述发光元件EL之间的连接。
如图7和图8所示，在复位时段P1，在所述复位信号线RE的控制下，第二复位子电路62控制导通所述初始化信号线Init与所述发光元件EL的阳极之间的连接，实现对所述发光元件EL的阳极复位。
在一些实施例中，所述像素驱动电路还包括第二控制子电路72，所述第二控制子电路72分别与所述第一栅线GA1、初始化信号线Init和所述第一存储子电路21的第二端连接；
在所述复位时段P1、所述数据写入时段P3和所述发光时段P4，在所述第一栅线GA1的控制下，所述第二控制子电路72控制断开所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接；
所述阈值补偿时段P2，在所述第一栅线GA1的控制下，所述第二控制子电路72控制导通所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接。
如图7和图9所示，在阈值补偿时段P2，在所述第一栅线GA1的控制下，所述第二控制子电路72控制导通所述初始化信号线Init与所述第一存储子电路21的第二端之间的连接，将N2节点的电位写入并保持在Vinit。
在数据写入时段P3，N2节点的电位变化量为Vdata-Vinit，在所述第一存储子电路21的自举作用下，N1节点的电位变为Vinit+Vth+Vdata-Vinit，即：Vth+Vdata。
当所述像素驱动电路包括所述发光控制子电路8和所述第二存储子电路22时，在发光时段P4，在所述第二存储子电路22的作用下，N1节点的电位变为Vth+Vdata+Voled-Vinit，Vgs＝Vth+Vdata-Vinit。驱动电流I为：I＝k(Vgs-Vth)2＝I＝k(Vdata-Vinit)2，可知驱动电流I与发光元件EL的工作电压Voled，驱动子电路1对应的阈值电压Vth，以及电源电压Vd均没有关系。
上述设置所述像素驱动电路还包括第二控制子电路72，使得在数据写入时段P3开始之前，N2节点具有稳定的电位，这样更有利于数据信号的写入。
需要说明，本说明书中的各个实施例均采用递进的方式描述，各个实施例之间相同相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。尤其，对于方法实施例而言，由于其基本相似于产品实施例，所以描述得比较简单，相关之处参见产品实施例的部分说明即可。
除非另外定义，本公开使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”、“耦接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
可以理解，当诸如层、膜、区域或基板之类的元件被称作位于另一元件“上”或“下”时，该元件可以“直接”位于另一元件“上”或“下”，或者可以存在中间元件。
在上述实施方式的描述中，具体特征、结构、材料或者特点可以在任何的一个或多个实施例或示例中以合适的方式结合。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (15)

1.一种像素驱动电路，其特征在于，用于驱动发光元件，包括：
驱动子电路，所述驱动子电路用于在其控制端的控制下，控制导通或断开该驱动子电路的第一端与该驱动子电路的第二端之间的连接，所述驱动子电路的第二端与所述发光元件连接；
第一存储子电路，所述第一存储子电路的第一端与所述控制端连接；
电源控制子电路，分别与发光控制信号线，第一电源线和所述驱动子电路的第一端连接，用于在所述发光控制信号线的控制下，控制导通或断开所述第一电源线与所述驱动子电路的第一端之间的连接；
补偿子电路，分别与第一栅线、所述驱动子电路的控制端和所述驱动子电路的第一端连接，用于在所述第一栅线的控制下，控制导通或断开所述驱动子电路的控制端和所述驱动子电路的第一端之间的连接；
数据写入子电路，分别与第二栅线、数据线和所述第一存储子电路的第二端连接，用于在所述第二栅线的控制下，控制导通或断开所述数据线与所述第一存储子电路的第二端之间的连接；
第一复位子电路，分别与复位信号线、所述第一电源线和所述驱动子电路的控制端连接，用于在所述复位信号线的控制下，控制导通或断开所述第一电源线与所述驱动子电路的控制端之间的连接；
第一控制子电路，分别与所述第一栅线、初始化信号线和所述驱动子电路的第二端连接，用于在所述第一栅线的控制下，控制导通和断开所述初始化信号线与所述驱动子电路的第二端之间的连接。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括发光控制子电路，所述驱动子电路的第二端通过所述发光控制子电路与所述发光元件连接；
所述发光控制子电路分别与所述发光控制信号线、所述驱动子电路的第二端和所述发光元件连接，用于在所述发光控制信号线的控制下，控制导通或断开所述驱动子电路的第二端与所述发光元件之间的连接。
3.根据权利要求2所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二存储子电路，所述第二存储子电路的第一端与所述驱动子电路的控制端连接，所述第二存储子电路的第二端与所述发光元件连接。
4.根据权利要求2所述的像素驱动电路，其特征在于，所述发光控制子电路包括：
第六晶体管，所述第六晶体管的栅极与所述发光控制信号线连接，所述第六晶体管的第一极与所述驱动子电路的第二端连接，所述第六晶体管的第二极与所述发光元件连接。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二复位子电路，分别与所述复位信号线、所述初始化信号线和所述发光元件连接，用于在所述复位信号线的控制下，控制导通或断开所述初始化信号线与所述发光元件之间的连接。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述第二复位子电路包括第七晶体管，所述第七晶体管的栅极与所述复位信号线连接，所述第七晶体管的第一极与所述初始化信号线连接，所述第七晶体管的第二极与所述发光元件连接。
7.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二控制子电路，分别与所述第一栅线、初始化信号线和所述第一存储子电路的第二端连接，用于在所述第一栅线的控制下，控制导通或断开所述初始化信号线与所述第一存储子电路的第二端之间的连接。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述第二控制子电路包括第九晶体管，所述第九晶体管的栅极与所述第一栅线连接，所述第九晶体管的第一极与所述初始化信号线连接，所述第九晶体管的第二极与所述第一存储子电路的第二端连接。
9.根据权利要求1所述的像素驱动电路，其特征在于，
所述驱动子电路包括第三晶体管；
所述第一存储子电路包括第一电容，所述第一电容的第一端与所述第三晶体管的栅极连接；
所述第一复位子电路包括第一晶体管，所述第一晶体管的栅极与所述复位信号线连接，所述第一晶体管的第一极与所述第一电源线连接，所述第一晶体管的第二极与所述第三晶体管的栅极连接；
所述补偿子电路包括第二晶体管，所述第二晶体管的栅极与所述第一栅线连接，所述第二晶体管的第一极与所述第三晶体管的第一极连接，所述第二晶体管的第二极与所述第三晶体管的栅极连接；
所述数据写入子电路包括第四晶体管，所述第四晶体管的栅极与所述第二栅线连接，所述第四晶体管的第一极与所述数据线连接，所述第四晶体管的第二极与所述第一电容的第二端连接；
所述电源控制子电路包括第五晶体管，所述第五晶体管的栅极与所述发光控制信号线连接，所述第五晶体管的第一极与所述第一电源线连接，所述第五晶体管的第二极与所述第三晶体管的第一极连接；
所述第一控制子电路包括第八晶体管，所述第八晶体管的栅极与所述第一栅线连接，所述第八晶体管的第一极与所述初始化信号线连接，所述第八晶体管的第二极与所述驱动子电路的第二端连接。
10.一种显示装置，其特征在于，包括如权利要求1～9中任一项所述的像素驱动电路。
11.根据权利要求10所述的显示装置，其特征在于，所述显示装置包括阵列分布的多个所述像素驱动电路，多个所述像素驱动电路划分为多行像素驱动电路；所述显示装置还包括栅极驱动电路、发光信号控制电路，多条第一栅线、多条第二栅线、多条复位信号线和多条发光控制信号线；
所述栅极驱动电路包括与多行像素驱动电路一一对应的多个第一移位寄存器单元；
所述发光信号控制电路包括多个第二移位寄存器单元；
所述多条第一栅线与所述多个第一移位寄存器单元和所述多行像素驱动电路均一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的第一栅线连接，所述第一栅线与对应的第一移位寄存器单元的输出端连接；
所述多条第二栅线与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的第二栅线连接，当前行像素驱动电路对应的所述第二栅线与相邻的下一行像素驱动电路对应的第一移位寄存器单元的输出端连接；
所述多条复位信号线与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的复位信号线连接，当前行像素驱动电路对应的复位信号线与相邻的上一行像素驱动电路对应的第一移位寄存器单元的输出端连接；
所述多条发光控制信号线与所述多行像素驱动电路一一对应，每行像素驱动电路中包括的各像素驱动电路分别与对应的发光控制信号线连接，每个第二移位寄存器单元的输出端与对应的至少一条所述发光控制信号线连接。
12.一种像素驱动电路的驱动方法，其特征在于，应用于如权利要求1～9任一项所述的像素驱动电路，所述驱动方法包括：在每一工作周期，
在复位时段，第一电源线输入电源电压Vd，在复位信号线的控制下，第一复位子电路控制导通所述第一电源线与所述驱动子电路的控制端之间的连接；
在阈值补偿时段，在所述复位信号线的控制下，第一复位子电路控制断开所述第一电源线与所述驱动子电路的控制端之间的连接；初始化信号线输入初始化电压Vinit，在第一栅线的控制下，第一控制子电路控制导通所述初始化信号线与所述驱动子电路的第二端之间的连接，补偿子电路控制导通所述驱动子电路的控制端和所述驱动子电路的第一端之间的连接，以使所述驱动子电路的第一端与第二端之间由导通变为截止，使得所述驱动子电路的控制端的电位由Vd变为Vinit+Vth，Vth为所述驱动子电路对应的阈值电压；
在数据写入时段，在第一栅线的控制下，第一控制子电路控制断开所述初始化信号线与所述驱动子电路的第二端之间的连接，补偿子电路控制断开所述驱动子电路的控制端和所述驱动子电路的第一端之间的连接；数据线输入数据电压Vdata，在第二栅线的控制下，数据写入子电路控制导通所述数据线与所述第一存储子电路的第二端之间的连接，使所述第一存储子电路的第二端的电位变为Vdata，所述驱动子电路的控制端的电位在所述第一存储子电路的自举作用下相应改变；
在发光时段，所述电源信号输入端输入电源电压Vdd，在所述发光控制信号线的控制下，所述电源控制子电路控制导通所述第一电源线与所述驱动子电路的第一端之间的连接，在第二栅线的控制下，数据写入子电路控制断开所述数据线与所述第一存储子电路的第二端之间的连接，所述驱动子电路在其控制端的控制下，控制导通该驱动子电路的第一端与该驱动子电路的第二端之间的连接，以驱动发光元件发光。
13.根据权利要求12所述的像素驱动电路的驱动方法，其特征在于，所述像素驱动电路还包括发光控制子电路，所述驱动子电路的第二端通过所述发光控制子电路与所述发光元件连接；所述发光控制子电路分别与所述发光控制信号线、所述驱动子电路的第二端和所述发光元件连接；所述像素驱动电路还包括第二存储子电路，所述第二存储子电路的第一端与所述驱动子电路的控制端连接，所述第二存储子电路的第二端与所述发光元件连接；
所述驱动方法还包括：
在所述复位时段、所述阈值补偿时段和所述数据写入时段，在所述发光控制信号线的控制下，所述发光控制子电路控制断开所述驱动子电路的第二端与所述发光元件之间的连接；
在所述发光时段，在所述发光控制信号线的控制下，所述发光控制子电路控制导通所述驱动子电路的第二端与所述发光元件之间的连接，所述驱动子电路的控制端的电位在所述第二存储子电路的自举作用下相应改变。
14.根据权利要求12所述的像素驱动电路的驱动方法，其特征在于，所述像素驱动电路还包括第二复位子电路，所述第二复位子电路分别与所述复位信号线、所述初始化信号线和所述发光元件连接；
在所述复位时段，在所述复位信号线的控制下，所述像素驱动电路控制导通所述初始化信号线与所述发光元件之间的连接；
在所述阈值补偿时段、所述数据写入时段和所述发光时段，在所述复位信号线的控制下，所述像素驱动电路控制断开所述初始化信号线与所述发光元件之间的连接。
15.根据权利要求12所述的像素驱动电路的驱动方法，其特征在于，所述像素驱动电路还包括第二控制子电路，所述第二控制子电路分别与所述第一栅线、初始化信号线和所述第一存储子电路的第二端连接；
在所述复位时段、所述数据写入时段和所述发光时段，在所述第一栅线的控制下，所述第二控制子电路控制断开所述初始化信号线与所述第一存储子电路的第二端之间的连接；
所述阈值补偿时段，在所述第一栅线的控制下，所述第二控制子电路控制导通所述初始化信号线与所述第一存储子电路的第二端之间的连接。
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