CN111445863B - 一种像素驱动电路及其驱动方法、显示装置 - Google Patents

一种像素驱动电路及其驱动方法、显示装置 Download PDF

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Abstract

本发明提供一种像素驱动电路及其驱动方法、显示装置，涉及显示技术领域，为解决像素驱动电路在低频驱动时，像素驱动电路中的驱动晶体管栅极漏电严重，使显示器件在显示时容易出现闪烁的问题。所述像素驱动电路包括的第一复位子电路用于在复位控制端的控制下，控制导通或断开驱动晶体管的栅极与公共节点之间的连接，以及控制导通或断开公共节点与第一初始化电压输入端之间的连接；还用于在第一控制端的控制下，控制导通或断开公共节点与第二初始化电压输入端之间的连接；第二初始化电压输入端输入的第二初始化信号的电位，与发光时段驱动晶体管的栅极的电位之间的差值小于阈值。本发明提供的像素驱动电路用于驱动发光元件发光。

Description

一种像素驱动电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路及其驱动方法、显示装置。
背景技术
AMOLED(Active-matrix Organic Light-Emitting Diode，有源矩阵有机发光二极管)显示器件具有自发光、超薄、反应速度快、对比度高、视角广等诸多优点，是目前受到广泛关注的一种显示器件。
这种AMOLED显示器件包括多个像素驱动电路和多个发光元件，像素驱动电路用于驱动对应的发光元件发光，从而实现AMOLED显示器件的显示功能。但是现有的像素驱动电路在低频驱动时，像素驱动电路中的驱动晶体管栅极漏电严重，使显示器件在显示时容易出现闪烁的现象。
发明内容
本发明的目的在于提供一种像素驱动电路及其驱动方法、显示装置，用于解决现有的显示器件中，像素驱动电路在低频驱动时，像素驱动电路中的驱动晶体管栅极漏电严重，使显示器件在显示时容易出现闪烁的问题。
为了实现上述目的，本发明提供如下技术方案：
本发明的第一方面提供一种像素驱动电路，用于驱动发光元件，包括：
驱动子电路，所述驱动子电路包括驱动晶体管，驱动晶体管的第二极与所述发光元件连接；
存储子电路，所述存储子电路的第一端与所述驱动晶体管的栅极连接，所述存储子电路的第二端与电源信号输入端连接；
电源控制子电路，分别与第一控制端、所述电源信号输入端和所述驱动晶体管的第一极连接；
数据写入子电路，分别与相应行栅线、相应列数据线和所述驱动晶体管的第一极连接；
补偿子电路，分别与相应行栅线、所述驱动晶体管的栅极和所述驱动晶体管的第二极连接；
第一复位子电路，分别与复位控制端、所述第一控制端、所述驱动晶体管的栅极、公共节点、第一初始化电压输入端和第二初始化电压输入端连接；用于在所述复位控制端的控制下，控制导通或断开所述驱动晶体管的栅极与所述公共节点之间的连接，以及控制导通或断开所述公共节点与所述第一初始化电压输入端之间的连接；还用于在所述第一控制端的控制下，控制导通或断开所述公共节点与所述第二初始化电压输入端之间的连接；
所述第二初始化电压输入端输入的第二初始化信号的电位，与发光时段所述驱动晶体管的栅极的电位之间的差值小于阈值。
可选的，所述第一复位子电路包括：
第一复位控制子电路，分别与所述复位控制端、所述驱动晶体管的栅极和所述公共节点连接；用于在所述复位控制端的控制下，控制导通或断开所述驱动晶体管的栅极与所述公共节点之间的连接；
第二复位控制子电路，分别与所述复位控制端、所述公共节点和所述第一初始化电压输入端连接；用于在所述复位控制端的控制下，控制导通或断开所述公共节点与所述第一初始化电压输入端之间的连接；
第三复位控制子电路，分别与所述第一控制端、所述公共节点和所述第二初始化电压输入端连接；用于在所述第一控制端的控制下，控制导通或断开所述公共节点与所述第二初始化电压输入端之间的连接。
可选的，所述第一复位控制子电路包括第一晶体管，所述第一晶体管的栅极与所述复位控制端连接，所述第一晶体管的第一极与所述公共节点连接，所述第一晶体管的第二极与所述驱动晶体管的栅极连接；
所述第二复位控制子电路包括第二晶体管，所述第二晶体管的栅极与所述复位控制端连接，所述第二晶体管的第一极与所述第一初始化电压输入端连接，所述第二晶体管的第二极与所述公共节点连接；
所述第三复位控制子电路包括第三晶体管，所述第三晶体管的栅极与所述第一控制端连接，所述第三晶体管的第一极与所述第二初始化电压输入端连接，所述第三晶体管的第二极与所述公共节点连接。
可选的，所述像素驱动电路还包括：
第二复位子电路，分别与所述复位控制端、所述发光元件和第三初始化电压输入端连接；用于在所述复位控制端的控制下，控制导通或断开所述第三初始化电压输入端与所述发光元件之间的连接。
可选的，所述第三初始化电压输入端与所述第一初始化电压输入端耦接。
可选的，所述第二复位子电路包括第四晶体管，所述第四晶体管的栅极与所述复位控制端连接，所述第四晶体管的第一极与所述第三初始化电压输入端连接，所述第四晶体管的第二极与所述发光元件连接。
可选的，所述像素驱动电路还包括发光控制子电路，所述驱动晶体管的第二极通过所述发光控制子电路与所述发光元件连接；
所述发光控制子电路分别与所述第一控制端、所述驱动晶体管的第二极和所述发光元件连接，用于：在所述第一控制端的控制下，控制导通或断开所述驱动晶体管的第二极与所述发光元件之间的连接。
可选的，所述发光控制子电路包括第五晶体管，所述第五晶体管的栅极与所述第一控制端连接，所述第五晶体管的第一极与所述驱动晶体管的第二极连接，所述第五晶体管的第二极与所述发光元件连接。
可选的，所述电源控制子电路包括第六晶体管，所述第六晶体管的栅极与所述第一控制端连接，所述第六晶体管的第一极与所述电源信号输入端连接，所述第六晶体管的第二极与所述驱动晶体管的第一极连接；
所述数据写入子电路包括第七晶体管，所述第七晶体管的栅极与相应行栅线连接，所述第七晶体管的第一极与相应列数据线连接，所述第七晶体管的第二极与所述驱动晶体管的第一极连接；
所述补偿子电路包括第八晶体管，所述第八晶体管的栅极与相应行栅线连接，所述第八晶体管的第一极与所述驱动晶体管的第二极连接，所述第八晶体管的第二极与所述驱动晶体管的栅极连接。
基于上述像素驱动电路的技术方案，本发明的第二方面提供一种显示装置，包括上述实施例提供的像素驱动电路。
可选的，所述显示装置包括显示区域和围绕所述显示区域的周边区域，所述显示装置还包括位于所述周边区域的第一初始化信号线和第二初始化信号线，所述第一初始化信号线和所述第二初始化信号线均沿第一方向延伸，
所述显示装置包括阵列分布在所述显示区域的多个所述像素驱动电路，沿第二方向位于同一行的各像素驱动电路中，第一复位子电路连接的第一初始化电压输入端均通过同一条第一连接线与所述第一初始化信号线连接；
沿第二方向位于同一行的各像素驱动电路中，第一复位子电路连接的第二初始化电压输入端均通过同一条第二连接线与所述第二初始化信号线连接，所述第一方向与所述第二方向相交。
基于上述像素驱动电路的技术方案，本发明的第三方面提供一种像素驱动电路的驱动方法，应用于上述实施例提供的像素驱动电路，所述驱动方法包括：在每一工作周期，
在复位时段，第一初始化电压输入端输入第一初始化电压Vinit1，在复位控制端的控制下，第一复位子电路控制导通所述第一初始化电压输入端与所述公共节点之间的连接，并导通所述公共节点与驱动子电路中驱动晶体管的栅极之间的连接；在所述第一控制端的控制下，第一复位子电路控制断开第二初始化电压输入端与所述公共节点之间的连接；
在写入补偿时段，在复位控制端的控制下，第一复位子电路控制断开所述第一初始化电压输入端与所述公共节点之间的连接，并控制断开所述公共节点与所述驱动晶体管的栅极之间的连接；相应列数据线输入数据电压Vdata，在相应行栅线的控制下，数据写入子电路控制导通相应列数据线和所述驱动晶体管的第一极之间的连接，补偿子电路控制导通所述驱动晶体管的栅极和所述驱动晶体管的第二极之间的连接，使所述驱动晶体管形成为二极管结构，使所述驱动晶体管的栅极的电位变为Vdata+Vth，Vth为驱动晶体管的阈值电压；
在发光时段，所述电源信号输入端输入电源电压Vdd，在所述第一控制端的控制下，所述电源控制子电路控制导通所述电源信号输入端与所述驱动晶体管的第一极之间的连接；在所述第一控制端的控制下，第一复位子电路控制导通所述第二初始化电压输入端与所述公共节点之间的连接；所述第二初始化电压输入端输入的第二初始化信号的电位，与发光时段所述驱动晶体管的栅极的电位之间的差值小于阈值。
可选的，当所述第一复位子电路包括第一复位控制子电路、第二复位控制子电路和第三复位控制子电路时，
在所述复位时段，在所述复位控制端的控制下，所述第一复位控制子电路控制导通所述驱动晶体管的栅极与所述公共节点之间的连接，同时所述第二复位控制子电路控制导通所述公共节点与所述第一初始化电压输入端之间的连接；在所述第一控制端的控制下，所述第三复位控制子电路控制断开所述公共节点与所述第二初始化电压输入端之间的连接；
在写入补偿时段，在复位控制端的控制下，所述第一复位控制子电路控制断开所述驱动晶体管的栅极与所述公共节点之间的连接，同时所述第二复位控制子电路控制断开所述公共节点与所述第一初始化电压输入端之间的连接；
在发光时段，在所述第一控制端的控制下，所述第三复位控制子电路控制导通所述第二初始化电压输入端与所述公共节点之间的连接。
可选的，所述像素驱动电路还包括发光控制子电路，所述驱动晶体管的第二极通过所述发光控制子电路与所述发光元件连接；所述发光控制子电路分别与所述第一控制端、所述驱动晶体管的第二极和所述发光元件连接；所述驱动方法还包括：
在所述复位时段和所述写入补偿时段，在所述第一控制端的控制下，所述发光控制子电路控制断开所述驱动晶体管的第二极与所述发光元件之间的连接，以使所述发光元件在所述复位时段和所述写入补偿时段不发光。
可选的，所述像素驱动电路还包括第二复位子电路，所述第二复位子电路分别与所述复位控制端、所述发光元件和第三初始化电压输入端连接；
在所述复位时段，在所述复位控制端的控制下，所述第二复位子电路控制导通所述第三初始化电压输入端与所述发光元件之间的连接。
可选的，所述第三初始化电压输入端输入的第三初始化信号的电位，与所述第一初始化电压输入端输入的第一初始化信号的电位相同。
本发明提供的技术方案中，驱动电流I只与电源电压Vdd和数据电压Vdata有关，而与驱动晶体管的阈值电压Vth没有关系；因此，即使向阈值电压Vth不同的多个驱动晶体管中输入相同的数据电压时，阈值电压Vth不同的驱动晶体管在饱和状态时所产生的驱动电流相同，从而使阈值电压Vth不同的驱动晶体管驱动对应的发光元件发光时，发光元件的发光亮度相同，避免了采用阈值电压Vth不同的驱动晶体管驱动发光元件发光时，由于阈值电压漂移而导致的发光元件发光不均匀的问题。
另外，本发明提供的技术方案中，有效降低了在所述发光时段所述驱动晶体管的栅极通过所述第一复位子电路漏电的电流，使得在低频驱动的情况下，也能够很好的保持所述驱动晶体管的栅极的电位，从而很好的改善了显示器件在显示时容易出现闪烁的问题。因此，本发明实施例提供的像素驱动电路在低频驱动的情况下，不仅保证了显示器件的显示质量还降低了显示器件的功耗。
附图说明
此处所说明的附图用来提供对本发明的进一步理解，构成本发明的一部分，本发明的示意性实施例及其说明用于解释本发明，并不构成对本发明的不当限定。在附图中：
图1为本发明实施例提供的像素驱动电路的第一结构示意图；
图2为本发明实施例提供的像素驱动电路的第一电路示意图；
图3为本发明实施例提供的像素驱动电路的第二结构示意图；
图4为本发明实施例提供的像素驱动电路的第二电路示意图；
图5为本发明实施例提供的像素驱动电路的第三结构示意图；
图6为本发明实施例提供的像素驱动电路的第三电路示意图；
图7为本发明实施例提供的像素驱动电路的第四结构示意图；
图8为本发明实施例提供的像素驱动电路的第四电路示意图；
图9为本发明实施例提供的像素驱动电路的驱动时序图；
图10为本发明实施例提供的显示装置的布局示意图。
具体实施方式
为了进一步说明本发明实施例提供的像素驱动电路及其驱动方法、显示装置，下面结合说明书附图进行详细描述。
请参阅图1和图2，本发明实施例提供了一种像素驱动电路，用于驱动发光元件EL，所述像素驱动电路包括：
驱动子电路3，所述驱动子电路3包括驱动晶体管DT，所述驱动晶体管DT的第二极与所述发光元件EL连接；
存储子电路4，所述存储子电路4的第一端与所述驱动晶体管DT的栅极(即节点G)连接，所述存储子电路4的第二端与电源信号输入端ELVDD连接；
电源控制子电路1，分别与第一控制端EM、所述电源信号输入端ELVDD和所述驱动晶体管DT的第一极(即节点S)连接；
数据写入子电路2，分别与相应行栅线GT、相应列数据线DA和所述驱动晶体管DT的第一极连接；
补偿子电路6，分别与相应行栅线GT、所述驱动晶体管DT的栅极和所述驱动晶体管DT的第二极连接；
第一复位子电路51，分别与复位控制端RE、所述第一控制端EM、所述驱动晶体管DT的栅极、公共节点N1、第一初始化电压输入端Vinit1和第二初始化电压输入端Vinit2连接；用于在所述复位控制端RE的控制下，控制导通或断开所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，以及控制导通或断开所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接；还用于在所述第一控制端EM的控制下，控制导通或断开所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接；
所述第二初始化电压输入端Vinit2输入的第二初始化信号的电位，与发光时段所述驱动晶体管DT的栅极的电位之间的差值小于阈值。
具体的，所述像素驱动电路应用于显示装置，显示装置包括基底，阵列分布在所述基底上的多个像素驱动电路，以及位于所述多个像素驱动电路背向所述基底的一侧，且与所述多个像素驱动电路一一对应的发光元件EL。示例性的，所述发光元件EL具体包括沿远离所述基底的方向上依次层叠设置的阳极、发光功能层和阴极，发光元件EL的阳极能够与对应的所述像素驱动电路连接，接收对应的所述像素驱动电路提供的驱动信号，所述阴极能够与显示装置中的负电源信号线ELVSS连接，接收所述负电源信号线提供的负电源信号，发光功能层用于在所述阳极和所述阴极的共同作用下发光。
需要说明，所述第二初始化电压输入端Vinit2输入的第二初始化信号的电位与发光时段所述驱动晶体管DT的栅极的电位大致相同，示例性的，所述第二初始化电压输入端Vinit2输入的第二初始化信号的电位，与发光时段所述驱动晶体管DT的栅极的电位之间的差值小于阈值。值得注意，所述阈值可根据实际需要设置，示例性的，所述阈值的设置应满足的条件为：在一帧显示时间内，发光元件EL上的电流变化量小于7％。
请参阅图1、图2和图9所示，上述像素驱动电路在一个驱动周期的工作过程为：
在复位时段P1，第一初始化电压输入端Vinit1输入的第一初始化信号的电位为V1，所述复位控制端RE输入的复位信号处于有效电平，使得在复位控制端RE的控制下，第一复位子电路51控制导通所述第一初始化电压输入端Vinit1与所述公共节点N1之间的连接，并导通所述公共节点N1与所述驱动晶体管DT的栅极之间的连接，使所述驱动晶体管DT的栅极的电位变为V1，实现对驱动晶体管DT的栅极复位，从而使得前一帧保持在驱动晶体管DT上的栅源电压Vgs被初始化；在该复位时段P1，所述第一控制端EM输入的第一控制信号处于非有效电平，使得在所述第一控制端EM的控制下，第一复位子电路51还控制断开第二初始化电压输入端Vinit2与所述公共节点N1之间的连接。
在写入补偿时段P2，所述复位控制端RE输入的复位信号处于非有效电平，使得在复位控制端RE的控制下，第一复位子电路51控制断开所述第一初始化电压输入端Vinit1与所述公共节点N1之间的连接，并控制断开所述公共节点N1与所述驱动晶体管DT的栅极之间的连接；在所述第一控制端EM的控制下，第一复位子电路51继续控制断开第二初始化电压输入端Vinit2与所述公共节点N1之间的连接；相应列数据线DA输入数据电压Vdata，相应行栅线GT输入的扫描信号处于有效电平，使得在相应行栅线GT的控制下，数据写入子电路2控制导通相应列数据线DA和所述驱动晶体管DT的第一极之间的连接，使驱动晶体管DT的第一极的电位变为Vdata；同时在相应行栅线GT的控制下，补偿子电路6控制导通所述驱动晶体管DT的栅极和所述驱动晶体管DT的第二极之间的连接，使所述驱动晶体管DT形成为二极管结构，因此通过数据写入子电路2、驱动晶体管DT和补偿子电路6配合工作，实现对驱动晶体管DT的阈值电压补偿，当补偿的时间足够长时，可控制驱动晶体管DT的栅极电位最终达到Vdata+Vth，Vth为驱动晶体管DT的阈值电压。
在发光时段P3，所述电源信号输入端ELVDD输入电源电压Vdd，所述第一控制端EM输入的第一控制信号处于有效电平，使得在所述第一控制端EM的控制下，所述电源控制子电路1控制导通所述电源信号输入端ELVDD与所述驱动晶体管DT的第一极之间的连接，使所述驱动晶体管DT的第一极的电位由Vdata变为Vdd；同时第二初始化电压输入端Vinit2输入的第二初始化信号的电位为V2，在所述第一控制端EM的控制下，第一复位子电路51控制导通所述第二初始化电压输入端Vinit2与所述公共节点N1之间的连接，使得所述公共节点N1的电位变为V2；所述第二初始化电压输入端Vinit2输入的第二初始化信号的电位V2，与发光时段P3所述驱动晶体管DT的栅极的电位之间的差值小于阈值。
在所述发光时段P3，驱动晶体管DT的栅极和驱动晶体管DT的第一极之间的电压Vgs为：
Vgs＝Vdata+Vth-Vdd， 公式(1)
驱动晶体管DT导通并工作在饱和状态时产生的驱动电流I为：
I＝k(Vgs-Vth)2 公式(2)
将公式(1)代入公式(2)得到：
I＝k(Vdata+Vth-Vdd-Vth)2＝k(Vdata-Vdd)2 公式(3)
公式(3)中，k为常数。
由公式(3)可知驱动电流I只与电源电压Vdd和数据电压Vdata有关，而与驱动晶体管DT的阈值电压Vth没有关系；因此，即使向阈值电压Vth不同的多个驱动晶体管DT中输入相同的数据电压时，阈值电压Vth不同的驱动晶体管DT在饱和状态时所产生的驱动电流相同，从而使阈值电压Vth不同的驱动晶体管DT驱动对应的发光元件EL发光时，发光元件EL的发光亮度相同，避免了采用阈值电压Vth不同的驱动晶体管DT驱动发光元件EL发光时，由于阈值电压漂移而导致的发光元件EL发光不均匀的问题。
根据上述像素驱动电路的具体结构和工作过程可知，本发明实施例提供的像素驱动电路中，通过设置所述第一复位子电路51，使得在复位时段P1，所述第一复位子电路51能够导通所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，使所述驱动晶体管DT的栅极的电位变为由第一初始化电压输入端Vinit1输入的较低的电位V1，实现对驱动晶体管DT的栅极复位；同时在所述复位时段P1，所述第一复位子电路51能够断开所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接。在发光时段P3，所述第一复位子电路51能够断开所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，并导通所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接，使得所述公共节点N1的电位与所述驱动晶体管DT的栅极的电位大致相同。
因此，本发明实施例提供的像素驱动电路，有效降低了在所述发光时段P3所述驱动晶体管DT的栅极通过所述第一复位子电路51漏电的电流，使得在低频驱动的情况下，也能够很好的保持所述驱动晶体管DT的栅极的电位，从而很好的改善了显示器件在显示时容易出现闪烁的问题。因此，本发明实施例提供的像素驱动电路在低频驱动的情况下，不仅保证了显示器件的显示质量还降低了显示器件的功耗。
另外，本发明实施例提供的像素驱动电路，在低灰阶显示情况和高灰阶显示情况下，均能够很好的保持所述驱动晶体管DT的栅极在发光时段的电位，改善显示器件在显示时容易出现闪烁的问题。
需要说明，图9中示出了两行像素驱动电路对应的驱动时序，其中EM2代表第二行像素驱动电路对应连接的第一控制端，RE2代第二行像素驱动电路对应连接的复位控制端，GT2代表第二行像素驱动电路对应连接的栅线，N1'代表第二行像素驱动电路中的公共节点。P1'代表第二行像素驱动电路对应的复位时段，P2'代表第二行像素驱动电路对应的写入补偿时段，P3'代表第二行像素驱动电路对应的发光时段。
如图3和图4所示，在一些实施例中，所述第一复位子电路51包括：
第一复位控制子电路511，分别与所述复位控制端RE、所述驱动晶体管DT的栅极和所述公共节点N1连接；用于在所述复位控制端RE的控制下，控制导通或断开所述驱动晶体管DT的栅极与所述公共节点N1之间的连接；
第二复位控制子电路512，分别与所述复位控制端RE、所述公共节点N1和所述第一初始化电压输入端Vinit1连接；用于在所述复位控制端RE的控制下，控制导通或断开所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接；
第三复位控制子电路513，分别与所述第一控制端EM、所述公共节点N1和所述第二初始化电压输入端Vinit2连接；用于在所述第一控制端EM的控制下，控制导通或断开所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接。
具体的，所述第一复位子电路51的具体结构多种多样，示例性的，所述第一复位子电路51包括所述第一复位控制子电路511、所述第二复位控制子电路512和第三复位控制子电路513，所述第一复位控制子电路511连接在所述驱动晶体管DT的栅极与所述公共节点N1之间，所述第二复位控制子电路512连接在所述公共节点N1与所述第一初始化电压输入端Vinit1之间，所述第三复位控制子电路513连接在所述公共节点N1与所述第二初始化电压输入端Vinit2之间。
当所述第一复位子电路51采用上述结构时，所述第一复位子电路51的工作过程如下：
在复位时段P1，在所述复位控制端RE的控制下，所述第一复位控制子电路511控制导通所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，所述第二复位控制子电路512控制导通所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接，使所述驱动晶体管DT的栅极的电位变为V1，实现对驱动晶体管DT的栅极复位，从而使得前一帧保持在驱动晶体管DT上的栅源电压Vgs被初始化。同时在所述第一控制端EM的控制下，第三复位控制子电路513控制断开所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接。
在写入补偿时段P2，在所述复位控制端RE的控制下，所述第一复位控制子电路511控制断开所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，所述第二复位控制子电路512控制断开所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接。同时在所述第一控制端EM的控制下，第三复位控制子电路513继续控制断开所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接。
在发光时段P3，在所述复位控制端RE的控制下，所述第一复位控制子电路511继续控制断开所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，所述第二复位控制子电路512继续控制断开所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接。同时在所述第一控制端EM的控制下，第三复位控制子电路513控制导通所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接，使得所述公共节点N1的电位变为与所述驱动晶体管DT的栅极电位大致相同的V2。
值得注意，所述驱动晶体管DT的栅极发生漏电的原因包括：在发光时段P3所述第一复位子电路51接入的初始化信号的电位较低，使得驱动晶体管DT的栅极电位与该初始化信号的电位之间产生较大的电位差，进而导致驱动晶体管DT的栅极通过所述第一复位子电路51向提供该初始化信号的初始化电压输入端漏电。
为了解决由上述原因导致的漏电问题，可以考虑将所述初始化电压输入端输入的初始化信号设置为交流信号，示例性的，在复位时段，设置所述初始化电压输入端输入的初始化信号的电位为在-1V至-3V之间的低电位；在发光时段，调节所述初始化电压输入端输入的初始化信号的电位为与所述驱动晶体管DT的栅极电位大致相同的高电位。
上述将所述初始化电压输入端输入的初始化信号设置为交流信号的方式虽然能够改善显示器件在显示时容易出现闪烁的问题，但是由于OLED驱动的架构为逐行发光，即所述初始化电压输入端输入的初始化信号的电位也需要逐行调节，这样就需要为每一行像素驱动电路对应的所述初始化电压输入端设置专门的GOA电路，即在显示器件中加入一列所述GOA电路，而一列所述GOA电路占用的空间较大，不利于显示器件的窄边框发展需求。
上述实施例提供的像素驱动电路中，由于所述第一初始化电压输入端Vinit1和所述第二初始化电压输入端Vinit2输入的均为直流信号，所述第一控制端EM除了能够控制所述第一复位子电路51，还能够同时控制所述电源控制子电路1，因此，第一复位子电路51和所述电源控制子电路1连接的第一控制端EM仅需要设置一个对应的GOA电路，同样的所述第一复位子电路51连接的所述复位控制端RE仅需要设置一个对应的GOA电路，因此，上述实施例提供的像素驱动电路采用现有的GOA方案即可实现在不同时段向所述公共节点N1提供具有合适电位的初始化信号，无需增加额外的专门用于实现初始化信号电位转换的GOA电路。
需要说明，现有的GOA方案中，包括一列EMGOA和一列GTGOA，EMGOA用于向其对应连接的第一控制端提供第一控制信号，GTGOA用于向其对应连接的栅线提供扫描信号。上述实施例提供的像素驱动电路采用现有的一列EMGOA和一列GTGOA即可，无需增加额外的专门用于实现初始化信号电位转换的GOA电路。
而且，上述实施例提供的像素驱动电路中，所述第一初始化电压输入端Vinit1和所述第二初始化电压输入端Vinit2输入的均为直流信号，避免了设置交流的初始化信号所导致的功耗增加。
在一些实施例中，所述第一复位控制子电路511包括第一晶体管T1，所述第一晶体管T1的栅极与所述复位控制端RE连接，所述第一晶体管T1的第一极与所述公共节点N1连接，所述第一晶体管T1的第二极与所述驱动晶体管DT的栅极连接；
所述第二复位控制子电路512包括第二晶体管T2，所述第二晶体管T2的栅极与所述复位控制端RE连接，所述第二晶体管T2的第一极与所述第一初始化电压输入端Vinit1连接，所述第二晶体管T2的第二极与所述公共节点N1连接；
所述第三复位控制子电路513包括第三晶体管T3，所述第三晶体管T3的栅极与所述第一控制端EM连接，所述第三晶体管T3的第一极与所述第二初始化电压输入端Vinit2连接，所述第三晶体管T3的第二极与所述公共节点N1连接。
具体地，所述第一复位控制子电路511、所述第二复位控制子电路512和所述第三复位控制子电路513的具体结构多种多样，示例性的，所述第一复位控制子电路511包括第一晶体管T1，所述第二复位控制子电路512包括第二晶体管T2，所述第三复位控制子电路513包括第三晶体管T3。
在所述复位时段P1，所述第一晶体管T1和所述第二晶体管T2导通，所述第三晶体管T3截止，从而控制导通所述第一初始化电压输入端Vinit1与所述驱动晶体管DT的栅极之间的连接，断开所述第二初始化电压输入端Vinit2与所述驱动晶体管DT的栅极之间的连接。
在所述数据写入时段，所述第一晶体管T1、所述第二晶体管T2和所述第三晶体管T3均截止，从而控制断开所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，同时控制断开所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接。
在所述发光时段P3，所述第一晶体管T1和所述第二晶体管T2截止，所述第三晶体管T3导通，从而控制断开所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，并控制导通所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接。
如图5和图6所示，在一些实施例中，所述像素驱动电路还包括：
第二复位子电路52，分别与所述复位控制端RE、所述发光元件EL和第三初始化电压输入端Vinit3连接；用于在所述复位控制端RE的控制下，控制导通或断开所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接。
具体地，在复位时段P1，在所述复位控制端RE提供的复位信号的控制下，第二复位子电路52控制导通所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接，利用所述第三初始化电压输入端Vinit3输入的第三初始化信号为所述发光元件EL的阳极复位。
在写入补偿时段P2和发光时段P3，在所述复位控制端RE提供的复位信号的控制下，第二复位子电路52控制断开所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接。
如图5和图6所示，在一些实施例中，所述第三初始化电压输入端Vinit3与所述第一初始化电压输入端Vinit1耦接。
具体地，所述第三初始化电压输入端Vinit3输入的第三初始化信号用于为所述发光元件EL的阳极进行复位，因此所述第三初始化信号的电位较低。所述第一初始化电压输入端Vinit1输入的第一初始化信号同样也是用于复位的信号，也具有较低的电位，因此，可以通过将所述第三初始化电压输入端Vinit3与所述第一初始化电压输入端Vinit1耦接，使得显示器件中仅需要设置一条能够同时为所述第一初始化电压输入端Vinit1和所述第三初始化电压输入端Vinit3，提供具有较低电位的初始化信号的初始化信号线，因此，上述实施例提供的像素驱动电路中，通过设置所述第三初始化电压输入端Vinit3与所述第一初始化电压输入端Vinit1耦接，有效减少了显示器件中初始化信号线的设置数量，从而更有利于降低所述显示器件的布局难度。
如图5和图6所示，在一些实施例中，所述第二复位子电路52包括第四晶体管T4，所述第四晶体管T4的栅极与所述复位控制端RE连接，所述第四晶体管T4的第一极与所述第三初始化电压输入端Vinit3连接，所述第四晶体管T4的第二极与所述发光元件EL连接。
具体的，所述第二复位子电路52的具体结构多种多样，示例性的，所述第二复位子电路52包括所述第四晶体管T4。
在复位时段P1，在所述复位控制端RE的控制下，所述第四晶体管T4导通，从而导通所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接，实现对所述发光元件EL的阳极的复位。
在所述写入补偿时段P2和所述发光时段P3，在所述复位控制端RE的控制下，所述第四晶体管T4截止，从而断开所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接。
如图7和图8所示，在一些实施例中，所述像素驱动电路还包括发光控制子电路8，所述驱动晶体管DT的第二极通过所述发光控制子电路8与所述发光元件EL连接；
所述发光控制子电路8分别与所述第一控制端EM、所述驱动晶体管DT的第二极和所述发光元件EL连接，用于：在所述第一控制端EM的控制下，控制导通或断开所述驱动晶体管DT的第二极与所述发光元件EL之间的连接。
具体地，在发光时段P3，在第一控制端EM的控制下，发光控制子电路8控制导通驱动晶体管DT的第二极与发光元件EL的阳极之间的连接。
在复位时段P1和写入补偿时段P2，在第一控制端EM的控制下，发光控制子电路8控制断开驱动晶体管DT的第二极与发光元件EL的阳极之间的连接，从而很好的避免了在复位时段P1和写入补偿时段P2所述发光元件EL异常发光。
如图7和图8所示，在一些实施例中，所述发光控制子电路8包括第五晶体管T5，所述第五晶体管T5的栅极与所述第一控制端EM连接，所述第五晶体管T5的第一极与所述驱动晶体管DT的第二极连接，所述第五晶体管T5的第二极与所述发光元件EL连接。
具体的，所述发光控制子电路8的具体结构多种多样，示例性的，所述发光控制子电路8包括所述第五晶体管T5。
在发光时段P3，在第一控制端EM的控制下，所述第五晶体管T5导通，从而控制导通驱动晶体管DT的第二极与发光元件EL的阳极之间的连接。
在复位时段P1和写入补偿时段P2，在第一控制端EM的控制下，所述第五晶体管T5截止，从而控制断开驱动晶体管DT的第二极与发光元件EL的阳极之间的连接，从而很好的避免了在复位时段P1和写入补偿时段P2所述发光元件EL异常发光。
如图7和图8所示，在一些实施例中，可设置所述电源控制子电路1包括第六晶体管T6，所述第六晶体管T6的栅极与所述第一控制端EM连接，所述第六晶体管T6的第一极与所述电源信号输入端连接，所述第六晶体管T6的第二极与所述驱动晶体管DT的第一极连接；
所述数据写入子电路2包括第七晶体管T7，所述第七晶体管T7的栅极与相应行栅线GT连接，所述第七晶体管T7的第一极与相应列数据线DA连接，所述第七晶体管T7的第二极与所述驱动晶体管DT的第一极连接；
所述补偿子电路6包括第八晶体管T8，所述第八晶体管T8的栅极与相应行栅线GT连接，所述第八晶体管T8的第一极与所述驱动晶体管DT的第二极连接，所述第八晶体管T8的第二极与所述驱动晶体管DT的栅极连接。
所述存储子电路4包括第一电容C1。
具体地，在复位时段P1，在所述第一控制端EM的控制下，所述第六晶体管T6截止，从而控制断开所述电源信号输入端ELVDD与所述驱动晶体管DT的第一极之间的连接；在相应行栅线GT的控制下，所述第七晶体管T7截止，从而控制断开所述相应列数据线DA与所述驱动晶体管DT的第一极之间的连接；在相应行栅线GT的控制下，所述第八晶体管T8截止，从而控制断开所述驱动晶体管DT的第二极与所述驱动晶体管DT的栅极之间的连接。
在写入补偿时段P2，在所述第一控制端EM的控制下，所述第六晶体管T6截止，继续控制断开所述电源信号输入端ELVDD与所述驱动晶体管DT的第一极之间的连接；在相应行栅线GT的控制下，所述第七晶体管T7导通，从而控制导通所述相应列数据线DA与所述驱动晶体管DT的第一极之间的连接；在相应行栅线GT的控制下，所述第八晶体管T8导通，从而控制导通所述驱动晶体管DT的第二极与所述驱动晶体管DT的栅极之间的连接。
在发光时段P3，在所述第一控制端EM的控制下，所述第六晶体管T6导通，从而控制导通所述电源信号输入端ELVDD与所述驱动晶体管DT的第一极之间的连接；在相应行栅线GT的控制下，所述第七晶体管T7截止，从而控制断开所述相应列数据线DA与所述驱动晶体管DT的第一极之间的连接；在相应行栅线GT的控制下，所述第八晶体管T8截止，从而控制断开所述驱动晶体管DT的第二极与所述驱动晶体管DT的栅极之间的连接。
上述实施例提供的像素驱动电路中，采用的各晶体管均为PMOS晶体管，因此，所述像素驱动电路中包括的各晶体管均能够采用相同的工艺同时制备，避免了制作像素驱动电路时，需要通过复杂工艺同时制作PMOS晶体管和氧化物晶体管，导致的制作流程复杂、制作成本增加的问题。
本发明实施例还提供了一种显示装置，包括上述实施例提供的像素驱动电路。
上述像素驱动电路中，驱动电流I只与电源电压Vdd和数据电压Vdata有关，而与驱动晶体管DT的阈值电压Vth没有关系；因此，即使向阈值电压Vth不同的多个驱动晶体管DT中输入相同的数据电压时，阈值电压Vth不同的驱动晶体管DT在饱和状态时所产生的驱动电流相同，从而使阈值电压Vth不同的驱动晶体管DT驱动对应的发光元件EL发光时，发光元件EL的发光亮度相同，避免了采用阈值电压Vth不同的驱动晶体管DT驱动发光元件EL发光时，由于阈值电压漂移而导致的发光元件EL发光不均匀的问题。
上述实施例提供的像素驱动电路中，通过设置所述第一复位子电路51，使得在复位时段P1，所述第一复位子电路51能够导通所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，使所述驱动晶体管DT的栅极的电位变为由第一初始化电压输入端Vinit1输入的较低的电位V1，实现对驱动晶体管DT的栅极复位；同时在所述复位时段P1，所述第一复位子电路51能够断开所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接。在发光时段P3，所述第一复位子电路51能够断开所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，并导通所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接，使得所述公共节点N1的电位与所述驱动晶体管DT的栅极的电位大致相同。因此，上述实施例提供的像素驱动电路，有效降低了在所述发光时段P3所述驱动晶体管DT的栅极通过所述第一复位子电路51漏电的电流，使得在低频驱动的情况下，也能够很好的保持所述驱动晶体管DT的栅极的电位，从而很好的改善了显示器件在显示时容易出现闪烁的问题。因此，本发明实施例提供的像素驱动电路在低频驱动的情况下，不仅保证了显示器件的显示质量还降低了显示器件的功耗。
本发明实施例提供的显示装置在包括上述实施例提供的像素驱动电路时，同样具有上述有益效果，此处不再赘述。
需要说明的是，所述显示装置可以为：电视、显示器、数码相框、手机、平板电脑等任何具有显示功能的产品或部件。
如图10所示，在一些实施例中，所述显示装置包括显示区域AA和围绕所述显示区域AA的周边区域，所述显示装置还包括位于所述周边区域的第一初始化信号线Init1和第二初始化信号线Init2，所述第一初始化信号线Init1和所述第二初始化信号线Init2均沿第一方向延伸；
所述显示装置包括阵列分布在所述显示区域AA的多个所述像素驱动电路，沿第二方向位于同一行的各像素驱动电路中，第一复位子电路51连接的第一初始化电压输入端Vinit1均通过同一条第一连接线91与所述第一初始化信号线Init1连接；
沿第二方向位于同一行的各像素驱动电路中，第一复位子电路51连接的第二初始化电压输入端Vinit2均通过同一条第二连接线92与所述第二初始化信号线Init2连接，所述第一方向与所述第二方向相交。
具体的，所述第一初始化信号线Init1和第二初始化信号线Init2的具体布局方式多种多样，示例性的，所述第一初始化信号线Init1和第二初始化信号线Init2均设置在周边区域，且沿第二方向相对的两侧均设置有所述第一初始化信号线Init1和第二初始化信号线Init2。
示例性的，所述第一方向与所述数据线的延伸方向相同，所述第二方向与所述栅线的延伸方向相同。
示例性的，所述第一初始化信号线Init1和第二初始化信号线Init2均采用相同的材料，同层制作，所述第一初始化信号线Init1和第二初始化信号线Init2沿第二方向依次排列。
示例性的，所述第一初始化信号线Init1和第二初始化信号线Init2异层设置，所述第一初始化信号线Init1在所述显示装置的基底上的正投影，与所述第二初始化信号线Init2在所述显示装置的基底上的正投影交叠。
示例性的，所述第一连接线91和所述第二连接线92异层设置。
按照上述方式在所述周边区域布局所述第一初始化信号线Init1和所述第二初始化信号线Init2时，更有利于缩小所述第一初始化信号线Init1和所述第二初始化信号线Init2占用的布局空间，在保证所述第一初始化信号线Init1和所述第二初始化信号线Init2为显示区域AA中的各像素驱动电路提供对应的初始化信号的情况下，更有利于显示装置的窄边框发展。
需要说明，图中还示出了第一扇出区F1，第二扇出区F2，弯折区BA，静电释放单元ESD，第一测试电路CT1、第二测试电路CT2，测试电路接触区ET，覆晶薄膜COF和多路调制器MUX。
本发明实施例还提供了一种像素驱动电路的驱动方法，应用于上述实施例提供的像素驱动电路，所述驱动方法包括：在每一工作周期，
在复位时段P1，第一初始化电压输入端Vinit1输入第一初始化电压Vinit1，在复位控制端RE的控制下，第一复位子电路51控制导通所述第一初始化电压输入端Vinit1与所述公共节点N1之间的连接，并导通所述公共节点N1与驱动子电路中驱动晶体管DT的栅极之间的连接；在所述第一控制端EM的控制下，第一复位子电路51控制断开第二初始化电压输入端Vinit2与所述公共节点N1之间的连接；
在写入补偿时段P2，在复位控制端RE的控制下，第一复位子电路51控制断开所述第一初始化电压输入端Vinit1与所述公共节点N1之间的连接，并控制断开所述公共节点N1与所述驱动晶体管DT的栅极之间的连接；相应列数据线DA输入数据电压Vdata，在相应行栅线GT的控制下，数据写入子电路2控制导通相应列数据线DA和所述驱动晶体管DT的第一极之间的连接，补偿子电路6控制导通所述驱动晶体管DT的栅极和所述驱动晶体管DT的第二极之间的连接，使所述驱动晶体管DT形成为二极管结构，使所述驱动晶体管DT的栅极的电位变为Vdata+Vth，Vth为驱动晶体管DT的阈值电压；
在发光时段P3，所述电源信号输入端ELVDD输入电源电压Vdd，在所述第一控制端EM的控制下，所述电源控制子电路1控制导通所述电源信号输入端ELVDD与所述驱动晶体管DT的第一极之间的连接；在所述第一控制端EM的控制下，第一复位子电路51控制导通所述第二初始化电压输入端Vinit2与所述公共节点N1之间的连接；所述第二初始化电压输入端Vinit2输入的第二初始化信号的电位，与发光时段P3所述驱动晶体管DT的栅极的电位之间的差值小于阈值。
采用上述驱动方法驱动像素驱动电路时，在一个驱动周期的工作过程为：
在复位时段P1，第一初始化电压输入端Vinit1输入的第一初始化信号的电位为V1，所述复位控制端RE输入的复位信号处于有效电平，使得在复位控制端RE的控制下，第一复位子电路51控制导通所述第一初始化电压输入端Vinit1与所述公共节点N1之间的连接，并导通所述公共节点N1与所述驱动晶体管DT的栅极之间的连接，使所述驱动晶体管DT的栅极的电位变为V1，实现对驱动晶体管DT的栅极复位，从而使得前一帧保持在驱动晶体管DT上的栅源电压Vgs被初始化；在该复位时段P1，所述第一控制端EM输入的第一控制信号处于非有效电平，使得在所述第一控制端EM的控制下，第一复位子电路51还控制断开第二初始化电压输入端Vinit2与所述公共节点N1之间的连接。
在写入补偿时段P2，所述复位控制端RE输入的复位信号处于非有效电平，使得在复位控制端RE的控制下，第一复位子电路51控制断开所述第一初始化电压输入端Vinit1与所述公共节点N1之间的连接，并控制断开所述公共节点N1与所述驱动晶体管DT的栅极之间的连接；在所述第一控制端EM的控制下，第一复位子电路51继续控制断开第二初始化电压输入端Vinit2与所述公共节点N1之间的连接；相应列数据线DA输入数据电压Vdata，相应行栅线GT输入的扫描信号处于有效电平，使得在相应行栅线GT的控制下，数据写入子电路2控制导通相应列数据线DA和所述驱动晶体管DT的第一极之间的连接，使驱动晶体管DT的第一极的电位变为Vdata；同时在相应行栅线GT的控制下，补偿子电路6控制导通所述驱动晶体管DT的栅极和所述驱动晶体管DT的第二极之间的连接，使所述驱动晶体管DT形成为二极管结构，因此通过数据写入子电路2、驱动晶体管DT和补偿子电路6配合工作，实现对驱动晶体管DT的阈值电压补偿，当补偿的时间足够长时，可控制驱动晶体管DT的栅极电位最终达到Vdata+Vth，Vth为驱动晶体管DT的阈值电压。
在发光时段P3，所述电源信号输入端ELVDD输入电源电压Vdd，所述第一控制端EM输入的第一控制信号处于有效电平，使得在所述第一控制端EM的控制下，所述电源控制子电路1控制导通所述电源信号输入端ELVDD与所述驱动晶体管DT的第一极之间的连接，使所述驱动晶体管DT的第一极的电位由Vdata变为Vdd；同时第二初始化电压输入端Vinit2输入的第二初始化信号的电位为V2，在所述第一控制端EM的控制下，第一复位子电路51控制导通所述第二初始化电压输入端Vinit2与所述公共节点N1之间的连接，使得所述公共节点N1的电位变为V2；所述第二初始化电压输入端Vinit2输入的第二初始化信号的电位V2，与发光时段P3所述驱动晶体管DT的栅极的电位之间的差值小于阈值。
采用本发明实施例提供的驱动方法驱动上述实施例提供的像素驱动电路时，驱动电流I只与电源电压Vdd和数据电压Vdata有关，而与驱动晶体管DT的阈值电压Vth没有关系；因此，即使向阈值电压Vth不同的多个驱动晶体管DT中输入相同的数据电压时，阈值电压Vth不同的驱动晶体管DT在饱和状态时所产生的驱动电流相同，从而使阈值电压Vth不同的驱动晶体管DT驱动对应的发光元件EL发光时，发光元件EL的发光亮度相同，避免了采用阈值电压Vth不同的驱动晶体管DT驱动发光元件EL发光时，由于阈值电压漂移而导致的发光元件EL发光不均匀的问题。
采用本发明实施例提供的驱动方法驱动上述像素驱动电路时，在复位时段P1，所述第一复位子电路51能够导通所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，使所述驱动晶体管DT的栅极的电位变为由第一初始化电压输入端Vinit1输入的较低的电位V1，实现对驱动晶体管DT的栅极复位；同时在所述复位时段P1，所述第一复位子电路51能够断开所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接。在发光时段P3，所述第一复位子电路51能够断开所述驱动晶体管DT的栅极与所述第一初始化电压输入端Vinit1之间的连接，并导通所述驱动晶体管DT的栅极与所述第二初始化电压输入端Vinit2之间的连接，使得所述公共节点N1的电位与所述驱动晶体管DT的栅极的电位大致相同。
因此，采用本发明实施例提供的驱动方法驱动上述像素驱动电路，有效降低了在所述发光时段P3所述驱动晶体管DT的栅极通过所述第一复位子电路51漏电的电流，使得在低频驱动的情况下，也能够很好的保持所述驱动晶体管DT的栅极的电位，从而很好的改善了显示器件在显示时容易出现闪烁的问题。因此，本发明实施例提供的像素驱动电路在低频驱动的情况下，不仅保证了显示器件的显示质量还降低了显示器件的功耗。
在一些实施例中，当所述第一复位子电路包括第一复位控制子电路511、第二复位控制子电路512和第三复位控制子电路513时，
在所述复位时段P1，在所述复位控制端RE的控制下，所述第一复位控制子电路511控制导通所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，同时所述第二复位控制子电路512控制导通所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接；在所述第一控制端EM的控制下，所述第三复位控制子电路513控制断开所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接；
在写入补偿时段P2，在复位控制端RE的控制下，所述第一复位控制子电路511控制断开所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，同时所述第二复位控制子电路512控制断开所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接；
在发光时段P3，在所述第一控制端EM的控制下，所述第三复位控制子电路513控制导通所述第二初始化电压输入端Vinit2与所述公共节点N1之间的连接。
具体地，在复位时段P1，在所述复位控制端RE的控制下，所述第一复位控制子电路511控制导通所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，所述第二复位控制子电路512控制导通所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接，使所述驱动晶体管DT的栅极的电位变为V1，实现对驱动晶体管DT的栅极复位，从而使得前一帧保持在驱动晶体管DT上的栅源电压Vgs被初始化。同时在所述第一控制端EM的控制下，第三复位控制子电路513控制断开所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接。
在写入补偿时段P2，在所述复位控制端RE的控制下，所述第一复位控制子电路511控制断开所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，所述第二复位控制子电路512控制断开所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接。同时在所述第一控制端EM的控制下，第三复位控制子电路513继续控制断开所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接。
在发光时段P3，在所述复位控制端RE的控制下，所述第一复位控制子电路511继续控制断开所述驱动晶体管DT的栅极与所述公共节点N1之间的连接，所述第二复位控制子电路512继续控制断开所述公共节点N1与所述第一初始化电压输入端Vinit1之间的连接。同时在所述第一控制端EM的控制下，第三复位控制子电路513控制导通所述公共节点N1与所述第二初始化电压输入端Vinit2之间的连接，使得所述公共节点N1的电位变为与所述驱动晶体管DT的栅极电位大致相同的V2。
采用上述实施例提供的驱动方法驱动像素驱动电路时，由于所述第一初始化电压输入端Vinit1和所述第二初始化电压输入端Vinit2输入的均为直流信号，所述第一控制端EM除了能够控制所述第一复位子电路51，还能够同时控制所述电源控制子电路1，因此，第一复位子电路51和所述电源控制子电路1连接的第一控制端EM仅需要设置一个对应的GOA电路，同样的所述第一复位子电路51连接的所述复位控制端RE仅需要设置一个对应的GOA电路，因此，采用上述实施例提供的驱动方法驱动像素驱动电路时，采用现有的GOA方案即可实现在不同时段向所述公共节点N1提供具有合适电位的初始化信号，无需增加额外的专门用于实现初始化信号电位转换的GOA电路。
而且，采用上述实施例提供的驱动方法驱动像素驱动电路时，所述第一初始化电压输入端Vinit1和所述第二初始化电压输入端Vinit2输入的均为直流信号，避免了设置交流的初始化信号所导致的功耗增加。
在一些实施例中，所述像素驱动电路还包括发光控制子电路8，所述驱动晶体管DT的第二极通过所述发光控制子电路8与所述发光元件EL连接；所述发光控制子电路8分别与所述第一控制端EM、所述驱动晶体管DT的第二极和所述发光元件EL连接；所述驱动方法还包括：在所述复位时段P1和所述写入补偿时段P2，在所述第一控制端EM的控制下，所述发光控制子电路8控制断开所述驱动晶体管DT的第二极与所述发光元件EL之间的连接，以使所述发光元件EL在所述复位时段P1和所述写入补偿时段P2不发光。
具体的，在发光时段P3，在第一控制端EM的控制下，发光控制子电路8控制导通驱动晶体管DT的第二极与发光元件EL的阳极之间的连接。
在复位时段P1和写入补偿时段P2，在第一控制端EM的控制下，发光控制子电路8控制断开驱动晶体管DT的第二极与发光元件EL的阳极之间的连接，从而很好的避免了在复位时段P1和写入补偿时段P2所述发光元件EL异常发光。
在一些实施例中，所述像素驱动电路还包括第二复位子电路52，所述第二复位子电路52分别与所述复位控制端RE、所述发光元件EL和第三初始化电压输入端Vinit3连接；在所述复位时段P1，在所述复位控制端RE的控制下，所述第二复位子电路52控制导通所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接。
具体地，在复位时段P1，在所述复位控制端RE提供的复位信号的控制下，第二复位子电路52控制导通所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接，利用所述第三初始化电压输入端Vinit3输入的第三初始化信号为所述发光元件EL的阳极复位。
在写入补偿时段P2和发光时段P3，在所述复位控制端RE提供的复位信号的控制下，第二复位子电路52控制断开所述第三初始化电压输入端Vinit3与所述发光元件EL之间的连接。
在一些实施中，可设置所述第三初始化电压输入端Vinit3输入的第三初始化信号的电位，与所述第一初始化电压输入端Vinit1输入的第一初始化信号的电位相同。
具体地，所述第三初始化电压输入端Vinit3输入的第三初始化信号用于为所述发光元件EL的阳极进行复位，因此所述第三初始化信号的电位较低。所述第一初始化电压输入端Vinit1输入的第一初始化信号同样也是用于复位的信号，也具有较低的电位，因此，可以通过将所述第三初始化电压输入端Vinit3与所述第一初始化电压输入端Vinit1耦接，使得显示器件中仅需要设置一条能够同时为所述第一初始化电压输入端Vinit1和所述第三初始化电压输入端Vinit3，提供相同的具有较低电位的初始化信号的初始化信号线，因此，采用上述实施例提供的驱动方法驱动像素驱动电路时，能够有效减少显示器件中初始化信号线的设置数量，从而更有利于降低所述显示器件的布局难度。
需要说明，本说明书中的各个实施例均采用递进的方式描述，各个实施例之间相同相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。尤其，对于方法实施例而言，由于其基本相似于产品实施例，所以描述得比较简单，相关之处参见产品实施例的部分说明即可。
除非另外定义，本公开使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”、“耦接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
可以理解，当诸如层、膜、区域或基板之类的元件被称作位于另一元件“上”或“下”时，该元件可以“直接”位于另一元件“上”或“下”，或者可以存在中间元件。
在上述实施方式的描述中，具体特征、结构、材料或者特点可以在任何的一个或多个实施例或示例中以合适的方式结合。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (16)

1.一种像素驱动电路，其特征在于，用于驱动发光元件，包括：
驱动子电路，所述驱动子电路包括驱动晶体管，所述驱动晶体管的第二极与所述发光元件连接；
存储子电路，所述存储子电路的第一端与所述驱动晶体管的栅极连接，所述存储子电路的第二端与电源信号输入端连接；
电源控制子电路，分别与第一控制端、所述电源信号输入端和所述驱动晶体管的第一极连接；
数据写入子电路，分别与相应行栅线、相应列数据线和所述驱动晶体管的第一极连接；
补偿子电路，分别与相应行栅线、所述驱动晶体管的栅极和所述驱动晶体管的第二极连接；
第一复位子电路，分别与复位控制端、所述第一控制端、所述驱动晶体管的栅极、公共节点、第一初始化电压输入端和第二初始化电压输入端连接；用于在所述复位控制端的控制下，控制导通或断开所述驱动晶体管的栅极与所述公共节点之间的连接，以及控制导通或断开所述公共节点与所述第一初始化电压输入端之间的连接；还用于在所述第一控制端的控制下，控制导通或断开所述公共节点与所述第二初始化电压输入端之间的连接；
所述第二初始化电压输入端输入的第二初始化信号的电位，与发光时段所述驱动晶体管的栅极的电位之间的差值小于阈值；
所述阈值的设置应满足的条件为：在一帧显示时间内，发光元件上的电流变化量小于7％。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述第一复位子电路包括：
第一复位控制子电路，分别与所述复位控制端、所述驱动晶体管的栅极和所述公共节点连接；用于在所述复位控制端的控制下，控制导通或断开所述驱动晶体管的栅极与所述公共节点之间的连接；
第二复位控制子电路，分别与所述复位控制端、所述公共节点和所述第一初始化电压输入端连接；用于在所述复位控制端的控制下，控制导通或断开所述公共节点与所述第一初始化电压输入端之间的连接；
第三复位控制子电路，分别与所述第一控制端、所述公共节点和所述第二初始化电压输入端连接；用于在所述第一控制端的控制下，控制导通或断开所述公共节点与所述第二初始化电压输入端之间的连接。
3.根据权利要求2所述的像素驱动电路，其特征在于，
所述第一复位控制子电路包括第一晶体管，所述第一晶体管的栅极与所述复位控制端连接，所述第一晶体管的第一极与所述公共节点连接，所述第一晶体管的第二极与所述驱动晶体管的栅极连接；
所述第二复位控制子电路包括第二晶体管，所述第二晶体管的栅极与所述复位控制端连接，所述第二晶体管的第一极与所述第一初始化电压输入端连接，所述第二晶体管的第二极与所述公共节点连接；
所述第三复位控制子电路包括第三晶体管，所述第三晶体管的栅极与所述第一控制端连接，所述第三晶体管的第一极与所述第二初始化电压输入端连接，所述第三晶体管的第二极与所述公共节点连接。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：
第二复位子电路，分别与所述复位控制端、所述发光元件和第三初始化电压输入端连接；用于在所述复位控制端的控制下，控制导通或断开所述第三初始化电压输入端与所述发光元件之间的连接。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述第三初始化电压输入端与所述第一初始化电压输入端耦接。
6.根据权利要求4所述的像素驱动电路，其特征在于，所述第二复位子电路包括第四晶体管，所述第四晶体管的栅极与所述复位控制端连接，所述第四晶体管的第一极与所述第三初始化电压输入端连接，所述第四晶体管的第二极与所述发光元件连接。
7.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括发光控制子电路，所述驱动晶体管的第二极通过所述发光控制子电路与所述发光元件连接；
所述发光控制子电路分别与所述第一控制端、所述驱动晶体管的第二极和所述发光元件连接，用于：在所述第一控制端的控制下，控制导通或断开所述驱动晶体管的第二极与所述发光元件之间的连接。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述发光控制子电路包括第五晶体管，所述第五晶体管的栅极与所述第一控制端连接，所述第五晶体管的第一极与所述驱动晶体管的第二极连接，所述第五晶体管的第二极与所述发光元件连接。
9.根据权利要求1所述的像素驱动电路，其特征在于，
所述电源控制子电路包括第六晶体管，所述第六晶体管的栅极与所述第一控制端连接，所述第六晶体管的第一极与所述电源信号输入端连接，所述第六晶体管的第二极与所述驱动晶体管的第一极连接；
所述数据写入子电路包括第七晶体管，所述第七晶体管的栅极与相应行栅线连接，所述第七晶体管的第一极与相应列数据线连接，所述第七晶体管的第二极与所述驱动晶体管的第一极连接；
所述补偿子电路包括第八晶体管，所述第八晶体管的栅极与相应行栅线连接，所述第八晶体管的第一极与所述驱动晶体管的第二极连接，所述第八晶体管的第二极与所述驱动晶体管的栅极连接。
10.一种显示装置，其特征在于，包括权利要求1～9中任一项所述的像素驱动电路。
11.根据权利要求10所述的显示装置，其特征在于，所述显示装置包括显示区域和围绕所述显示区域的周边区域，所述显示装置还包括位于所述周边区域的第一初始化信号线和第二初始化信号线，所述第一初始化信号线和所述第二初始化信号线均沿第一方向延伸；
所述显示装置包括阵列分布在所述显示区域的多个所述像素驱动电路，沿第二方向位于同一行的各像素驱动电路中，第一复位子电路连接的第一初始化电压输入端均通过同一条第一连接线与所述第一初始化信号线连接；
沿第二方向位于同一行的各像素驱动电路中，第一复位子电路连接的第二初始化电压输入端均通过同一条第二连接线与所述第二初始化信号线连接，所述第一方向与所述第二方向相交。
12.一种像素驱动电路的驱动方法，其特征在于，应用于如权利要求1～9中任一项所述的像素驱动电路，所述驱动方法包括：在每一工作周期，
在复位时段，第一初始化电压输入端输入第一初始化电压Vinit1，在复位控制端的控制下，第一复位子电路控制导通所述第一初始化电压输入端与所述公共节点之间的连接，并导通所述公共节点与驱动子电路中驱动晶体管的栅极之间的连接；在所述第一控制端的控制下，第一复位子电路控制断开第二初始化电压输入端与所述公共节点之间的连接；
在写入补偿时段，在复位控制端的控制下，第一复位子电路控制断开所述第一初始化电压输入端与所述公共节点之间的连接，并控制断开所述公共节点与所述驱动晶体管的栅极之间的连接；相应列数据线输入数据电压Vdata，在相应行栅线的控制下，数据写入子电路控制导通相应列数据线和所述驱动晶体管的第一极之间的连接，补偿子电路控制导通所述驱动晶体管的栅极和所述驱动晶体管的第二极之间的连接，使所述驱动晶体管形成为二极管结构，使所述驱动晶体管的栅极的电位变为Vdata+Vth，Vth为驱动晶体管的阈值电压；
在发光时段，所述电源信号输入端输入电源电压Vdd，在所述第一控制端的控制下，所述电源控制子电路控制导通所述电源信号输入端与所述驱动晶体管的第一极之间的连接；在所述第一控制端的控制下，第一复位子电路控制导通所述第二初始化电压输入端与所述公共节点之间的连接；所述第二初始化电压输入端输入的第二初始化信号的电位，与发光时段所述驱动晶体管的栅极的电位之间的差值小于阈值，所述阈值的设置应满足的条件为：在一帧显示时间内，发光元件上的电流变化量小于7％。
13.根据权利要求12所述的像素驱动电路的驱动方法，其特征在于，当所述第一复位子电路包括第一复位控制子电路、第二复位控制子电路和第三复位控制子电路时，
在所述复位时段，在所述复位控制端的控制下，所述第一复位控制子电路控制导通所述驱动晶体管的栅极与所述公共节点之间的连接，同时所述第二复位控制子电路控制导通所述公共节点与所述第一初始化电压输入端之间的连接；在所述第一控制端的控制下，所述第三复位控制子电路控制断开所述公共节点与所述第二初始化电压输入端之间的连接；
在写入补偿时段，在复位控制端的控制下，所述第一复位控制子电路控制断开所述驱动晶体管的栅极与所述公共节点之间的连接，同时所述第二复位控制子电路控制断开所述公共节点与所述第一初始化电压输入端之间的连接；
在发光时段，在所述第一控制端的控制下，所述第三复位控制子电路控制导通所述第二初始化电压输入端与所述公共节点之间的连接。
14.根据权利要求12所述的像素驱动电路的驱动方法，其特征在于，所述像素驱动电路还包括发光控制子电路，所述驱动晶体管的第二极通过所述发光控制子电路与所述发光元件连接；所述发光控制子电路分别与所述第一控制端、所述驱动晶体管的第二极和所述发光元件连接；所述驱动方法还包括：
在所述复位时段和所述写入补偿时段，在所述第一控制端的控制下，所述发光控制子电路控制断开所述驱动晶体管的第二极与所述发光元件之间的连接，以使所述发光元件在所述复位时段和所述写入补偿时段不发光。
15.根据权利要求12所述的像素驱动电路的驱动方法，其特征在于，所述像素驱动电路还包括第二复位子电路，所述第二复位子电路分别与所述复位控制端、所述发光元件和第三初始化电压输入端连接；
在所述复位时段，在所述复位控制端的控制下，所述第二复位子电路控制导通所述第三初始化电压输入端与所述发光元件之间的连接。
16.根据权利要求15所述的像素驱动电路的驱动方法，其特征在于，所述第三初始化电压输入端输入的第三初始化信号的电位，与所述第一初始化电压输入端输入的第一初始化信号的电位相同。
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