CN107342044B - 像素电路、显示面板和像素电路的驱动方法 - Google Patents

像素电路、显示面板和像素电路的驱动方法 Download PDF

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Abstract

本发明实施例公开了一种像素电路、显示面板和像素电路的驱动方法。其中，像素电路包括：发光元件，用于响应驱动电流而发光；驱动晶体管，用于向所述发光元件提供驱动电流；数据写入模块，用于将数据信号写入所述驱动晶体管的栅极；保持模块，与所述驱动晶体管的栅极电连接，用于在发光阶段保持所述驱动晶体管的栅极的电压；控制模块，与所述驱动晶体管的栅极电连接，用于在截止阶段控制所述驱动晶体管工作于完全截止区域，其中，所述截止阶段位于所述发光阶段之前。本发明实施例提供的技术方案，可以降低像素电路中驱动晶体管的特性漂移程度，降低显示mura和残影，提高显示效果。

Description

像素电路、显示面板和像素电路的驱动方法
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素电路、显示面板和像素电路的驱动方法。
背景技术
有机发光显示器相比液晶显示器，有机发光二极管具有低能耗、生产成本低、自发光、宽视角及响应速度快等优点，目前，在手机、PDA、数码相机等显示领域得到广泛的应用。有机发光显示器的每个像素包括有机发光二极管和驱动有机发光二极管发光显示的像素电路。
像素电路一般包括一个驱动晶体管、若干个开关晶体管和存储电容。由于工艺制程和器件老化等原因，各像素对应的像素电路中的驱动晶体管的特性发生漂移，例如阈值电压漂移，而且驱动晶体管一般长时间工作于亚阈值区域，也容易导致驱动晶体管的特性发生漂移，驱动晶体管的特性发生漂移后，特性曲线会发生扭曲，经过补偿后不一定完全重合，所以不同驱动晶体管的特性偏移程度不一样，会出现显示mura和残影等问题，从而影响整个图像的显示效果。
发明内容
本发明实施例提供了一种像素电路、显示面板和像素电路的驱动方法，以降低像素电路中驱动晶体管的特性漂移程度，降低显示mura和残影，提高显示效果。
一方面，本发明实施例提供了一种像素电路，该像素电路包括：
发光元件，用于响应驱动电流而发光；
驱动晶体管，用于向发光元件提供驱动电流；
数据写入模块，用于将数据信号写入驱动晶体管的栅极；
保持模块，与驱动晶体管的栅极电连接，用于在发光阶段保持驱动晶体管的栅极的电压；
控制模块，与驱动晶体管的栅极电连接，用于在截止阶段控制驱动晶体管工作于完全截止区域，其中，截止阶段位于发光阶段之前。
另一方面，本发明实施例提供了一种显示面板，该显示面板包括本发明任意实施例提供的像素电路。
又一方面，本发明实施例还提供了一种像素电路的驱动方法，用于驱动本发明任意实施例提供的像素电路，该像素电路的驱动方法包括：
截止阶段，控制模块导通，截止信号写入驱动晶体管的栅极，驱动晶体管工作于完全截止区域；
数据写入阶段，控制模块关断，数据写入模块导通，数据信号写入驱动晶体管的栅极；
发光阶段，驱动晶体管产生驱动电流驱动发光元件发光。
本发明实施例提供的技术方案，由于在截止阶段，驱动晶体管工作于完全截止阶段。也就是说，在显示的一帧时间内，驱动晶体管在部分时间(对应截止阶段)工作于完全截止区域，使得驱动晶体管偏压程度偏低，可以降低驱动晶体管的特性漂移程度，降低特性曲线扭曲程度，降低显示mura和残影，提高显示画面的显示效果。
附图说明
图1A是本发明实施例提供的一种像素电路的电路框图；
图1B本发明实施例提供的一种驱动晶体管特性曲线对比图；
图2A是本发明实施例提供的另一种像素电路的电路框图；
图2B本发明实施例提供的另一种驱动晶体管特性曲线对比图；
图2C是本发明实施例提供的另一种像素电路的电路框图；
图2D是本发明实施例提供的一种像素电路的电路图；
图2E是本发明实施例提供的一种驱动时序图；
图3A是本发明实施例提供的另一种像素电路的电路框图；
图3B是本发明实施例提供的另一种像素电路的电路框图；
图3C是本发明实施例提供的另一种像素电路的电路图；
图3D是本发明实施例提供的另一种驱动时序图；
图4A是本发明实施例提供的另一种像素电路的电路框图；
图4B是本发明实施例提供的另一种像素电路的电路图；
图5是本发明实施例提供的一种显示面板的示意图；
图6是本发明实施例提供的一种像素电路的驱动方法的流程示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
图1A是本发明实施例提供的一种像素电路的电路框图，参见图1A，该像素电路包括：
发光元件11，用于响应驱动电流而发光；
驱动晶体管12，用于向发光元件11提供驱动电流；
数据写入模块13，用于将数据信号写入驱动晶体管12的栅极；
保持模块14，与驱动晶体管12的栅极电连接，用于在发光阶段保持驱动晶体管12的栅极的电压；
控制模块15，与驱动晶体管12的栅极电连接，用于在截止阶段控制驱动晶体管12工作于完全截止区域，其中，截止阶段位于发光阶段之前。
具体地，在截止阶段，控制模块15的控制端写入控制信号ctrl，控制模块15导通，将其输入端输入的截止信号vt写入驱动晶体管12的栅极，控制驱动晶体管12工作于完全截止区域。然后，控制模块15根据其控制端写入的控制信号关断，扫描信号scan写入数据写入模块13的控制端，数据写入模块13导通，将输入端输入的数据信号Vdata写入驱动晶体管12的栅极，驱动晶体管12根据其栅极写入的数据信号Vdata产生相应的驱动电流，驱动电流驱动发光元件11发光显示。同时，保持模块14保持驱动晶体管12的栅极电压，驱动晶体管12持续产生驱动电流以驱动发光元件11持续发光。
需要说明书的是，驱动晶体管12可以为N型晶体管或者P型晶体管；若驱动晶体管12为N型晶体管，控制驱动晶体管12工作于完全截止区域，则驱动晶体管12的栅极和源极电压差需要小于其阈值电压的负值；若驱动晶体管12为P型晶体管，控制驱动晶体管12工作于完全截止区域，驱动晶体管12的栅极和源极电压差需要大于其阈值电压的负值。例如对于阈值电压为-2.791V的P型驱动晶体管，则要该驱动晶体管工作于完全截止区域，驱动晶体管的栅极和源极电压差可以为3V。
本发明实施例提供的技术方案，由于在截止阶段，驱动晶体管工作于完全截止区域。也就是说，在显示的一帧时间内，驱动晶体管在部分时间(对应截止阶段)工作于完全截止区域，使得驱动晶体管偏压程度偏低，可以降低驱动晶体管的特性漂移程度，降低特性曲线扭曲程度，降低显示mura和残影，提高显示画面的显示效果。示例性地，参见图1B，图1B是本发明实施例提供的一种驱动晶体管特性曲线对比图。其中，第一曲线102可表示驱动晶体管的原始特性曲线，第二曲线103可表示驱动晶体管发生特性漂移后的特性曲线，第三曲线104可表示驱动晶体管部分时间工作于完全截止区域的特性曲线。可以看到驱动晶体管部分时间工作于完全截止区域之后，第三曲线104的特性漂移程度相对于第二曲线103的特性漂移程度有所降低，即驱动晶体管部分时间工作于完全截止区域，降低了驱动晶体管的特性漂移程度，可以提高显示画面的显示效果。
图2A是本发明实施例提供的另一种像素电路的电路框图。参见图2A，本发明实施例提供的像素电路包括发光元件11、驱动晶体管12、数据写入模块13、保持模块14、控制模块15、阈值补偿模块16、第一发光控制模块17、第二发光控制模块18和第一复位模块19。
其中，数据写入模块13的控制端与第一扫描线S1电连接，数据写入模块13的第一端与数据线101电连接，数据写入模块13的第二端与驱动晶体管12的第一极(第二节点N2)电连接；
阈值补偿模块16的控制端与第一扫描线S1电连接，阈值补偿模块16的第一端与驱动晶体管12的第二极(第三节点N3)电连接，阈值补偿模块16的第二端与驱动晶体管12的栅极(第一节点N1)电连接；
保持模块14的第一端与驱动晶体管12的栅极电连接，保持模块14的第二端用于输入固定电平信号，可与第一电平信号线PVDD电连接。
控制模块15的控制端与控制信号线Ctr1电连接，控制模块15的第一端与第三电平信号线Vref3电连接，控制模块15的第二端与驱动晶体管12的栅极电连接；
第一发光控制模块17的控制端与第一发光信号线Emit1电连接，第一发光控制模块17的第一端与第一电平信号线PVDD电连接，第一发光控制模块17的第二端与驱动晶体管12的第一极电连接；
第二发光控制模块18的控制端与第一发光信号线Emit1电连接，第二发光控制模块18的第一端与驱动晶体管12的第二极电连接，第二发光控制模块18的第二端与发光元件11的第一极电连接；
发光元件11的第二极与第二电平信号线PVEE电连接；
所述第一复位模块19的控制端与第二扫描线S2电连接，所述第一复位模块19的第一端与第四电平信号线Vref4电连接，所述第一复位模块19的第二端与驱动晶体管12的栅极电连接。
示例性地，在显示的一帧内，第一阶段，也称截止阶段，第一发光信号线Emit1上的第一发光信号写入第一发光控制模块17的控制端和第二发光控制模块18的控制端，第一发光控制模块17和第二发光控制模块18导通。控制信号线Ctr1上的控制信号写入控制模块15的控制端，控制模块15导通。第三电平信号线Vref3上的第三电平信号写入驱动晶体管12的栅极，驱动晶体管12工作于完全截止区域。第二阶段，也称初始化阶段，控制模块15关断，第一发光控制模块17和第二发光控制模块18也关断，第二扫描线S2上的第二扫描信号写入第一复位模块19的控制端，第一复位模块19导通，第四电平信号线Vref4上的第四电平信号写入驱动晶体管12的栅极和保持模块14的第一端，对驱动晶体管12的栅极电压和保持模块14的第一端的电压进行复位。第三阶段，也称数据写入阶段，第一复位模块19关断，第一扫描线S1上的第一扫描信号写入数据写入模块13的控制端，数据写入模块19和阈值补偿模块16导通，数据线101上的数据信号依次通过数据写入模块19、驱动晶体管12和阈值补偿模块16写入驱动晶体管12的栅极，驱动晶体管的栅极电压升高，直至驱动晶体管关断，设数据线101上的数据信号的电压值为Vdata，在驱动晶体管12关断时，驱动晶体管12的栅极电压，即第一节点N1的电压V1＝Vdata+Vth，其中Vth为驱动晶体管12的阈值电压。第四阶段，也称发光阶段，数据写入模块13和阈值补偿模块16关断，第一发光信号线Emit1上的发光信号写入第一发光控制模块17的控制端和第二发光控制模块18的控制端，第一发光控制模块17和第二发光控制模块18导通，驱动晶体管12的漏电流Id，即驱动电流通过第二发光控制模块18驱动发光元件11发光，以实现显示面板的显示功能。驱动电流Id满足以下公式：
Figure BDA0001379436210000071
其中，μ为驱动晶体管12的载流子迁移率，W、L为驱动晶体管12沟道的宽度和长度，Cox为驱动晶体管12单位面积的栅氧化层电容量。VPVDD为第一电平信号线PVDD上的第一电平信号的电压值，也为第二节点N2的电压值。可以看到，驱动晶体管12产生的驱动电流Id与驱动晶体管12的阈值电压Vth无关。解决了驱动晶体管12阈值电压漂移引起的显示异常问题。而且由于截止阶段，驱动晶体管12工作于完全截止区域，可以降低驱动晶体管12的特性漂移程度，降低显示mura和残影，提高显示质量。图2B是本发明实施例提供的一种驱动晶体管特性曲线对比图。参见图2B，第一曲线201可表示驱动晶体管的原始特性曲线，第二曲线202可表示驱动晶体管发生特性漂移后的特性曲线，第三曲线203可表示对驱动晶体管进行阈值补偿之后的特性曲线。可以看到经过阈值补偿，第三曲线203也不能和第一曲线201重合。在完全截止区域，第一曲线201、第二曲线202和第三曲线203的重合度较高，在显示的一帧内，通过控制模块15控制驱动晶体管12在部分时间段(截止阶段)工作于完全截止区域，可以降低驱动晶体管12的特性漂移程度，提高补偿的效果，进一步降低显示mura和残影，提高显示效果。
在本发明实施例中，保持模块14的第二端用于输入固定电平信号作为参考电压，用于保持其第二端的电压。如图2A所示，保持模块14的第二端与第一电平信号线PVDD电连接，由第一电平信号线PVDD提供固定电平信号作为参考电压。在本发明实施例的其他实施例方式中，保持模块14第二端可以与其他电平信号线电连接。参见图2C，图2C是本发明实施例提供的另一种像素电路的电路框图。与图2A所示的像素电路不同的是，保持模块14的第二端与参考电压信号线Vref1电连接，参考电压信号线Vref1提供固定电压信号。图2A中保持模块14的第二端与第一电平信号线PVDD电连接，不用额外设置参考电压信号线。
在本发明实施例中，第三电平信号线Vref3上的信号的电压值可大于第一电平信号线PVDD上的信号的电压值。例如，第一扫描线S1上的第一扫描信号可包括高电平阶段和低电平阶段，第一电平信号线Vref3上的信号的电压值可以等于第一扫描信号的高电平阶段的电压值。由于在截止阶段，第三电平信号线Vref3上的信号写入驱动晶体管12的栅极，第一电平信号线PVDD上的信号写入驱动晶体管12的第一电极，第三电平信号线Vref3上的信号的电压值大于第一电平信号线PVDD上的信号的电压值，具体地，第三电平信号线Vref3上的信号的电压值与第一电平信号线PVDD上的信号的电压值之差需要大于驱动晶体管的阈值电压的负值，驱动晶体管12将工作于完全截止区域。
图2C是本发明实施例提供的一种像素电路的电路图。在本发明任意实施例的提供的像素电路的基础上，数据写入模块13包括第一晶体管M1，阈值补偿模块16包括第二晶体管，控制模块15包括第三晶体管M3，第一发光控制模块17包括第四晶体管M4、第二发光控制模块18包括第五晶体管M5，第一复位模块19包括第六晶体管M6，保持模块14包括第一电容Cst；
第一晶体管M1的第一极与数据线101电连接，第一晶体管M1的第二极与驱动晶体管12的第一极(第二节点N2)电连接，第一晶体管M1的栅极与第一扫描线S1电连接；
第二晶体管M2的第一极与驱动晶体管12的第二极(第三节点N3)电连接，第二晶体管M2的第二极与驱动晶体管12的栅极(第一节点N1)电连接，第二晶体管M2的栅极与第一扫描线S1电连接；
第三晶体管M3的第一极与第三电平信号线Vref3电连接，第三晶体管M3的第二极与驱动晶体管12的栅极电连接，第三晶体管M3的栅极与控制信号线Ctr1电连接；
第四晶体管M4的第一极与第一电平信号线PVDD电连接，第四晶体管M4的第二极与驱动晶体管12的第一极电连接，第四晶体管M4的栅极与第一发光信号线Emit1电连接；
第五晶体管M5的第一极与驱动晶体管12的第二极电连接，第五晶体管M5的第二极与发光元件11的第一极电连接，第五晶体管M5的栅极与第一发光信号线Emit1电连接；
第六晶体管M6的第一极与第四电平信号线Vref4电连接，第六晶体管M6的第二极与驱动晶体管12的栅极电连接，第六晶体管M6的栅极与第二扫描线S2电连接；
第一电容Cst的第一极与驱动晶体管12的栅极电连接，第一电容Cst的第二极与驱动晶体管12的第一极电连接。
图2E是本发明实施例提供的一种驱动时序图，下面结合图2D和图2E示例性地说明本发明实施例提供的像素电路的工作过程。其中，S-S1表示第一扫描线S1上的第一扫描信号，S-S2表示第二扫描线S2上的第二扫描信号，S-Emit1表示第一发光信号线Emit1上的第一发光信号，S-Ctr1表示控制信号线Ctr1上的控制信号，S-Vref表示第三电平信号线的第三电平信号，为高电平。第一电平信号线PVDD上的第一电平信号为高电平，第二电平信号线PVEE上的第二电平信号为低电平。各晶体管均为P型晶体管。该像素电路的工作过程包括如下阶段：
t1阶段，第一发光信号Emit1为低电平，第四晶体管M4和第五晶体管M5导通。控制信号S-Ctrl为低电平，第三晶体管M3导通，第三电平信号S-Vref写入驱动晶体管12的栅极和第一电容Cst的第一极，驱动晶体管12的栅极，由于第四晶体管M4导通，第一电平信号线PVDD上的第一电平信号写入驱动晶体管12的第一级，即驱动晶体管12的源极，驱动晶体管12工作于完全截止区域，该阶段也称截止阶段。
t2阶段，第一发光信号Emit1为高电平，第四晶体管M4和第五晶体管M5关断。控制信号S-Ctrl为高电平，第三晶体管M3关断。第二扫描信号S-S2为低电平，第六晶体管M6导通，第四电平信号S-Vref写入驱动晶体管12的栅极和第一电容Cst的第一极，此阶段的第四电平信号S-Vref可以为低电平信号，以对驱动晶体管12的栅极电极和和第一电容Cst的第一极的电压进行复位，保证下一阶段驱动晶体管12导通，数据信号能够写入驱动晶体管12的栅极，此阶段也称初始化阶段。
t3阶段，第四晶体管M4、第五晶体管M5和第三晶体管M3关断。第二扫描信号S-S2为高电平，第六晶体管M6关断。第一扫描信号S-S1为低电平，第一晶体管M1和第二晶体管M2导通，数据线101上的数据信号依次通过第一晶体管M1、驱动晶体管12和第二晶体管M2写入驱动晶体管12的栅极和第一电容Cst的第一极，驱动晶体管12的栅极电压逐渐升高，直至驱动晶体管12的栅极电压和源极电压差等于驱动晶体管12的阈值电压时，驱动晶体管12关断，驱动晶体管12的栅极电压保持不变，驱动晶体管12的栅极电压，即第一节点N1的电压V1＝Vdata+Vth，其中Vdata为数据线101上的数据信号的电压值，Vth为驱动晶体管12的阈值电压。
t3之后的阶段，也称发光阶段，第一发光信号Emit1为低电平，第四晶体管M4和第五晶体管M5导通。第一扫描信号S-S1为高电平，第一晶体管M1和第二晶体管M2关断，第三晶体管M3和第六晶体管M6也关断。驱动晶体管12的漏电流，即驱动晶体管12产生的驱动电流驱动发光元件11发光，驱动电流Id满足以下公式：
Figure BDA0001379436210000111
其中，VPVDD为第一电平信号线PVDD上的第一电平信号的电压值，也即第二节点N2的电压值。可以看到，驱动晶体管12产生的驱动电流Id与驱动晶体管12的阈值电压Vth无关。解决了驱动晶体管12阈值电压漂移引起的显示异常问题，而且由于截止阶段，驱动晶体管12工作于完全截止区域，可以降低驱动晶体管12的特性漂移程度，降低显示mura和残影，提高显示质量。
图3A是本发明实施例提供的另一种像素电路的电路框图。参见图3A，本发明实施例提供的像素电路，该像素电路包括发光元件11、驱动晶体管12、数据写入模块13、保持模块14、控制模块15、阈值补偿模块16、第一发光控制模块17、第二发光控制模块18和第一复位模块19。
其中，数据写入模块13的控制端与第一扫描线S1电连接、第一端与数据线101电连接、第二端与驱动晶体管12的第一极电连接；
阈值补偿模块16的控制端与第一扫描线S1电连接、第一端与驱动晶体的第二极电连接、第二端与驱动晶体管的栅极电连接；
保持模块14的第一端与驱动晶体管12的栅极电连接，保持模块的第二端用于输入固定电平信号；
控制模块15的控制端与控制信号线Ctr1电连接、第一端与第二发光信号线Emit2电连接、第二端与驱动晶体管12的栅极电连接；
第一发光控制模块17的控制端与第一发光信号线Emit1电连接、第一端与第一电平信号线PVDD电连接、第二端与驱动晶体管12的第一极电连接；
第二发光控制模块18的控制端与第一发光信号线Emit1电连接、第一端与驱动晶体管12的第二极电连接、第二端与发光元件11的第一极电连接；
发光元件11的第二极与第二电平信号线PVEE电连接；
第一复位模块19的控制端与第二扫描线S2电连接、第一端与第四电平信号线Vref4电连接、第二端与驱动晶体管12的栅极电连接。
图3A所示的像素电路与图2A所示的像素电路不同的是，控制模块15的第一端与第二发光信号线Emit2电连接，在截止阶段，第二发光信号线Emit2提供电压，以控制驱动晶体管12工作于完全截止区域。
在本发明实施例中，第一发光信号线Emit1和第二发光信号线Emit2上的信号均为脉冲信号；
第二发光信号线Emit2上的信号为第一发光信号线Emit1上的信号的前一信号。
具体地，第一发光信号线Emit1和第二发光信号线Emit2可以与显示面板上的发光信号驱动电路(EOA)的输出端电连接，EOA电路位于显示面板的非显示区域，可以位于显示面板的显示区域的一侧或者相对的两侧。由EOA电路向第一发光信号线Emit1充电，即提供第一发光信号，向第二发光信号线Emit2充电即提供第二发光信号。第一发光信号线Emit1和第二发光信号线Emit2可为相邻的两条信号线。EOA电路在向第二发光信号线Emit2提供第二发光信号，完成充电之后，紧接着向第一发光信号线Emit1提供第一发光信号，第二发光信号为第一发光信号的前一信号。也就是说第一发光信号线Emit1上的脉冲信号和第二发光信号线Emit2上的脉冲信号的幅值相同，相位不同。控制模块15的第一端与第二发光信号线Emit2电连接，使用第二发光信号线Emit2代替第三电平信号线，可以节省第三电平信号线，可以节省显示面板内的布线空间，降低成本。
第二发光信号线Emit2上高电平信号的电压值大于第一电平信号线PVDD上的信号的电压值。由于在截止阶段，第二发光信号线Emit2上的高电平信号的电压写入驱动晶体管12的栅极，第一电平信号线PVDD上的信号的电压写入驱动晶体管12的第一电极，第二发光信号线Emit2上高电平信号的电压值大于第一电平信号线PVDD上的信号的电压值，具体地，第三电平信号线Vref3上的信号的电压值与第一电平信号线PVDD上的信号的电压值之差需要大于驱动晶体管的阈值电压的负值，驱动晶体管12将工作于完全截止区域。
图3B是本发明实施例提供的另一种像素电路的电路框图，在本发明实施例的另一种实施方式中，参见图3B，控制模块的控制端可与第三扫描线S3电连接，第三扫描线S3上的信号为脉冲信号，第三扫描线S3上的信号为第二扫描线上的信号的前一信号，第三扫描线S3复用为控制信号线。
其中，控制信号线、第一扫描线S1和第二扫描线S2上的信号均为脉冲信号；第二扫描线S2上的信号为第一扫描线S1上的信号的前一信号。
具体地，第一扫描线S1、第二扫描线S2和第三扫描线S3可以与显示面板上的扫描驱动电路，也称栅极驱动电路(GOA)的输出端电连接，GOA电路位于显示面板的非显示区域，可以位于显示面板的显示区域的一侧或者相对的两侧。由GOA电路向第一扫描线S1充电，即提供第一扫描信号；向第二扫描线S2充电，即提供第二扫描信号；向第三扫描线S3充电，即提供第三扫描信号。第一扫描线S1、第二扫描线S2和第三扫描线S3依次相邻排列。GOA电路在向第三扫描线S3提供第三扫描信号，完成充电之后，紧接着向第二扫描线S2提供第二扫描信号，对第二扫描线S2完成充电之后，向第一扫描线S1提供第一扫描信号。第三扫描信号为第二扫描信号的前一信号，第二扫描信号为第一扫描信号的前一信号。也就是说第一扫描信号、第二扫描信号和第三扫描信号的幅值相同，相位不同。第三扫描信号线S3复位为控制信号线，可以省去控制信号线，在保证电路正常工作的基础上，可以节省布线空间。
图3A和图3B所示的像素电路，使用第二发光信号线Emit2代替第三电平信号线Vref3，使用第三扫描线S3代替控制信号线Ctr1，不用额外设置第三电平信号线线和控制信号线Ctr1和设计提供相应的驱动信号，这将节省走线空间，节省成本。
图3C是本发明实施例提供的另一种像素电路的电路图，参见图3C，与图2D所示像素电路不同的是，第三晶体管M3的第一极与第二发光信号线Emit2电连接，第三晶体管M3的栅极和第三扫描线S3电连接。图3D是本发明实施例提供的另一种驱动时序图。其中S-S3表示第三扫描线S3上的第三扫描信号，S-Emit2表示第二发光信号线Emit2上的第二发光信号。在t1阶段，第三扫描信号S-S3为低电平，第三晶体管M3导通，第二发光信号S-Emit2的高电平写入驱动晶体管12的栅极，驱动晶体管12工作于完全截止区域。其他阶段的各晶体管的导通情况以及信号流向可参考针对图2D所示的像素电路的描述。
在本发明实施例中，第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、以及驱动晶体管可均为P型晶体管。在本发明实施例的其他实施例方式中，第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、以及驱动晶体管可均为N型晶体管。驱动晶体管为N型晶体管的情况下，驱动晶体管的栅极和源极电压差需要小于其阈值电压的负值。在截止阶段，第三电平信号线写入驱动晶体管的栅极电压可以等于第一扫描信号的低电平阶段的电压值或者第二发光信号线低电平阶段的电压值。
图4A是本发明实施提供的另一种像素电路的电路框图，在上述实施例的基础上，像素电路还包括第二复位模块20；
第二复位模块20的控制端与第二扫描线S2电连接、第一端与第四电平信号线Vref4电连接、第二端与发光元件11的第一极电连接。第二复位模块在导通时，可以将第四电平信号线Vref4上的信号写入发光元件的第一极，对发光元件的第一极进行复位，防止发光元件第一极的上一帧的电荷对下一帧造成影响，提高显示效果。
其中，第二复位模块20包括第八晶体管；示例性地，图4B是本发明实施例提供的一种像素电路的电路图，参见图4B，其中第二复位模块包括第八晶体管M8，第八晶体管M8的第一极与第四电平信号线Vref4电连接、第二极与发光元件11的第一极电连接、栅极与第二扫描线S2电连接。
本发明实施例还提供了一种显示面板，图5是本发明实施例提供的一种显示面板的示意图，参见图5，该显示面板50包括本发明任意实施例中的像素电路10，其中，Sn-2、Sn-1和Sn表示扫描线。
本发明实施例还提供了一种像素电路的驱动方法，可用于驱动本发明任意实施例提供的像素电路工作。图6是本发明实施例提供的一种像素电路的驱动方法的流程示意图，参见图6，本发明实施例提供的像素电路的驱动方法，包括：
S110、截止阶段，控制模块导通，截止信号写入驱动晶体管的栅极，驱动晶体管工作于完全截止区域；
驱动晶体管工作于完全截止区域，可以降低驱动晶体管的漂移程度，降低显示mura和残影，提高显示效果。
S120、数据写入阶段，控制模块关断，数据写入模块导通，数据信号写入驱动晶体管的栅极；
S130、发光阶段，驱动晶体管产生驱动电流驱动发光元件发光。
进一步的，在发光阶段之前还包括阈值补偿阶段，在阈值补偿阶段，驱动晶体管的阈值电压得到补偿，保持模块存储与驱动晶体管的阈值电压关联的电压；
在发光阶段，驱动晶体管根据保持模块提供的电压产生与其阈值电压无关的驱动电流。
进一步的，像素电路还包括第一复位模块，第一复位模块与驱动晶体管的栅极电连接；
在截止阶段之后以及数据写入阶段之前还包括初始化阶段；
在初始化阶段，第一复位导通，复位电压写入所述保持模块与所述驱动晶体管的栅极电连接的一端。以对驱动晶体管的栅极电压和保持模块第一端的电压进行复位，以在数据写入阶段将数据信号写入驱动晶体管的栅极。
本发明实施例中技术方案，设置控制模块，控制像素电路中的晶体管，在一帧内的部分时间工作于完全截止区域，使得驱动晶体管偏压程度偏低，可以降低驱动晶体管的特性漂移程度，降低特性曲线扭曲程度，降低显示mura和残影，提高显示画面的显示效果。而且通过复用显示面板内的第三扫描信号线和第二发光控制信号线为控制模块提供驱动信号，使用显示面板内原有的信号线和驱动时序即可实现控制驱动晶体管工作于完全截止区域，可以节省显示面板内走线，节省布线空间。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (14)

1.一种像素电路，其特征在于，包括：
发光元件，用于响应驱动电流而发光；
驱动晶体管，用于向所述发光元件提供驱动电流；
数据写入模块，用于将数据信号写入所述驱动晶体管的栅极；
保持模块，与所述驱动晶体管的栅极电连接，用于在发光阶段保持所述驱动晶体管的栅极的电压；
控制模块，所述控制模块的控制端与控制信号线电连接、第一端与第三电平信号线或第二发光信号线电连接、第二端与所述驱动晶体管的栅极电连接；用于在截止阶段，所述控制模块为所述驱动晶体管的栅极提供截止信号，控制所述驱动晶体管工作于完全截止区域，其中，所述截止阶段位于所述发光阶段之前，若所述驱动晶体管为N型晶体管，所述截止信号的电压值与所述驱动晶体管的源极电压值的差值小于所述驱动晶体管阈值电压的负值；若所述驱动晶体管为P型晶体管，所述截止信号的电压值与所述驱动晶体管的源极电压值的差值大于所述驱动晶体管阈值电压的负值；
第一复位模块，所述第一复位模块的控制端与第二扫描线电连接、第一端与第四电平信号线电连接、第二端与所述驱动晶体管的栅极电连接。
2.根据权利要求1所述的像素电路，其特征在于，还包括阈值补偿模块、第一发光控制模块和第二发光控制模块；
所述数据写入模块的控制端与第一扫描线电连接、第一端与数据线电连接、第二端与所述驱动晶体管的第一极电连接；
所述阈值补偿模块的控制端与所述第一扫描线电连接、第一端与所述驱动晶体管的第二极电连接、第二端与所述驱动晶体管的栅极电连接；
所述保持模块的第一端与所述驱动晶体管的栅极电连接，所述保持模块的第二端用于输入固定电平信号；
所述第一发光控制模块的控制端与第一发光信号线电连接、第一端与第一电平信号线电连接、第二端与所述驱动晶体管的第一极电连接；
所述第二发光控制模块的控制端与所述第一发光信号线电连接、第一端与所述驱动晶体管的第二极电连接、第二端与所述发光元件的第一极电连接；
所述发光元件的第二极与第二电平信号线电连接。
3.根据权利要求2所述的像素电路，其特征在于，所述第三电平信号线上的信号的电压值大于所述第一电平信号线上的信号的电压值。
4.根据权利要求2所述的像素电路，其特征在于，所述第一发光信号线和所述第二发光信号线上的信号均为脉冲信号；
所述第二发光信号线上的信号为所述第一发光信号线上的信号的前一信号。
5.根据权利要求2所述的像素电路，其特征在于，所述第二发光信号线上的信号为脉冲信号；
所述第二发光信号线上高电平信号的电压值大于所述第一电平信号线上的信号的电压值。
6.根据权利要求2所述的像素电路，其特征在于，所述控制信号线、所述第一扫描线和第二扫描线上的信号均为脉冲信号；
所述第二扫描线上的信号为所述第一扫描线上的信号的前一信号。
7.根据权利要求 6所述的像素电路，其特征在于，所述控制模块的控制端与第三扫描线电连接，所述第三扫描线上的信号为脉冲信号，所述第三扫描线上的信号为所述第二扫描线上的信号的前一信号，所述第三扫描线复用为所述控制信号线。
8.根据权利要求2所述的像素电路，其特征在于，所述数据写入模块包括第一晶体管，所述阈值补偿模块包括第二晶体管，所述控制模块包括第三晶体管，所述第一发光控制模块包括第四晶体管、所述第二发光控制模块包括第五晶体管，所述第一复位模块包括第六晶体管，所述保持模块包括第一电容；
所述第一晶体管的第一极与所述数据线电连接、第二极与所述驱动晶体管的第一极电连接、栅极与所述第一扫描线电连接；
所述第二晶体管的第一极与所述驱动晶体管的第二极电连接、第二极与所述驱动晶体管的栅极电连接、栅极与所述第一扫描线电连接；
所述第三晶体管的第一极与所述第三电平信号线或所述第二发光信号线电连接、第二极与所述驱动晶体管的栅极电连接、栅极与所述控制信号线电连接；
所述第四晶体管的第一极与所述第一电平信号线电连接、第二极与所述驱动晶体管的第一极电连接、栅极与所述第一发光信号线电连接；
所述第五晶体管的第一极与所述驱动晶体管的第二极电连接、第二极与所述发光元件的第一极电连接、栅极与所述第一发光信号线电连接；
所述第六晶体管的第一极与所述第四电平信号线电连接、第二极与所述驱动晶体管的栅极电连接、栅极与所述第二扫描线电连接；
所述第一电容的第一极与所述驱动晶体管的栅极电连接，所述第一电容的第二极与所述驱动晶体管的第一极电连接。
9.根据权利要求8所述的像素电路，其特征在于，所述第一晶体管、所述第二晶体管、所述第三晶体管、所述第四晶体管、所述第五晶体管、所述第六晶体管、以及所述驱动晶体管均为P型晶体管。
10.根据权利要求2所述的像素电路，其特征在于，还包括第二复位模块；
所述第二复位模块的控制端与所述第二扫描线电连接、第一端与所述第四电平信号线电连接、第二端与所述发光元件的第一极电连接。
11.根据权利要求10所述的像素电路，其特征在于，所述第二复位模块包括第八晶体管；
所述第八晶体管的第一极与所述第四电平信号线电连接、第二极与所述发光元件的第一极电连接、栅极与所述第二扫描线电连接。
12.一种显示面板，其特征在于，包括权利要求1-11任一项所述的像素电路。
13.一种像素电路的驱动方法，用于驱动权利要求1-11任一项所述的像素电路，其特征在于，包括：
截止阶段，所述控制模块导通，截止信号写入所述驱动晶体管的栅极，所述驱动晶体管工作于完全截止区域；若所述驱动晶体管为N型晶体管，所述截止信号的电压值与所述驱动晶体管的源极电压值的差值小于所述驱动晶体管阈值电压的负值；若所述驱动晶体管为P型晶体管，所述截止信号的电压值与所述驱动晶体管的源极电压值的差值大于所述驱动晶体管阈值电压的负值；
初始化阶段，所述第一复位模块导通，复位电压写入保持模块与所述驱动晶体管的栅极电连接的一端；
数据写入阶段，所述控制模块关断，所述数据写入模块导通，数据信号写入所述驱动晶体管的栅极；
发光阶段，所述驱动晶体管产生驱动电流驱动所述发光元件发光。
14.根据权利要求13所述的驱动方法，其特征在于，在所述发光阶段之前还包括阈值补偿阶段，在所述阈值补偿阶段，所述驱动晶体管的阈值电压得到补偿，所述保持模块存储与所述驱动晶体管的阈值电压关联的电压；
在所述发光阶段，所述驱动晶体管根据所述保持模块提供的电压产生与其阈值电压无关的驱动电流。
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