CN110223636B - 像素驱动电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明提供一种像素驱动电路，包括驱动晶体管、电容和发光器件；还包括：第一复位模块，用于在复位阶段将初始化电压端的信号传输至驱动晶体管的栅极；数据写入模块，用于在数据写入阶段将数据信号写入驱动晶体管的第一极；阈值补偿模块，包括补偿晶体管；发光控制模块，用于在数据写入阶段和复位阶段将第一电源端与驱动晶体管的第一极断开、将驱动晶体管的第二极与发光器件断开；及在发光阶段将第一电源端与驱动晶体管的第一极导通、将驱动晶体管的第二极与发光器件导通；补偿晶体管为氧化物晶体管，驱动晶体管为低温多晶硅晶体管。本发明还提供一种像素驱动电路的驱动方法、显示装置。本发明能改善发光亮度不一致的问题，并有利于实现窄边框。

Description

像素驱动电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术，具体涉及一种像素驱动电路及其驱动方法、显示装置。
背景技术
在有机发光二极管(OLED，Organic Light Emitting Diode)显示面板中，各个像素单元中的驱动晶体管的阈值电压由于制备工艺可能彼此之间存在差异，而且由于温度等因素的影响，驱动晶体管的阈值电压也会产生漂移的现象。因此，各个驱动晶体管的阈值电压的不同也可能会导致发光器件的发光亮度不一致，从而导致显示面板显示不均匀。
发明内容
本发明旨在至少解决现有技术中存在的技术问题之一，提出了一种一种像素驱动电路及其驱动方法、显示装置。
为了实现上述目的，本发明提供一种像素驱动电路，包括驱动晶体管、电容和发光器件，所述电容的两端分别与第一电源端和所述驱动晶体管的栅极相连，所述像素驱动电路还包括：
第一复位模块，用于在复位阶段将初始化电压端的信号传输至所述驱动晶体管的栅极；
数据写入模块，用于在数据写入阶段将数据写入端的数据信号写入所述驱动晶体管的第一极；
阈值补偿模块，包括补偿晶体管，该补偿晶体管用于在数据写入阶段将所述驱动晶体管第二极与栅极导通；
发光控制模块，用于在数据写入阶段和复位阶段将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开；以及在发光阶段将所述第一电源端与所述驱动晶体管的第一极导通、并将所述驱动晶体管的第二极与所述发光器件导通；
其中，所述补偿晶体管为氧化物晶体管，所述驱动晶体管为低温多晶硅晶体管。
可选地，所述像素驱动电路还包括：第二复位模块，所述第二复位模块与第一复位端、所述初始化电压端和所述发光器件的第一端相连，用于在复位阶段响应于所述第一复位端提供的第一电平信号的控制，将所述初始化电压端的信号传输至所述发光器件的第一端。
可选地，所述数据写入模块包括：写入晶体管，所述写入晶体管的栅极与第一扫描端相连，所述写入晶体管的第一极与所述数据写入端相连，所述写入晶体管的第二极与所述驱动晶体管的第一极相连。
可选地，所述补偿晶体管的栅极与第二扫描端相连，所述补偿晶体管的第一极与所述驱动晶体管的第二极相连，所述补偿晶体管的第二极与所述驱动晶体管的栅极相连。
可选地，所述第一复位模块包括：第一复位晶体管，所述第一复位晶体管的栅极与第二复位端相连，所述第一复位晶体管的第一极与所述驱动晶体管的栅极相连，所述第一复位晶体管的第二极与所述初始化电压端相连；
所述第一复位晶体管为氧化物晶体管。
可选地，所述发光控制模块包括：控制单元和选通单元；
所述控制单元与所述第二复位端、所述第二扫描端和所述选通单元相连，用于在复位阶段响应于所述第二复位端提供的第二电平信号，将该第二电平信号传输至所述选通单元；以及在数据写入阶段响应于所述第二扫描端提供的第二电平信号，将该第二电平信号传输至所述选通单元；并在发光阶段响应于所述第二复位端提供的第一电平信号，将该第一电平信号传输至所述选通单元；
所述选通单元用于在所述第一电平信号的控制下，将所述第一电源端与所述驱动晶体管的第一极导通、并将所述驱动晶体管的第二极与所述发光器件导通；以及在所述第二电平信号的控制下，将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开。
可选地，所述控制单元包括：第一控制晶体管、第二控制晶体管、第三控制晶体管和第四控制晶体管；
所述第一控制晶体管的栅极和第一极均与所述第二扫描端相连，所述第一控制晶体管的第二极与所述选通单元相连；
所述第二控制晶体管的栅极和第一极均与所述第二复位端相连，所述第二控制晶体管的第二极与所述选通单元相连；
所述第三控制晶体管的栅极和第一极均与所述第二扫描端相连，所述第三控制晶体管的第二极与所述第四控制晶体管的第一极相连；所述第四控制晶体管的栅极与所述第二复位端相连，所述第四控制晶体管的第二极与所述选通单元相连。
可选地，所述选通单元包括：第一选通晶体管和第二选通晶体管，
所述第一选通晶体管的栅极与所述控制单元相连，所述第一选通晶体管的第一极与所述第一电源端相连，所述第一选通晶体管的第二极与所述驱动晶体管的第一极相连；
所述第二选通晶体管的栅极与所述控制单元相连，所述第二选通晶体管的第一极与所述驱动晶体管的第二极相连，所述第二选通晶体管的第二极与所述发光器件相连。
可选地，所述补偿模块还包括：补偿控制晶体管，所述补偿控制晶体管的栅极与第一扫描端相连，所述补偿控制晶体管的第一极与发光控制端相连，所述补偿控制晶体管的第二极与所述补偿晶体管的栅极相连；
所述补偿晶体管的第一极与所述驱动晶体管的第二极相连，所述补偿晶体管的第二极与所述驱动晶体管的栅极相连。
可选地，所述第一复位模块包括：第二复位晶体管和第三复位晶体管，
所述第三复位晶体管的栅极与第一复位端相连，所述第三复位晶体管的第一极与发光控制端相连，所述第三复位晶体管的第二极与所述第二复位晶体管的栅极相连；所述第二复位晶体管的第一极与所述驱动晶体管的栅极相连，所述第二复位晶体管的第二极与初始化电压端相连；
所述第三复位晶体管和所述第二复位晶体管均为氧化物晶体管。
可选地，所述发光控制模块包括：第三选通晶体管和第四选通晶体管，
所述第三选通晶体管的栅极和所述第四选通晶体管的栅极均与发光控制端相连，所述第三选通晶体管的第一极与所述第一电源端相连，所述第三选通晶体管的第二极与所述驱动晶体管的第一极相连；所述第四选通晶体管的第一极与所述驱动晶体管的第二极相连，所述第四选通晶体管的第二极与所述发光器件相连。
可选地，所述第二复位模块包括：第四复位晶体管，该第四复位晶体管的栅极与所述第一复位端相连，所述第四复位晶体管的第一极与所述初始化电压端相连，所述第四复位晶体管的第二极与所述发光器件的第一端相连。
相应地，本发明还提供一种如上述像素驱动电路的驱动方法，包括：
在复位阶段，所述第一复位模块将所述初始化电压端的信号传输至所述驱动晶体管的栅极，以控制所述驱动晶体管开启；所述发光控制模块将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开；
在数据写入阶段，所述数据写入模块将所述数据写入端的数据信号写入所述驱动晶体管的第一极；所述补偿晶体管将所述驱动晶体管的第二极与栅极导通；所述发光控制模块将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开；
在发光阶段，所述发光控制模块将所述第一电源端与所述驱动晶体管的第一极导通、并将所述驱动晶体管的第二极与所述发光器件导通。
可选地，所述驱动方法具体包括：
在复位阶段，向所述第一复位端和所述第二扫描端提供第一电平信号、并向所述第一扫描端和所述第二复位端提供第二电平信号；
在数据写入阶段，向所述第一复位端和所述第二扫描端提供第二电平信号、并向所述第一扫描端和所述第二复位端提供第一电平信号；
在发光阶段，向所述第一复位端和所述第一扫描端提供第二电平信号，向所述第二复位端和所述第二扫描端提供第一电平信号。
可选地，其驱动方法具体包括：
在复位阶段，向所述第一复位端提供第一电平信号、并向所述发光控制端和所述第一扫描端提供第二电平信号；
在数据写入阶段，向所述发光控制端和所述第一复位端提供第二电平信号、并向所述第一扫描端提供第一电平信号；
在发光阶段，向所述发光控制端提供第一电平信号、并向所述第一复位端和所述第一扫描端提供第二电平信号。
相应地，本发明还提供一种显示装置，包括上述像素驱动电路。
附图说明
附图是用来提供对本发明的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本发明，但并不构成对本发明的限制。在附图中：
图1为本发明实施例一提供的一种像素驱动电路的示意图；
图2为本发明实施例二提供的一种像素驱动电路的示意图；
图3为图2所示像素驱动电路中部分信号端的时序图；
图4为本发明实施例三提供的一种像素驱动电路的示意图；
图5为图4所示像素驱动电路中部分信号端的时序图。
具体实施方式
以下结合附图对本发明的具体实施方式进行详细说明。应当理解的是，此处所描述的具体实施方式仅用于说明和解释本发明，并不用于限制本发明。
图1为本发明实施例一提供的一种像素驱动电路的示意图，如图1所示，该像素驱动电路包括：驱动晶体管DTFT、电容Cst、发光器件10、第一复位模块20、数据写入模块30、阈值补偿模块40和发光控制模块50。
其中，像素驱动电路的工作阶段包括复位阶段、数据写入阶段和发光阶段。
电容Cst的两端分别与驱动晶体管DTFT的栅极和第一电源端VDD相连。第一复位模块20与驱动晶体管DTFT的栅极和初始化电压端Vinit相连，用于在复位阶段将初始化电压端Vinit的信号传输至驱动晶体管DTFT的栅极。
数据写入模块30与数据写入端Data和驱动晶体管DTFT的第一极相连，用于在数据写入阶段将数据写入端Data的数据信号写入驱动晶体管DTFT的第一极。
阈值补偿模块40包括补偿晶体管T1，该补偿晶体管T1的第一极与驱动晶体管DTFT的第二极相连，补偿晶体管T1的第二极与驱动晶体管DTFT的栅极相连；补偿晶体管T1用于在数据写入阶段将驱动晶体管DTFT第二极与栅极导通。
发光控制模块50与第一电源端VDD、驱动晶体管DTFT的第一极、驱动晶体管DTFT的第二极、发光器件10的第一端相连，发光控制模块50用于在数据写入阶段和复位阶段将第一电源端VDD与驱动晶体管DTFT的第一极断开、并将驱动晶体管DTFT的第二极与发光器件10断开；以及在发光阶段将第一电源端VDD与驱动晶体管DTFT的第一极导通、并将驱动晶体管DTFT的第二极与发光器件10导通。
其中，补偿晶体管T1为氧化物晶体管(Oxide TFT)；驱动晶体管DTFT为低温多晶硅晶体管(LTPS)。其中，本发明中的氧化物晶体管均为N型晶体管，低温多晶硅晶体管均为P型晶体管。
发光器件10的第二端与第二电源端VSS相连。其中，第一电源端VDD可以为高电平信号端，第二电源端VSS可以为低电平信号端，例如接地端。
在本发明实施例中，在数据写入阶段，补偿晶体管T1将驱动晶体管DTFT的栅极和第二极导通，从而形成经过驱动晶体管DTFT的第二极而对驱动晶体管DTFT的栅极进行电压补偿的路径。具体地，在复位阶段，驱动晶体管DTFT的栅极接收到初始化电压端Vinit的信号，从而达到初始电压；在数据写入阶段，数据写入端Data的数据被写入至驱动晶体管DTFT的第一极，且驱动晶体管DTFT的栅极和第二极短接，形成二极管结构，此时，数据信号经过驱动晶体管DTFT和补偿晶体管T1，一直流向驱动晶体管DTFT的栅极，驱动晶体管DTFT的栅极电位达到Vdata+Vth，其中，Vth为阈值晶体管的阈值电压，Vdata为数据写入端Data提供的数据信号的电压。在发光阶段，在电容Cst的电压保持作用下，驱动晶体管DTFT的栅极电位保持为Vdata+Vth；第一电源端VDD的电压经由发光控制模块50和驱动晶体管DTFT产生驱动电流流入发光器件10。此时，驱动电流IOLED满足以下饱和电流公式：
IOLED＝K(Vgs-Vth)2＝K(Vdata+Vth-ELVDD-Vth)2
＝K(Vdata-ELVDD)2 (1)
其中，K为与驱动晶体管DTFT本身特性有关的系数，Vgs为驱动晶体管DTFT的栅源电压，即，驱动晶体管DTFT栅极与第一极之间的电压，ELVDD为第一电源端VDD提供的电压。
可见，提供给发光器件10的驱动电流IOLED不受阈值影响。
另外，由于低温多晶硅晶体管具有阈值电压偏大、开启电压小、迁移率高等优点，因此，本发明中的驱动晶体管DTFT采用低温多晶硅晶体管能够实现低频、低功耗驱动；而氧化物晶体管相对于低温多晶硅晶体管而言，在截止状态时的电流Ioff较小，且Ioff平缓，因此，本发明的补偿晶体管T1采用氧化物晶体管时，电路中的漏电流非常小，可以改善像素驱动电路中发光器件10发光亮度不一致的问题。
进一步地，如图1所示，像素驱动电路还包括：第二复位模块60。第二复位模块60与第一复位端Reset_P、初始化电压端Vinit和发光器件10的第一端相连，用于在复位阶段响应于第一复位端Reset_P提供的第一电平信号的控制，将初始化电压端Vinit的信号传输至发光器件10的第一端，从而对发光器件10第一端的电位进行初始化。
图2为本发明实施例二提供的一种像素驱动电路的示意图，该像素驱动电路是图1中结构的一种具体化实现方式。如图2所示，数据写入模块30包括：写入晶体管T4。写入晶体管T4的栅极与第一扫描端Gate_P相连，写入晶体管T4的第一极与数据写入端Data相连，写入晶体管T4的第二极与驱动晶体管DTFT的第一极相连。写入晶体管T4采用低温多晶硅晶体管。
阈值补偿模块40包括补偿晶体管T1，补偿晶体管T1的栅极与第二扫描端Gate_N相连，补偿晶体管T1的第一极与驱动晶体管DTFT的第二极相连，补偿晶体管T1的第二极与驱动晶体管DTFT的栅极相连。
第一复位模块20包括：第一复位晶体管T2。第一复位晶体管T2的栅极与第二复位端Reset_N相连，第一复位晶体管T2的第一极与驱动晶体管DTFT的栅极相连，第一复位晶体管T2的第二极与初始化电压端Vinit相连。第一复位晶体管T2为氧化物晶体管。也就是说，本实施例中控制驱动晶体管DTFT栅极电位的晶体管均采用氧化物晶体管，以减小漏电流。
第二复位模块60包括：第四复位晶体管T7。该第四复位晶体管T7的栅极与第一复位端Reset_P相连，第四复位晶体管T7的第一极与初始化电压端Vinit相连，第四复位晶体管T7的第二极与发光器件10的第一端相连。第四复位晶体管T7为低温多晶硅晶体管。
其中，第一复位端Reset_P在复位阶段提供的第一电平信号为控制第四复位晶体管T7开启的信号。第二复位端Reset_N在复位阶段提供的第二电平信号为控制第一复位晶体管T2开启的信号。第一扫描端Gate_P在数据写入阶段提供控制写入晶体管T4开启的信号，第二扫描端Gate_N在数据写入阶段提供控制补偿晶体管T1开启的信号。而由于在本实施例中，第一复位晶体管T2、补偿晶体管T1为氧化物晶体管，第四复位晶体管T7和写入晶体管均为低温多晶硅晶体管，也即，第一电平信号为低电平信号，第二电平信号为高电平信号。因此，第一复位端Reset_P和第一扫描端Gate_P可以与同一移位寄存器的相邻两级移位寄存器单元相连，该移位寄存器的多级移位寄存器单元依次输出低电平信号，从而使得第一复位端Reset_P和第一扫描端Gate_P在相邻两个阶段依次接收到低电平信号。另外，第二复位端Reset_N和第二扫描端Gate_N可以与同一移位寄存器的相邻两级移位寄存器单元相连，该移位寄存器的多级移位寄存器单元依次输出高电平信号，从而使得第二复位端Reset_N和第二扫描端Gate_N在相邻两个阶段依次接收到高电平信号。
发光控制模块50包括：控制单元51和选通单元52。
其中，控制单元51与第二复位端Reset_N、第二扫描端Gate_N和选通单元52相连，控制单元51用于在复位阶段响应于第二复位端Reset_N提供的第二电平信号，将该第二电平信号传输至选通单元52；以及在数据写入阶段响应于第二扫描端Gate_N提供的第二电平信号，将该第二电平信号传输至选通单元52；并在发光阶段响应于第二复位端Reset_N提供的第一电平信号，将该第一电平信号传输至选通单元52。
选通单元52用于在第一电平信号的控制下，将第一电源端VDD与驱动晶体管DTFT的第一极导通、并将驱动晶体管DTFT的第二极与发光器件10导通；以及在第二电平信号的控制下，将第一电源端VDD与驱动晶体管DTFT的第一极断开、并将驱动晶体管DTFT的第二极与发光器件10断开。
具体地，如图2所示，控制单元51包括：第一控制晶体管T8、第二控制晶体管T9、第三控制晶体管T11和第四控制晶体管T10。其中，第一控制晶体管T8和第二控制晶体管T9为氧化物晶体管；第三控制晶体管T11和第四控制晶体管T10为低温多晶硅晶体管。
其中，第一控制晶体管T8的栅极和第一极均与第二扫描端Gate_N相连，第一控制晶体管T8的第二极与选通单元52相连。
第二控制晶体管T9的栅极和第一极均与第二复位端Reset_N相连，第二控制晶体管T9的第二极与选通单元52相连。
第三控制晶体管T11的栅极和第一极均与第二扫描端Gate_N相连，第三控制晶体管T11的第二极与第四控制晶体管T10的第一极相连。第四控制晶体管T10的栅极与第二复位端Reset_N相连，第四控制晶体管T10的第二极与选通单元52相连。
选通单元52具体包括：第一选通晶体管T5和第二选通晶体管T6。第一选通晶体管T5和第二选通晶体管T6均为低温多晶硅晶体管。
其中，第一选通晶体管T5的栅极与控制单元相连，具体与第二控制晶体管T9的第二极、第四控制晶体管T10的第二极和第一控制晶体管T8的第二极相连；第一选通晶体管T5的第一极与第一电源端VDD相连，第一选通晶体管T5的第二极与驱动晶体管DTFT的第一极相连。
第二选通晶体管T6的栅极与控制单元51相连，具体与第二控制晶体管T9的第二极、第四控制晶体管T10的第二极和第一控制晶体管T8的第二极相连；第二选通晶体管T6的第一极与驱动晶体管DTFT的第二极相连，第二选通晶体管T6的第二极与发光器件10相连。
图3为图2所示像素驱动电路中部分信号端的时序图，如图3所示，在复位阶段t1，第一复位端Reset_P和第二扫描端Gate_N提供低电平信号，第二复位端Reset_N和第一扫描端Gate_P提供高电平信号。
此时，第一复位端Reset_P提供的低电平信号控制第四复位晶体管T7开启，第二复位端Reset_N提供的高电平信号控制第一复位晶体管T2开启，初始化电压端Vinit的初始电压传输至驱动晶体管DTFT的栅极和发光器件10的第一端。同时，第二复位端Reset_N提供的高电平信号控制第二控制晶体管T9开启，从而将第二复位端Reset_N的高电平信号传输至第一选通晶体管T5的栅极和第二选通晶体管T6的栅极，以使第一选通晶体管T5和第二选通晶体管T6关闭。另外，第二扫描端Gate_N提供的低电平信号控制第一控制晶体管T8关闭，第二复位端Reset_N提供的高电平信号控制第四控制晶体管T10关闭。
在数据写入阶段t2，第一复位端Reset_P和第二扫描端Gate_N提供高电平信号，第二复位端Reset_N和第一扫描端Gate_P提供低电平信号。
此时，由于第二扫描端Gate_N提供高电平信号，因此第一控制晶体管T8开启、第三控制晶体管T11关闭，由于第二复位端Reset_N提供低电平信号，因此，第二控制晶体管T9关闭、第四控制晶体管T10开启。此时，第二扫描端Gate_N的高电平信号传输至第一选通晶体管T5的栅极和第二选通晶体管T6的栅极，以控制第一选通晶体管T5和第二选通晶体管T6关闭。同时，补偿晶体管T1在第二扫描端Gate_N提供的高电平信号控制下开启，写入晶体管T4在第一扫描端Gate_P的低电平信号的控制下开启，数据写入端Data的数据信号经过补偿晶体管T1和写入晶体管T4向驱动晶体管DTFT的栅极传输，栅极驱动晶体管DTFT的栅极电位达到Vdata+Vth。
在发光阶段，第一复位端Reset_P和第一扫描端Gate_P均提供高电平信号，第二复位端Reset_N和第二扫描端Gate_N均提供低电平信号。
此时，由于第二复位端Reset_N提供低电平信号，因此第二控制晶体管T9关闭，第四控制晶体管T10开启。由于第二扫描端Gate_N提供低电平信号，因此，第一控制晶体管T8关闭，第三控制晶体管T11开启，第二扫描端Gate_N的低电平信号传输至第一选通晶体管T5和第二选通晶体管T6的栅极，从而使第一选通晶体管T5和第二选通晶体管T6开启。在电容Cst的电压保持作用下，驱动晶体管DTFT的栅极电位保持Vdata+Vth，驱动晶体管DTFT保持开启，驱动电流流入发光器件10，使发光器件10发光，驱动电流大小参见上述公式(1)。在此阶段，第一选通晶体管T5、第二选通晶体管T6和驱动晶体管DTFT之外的其他晶体管均关闭。
在本实施例二中，通过控制单元51与第一扫描端Gate_P、第一复位端Reset_P、第二扫描端Gate_N和第二复位端Reset_N的配合，可以控制第一选通晶体管T5和第二选通晶体管T6在复位阶段、数据写入阶段关闭，在发光阶段开启；且如上文所示，第一复位端Reset_P和第一扫描端Gate_P的信号可以由同一移位寄存器提供，第二复位端Reset_N和第二扫描端Gate_N的信号可以由同一移位寄存器提供，因此，在显示区域的外围，只需设置两个移位寄存器即可，无需为第一选通晶体管T5和第二选通晶体管T6再单独设置一移位寄存器来提供发光控制信号，从而减少外围走线，有利于实现窄边框。
图4为本发明实施例三提供的一种像素驱动电路的示意图，该像素驱动电路是图1中结构的另一种具体化实现方式。如图3所示，数据写入模块30包括：写入晶体管T4。写入晶体管T4的栅极与第一扫描端Gate_P相连，写入晶体管T4的第一极与数据写入端相连，写入晶体管T4的第二极与驱动晶体管DTFT的第一极相连。写入晶体管T4采用低温多晶硅晶体管。
补偿模块40包括：补偿晶体管T1和补偿控制晶体管T12。补偿控制晶体管T12的栅极与第一扫描端Gate_P相连，补偿控制晶体管T12的第一极与发光控制端EM相连，补偿控制晶体管T12的第二极与补偿晶体管T1的栅极相连。补偿晶体管T1的第一极与驱动晶体管DTFT的第二极相连，补偿晶体管T1的第二极与驱动晶体管DTFT的栅极相连。
第一复位模块20包括：第二复位晶体管T2’和第三复位晶体管T3’。第三复位晶体管T3’的栅极与第一复位端Reset_P相连，第三复位晶体管T3’的第一极与发光控制端EM相连，第三复位晶体管T3’的第二极与第二复位晶体管T2’的栅极相连。第二复位晶体管T2’的第一极与驱动晶体管DTFT的栅极相连，第二复位晶体管T2’的第二极与初始化电压端Vinit相连。
第二复位模块包括：第四复位晶体管T7。该第四复位晶体管T7的栅极与第一复位端Reset_P相连，第四复位晶体管T7的第一极与初始化电压端Vinit相连，第四复位晶体管T7的第二极与发光器件10的第一端相连。
发光控制模块50包括：第三选通晶体管T5’和第四选通晶体管T6’。第三选通晶体管T5’的栅极和第四选通晶体管T6’的栅极均与发光控制端EM相连，第三选通晶体管T5’的第一极与第一电源端VDD相连，第三选通晶体管T5’的第二极与驱动晶体管DTFT的第一极相连。第四选通晶体管T6’的第一极与驱动晶体管DTFT的第二极相连，第四选通晶体管T6’的第二极与发光器件10相连。
在本实施例中，与驱动晶体管DTFT的栅极直接相连的晶体管(即，第二复位晶体管T2’和补偿晶体管T1)为氧化物晶体管，其余各晶体管均为低温多晶硅晶体管。
其中，第一复位端Reset_P在复位阶段提供的第一电平信号为控制第四复位晶体管T7开启的信号，第一扫描端Gate_P在数据写入阶段提供的信号为控制写入晶体管T4开启的信号。而在本实施例中，第四复位晶体管T7为P型晶体管，即，第一电平信号为低电平信号，第一扫描端Gate_P在数据写入阶段提供低电平信号。
图5为图4所示像素驱动电路中部分信号端的时序图，结合图4和图5所示，在复位阶段t1，发光控制端EM和第一扫描端Gate_P均提供高电平信号，第一复位端Reset_P提供低电平信号。
此时，在第一复位端Reset_P的低电平信号控制下，第三复位晶体管T3’和第四复位晶体管T7开启，从而使得发光控制端EM的高电平信号传输至第二复位晶体管T2’的栅极，以控制第二复位晶体管T2’开启，因此，初始化电压端Vinit的初始化信号通过第二复位晶体管T2’传输至驱动晶体管DTFT的栅极、并通过第四复位晶体管T7传输至发光器件10的第一端。另外，由于发光控制端EM提供高电平信号，因此，第三选通晶体管T5’和第四选通晶体管T6’均关断，不会产生驱动电流。
在数据写入阶段t2，发光控制端EM和第一复位端Reset_P均提供高电平信号，第一扫描端Gate_P提供低电平信号。
此时，第三选通晶体管T5’和第四选通晶体管T6’均保持关闭。由于第一复位端Reset_P提供高电平信号，因此，第三复位晶体管T3’、第二复位晶体管T2’和第四晶体管关闭。由于第一扫描端Gate_P提供低电平信号，因此，写入晶体管T4和补偿控制晶体管T12开启，从而使发光控制端EM的高电平信号通过补偿控制晶体管T12传输至补偿晶体管T1的栅极，以使得补偿晶体管T1开启。此时，数据写入端Data的数据信号经过补偿晶体管T1和写入晶体管T4向驱动晶体管DTFT的栅极传输，驱动晶体管DTFT的栅极电位达到Vdata+Vth。
在发光阶段t3，第一复位端Reset_P和第一扫描端Gate_P均提供高电平信号，发光控制端EM提供低电平信号。
此时，由于第一复位端Reset_P提供高电平信号，因此，第三复位晶体管T3’、第二复位晶体管T2’和写入晶体管T4关闭。并且，由于第一扫描端Gate_P提供高电平信号，因此，写入晶体管T4和补偿控制晶体管T12关闭，从而使得补偿晶体管T1关闭。同时，在发光控制端EM提供的低电平信号的控制下，第三选通晶体管T5’和第四选通晶体管T6’均开启。在电容Cst的电压保持作用下，驱动晶体管DTFT的栅极电位保持Vdata+Vth，驱动晶体管DTFT保持开启，驱动电流流入发光器件10，使发光器件10发光，驱动电流大小参见上述公式(1)。
和实施例二中相同的，第一复位端Reset_P和第一扫描端Gate_P的信号可以由同一移位寄存器提供。另外，在本实施例三中，通过设置第三复位晶体管T3’和补偿控制晶体管T12，并配合发光控制端EM的信号，能够控制第三复位晶体管T3’在复位阶段开启、控制补偿晶体管T1在数据写入阶段开启。因此，在显示区域外围，只需设置两个移位寄存器(其中一个用来为每行像素中的第一复位端Reset_P和第一扫描端Gate_P提供低电平信号；另一个用来为每行像素中的发光控制端EM提供高电平信号)即可，而无需再单独设置移位寄存器来控制像素驱动电路中的N型晶体管，从而减少外围走线，有利于实现窄边框。
可见，在本发明实施例二和实施例三提供的像素驱动电路中，虽然设置有N型晶体管和P型晶体管，但在显示区域外围，均只需要设置两个移位寄存器来提供控制信号即可，无需设置三个移位寄存器来分别控制N型晶体管、P型晶体管和第三选通晶体管T5’/第四选通晶体管T6’，从而减少外围走线，有利于实现窄边框。
本发明还提供一种上述像素驱动电路的驱动方法，包括：
在复位阶段，第一复位模块将初始化电压端的信号传输至驱动晶体管的栅极，以控制驱动晶体管开启；发光控制模块将第一电源端与驱动晶体管的第一极断开、并将驱动晶体管的第二极与发光器件断开。
在数据写入阶段，数据写入模块将数据写入端的数据信号写入驱动晶体管的第一极；补偿晶体管将驱动晶体管第二极与栅极导通。发光控制模块将第一电源端与驱动晶体管的第一极断开、并将驱动晶体管的第二极与发光器件断开。
在发光阶段，发光控制模块将第一电源端与驱动晶体管的第一极导通、并将驱动晶体管的第二极与发光器件导通。
其中，当像素驱动电路采用上述实施例二中的结构时，其驱动方法具体包括：
在复位阶段，向第一复位端和第二扫描端提供第一电平信号、并向第一扫描端和第二复位端提供第二电平信号。
其中，第二电平信号为控制第一复位晶体管和补偿晶体管开启的高电平信号；第一电平信号为控制其余各晶体管开启的低电平信号。
在数据写入阶段，向第一复位端和第二扫描端提供第二电平信号、并向第一扫描端和第二复位端提供第一电平信号。
在发光阶段，向第一复位端和第一扫描端提供第二电平信号，向第二复位端和第二扫描端提供第一电平信号。
像素驱动电路在各阶段的工作过程参见上文描述，这里不再赘述。
当像素驱动电路采用上述实施例三中的结构时，其驱动方法具体包括：
在复位阶段，向第一复位端提供第一电平信号、并向发光控制端和第一扫描端提供第二电平信号。其中，第二电平信号为控制第二复位晶体管和补偿晶体管开启的信号，第一电平信号为控制其余各晶体管开启。
在数据写入阶段，向发光控制端和第一复位端提供第二电平信号、并向第一扫描端提供第一电平信号。
在发光阶段，向发光控制端提供第一电平信号、并向第一复位端和第一扫描端提供第二电平信号。
像素驱动电路在各阶段的工作过程参见上文描述，这里不再赘述。
本发明还提供一种显示装置，包括上述任一实施例所述的像素驱动电路。具体地，显示装置包括显示面板，显示面板的显示区包括多个像素单元，每个像素单元中均设置有像素驱动电路。
在显示区外围，还设置有用于为像素驱动电路提供控制信号的移位寄存器。
其中，当像素驱动电路采用图2所示的结构时，显示区外围设置有第一移位寄存器和第二移位寄存器，第一移位寄存器包括多级第一移位寄存器单元，第二移位寄存器包括多级第二移位寄存器单元，每级第一移位寄存器单元和第二移位寄存器单元均对应一行像素单元。多级第一移位寄存器单元依次输出低电平信号，多级第二移位寄存器单元依次输出高电平信号。第n行像素单元中的像素驱动电路的第一复位端Reset_P与第n-1级第一移位寄存器单元的输出端相连，第n行像素单元中的像素驱动电路的第一扫描端Gate_P与第n级第一移位寄存器单元的输出端相连。第n行像素单元中的像素驱动电路的第二复位端Reset_N与第n-1级第二移位寄存器单元的输出端相连，第n行像素单元中的像素驱动电路的第二扫描端Gate_N与第n级第二移位寄存器单元的输出端相连。n为大于0且不大于像素单元行数的整数。
当像素驱动电路采用图3所示的结构时，显示区外围设置有上述第一移位寄存器以及第三移位寄存器，第三移位寄存器包括多级第三移位寄存器单元，每级第三移位寄存器单元均对应一行像素单元。第n行像素单元中的像素驱动电路的第一复位端Reset_P与第n-1级第一移位寄存器单元的输出端相连，第n行像素单元中的像素驱动电路的第一扫描端Gate_P与第n级第一移位寄存器单元的输出端相连。第n行像素单元中的像素驱动电路的发光控制端EM与第n级第三移位寄存器单元的输出端相连。第n级第三移位寄存器单元在第n行像素单元中的像素驱动电路复位阶段和数据写入阶段输出高电平信号。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (14)

1.一种像素驱动电路，包括驱动晶体管、电容和发光器件，所述电容的两端分别与第一电源端和所述驱动晶体管的栅极相连，其特征在于，所述像素驱动电路还包括：
第一复位模块，用于在复位阶段将初始化电压端的信号传输至所述驱动晶体管的栅极；
数据写入模块，用于在数据写入阶段将数据写入端的数据信号写入所述驱动晶体管的第一极；
阈值补偿模块，包括补偿晶体管，该补偿晶体管用于在数据写入阶段将所述驱动晶体管第二极与栅极导通；
发光控制模块，用于在数据写入阶段和复位阶段将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开；以及在发光阶段将所述第一电源端与所述驱动晶体管的第一极导通、并将所述驱动晶体管的第二极与所述发光器件导通；
其中，所述补偿晶体管为氧化物晶体管，所述驱动晶体管为低温多晶硅晶体管；
所述数据写入模块包括：写入晶体管，所述写入晶体管的栅极与第一扫描端相连，所述写入晶体管的第一极与所述数据写入端相连，所述写入晶体管的第二极与所述驱动晶体管的第一极相连；
所述补偿模块还包括：补偿控制晶体管，所述补偿控制晶体管的栅极与第一扫描端相连，所述补偿控制晶体管的第一极与发光控制端相连，所述补偿控制晶体管的第二极与所述补偿晶体管的栅极相连；
所述补偿晶体管的第一极与所述驱动晶体管的第二极相连，所述补偿晶体管的第二极与所述驱动晶体管的栅极相连。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述像素驱动电路还包括：第二复位模块，所述第二复位模块与第一复位端、所述初始化电压端和所述发光器件的第一端相连，用于在复位阶段响应于所述第一复位端提供的第一电平信号的控制，将所述初始化电压端的信号传输至所述发光器件的第一端。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述补偿晶体管的栅极与第二扫描端相连，所述补偿晶体管的第一极与所述驱动晶体管的第二极相连，所述补偿晶体管的第二极与所述驱动晶体管的栅极相连。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述第一复位模块包括：第一复位晶体管，所述第一复位晶体管的栅极与第二复位端相连，所述第一复位晶体管的第一极与所述驱动晶体管的栅极相连，所述第一复位晶体管的第二极与所述初始化电压端相连；
所述第一复位晶体管为氧化物晶体管。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述发光控制模块包括：控制单元和选通单元；
所述控制单元与所述第二复位端、所述第二扫描端和所述选通单元相连，用于在复位阶段响应于所述第二复位端提供的第二电平信号，将该第二电平信号传输至所述选通单元；以及在数据写入阶段响应于所述第二扫描端提供的第二电平信号，将该第二电平信号传输至所述选通单元；并在发光阶段响应于所述第二复位端提供的第一电平信号，将该第一电平信号传输至所述选通单元；
所述选通单元用于在所述第一电平信号的控制下，将所述第一电源端与所述驱动晶体管的第一极导通、并将所述驱动晶体管的第二极与所述发光器件导通；以及在所述第二电平信号的控制下，将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述控制单元包括：第一控制晶体管、第二控制晶体管、第三控制晶体管和第四控制晶体管；
所述第一控制晶体管的栅极和第一极均与所述第二扫描端相连，所述第一控制晶体管的第二极与所述选通单元相连；
所述第二控制晶体管的栅极和第一极均与所述第二复位端相连，所述第二控制晶体管的第二极与所述选通单元相连；
所述第三控制晶体管的栅极和第一极均与所述第二扫描端相连，所述第三控制晶体管的第二极与所述第四控制晶体管的第一极相连；所述第四控制晶体管的栅极与所述第二复位端相连，所述第四控制晶体管的第二极与所述选通单元相连。
7.根据权利要求5所述的像素驱动电路，其特征在于，所述选通单元包括：第一选通晶体管和第二选通晶体管，
所述第一选通晶体管的栅极与所述控制单元相连，所述第一选通晶体管的第一极与所述第一电源端相连，所述第一选通晶体管的第二极与所述驱动晶体管的第一极相连；
所述第二选通晶体管的栅极与所述控制单元相连，所述第二选通晶体管的第一极与所述驱动晶体管的第二极相连，所述第二选通晶体管的第二极与所述发光器件相连。
8.根据权利要求1所述的像素驱动电路，其特征在于，所述第一复位模块包括：第二复位晶体管和第三复位晶体管，
所述第三复位晶体管的栅极与第一复位端相连，所述第三复位晶体管的第一极与发光控制端相连，所述第三复位晶体管的第二极与所述第二复位晶体管的栅极相连；所述第二复位晶体管的第一极与所述驱动晶体管的栅极相连，所述第二复位晶体管的第二极与初始化电压端相连；
所述第三复位晶体管和所述第二复位晶体管均为氧化物晶体管。
9.根据权利要求8所述的像素驱动电路，其特征在于，所述发光控制模块包括：第三选通晶体管和第四选通晶体管，
所述第三选通晶体管的栅极和所述第四选通晶体管的栅极均与发光控制端相连，所述第三选通晶体管的第一极与所述第一电源端相连，所述第三选通晶体管的第二极与所述驱动晶体管的第一极相连；所述第四选通晶体管的第一极与所述驱动晶体管的第二极相连，所述第四选通晶体管的第二极与所述发光器件相连。
10.根据权利要求2所述的像素驱动电路，其特征在于，所述第二复位模块包括：第四复位晶体管，该第四复位晶体管的栅极与所述第一复位端相连，所述第四复位晶体管的第一极与所述初始化电压端相连，所述第四复位晶体管的第二极与所述发光器件的第一端相连。
11.一种如权利要求1至10中任意一项所述的像素驱动电路的驱动方法，其特征在于，包括：
在复位阶段，所述第一复位模块将所述初始化电压端的信号传输至所述驱动晶体管的栅极，以控制所述驱动晶体管开启；所述发光控制模块将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开；
在数据写入阶段，所述数据写入模块将所述数据写入端的数据信号写入所述驱动晶体管的第一极；所述补偿晶体管将所述驱动晶体管的第二极与栅极导通；所述发光控制模块将所述第一电源端与所述驱动晶体管的第一极断开、并将所述驱动晶体管的第二极与所述发光器件断开；
在发光阶段，所述发光控制模块将所述第一电源端与所述驱动晶体管的第一极导通、并将所述驱动晶体管的第二极与所述发光器件导通。
12.根据权利要求11所述的驱动方法，其特征在于，所述像素驱动电路采用权利要求5的像素驱动电路，所述驱动方法具体包括：
在复位阶段，向所述第一复位端和所述第二扫描端提供第一电平信号、并向所述第一扫描端和所述第二复位端提供第二电平信号；
在数据写入阶段，向所述第一复位端和所述第二扫描端提供第二电平信号、并向所述第一扫描端和所述第二复位端提供第一电平信号；
在发光阶段，向所述第一复位端和所述第一扫描端提供第二电平信号，向所述第二复位端和所述第二扫描端提供第一电平信号。
13.根据权利要求11所述的驱动方法，其特征在于，像素驱动电路采用权利要求9的像素驱动电路，其驱动方法具体包括：
在复位阶段，向所述第一复位端提供第一电平信号、并向所述发光控制端和所述第一扫描端提供第二电平信号；
在数据写入阶段，向所述发光控制端和所述第一复位端提供第二电平信号、并向所述第一扫描端提供第一电平信号；
在发光阶段，向所述发光控制端提供第一电平信号、并向所述第一复位端和所述第一扫描端提供第二电平信号。
14.一种显示装置，其特征在于，包括权利要求1至10中任意一项所述的像素驱动电路。
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