CN112951159B - 像素电路、像素驱动方法、显示基板和显示装置 - Google Patents

像素电路、像素驱动方法、显示基板和显示装置 Download PDF

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Abstract

本发明提供一种像素电路。像素电路包括发光元件、储能电路、驱动电路、数据写入电路、补偿控制电路、初始化电路和发光控制电路，其中，补偿控制电路在第一控制信号的控制下，控制驱动电路的控制端与驱动电路的第一端之间连通；驱动电路用于在其控制端的电位的控制下，生成驱动发光元件发光的驱动电流。本发明所述的像素电路、像素驱动方法、显示基板和显示装置能够在提升显示面板的亮度均一性的同时，减少采用的晶体管的数量，减少功耗；并能够减少采用的控制线的数量，方便布线。

Description

像素电路、像素驱动方法、显示基板和显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素电路、像素驱动方法、显示基板和显示装置。
背景技术
在相关技术中，OLED(有机发光二极管)显示平的制备容易受到工艺的不稳定、异物、温度等因素的影响，进而导致像素电路中的驱动晶体管的阈值电压发生的偏移，在正常点灯电压条件下，驱动晶体管打开的程度不均匀，这容易导致通过有机发光二极管的电流大小不一样，OLED显示屏会出现亮度不均匀的问题。相关的能够提升显示面板的亮度均一性的显示面板中的像素电路存在采用的晶体管的数量和控制线的数量多，功耗高并不方便布线的问题。
发明内容
本发明的主要目的在于提供一种像素电路、像素驱动方法、显示基板和显示装置，解决能够提升显示面板的亮度均一性的显示面板中的像素电路存在采用的晶体管的数量和控制线的数量多，功耗高并不方便布线的问题。
在一个方面中，本发明实施例提供了一种像素电路，包括发光元件、储能电路、驱动电路、数据写入电路、补偿控制电路、初始化电路和发光控制电路，其中，
所述补偿控制电路分别与第一控制线、所述驱动电路的控制端和所述驱动电路的第一端电连接，用于在所述第一控制线提供的第一控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第一端之间连通；
所述数据写入电路分别与第二控制线、所述驱动电路的第一端和数据线电连接，用于在所述第二控制线提供的第二控制信号的控制下，控制将所述数据线提供的数据电压写入所述驱动电路的第一端；
所述初始化电路分别与所述第二控制线、所述驱动电路的控制端和所述驱动电路的第二端电连接，用于在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通；
所述发光控制电路分别与所述第二控制线、第三控制线、第一电压线、所述驱动电路的第一端、所述驱动电路的第二端和发光元件的第一极电连接，用于在所述第二控制信号的控制下，控制所述第一电压线与所述驱动电路的第一端之间连通，在所述第三控制线提供的第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通；所述发光元件的第二极与第二电压线电连接；
所述储能电路的第一端与所述第一电压线电连接，所述储能电路的第二端与所述驱动电路的控制端电连接，所述储能电路用于储存电能；
所述驱动电路用于在其控制端的电位的控制下，生成驱动所述发光元件发光的驱动电流。
可选的，所述补偿控制电路包括第一晶体管；
所述第一晶体管的控制极与所述第一控制线电连接，所述第一晶体管的第一极与所述驱动电路的第一端电连接，所述第一晶体管的第二极与所述驱动电路的控制端电连接。
可选的，所述初始化电路包括第二晶体管；
所述第二晶体管的控制极与所述第二控制线电连接，所述第二晶体管的第一极与所述驱动电路的控制端电连接，所述第二晶体管的第二极与所述驱动电路的第二端电连接。
可选的，所述驱动电路包括第三晶体管，所述数据写入电路包括第四晶体管；所述储能电路包括存储电容；
所述第三晶体管的控制极为所述驱动电路的控制端，所述第三晶体管的第一极为所述驱动电路的第一端，所述第三晶体管的第二极为所述驱动电路的第二端；
所述第四晶体管的控制极与所述第二控制线电连接，所述第四晶体管的第一极与所述数据线电连接，所述第四晶体管的第二极与所述第三晶体管的第一极电连接；
所述存储电容的第一极板与所述第一电压线电连接，所述存储电容的第二极板与所述驱动电路的控制端电连接。
可选的，所述发光控制电路包括第五晶体管和第六晶体管；
所述第五晶体管的控制极与所述第二控制线电连接，所述第五晶体管的第一极与所述第一电压线电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述第三控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接。
可选的，所述发光元件为有机发光二极管；所述发光元件的第一极为所述有机发光二极管的阳极，所述发光元件的第二极为所述有机发光二极管的阴极。
可选的，所述补偿控制电路包括第一晶体管；
所述第一晶体管的控制极与所述第一控制线电连接，所述第一晶体管的第一极与所述驱动电路的第一端电连接，所述第一晶体管的第二极与所述驱动电路的控制端电连接；
所述初始化电路包括第二晶体管；
所述第二晶体管的控制极与所述第二控制线电连接，所述第二晶体管的第一极与所述驱动电路的控制端电连接，所述第二晶体管的第二极与所述驱动电路的第二端电连接；
所述驱动电路包括第三晶体管，所述数据写入电路包括第四晶体管；所述储能电路包括存储电容；
所述第三晶体管的控制极为所述驱动电路的控制端，所述第三晶体管的第一极为所述驱动电路的第一端，所述第三晶体管的第二极为所述驱动电路的第二端；
所述第四晶体管的控制极与所述第二控制线电连接，所述第四晶体管的第一极与所述数据线电连接，所述第四晶体管的第二极与所述第三晶体管的第一极电连接；
所述存储电容的第一极板与所述第一电压线电连接，所述存储电容的第二极板与所述驱动电路的控制端电连接；
所述发光控制电路包括第五晶体管和第六晶体管；
所述第五晶体管的控制极与所述第二控制线电连接，所述第五晶体管的第一极与所述第一电压线电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述第三控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接；
所述第一晶体管、所述第二晶体管和所述第四晶体管为n型氧化物晶体管，所述第三晶体管、所述第五晶体管和所述第六晶体管为p型低温多晶硅晶体管。
在第二个方面中，本发明实施例提供了一种像素驱动方法，应用于上述的像素电路，显示周期包括依次设置的初始化阶段、写入阶段和发光阶段，所述像素驱动方法包括：
在初始化阶段，数据线提供初始化电压，数据写入电路在第二控制信号的控制下，将所述初始化电压写入驱动电路的第一端，补偿控制电路在第一控制信号的控制下，控制所述驱动电路的第一端与所述驱动电路的控制端之间连通，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通，所述发光控制电路在第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通，以控制对发光元件的第一极和驱动电路的控制端进行初始化，以清除所述发光元件的第一极残留的电荷，并使得在写入阶段开始时，所述驱动电路能够导通其第一端与所述驱动电路的第二端之间的连接；
在写入阶段，数据线提供数据电压，数据写入电路在第二控制信号的控制下，将所述数据电压写入驱动电路的第一端，补偿控制电路在第一控制信号的控制下，控制所述驱动电路的第一端与所述驱动电路的控制端之间断开，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通，驱动电路在其控制端的电位的控制下，导通所述驱动电路的第一端与所述驱动电路的第二端之间的连接，以通过所述数据电压为储能电路充电，以改变驱动电路的控制端的电位，直至所述驱动电路在其控制端的控制下，断开所述驱动电路的第一端与所述驱动电路的第二端之间的连接；
在发光阶段，数据写入电路在第二控制信号的控制下，将所述数据线与所述驱动电路的第一端之间断开，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间断开，所述发光控制电路在所述第二控制信号的控制下，控制第一电压线与所述驱动电路的第一端之间连通，所述发光控制电路在第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通，驱动电路在其控制端的电位的控制下，生成驱动所述发光元件发光的驱动电流，以驱动所述发光元件发光。
在第三个方面中，本发明实施例提供了一种显示基板，包括基底，所述显示基板还包括阵列设置于所述基底上的多个上述的像素电路；所述像素电路还包括第一控制线、第二控制线、第三控制线、数据线和第一电压线；
所述第一电压线的至少部分沿第一方向延伸，所述数据线的至少部分沿第一方向延伸；
所述第一控制线的至少部分沿第二方向延伸，所述第二控制线的至少部分沿第二方向延伸，所述第三控制线的至少部分沿第二方向延伸；
所述第二控制线设置于所述第一控制线与所述第三控制线之间；
所述第一方向和所述第二方向相交。
可选的，所述像素电路中的补偿控制电路包括第一晶体管；所述像素电路中的初始化电路包括第二晶体管，所述像素电路中的驱动电路包括第三晶体管，所述像素电路中的数据写入电路包括第四晶体管；所述像素电路中的储能电路包括存储电容；所述像素电路中的发光控制电路包括第五晶体管和第六晶体管；
所述存储电容包括相对设置的第一极板和第二极板；所述第二极板位于所述第一极板和所述基底之间；
所述第三晶体管的源极、所述第五晶体管的源极、所述第三晶体管的漏极、所述第六晶体管的源极和所述第六晶体管的漏极同层同材料设置；所述第三晶体管的源极复用为所述第五晶体管的漏极；
所述第一晶体管的源极、所述第一晶体管的漏极、所述第二晶体管的源极、所述第四晶体管的源极和所述第四晶体管的漏极同层同材料设置；所述第一晶体管的源极复用为所述第二晶体管的漏极；
所述第三晶体管的源极位于所述基底与所述第二极板之间，所述第一晶体管的源极位于所述第一极板远离所述第二极板的一侧。
在第四个方面中，本发明实施例还提供了一种显示装置，包括上述的显示基板。
本发明实施例所述的像素电路、像素驱动方法、显示基板和显示装置能够在提升显示面板的亮度均一性的同时，减少采用的晶体管的数量，减少功耗；并能够减少采用的控制线的数量，方便布线。
附图说明
图1是本发明实施例所述的像素电路的结构图；
图2是本发明至少一实施例所述的像素电路的电路图；
图3A是本发明如图2所示的像素电路的至少一实施例的工作时序图；
图3B是本发明如图2所示的像素电路的至少一实施例的仿真工作时序图；
图3C是在本发明如图2所示的像素电路的至少一实施例工作时，当第三晶体管T3的阈值电压为-3V时，数据电压Vd在3V至5.5V的条件下，在发光阶段J3流过O1的电流I1的示意图；
图3D为第一曲线B1，第二曲线B2，第三曲线B3的示意图；
图4是本发明如图2所示的像素电路的至少一实施例在初始化阶段的工作状态示意图；
图5是本发明如图2所示的像素电路的至少一实施例在写入阶段的工作状态示意图；
图6是本发明如图2所示的像素电路的至少一实施例在发光阶段的工作状态示意图；
图7是图2所示的像素电路的至少一实施例的基础上，对各晶体管的电极，以及存储电容的极板进行编号的示意图；
图8为本发明实施例所述的像素电路的一种布局示意图；
图9是图8中的第一有源层的示意图；
图10是图8中的第一栅金属层的示意图；
图11是图8中的第二栅金属层的示意图；
图12是图8中的第二有源层的示意图；
图13是图8中的过孔示意图(在图13中，未设置有源漏金属层)；
图14是图8中的源漏金属层的示意图。
图15是在图8所示的至少一实施例的基础上增加了阳极O11的示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
如图1所示，本发明实施例所述的像素电路包括发光元件E1、储能电路11、驱动电路12、数据写入电路13、补偿控制电路14、初始化电路15和发光控制电路16，其中，
所述补偿控制电路14分别与第一控制线R1、所述驱动电路12的控制端和所述驱动电路12的第一端电连接，用于在所述第一控制线R1提供的第一控制信号的控制下，控制所述驱动电路12的控制端与所述驱动电路12的第一端之间连通；
所述数据写入电路13分别与第二控制线R2、所述驱动电路12的第一端和数据线A1电连接，用于在所述第二控制线R2提供的第二控制信号的控制下，控制将所述数据线A1提供的数据电压写入所述驱动电路12的第一端；
所述初始化电路15分别与所述第二控制线R2、所述驱动电路12的控制端和所述驱动电路12的第二端电连接，用于在所述第二控制信号的控制下，控制所述驱动电路12的控制端与所述驱动电路12的第二端之间连通；
所述发光控制电路16分别与所述第二控制线R2、第三控制线R3、第一电压线V1、所述驱动电路12的第一端、所述驱动电路12的第二端和发光元件E1的第一极电连接，用于在所述第二控制信号的控制下，控制所述第一电压线V1与所述驱动电路12的第一端之间连通，在所述第三控制线R3提供的第三控制信号的控制下，控制所述驱动电路12的第二端与所述发光元件E1的第一极之间连通；所述发光元件的第二极E1与第二电压线V2电连接；
所述储能电路11的第一端与所述第一电压线V1电连接，所述储能电路11的第二端与所述驱动电路12的控制端电连接，所述储能电路11用于储存电能；
所述驱动电路12用于在其控制端的电位的控制下，生成驱动所述发光元件E1发光的驱动电流。
本发明实施例所述的像素电路能够减少采用的晶体管的数量，减少功耗；并能够减少采用的控制线的数量，方便布线。
本发明实施例所述的像素电路能够通过内部补偿的方式，避免驱动电路包括的驱动晶体管的阈值电压偏移对显示面板亮度均一性的影响，并能够通过对发光元件的第一极和驱动电路的控制端进行初始化，以能够清除所述发光元件的第一极残留的电荷。
本发明实施例所述的像素电路在工作时，显示周期可以包括依次设置的初始化阶段、写入阶段和发光阶段；
在初始化阶段，数据线A1提供初始化电压，数据写入电路13在第二控制信号的控制下，将所述初始化电压写入驱动电路12的第一端，补偿控制电路14在第一控制信号的控制下，控制所述驱动电路12的第一端与所述驱动电路的控制端12之间连通，初始化电路15在所述第二控制信号的控制下，控制所述驱动电路12的控制端与所述驱动电路12的第二端之间连通，所述发光控制电路16在第三控制信号的控制下，控制所述驱动电路12的第二端与所述发光元件E1的第一极之间连通，以控制对发光元件E1的第一极和驱动电路12的控制端进行初始化，以清除所述发光元件E1的第一极残留的电荷，并使得在写入阶段开始时，所述驱动电路12能够导通其第一端与所述驱动电路12的第二端之间的连接；
在写入阶段，数据线A1提供数据电压，数据写入电路13在第二控制信号的控制下，将所述数据电压写入驱动电路12的第一端，补偿控制电路14在第一控制信号的控制下，控制所述驱动电路12的第一端与所述驱动电路12的控制端之间断开，初始化电路15在所述第二控制信号的控制下，控制所述驱动电路12的控制端与所述驱动电路12的第二端之间连通，驱动电路12在其控制端的电位的控制下，导通所述驱动电路12的第一端与所述驱动电路12的第二端之间的连接，以通过所述数据电压为储能电路充电，以改变驱动电路12的控制端的电位，直至所述驱动电路12在其控制端的控制下，断开所述驱动电路12的第一端与所述驱动电路12的第二端之间的连接，从而使得所述驱动电路12的控制端的电位与所述驱动电路12包括的驱动晶体管的阈值电压相关，进而在发光阶段使得驱动E1发光的驱动电流与驱动晶体管的阈值电压无关；
在发光阶段，数据写入电路13在第二控制信号的控制下，将所述数据线A1与所述驱动电路12的第一端之间断开，初始化电路15在所述第二控制信号的控制下，控制所述驱动电路12的控制端与所述驱动电路12的第二端之间断开，所述发光控制电路16在所述第二控制信号的控制下，控制第一电压线V1与所述驱动电路12的第一端之间连通，所述发光控制电路16在第三控制信号的控制下，控制所述驱动电路12的第二端与所述发光元件E1的第一极之间连通，驱动电路12在其控制端的电位的控制下，生成驱动所述发光元件E1发光的驱动电流，以驱动所述发光元件E1发光。
在相关技术中，显示面板的亮度均一性与驱动晶体管的阈值电压偏移、发光后发光元件E1的第一极残留的电荷等相关，本发明实施例所述的像素电路能够避免驱动电路包括的驱动晶体管的阈值电压偏移对显示面板亮度均一性的影响，并能够在初始化阶段清除所述发光元件的第一极残留的电荷，从而提升显示面板亮度均一性。
在本发明至少一实施例中，第一电压线可以为高电压线，所述第二电压线可以为低电压线。
可选的，所述补偿控制电路包括第一晶体管；
所述第一晶体管的控制极与所述第一控制线电连接，所述第一晶体管的第一极与所述驱动电路的第一端电连接，所述第一晶体管的第二极与所述驱动电路的控制端电连接。
可选的，所述初始化电路包括第二晶体管；
所述第二晶体管的控制极与所述第二控制线电连接，所述第二晶体管的第一极与所述驱动电路的控制端电连接，所述第二晶体管的第二极与所述驱动电路的第二端电连接。
在本发明至少一实施例中，所述驱动电路可以包括第三晶体管，所述数据写入电路可以包括第四晶体管；所述储能电路可以包括存储电容；
所述第三晶体管的控制极为所述驱动电路的控制端，所述第三晶体管的第一极为所述驱动电路的第一端，所述第三晶体管的第二极为所述驱动电路的第二端；
所述第四晶体管的控制极与所述第二控制线电连接，所述第四晶体管的第一极与所述数据线电连接，所述第四晶体管的第二极与所述第三晶体管的第一极电连接；
所述存储电容的第一极板与所述第一电压线电连接，所述存储电容的第二极板与所述驱动电路的控制端电连接。
可选的，所述发光控制电路包括第五晶体管和第六晶体管；
所述第五晶体管的控制极与所述第二控制线电连接，所述第五晶体管的第一极与所述第一电压线电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述第三控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接。
可选的，所述发光元件可以为有机发光二极管；所述发光元件的第一极为所述有机发光二极管的阳极，所述发光元件的第二极为所述有机发光二极管的阴极。
在具体实施时，所述发光元件可以为OLED(有机发光二极管)，此时，发光元件的第一极为OLED的阳极，发光元件的第二极为OLED的阴极。
在本发明至少一实施例中，所述补偿控制电路包括第一晶体管；
所述第一晶体管的控制极与所述第一控制线电连接，所述第一晶体管的第一极与所述驱动电路的第一端电连接，所述第一晶体管的第二极与所述驱动电路的控制端电连接；
所述初始化电路包括第二晶体管；
所述第二晶体管的控制极与所述第二控制线电连接，所述第二晶体管的第一极与所述驱动电路的控制端电连接，所述第二晶体管的第二极与所述驱动电路的第二端电连接；
所述驱动电路包括第三晶体管，所述数据写入电路包括第四晶体管；所述储能电路包括存储电容；
所述第三晶体管的控制极为所述驱动电路的控制端，所述第三晶体管的第一极为所述驱动电路的第一端，所述第三晶体管的第二极为所述驱动电路的第二端；
所述第四晶体管的控制极与所述第二控制线电连接，所述第四晶体管的第一极与所述数据线电连接，所述第四晶体管的第二极与所述第三晶体管的第一极电连接；
所述存储电容的第一极板与所述第一电压线电连接，所述存储电容的第二极板与所述驱动电路的控制端电连接；
所述发光控制电路包括第五晶体管和第六晶体管；
所述第五晶体管的控制极与所述第二控制线电连接，所述第五晶体管的第一极与所述第一电压线电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述第三控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接；
所述第一晶体管、所述第二晶体管和所述第四晶体管为n型氧化物晶体管，所述第三晶体管、所述第五晶体管和所述第六晶体管为p型低温多晶硅晶体管。
如图2所示，在图1所示的像素电路的实施例的基础上，所述补偿控制电路14包括第一晶体管T1；所述初始化电路15包括第二晶体管T2；所述驱动电路12包括第三晶体管T3，所述数据写入电路13包括第四晶体管T4；所述储能电路11包括存储电容C1；所述发光控制电路包括第五晶体管T5和第六晶体管T6；发光元件为有机发光二极管O1；
所述第一晶体管T1的栅极与所述第一控制线R1电连接，所述第一晶体管T1的漏极与所述驱动晶体管T3的源极电连接，所述第一晶体管T1的源极与所述驱动晶体管T3的栅极电连接；
所述第二晶体管T2的栅极与所述第二控制线R2电连接，所述第二晶体管T2的漏极与所述驱动晶体管T3的栅极电连接，所述第二晶体管T2的源极与所述驱动晶体管T3的漏极电连接；
所述第三晶体管T3的栅极为所述驱动电路12的控制端，所述第三晶体管T3的源极为所述驱动电路12的第一端，所述第三晶体管T3的漏极为所述驱动电路12的第二端；
所述第四晶体管T4的栅极与所述第二控制线R2电连接，所述第四晶体管T4的漏极与所述数据线A1电连接，所述第四晶体管T4的源极与所述第三晶体管T3的源极电连接；
所述存储电容C1的第一极板与高电压线V01电连接，所述存储电容C1的第二极板与所述驱动晶体管T3的栅极电连接；所述高电压线V01用于提供高电压信号；
所述第五晶体管T5的栅极与所述第二控制线R2电连接，所述第五晶体管T5的源极与所述高电压线V01电连接，所述第五晶体管T5的漏极与所述驱动晶体管T3的源极电连接；
所述第六晶体管T6的栅极与所述第三控制线R3电连接，所述第六晶体管T6的源极与所述驱动晶体管T3的漏极电连接，所述第六晶体管T6的漏极与有机发光二极管O1的阳极电连接；
所述有机发光二极管O1的阴极与低电压线V02电连接；所述低电压线V02用于提供低电压信号。
在图2所示的像素电路的至少一实施例中，T1、T2和T4都为NMOS管(N型金属-氧化物-半导体晶体管)，T3、T5和T6都为PMOS管(P型金属-氧化物-半导体晶体管)，但不以此为限。
在图2所示的像素电路的至少一实施例中，第一节点A为与T3的栅极电连接的节点，第二节点B为与T3的源极电连接的节点。
如图3A所示，本发明如图2所示的像素电路的至少一实施例在工作时，显示周期可以包括依次设置的初始化阶段J1、写入阶段J2和发光阶段J3；
在初始化阶段J1，数据线A1提供初始化电压Vi(所述初始化电压Vi为低电压信号)，以对T3的栅极、C1的第二极板和O1的阳极复位，R1和R2提供高电压信号，R3提供低电压信号，如图4所示，T1、T2、T4和T6处于导通状态，T5处于关闭状态，将Vi写入第一节点A，同时消除O1的阳极残留的正电荷，第二节点B的电位为Vi；
在写入阶段J2，R1输入低电压信号，R2和R3均写入高电压信号，如图5所示，使得T2和T4处于导通状态，T1、T5和T6处于关闭状态，数据线A1提供数据电压Vd，通过Vd对第一节点A进行充电，直到第一节点A的电位为Vd+Vth，T3断开，第二节点B的电位为Vd，此时将T3关闭置于OFF-Bais(关闭偏压)状态，可以有效改善显示屏幕mura(显示亮度不均匀)的问题；
在发光阶段J3，R1、R2和R3输入低电压信号，如图6所示，T5和T6处于导通状态，T1、T2和T4处于关闭状态，第一节点A的电压为Vd+Vth，第二节点B的电位为V01，通过O1的电流I等于0.5K(Vd-V01)2，I与Vth无关；其中，Vth为T3的阈值电压。
图3B是图2所示的像素电路的至少一实施例仿真工作时序图。在图3B中，标号为V(A)的为T3的栅极的电位，I1为流过O1的电流。
图3C是当第三晶体管T3的阈值电压为-3V时，数据电压Vd在3V至5.5V的条件下，在发光阶段J3流过O1的电流I1的示意图；
当T3的阈值电压分别为0V、-2V和-2.5V时，数据电压Vd在3V至5.5V的条件下，在发光阶段J3流过O1的电流I1的示意图与图3C中的示意图近似重合，也即，I1受Vth漂移的影响小。
在图3C中，横轴为数据电压Vd，单位为V(伏)，纵轴为I1，单位为nA(纳安)。
在图3D中，标号为B1的为第一曲线，标号为B2的为第二曲线，标号为B3的为第三曲线；
第一曲线B1为：当数据电压为3.5V时，在发光阶段J3流过O1的电流I1与T3的阈值电压Vth之间的关系示意图；
第二曲线B2为：当数据电压为4.5V，在发光阶段J3流过O1的电流I1与T3的阈值电压Vth之间的关系示意图；
第三曲线B3为：当数据电压为5.5V，在发光阶段J3流过O1的电流I1与T3的阈值电压Vth之间的关系示意图；
由B1、B2和B3可知，当数据电压为各值时，在第三晶体管T3的阈值电压为不同值时，I1的电流最大波动在0.25％范围内。
在图3D中，横轴为T3的阈值电压Vth，单位为V(伏)，纵轴为I1，单位为nA(纳安)。
本发明实施例所述的像素驱动方法，应用于上述的像素电路，显示周期包括依次设置的初始化阶段、写入阶段和发光阶段，所述像素驱动方法包括：
在初始化阶段，数据线提供初始化电压，数据写入电路在第二控制信号的控制下，将所述初始化电压写入驱动电路的第一端，补偿控制电路在第一控制信号的控制下，控制所述驱动电路的第一端与所述驱动电路的控制端之间连通，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通，所述发光控制电路在第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通，以控制对发光元件的第一极和驱动电路的控制端进行初始化，以清除所述发光元件的第一极残留的电荷，并使得在写入阶段开始时，所述驱动电路能够导通其第一端与所述驱动电路的第二端之间的连接；
在写入阶段，数据线提供数据电压，数据写入电路在第二控制信号的控制下，将所述数据电压写入驱动电路的第一端，补偿控制电路在第一控制信号的控制下，控制所述驱动电路的第一端与所述驱动电路的控制端之间断开，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通，驱动电路在其控制端的电位的控制下，导通所述驱动电路的第一端与所述驱动电路的第二端之间的连接，以通过所述数据电压为储能电路充电，以改变驱动电路的控制端的电位，直至所述驱动电路在其控制端的控制下，断开所述驱动电路的第一端与所述驱动电路的第二端之间的连接；
在发光阶段，数据写入电路在第二控制信号的控制下，将所述数据线与所述驱动电路的第一端之间断开，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间断开，所述发光控制电路在所述第二控制信号的控制下，控制第一电压线与所述驱动电路的第一端之间连通，所述发光控制电路在第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通，驱动电路在其控制端的电位的控制下，生成驱动所述发光元件发光的驱动电流，以驱动所述发光元件发光。
本发明实施例所述的像素驱动方法能够通过内部补偿的方式，避免驱动电路包括的驱动晶体管的阈值电压偏移对显示面板亮度均一性的影响，并能够通过对发光元件的第一极和驱动电路的控制端进行初始化，以能够清除所述发光元件的第一极残留的电荷。
如图7所示，在图2所示的像素电路的实施例的基础上，对各晶体管的电极，以及存储电容的极板进行编号；
在图7中，标号为G1的为T1的栅极，标号为S1的为T1的源极，标号为D1的为T1的漏极；标号为G2的为T2的栅极，标号为S2的为T2的源极，标号为D2的为T2的漏极；标号为G3的为T3的栅极，标号为S3的为T3的源极，标号为D3的为T3的漏极；标号为G4的为T4的栅极，标号为S4的为T4的源极，标号为D4的为T4的漏极；标号为G5的为T5的栅极，标号为S5的为T5的源极，标号为D5的为T5的漏极；标号为G6的为T6的栅极，标号为S6的为T6的源极，标号为D6的为T6的漏极；标号为C1a的为C1的第一极板，标号为C1b的为C1的第二极板。
图8示出了本发明实施例所述的像素电路的一种布局示意图；图9是图8中的第一有源层的示意图，图10是图8中的第一栅金属层的示意图，图11是图8中的第二栅金属层的示意图，图12是图8中的第二有源层的示意图，图13是图8中的过孔示意图(在图13中，未设置有源漏金属层)，图14是图8中的源漏金属层的示意图。
在图8中，标号为R1的为第一控制线，标号为R2的为第二控制线，标号为R3的为第三控制线，标号为V01的为高电压线，标号为A1的为数据线。
在具体实施时，在基底上可以依次设置有第一有源层、第一栅金属层、第二栅金属层、源漏金属层和阳极层，以形成显示基板。
在本发明至少一实施例中，所述像素电路可以包括多个晶体管；每个晶体管的沟道部分两侧的导电部分，可以分别对应作为该晶体管的第一电极和第二电极，或者可以分别与该晶体管的第一电极和该晶体管的第二电极耦接。
在图7-图14所示的至少一实施例中，所述第一电压线为高电压线V01。
如图14所示，数据线A1与所述高电压线V01都形成于源漏金属层，并A1和V01都沿第一方向延伸(在图7-图14所示的至少一实施例中，第一方向可以为竖直方向)。
如图10所示，所述第一控制线R1、所述第二控制线R2、所述第三控制线R3和C1的第二极板C1b都形成于第一栅金属层；
R2设置于R1与R3之间；
R2包括沿第二方向延伸的第一控制线部分R21、沿第二方向延伸的第二控制线部分R22和连接部R0；R21通过R0与R22电连接；
R1、R3、R21和R22都沿第二方向延伸(在图7-图14所示的至少一实施例中，第二方向可以为水平方向)，R0沿第一方向延伸；
C1b设置于R21与R22之间；C1b复用为T3的栅极；
在图10中，标号为G1的为T1的栅极，标号为G2的为T2的栅极，标示为G4的为T4的栅极，标号为G5的为T5的栅极，标号为G6的为T6的栅极；
G1可以与R1形成为一体结构，G2和G4可以与R21形成为一体结构，G5可以与R22形成为一体结构，G6可以与R3形成为一体结构。
在图9中，标号为S5的为T5的源极；标示为S3的为T3的源极，标示为D3的为T3的漏极；T3的源极S3复用为T5的漏极；
标示为S6的为T6的源极，标号为D6的为T6的漏极。
如图9所示，所述第三晶体管的源极S3、所述第五晶体管的源极S5、所述第三晶体管的漏极D3、所述第六晶体管的源极S6和所述第六晶体管的漏极D6同层同材料设置；所述第三晶体管的源极S3复用为所述第五晶体管的漏极。
在图11中，标号为C1a的为C1的第一极板，在C1a中设置有一开口，便于C1b通过该开口与T1的源极S1电连接；
C1a与C1b相对设置。
在图12中，标示为S1的为T1的源极，标号为D1的为T1的漏极；S1复用为T2的漏极，标号为S2的为T2的源极；标号为D4的为T4的漏极，标号为S4的T4的源极。
如图12所示，所述第一晶体管的源极S1、所述第一晶体管的漏极D1、所述第二晶体管的源极S2、所述第四晶体管的源极S4和所述第四晶体管的漏极D4同层同材料设置；所述第一晶体管的源极S1复用为所述第二晶体管的漏极。
在图13中，标号为H1的为第一过孔，标号为H2的为第二过孔，标号为H3的为第三过孔，标号为H4的为第四过孔，标号为H5的为第五过孔，标号为H6的为第六过孔，标号为H7的为第七过孔，标号为H8的为第八过孔，标号为H9的为第九过孔，标号为H10的为第十过孔，标号为H11的为第十一过孔，标号为H12的为第十二过孔，标号为H13的为第十三过孔，标号为H14的为第十四过孔，标号为H15的为第十五过孔。
在图14中，标号为A1的为数据线，标号为V01的为高电压线，标号为L1的为第一连接导电部，标号为L2的为第二连接导电部，标号为L3的为第三连接导电部，标示为L4的为第四连接导电部，标号为L5的为第五连接导电部，标号为L6的为第六连接导电部。
如图8-图14所示，D1通过过孔与D4电连接；S1通过过孔与L3电连接，L3通过过孔与C1b电连接，以使得S1与C1b电连接；
C1a通过过孔与高电压线V01电连接；
S1复用为T2的漏极；S2通过过孔与L4电连接，L4通过过孔与D3电连接，以使得S2与D3电连接；
S4通过过孔与数据线A1电连接，D4通过过孔与L1电连接，L1通过过孔与S3电连接，以使得S3与D4电连接；
S5通过过孔与高电压线V01电连接；
T6的源极S6通过过孔与L5电连接，L5通过过孔与D3电连接，以使得S6与D3电连接；
D6通过过孔与L6电连接。
在如图8-图14所示的至少一实施例中，第一有源层可以采用P-Si(低温多晶硅)材料制成，第二有源层可以采用IGZO(Indium Gallium Zinc Oxide，铟镓锌氧化物)材料制成。
如图15所示，在图8所示的至少一实施例的基础上，增加了阳极O11，O11通过连接过孔H0与L6电连接，以使得O11与D6电连接。
在本发明至少一实施例中，O11设置于A1远离基底的一侧，O11形成于阳极层，所述阳极层与所述源漏金属层之间可以设置有平坦层，H0可以为贯穿所述平坦层的连接过孔。
本发明实施例所述的显示基板包括基底，所述显示基板还包括阵列设置于所述基底上的多个上述的像素电路；所述像素电路还包括第一控制线、第二控制线、第三控制线、数据线和第一电压线；
所述第一电压线的至少部分沿第一方向延伸，所述数据线的至少部分沿第一方向延伸；
所述第一控制线的至少部分沿第二方向延伸，所述第二控制线的至少部分沿第二方向延伸，所述第三控制线的至少部分沿第二方向延伸；
所述第二控制线设置于所述第一控制线与所述第三控制线之间；
所述第一方向和所述第二方向相交。
示例性的，所述多个像素电路可以在所述基底上呈阵列分布，所述多个像素电路能够划分为沿第一方向排列的多行像素电路，每行像素电路均包括沿第二方向排列的多个像素电路；所述多个像素电路能够划分为沿第二方向排列的多列像素电路，每列像素电路均包括沿第一方向排列的多个像素电路。
示例性的，在同一列像素电路中，各像素电路包括的第一电压线可以依次耦接，形成为一体结构；在同一列像素电路中，各像素电路包括的数据线可以依次耦接，形成为一体结构。
示例性的，在同一行像素电路中，各像素电路包括的第一控制线可以依次耦接，形成为一体结构；在同一行像素电路中，各像素电路包括的第二控制线可以依次耦接，形成为一体结构；在同一行像素电路中，各像素电路包括的第三控制线可以依次耦接，形成为一体结构。
可选的，所述像素电路中的补偿控制电路包括第一晶体管；所述像素电路中的初始化电路包括第二晶体管，所述像素电路中的驱动电路包括第三晶体管，所述像素电路中的数据写入电路包括第四晶体管；所述像素电路中的储能电路包括存储电容；所述像素电路中的发光控制电路包括第五晶体管和第六晶体管；
所述存储电容包括相对设置的第一极板和第二极板；所述第二极板位于所述第一极板和所述基底之间；
所述第三晶体管的源极、所述第五晶体管的源极、所述第三晶体管的漏极、所述第六晶体管的源极和所述第六晶体管的漏极同层同材料设置；所述第三晶体管的源极复用为所述第五晶体管的漏极；
所述第一晶体管的源极、所述第一晶体管的漏极、所述第二晶体管的源极、所述第四晶体管的源极和所述第四晶体管的漏极同层同材料设置；所述第一晶体管的源极复用为所述第二晶体管的漏极；
所述第三晶体管的源极位于所述基底与所述第二极板之间，所述第一晶体管的源极位于所述第一极板远离所述第二极板的一侧。
在本发明至少一实施例中，所述第三晶体管的源极、所述第五晶体管的源极、所述第三晶体管的漏极、所述第六晶体管的源极和所述第六晶体管的漏极可以都形成于第一有源层，所述第一晶体管的源极、所述第一晶体管的漏极、所述第二晶体管的源极、所述第四晶体管的源极和所述第四晶体管的漏极可以都形成于第二有源层，第一有源层可以采用P-Si(低温多晶硅)材料制成，第二有源层可以采用IGZO(Indium Gallium Zinc Oxide，铟镓锌氧化物)材料制成。
本发明实施例所述的显示装置包括上述的显示基板。
本发明实施例所提供的显示装置可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
以上所述是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本发明所述原理的前提下，还可以作出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (10)

1.一种像素电路，其特征在于，包括发光元件、储能电路、驱动电路、数据写入电路、补偿控制电路、初始化电路和发光控制电路，其中，显示周期包括依次设置的初始化阶段、写入阶段和发光阶段；
所述补偿控制电路分别与第一控制线、所述驱动电路的控制端和所述驱动电路的第一端电连接，用于在所述第一控制线提供的第一控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第一端之间连通；
所述数据写入电路分别与第二控制线、所述驱动电路的第一端和数据线电连接，用于在所述第二控制线提供的第二控制信号的控制下，控制将所述数据线提供的数据电压写入所述驱动电路的第一端；
所述初始化电路分别与所述第二控制线、所述驱动电路的控制端和所述驱动电路的第二端电连接，用于在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通；
所述发光控制电路分别与所述第二控制线、第三控制线、第一电压线、所述驱动电路的第一端、所述驱动电路的第二端和发光元件的第一极电连接，用于在所述第二控制信号的控制下，控制所述第一电压线与所述驱动电路的第一端之间连通，在所述第三控制线提供的第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通；所述发光元件的第二极与第二电压线电连接；
所述储能电路的第一端与所述第一电压线电连接，所述储能电路的第二端与所述驱动电路的控制端电连接，所述储能电路用于储存电能；
所述驱动电路用于在其控制端的电位的控制下，生成驱动所述发光元件发光的驱动电流；
所述补偿控制电路包括第一晶体管；
所述第一晶体管的控制极与所述第一控制线电连接，所述第一晶体管的第一极与所述驱动电路的第一端电连接，所述第一晶体管的第二极与所述驱动电路的控制端电连接；
所述初始化电路包括第二晶体管；
所述第二晶体管的控制极与所述第二控制线电连接，所述第二晶体管的第一极与所述驱动电路的控制端电连接，所述第二晶体管的第二极与所述驱动电路的第二端电连接；
所述驱动电路包括第三晶体管，所述数据写入电路包括第四晶体管；所述储能电路包括存储电容；
所述第三晶体管的控制极为所述驱动电路的控制端，所述第三晶体管的第一极为所述驱动电路的第一端，所述第三晶体管的第二极为所述驱动电路的第二端；
所述第四晶体管的控制极与所述第二控制线电连接，所述第四晶体管的第一极与所述数据线电连接，所述第四晶体管的第二极与所述第三晶体管的第一极电连接；
所述存储电容的第一极板与所述第一电压线电连接，所述存储电容的第二极板与所述驱动电路的控制端电连接；
所述发光控制电路包括第五晶体管和第六晶体管；
所述第五晶体管的控制极与所述第二控制线电连接，所述第五晶体管的第一极与所述第一电压线电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述第三控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接；
所述第一晶体管、所述第二晶体管和所述第四晶体管为n型氧化物晶体管，所述第三晶体管、所述第五晶体管和所述第六晶体管为p型低温多晶硅晶体管。
2.如权利要求1所述的像素电路，其特征在于，所述补偿控制电路包括第一晶体管；
所述第一晶体管的控制极与所述第一控制线电连接，所述第一晶体管的第一极与所述驱动电路的第一端电连接，所述第一晶体管的第二极与所述驱动电路的控制端电连接。
3.如权利要求1所述的像素电路，其特征在于，所述初始化电路包括第二晶体管；
所述第二晶体管的控制极与所述第二控制线电连接，所述第二晶体管的第一极与所述驱动电路的控制端电连接，所述第二晶体管的第二极与所述驱动电路的第二端电连接。
4.如权利要求1所述的像素电路，其特征在于，所述驱动电路包括第三晶体管，所述数据写入电路包括第四晶体管；所述储能电路包括存储电容；
所述第三晶体管的控制极为所述驱动电路的控制端，所述第三晶体管的第一极为所述驱动电路的第一端，所述第三晶体管的第二极为所述驱动电路的第二端；
所述第四晶体管的控制极与所述第二控制线电连接，所述第四晶体管的第一极与所述数据线电连接，所述第四晶体管的第二极与所述第三晶体管的第一极电连接；
所述存储电容的第一极板与所述第一电压线电连接，所述存储电容的第二极板与所述驱动电路的控制端电连接。
5.如权利要求1所述的像素电路，其特征在于，所述发光控制电路包括第五晶体管和第六晶体管；
所述第五晶体管的控制极与所述第二控制线电连接，所述第五晶体管的第一极与所述第一电压线电连接，所述第五晶体管的第二极与所述驱动电路的第一端电连接；
所述第六晶体管的控制极与所述第三控制线电连接，所述第六晶体管的第一极与所述驱动电路的第二端电连接，所述第六晶体管的第二极与所述发光元件的第一极电连接。
6.如权利要求1所述的像素电路，其特征在于，所述发光元件为有机发光二极管；所述发光元件的第一极为所述有机发光二极管的阳极，所述发光元件的第二极为所述有机发光二极管的阴极。
7.一种像素驱动方法，应用于如权利要求1至6中任一权利要求所述的像素电路，其特征在于，显示周期包括依次设置的初始化阶段、写入阶段和发光阶段，所述像素驱动方法包括：
在初始化阶段，数据线提供初始化电压，数据写入电路在第二控制信号的控制下，将所述初始化电压写入驱动电路的第一端，补偿控制电路在第一控制信号的控制下，控制所述驱动电路的第一端与所述驱动电路的控制端之间连通，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通，所述发光控制电路在第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通，以控制对发光元件的第一极和驱动电路的控制端进行初始化，以清除所述发光元件的第一极残留的电荷，并使得在写入阶段开始时，所述驱动电路能够导通其第一端与所述驱动电路的第二端之间的连接；
在写入阶段，数据线提供数据电压，数据写入电路在第二控制信号的控制下，将所述数据电压写入驱动电路的第一端，补偿控制电路在第一控制信号的控制下，控制所述驱动电路的第一端与所述驱动电路的控制端之间断开，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间连通，驱动电路在其控制端的电位的控制下，导通所述驱动电路的第一端与所述驱动电路的第二端之间的连接，以通过所述数据电压为储能电路充电，以改变驱动电路的控制端的电位，直至所述驱动电路在其控制端的控制下，断开所述驱动电路的第一端与所述驱动电路的第二端之间的连接；
在发光阶段，数据写入电路在第二控制信号的控制下，将所述数据线与所述驱动电路的第一端之间断开，初始化电路在所述第二控制信号的控制下，控制所述驱动电路的控制端与所述驱动电路的第二端之间断开，所述发光控制电路在所述第二控制信号的控制下，控制第一电压线与所述驱动电路的第一端之间连通，所述发光控制电路在第三控制信号的控制下，控制所述驱动电路的第二端与所述发光元件的第一极之间连通，驱动电路在其控制端的电位的控制下，生成驱动所述发光元件发光的驱动电流，以驱动所述发光元件发光。
8.一种显示基板，包括基底，其特征在于，所述显示基板还包括阵列设置于所述基底上的多个如权利要求1至6中任一权利要求所述的像素电路；所述像素电路还包括第一控制线、第二控制线、第三控制线、数据线和第一电压线；
所述第一电压线的至少部分沿第一方向延伸，所述数据线的至少部分沿第一方向延伸；
所述第一控制线的至少部分沿第二方向延伸，所述第二控制线的至少部分沿第二方向延伸，所述第三控制线的至少部分沿第二方向延伸；
所述第二控制线设置于所述第一控制线与所述第三控制线之间；
所述第一方向和所述第二方向相交。
9.如权利要求8所述的显示基板，其特征在于，所述像素电路中的补偿控制电路包括第一晶体管；所述像素电路中的初始化电路包括第二晶体管，所述像素电路中的驱动电路包括第三晶体管，所述像素电路中的数据写入电路包括第四晶体管；所述像素电路中的储能电路包括存储电容；所述像素电路中的发光控制电路包括第五晶体管和第六晶体管；
所述存储电容包括相对设置的第一极板和第二极板；所述第二极板位于所述第一极板和所述基底之间；
所述第三晶体管的源极、所述第五晶体管的源极、所述第三晶体管的漏极、所述第六晶体管的源极和所述第六晶体管的漏极同层同材料设置；所述第三晶体管的源极复用为所述第五晶体管的漏极；
所述第一晶体管的源极、所述第一晶体管的漏极、所述第二晶体管的源极、所述第四晶体管的源极和所述第四晶体管的漏极同层同材料设置；所述第一晶体管的源极复用为所述第二晶体管的漏极；
所述第三晶体管的源极位于所述基底与所述第二极板之间，所述第一晶体管的源极位于所述第一极板远离所述第二极板的一侧。
10.一种显示装置，其特征在于，包括如权利要求8或9所述的显示基板。
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