CN109308875A - 一种像素电路、其驱动方法、显示面板及显示装置 - Google Patents

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Abstract

本发明公开了一种像素电路、其驱动方法、显示面板及显示装置，包括：数据写入模块、补偿控制模块、第一存储模块、第二存储模块、发光控制模块和驱动晶体管。本发明通过上述五个模块以及驱动晶体管的相互配合，可以使像素电路中的驱动晶体管输出的电流仅与数据信号端的数据电压和参考电压有关，而与驱动晶体管的阈值电压以及第二电源端的电压无关，可以避免驱动晶体管的阈值电压以及IR Drop对驱动晶体管输出的电流的影响，从而使驱动晶体管输出的电流保持稳定，进而可以提高显示装置中显示区域画面亮度的均匀性。

Description

一种像素电路、其驱动方法、显示面板及显示装置
技术领域
本发明涉及显示技术领域，特别涉及一种像素电路、其驱动方法、显示面板及显示装置。
背景技术
有机发光二极管(Organic Light Emitting Diode，OLED)是当今平板显示器研究领域的热点之一，与液晶显示器(Liquid Crystal Display，LCD)相比，OLED显示器具有低能耗、生产成本低、自发光、宽视角及响应速度快等优点。目前，在手机、平板电脑、数码相机等显示领域，OLED显示器已经开始取代传统的LCD显示器。
与LCD利用稳定的电压控制亮度不同，OLED属于电流驱动，需要稳定的电流来控制其发光。由于工艺制程和器件老化等原因，会使像素电路的驱动晶体管的阈值电压Vth存在不均匀性，这样就导致了流过每个OLED的电流发生变化使得显示亮度不均，从而影响整个图像的显示效果。并且由于流过每个OLED的电流与驱动管源极即电源电压相关，由于IRDrop原因，也会造成不同区域的电流差异，进而造成不同区域的OLED出现亮度不均匀现象。
例如现有的2M1C的像素电路中，如图1所示，该电路由1个驱动晶体管M0，一个开关晶体管M和一个存储电容Cs组成，当扫描线Scan选择某一行时，扫描线Scan输入低电平信号，P型的开关晶体管M1导通，数据线Data的电压写入存储电容Cs；当该行扫描结束后，扫描线Scan输入的信号变为高电平，P型的开关晶体管M1关断，存储电容Cs存储的栅极电压使驱动晶体管M0产生电流来驱动OLED，保证OLED在一帧内持续发光。其中，驱动晶体管M0的饱和电流公式为IOLED＝K(VSG-Vth)2，正如前述，由于工艺制程和器件老化等原因，驱动晶体管M0的阈值电压Vth会漂移，并且由于电流与电源电压相关，由于IR Drop原因，Vs也会不同。这样就导致了流过每个OLED的电流因驱动晶体管的阈值电压Vth和驱动晶体管的源极电压的变化而变化，从而导致图像亮度不均匀。
发明内容
有鉴于此，本发明实施例提供了一种像素电路、其驱动方法、显示面板及显示装置，用以提高显示装置显示区域图像亮度的均匀性。
因此，本发明实施例提供了一种像素电路，包括：数据写入模块、补偿控制模块、第一存储模块、第二存储模块、发光控制模块和驱动晶体管；其中，
所述数据写入模块分别与第一控制信号端、数据信号端以及第一节点相连；所述数据写入模块用于在所述第一控制信号端的控制下将所述数据信号端的信号提供给所述第一节点；
所述第一存储模块分别与所述第一节点以及所述驱动晶体管的栅极相连；所述第一存储模块用于保持所述第一节点与所述驱动晶体管的栅极之间的电压差稳定；
所述第二存储模块分别与所述第一节点以及所述驱动晶体管的第二极相连；所述第二存储模块用于保持所述第一节点与所述驱动晶体管的第二极的电压差稳定；
所述补偿控制模块分别与第二控制信号端、所述驱动晶体管的栅极以及所述驱动晶体管的第一极相连；所述补偿控制模块用于在所述第二控制信号端的控制下使所述驱动晶体管的栅极与所述驱动晶体管的第一极导通；
所述发光控制模块分别与发光控制信号端、第一电源端以及所述驱动晶体管的第一极相连；所述发光控制模块用于在所述发光控制信号端的控制下控制所述驱动晶体管输出稳定的电流。
较佳地，在本发明实施例提供的上述像素电路中，所述第一存储模块包括：第一电容；其中，
所述第一电容的第一端与所述第一节点相连，第二端与所述驱动晶体管的栅极相连。
较佳地，在本发明实施例提供的上述像素电路中，所述第二存储模块包括：第二电容；其中，
所述第二电容的第一端与所述第一节点相连，第二端与所述驱动晶体管的第二极相连。
较佳地，在本发明实施例提供的上述像素电路中，所述第一电容的电容值大于所述第二电容的电容值。
较佳地，在本发明实施例提供的上述像素电路中，所述数据写入模块包括：第一开关晶体管；其中，
所述第一开关晶体管的栅极与所述第一控制信号端相连，第一极与所述数据信号端相连，第二极与所述第一节点相连。
较佳地，在本发明实施例提供的上述像素电路中，所述补偿控制模块包括：第二开关晶体管；其中，
所述第二开关晶体管的栅极与所述第二控制信号端相连，第一极与所述驱动晶体管的栅极相连，第二极与所述驱动晶体管的第一极相连。
较佳地，在本发明实施例提供的上述像素电路中，所述发光控制模块包括：第三开关晶体管；其中，
所述第三开关晶体管的栅极与所述发光控制信号端相连，第一极与所述第二电源端相连，第二极与所述驱动晶体管的第一极相连。
较佳地，在本发明实施例提供的上述像素电路中，所述驱动晶体管为N型晶体管，所有开关晶体管均为P型晶体管或均为N型晶体管。
相应地，本发明实施例还提供了一种显示面板，包括本发明实施例提供的上述任一种像素电路。
相应地，本发明实施例还提供了一种显示装置，包括本发明实施例提供的上述显示面板。
相应地，本发明实施例还提供了一种本发明实施例提供的上述任一种像素电路的驱动方法，包括：
补偿阶段，所述补偿控制模块在所述第二控制信号端的控制下导通所述驱动晶体管的栅极与所述驱动晶体管的第一极；
数据写入阶段，所述数据写入模块在所述第一控制信号端的控制下将所述数据信号端的信号提供给所述第一节点；
发光阶段，所述第一存储模块保持所述第一节点与所述驱动晶体管的栅极之间的电压差稳定；所述第二存储模块保持所述第一节点与所述驱动晶体管的第二极的电压差稳定；所述发光控制模块在所述发光控制信号端的控制下控制所述驱动晶体管输出稳定的电流。
本发明实施例提供的像素电路、其驱动方法、显示面板及显示装置，包括：数据写入模块、补偿控制模块、第一存储模块、第二存储模块、发光控制模块和驱动晶体管；其中，数据写入模块用于在第一控制信号端的控制下将数据信号端的信号提供给第一节点；第一存储模块用于保持第一节点与驱动晶体管的栅极之间的电压差稳定；第二存储模块用于保持第一节点与驱动晶体管的第二极的电压差稳定；补偿控制模块用于在第二控制信号端的控制下使驱动晶体管的栅极与驱动晶体管的第一极导通；发光控制模块用于在发光控制信号端的控制下控制驱动晶体管输出稳定的电流。因此通过上述五个模块以及驱动晶体管的相互配合，可以使像素电路中的驱动晶体管输出的电流仅与数据信号端的数据电压和参考电压有关，而与驱动晶体管的阈值电压以及第二电源端的电压无关，可以避免驱动晶体管的阈值电压以及IR Drop对驱动晶体管输出的电流的影响，从而使驱动晶体管输出的电流保持稳定，进而可以提高显示装置中显示区域画面亮度的均匀性。
附图说明
图1为现有的2M1C的像素电路的结构示意图；
图2为本发明实施例提供的像素电路的结构示意图之一；
图3为本发明实施例提供的像素电路的结构示意图之二；
图4为本发明实施例提供的像素电路的具体结构示意图；
图5为图4所示的像素电路的电路时序示意图；
图6为本发明实施例提供的像素电路的仿真模拟图；
图7为本发明实施例提供的像素电路的驱动方法的流程示意图。
具体实施方式
为了使本发明的目的，技术方案和优点更加清楚，下面结合附图，对本发明实施例提供的像素电路、其驱动方法、显示面板及显示装置的具体实施方式进行详细地说明。
本发明实施例提供的一种像素电路，如图2所示，包括：数据写入模块1、第一存储模块2、第二存储模块3、补偿控制模块4、发光控制模块5和驱动晶体管M0；其中，
数据写入模块1分别与第一控制信号端G1、数据信号端Data以及第一节点A相连；数据写入模块1用于在第一控制信号端G1的控制下将数据信号端Data的信号提供给第一节点A；
第一存储模块2分别与第一节点A以及驱动晶体管的栅极相连；第一存储模块2用于保持第一节点A与驱动晶体管M0的栅极之间的电压差稳定；
第二存储模块3分别与第一节点A以及驱动晶体管的第二极相连；第二存储模块3用于保持第一节点A与驱动晶体管的第二极的电压差稳定；
补偿控制模块4分别与第二控制信号端G2、驱动晶体管M0的栅极以及驱动晶体管M0的第一极相连；补偿控制模块4用于在第二控制信号端G2的控制下使驱动晶体管M0的栅极与驱动晶体管M0的第一极导通；
发光控制模块5分别与发光控制信号端EM、第一电源端VDD以及驱动晶体管M0的第一极相连；发光控制模块5用于在发光控制信号端EM的控制下控制驱动晶体管M0输出稳定的电流。
本发明实施例提供的像素电路，包括：数据写入模块、补偿控制模块、第一存储模块、第二存储模块、发光控制模块和驱动晶体管；其中，数据写入模块用于在第一控制信号端的控制下将数据信号端的信号提供给第一节点；第一存储模块用于保持第一节点与驱动晶体管的栅极之间的电压差稳定；第二存储模块用于保持第一节点与驱动晶体管的第二极的电压差稳定；补偿控制模块用于在第二控制信号端的控制下使驱动晶体管的栅极与驱动晶体管的第一极导通；发光控制模块用于在发光控制信号端的控制下控制驱动晶体管输出稳定的电流。因此通过上述五个模块以及驱动晶体管的相互配合，可以使像素电路中的驱动晶体管输出的电流仅与数据信号端的数据电压和参考电压有关，而与驱动晶体管的阈值电压以及第二电源端的电压无关，可以避免驱动晶体管的阈值电压以及IR Drop对驱动晶体管输出的电流的影响，从而使驱动晶体管输出的电流保持稳定，进而可以提高显示装置中显示区域画面亮度的均匀性。
在具体实施时，在本发明实施例提供的上述像素电路中，该像素电路一般用于驱动发光器件发光，如图3所示，发光器件OLED的阳极与驱动晶体管M0的第二极相连，发光器件OLED的阴极与第二电源端VSS相连。
在具体实施时，在本发明实施例提供的上述像素电路中，发光器件一般为有机发光二极管(OLED)，发光器件在驱动晶体管处于饱和状态时的电流的作用下实现发光。另外，一般发光器件具有阈值电压，在发光器件两端的电压大于或等于阈值电压时进行发光。
在具体实施时，在本发明实施例提供的上述像素电路中，第一电源端VDD的电压一般为高电平电压，第二电源端VSS的电压一般接地或为低电平电压。
下面结合具体实施例，对本发明进行详细说明。需要说明的是，本实施例中是为了更好的解释本发明，但不限制本发明。
较佳地，在具体实施时，在本发明实施例提供的上述像素电路中，如图4所示，第一存储模块2具体可以包括：第一电容C1；其中，
第一电容C1的第一端与第一节点A相连，第二端与驱动晶体管M0的栅极相连。
在具体实施时，在本发明实施例提供的上述像素电路中，第一电容在第一节点的信号和驱动晶体管的栅极的信号的共同控制下进行充电；并在第一节点的信号和驱动晶体管的栅极的信号的共同控制下进行放电；以及在驱动晶体管的栅极处于浮接状态时，保持第一节点和驱动晶体管的栅极之间的电压差稳定，以将驱动晶体管的阈值电压Vth(M0)和第一电源端VDD的电压存储于驱动晶体管的栅极上。
以上仅是举例说明像素电路中第一存储模块的具体结构，在具体实施时，第一存储模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在具体实施时，在本发明实施例提供的上述像素电路中，如图4所示，第二存储模块3具体可以包括：第二电容C2；其中，
第二电容C2的第一端与第一节点A相连，第二端与发光器件OLED的阳极相连。
在具体实施时，在本发明实施例提供的上述像素电路中，第二电容在第一节点的信号与驱动晶体管的第二极的信号的共同控制下进行充电，并在第一节点的信号和驱动晶体管的第二极的信号的共同控制下进行放电；以及在发光器件处于发光状态时保持第一节点与驱动晶体管的第二极之间的电压差稳定，以保证驱动晶体管输出稳定的电流。
以上仅是举例说明像素电路中第二存储模块的具体结构，在具体实施时，第二存储模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
在具体实施时，在本发明实施例提供的上述像素电路中，由于第一电容要长时间保持驱动晶体管的栅极与第一节点之间的电压差稳定，以保证流向发光器件的电流恒定，因此第一电容的电容值相对较大。而为了减小空间占用面积，第二电容的电容值相对较小。因此，较佳地，在具体实施时，在本发明实施例提供的上述像素电路中，第一电容的电容值大于第二电容的电容值。
较佳地，在具体实施时，在本发明实施例提供的上述像素电路中，如图4所示，数据写入模块1具体可以包括：第一开关晶体管M1；其中，
第一开关晶体管M1的栅极与第一控制信号端G1相连，第一极与数据信号端Data相连，第二极与第一节点A相连。
在具体实施时，在本发明实施例提供的上述像素电路中，第一开关晶体管在第一控制信号端的控制下处于导通状态时，将数据信号端的信号提供给第一节点。
以上仅是举例说明像素电路中数据写入模块的具体结构，在具体实施时，数据写入模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在具体实施时，在本发明实施例提供的上述像素电路中，如图4所示，补偿控制模块4具体可以包括：第二开关晶体管M2；其中，
第二开关晶体管M2的栅极与第二控制信号端G2相连，第一极与驱动晶体管M0的栅极相连，第二极与驱动晶体管M0的第一极相连。
在具体实施时，在本发明实施例提供的上述像素电路中，第二开关晶体管在第二控制信号端的控制下导通驱动晶体管的栅极与其第一极，以控制驱动晶体管处于二极管状态。
以上仅是举例说明像素电路中补偿控制模块的具体结构，在具体实施时，补偿控制模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在具体实施时，在本发明实施例提供的上述像素电路中，如图4所示，发光控制模块5具体可以包括：第三开关晶体管M3；其中，
第三开关晶体管M3的栅极与发光控制信号端EM相连，第一极与第二电源端VSS相连，第二极与驱动晶体管M0的第一极相连。
在具体实施时，在本发明实施例提供的上述像素电路中，第三开关晶体管在发光控制信号端的控制下，将第一电源端的电压提供驱动晶体管的第一极，将驱动晶体管的第二极输出的驱动电流输出给发光器件以驱动发光器件发光。
以上仅是举例说明像素电路中发光控制模块的具体结构，在具体实施时，发光控制模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
在具体实施时，在本发明实施例提供的上述像素电路中，驱动晶体管为N型晶体管。对于驱动晶体管为P型晶体的原理与驱动晶体管为N型晶体管的原理相似，也属于本发明保护的范围。
在具体实施时，在本发明实施例提供的上述像素电路中，所有开关晶体管均为P型晶体管或均为N型晶体管，在此不做限定。
较佳地，在具体实施时，在本发明实施例提供的上述像素电路中，如图4所示，驱动晶体管M0和所有开关晶体管M1-M3均为N型晶体管。
在具体实施时，在本发明实施例提供的上述像素电路中，N型开关晶体管在高电位作用下导通，在低电位作用下截止。
需要说明的是，在本发明实施例提供的上述像素电路中，驱动晶体管和开关晶体管可以是薄膜晶体管(TFT，Thin Film Transistor)，也可以是金属氧化物半导体场效应管(MOS，Metal Oxide Scmiconductor)，在此不作限定。
在具体实施时，这些开关晶体管的第一极和第二极根据开关晶体管类型以及信号端的信号的不同，其功能可以互换，其中第一极可以为源极，第二极为漏极，或者第一极可以为漏极，第二极为源极，在此不作具体区分。
下面以图4所示的像素电路为例，结合电路时序图对本发明实施例提供的上述像素电路的工作过程作以描述。下述描述中以1表示高电位，0表示低电位。需要说明的是，1和0是逻辑电位，其仅是为了更好的解释本发明实施例的具体工作过程，而不是在具体实施时施加在各开关晶体管的栅极上的电位。
如图4所示，驱动晶体管M0为N型晶体管，所有开关晶体管均为N型晶体管；对应的输入时序图如图5所示。具体地，选取如图5所示的输入时序图中的T1、T2以及T3三个阶段。
在T1阶段，G1＝1，G2＝1，EM＝0。
第一开关晶体管M1、第二开关晶体管M2和驱动晶体管M0均处于导通状态，第三开关晶体管M3处于截止状态。此阶段时数据信号端Data的电压为参考电压Vref，从而导通的第一开关晶体管M1将数据信号端Data的参考电压Vref提供给第一节点A，因此第一节点A的电压VA＝Vref。导通的第二开关晶体管M2可以导通驱动晶体管M0的栅极与其第一极，使驱动晶体管M0处于二极管连接状态，因此发光器件OLED的阳极和驱动晶体管M0的栅极的电压被释放，发光器件OLED的阳极的电压即驱动晶体管M0的源极的电压Vs为第二电源端VSS的电压VSS和发光器件OLED的阈值电压Voled0之和，即Vs＝VSS+Voled0，驱动晶体管M0的栅极的电压Vg为驱动晶体管M0的源极的电压加上驱动晶体管M0的阈值电压Vth，即Vg＝VSS+Voled0+Vth。
在T2阶段，G1＝1，G2＝0，EM＝0。第一开关晶体管M1和驱动晶体管M0均处于导通状态，第二开关晶体管M2和第三开关晶体管M3均处于截止状态。设定此阶段数据信号端Data写入的电压为Vdata，即导通的第一开关晶体管M1将数据信号端Data的电压Vdata提供给第一节点A，因此第一节点A的电压VA＝Vdata。由于第一电容C1的耦合作用，驱动晶体管M0的栅极的电压Vg＝VSS+Voled0+Vth+Vdata-Vref。
在T3阶段，G1＝0，G2＝0，EM＝1。第三开关晶体管M3和驱动晶体管M0均处于导通状态，第一开关晶体管M1和第二开关晶体管M2处于截止状态。发光器件OLED开始发光，发光器件OLED的阳极的电压为VSS+Voled，即驱动晶体管M0的源极的电压Vs＝VSS+Voled，其中，Voled为发光器件OLED发光时的电压。在此阶段中，第一节点A的电压VA＝Vdata+Voled-Voled0，驱动晶体管M0的栅极的电压Vg＝VSS+Voled0+Vth+Vdata-Vref+Voled-Voled0
＝VSS+Voled+Vth+Vdata-Vref；
驱动晶体管M0的第一极电压为第一电源端VDD的电压VDD，驱动晶体管M0工作处于饱和状态，根据饱和状态电流特性可知，流过驱动晶体管M0且用于驱动发光器件OLED发光的工作电流IOLED满足公式：
IOLED＝K(Vgs–Vth)2
＝K(VSS+Voled+Vth+Vdata-Vref-VSS-Voled–Vth)2
＝K(Vdata-Vref)2；
其中K为结构参数，相同结构中此数值相对稳定，可以算作常量。从而可以看出发光器件OLED的工作电流IOLED已经不受驱动晶体管M0的阈值电压Vth的影响，且和第二电源端VSS的电压VSS无关，仅与数据信号端Data的数据电压Vdata和参考电压Vref有关，彻底解决了由于工艺制程以及长时间的操作造成的驱动晶体管M0的阈值电压Vth漂移以及压降(IRDrop)对发光器件OLED的工作电流IOLED造成的影响，从而改善了面板显示的不均匀性。并且本发明实施例提供的上述像素电路仅采用了4个晶体管和2个电容就可以实现对驱动晶体管M0的阈值电压Vth进行补偿，结构比较简单。
并且，当驱动晶体管M0的阈值电压取不同值时，本发明还对上述实施例提供的像素电路在三个阶段进行了仿真模拟，如图6所示，当驱动晶体管M0的阈值电压分别为Vth＝1和Vth＝2时，由图6的仿真结果可以看出，流过发光器件的驱动电流基本上重合的，取图中T3阶段任一时刻如1.2447ms时刻时流过发光器件OLED的工作电流IOLED，当驱动晶体管M0的阈值电压Vth＝1时，IOLED1＝4.842uA；当驱动晶体管M0的阈值电压，IOLED2＝4.8416uA；IOLED1与IOLED2近似相等，因此可以验证在本发明实施例提供的像素电路中，发光器件OLED的工作电流IOLED确实不受驱动晶体管M0的阈值电压Vth的影响。
基于同一发明构思，本发明实施例还提供了一种本发明实施例提供的上述任一种像素电路的驱动方法，如图7所示，包括：
S701、补偿阶段，补偿控制模块在第二控制信号端的控制下导通驱动晶体管的栅极与驱动晶体管的第一极；
S702、数据写入阶段，数据写入模块在第一控制信号端的控制下将数据信号端的信号提供给第一节点；
S703、发光阶段，第一存储模块保持第一节点与驱动晶体管的栅极之间的电压差稳定；第二存储模块保持第一节点与驱动晶体管的第二极的电压差稳定；发光控制模块在发光控制信号端的控制下控制驱动晶体管输出稳定的电流。
本发明实施例提供的上述驱动方法，可以使像素电路中的驱动晶体管驱动发光器件发光的工作电流仅与数据信号端的数据电压和参考电压有关，而与驱动晶体管的阈值电压以及第二电源端的电压无关，可以避免驱动晶体管的阈值电压以及IR Drop对驱动晶体管输出的电流的影响，从而使驱动晶体管输出的电流保持稳定，进而可以提高显示装置中显示区域画面亮度的均匀性。
基于同一发明构思，本发明实施例还提供了一种显示面板，包括：本发明实施例提供的上述任一种像素电路。该显示面板解决问题的原理与前述的像素电路相似，因此该显示面板的实施可以参见上述像素电路的实施，重复之处不再赘述。
在具体实施时，在本发明实施例提供的上述显示面板中，显示面板可以为有机电致发光显示面板。
基于同一发明构思，本发明实施例还提供了一种显示装置，包括本发明实施例提供的上述显示面板。该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。对于该显示装置的其它必不可少的组成部分均为本领域的普通技术人员应该理解具有的，在此不做赘述，也不应作为对本发明的限制。该显示装置的实施可以参见上述像素电路的实施例，重复之处不再赘述。
本发明实施例提供的像素电路、其驱动方法、显示面板及显示装置，包括：数据写入模块、补偿控制模块、第一存储模块、第二存储模块、发光控制模块和驱动晶体管；其中，数据写入模块用于在第一控制信号端的控制下将数据信号端的信号提供给第一节点；第一存储模块用于保持第一节点与驱动晶体管的栅极之间的电压差稳定；第二存储模块用于保持第一节点与驱动晶体管的第二极的电压差稳定；补偿控制模块用于在第二控制信号端的控制下使驱动晶体管的栅极与驱动晶体管的第一极导通；发光控制模块用于在发光控制信号端的控制下控制驱动晶体管输出稳定的电流。因此通过上述五个模块以及驱动晶体管的相互配合，可以使像素电路中的驱动晶体管输出的电流仅与数据信号端的数据电压和参考电压有关，而与驱动晶体管的阈值电压以及第二电源端的电压无关，可以避免驱动晶体管的阈值电压以及IR Drop对驱动晶体管输出的电流的影响，从而使驱动晶体管输出的电流保持稳定，进而可以提高显示装置中显示区域画面亮度的均匀性。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (11)

1.一种像素电路，其特征在于，包括：数据写入模块、补偿控制模块、第一存储模块、第二存储模块、发光控制模块和驱动晶体管；其中，
所述数据写入模块分别与第一控制信号端、数据信号端以及第一节点相连；所述数据写入模块用于在所述第一控制信号端的控制下将所述数据信号端的信号提供给所述第一节点；
所述第一存储模块分别与所述第一节点以及所述驱动晶体管的栅极相连；所述第一存储模块用于保持所述第一节点与所述驱动晶体管的栅极之间的电压差稳定；
所述第二存储模块分别与所述第一节点以及所述驱动晶体管的第二极相连；所述第二存储模块用于保持所述第一节点与所述驱动晶体管的第二极的电压差稳定；
所述补偿控制模块分别与第二控制信号端、所述驱动晶体管的栅极以及所述驱动晶体管的第一极相连；所述补偿控制模块用于在所述第二控制信号端的控制下使所述驱动晶体管的栅极与所述驱动晶体管的第一极导通；
所述发光控制模块分别与发光控制信号端、第一电源端以及所述驱动晶体管的第一极相连；所述发光控制模块用于在所述发光控制信号端的控制下控制所述驱动晶体管输出稳定的电流。
2.如权利要求1所述的像素电路，其特征在于，所述第一存储模块包括：第一电容；其中，
所述第一电容的第一端与所述第一节点相连，第二端与所述驱动晶体管的栅极相连。
3.如权利要求2所述的像素电路，其特征在于，所述第二存储模块包括：第二电容；其中，
所述第二电容的第一端与所述第一节点相连，第二端与所述驱动晶体管的第二极相连。
4.如权利要求3所述的像素电路，其特征在于，所述第一电容的电容值大于所述第二电容的电容值。
5.如权利要求1所述的像素电路，其特征在于，所述数据写入模块包括：第一开关晶体管；其中，
所述第一开关晶体管的栅极与所述第一控制信号端相连，第一极与所述数据信号端相连，第二极与所述第一节点相连。
6.如权利要求1所述的像素电路，其特征在于，所述补偿控制模块包括：第二开关晶体管；其中，
所述第二开关晶体管的栅极与所述第二控制信号端相连，第一极与所述驱动晶体管的栅极相连，第二极与所述驱动晶体管的第一极相连。
7.如权利要求1所述的像素电路，其特征在于，所述发光控制模块包括：第三开关晶体管；其中，
所述第三开关晶体管的栅极与所述发光控制信号端相连，第一极与所述第二电源端相连，第二极与所述驱动晶体管的第一极相连。
8.如权利要求5-7任一项所述的像素电路，其特征在于，所述驱动晶体管为N型晶体管，所有开关晶体管均为P型晶体管或均为N型晶体管。
9.一种显示面板，其特征在于，包括如权利1-8任一项所述的像素电路。
10.一种显示装置，其特征在于，包括如权利要求9所述的显示面板。
11.一种如权利要求1-8任一项所述的像素电路的驱动方法，其特征在于，包括：
补偿阶段，所述补偿控制模块在所述第二控制信号端的控制下导通所述驱动晶体管的栅极与所述驱动晶体管的第一极；
数据写入阶段，所述数据写入模块在所述第一控制信号端的控制下将所述数据信号端的信号提供给所述第一节点；
发光阶段，所述第一存储模块保持所述第一节点与所述驱动晶体管的栅极之间的电压差稳定；所述第二存储模块保持所述第一节点与所述驱动晶体管的第二极的电压差稳定；所述发光控制模块在所述发光控制信号端的控制下控制所述驱动晶体管输出稳定的电流。
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