JP6781176B2 - 画素回路および表示装置 - Google Patents
画素回路および表示装置 Download PDFInfo
- Publication number
- JP6781176B2 JP6781176B2 JP2018029573A JP2018029573A JP6781176B2 JP 6781176 B2 JP6781176 B2 JP 6781176B2 JP 2018029573 A JP2018029573 A JP 2018029573A JP 2018029573 A JP2018029573 A JP 2018029573A JP 6781176 B2 JP6781176 B2 JP 6781176B2
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- voltage
- gate
- drive transistor
- drive
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
- 238000012937 correction Methods 0.000 claims description 50
- 239000003990 capacitor Substances 0.000 claims 1
- 238000002408 directed self-assembly Methods 0.000 description 37
- 102100031699 Choline transporter-like protein 1 Human genes 0.000 description 20
- 101000940912 Homo sapiens Choline transporter-like protein 1 Proteins 0.000 description 20
- 102100039497 Choline transporter-like protein 3 Human genes 0.000 description 19
- 101000889279 Homo sapiens Choline transporter-like protein 3 Proteins 0.000 description 19
- 102100035954 Choline transporter-like protein 2 Human genes 0.000 description 14
- 101000948115 Homo sapiens Choline transporter-like protein 2 Proteins 0.000 description 14
- 230000000694 effects Effects 0.000 description 12
- 238000012986 modification Methods 0.000 description 9
- 230000004048 modification Effects 0.000 description 9
- 102100039496 Choline transporter-like protein 4 Human genes 0.000 description 6
- 101000889282 Homo sapiens Choline transporter-like protein 4 Proteins 0.000 description 6
- 238000012545 processing Methods 0.000 description 6
- 238000010791 quenching Methods 0.000 description 6
- 230000036962 time dependent Effects 0.000 description 6
- 238000010586 diagram Methods 0.000 description 5
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 4
- 239000011159 matrix material Substances 0.000 description 4
- 238000002360 preparation method Methods 0.000 description 4
- 230000000171 quenching effect Effects 0.000 description 4
- 230000014759 maintenance of location Effects 0.000 description 3
- 238000013459 approach Methods 0.000 description 2
- 239000004973 liquid crystal related substance Substances 0.000 description 2
- 238000005070 sampling Methods 0.000 description 2
- 102100039505 Choline transporter-like protein 5 Human genes 0.000 description 1
- 101000889267 Homo sapiens Choline transporter-like protein 5 Proteins 0.000 description 1
- 206010047571 Visual impairment Diseases 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 238000005401 electroluminescence Methods 0.000 description 1
- 230000001771 impaired effect Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 239000012044 organic layer Substances 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
- 238000012546 transfer Methods 0.000 description 1
Images
Classifications
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
- G09G3/30—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels
- G09G3/32—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED]
- G09G3/3208—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED]
- G09G3/3225—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix
- G09G3/3233—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix with pixel circuitry controlling the current through the light-emitting element
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
- G09G3/30—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels
- G09G3/32—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED]
- G09G3/3208—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED]
- G09G3/3225—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix
- G09G3/3258—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix with pixel circuitry controlling the voltage across the light-emitting element
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2300/00—Aspects of the constitution of display devices
- G09G2300/08—Active matrix structure, i.e. with use of active elements, inclusive of non-linear two terminal elements, in the pixels together with light emitting or modulating elements
- G09G2300/0809—Several active elements per pixel in active matrix panels
- G09G2300/0819—Several active elements per pixel in active matrix panels used for counteracting undesired variations, e.g. feedback or autozeroing
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2300/00—Aspects of the constitution of display devices
- G09G2300/08—Active matrix structure, i.e. with use of active elements, inclusive of non-linear two terminal elements, in the pixels together with light emitting or modulating elements
- G09G2300/0809—Several active elements per pixel in active matrix panels
- G09G2300/0842—Several active elements per pixel in active matrix panels forming a memory circuit, e.g. a dynamic memory with one capacitor
- G09G2300/0852—Several active elements per pixel in active matrix panels forming a memory circuit, e.g. a dynamic memory with one capacitor being a dynamic memory with more than one capacitor
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2300/00—Aspects of the constitution of display devices
- G09G2300/08—Active matrix structure, i.e. with use of active elements, inclusive of non-linear two terminal elements, in the pixels together with light emitting or modulating elements
- G09G2300/0809—Several active elements per pixel in active matrix panels
- G09G2300/0842—Several active elements per pixel in active matrix panels forming a memory circuit, e.g. a dynamic memory with one capacitor
- G09G2300/0861—Several active elements per pixel in active matrix panels forming a memory circuit, e.g. a dynamic memory with one capacitor with additional control of the display period without amending the charge stored in a pixel memory, e.g. by means of additional select electrodes
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2320/00—Control of display operating conditions
- G09G2320/02—Improving the quality of display appearance
- G09G2320/0233—Improving the luminance or brightness uniformity across the screen
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2320/00—Control of display operating conditions
- G09G2320/04—Maintaining the quality of display appearance
- G09G2320/043—Preventing or counteracting the effects of ageing
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Control Of El Displays (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Electroluminescent Light Sources (AREA)
- Devices For Indicating Variable Information By Combining Individual Elements (AREA)
Description
本開示は、画素回路および表示装置に関する。
近年、映像表示を行う表示装置の分野では、画素の発光素子として、流れる電流値に応じて発光輝度が変化する電流駆動型の光学素子、例えば有機ＥＬ(electro luminescence)素子を用いた表示装置が商品化されている。有機ＥＬ素子は、液晶素子などと異なり自発光素子である。そのため、有機ＥＬ素子を用いた表示装置（有機ＥＬ表示装置）では、光源（バックライト）が必要ないので、光源を必要とする液晶表示装置と比べて、軽量化、薄型化、高輝度化することができる。さらに、有機ＥＬ素子の応答速度は、数μｓ程度と非常に高速であるので、動画表示時の残像が発生しない。そのため、有機ＥＬ表示装置は、次世代のフラットパネルディスプレイの主流になると期待されている。
アクティブマトリックス型の有機ＥＬ表示装置においては、各走査線が順次走査されると共に、映像信号に対応する信号電圧がサンプリングされ、保持容量に書き込まれる。即ち、線順次走査によって、信号電圧の書込動作が行われる。また、有機ＥＬ表示装置では、駆動トランジスタの閾値電圧や移動度が画素ごとに異なる場合には、有機ＥＬ素子の発光輝度がばらつき、画面の一様性（ユニフォーミティ）が損なわれてしまう。そこで、アクティブマトリックス型の有機ＥＬ表示装置では、駆動トランジスタの閾値電圧や移動度のばらつきに起因する発光輝度のばらつきを低減する補正動作が、線順次走査に併せて行われる（特許文献１，２参照）。
ところで、有機ＥＬ表示装置では、上述の補正動作で、発光輝度のばらつきをより一層、低減することが求められている。従って、発光輝度のばらつきをより一層、低減することの可能な画素回路および表示装置を提供することが望ましい。
本開示の一実施の形態に係る画素回路は、発光素子に流れる電流を制御する駆動トランジスタと、駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタとを備えている。この画素回路は、さらに、駆動トランジスタのゲート−ソース間電圧を駆動トランジスタの閾値電圧に近づける補正動作を行う際の駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、駆動トランジスタの、発光素子側の第１端子と、書き込みトランジスタの、駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタとを備えている。この画素回路は、さらに、駆動トランジスタのゲートと、第１端子との間の導電パスに設けられた第１保持容量と、駆動トランジスタのゲートと、第２端子との間の導電パスに設けられた第２保持容量と、第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタとを備えている。
本開示の一実施の形態に係る表示装置は、各々が発光素子と画素回路とを含む複数の画素と、複数の画素を駆動する駆動回路とを備えている。この表示装置において、画素回路は、上記の画素回路と同じ構成要素を有している。
本開示の一実施の形態に係る画素回路および表示装置では、４つのトランジスタ（駆動トランジスタ、書き込みトランジスタ、第１スイッチングトランジスタおよび第２スイッチングトランジスタ）と、２つの保持容量（第１保持容量および第２保持容量）とが設けられている。これにより、少なくとも、駆動トランジスタのゲートへの信号電圧を書き込む際に、駆動トランジスタのソース電位の揺れを抑えることが可能となる。
本開示の一実施の形態に係る画素回路および表示装置によれば、少なくとも、駆動トランジスタのゲートへの信号電圧を書き込む際に、駆動トランジスタのソース電位の揺れを抑えることができるようにしたので、発光輝度のばらつきを低減することができる。なお、本開示の効果は、ここに記載された効果に必ずしも限定されず、本明細書中に記載されたいずれの効果であってもよい。
以下、本開示を実施するための形態について、図面を参照して詳細に説明する。以下に説明する実施の形態は、いずれも本開示の好ましい一具体例を示すものである。したがって、以下の実施の形態で示される数値、形状、材料、構成要素、構成要素の配置位置及び接続形態などは、一例であって本開示を限定する主旨ではない。よって、以下の実施の形態における構成要素のうち、本開示の最上位概念を示す独立請求項に記載されていない構成要素については、任意の構成要素として説明される。なお、各図は、模式図であり、必ずしも厳密に図示されたものではない。また、各図において、実質的に同一の構成に対しては同一の符号を付しており、重複する説明は省略又は簡略化する。なお、説明は以下の順序で行う。
１．第１の実施の形態（表示装置）
２．第２の実施の形態（表示装置）
３．第３の実施の形態（表示装置）
４．第３の実施の形態の変形例（表示装置）
５．第４の実施の形態（表示装置）
６．適用例（電子機器）
１．第１の実施の形態（表示装置）
２．第２の実施の形態（表示装置）
３．第３の実施の形態（表示装置）
４．第３の実施の形態の変形例（表示装置）
５．第４の実施の形態（表示装置）
６．適用例（電子機器）
＜１．第１の実施の形態＞
[構成]
図１は、本開示の第１の実施の形態に係る表示装置１の概略構成を表したものである。表示装置１は、例えば、画素アレイ部１０、コントローラ２０およびドライバ３０を備えている。コントローラ２０およびドライバ３０が、本開示の「駆動回路」の一具体例に対応する。画素アレイ部１０は、複数の画素１１が行列状に配置されてなる。コントローラ２０およびドライバ３０は、外部から入力された映像信号Ｄｉｎおよび同期信号Ｔｉｎに基づいて、複数の画素１１を駆動する。
[構成]
図１は、本開示の第１の実施の形態に係る表示装置１の概略構成を表したものである。表示装置１は、例えば、画素アレイ部１０、コントローラ２０およびドライバ３０を備えている。コントローラ２０およびドライバ３０が、本開示の「駆動回路」の一具体例に対応する。画素アレイ部１０は、複数の画素１１が行列状に配置されてなる。コントローラ２０およびドライバ３０は、外部から入力された映像信号Ｄｉｎおよび同期信号Ｔｉｎに基づいて、複数の画素１１を駆動する。
（画素アレイ部１０）
図２は、画素アレイ部１０に含まれる各画素１１の回路構成の一例を表したものである。画素アレイ部１０は、コントローラ２０およびドライバ３０によって各画素１１がアクティブマトリクス駆動されることにより、外部から入力された映像信号Ｄｉｎおよび同期信号Ｔｉｎに基づく画像を表示する。画素アレイ部１０は、行方向に延在する複数の走査線ＷＳＬ、複数の電源制御線ＤＳＬおよび複数の制御線ＣＴＬ１，ＣＴＬ２，ＣＴＬ３と、列方向に延在する複数の信号線ＤＴＬとを有している。画素アレイ部１０は、さらに、走査線ＷＳＬと信号線ＤＴＬとが互いに交差する箇所ごとに１つずつ設けられた複数の画素１１を有している。
図２は、画素アレイ部１０に含まれる各画素１１の回路構成の一例を表したものである。画素アレイ部１０は、コントローラ２０およびドライバ３０によって各画素１１がアクティブマトリクス駆動されることにより、外部から入力された映像信号Ｄｉｎおよび同期信号Ｔｉｎに基づく画像を表示する。画素アレイ部１０は、行方向に延在する複数の走査線ＷＳＬ、複数の電源制御線ＤＳＬおよび複数の制御線ＣＴＬ１，ＣＴＬ２，ＣＴＬ３と、列方向に延在する複数の信号線ＤＴＬとを有している。画素アレイ部１０は、さらに、走査線ＷＳＬと信号線ＤＴＬとが互いに交差する箇所ごとに１つずつ設けられた複数の画素１１を有している。
走査線ＷＳＬは、各画素１１の選択に用いられるものであり、各画素１１を所定の単位（例えば画素行）ごとに選択する選択パルスを各画素１１に供給するものである。信号線ＤＴＬは、映像信号Ｄｉｎに応じた信号電圧Ｖｓｉｇの、各画素１１への供給に用いられるものであり、信号電圧Ｖｓｉｇを含むデータパルスを各画素１１に供給するものである。電源制御線ＤＳＬは、各画素１１への電力の供給を制御する制御パルスを各画素１１に供給するものである。具体的には、制御線ＤＳＬは、後述のスイッチングトランジスタＴｒ３のオンオフを制御する制御パルスを各画素１１に供給するものである。制御線ＣＴＬ１は、後述のスイッチングトランジスタＴｒ４のオンオフを制御する制御パルスを各画素１１に供給するものである。制御線ＣＴＬ２は、後述のスイッチングトランジスタＴｒ５のオンオフを制御する制御パルスを各画素１１に供給するものである。制御線ＣＴＬ３は、後述のスイッチングトランジスタＴｒ６のオンオフを制御する制御パルスを各画素１１に供給するものである。
各画素１１は、例えば、画素回路１２と、有機ＥＬ素子１３とを有している。有機ＥＬ素子１３が、本開示の「発光素子」の一具体例に対応する。有機ＥＬ素子１３は、例えば、アノード電極、有機層およびカソード電極が順に積層された構成を有している。有機ＥＬ素子１３は、素子容量（後述の素子容量Ｃｅｌ）を有している。画素回路１２は、有機ＥＬ素子１３の発光・消光を制御する。画素回路１２は、後述の書込走査によって各画素１１に書き込んだ電圧を保持する機能を有している。画素回路１２は、例えば、書き込みトランジスタＴｒ１、駆動トランジスタＴｒ２、スイッチングトランジスタＴｒ３，Ｔｒ４，Ｔｒ５，Ｔｒ６および保持容量Ｃｓ１，Ｃｓ２を含んで構成されている。
スイッチングトランジスタＴｒ３は、本開示の「第３スイッチングトランジスタ」の一具体例に対応する。スイッチングトランジスタＴｒ４は、本開示の「第１スイッチングトランジスタ」の一具体例に対応する。スイッチングトランジスタＴｒ５は、本開示の「第４スイッチングトランジスタ」の一具体例に対応する。スイッチングトランジスタＴｒ６は、本開示の「第２スイッチングトランジスタ」の一具体例に対応する。保持容量Ｃｓ１は本開示の「第１保持容量」の一具体例に対応する。保持容量Ｃｓ２本開示の「第２保持容量」の一具体例に対応する。
書き込みトランジスタＴｒ１は、駆動トランジスタＴｒ２のゲートに対する、映像信号Ｄｉｎに対応した信号電圧Ｖｓｉｇの印加を制御する。具体的には、書き込みトランジスタＴｒ１は、信号線ＤＴＬの電圧をサンプリングするとともに、サンプリングにより得られた電圧を、保持容量Ｃｓ２を介して駆動トランジスタＴｒ２のゲートに書き込む。駆動トランジスタＴｒ２は、有機ＥＬ素子１３に直列に接続されている。駆動トランジスタＴｒ２は、有機ＥＬ素子１３を駆動する。駆動トランジスタＴｒ２は、書き込みトランジスタＴｒ１によってサンプリングされた電圧の大きさに応じて有機ＥＬ素子１３に流れる電流を制御する。
保持容量Ｃｓ１は、駆動トランジスタＴｒ２のゲート−ソース間に所定の電圧を保持するものである。保持容量Ｃｓ２は、書き込みトランジスタＴｒ１の、駆動トランジスタＴｒ２側の端子Ｐ１と、駆動トランジスタＴｒ２のゲートとの間に所定の電圧を保持するものである。保持容量Ｃｓ１は、駆動トランジスタＴｒ２のゲートと、有機ＥＬ素子１３のアノード（駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２）との間の導電パスに設けられている。保持容量Ｃｓ２は、書き込みトランジスタＴｒ１の、駆動トランジスタＴｒ２側の端子Ｐ１と、駆動トランジスタＴｒ２のゲートとの間の導電パスに設けられている。
保持容量Ｃｓ１の容量と、保持容量Ｃｓ２の容量とは、例えば、互いに等しくなっている。スイッチングトランジスタＴｒ３は、駆動トランジスタＴｒ２に流れる電流を制御する。スイッチングトランジスタＴｒ３は、固定電圧線Ｖｃｃと、駆動トランジスタＴｒ２の、固定電圧線Ｖｃｃ側の端子との間の導電パスに設けられている。従って、スイッチングトランジスタＴｒ３は、スイッチングトランジスタＴｒ３がオンすることにより、駆動トランジスタＴｒ２に所定の電流を供給する。スイッチングトランジスタＴｒ４は、駆動トランジスタＴｒ２のゲート−ソース間電圧を駆動トランジスタＴｒ２の閾値電圧Ｖｔｈに近づける補正動作を行う際の駆動トランジスタＴｒ２のゲート電圧Ｖｇを制御する。スイッチングトランジスタＴｒ４は、駆動トランジスタＴｒ２のゲートおよびスイッチングトランジスタＴｒ３側の端子の間の導電パスに設けられている。
スイッチングトランジスタＴｒ５は、駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２に対する、固定電圧線Ｖｓｓの電圧の印加を制御する。スイッチングトランジスタＴｒ５は、駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２と、固定電圧線Ｖｓｓとの間の導電パスに設けられている。スイッチングトランジスタＴｒ６は、駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２と、書き込みトランジスタＴｒ１の、有機ＥＬ素子１３側の端子Ｐ１との間の導電パスに設けられている。
書き込みトランジスタＴｒ１、駆動トランジスタＴｒ２およびスイッチングトランジスタＴｒ３，Ｔｒ４，Ｔｒ５，Ｔｒ６は、例えば、ｎチャネルＭＯＳ型の薄膜トランジスタ（ＴＦＴ（Thin Film Transistor））により形成されている。なお、書き込みトランジスタＴｒ１およびスイッチングトランジスタＴｒ３，Ｔｒ４，Ｔｒ５，Ｔｒ６が、ｐチャネルＭＯＳ型のＴＦＴにより形成されていてもよい。これらのトランジスタがエンハンスメント型であるものとして、以下の説明がなされているが、これらのトランジスタが、デプレッション型であってもよい。
各信号線ＤＴＬは、後述の水平セレクタ３１の出力端（図示せず）と、書き込みトランジスタＴｒ１のソースまたはドレインとに接続されている。各走査線ＷＳＬは、後述のライトスキャナ３２の出力端（図示せず）と、書き込みトランジスタＴｒ１のゲートとに接続されている。各電源制御線ＤＳＬは、後述のドライブスキャナ３３の出力端（図示せず）と、スイッチングトランジスタＴｒ３のゲートとに接続されている。
各制御線ＣＴＬ１は、後述の制御スキャナ３４Ａの出力端（図示せず）と、スイッチングトランジスタＴｒ４のゲートとに接続されている。各制御線ＣＴＬ２は、後述の制御スキャナ３４Ｂの出力端（図示せず）と、スイッチングトランジスタＴｒ５のゲートとに接続されている。各制御線ＣＴＬ３は、後述の制御スキャナ３４Ａの出力端（図示せず）と、スイッチングトランジスタＴｒ６のゲートとに接続されている。
書き込みトランジスタＴｒ１のゲートは、走査線ＷＳＬに接続されている。書き込みトランジスタＴｒ１のソースまたはドレインが信号線ＤＴＬに接続されている。書き込みトランジスタＴｒ１のソースおよびドレインのうち信号線ＤＴＬに未接続の端子（端子Ｐ１）が保持容量Ｃｓ２に接続されている。駆動トランジスタＴｒ２のゲートは、保持容量Ｃｓ２に接続されている。駆動トランジスタＴｒ２のソースまたはドレインがスイッチングトランジスタＴｒ３のソースまたはドレインに接続されている。駆動トランジスタＴｒ２のソースおよびドレインのうちスイッチングトランジスタＴｒ３に未接続の端子（端子Ｐ２）が有機ＥＬ素子１３のアノードに接続されている。
スイッチングトランジスタＴｒ３のゲートは、電源制御線ＤＳＬに接続されている。スイッチングトランジスタＴｒ３のソースまたはドレインが固定電圧線Ｖｃｃに接続されている。スイッチングトランジスタＴｒ３のソースおよびドレインのうち固定電圧線Ｖｃｃに未接続の端子が駆動トランジスタＴｒ２のソースまたはドレインに接続されている。スイッチングトランジスタＴｒ４のゲートは、制御線ＣＴＬ１に接続されている。スイッチングトランジスタＴｒ４のソースまたはドレインが駆動トランジスタＴｒ２のゲートに接続されている。スイッチングトランジスタＴｒ４のソースおよびドレインのうち駆動トランジスタＴｒ２のゲートに未接続の端子が駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２とは別の端子）に接続されている。
スイッチングトランジスタＴｒ５のゲートは、制御線ＣＴＬ２に接続されている。スイッチングトランジスタＴｒ５のソースまたはドレインが固定電圧線Ｖｓｓに接続されている。スイッチングトランジスタＴｒ５のソースおよびドレインのうち固定電圧線Ｖｓｓに未接続の端子が駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２）に接続されている。スイッチングトランジスタＴｒ６のゲートは、制御線ＣＴＬ３に接続されている。スイッチングトランジスタＴｒ６のソースまたはドレインが書き込みトランジスタＴｒ１のソースまたはドレイン（端子Ｐ１）に接続されている。スイッチングトランジスタＴｒ６のソースおよびドレインのうち端子Ｐ１に未接続の端子が駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２）に接続されている。
保持容量Ｃｓ１の一端が駆動トランジスタＴｒ２のゲートに接続されている。保持容量Ｃｓ１の他端が駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２）に接続されている。保持容量Ｃｓ２の一端が書き込みトランジスタＴｒ１のソースまたはドレイン（端子Ｐ１）に接続されている。保持容量Ｃｓ２の他端が駆動トランジスタＴｒ２のゲートに接続されている。有機ＥＬ素子１３のアノードは、駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２）に接続されている。有機ＥＬ素子１３のカソードは、カソード電圧線Ｖｃａｔに接続されている。
ドライバ３０は、例えば、水平セレクタ３１、ライトスキャナ３２、ドライブスキャナ３３および制御スキャナ３４Ａ，３４Ｂを有している。
水平セレクタ３１は、例えば、制御信号の入力に応じて（同期して）、映像信号処理回路２１から入力されたアナログの信号電圧Ｖｓｉｇを、各信号線ＤＴＬに印加する。具体的には、水平セレクタ３１は、ライトスキャナ３２により選択された画素１１へ、信号線ＤＴＬを介して信号電圧Ｖｓｉｇを供給する。信号電圧Ｖｓｉｇは、映像信号Ｄｉｎに対応する電圧値となっている。
ライトスキャナ３２は、複数の画素１１を所定の単位ごとに走査する。具体的には、ライトスキャナ３２は、１フレーム期間において、各走査線ＷＳＬに選択パルスを順次、出力する。ライトスキャナ３２は、例えば、制御信号の入力に応じて（同期して）、複数の走査線ＷＳＬを所定のシーケンスで選択することにより、信号電圧Ｖｓｉｇの書き込みおよび発光を所望の順番で実行させる。信号電圧Ｖｓｉｇの書き込み（信号書込）とは、駆動トランジスタＴｒ２のゲートに対して、信号電圧Ｖｓｉｇを、書き込みトランジスタＴｒ１および保持容量Ｃｓ２を介して書き込む動作を指している。
ライトスキャナ３２は、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、ライトスキャナ３２は、駆動対象の画素１１へ、走査線ＷＳＬを介して２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給し、書き込みトランジスタＴｒ１のオンオフ制御を行う。オン電圧Ｖｏｎは、書き込みトランジスタＴｒ１のオン電圧以上の値となっている。オン電圧Ｖｏｎは、後述の「書き込み期間」などにライトスキャナ３２から出力される選択パルスの波高値である。オフ電圧Ｖｏｆｆは、書き込みトランジスタＴｒ１のオン電圧よりも低い値となっており、かつ、オン電圧Ｖｏｎよりも低い値となっている。
ドライブスキャナ３３は、例えば、制御信号の入力に応じて（同期して）、複数の電源制御線ＤＳＬを所定の単位ごとに順次選択する。ドライブスキャナ３３は、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、電源スキャナ３３は、電源制御線ＤＳＬを介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ３のオン電圧以上の値となっている。オン電圧Ｖｏｎは、後述の「発光期間」にドライブスキャナ３３から出力される電圧の波高値である。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ３のオン電圧よりも低い値となっている。
制御スキャナ３４Ａは、例えば、制御信号の入力に応じて（同期して）、複数の制御線ＣＴＬ１，ＣＴＬ３を所定の単位ごとに順次選択する。制御スキャナ３４Ａは、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、制御スキャナ３４Ａは、制御線ＣＴＬ１，ＣＴＬ３を介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ４、６のオン電圧以上の値となっている。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ４、６のオン電圧よりも低い値となっている。
制御スキャナ３４Ｂは、例えば、制御信号の入力に応じて（同期して）、複数の制御線ＣＴＬ２を所定の単位ごとに順次選択する。制御スキャナ３４Ｂは、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、制御スキャナ３４Ｂは、制御線ＣＴＬ２を介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ５のオン電圧以上の値となっている。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ５のオン電圧よりも低い値となっている。
（コントローラ２０）
次に、コントローラ２０について説明する。コントローラ２０は、例えば、映像信号処理回路２１、タイミング生成回路２２および電源回路２３を有している。映像信号処理回路２１は、例えば、外部から入力されたデジタルの映像信号Ｄｉｎに対して所定の補正を行い、それにより得られた映像信号に基づいて、信号電圧Ｖｓｉｇを生成する。映像信号処理回路２１は、例えば、生成した信号電圧Ｖｓｉｇを水平セレクタ３１に出力する。所定の補正としては、例えば、ガンマ補正や、オーバードライブ補正などが挙げられる。タイミング生成回路２２は、ドライバ３０内の各回路が連動して動作するように制御するものである。タイミング生成回路２２は、例えば、外部から入力された同期信号Ｔｉｎに応じて（同期して）、ドライバ３０内の各回路に対して制御信号を出力する。電源回路２３は、水平セレクタ３１、ライトスキャナ３２、ドライブスキャナ３３、制御スキャナ３４Ａ，３４Ｂ、映像信号処理回路２１およびタイミング生成回路２２等の種々の回路で必要となる種々の固定電圧を生成し、供給する。
次に、コントローラ２０について説明する。コントローラ２０は、例えば、映像信号処理回路２１、タイミング生成回路２２および電源回路２３を有している。映像信号処理回路２１は、例えば、外部から入力されたデジタルの映像信号Ｄｉｎに対して所定の補正を行い、それにより得られた映像信号に基づいて、信号電圧Ｖｓｉｇを生成する。映像信号処理回路２１は、例えば、生成した信号電圧Ｖｓｉｇを水平セレクタ３１に出力する。所定の補正としては、例えば、ガンマ補正や、オーバードライブ補正などが挙げられる。タイミング生成回路２２は、ドライバ３０内の各回路が連動して動作するように制御するものである。タイミング生成回路２２は、例えば、外部から入力された同期信号Ｔｉｎに応じて（同期して）、ドライバ３０内の各回路に対して制御信号を出力する。電源回路２３は、水平セレクタ３１、ライトスキャナ３２、ドライブスキャナ３３、制御スキャナ３４Ａ，３４Ｂ、映像信号処理回路２１およびタイミング生成回路２２等の種々の回路で必要となる種々の固定電圧を生成し、供給する。
[動作]
次に、本実施の形態の表示装置１の動作（消光から発光までの動作）について説明する。本実施の形態では、有機ＥＬ素子１３のＩ−Ｖ特性が経時変化しても、その影響を受けることなく、有機ＥＬ素子１３の発光輝度を一定に保つようにするために、有機ＥＬ素子１３のＩ−Ｖ特性の変動に対する補償動作を組み込んでいる。さらに、本実施の形態では、駆動トランジスタＴｒ２の閾値電圧が経時変化しても、その影響を受けることなく、有機ＥＬ素子１３の発光輝度を一定に保つようにするために、上記閾値電圧の変動に対する補正動作を組み込んでいる。
次に、本実施の形態の表示装置１の動作（消光から発光までの動作）について説明する。本実施の形態では、有機ＥＬ素子１３のＩ−Ｖ特性が経時変化しても、その影響を受けることなく、有機ＥＬ素子１３の発光輝度を一定に保つようにするために、有機ＥＬ素子１３のＩ−Ｖ特性の変動に対する補償動作を組み込んでいる。さらに、本実施の形態では、駆動トランジスタＴｒ２の閾値電圧が経時変化しても、その影響を受けることなく、有機ＥＬ素子１３の発光輝度を一定に保つようにするために、上記閾値電圧の変動に対する補正動作を組み込んでいる。
図３は、１つの画素１１に着目したときの走査線ＷＳＬ、電源制御線ＤＳＬおよび各種制御線ＣＴＬ１，ＣＴＬ２，ＣＴＬ３に印加される電圧ならびに駆動トランジスタＴｒ２のゲート電圧Ｖｇおよびソース電圧Ｖｓの経時変化の一例を表したものである。図４〜図７は、画素１１の動作の一例を表したものである。
まず、コントローラ２０およびドライバ３０は、駆動トランジスタＴｒ２のゲート−ソース間電圧Ｖｇｓを駆動トランジスタＴｒ２の閾値電圧Ｖｔｈに近づける閾値補正の準備を行う。閾値補正とは、駆動トランジスタＴｒ２のゲート−ソース間電圧Ｖｇｓを駆動トランジスタＴｒ２の閾値電圧に近づける補正動作を指している。閾値補正の準備前、有機ＥＬ素子１３は発光している。このとき、走査線ＷＳＬの電圧がＶｏｆｆとなっており、制御線ＣＴＬ１，ＣＴＬ２，ＣＴＬ３の電圧がＶｏｆｆとなっており、電源制御線ＤＳＬの電圧がＶｏｎとなっている（図４）。駆動トランジスタＴｒ２は飽和領域で動作するので、有機ＥＬ素子１３に流れる電流Ｉｄｓは、駆動トランジスタＴｒ２のゲート−ソース間電圧Ｖｇｓの大きさに応じた値となっている。
コントローラ２０およびドライバ３０は、閾値補正の準備を開始するにあたって、有機ＥＬ素子１３を消光する。具体的には、コントローラ２０およびドライバ３０は、スイッチングトランジスタＴｒ４，Ｔｒ５，Ｔｒ６をオンさせる（時刻Ｔ１、図５）。この時、駆動トランジスタＴｒ２のゲートにはＶｃｃが、駆動トランジスタＴｒ２の端子Ｐ２および書き込みトランジスタＴｒ１の端子Ｐ１にはＶｓｓが充電される。駆動トランジスタＴｒ２の端子Ｐ２に充電される電圧Ｖｓｓが有機ＥＬ素子１３の閾値Ｖｔｈｅｌとカソード電圧Ｖｃａｔの和よりも小さい時、つまりＶｓｓ＜Ｖｔｈｅｌ＋Ｖｃａｔであれば有機ＥＬ素子１３は消光する。また閾値補正動作を正常に行うためにＶｃｃとＶｓｓの差は駆動トランジスタＴｒ２の閾値電圧Ｖｔｈ以上とする必要がある。
次に、コントローラ２０およびドライバ３０は、閾値補正動作においてスイッチングトランジスタＴｒ３をオフさせる（時刻Ｔ２）。スイッチングトランジスタＴｒ３をオフすることで、図６に示したように電流が流れ、駆動トランジスタＴｒ２のゲート電圧が低下する。一定時間経過後、駆動トランジスタＴｒ２のゲート電圧はＶｓｓと駆動トランジスタＴｒ２の閾値電圧の和であるＶｓｓ＋Ｖｔｈとなり、保持容量Ｃｓ１、Ｃｓ２それぞれに、駆動トランジスタＴｒ２の閾値電圧Ｖｔｈが保持される。その後、スイッチングトランジスタＴｒ４、Ｔｒ６をオフする（時刻Ｔ３）。このようにして、コントローラ２０およびドライバ３０は、スイッチングトランジスタＴｒ５をオンさせるとともに、書き込みトランジスタＴｒ１をオフさせた状態で、スイッチングトランジスタＴｒ６およびスイッチングトランジスタＴｒ４をオンオフさせることにより、補正動作を行う。
次に、コントローラ２０およびドライバ３０は、書き込み期間において、書き込みトランジスタＴｒ１をオンさせ、書き込みトランジスタＴｒ１の端子Ｐ１に信号電圧Ｖｓｉｇを書き込む（時刻Ｔ４、図７）。この時、書き込みトランジスタＴｒ１の端子Ｐ１の電位変化が保持容量Ｃｓ２を介して駆動トランジスタＴｒ２のゲートに入力される。つまり、コントローラ２０およびドライバ３０は、補正動作を行った後、書き込みトランジスタＴｒ１をオンさせることにより、書き込みトランジスタＴｒ１のゲートに、信号電圧Ｖｓｉｇに対応する電圧を印加する。その結果、駆動トランジスタＴｒ２のゲート電圧は、図７で示すようにＶｘとなる。このＶｘは、駆動トランジスタＴｒ２の閾値電圧Ｖｔｈを含むので、駆動トランジスタＴｒ２のゲートソース電圧Ｖｇｓは駆動トランジスタＴｒ２の閾値電圧を反映したものとなる。コントローラ２０およびドライバ３０は、信号書き込み終了時に書き込みトランジスタＴｒ１をオフさせる（時刻Ｔ５）。最後に、コントローラ２０およびドライバ３０は、発光期間においてスイッチングトランジスタＴｒ５をオフし、スイッチングトランジスタＴｒ３をオンする(時刻Ｔ６、図４)。スイッチングトランジスタＴｒ３をオンすることで、電源回路２３から電流が流れ、有機ＥＬ素子１３は発光する。
[効果]
次に、本実施の形態の表示装置１における効果について説明する。
次に、本実施の形態の表示装置１における効果について説明する。
本実施の形態では、６つのトランジスタ（駆動トランジスタＴｒ２、書き込みトランジスタＴｒ１、４つのスイッチングトランジスタ（Ｔｒ３，Ｔｒ４，Ｔｒ５，Ｔｒ６））と、２つの保持容量（保持容量Ｃｓ１，Ｃｓ２）とが設けられている。これにより、少なくとも、駆動トランジスタＴｒ２のゲートへの信号電圧Ｖｓｉｇを書き込む際に、駆動トランジスタＴｒ２のソース電位の揺れを抑えることができる。その結果、発光輝度のばらつきを低減することができる。
本実施の形態では、駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓは信号書き込み前に行われる閾値補正動作によって補正される。これにより、有機ＥＬ素子１３に流れる電流のバラツキを補正することが可能となる。さらに、信号書き込み時に、駆動トランジスタＴｒ２のソース電圧は、スイッチングトランジスタＴｒ５を介してＶｓｓとなるので、駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓは、カソード電位の揺れの影響を受けず、変化することがない。その結果、ムラやクロストークのない均一な画質を得ることができる。
＜２．第２の実施の形態＞
[構成]
図８は、本開示の第２の実施の形態に係る表示装置２の概略構成を表したものである。表示装置２は、上記実施の形態に係る表示装置１において、制御スキャナ３４Ａの代わりに、制御スキャナ３４Ｃ，３４Ｄを設けたものに相当する。
[構成]
図８は、本開示の第２の実施の形態に係る表示装置２の概略構成を表したものである。表示装置２は、上記実施の形態に係る表示装置１において、制御スキャナ３４Ａの代わりに、制御スキャナ３４Ｃ，３４Ｄを設けたものに相当する。
本実施の形態では、各制御線ＣＴＬ１は、制御スキャナ３４Ｃの出力端（図示せず）と、スイッチングトランジスタＴｒ４のゲートとに接続されている。各制御線ＣＴＬ２は、制御スキャナ３４Ｂの出力端（図示せず）と、スイッチングトランジスタＴｒ５のゲートとに接続されている。各制御線ＣＴＬ３は、制御スキャナ３４Ｄの出力端（図示せず）と、スイッチングトランジスタＴｒ６のゲートとに接続されている。
制御スキャナ３４Ｃは、例えば、制御信号の入力に応じて（同期して）、複数の制御線ＣＴＬ１を所定の単位ごとに順次選択する。制御スキャナ３４Ｃは、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、制御スキャナ３４Ｃは、制御線ＣＴＬ１を介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ４のオン電圧以上の値となっている。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ４のオン電圧よりも低い値となっている。
制御スキャナ３４Ｄは、例えば、制御信号の入力に応じて（同期して）、複数の制御線ＣＴＬ３を所定の単位ごとに順次選択する。制御スキャナ３４Ｄは、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、制御スキャナ３４Ｄは、制御線ＣＴＬ３を介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ６のオン電圧以上の値となっている。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ６のオン電圧よりも低い値となっている。
[動作]
次に、本実施の形態の表示装置２の動作（消光から発光までの動作）について説明する。
次に、本実施の形態の表示装置２の動作（消光から発光までの動作）について説明する。
図９は、１つの画素１１に着目したときの走査線ＷＳＬ、電源制御線ＤＳＬおよび各種制御線ＣＴＬ１，ＣＴＬ２，ＣＴＬ３に印加される電圧の経時変化の一例を表したものである。図１０は、画素１１の動作の一例を表したものである。本実施の形態では、書き込み時に、書き込みトランジスタＴｒ１とスイッチングトランジスタＴｒ４とが互いに同時にオンしている期間（図９中の時刻Ｔ４〜Ｔ５内の一部）が存在している。
[効果]
信号書き込み時において、書き込みトランジスタＴｒ１とスイッチングトランジスタＴｒ４とを同時にオンする効果について説明する。
信号書き込み時において、書き込みトランジスタＴｒ１とスイッチングトランジスタＴｒ４とを同時にオンする効果について説明する。
本実施の形態では、６つのトランジスタ（駆動トランジスタＴｒ２、書き込みトランジスタＴｒ１、４つのスイッチングトランジスタ（Ｔｒ３，Ｔｒ４，Ｔｒ５，Ｔｒ６））と、２つの保持容量（保持容量Ｃｓ１，Ｃｓ２）とが設けられている。これにより、少なくとも、駆動トランジスタＴｒ２のゲートへの信号電圧Ｖｓｉｇを書き込む際に、駆動トランジスタＴｒ２のソース電位の揺れを抑えることができる。その結果、発光輝度のばらつきを低減することができる。
また、本実施の形態では、上述したように、信号書き込み前に、駆動トランジスタＴｒ２の閾値補正動作が行われている。これにより、書き込み時においてスイッチングトランジスタＴｒ４をオンする前には、駆動トランジスタＴｒ２のゲート電圧はＶｘという値となっている。この状態でスイッチングトランジスタＴｒ４をオンすると、図１０のように電流が流れる。この時、駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓが補正されるので、駆動トランジスタＴｒ２を流れる電流は駆動トランジスタＴｒ２の移動度を反映したものとなる。つまり、駆動トランジスタＴｒ２の移動度が大きいと、駆動トランジスタＴｒ２を流れる電流は大きく、駆動トランジスタＴｒ２の移動度が小さいと、駆動トランジスタＴｒ２を流れる電流は小さくなり、その値に応じて駆動トランジスタＴｒ２のゲート電圧も低下する。一定時間経過後、駆動トランジスタＴｒ２のゲート電圧がＶｙとなった時に、スイッチングトランジスタＴｒ４をオフすることで、駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓは移動度を反映した値となり、駆動トランジスタＴｒ２に対して閾値補正だけでなく移動度補正もすることができる。移動度補正とは、駆動トランジスタＴｒ２のゲート−ソース間に保持される電圧（ゲート−ソース間電圧Ｖｇｓ）を、駆動トランジスタＴｒ２の移動度の大きさに応じて補正する動作を指している。
＜３．第３の実施の形態＞
[構成]
図１１は、本開示の第３の実施の形態に係る表示装置３の概略構成を表したものである。表示装置３は、上記実施の形態に係る表示装置１において、制御スキャナ３４Ａ，３４Ｂの代わりに、制御スキャナ３４Ｅを設け，各画素回路１２を図１２に示した構成にしたものに相当する。
[構成]
図１１は、本開示の第３の実施の形態に係る表示装置３の概略構成を表したものである。表示装置３は、上記実施の形態に係る表示装置１において、制御スキャナ３４Ａ，３４Ｂの代わりに、制御スキャナ３４Ｅを設け，各画素回路１２を図１２に示した構成にしたものに相当する。
本実施の形態では、各制御線ＣＴＬ１，ＣＴＬ３は、制御スキャナ３４Ｅの出力端（図示せず）に接続されている。本実施の形態では、各画素回路１２は、例えば、書き込みトランジスタＴｒ１、駆動トランジスタＴｒ２、スイッチングトランジスタＴｒ４，Ｔｒ６および保持容量Ｃｓ１，Ｃｓ２を含んで構成されている。
書き込みトランジスタＴｒ１は、駆動トランジスタＴｒ２のゲートに対する、映像信号Ｄｉｎに対応した信号電圧Ｖｓｉｇの印加を制御する。具体的には、書き込みトランジスタＴｒ１は、信号線ＤＴＬの電圧をサンプリングするとともに、サンプリングにより得られた電圧を、保持容量Ｃｓ２を介して駆動トランジスタＴｒ２のゲートに書き込む。駆動トランジスタＴｒ２は、有機ＥＬ素子１３に直列に接続されている。駆動トランジスタＴｒ２は、有機ＥＬ素子１３を駆動する。駆動トランジスタＴｒ２は、書き込みトランジスタＴｒ１によってサンプリングされた電圧の大きさに応じて有機ＥＬ素子１３に流れる電流を制御する。
保持容量Ｃｓ１は、駆動トランジスタＴｒ２のゲート−ソース間に所定の電圧を保持するものである。保持容量Ｃｓ２は、書き込みトランジスタＴｒ１の、駆動トランジスタＴｒ２側の端子Ｐ１と、駆動トランジスタＴｒ２のゲートとの間に所定の電圧を保持するものである。保持容量Ｃｓ１は、駆動トランジスタＴｒ２のゲートと、有機ＥＬ素子１３のアノード（駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２）との間の導電パスに設けられている。保持容量Ｃｓ２は、書き込みトランジスタＴｒ１の、駆動トランジスタＴｒ２側の端子Ｐ１と、駆動トランジスタＴｒ２のゲートとの間の導電パスに設けられている。
保持容量Ｃｓ１の容量と、保持容量Ｃｓ２の容量とは、例えば、互いに等しくなっている。スイッチングトランジスタＴｒ４は、駆動トランジスタＴｒ２のゲート−ソース間電圧を駆動トランジスタＴｒ２の閾値電圧Ｖｔｈに近づける補正動作を行う際の駆動トランジスタＴｒ２のゲート電圧Ｖｇを制御する。スイッチングトランジスタＴｒ４は、駆動トランジスタＴｒ２のゲートおよび固定電圧線Ｖｏｆｓの間の導電パスに設けられている。スイッチングトランジスタＴｒ６は、駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２と、書き込みトランジスタＴｒ１の、有機ＥＬ素子１３側の端子Ｐ１との間の導電パスに設けられている。
各信号線ＤＴＬは、水平セレクタ３１の出力端（図示せず）と、書き込みトランジスタＴｒ１のソースまたはドレインとに接続されている。各走査線ＷＳＬは、後述のライトスキャナ３２の出力端（図示せず）と、書き込みトランジスタＴｒ１のゲートとに接続されている。各電源制御線ＤＳＬは、ドライブスキャナ３３の出力端（図示せず）と、駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２とは別の端子）とに接続されている。
各制御線ＣＴＬ１は、制御スキャナ３４Ｅの出力端（図示せず）と、スイッチングトランジスタＴｒ４のゲートとに接続されている。各制御線ＣＴＬ３は、制御スキャナ３４Ｅの出力端（図示せず）と、スイッチングトランジスタＴｒ６のゲートとに接続されている。
書き込みトランジスタＴｒ１は、駆動トランジスタＴｒ２のゲートに対する、映像信号Ｄｉｎに対応した信号電圧Ｖｓｉｇの印加を制御する。書き込みトランジスタＴｒ１のゲートは、走査線ＷＳＬに接続されている。書き込みトランジスタＴｒ１のソースまたはドレインが信号線ＤＴＬに接続されている。書き込みトランジスタＴｒ１のソースおよびドレインのうち信号線ＤＴＬに未接続の端子（端子Ｐ１）が保持容量Ｃｓ２に接続されている。駆動トランジスタＴｒ２は、有機ＥＬ素子１３に流れる電流を制御する。駆動トランジスタＴｒ２のゲートは、保持容量Ｃｓ２に接続されている。駆動トランジスタＴｒ２のソースまたはドレインが電源制御線ＤＳＬに接続されている。駆動トランジスタＴｒ２のソースおよびドレインのうち電源制御線ＤＳＬに未接続の端子（端子Ｐ２）が有機ＥＬ素子１３のアノードに接続されている。
スイッチングトランジスタＴｒ４は、駆動トランジスタＴｒ２のゲート−ソース間電圧を駆動トランジスタＴｒ２の閾値電圧Ｖｔｈに近づける補正動作を行う際の駆動トランジスタＴｒ２のゲート電圧Ｖｇを制御する。スイッチングトランジスタＴｒ４のゲートは、制御線ＣＴＬ１に接続されている。スイッチングトランジスタＴｒ４のソースまたはドレインが固定電圧線Ｖｏｆｓに接続されている。スイッチングトランジスタＴｒ４のソースおよびドレインのうち固定電圧線Ｖｏｆｓに未接続の端子が駆動トランジスタＴｒ２のゲートに接続されている。スイッチングトランジスタＴｒ６は、駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２と、書き込みトランジスタＴｒ１の、有機ＥＬ素子１３側の端子Ｐ１との間の導電パスに設けられている。スイッチングトランジスタＴｒ６のゲートは、制御線ＣＴＬ３に接続されている。スイッチングトランジスタＴｒ６のソースまたはドレインが書き込みトランジスタＴｒ１のソースまたはドレイン（端子Ｐ１）に接続されている。スイッチングトランジスタＴｒ６のソースおよびドレインのうち端子Ｐ１に未接続の端子が駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２）に接続されている。
保持容量Ｃｓ１は、駆動トランジスタＴｒ２のゲートと、有機ＥＬ素子１３のアノード（駆動トランジスタＴｒ２の、有機ＥＬ素子１３側の端子Ｐ２）との間の導電パスに設けられている。保持容量Ｃｓ１の一端が駆動トランジスタＴｒ２のゲートに接続されている。保持容量Ｃｓ１の他端が駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２）に接続されている。保持容量Ｃｓ２は、書き込みトランジスタＴｒ１の、駆動トランジスタＴｒ２側の端子Ｐ１と、駆動トランジスタＴｒ２のゲートとの間の導電パスに設けられている。保持容量Ｃｓ２の一端が書き込みトランジスタＴｒ１のソースまたはドレイン（端子Ｐ１）に接続されている。保持容量Ｃｓ２の他端が駆動トランジスタＴｒ２のゲートに接続されている。有機ＥＬ素子１３のアノードは、駆動トランジスタＴｒ２のソースまたはドレイン（端子Ｐ２）に接続されている。有機ＥＬ素子１３のカソードは、カソード電圧線Ｖｃａｔに接続されている。
ドライバ３０は、例えば、水平セレクタ３１、ライトスキャナ３２、ドライブスキャナ３３および制御スキャナ３４Ｅを有している。
ドライブスキャナ３３は、例えば、制御信号の入力に応じて（同期して）、複数の電源制御線ＤＳＬを所定の単位ごとに順次選択する。ドライブスキャナ３３は、例えば、２種類の電圧（Ｖｃｃ、Ｖｓｓ）を出力可能となっている。具体的には、電源スキャナ３３は、電源制御線ＤＳＬを介して、各画素１１へ２種類の電圧（Ｖｃｃ、Ｖｓｓ）を供給する。固定電圧Ｖｓｓは、有機ＥＬ素子１３の閾値電圧Ｖｔｈｅｌと、有機ＥＬ素子１３のカソード電圧Ｖｃａｔとを足し合わせた電圧（Ｖｔｈｅｌ＋Ｖｃａｔ）よりも低い電圧値である。固定電圧Ｖｃｃは、電圧（Ｖｔｈｅｌ＋Ｖｃａｔ）よりも高い電圧値である。
制御スキャナ３４Ｅは、例えば、制御信号の入力に応じて（同期して）、複数の制御線ＣＴＬ１，ＣＴＬ３を所定の単位ごとに順次選択する。制御スキャナ３４Ｅは、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、制御スキャナ３４Ｅは、制御線ＣＴＬ１，ＣＴＬ３を介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ４、６のオン電圧以上の値となっている。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ４、６のオン電圧よりも低い値となっている。
[動作]
次に、本実施の形態の表示装置３の動作（消光から発光までの動作）について説明する。
次に、本実施の形態の表示装置３の動作（消光から発光までの動作）について説明する。
図１３は、１つの画素１１に着目したときの走査線ＷＳＬ、電源制御線ＤＳＬおよび各種制御線ＣＴＬ１，ＣＴＬ３に印加される電圧ならびに駆動トランジスタＴｒ２のゲート電圧Ｖｇおよびソース電圧Ｖｓの経時変化の一例を表したものである。図１４〜図１８は、画素１１の動作の一例を表したものである。
まず、コントローラ２０およびドライバ３０は、駆動トランジスタＴｒ２のゲート−ソース間電圧Ｖｇｓを駆動トランジスタＴｒ２の閾値電圧Ｖｔｈに近づける閾値補正の準備を行う。閾値補正の準備前、有機ＥＬ素子１３は発光している。このとき、走査線ＷＳＬの電圧がＶｏｆｆとなっており、制御線ＣＴＬ１，ＣＴＬ３の電圧がＶｏｆｆとなっており、電源制御線ＤＳＬの電圧がＶｃｃとなっている（図１４）。駆動トランジスタＴｒ２は飽和領域で動作するので、有機ＥＬ素子１３に流れる電流Ｉｄｓは、駆動トランジスタＴｒ２のゲート−ソース間電圧Ｖｇｓの大きさに応じた値となっている。
コントローラ２０およびドライバ３０は、閾値補正の準備を開始するにあたって、有機ＥＬ素子１３を消光する。具体的には、コントローラ２０およびドライバ３０は、電源制御線ＤＳＬの電圧をＶｃｃからＶｓｓに変化させ（時刻Ｔ１）、スイッチングトランジスタＴｒ６をオンさせる（図１５）。この時、Ｖｓｓが有機ＥＬ素子１３の閾値Ｖｔｈｅｌとカソード電圧Ｖｃａｔの和よりも小さい時、つまりＶｓｓ＜Ｖｔｈｅｌ＋Ｖｃａｔであれば有機ＥＬ素子１３は消光し、駆動トランジスタＴｒ２の端子Ｐ２および書き込みトランジスタＴｒ１の端子Ｐ１はＶｓｓという値となる。
次に、コントローラ２０およびドライバ３０は、スイッチングトランジスタＴｒ４をオンさせ、駆動トランジスタＴｒ２のゲート電圧をＶｏｆｓにする。この時、駆動トランジスタＴｒ２のゲートソース間電圧ＶｇｓはＶｏｆｓ−Ｖｓｓという値となる。このＶｏｆｓ−Ｖｓｓが駆動トランジスタＴｒ２の閾値電圧Ｖｔｈよりも大きくないと閾値補正動作を行うことができないので、Ｖｏｆｓ−Ｖｓｓ＞Ｖｔｈとする必要がある。
次に、コントローラ２０およびドライバ３０は、閾値補正期間において、電源制御線ＤＳＬの電圧をＶｓｓからＶｃｃに変化させる（時刻Ｔ２、図１６）。これにより、有機ＥＬ素子１３のアノードが駆動トランジスタＴｒ２のソースとなり、図１６に示したように電流が流れる。この時、有機ＥＬ素子１３のアノード電圧が、有機ＥＬ素子１３のカソード電圧と有機ＥＬ素子１３の閾値電圧の和よりも小さければ、有機ＥＬ素子１３に電流が流れることがなく、正常に閾値補正動作が行われ、駆動トランジスタＴｒ２のソース電位は上昇し、一定時間経過後、駆動トランジスタＴｒ２のゲートソース間電圧はＶｔｈという値をとり、保持容量Ｃｓ１，Ｃｓ２それぞれに保持される。その後、コントローラ２０およびドライバ３０は、スイッチングトランジスタＴｒ４をオフさせる（時刻Ｔ３）。このように、コントローラ２０およびドライバ３０は、スイッチングトランジスタＴｒ６をオンさせるとともに、書き込みトランジスタＴｒ１をオフさせた状態で、スイッチングトランジスタＴｒ４をオンオフさせ、保持容量Ｃｓ１，Ｃｓ２に、駆動トランジスタＴｒ２の閾値電圧Ｖｔｈに対応する電圧を保持させることにより、補正動作を行う。
次に、コントローラ２０およびドライバ３０は、閾値転送期間において、電源制御線ＤＳＬの電圧をＶｃｃからＶｓｓに変化させる（時刻Ｔ４、図１７）。これにより、有機ＥＬ素子１３のアノード電圧が低下する。この時、スイッチングトランジスタＴｒ４はオフしているので、保持容量Ｃｓ１，Ｃｓ２によって駆動トランジスタＴｒ２のゲートソース間電位Ｖｇｓは駆動トランジスタＴｒ２の閾値電圧Ｖｔｈに保持されたまま、駆動トランジスタＴｒ２のゲート電位も低下する。一定時間経過後、スイッチングトランジスタＴｒ６をオフする（時刻Ｔ５）。
次に、コントローラ２０およびドライバ３０は、書き込み期間において、書き込みトランジスタＴｒ１をオンさせ、書き込みトランジスタＴｒ１の端子Ｐ１に信号電圧Ｖｓｉｇを書き込む（時刻Ｔ６、図１８）。この時、書き込みトランジスタＴｒ１の端子Ｐ１の電位変化が保持容量Ｃｓ２を介して駆動トランジスタＴｒ２のゲートに入力される。つまり、コントローラ２０およびドライバ３０は、補正動作を行った後、書き込みトランジスタＴｒ１をオンさせることにより、書き込みトランジスタＴｒ１のゲートに、信号電圧Ｖｓｉｇに対応する電圧を印加する。駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓは駆動トランジスタＴｒ２の閾値電圧Ｖｔｈを含むため、駆動トランジスタＴｒ２のゲートソース電圧Ｖｇｓは駆動トランジスタＴｒ２の閾値電圧Ｖｔｈを反映したものとなる。その後、コントローラ２０およびドライバ３０は、信号書き込み終了時に、書き込みトランジスタＴｒ１をオフさせる（時刻Ｔ７）。最後に、コントローラ２０およびドライバ３０は、発光期間において、電源制御線ＤＳＬの電圧をＶｓｓからＶｃｃに変化させる（時刻Ｔ８）。これにより、電源制御線ＤＳＬから電流が流れ、有機ＥＬ素子１３は発光する(図１４)。
[効果]
本実施の形態では、４つのトランジスタ（駆動トランジスタＴｒ２、書き込みトランジスタＴｒ１、２つのスイッチングトランジスタ（Ｔｒ４，Ｔｒ６））と、２つの保持容量（保持容量Ｃｓ１，Ｃｓ２）とが設けられている。これにより、少なくとも、駆動トランジスタＴｒ２のゲートへの信号電圧Ｖｓｉｇを書き込む際に、駆動トランジスタＴｒ２のソース電位の揺れを抑えることができる。その結果、発光輝度のばらつきを低減することができる。
本実施の形態では、４つのトランジスタ（駆動トランジスタＴｒ２、書き込みトランジスタＴｒ１、２つのスイッチングトランジスタ（Ｔｒ４，Ｔｒ６））と、２つの保持容量（保持容量Ｃｓ１，Ｃｓ２）とが設けられている。これにより、少なくとも、駆動トランジスタＴｒ２のゲートへの信号電圧Ｖｓｉｇを書き込む際に、駆動トランジスタＴｒ２のソース電位の揺れを抑えることができる。その結果、発光輝度のばらつきを低減することができる。
また、本実施の形態では、上述したように、駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓは信号書き込み前に行われる閾値補正動作によって補正される。これにより、有機ＥＬ素子１３に流れる電流のバラツキを補正することが可能となる。さらに、電源制御線ＤＳＬの電圧がＶｓｓとなっている時に信号書き込みを行うので、駆動トランジスタＴｒ２のソース電圧は、Ｖｓｓとなっており、駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓはカソード電位の揺れの影響を受けず、変化することがない。その結果、ムラやクロストークのない均一な画質を得ることができる。
＜４．第３の実施の形態の変形例＞
以下に、上記第３の実施の形態に係る表示装置３の変形例について説明する。なお、以下では、上記実施の形態の表示装置１と共通する構成要素に対しては、同一の符号が付与される。さらに、上記実施の形態の表示装置１と共通する構成要素についての説明は、適宜、省略されるものとする。
以下に、上記第３の実施の形態に係る表示装置３の変形例について説明する。なお、以下では、上記実施の形態の表示装置１と共通する構成要素に対しては、同一の符号が付与される。さらに、上記実施の形態の表示装置１と共通する構成要素についての説明は、適宜、省略されるものとする。
上記実施の形態において、例えば、図１９に示したように、信号書き込み時において、電源制御線ＤＳＬの電圧をＶｓｓとは異なる値（Ｖｓｓ２）としてもよい。ここで、Ｖｓｓ２はＶｏｆｓよりも小さくＶｓｓよりも大きい値に設定されている。
上記第３の実施の形態において、書き込みトランジスタＴｒ１の端子Ｐ１における電圧変化が、保持容量Ｃｓ２を介して、駆動トランジスタＴｒ２のゲートに入力されている。黒表示を行う場合には、駆動トランジスタＴｒ２のゲート電圧の変化が負方向となっていることが好ましい。しかし、Ｖｓｓは、閾値補正動作を行うためにある程度小さくなっている必要がある。さらに、ドライブスキャナ３３は０Ｖ以上を出力する方が好ましい。そのため、上記第３の実施の形態における画素回路１２では、Ｖｓｓの電圧設定が難しい。そこで、本変形例では、閾値補正動作のときの電源制御線ＤＳＬの電圧をＶｓｓとし、さらに、信号書き込み前の電源制御線ＤＳＬの電圧をＶｓｓより大きいＶｓｓ２とすることで、比較的簡易に電圧設定を行うことができる。
＜５．第４の実施の形態＞
[構成]
図２０は、本開示の第４の実施の形態に係る表示装置４の概略構成を表したものである。図２１は、表示装置４における各画素１１の回路構成の一例を表したものである。表示装置４は、上記第３の実施の形態に係る表示装置３において、さらに、制御スキャナ３４Ｆを設けるとともに、画素１１ごとにスイッチングトランジスタＴｒ７を設けたものに相当する。スイッチングトランジスタＴｒ７は、本開示の「第６スイッチングトランジスタ」の一具体例に対応する。スイッチングトランジスタＴｒ７のゲートには、制御線ＣＴＬ４が接続されており、制御線ＣＴＬ４は制御スキャナ３４Ｆの出力端（図示せず）に接続されている。スイッチングトランジスタＴｒ７は、例えば、図２１に示したように、駆動トランジスタＴｒ２の端子Ｐ２と、有機ＥＬ素子１３のアノードとの間に設けられている。
[構成]
図２０は、本開示の第４の実施の形態に係る表示装置４の概略構成を表したものである。図２１は、表示装置４における各画素１１の回路構成の一例を表したものである。表示装置４は、上記第３の実施の形態に係る表示装置３において、さらに、制御スキャナ３４Ｆを設けるとともに、画素１１ごとにスイッチングトランジスタＴｒ７を設けたものに相当する。スイッチングトランジスタＴｒ７は、本開示の「第６スイッチングトランジスタ」の一具体例に対応する。スイッチングトランジスタＴｒ７のゲートには、制御線ＣＴＬ４が接続されており、制御線ＣＴＬ４は制御スキャナ３４Ｆの出力端（図示せず）に接続されている。スイッチングトランジスタＴｒ７は、例えば、図２１に示したように、駆動トランジスタＴｒ２の端子Ｐ２と、有機ＥＬ素子１３のアノードとの間に設けられている。
制御スキャナ３４Ｆは、例えば、制御信号の入力に応じて（同期して）、複数の制御線ＣＴＬ４を所定の単位ごとに順次選択する。制御スキャナ３４Ｆは、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、制御スキャナ３４Ｆは、制御線ＣＴＬ４を介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ７のオン電圧以上の値となっている。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ７のオン電圧よりも低い値となっている。
本実施の形態では、コントローラ２０およびドライバ３０は、例えば、図２２に示したように、電源制御線ＤＳＬの電圧をＶｃｃからＶｓｓに変化させ、スイッチングトランジスタＴｒ６をオンさせるとともに、制御線ＣＴＬ４の電圧をＶｏｎからＶｏｆｆに変化させ、スイッチングトランジスタＴｒ７をオフさせる（時刻Ｔ１）。その後、コントローラ２０およびドライバ３０は、例えば、図２２に示したように、発光期間において、電源制御線ＤＳＬの電圧をＶｓｓからＶｃｃに変化させるとともに、制御線ＣＴＬ４の電圧をＶｏｆｆからＶｏｎに変化させる（時刻Ｔ８）。これにより、電源制御線ＤＳＬから電流が流れ、有機ＥＬ素子１３は発光する。つまり、本実施の形態では、コントローラ２０およびドライバ３０は、例えば、図２２に示したように、閾値補正や書込みをしている際に、スイッチングトランジスタＴｒ７をオフして、駆動トランジスタＴｒ２の端子Ｐ２と、有機ＥＬ素子１３のアノードとを非接続としている。具体的には、コントローラ２０およびドライバ３０は、例えば、図２２に示したように、スイッチングトランジスタＴｒ６をオンさせるとともに、書き込みトランジスタＴｒ１およびスイッチングトランジスタＴｒ７をオフさせた状態で、スイッチングトランジスタＴｒ４をオンオフさせることにより、補正動作を行う。これにより、少なくとも、駆動トランジスタＴｒ２のゲートへの信号電圧Ｖｓｉｇを書き込む際に、駆動トランジスタＴｒ２のソース電位の揺れを抑えることができる。その結果、発光輝度のばらつきを低減することができる。
＜６．第５の実施の形態＞
[構成]
図２３は、本開示の第５の実施の形態に係る表示装置５の概略構成を表したものである。図２４は、表示装置５における各画素１１の回路構成の一例を表したものである。表示装置５は、上記第３の実施の形態に係る表示装置３において、さらに、制御スキャナ３４Ｇを設けるとともに、画素１１ごとにスイッチングトランジスタＴｒ５を設けたものに相当する。スイッチングトランジスタＴｒ５は、本開示の「第４スイッチングトランジスタ」の一具体例に対応する。スイッチングトランジスタＴｒ５のゲートには、制御線ＣＴＬ２が接続されており、制御線ＣＴＬ２は制御スキャナ３４Ｇの出力端（図示せず）に接続されている。スイッチングトランジスタＴｒ５は、例えば、図２４に示したように、駆動トランジスタＴｒ２の端子Ｐ２と、固定電圧線Ｖｓｓとの間の導電パスに設けられている。スイッチングトランジスタＴｒ５は、駆動トランジスタＴｒ２の端子Ｐ２に対する、固定電圧Ｖｓｓの印加を制御する。
[構成]
図２３は、本開示の第５の実施の形態に係る表示装置５の概略構成を表したものである。図２４は、表示装置５における各画素１１の回路構成の一例を表したものである。表示装置５は、上記第３の実施の形態に係る表示装置３において、さらに、制御スキャナ３４Ｇを設けるとともに、画素１１ごとにスイッチングトランジスタＴｒ５を設けたものに相当する。スイッチングトランジスタＴｒ５は、本開示の「第４スイッチングトランジスタ」の一具体例に対応する。スイッチングトランジスタＴｒ５のゲートには、制御線ＣＴＬ２が接続されており、制御線ＣＴＬ２は制御スキャナ３４Ｇの出力端（図示せず）に接続されている。スイッチングトランジスタＴｒ５は、例えば、図２４に示したように、駆動トランジスタＴｒ２の端子Ｐ２と、固定電圧線Ｖｓｓとの間の導電パスに設けられている。スイッチングトランジスタＴｒ５は、駆動トランジスタＴｒ２の端子Ｐ２に対する、固定電圧Ｖｓｓの印加を制御する。
制御スキャナ３４Ｇは、例えば、制御信号の入力に応じて（同期して）、複数の制御線ＣＴＬ２を所定の単位ごとに順次選択する。制御スキャナ３４Ｇは、例えば、２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を出力可能となっている。具体的には、制御スキャナ３４Ｇは、制御線ＣＴＬ２を介して、各画素１１へ２種類の電圧（Ｖｏｎ、Ｖｏｆｆ）を供給する。オン電圧Ｖｏｎは、スイッチングトランジスタＴｒ５のオン電圧以上の値となっている。オフ電圧Ｖｏｆｆは、スイッチングトランジスタＴｒ５のオン電圧よりも低い値となっている。本実施の形態では、ドライブスキャナ３３は、電源制御線ＤＳＬに対して、固定電圧Ｖｃｃを出力可能となっている。
本実施の形態では、例えば、図２５に示したように、電源制御線ＤＳＬの電圧が固定電圧Ｖｃｃとなっており、画素回路１２が、駆動トランジスタＴｒ２の端子Ｐ２にスイッチングトランジスタＴｒ５を介して固定電源Ｖｓｓを接続した構成となっている。上記第３の実施の形態に係る画素回路１２では、電圧降下等を考えて電源制御線ＤＳＬは低抵抗にする必要がある。しかし、電源制御線ＤＳＬはトランジスタの制御線と同一方向に配線しなければならず、低抵抗化が比較的難しかった。それに対して、本実施の形態では、電源制御線ＤＳＬを固定電圧Ｖｃｃとしたことで、トランジスタの制御線と同一の方向に電源制御線ＤＳＬを配線する必要がなくなり、電源制御線ＤＳＬを低抵抗に配線することが比較的容易となっている。本実施の形態では、コントローラ２０およびドライバ３０は、例えば、図２５に示したように、スイッチングトランジスタＴｒ６をオンさせるとともに、書き込みトランジスタＴｒ１をオフさせた状態で、スイッチングトランジスタＴｒ５およびスイッチングトランジスタＴｒ４をオンオフさせることにより、補正動作を行う。
図２４に示す画素回路１２では、非発光時は駆動トランジスタＴｒ２のゲートにＶｏｆｓを書き込むことで有機ＥＬ素子１３を消光する駆動方式が取られている。また、図２４に示す画素回路１２においても、信号書き込み時に駆動トランジスタＴｒ２の端子Ｐ２はスイッチングトランジスタＴｒ５によってＶｓｓとなるので、駆動トランジスタＴｒ２のゲートソース間電圧Ｖｇｓはカソード電位の揺れの影響を受けることがない。その結果ムラやクロストークのない均一な画質を得ることができる。
＜６．適用例＞
以下、上記各実施の形態およびそれらの変形例（以下、「上記実施の形態等」と称する。）で説明した表示装置１〜５の適用例について説明する。上記実施の形態等の表示装置１〜５は、テレビジョン装置、デジタルカメラ、ノート型パーソナルコンピュータ、携帯電話等の携帯端末装置あるいはビデオカメラなど、外部から入力された映像信号あるいは内部で生成した映像信号を、画像あるいは映像として表示するあらゆる分野の電子機器の表示装置に適用することが可能である。
以下、上記各実施の形態およびそれらの変形例（以下、「上記実施の形態等」と称する。）で説明した表示装置１〜５の適用例について説明する。上記実施の形態等の表示装置１〜５は、テレビジョン装置、デジタルカメラ、ノート型パーソナルコンピュータ、携帯電話等の携帯端末装置あるいはビデオカメラなど、外部から入力された映像信号あるいは内部で生成した映像信号を、画像あるいは映像として表示するあらゆる分野の電子機器の表示装置に適用することが可能である。
図２６は、本適用例に係る電子機器６の概略構成例を表したものである。電子機器６は、例えば、折りたたみ可能な２枚の板状の筐体のうちの一方の筐体の主面に表示面６Ａを備えたノート型のパーソナルコンピュータである。電子機器６は、上記実施の形態等の表示装置１〜５を備えており、例えば、表示面６Ａの位置に画素アレイ部１０を備えている。本適用例では、上記実施の形態等の表示装置１〜５が設けられているので、発光輝度のばらつきを低減することができる。
以上、実施の形態、変形例および適用例を挙げて本開示を説明したが、本開示は実施の形態等に限定されるものではなく、種々変形が可能である。なお、本明細書中に記載された効果は、あくまで例示である。本開示の効果は、本明細書中に記載された効果に限定されるものではない。本開示が、本明細書中に記載された効果以外の効果を持っていてもよい。
また、例えば、本開示は以下のような構成を取ることができる。
（１）
発光素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタと、
前記駆動トランジスタのゲート−ソース間電圧を前記駆動トランジスタの閾値電圧に近づける補正動作を行う際の前記駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、
前記駆動トランジスタの、前記発光素子側の第１端子と、前記書き込みトランジスタの、前記駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタと、
前記駆動トランジスタのゲートと、前記第１端子との間の導電パスに設けられた第１保持容量と、
前記駆動トランジスタのゲートと、前記第２端子との間の導電パスに設けられた第２保持容量と
を備えた
画素回路。
（２）
前記駆動トランジスタに流れる電流を制御する第３スイッチングトランジスタと、
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタと
を更に備えた
（１）に記載の画素回路。
（３）
前記第１端子と、前記発光素子との間の導電パスに設けられた第６スイッチングトランジスタを更に備えた
（１）に記載の画素回路。
（４）
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタを更に備えた
（１）に記載の画素回路。
（５）
各々が発光素子と画素回路とを含む複数の画素と、
複数の前記画素を駆動する駆動回路と
を備え、
前記画素回路は、
発光素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタと、
前記駆動トランジスタのゲート−ソース間電圧を前記駆動トランジスタの閾値電圧に近づける補正動作を行う際の前記駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、
前記駆動トランジスタの、前記発光素子側の第１端子と、前記書き込みトランジスタの、前記駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタと、
前記駆動トランジスタのゲートと、前記第１端子との間の導電パスに設けられた第１保持容量と、
前記駆動トランジスタのゲートと、前記第２端子との間の導電パスに設けられた第２保持容量と
を有する
表示装置。
（６）
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第１スイッチングトランジスタをオンオフさせ、前記第１保持容量および前記第２保持容量に、前記駆動トランジスタの閾値電圧に対応する電圧を保持させることにより、前記補正動作を行う
（５）に記載の表示装置。
（７）
前記画素回路は、
前記駆動トランジスタに流れる電流を制御する第３スイッチングトランジスタと、
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタと
を更に有し、
前記第１スイッチングトランジスタが、前記駆動トランジスタのゲートおよび前記第３スイッチングトランジスタ側の端子の間の導電パスに設けられ、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第３スイッチングトランジスタおよび前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
（５）に記載の表示装置。
（８）
前記画素回路は、前記第１端子と、前記発光素子との間の導電パスに設けられた第６スイッチングトランジスタを更に有し、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタおよび前記第６スイッチングトランジスタをオフさせた状態で、前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
（５）に記載の表示装置。
（９）
前記画素回路は、前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタを更に有し、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第４スイッチングトランジスタおよび前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
（５）に記載の表示装置。
（１０）
前記駆動回路は、前記補正動作を行った後、前記書き込みトランジスタをオンさせることにより、前記書き込みトランジスタのゲートに、前記信号電圧に対応する電圧を印加する
（６）から（９）のいずれか一項に記載の表示装置。
（１）
発光素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタと、
前記駆動トランジスタのゲート−ソース間電圧を前記駆動トランジスタの閾値電圧に近づける補正動作を行う際の前記駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、
前記駆動トランジスタの、前記発光素子側の第１端子と、前記書き込みトランジスタの、前記駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタと、
前記駆動トランジスタのゲートと、前記第１端子との間の導電パスに設けられた第１保持容量と、
前記駆動トランジスタのゲートと、前記第２端子との間の導電パスに設けられた第２保持容量と
を備えた
画素回路。
（２）
前記駆動トランジスタに流れる電流を制御する第３スイッチングトランジスタと、
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタと
を更に備えた
（１）に記載の画素回路。
（３）
前記第１端子と、前記発光素子との間の導電パスに設けられた第６スイッチングトランジスタを更に備えた
（１）に記載の画素回路。
（４）
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタを更に備えた
（１）に記載の画素回路。
（５）
各々が発光素子と画素回路とを含む複数の画素と、
複数の前記画素を駆動する駆動回路と
を備え、
前記画素回路は、
発光素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタと、
前記駆動トランジスタのゲート−ソース間電圧を前記駆動トランジスタの閾値電圧に近づける補正動作を行う際の前記駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、
前記駆動トランジスタの、前記発光素子側の第１端子と、前記書き込みトランジスタの、前記駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタと、
前記駆動トランジスタのゲートと、前記第１端子との間の導電パスに設けられた第１保持容量と、
前記駆動トランジスタのゲートと、前記第２端子との間の導電パスに設けられた第２保持容量と
を有する
表示装置。
（６）
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第１スイッチングトランジスタをオンオフさせ、前記第１保持容量および前記第２保持容量に、前記駆動トランジスタの閾値電圧に対応する電圧を保持させることにより、前記補正動作を行う
（５）に記載の表示装置。
（７）
前記画素回路は、
前記駆動トランジスタに流れる電流を制御する第３スイッチングトランジスタと、
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタと
を更に有し、
前記第１スイッチングトランジスタが、前記駆動トランジスタのゲートおよび前記第３スイッチングトランジスタ側の端子の間の導電パスに設けられ、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第３スイッチングトランジスタおよび前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
（５）に記載の表示装置。
（８）
前記画素回路は、前記第１端子と、前記発光素子との間の導電パスに設けられた第６スイッチングトランジスタを更に有し、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタおよび前記第６スイッチングトランジスタをオフさせた状態で、前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
（５）に記載の表示装置。
（９）
前記画素回路は、前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタを更に有し、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第４スイッチングトランジスタおよび前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
（５）に記載の表示装置。
（１０）
前記駆動回路は、前記補正動作を行った後、前記書き込みトランジスタをオンさせることにより、前記書き込みトランジスタのゲートに、前記信号電圧に対応する電圧を印加する
（６）から（９）のいずれか一項に記載の表示装置。
１〜５…表示装置、６…電子機器、６Ａ…表示面、１０…画素アレイ部、１１…画素、１２…画素回路、１３…有機ＥＬ素子、２０…コントローラ、２１…映像信号処理回路、２２…タイミング生成回路、２３…電源回路、３０…ドライバ、３１…水平セレクタ、３２…ライトスキャナ、３３…ドライブスキャナ、３４Ａ〜３４Ｈ…制御スキャナ、Ｃ１，Ｃ２，Ｃ３，Ｃ４…容量値、Ｃｅｌ…素子容量、Ｃｓ１，Ｃｓ２…保持容量、ＣＴＬ１〜ＣＴＬ５…制御線、Ｄｉｎ…映像信号、ＤＳＬ…電源線、ＤＴＬ…信号線、Ｉｄｓ…電流、Ｐ１，Ｐ２…端子、Ｔ１，Ｔ２，Ｔ３，Ｔ４，Ｔ５，Ｔ６…時刻、Ｔｉｎ…同期信号、Ｔｒ１…書き込みトランジスタＴｒ１…駆動トランジスタ、Ｔｒ３…発光制御トランジスタ、Ｔｒ４，Ｔｒ５，Ｔｒ６…スイッチングトランジスタ、Ｖｃａｔ…カソード電圧、Ｖｃｃ，Ｖｏｆｓ，Ｖｓｓ，Ｖｓｓ２…固定電圧、Ｖｇｓ…ゲート−ソース間電圧、Ｖｏｎ…オン電圧、Ｖｏｆｆ…オフ電圧、Ｖｓｉｇ…信号電圧、Ｖｔｈ，Ｖｔｈｅｌ…閾値電圧、Ｖｘ，Ｖｙ…電圧、ＷＳＬ…走査線、ΔＶ…増加量。
Claims (5)
- 発光素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタと、
前記駆動トランジスタのゲート−ソース間電圧を前記駆動トランジスタの閾値電圧に近づける補正動作を行う際の前記駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、
前記駆動トランジスタの、前記発光素子側の第１端子と、前記書き込みトランジスタの、前記駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタと、
前記駆動トランジスタのゲートと、前記第１端子との間の導電パスに設けられた第１保持容量と、
前記駆動トランジスタのゲートと、前記第２端子との間の導電パスに設けられた第２保持容量と、
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタと
を備えた
画素回路。 - 前記駆動トランジスタに流れる電流を制御する第３スイッチングトランジスタを更に備えた
請求項１に記載の画素回路。 - 各々が発光素子と画素回路とを含む複数の画素と、
複数の前記画素を駆動する駆動回路と
を備え、
前記画素回路は、
発光素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタと、
前記駆動トランジスタのゲート−ソース間電圧を前記駆動トランジスタの閾値電圧に近づける補正動作を行う際の前記駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、
前記駆動トランジスタの、前記発光素子側の第１端子と、前記書き込みトランジスタの、前記駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタと、
前記駆動トランジスタのゲートと、前記第１端子との間の導電パスに設けられた第１保持容量と、
前記駆動トランジスタのゲートと、前記第２端子との間の導電パスに設けられた第２保持容量と
を有し、
前記画素回路は、
前記駆動トランジスタに流れる電流を制御する第３スイッチングトランジスタと、
前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタと
を更に有し、
前記第１スイッチングトランジスタが、前記駆動トランジスタのゲートおよび前記第３スイッチングトランジスタ側の端子の間の導電パスに設けられ、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第３スイッチングトランジスタおよび前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
表示装置。 - 各々が発光素子と画素回路とを含む複数の画素と、
複数の前記画素を駆動する駆動回路と
を備え、
前記画素回路は、
発光素子に流れる電流を制御する駆動トランジスタと、
前記駆動トランジスタのゲートに対する、映像信号に対応した信号電圧の印加を制御する書き込みトランジスタと、
前記駆動トランジスタのゲート−ソース間電圧を前記駆動トランジスタの閾値電圧に近づける補正動作を行う際の前記駆動トランジスタのゲート電圧を制御する第１スイッチングトランジスタと、
前記駆動トランジスタの、前記発光素子側の第１端子と、前記書き込みトランジスタの、前記駆動トランジスタ側の第２端子との間の導電パスに設けられた第２スイッチングトランジスタと、
前記駆動トランジスタのゲートと、前記第１端子との間の導電パスに設けられた第１保持容量と、
前記駆動トランジスタのゲートと、前記第２端子との間の導電パスに設けられた第２保持容量と
を有し、
前記画素回路は、前記第１端子に対する、固定電圧の印加を制御する第４スイッチングトランジスタを更に有し、
前記駆動回路は、前記第２スイッチングトランジスタをオンさせるとともに、前記書き込みトランジスタをオフさせた状態で、前記第４スイッチングトランジスタおよび前記第１スイッチングトランジスタをオンオフさせることにより、前記補正動作を行う
表示装置。 - 前記駆動回路は、前記補正動作を行った後、前記書き込みトランジスタをオンさせることにより、前記書き込みトランジスタのゲートに、前記信号電圧に対応する電圧を印加する
請求項３または請求項４に記載の表示装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2018029573A JP6781176B2 (ja) | 2018-02-22 | 2018-02-22 | 画素回路および表示装置 |
| US16/239,875 US10685601B2 (en) | 2018-02-22 | 2019-01-04 | Pixel circuit and display unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2018029573A JP6781176B2 (ja) | 2018-02-22 | 2018-02-22 | 画素回路および表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2019144453A JP2019144453A (ja) | 2019-08-29 |
| JP6781176B2 true JP6781176B2 (ja) | 2020-11-04 |
Family
ID=67617987
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2018029573A Active JP6781176B2 (ja) | 2018-02-22 | 2018-02-22 | 画素回路および表示装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US10685601B2 (ja) |
| JP (1) | JP6781176B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN109087609A (zh) * | 2018-11-13 | 2018-12-25 | 京东方科技集团股份有限公司 | 像素电路及其驱动方法、显示基板、显示装置 |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4687026B2 (ja) | 2004-07-22 | 2011-05-25 | ソニー株式会社 | 表示装置および表示装置の駆動方法 |
| JP4655589B2 (ja) | 2004-11-08 | 2011-03-23 | ソニー株式会社 | 表示装置とその駆動方法及び画素回路の駆動方法 |
| KR101985502B1 (ko) * | 2012-07-04 | 2019-06-04 | 삼성디스플레이 주식회사 | 표시 장치, 표시 장치의 구동 제어 장치, 및 그 구동 제어 방법 |
| CN105225636B (zh) * | 2014-06-13 | 2017-05-31 | 京东方科技集团股份有限公司 | 像素驱动电路、驱动方法、阵列基板及显示装置 |
| CN106531074B (zh) * | 2017-01-10 | 2019-02-05 | 上海天马有机发光显示技术有限公司 | 有机发光像素驱动电路、驱动方法以及有机发光显示面板 |
| CN108630141B (zh) * | 2017-03-17 | 2019-11-22 | 京东方科技集团股份有限公司 | 像素电路、显示面板及其驱动方法 |
-
2018
- 2018-02-22 JP JP2018029573A patent/JP6781176B2/ja active Active
-
2019
- 2019-01-04 US US16/239,875 patent/US10685601B2/en active Active
Also Published As
| Publication number | Publication date |
|---|---|
| US20190259329A1 (en) | 2019-08-22 |
| JP2019144453A (ja) | 2019-08-29 |
| US10685601B2 (en) | 2020-06-16 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| US10733933B2 (en) | Pixel driving circuit and driving method thereof, display panel and display device | |
| JP2020112795A (ja) | ハイブリッド画素内及び外部補償を備えた電子ディスプレイ | |
| JP4715850B2 (ja) | 表示装置及びその駆動方法と電子機器 | |
| US8471838B2 (en) | Pixel circuit having a light detection element, display apparatus, and driving method for correcting threshold and mobility for light detection element of pixel circuit | |
| JP6853662B2 (ja) | 表示パネルおよび表示装置 | |
| JP4433039B2 (ja) | 表示装置及びその駆動方法と電子機器 | |
| JP4591511B2 (ja) | 表示装置及び電子機器 | |
| JP2009080365A (ja) | 表示装置及びその駆動方法と電子機器 | |
| JP5162807B2 (ja) | 電気光学装置及び電子機器 | |
| US9214110B2 (en) | Display unit and electronic apparatus | |
| JP2009080367A (ja) | 表示装置及びその駆動方法と電子機器 | |
| JP4984863B2 (ja) | 表示装置とその駆動方法 | |
| JP5909759B2 (ja) | 画素回路、表示パネル、表示装置および電子機器 | |
| JP2009048212A (ja) | 電気光学装置、電気光学装置の駆動方法および電子機器 | |
| JP6781176B2 (ja) | 画素回路および表示装置 | |
| JP6732822B2 (ja) | 画素回路および表示装置 | |
| JP6789796B2 (ja) | 表示装置および駆動方法 | |
| US9378677B2 (en) | Drive circuit, display unit, and electronic apparatus | |
| JP6774325B2 (ja) | 画素回路および表示装置 | |
| JP5239812B2 (ja) | 表示装置、表示装置の駆動方法および電子機器 | |
| JP2009098430A (ja) | 表示装置と電子機器 | |
| JP2020012934A (ja) | 表示パネルの駆動方法、駆動回路および表示装置 | |
| JP2015090478A (ja) | 表示装置および電子機器 | |
| JP2015106003A (ja) | 駆動回路、表示装置および電子機器 | |
| JP6811085B2 (ja) | 駆動回路および表示装置 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20190709 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20200624 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20200714 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20200824 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20201006 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20201015 |
|
| R151 | Written notification of patent or utility model registration |
Ref document number: 6781176 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R151 |
|
| S303 | Written request for registration of pledge or change of pledge |
Free format text: JAPANESE INTERMEDIATE CODE: R316303 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| S803 | Written request for registration of cancellation of provisional registration |
Free format text: JAPANESE INTERMEDIATE CODE: R316803 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313113 |