CN104751799A - 像素电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明提供一种像素电路及其驱动方法和一种显示装置，所述像素电路包括：驱动晶体管、发光器件、存储电容和选通模块，存储电容的第一端与驱动晶体管的栅极相连，存储电容的第二端与驱动晶体管的第一极相连，像素电路还包括补偿模块和开关模块，补偿模块包括：复位子模块，复位子模块的输出端与驱动晶体管的第二极相连，用于在复位阶段向驱动晶体管的第一极充电，以将驱动晶体管的阈值电压存储在存储电容内；分压子模块，分压子模块的第一端与所述驱动晶体管的第一极相连，所述分压子模块的第二端与高电平输入端相连，以使得所述分压子模块与所述存储电容并联。本发明能够减小阈值电压和电源内阻压降对显示均匀性的影响，改善显示效果。

Description

像素电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，具体涉及一种像素电路、该像素电路的驱动方法以及包括所述像素电路的显示装置。
背景技术
有机发光(Organic Light Emitting Diode，OLED)作为一种电流型发光器件，因其所具有的自发光、快速响应、宽视角和可制作在柔性衬底上等特点越来越多地被应用于高性能显示领域中。
在OLED器件发光时，所有像素的驱动电流时由背板电源提供，而由于背板电源线存在一定电阻，因此，靠近电源供电位置区域的电源电压比远离供电位置区域的电源电压要高，这种现象被称为电源内阻压降(IR drop)，随着OLED显示器的尺寸增大，电源内阻压降现象越明显。另外，每个像素电路中都集成了一组薄膜晶体管和存储电容，通过OLED的电流不仅会受数据电压的控制，还会受到薄膜晶体管TFT阈值电压的影响。由于多个像素电路中的薄膜晶体管不可能具备完全一致的性能，导致不同像素电路中的薄膜晶体管的阈值电压存在差异，从而使得通过OLED的电流也会存在差异，进而影响整个显示屏显示亮度的均匀性。
发明内容
本发明的目的在于提供一种像素电路及其驱动方法、一种显示装置，以减小阈值电压和电源内阻压降对显示均匀性的影响。
为了实现上述目的，本发明提供一种像素电路，包括：驱动晶体管、发光器件、存储电容和选通模块，所述选通模块连接在数据线和所述驱动晶体管的栅极之间，所述存储电容的第一端与所述驱动晶体管的栅极相连，所述存储电容的第二端与所述驱动晶体管的第一极相连，所述像素电路还包括补偿模块和开关模块，所述补偿模块包括：
复位子模块，所述复位子模块的输出端与所述驱动晶体管的第二极相连，用于在复位阶段向所述驱动晶体管的第一极充电，以将所述驱动晶体管的阈值电压存储在所述存储电容内；
分压子模块，所述分压子模块的第一端与所述驱动晶体管的第一极相连，所述分压子模块的第二端与高电平输入端相连，以使得所述分压子模块与所述存储电容并联；
所述开关模块与所述高电平输入端、所述驱动晶体管分别相连，用于在发光阶段使得所述高电平输入端与所述驱动晶体管的第一极导通。
优选地，所述复位子模块包括第一晶体管、复位控制端和参考电压端，所述第一晶体管的栅极与所述复位控制端相连，所述第一晶体管的第一极与所述参考电压端相连，所述第一晶体管的第二极与所述驱动晶体管的第二极相连。
优选地，所述参考电压端与所述选通模块的输出端相连。
优选地，所述分压子模块包括分压电容，所述分压电容的第一端形成为所述分压子模块的第一端，所述分压电容的第二端形成为所述分压子模块的第二端。
优选地，所述开关模块包括第二晶体管和发光控制信号端，所述第二晶体管的栅极与所述发光控制信号端相连，所述第二晶体管的第一极与高电平输入端相连，所述第二晶体管的第二极与所述驱动晶体管的第一极相连。
优选地，所述开关模块还与所述发光器件相连，在发光阶段使得所述驱动晶体管的第二极与所述发光器件的阳极导通。
优选地，所述开关模块包括第二晶体管、第三晶体管和发光控制信号线，所述第二晶体管的栅极与所述发光控制信号端相连，所述第二晶体管的第一极与高电平输入端相连，所述第二晶体管的第二极与所述驱动晶体管的第一极相连；所述第三晶体管的栅极与所述发光控制信号端相连，所述第三晶体管的第一极与所述驱动晶体管的第二极相连，所述第三晶体管的第二极与所述发光器件相连。
优选地，所述选通模块包括第四晶体管，所述第四晶体管的栅极与扫描线相连，所述第四晶体管的第一极与数据线相连，所述第四晶体管的第二极与所述驱动晶体管的栅极相连。
相应地，本发明还提供一种像素电路的驱动方法，所述像素电路为本发明提供的上述像素电路，所述驱动方法包括：
复位阶段，向所述驱动晶体管的栅极提供高电平的数据电压信号，所述复位子模块向所述驱动晶体管的第一极充电，以将所述驱动晶体管的阈值电压存储在所述存储电容内；
补偿阶段，向所述驱动晶体管的栅极提供低电平的预设电压信号，以将所述高电平的数据电压信号和所述阈值电压共同存储至所述存储电容中；
发光阶段，将所述选通模块关断，并通过所述开关模块将高电平输入端和所述驱动晶体管的第一极导通，以使所述发光器件发光。
优选地，所述复位子模块包括第一晶体管、复位控制端和参考电压端，所述分压子模块包括分压电容，所述开关模块包括发光控制信号端、第二晶体管和第三晶体管，所述选通模块包括第四晶体管；
在复位阶段，向所述复位控制端和扫描线均提供开启信号，向数据线提供高电平的数据电压信号，所述参考电压端向所述驱动晶体管的第一极充电；
在补偿阶段，向所述复位控制端提供关断信号，向所述扫描线提供开启信号，向数据线提供低电平的预设电压信号；
在发光阶段，向所述扫描线提供关断信号，向所述发光控制信号端提供开启信号。
相应地，本发明还提供一种显示装置，所述显示装置包括本发明提供的上述像素电路。
在本发明中，存储电容在发光阶段之前可以对驱动晶体管的阈值电压以及数据线提供的数据电压信号信息存储，且由于存储电容的自举作用，使得驱动晶体管的栅源电压在补偿阶段和发光阶段相同，因此，提供给发光器件的驱动电流的大小与阈值电压和高电平输入端提供的电压无关，减小了阈值电压和电源内阻压降对显示均匀性的影响，从而改善了显示装置的显示效果。
附图说明
附图是用来提供对本发明的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本发明，但并不构成对本发明的限制。在附图中：
图1是本发明的实施方式中像素电路的模块结构示意图；
图2是本发明的第一种实施方式中像素电路的详细结构示意图；
图3是本发明的第二种实施方式中像素电路的详细结构示意图；
图4是本发明的实施方式中像素电路的信号端的驱动时序图。
其中，附图标记为：10、发光器件；20、选通模块；30、补偿模块；31、复位子模块；32、分压子模块；40、开关模块；T1、第一晶体管；T2、第二晶体管；T3、第三晶体管；T4、第四晶体管；DTFT、驱动晶体管；C1、存储电容；C2、分压电容；VDD、高电平输入端；VSS、低电平输入端；GATE、扫描线；DATA、数据线；RESET、复位控制端；EM、发光控制信号端；SUS、参考电压端。
具体实施方式
以下结合附图对本发明的具体实施方式进行详细说明。应当理解的是，此处所描述的具体实施方式仅用于说明和解释本发明，并不用于限制本发明。
作为本发明的一方面，提供一种像素电路，如图1所示，包括：驱动晶体管DTFT、发光器件10、存储电容C1和选通模块20；选通模块20连接在数据线DATA和驱动晶体管DTFT的栅极(即图1中所示的Cst节点)之间，存储电容C1的第一端与驱动晶体管DTFT的栅极相连，存储电容C1的第二端与驱动晶体管DTFT的第一极(即图1中所示的S节点)相连，所述像素电路还包括补偿模块30和开关模块40，补偿模块30包括：
复位子模块31，复位子模块31的输出端与驱动晶体管DTFT的第二极(即图1中所示的D节点)相连，用于在复位阶段向驱动晶体管DTFT的第一极充电，以将驱动晶体管DTFT的阈值电压Vth存储在存储电容C1内；
分压子模块32，分压子模块32的第一端与驱动晶体管DTFT的第一极相连，分压子模块32的第二端与高电平输入端VDD相连，以使得分压子模块32与存储电容C1并联；
开关模块40与高电平输入端VDD、驱动晶体管DTFT分别相连，用于在发光阶段使得高电平输入端VDD与驱动晶体管DTFT的第一极导通。
数据线DATA分别在复位阶段向驱动晶体管DTFT的栅极(Cst节点)提供Vdata的电压信号、补偿阶段提供Vref的电压信号，由于分压子模块32与存储电容C1并联，因此，S节点的电压在复位阶段和补偿阶段也相应地发生变化，且S节点电压的变化量与G节点电压的变化量之比为小于1的常数α，以使得存储电容C1所存储的电压既包括复位阶段中所存储的阈值电压Vth的信息，也包括数据线在两个阶段分别提供给Cst节点的电压信息，存储电容C1所存储的电压为：Vref-[(Vdata-Vth)+α(Vref-Vdata)]；该电压值与高电平输入端VDD的电压无关，当发光阶段高电平输入端VDD的高电平信号Vdd输入至S节点时，由于存储电容C1的自举作用，使得驱动晶体管DTFT的栅源电压保持与补偿阶段中存储电容C1两端电压相同，即：Vgs＝Vref-[(Vdata-Vth)+α(Vref-Vdata)]；因此，在发光阶段，发光器件的驱动电流为：
Ioled＝0.5μnCox(W/L)(Vgs-Vth)^2
＝0.5μnCox(W/L){Vref-[(Vdata-Vth)+α(Vref-Vdata)]-Vth}^2
＝0.5μnCox(W/L)[(1-α)(Vref-Vdata)]^2
其中，μn为载流子迁移率，Cox为驱动晶体管栅氧化层电容，W/L为驱动晶体管导电沟道的宽长比。可以看出，驱动电流的大小与阈值电压Vth和高电平信号Vdd均无关，从而有效地对阈值电压和电源内阻压降进行补偿，进而提高了显示画面的均匀性。
作为本发明的第一种具体实施方式，如图2所示，复位子模块31包括第一晶体管T1、复位控制端RESET和参考电压端SUS，第一晶体管T1的栅极与复位控制端RESET相连，第一晶体管T1的第一极与参考电压端SUS相连，第一晶体管T1的第二极与驱动晶体管DTFT的第二极相连。
在复位阶段，复位控制端RESET的提供开启信号，第一晶体管T1导通，参考电压端RESET的参考电压信号通过第一晶体管T1输入至驱动晶体管DTFT的第二极(D节点)。
以驱动晶体管DTFT为P型晶体管为例，在复位阶段，选通模块20导通，数据电压信号Vdata输入至驱动晶体管DTFT的栅极(Cst节点)，而此时驱动晶体管DTFT的第一极(S节点)的电压保持上一阶段的电压值(即高电平输入端提供的高电平信号Vdd)，使得驱动晶体管DTFT的Vgs<0，从而使得驱动晶体管DTFT导通，参考电压端SUS向S节点充电，直至驱动晶体管DTFT关断，此时，S节点的电压为Vdata-Vth，Cst节点电压为Vdata，存储电容C1两端的电压为Vth。
作为本发明的第二种实施方式，参考电压端SUS与选通模块20的输出端相连，如图3所示，复位子模块31包括第一晶体管T1和复位控制端RESET，第一晶体管T1的栅极与复位控制端RESET相连、第一晶体管T1的第一极与选通模块20的输出端相连、第一晶体管T1的第二极与驱动晶体管DTFT的第二极相连。
和第一种实施方式相比，第二种实施方式中的复位子模块31在复位阶段对S节点进行充电时，由数据线向驱动晶体管DTFT的栅极充电，以使Cst节点电压达到Vdata，同时数据线通过第一晶体管T1向S节点充电。本领域技术人员可以理解的是，两种实施方式相比，如图3的实施方式中，只有当驱动晶体管DTFT为增强型薄膜晶体管时，可以完成对S节点的充电，不能对耗尽型薄膜晶体管的第一极充电。这是由于耗尽型薄膜晶体管的导通条件是：第一极的电压需要大于栅极电压，而数据线同时为栅极和源极充电是无法满足的。如图2的实施方式中既可以用于增强型的薄膜晶体管，也可以用于耗尽型的薄膜晶体管。
具体地，如图2和图3所示，分压子模块32包括分压电容C2，分压电容C2的第一端形成为分压子模块32的第一端，分压电容C2的第二端形成为分压子模块32的第二端，即，分压电容C2的第一端与驱动晶体管DTFT的第一极相连，分压电容C2的第二端与高电平输入端VDD相连。
如图2和图3所示，开关模块40包括第二晶体管T2和发光控制信号端EM，第二晶体管T2的栅极与发光控制信号端EM相连，第二晶体管T2的第一极与高电平输入端VDD相连，第二晶体管T2的第二极与驱动晶体管DTFT的第一极相连。发光阶段，发光控制信号端EM提供开启信号，以使得第二晶体管T2导通，高电平输入端VDD的高电平信号输入至驱动晶体管DTFT的第一极。
更进一步地，开关模块40还可以与发光器件相连，在发光阶段使得驱动晶体管DTFT的第二极与发光器件10的阳极导通。在复位阶段和补偿阶段，开关模块40包括关断，防止有电流经过发光器件而使得发光器件发光。
具体地，如图2和图3所示，开关模块40还包括第三晶体管T3，第三晶体管T3的栅极与发光控制信号端EM相连，第三晶体管T3的第一极与驱动晶体管DTFT的第二极相连，第三晶体管T3的第二极与发光器件10相连。
选通模块20包括第四晶体管T4，第四晶体管T4的栅极与扫描线GATE相连，第四晶体管T4的第一极与数据线DATA相连，第四晶体管T4的第二极与驱动晶体管DTFT的栅极相连。扫描线GATE提供开启信号时，第四晶体管T4导通，将数据线上的信号输出至驱动晶体管DTFT的栅极。
本发明中第一晶体管至第四晶体管以及驱动晶体管DTFT均为P型晶体管，第一极为源极，第二极为漏极，相应地，上述开启信号为低电平信号，关断信号为高电平信号；当然，各个晶体管也可以均为N型晶体管，或者部分为N型晶体管、部分为P型晶体管，只要相应地调节输入其栅极的电压信号，使得各晶体管在各阶段的导通状态与本发明中一致即可。
本发明像素电路的驱动过程包括三个阶段：复位阶段、补偿阶段和发光阶段。以第一种实施方式的结构(如图2所示)为例对每个阶段进行介绍：
在复位阶段(如图4中的t1阶段)，扫描线GATE和复位控制端RESET提供低电平信号，发光控制信号端EM和数据线DATA提供高电平信号，此时，第一晶体管T1和第四晶体管T4导通，第二晶体管T2和第三晶体管T3关断。数据线上的高电平信号Vdata输入至驱动晶体管DTFT的栅极，驱动晶体管DTFT导通，参考电压端SUS通过第一晶体管T1和驱动晶体管DTFT向S节点充电，直至S节点的电压为达到Vdata-Vth。
其中，为了保证驱动晶体管DTFT的导通，高电平输入端的高电平信号Vdd应满足：Vdd>Vdata,max-Vth；参考电压端的参考电压信号Vsus应满足：Vsus<Vdata,min-Vth；其中，Vdata,max为写入不同灰度信号时对应的多个数据电压信号Vdata中的最大值，Vdata,min为多个数据电压信号Vdata中的最小值。
在补偿阶段(如图4中的t2阶段)，扫描线GATE和数据线DATA提供低电平信号，发光控制信号端EM和复位控制端RESET提供高电平信号，其中数据线上的低电平信号以Vref表示。在该阶段中，第一晶体管T1和第四晶体管T4导通，第二晶体管T2和第三晶体管T3关断。Cst节点电压由Vdata跳变为Vref，S节点处于悬空状态(Floating)，该节点处的电压受到Cst节点电压的影响。Cst节点处的电压在复位阶段至补偿阶段之间的变化量△Vcst反馈至S节点，由于分压电容C2的分压作用，S节点电压在复位阶段和补偿阶段的变化量△Vs为[C1/(C1+C2)](Vref-Vdata)，因此S节点在补偿阶段的电压为：(Vdata-Vth)+[C1/(C1+C2)](Vref-Vdata)。可以看出，在补偿阶段，存储电容C1所存储的电压信息中同时包括Vdata和Vth的电压信息。
为了保证驱动晶体管DTFT的正常开启，同时减小通过发光模块的电流，以保证黑态效果，数据线的低电平信号Vref可以等于或略大于复位阶段中所提供的数据电压信号的最小值Vdata,min。
在发光阶段(如图4中的t3阶段)，发光控制信号端EM和数据线DATA提供低电平信号，复位控制端RESET和扫描线GATE提供高电平信号，此时，第一晶体管T1和第四晶体管T4关断，第二晶体管T2和第三晶体管T3开启，高电平信号端VDD通过第二晶体管T2向驱动晶体管DTFT的第一极S节点充电，使得S节点的电压由(Vdata-Vth)+[C1/(C1+C2)](Vref-Vdata)升高至Vdd，由于第一电容C1的自举作用，使得驱动晶体管DTFT的栅源电压保持与补偿阶段中存储电容C1两端电压相同，即：
Vgs＝Vref-{(Vdata-Vth)+[C1/(C1+C2)](Vref-Vdata)}；
因此，通过发光器件的电流为：
Ioled＝0.5μnCox(W/L)(Vgs-Vth)^2
＝0.5μnCox(W/L){[1-C1/(C1+C2)](Vref-Vdata)}^2
＝0.5μnCox(W/L){[(C2)/(C1+C2)](Vref-Vdata)}^2
其中，μn为载流子迁移率，Cox为驱动晶体管栅氧化层电容，W/L为驱动晶体管导电沟道的宽长比，可以看出，经过发光器件的电流与Vdd和Vth均无关，从而有效地补偿了阈值均匀性和电源内阻压降，提高了显示亮度的均匀性。
作为本发明的另一方面，提供一种像素电路的驱动方法，所述像素单元为上述像素电路，所述驱动方法包括：
复位阶段，向驱动晶体管DTFT的栅极提供高电平的数据电压信号，复位子模块31向驱动晶体管DTFT的第一极充电，以将驱动晶体管DTFT的阈值存储在存储电容C1内；
补偿阶段，向驱动晶体管DTFT的栅极提供低电平的预设电压信号，以将所述高电平的数据电压信号和所述阈值电压信号共同存储至存储电容C1内；
发光阶段，关断选通模块，通过开关模块将高电平输入端和驱动晶体管DTFT的第一极导通，以使所述发光器件发光。
具体地，如图2所示，复位子模块31包括第一晶体管T1、复位控制端RESET和参考电压端SUS，分压子模块32包括分压电容C2，开关模块40包括发光控制信号端EM、第二晶体管T2和第三晶体管T3，选通模块20包括第四晶体管T4；
如图4所示，在复位阶段(t1阶段)中，向复位控制端RESET和扫描线GATE均提供开启信号，向数据线DATA提供高电平的数据电压信号，参考电压端SUS向所述驱动晶体管的第一极充电。从而使得第一晶体管T1、第四晶体管T4和驱动晶体管DTFT导通，所述高电平的数据电压信号通过第四晶体管T4输入至驱动晶体管DTFT的栅极，参考电压端SUS的参考电压信号通过第一晶体管T1和驱动晶体管DTFT向S节点充电，直至驱动晶体管DTFT关断，此时S节点电压达到Vdata-Vth，Cst节点电压为Vdata，存储电容C1内所存储的电压为Vth。
在补偿阶段(t2阶段)，向复位控制端Reset提供关断信号，向扫描线Gate提供开启信号，向数据线Data提供低电平的预设电压信号。从而使得第一晶体管T1关断，第四晶体管T4导通，数据线向Cst节点输入低电平的预设电压信号Vref，第二晶体管T2和第三晶体管T3关断，S节点处于悬空状态，该节点电压受Cst节点电压改变的影响，变为(Vdata-Vth)+[C1/(C1+C2)](Vref-Vdata)。在复位阶段和补偿阶段，发光控制信号端EM的信号均为关断信号，以使得第二晶体管T2和第三晶体管T3在两个阶段均关断。
在发光阶段(t3阶段)，向扫描线GATE提供关断信号，向发光控制信号端EM提供开启信号，从而使得第四晶体管T4关断，第二晶体管T2和第三晶体管T3导通，高电平输入端VDD的电压输入至S节点，并驱动所述发光器件发光。而由于存储电容C1的自举作用使得驱动晶体管DTFT的栅极和源极之间的电压保持与补偿阶段中相同，即与高电平信号无关。
第一晶体管T1至第四晶体管T4以及驱动晶体管DTFT均为P型晶体管，相应地，开启信号为低电平信号，关断信号为高电平信号。
在本发明提供的像素电路中，在发光阶段前，存储电容中所存储的电压包含了阈值电压，且发光阶段，存储电容所存储的电压与高电平输入端的电压无关，因此流过发光器件的电流与阈值和高电平输入端的电压均无关，因此可以补偿阈值电压均匀性和电源内阻压降，从而提高了显示亮度的均匀性。
作为本发明的再一个方面，提供一种显示装置，包括本发明提供的上述驱动电路。
该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
由于本发明中提供的像素电路的稳定性较好，不受电路内部的晶体管阈值和背板电源的影响，从而使得驱动电流不受晶体管阈值和背板单元的影响，改善显示效果，同时延长发光器件的寿命。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (11)

1.一种像素电路，包括：驱动晶体管、发光器件、存储电容和选通模块，所述选通模块连接在数据线和所述驱动晶体管的栅极之间，其特征在于，所述存储电容的第一端与所述驱动晶体管的栅极相连，所述存储电容的第二端与所述驱动晶体管的第一极相连，所述像素电路还包括补偿模块和开关模块，所述补偿模块包括：
复位子模块，所述复位子模块的输出端与所述驱动晶体管的第二极相连，用于在复位阶段向所述驱动晶体管的第一极充电，以将所述驱动晶体管的阈值电压存储在所述存储电容内；
分压子模块，所述分压子模块的第一端与所述驱动晶体管的第一极相连，所述分压子模块的第二端与高电平输入端相连，以使得所述分压子模块与所述存储电容并联；
所述开关模块与所述高电平输入端、所述驱动晶体管分别相连，用于在发光阶段使得所述高电平输入端与所述驱动晶体管的第一极导通。
2.根据权利要求1所述的像素电路，其特征在于，所述复位子模块包括第一晶体管、复位控制端和参考电压端，所述第一晶体管的栅极与所述复位控制端相连，所述第一晶体管的第一极与所述参考电压端相连，所述第一晶体管的第二极与所述驱动晶体管的第二极相连。
3.根据权利要求2所述的像素电路，其特征在于，所述参考电压端与所述选通模块的输出端相连。
4.根据权利要求1至3中任意一项所述的像素电路，其特征在于，所述分压子模块包括分压电容，所述分压电容的第一端形成为所述分压子模块的第一端，所述分压电容的第二端形成为所述分压子模块的第二端。
5.根据权利要求1至3中任意一项所述的像素电路，其特征在于，所述开关模块包括第二晶体管和发光控制信号端，所述第二晶体管的栅极与所述发光控制信号端相连，所述第二晶体管的第一极与高电平输入端相连，所述第二晶体管的第二极与所述驱动晶体管的第一极相连。
6.根据权利要求1至3中任意一项所述的像素电路，其特征在于，所述开关模块还与所述发光器件相连，在发光阶段使得所述驱动晶体管的第二极与所述发光器件的阳极导通。
7.根据权利要求6所述的像素电路，其特征在于，所述开关模块包括第二晶体管、第三晶体管和发光控制信号线，所述第二晶体管的栅极与所述发光控制信号端相连，所述第二晶体管的第一极与高电平输入端相连，所述第二晶体管的第二极与所述驱动晶体管的第一极相连；所述第三晶体管的栅极与所述发光控制信号端相连，所述第三晶体管的第一极与所述驱动晶体管的第二极相连，所述第三晶体管的第二极与所述发光器件相连。
8.根据权利要求1至3中任意一项所述的像素电路，其特征在于，所述选通模块包括第四晶体管，所述第四晶体管的栅极与扫描线相连，所述第四晶体管的第一极与数据线相连，所述第四晶体管的第二极与所述驱动晶体管的栅极相连。
9.一种像素电路的驱动方法，其特征在于，所述像素电路为权利要求1所述的像素电路，所述驱动方法包括：
复位阶段，向所述驱动晶体管的栅极提供高电平的数据电压信号，所述复位子模块向所述驱动晶体管的第一极充电，以将所述驱动晶体管的阈值电压存储在所述存储电容内；
补偿阶段，向所述驱动晶体管的栅极提供低电平的预设电压信号，以将所述高电平的数据电压信号和所述阈值电压共同存储至所述存储电容中；
发光阶段，将所述选通模块关断，并通过所述开关模块将高电平输入端和所述驱动晶体管的第一极导通，以使所述发光器件发光。
10.根据权利要求9所述的驱动方法，其特征在于，所述复位子模块包括第一晶体管、复位控制端和参考电压端，所述分压子模块包括分压电容，所述开关模块包括发光控制信号端、第二晶体管和第三晶体管，所述选通模块包括第四晶体管；
在复位阶段，向所述复位控制端和扫描线均提供开启信号，向数据线提供高电平的数据电压信号，所述参考电压端向所述驱动晶体管的第一极充电；
在补偿阶段，向所述复位控制端提供关断信号，向所述扫描线提供开启信号，向数据线提供低电平的预设电压信号；
在发光阶段，向所述扫描线提供关断信号，向所述发光控制信号端提供开启信号。
11.一种显示装置，其特征在于，所述显示装置包括权利要求1至8中任意一项所述的像素电路。
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