CN109509433A - 像素电路、显示装置和像素驱动方法 - Google Patents

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Abstract

本公开提供了一种像素电路，包括：重置模块、阈值补偿模块、数据写入模块、发光控制模块、电容模块、驱动晶体管和发光器件；其中，在重置阶段，重置模块将重置电压写入至第一节点，数据写入模块将参考电压写入至电容模块；在阈值补偿阶段，阈值补偿模块获取驱动晶体管的阈值电压，并将阈值电压写入至电容模块；在数据写入阶段，数据写入模块将数据电压写入至电容模块；在发光阶段，阈值补偿模块将第一工作电压写入至第二节点，电容模块将补偿电压写入至第一节点，驱动晶体管根据补偿电压输出相应的驱动电流，发光控制模块将驱动电流输出至发光器件，以控制发光器件发光。本公开还提供了一种显示装置和像素驱动方法。

Description

像素电路、显示装置和像素驱动方法
技术领域
本公开涉及显示技术领域，特别涉及一种像素电路、显示装置和像素驱动方法。
背景技术
目前，有源矩阵型有机发光二极管(Active-matrix Organic Light-emittingDiode，简称AMOLED)的柔性屏技术日趋成熟，其具有的可弯曲，对比度高，功耗低等特点，使其成为取代液晶显示面板(Liquid Crystal Display，LCD)的下一代显示方式。
OLED显示装置中的像素是由驱动晶体管在饱和状态下所产生的电流进行驱动发光的，但当前的OLED显示装置制造工艺难以保证驱动晶体管的阈值电压的均一性，并且在使用过程中驱动晶体管的阈值电压会发生不同程度的漂移，从而使得OLED显示装置产生各像素亮度不均匀的问题。
另外，随着显示技术发展，长宽比较大的用于可穿戴设备的OLED显示装置越来越受到人们的欢迎。但是，在可穿戴设备中长宽比越大的OLED显示装置其工作电源所提供的工作电压受到压降(IR-Drop)的影响越大，这也会带来OLED显示装置整体发光亮度不均的问题。
发明内容
本公开旨在至少解决现有技术中存在的技术问题之一，提出了一种像素电路、显示装置和像素驱动方法。
第一方面，本公开实施例提供了一种像素电路，包括：重置模块、阈值补偿模块、数据写入模块、发光控制模块、电容模块、驱动晶体管和发光器件，所述驱动晶体管的栅极与所述重置模块、所述电容模块连接于第一节点，所述驱动晶体管的第一极与所述阈值补偿模块、所述电容模块连接于第二节点，所述驱动晶体管的第二极与所述阈值补偿模块、所述发光控制模块连接于第三节点，所述数据写入模块与所述阈值补偿模块、所述电容模块连接于第四节点；
所述重置模块，与第一控制信号线和重置信号端连接，响应于所述第一控制信号线所提供的第一控制信号的控制，用于在重置阶段、阈值补偿阶段和数据写入阶段时将所述重置信号端所提供的重置电压写入所述第一节点；
数据写入模块，与所述第一控制信号线和数据线连接，响应于所述第一控制信号的控制，用于在所述重置阶段和所述阈值补偿阶段时将所述数据线所提供的参考电压写入至所述电容模块；以及，用于在所述数据写入阶段时将所述数据线所提供的数据电压写入至所述电容模块；
所述阈值补偿模块，与第二控制信号线、第三控制信号线和第一电源端连接，响应于所述第二控制信号线所提供的第二控制信号和所述第三控制信号线所提供的第三控制信号，用于在所述阈值补偿阶段时获取所述驱动晶体管的阈值电压，并通过所述电容模块存储所述阈值电压；以及，用于在发光阶段时将所述第一电源端提供的第一工作电压写入至所述第二节点，并通过所述电容模块向所述第一节点写入补偿电压，以供所述驱动晶体管根据所述写入至补偿电压输出相应的驱动电流，所述补偿电压V1＝Vdd+Vth-(Vdata-Vref)*α，其中Vdd、Vth、Vdata、Vref分别表示所述第一工作电压、所述阈值电压、所述数据电压和所述参考电压，α为大于0且小于1的预定系数；
所述发光控制模块，与所述发光器件的第一极、所述第三控制信号线连接，响应于所述第三控制信号的控制，用于在所述发光阶段时将所述驱动晶体管输出的驱动电流传输至所述发光器件的第一极；
所述发光器件的第二极与第二电源端连接，所述发光器件用于在所述发光阶段时根据接收到的驱动电流进行发光。
在一些实施例中，所述重置模块包括：第一晶体管；
所述第一晶体管的控制极与所述第一控制信号线连接，所述第一晶体管的第一极与所述重置信号端连接，所述第一晶体管的第二极与所述第一节点连接。
在一些实施例中，所述阈值补偿模块包括：第二晶体管和第三晶体管；
所述第二晶体管的控制极与所述第二控制信号线连接，所述第二晶体管的第一极与所述第三节点连接，所述第三晶体管的第二极与所述第四节点连接；
所述第三晶体管的控制极与所述第三控制信号线连接，所述第三晶体管的第一极与所述第一电源连接，所述第三晶体管的第二极与所述第二节点连接。
在一些实施例中，所述数据写入模块包括：第四晶体管；
所述第四晶体管的控制极与所述第一控制信号线连接，所述第四晶体管的第一极与所述第四节点连接，所述第四晶体管的第二极与所述数据线连接。
在一些实施例中，所述发光控制模块包括：第五晶体管；
所述第五晶体管的控制极与所述第三控制信号线连接，所述第五晶体管的第一极与所述第三节点连接，所述第五晶体管的第二极与所述发光器件的第一极连接。
在一些实施例中，所述电容模块包括：第一电容和第二电容；
所述第一电容的第一端与所述第一节点连接，所述第一电容的第二端与所述第二节点连接；
所述第二电容的第一端与所述第二节点连接，所述第二电容的第二端与所述第四节点连接；
预定系数α＝c2/(c1+c2)，其中c1和C2分别为所述第一电容和所述第二电容的电容值。
在一些实施例中，所述像素电路中的全部晶体管均为P型晶体管或N型晶体管。
第二方面，本公开实施例还提供了一种显示装置，包括：如上述的像素电路。
在一些实施例中，所述显示装置包括多行所述像素电路；
位于同一行的全部所述像素电路的共用同一所述第一控制信号线、共用同一所述第二控制信号线、共用同一所述第三控制信号线；
任意相邻两行像素电路之间设置有对应的反向电路；
对于任一所述反向电路，该反向电路的输入端与该反向电路所对应的后一行像素电路的第一控制信号线连接，该反向电路的输出端与该反向电路所对应的前一行像素电路的第三控制信号线连接。
第三方面，本公开实施例还提供了一种像素驱动方法，所述像素驱动方法基于像素电路，所述像素电路采用上述的像素电路，所述像素驱动方法包括：
在所述重置阶段，所述重置模块将所述重置电压写入至所述第一节点，所述数据写入模块将所述参考电压写入至所述电容模块；
在所述阈值补偿阶段，所述阈值补偿模块获取所述驱动晶体管的阈值电压，并将所述阈值电压写入至所述电容模块；
在数据写入阶段，所述数据写入模块将所述数据电压写入至所述电容模块；
在发光阶段，所述阈值补偿模块将第一工作电压写入至所述第二节点，所述电容模块将所述补偿电压写入至所述第一节点，所述驱动晶体管根据所述补偿电压输出相应的驱动电流，所述发光控制模块将所述驱动电流输出至所述发光器件，以控制所述发光器件发光。
附图说明
图1为本公开实施例提供的一种像素电路的电路结构示意图；
图2为本公开实施例提供的另一种像素电路的电路结构示意图；
图3为图2所示像素电路的一种工作时序图；
图4为图2所示像素电路处于重置阶段的工作状态示意图；
图5为图2所示像素电路处于阈值补偿阶段的工作状态示意图；
图6为图2所示像素电路处于数据写入阶段的工作状态示意图；
图7为图2所示像素电路处于发光阶段的工作状态示意图；
图8为图2所示像素电路的另一种工作时序图；
图9为图2所示像素电路处于缓冲阶段的工作状态示意图；
图10为本公开实施例提供的一种像素驱动方法的流程图。
具体实施方式
为使本领域的技术人员更好地理解本公开的技术方案，下面结合附图对本公开提供的一种像素电路、显示装置和像素驱动方法进行详细描述。
本公开中的发光器件可以是现有技术中包括LED(Light Emitting Diode，发光二极管)或OLED(Organic Light Emitting Diode，有机发光二极管)在内的电流驱动型发光器件，在本实施例中是以发光器件为OLED为例进行的说明。
需要说明的是，本公开中的晶体管可以为薄膜晶体管或场效应晶体管或其他特性相同的开关器件。晶体管一般包括三个极：栅极、源极和漏极，晶体管中的源极和漏极在结构上是对称的，根据需要两者是可以互换的。在本公开中，控制极是指晶体管的栅极，第一极和第二极中的一者为源极，另一者为漏极。
此外，按照晶体管特性，可将晶体管分为N型晶体管和P型晶体管；当晶体管为N型晶体管时，其导通电压为高电平电压，截止电压为低电平电压；当晶体管为P型晶体管时，其导通电压为低电平电压，截止电压为高电平电压。
各晶体管均为P型晶体管为例进行示例性说明，其不会对本公开的技术方案产生限制。
图1为本公开实施例提供的一种像素电路的电路结构示意图，如图1所示，该像素电路包括：包括：重置模块1、阈值补偿模块2、数据写入模块3、发光控制模块4、电容模块5、驱动晶体管DTFT和发光器件OLED。
其中，驱动晶体管DTFT的栅极与重置模块1、电容模块5连接于第一节点N1，驱动晶体管DTFT的第一极与阈值补偿模块2、电容模块5连接于第二节点N2，驱动晶体管DTFT的第二极与阈值补偿模块2、发光控制模块4连接于第三节点N3，数据写入模块3与阈值补偿模块2、电容模块5连接于第四节点N4。
重置模块1，与第一控制信号线S1和重置信号端连接，响应于第一控制信号线S1所提供的第一控制信号的控制，用于在重置阶段、阈值补偿阶段和数据写入阶段时将重置信号端所提供的重置电压写入第一节点N1。
数据写入模块3，与第一控制信号线S1和数据线Data连接，响应于第一控制信号的控制，用于在重置阶段和阈值补偿阶段时将数据线Data所提供的参考电压写入至电容模块5；以及，用于在数据写入阶段时将数据线Data所提供的数据电压写入至电容模块5。
阈值补偿模块2，与第二控制信号线S2、第三控制信号线S3和第一电源端连接，响应于第二控制信号线S2所提供的第二控制信号和第三控制信号线S3所提供的第三控制信号，用于在阈值补偿阶段时获取驱动晶体管DTFT的阈值电压，并通过电容模块5存储阈值电压；以及，用于在发光阶段时将第一电源端提供的第一工作电压写入至第二节点N2，并通过电容模块5向第一节点N1写入补偿电压，以供驱动晶体管DTFT根据写入至补偿电压输出相应的驱动电流，补偿电压V1＝Vdd+Vth-(Vdata-Vref)*α，其中Vdd、Vth、Vdata、Vref分别表示第一工作电压、阈值电压、数据电压和参考电压，α为大于0且小于1的预定系数。
发光控制模块4，与发光器件OLED的第一极、第三控制信号线S3连接，响应于第三控制信号的控制，用于在发光阶段时将驱动晶体管DTFT输出的驱动电流传输至发光器件OLED的第一极。
发光器件OLED的第二极与第二电源端连接，发光器件OLED用于在发光阶段时根据接收到的驱动电流进行发光。其中，第二电源端提供第二工作电压Vss。
在本公开中，在发光阶段时，由于阈值补偿模块2将第一工作电压写入至第二节点N2，因此第二节点N2的电压VN2为Vdd；与此同时，电容模块5将补偿电压写入至第一节点N1，因此第一节点N1的的电压VN2为补偿电压V1，其中，V1＝Vdd+Vth-(Vdata-Vref)*α。
此时，驱动晶体管DTFT的栅源电压Vgs：
Vgs＝VN1-VN2
＝Vdd+Vth-(Vdata-Vref)*α-Vdd
＝Vth-(Vdata-Vref)*α
此时根据驱动晶体管DTFT的饱和驱动电流公式可得：
I＝K*(Vgs-Vth)2
＝K*[Vth-(Vdata-Vref)*α-Vth]2
＝K*[(Vdata-Vref)*α]2
其中，I为驱动晶体管DTFT输出的驱动电流，K为一个常量。
通过上式可见，驱动晶体管DTFT输出的驱动电流仅与数据电压Vdata、参考电压Vref和预定系数α相关，与驱动晶体管DTFT的阈值电压Vth和第一工作电压Vdd无关。
通过上述内容可见，本公开的技术方案可对驱动晶体管的阈值电压进行补偿，使得驱动电流不受驱动晶体管的阈值电压影响，消除了由于阈值电压不均匀、漂移导致的各像素发光亮度不均的问题。与此同时，本公开的技术方案还可对电源工作电压进行补偿，使得驱动电流不受电源工作电压影响，消除由于电源工作电压的压降所导致的整体显示亮度不均的问题。
图2为本公开实施例提供的另一种像素电路的电路结构示意图，如图2所示，该像素电路为基于图1所示像素电路的一种具体化可选方案。
在一些实施例中，重置模块1包括：第一晶体管T1；第一晶体管T1的控制极与第一控制信号线S1连接，第一晶体管T1的第一极与重置信号端连接，第一晶体管T1的第二极与第一节点N1连接。
在一些实施例中，阈值补偿模块2包括：第二晶体管T2和第三晶体管T3；第二晶体管T2的控制极与第二控制信号线S2连接，第二晶体管T2的第一极与第三节点N3连接，第三晶体管T3的第二极与第四节点N4连接；第三晶体管T3的控制极与第三控制信号线S3连接，第三晶体管T3的第一极与第一电源连接，第三晶体管T3的第二极与第二节点N2连接。
在一些实施例中，数据写入模块3包括：第四晶体管T4；第四晶体管T4的控制极与第一控制信号线S1连接，第四晶体管T4的第一极与第四节点N4连接，第四晶体管T4的第二极与数据线Data连接。
在一些实施例中，发光控制模块4包括：第五晶体管T5；第五晶体管T5的控制极与第三控制信号线S3连接，第五晶体管T5的第一极与第三节点N3连接，第五晶体管T5的第二极与发光器件OLED的第一极连接。
在一些实施例中，电容模块5包括：第一电容C1和第二电容C2；第一电容C1的第一端与第一节点N1连接，第一电容C1的第二端与第二节点N2连接；第二电容C2的第一端与第二节点N2连接，第二电容C2的第二端与第四节点N4连接；此时，预定系数α＝c2/(c1+c2)，其中c1和c2分别为第一电容C1和第二电容C2的电容值。
在本公开中，第一晶体管T1～第五晶体管T5均作为开关管来使用。为便于本领域技术人员更好的理解本公开的技术方案，下面将以各晶体管(第一晶体管T1～第五晶体管T5和驱动晶体管DTFT)均为P型晶体管为例进行示例性说明。
图3为图2所示像素电路的一种工作时序图，如图3所示，该像素电路的工作过程可包括如下四个阶段：重置阶段、阈值补偿阶段、数据写入阶段和发光阶段。
图4为图2所示像素电路处于重置阶段的工作状态示意图，如图4所示，在重置阶段，第一控制信号线S1所提供的第一控制信号处于低电平状态，第二控制信号线S2所提供的第二控制信号处于低电平状态，第三控制信号线S3所提供的第三控制信号处于低电平状态。此时，第一晶体管T1～第五晶体管T5均导通。
由于第一晶体管T1导通，则重置电压Vrst通过第一晶体管T1写入至第一节点N1，第一节点N1的电压VN1为Vrst。由于第三晶体管T3导通，则第一工作电压Vdd通过第三晶体管T3写入至第二节点N2，第二节点N2的电压VN2为Vdd。由于第二晶体管T2和第四晶体管T4导通，则数据线Data提供的基准电压Vref可通过第四晶体管T4写入至第四节点N4，以及通过第二晶体管T2写入至第三节点N3，此时第三节点N3的电压VN3和第四节点N4的电压VN4均为Vref。
需要说明的是，此时虽然驱动晶体管DTFT处于导通状态，且输出有电流，但是由于第二晶体管T2和第四晶体管T4所形成的支路上的电阻远小于第五晶体管T5所形成支路上的电路，因此仅有极小的电流从第五晶体管T5所形成支路上的电路流过，该电流并不足以使得发光器件OLED发光。
图5为图2所示像素电路处于阈值补偿阶段的工作状态示意图，如图5所示，在阈值补偿阶段，第一控制信号线S1所提供的第一控制信号处于低电平状态，第二控制信号线S2所提供的第二控制信号处于低电平状态，第三控制信号线S3所提供的第三控制信号处于高电平状态。此时，第一晶体管T1、第二晶体管T2和第四晶体管T4导通，第三晶体管T3和第五晶体管T5截止。
由于第三晶体管T3截止，则第一工作电源不再对第二节点N2进行充电，此时由于驱动晶体管DTFT处于导通状态，则第二节点N2会通过驱动晶体管DTFT、第二晶体管T2、第四晶体管T4、数据线Data所形成的通路进行放电，直至第二节点N2的电压VN2下降至Vrst-Vth，驱动晶体管DTFT截止，第二节点N2放电结束；此时，第一电容C1的两端电压差(第一节点N1与第二节点N2的电压差)为Vth，即完成将驱动晶体管DTFT的阈值电压存储于电容模块5。第二电容C2的两端电压差(第二节点N2与第四节点N4的电压差)Vrst-Vth-Vref。
图6为图2所示像素电路处于数据写入阶段的工作状态示意图，如图6所示，在数据写入阶段，第一控制信号线S1所提供的第一控制信号处于低电平状态，第二控制信号线S2所提供的第二控制信号处于高电平状态，第三控制信号线S3所提供的第三控制信号处于高电平状态。此时，第一晶体管T1和第四晶体管T4导通，第二晶体管T2、第三晶体管T3和第五晶体管T5截止。
由于第一晶体管T1持续导通，则第一节点N1的电压VN1仍为Vrst。由于第四晶体管T4导通，则数据线Data提供的数据电压通过第四晶体管T4写入至第四节点N4，此时第四节点N4的电压VN4为Vdata。在第二电容C2的自举作用下，第二节点N2的电压VN2跳变为Vrst-Vth+(Vdata-Vref)*c2/(c1+c2)。
需要说明的是，为保证驱动晶体管DTFT在后续的发光阶段能够导通，则应使得在数据写入阶段结束时驱动晶体管DTFT的栅源电压要小于Vth。
即，Vrst-Vrst+Vth-(Vdata-Vref)*c2/(c1+c2)＜Vth
即，(Vdata-Vref)*c2/(c1+c2)＞0
即，应满足Vdata＞Vref。
需要说明的是，虽然当第二电容C2将第二节点N2的电压VN2上拉至Vrst-Vth+(Vdata-Vref)*c2/(c1+c2)时，会使得驱动晶体管DTFT处于导通状态，但是由于第五晶体管T5截止且第二晶体管T2截止，因此驱动晶体管DTFT不会输出电流(第二节点N2无放电通路)，因此第二节点N2的电压VN2会稳定于Vrst-Vth+(Vdata-Vref)*c2/(c1+c2)。
在数据写入阶段结束时，第一电容C1的两端电压差为：Vth-(Vdata-Vref)*c2/(c1+c2)。
图7为图2所示像素电路处于发光阶段的工作状态示意图，如图7所示，在发光阶段，第一控制信号线S1所提供的第一控制信号处于高电平状态，第二控制信号线S2所提供的第二控制信号处于低电平状态，第三控制信号线S3所提供的第三控制信号处于低电平状态。此时，第二晶体管T2、第三晶体管T3和第五晶体管T5导通，第一晶体管T1和第四晶体管T4截止。
由于第一晶体管T1截止，则第一节点N1处于浮接(Floating)状态。又由于第三晶体管T3截止，则第一工作电压通过第三晶体管T3写入至第二节点N2，第二节点N2的电压VN2由Vrst-Vth+(Vdata-Vref)*c2/(c1+c2)充电至Vdd。此时，在第一电容C1的自举作用(维持电容两端电压差不变)下，第一节点N1的电压VN1跳变为Vdd+Vth-(Vdata-Vref)*c2/(c1+c2)，即实现电容模块5向第一节点N1写入补偿电压。
此时，驱动晶体管DTFT的栅源电压Vgs：
Vgs＝Vdd+Vth-(Vdata-Vref)*c2/(c1+c2)-Vdd
＝Vth-(Vdata-Vref)*c2/(c1+c2)
由于Vdata＞Vref，即Vdata-Vref＞0，因此Vgs小于Vth，驱动晶体管DTFT导通。此时，根据驱动晶体管DTFT的饱和驱动电流公式可得：
I＝K*(Vgs-Vth)2
＝K*[Vdd+Vth-(Vdata-Vref)*c2/(c1+c2)-Vdd-Vth]2
＝K*[(Vdata-Vref)*c2/(c1+c2)]2
通过上式可见，驱动晶体管DTFT输出的驱动电流仅与数据电压Vdata、参考电压Vref、第一电容C1和第二电容C2相关，与驱动晶体管DTFT的阈值电压Vth和第一工作电压Vdd无关。
通过上述内容可见，本公开的技术方案可对驱动晶体管DTFT的阈值电压进行补偿，使得驱动电流不受驱动晶体管DTFT的阈值电压影响，消除了由于阈值电压不均匀、漂移导致的各像素发光亮度不均的问题。与此同时，本公开的技术方案还可对电源工作电压进行补偿，使得驱动电流不受电源工作电压影响，消除由于电源工作电压的压降所导致的整体显示亮度不均的问题。
在一些实施例中，参考电压Vref等于重置电压Vrst(参考电压Vref和重置电压Vrst为同一电压)，此时可减少像素电路所需配置的电压种类数，降低用于生成各种电压的芯片(或电路)的复杂程度。
另外，上述像素电路中全部晶体管均为P型晶体管的情况，仅为本公开中的一种优选实施方案，其可使得通过相同的制备工艺以同时制备出像素电路中的各晶体管。当然，作为另一种优选方案，像素电路中全部晶体管均为N型晶体管；此外，本公开中的像素电路中的各晶体管类型也可以不完全相同，具体情况此处不再一一举例描述。
本公开实施例还提供了一种显示装置，该显示装置包括：像素电路，该像素电路采用上述实施例所提供的像素电路。
在该显示装置中，位于同一行的全部像素电路的共用同一第一控制信号线、共用同一第二控制信号线、共用同一第三控制信号线。驱动模块(例如，GOA电路或驱动芯片)用于向各行像素电路所对应的第一控制信号线、第二控制信号线和第三控制信号线提供的相应的信号。其中，第二控制信号线具体为栅线。
本公开实施例还提供了另一种显示装置，与上述实施例不同的是，在本实施例中任意相邻两行像素电路之间设置有对应的反向电路；对于任一反向电路，该反向电路的输入端与该反向电路所对应的后一行像素电路的第一控制信号线连接，该反向电路的输出端与该反向电路所对应的前一行像素电路的第三控制信号线连接。
需要说明的是，本公开中的“该反向电路所对应的后一行像素电路”和“该反向电路所对应的前一行像素电路”为与该反向电路相对应且位于相邻行的像素电路。
在前述实施例所提供的显示装置中，驱动模块需要输出三种不同类型(对应第一控制信号线、第二控制信号线和第三控制信号线)的信号；而在本实施例所提供的显示装置中，由于后一行像素电路的第一控制信号经过反相电路反向处理后可用作前一行像素电路的第三控制信号，此时驱动模块需要输出两种不同类型(对应第一控制信号线和第二控制信号线)，此时可有效降低驱动模块的复杂程度，在一定程度上有利于边框尺寸的减小。
下面将结合附图来对本实施例所提供的显示装置中的像素电路的工作过程进行描述。为便于本领域技术人员进行理解，以像素电路为图2所示像素电路为例。
图8为图2所示像素电路的另一种工作时序图，如图8所示，该像素电路除了包括：重置阶段、阈值补偿阶段、数据写入阶段和发光阶段外，在数据写入阶段和发光阶段还包括：缓冲阶段。
对于像素电路在重置阶段、阈值补偿阶段、数据写入阶段和发光阶段的具体工作过程可参见前述内容，此处不再赘述。下面仅对该像素电路在缓冲阶段的工作过程进行描述。
图9为图2所示像素电路处于缓冲阶段的工作状态示意图，如图9所示，在缓冲阶段，第一控制信号线S1所提供的第一控制信号处于高电平状态，第二控制信号线S2所提供的第二控制信号处于低电平状态，第三控制信号线S3所提供的第三控制信号处于高电平状态。此时，第二晶体管T2导通，第一晶体管T1、第三晶体管T3、第四晶体管T4和第五晶体管T5均截止。
此时，虽然第二晶体管T2导通导通，但是由于第四晶体管T4和第五晶体管T5截止，因此驱动晶体管DTFT不会输出电流(第二节点N2无放电通路)，因此第二节点N2的电压VN2会稳定于Vrst-Vth+(Vdata-Vref)*c2/(c1+c2)。
在缓冲阶段结束时，第一电容C1的两端电压差仍为：Vth-(Vdata-Vref)*c2/(c1+c2)。
需要说明的是，由于第三控制信号线S3中的第三控制信号是将后一行像素单元所对应的第一控制信号线S1中的第一控制信号进行反向处理后得到的，因此在一个周期内，第一控制信号处于低电平状态的时长与第三控制信号处于高电平状态的时长相等；相应地，重置阶段和缓冲阶段的时长相等。
本公开所提供的显示装置具体可以为：显示面板、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。对于该显示装置的其它必不可少的组成部分均为本领域的普通技术人员应该理解具有的，在此不做赘述，也不应作为对本公开的限制。
图10为本公开实施例提供的一种像素驱动方法的流程图，如图10所示，该像素驱动方法基于像素电路，像素电路采用前述任一实施例所提供的像素电路，对于该像素电路的具体描述，可参见前述实施例中的内容，此次不再赘述。该像素驱动方法包括：
步骤S1、在重置阶段，重置模块将重置电压写入至第一节点，数据写入模块将参考电压写入至电容模块。
步骤S2、在阈值补偿阶段，阈值补偿模块获取驱动晶体管的阈值电压，并将阈值电压写入至电容模块。
步骤S3、在数据写入阶段，数据写入模块将数据电压写入至电容模块。
步骤S4、在发光阶段，阈值补偿模块将第一工作电压写入至第二节点，电容模块将补偿电压写入至第一节点，驱动晶体管根据补偿电压输出相应的驱动电流，发光控制模块将驱动电流输出至发光器件，以控制发光器件发光。
对于上述各步骤的具体描述，可参见前述实施例中相应内容，此处不再赘述。本公开实施例提供的上述驱动方法，可以通过简单的时序即可实现对驱动晶体管的阈值电压的补偿和除去第一工作电压的IR-Drop的影响的功能。
可以理解的是，以上实施方式仅仅是为了说明本公开的原理而采用的示例性实施方式，然而本公开并不局限于此。对于本领域内的普通技术人员而言，在不脱离本公开的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本公开的保护范围。

Claims (10)

1.一种像素电路，其特征在于，包括：重置模块、阈值补偿模块、数据写入模块、发光控制模块、电容模块、驱动晶体管和发光器件，所述驱动晶体管的栅极与所述重置模块、所述电容模块连接于第一节点，所述驱动晶体管的第一极与所述阈值补偿模块、所述电容模块连接于第二节点，所述驱动晶体管的第二极与所述阈值补偿模块、所述发光控制模块连接于第三节点，所述数据写入模块与所述阈值补偿模块、所述电容模块连接于第四节点；
所述重置模块，与第一控制信号线和重置信号端连接，响应于所述第一控制信号线所提供的第一控制信号的控制，用于在重置阶段、阈值补偿阶段和数据写入阶段时将所述重置信号端所提供的重置电压写入所述第一节点；
数据写入模块，与所述第一控制信号线和数据线连接，响应于所述第一控制信号的控制，用于在所述重置阶段和所述阈值补偿阶段时将所述数据线所提供的参考电压写入至所述电容模块；以及，用于在所述数据写入阶段时将所述数据线所提供的数据电压写入至所述电容模块；
所述阈值补偿模块，与第二控制信号线、第三控制信号线和第一电源端连接，响应于所述第二控制信号线所提供的第二控制信号和所述第三控制信号线所提供的第三控制信号，用于在所述阈值补偿阶段时获取所述驱动晶体管的阈值电压，并通过所述电容模块存储所述阈值电压；以及，用于在发光阶段时将所述第一电源端提供的第一工作电压写入至所述第二节点，并通过所述电容模块向所述第一节点写入补偿电压，以供所述驱动晶体管根据所述写入至补偿电压输出相应的驱动电流，所述补偿电压V1＝Vdd+Vth-(Vdata-Vref)*α，其中Vdd、Vth、Vdata、Vref分别表示所述第一工作电压、所述阈值电压、所述数据电压和所述参考电压，α为大于0且小于1的预定系数；
所述发光控制模块，与所述发光器件的第一极、所述第三控制信号线连接，响应于所述第三控制信号的控制，用于在所述发光阶段时将所述驱动晶体管输出的驱动电流传输至所述发光器件的第一极；
所述发光器件的第二极与第二电源端连接，所述发光器件用于在所述发光阶段时根据接收到的驱动电流进行发光。
2.根据权利要求1所述的像素电路，其特征在于，所述重置模块包括：第一晶体管；
所述第一晶体管的控制极与所述第一控制信号线连接，所述第一晶体管的第一极与所述重置信号端连接，所述第一晶体管的第二极与所述第一节点连接。
3.根据权利要求1所述的像素电路，其特征在于，所述阈值补偿模块包括：第二晶体管和第三晶体管；
所述第二晶体管的控制极与所述第二控制信号线连接，所述第二晶体管的第一极与所述第三节点连接，所述第三晶体管的第二极与所述第四节点连接；
所述第三晶体管的控制极与所述第三控制信号线连接，所述第三晶体管的第一极与所述第一电源连接，所述第三晶体管的第二极与所述第二节点连接。
4.根据权利要求1所述的像素电路，其特征在于，所述数据写入模块包括：第四晶体管；
所述第四晶体管的控制极与所述第一控制信号线连接，所述第四晶体管的第一极与所述第四节点连接，所述第四晶体管的第二极与所述数据线连接。
5.根据权利要求1所述的像素电路，其特征在于，所述发光控制模块包括：第五晶体管；
所述第五晶体管的控制极与所述第三控制信号线连接，所述第五晶体管的第一极与所述第三节点连接，所述第五晶体管的第二极与所述发光器件的第一极连接。
6.根据权利要求1所述的像素电路，其特征在于，所述电容模块包括：第一电容和第二电容；
所述第一电容的第一端与所述第一节点连接，所述第一电容的第二端与所述第二节点连接；
所述第二电容的第一端与所述第二节点连接，所述第二电容的第二端与所述第四节点连接；
预定系数α＝c2/(c1+c2)，其中c1和c2分别为所述第一电容和所述第二电容的电容值。
7.根据权利要求1-6中任一所述的像素电路，其特征在于，所述像素电路中的全部晶体管均为P型晶体管或N型晶体管。
8.一种显示装置，其特征在于，包括：如上述权利要求1-7中任一所述像素电路。
9.根据权利要求8中所述显示装置，其特征在于，所述显示装置包括多行所述像素电路；
位于同一行的全部所述像素电路的共用同一所述第一控制信号线、共用同一所述第二控制信号线、共用同一所述第三控制信号线；
任意相邻两行像素电路之间设置有对应的反向电路；
对于任一所述反向电路，该反向电路的输入端与该反向电路所对应的后一行像素电路的第一控制信号线连接，该反向电路的输出端与该反向电路所对应的前一行像素电路的第三控制信号线连接。
10.一种像素驱动方法，其特征在于，所述像素驱动方法基于像素电路，所述像素电路采用上述权利要求1-7中任一所述的像素电路，所述像素驱动方法包括：
在所述重置阶段，所述重置模块将所述重置电压写入至所述第一节点，所述数据写入模块将所述参考电压写入至所述电容模块；
在所述阈值补偿阶段，所述阈值补偿模块获取所述驱动晶体管的阈值电压，并将所述阈值电压写入至所述电容模块；
在数据写入阶段，所述数据写入模块将所述数据电压写入至所述电容模块；
在发光阶段，所述阈值补偿模块将第一工作电压写入至所述第二节点，所述电容模块将所述补偿电压写入至所述第一节点，所述驱动晶体管根据所述补偿电压输出相应的驱动电流，所述发光控制模块将所述驱动电流输出至所述发光器件，以控制所述发光器件发光。
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