TWI451384B - 像素結構、其驅動方法及使用其之自發光顯示器 - Google Patents

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Description

像素結構、其驅動方法及使用其之自發光顯示器
本發明是有關於一種自發光顯示器的像素結構，且特別是有關於一種同步顯示之自發光顯示器的像素結構、其驅動方法及使用其之自發光顯示器。
有機發光二極體(Organic Light Emitting Diode，O LED)依驅動方式可分為被動式矩陣驅動(Passive Matrix OLED，PMOLED)與主動式矩陣驅動(Active Matrix OLED，AMOLED)兩種。PMOLED是當資料未寫入時並不發光，只在資料寫入期間發光。這種驅動方式結構簡單、成本較低、較容易設計，早期的業者皆朝此技術發展。主要應用於中小尺寸之顯示器。
AMOLED與PMOLED最大的差異在於每一畫素皆有一電容儲存資料，讓每一畫素皆維持在發光狀態。由於AMOLED耗電量明顯小於PMOLED，加上其驅動方式適合發展大尺寸與高解析度之顯示器，使得AMOLED成為未來發展的主要方向。如圖6所示，其為AMOLED面板中的一個像素結構。在此像素結構中包含了兩個電晶體TR1 與TR2 、一個儲存電容CS 以及發光元件O1 。只有在資料要被寫入這個像素結構的時候，控制訊號Scan N才會使電晶體TR1 導通，並將資料訊號的電位Vdata 導入電晶體TR2 的控制端，之後再調整控制訊號Scan N以使電晶體TR1 被截止，並利用之前資料訊號電位Vdata 被導入之後儲存在儲存電容CS 兩端的電壓來控制電晶體TR2 的導通程度，進而控制流經發光元件O1 的電流量。
雖然AMOLED具有省電、適合大尺寸與全彩化之應用，但是卻也延伸出許多設計上的問題。例如OLED本身或做為開關或驅動元件之用的薄膜電晶體(Thin Film Transistor，TFT)的材料特性的變異與材料老化程度不同而造成面板顯示的不均勻就是一個相當嚴重的問題。過去也已經有許多相關的文獻提出不同的補償電路來改善這方面的問題，主要分為電壓式與電流式兩種方法。
然而，隨著三度空間(three-dimension，3D)立體顯示裝置的需求上升，傳統的非同步(non-simultaneously)顯示方式因為容易使左右眼畫面間互相產生干擾，所以廠商另外設計出同步(simultaneously)顯示方式。在同步顯示方式中，顯示資料被依序提供到各像素結構中，並在最後才一起發光以顯示對應的內容。
然而，先前提出的各種補償電路僅能應用在非同步顯示方式中，沒辦法適用於新的同步顯示方式。因此，如何對採用同步顯示方式的顯示面板進行相關的顯示均勻性的補償，就成了一個重要的課題。
本發明的目的之一就是在提供一種自發光顯示器的像素結構，其可適用於使用同步與非同步顯示方式的顯示面板。
本發明的再一目的是提供一種像素結構的驅動方法，其可驅動上述像素結構，並在各類顯示面板中進行顯示補償。
本發明的又一目的是提供一種自發光顯示器。
本發明提出一種自發光顯示器的像素結構，其電性耦接至資料線、第一與第二電壓源線以及第一、第二與第三控制訊號線。此像素結構包括：第一至第四電晶體、第一與第二電容以及發光元件。各電晶體分別具有第一端、第二端與控制端。其中，第一電晶體的第一端電性耦接至資料線，第一電晶體的控制端電性耦接至第一控制訊號線；第二電晶體的第一端電性耦接至第一電壓源，第二電晶體的控制端電性耦接至第二控制訊號線；第三電晶體的第一端電性耦接至第二電晶體的第二端，第三電晶體的控制端電性耦接至第一電晶體的第二端；第四電晶體的第一端電性耦接至第三電晶體的第二端，第四電晶體的控制端電性耦接至第三控制訊號線；第一電容的一端電性耦接至第一電晶體的第二端，另一端電性耦接至第三電晶體的第一端；第二電容的一端電性耦接至第三電晶體的第一端，另一端電性耦接至第一電壓源線；發光元件的一端電性耦接至第四電晶體的第二端，另一端則電性耦接至第二電壓源線。
本發明另外提出一種自發光顯示器的像素結構，其可接收第一電壓源與第二電壓源。此像素結構包括第一～第四電晶體、第一與第二電容以及發光元件，且各電晶體各具有第一端、第二端與控制端。其中，第一電晶體的第一端用以接收資料訊號，第一電晶體的控制端用以接收第一控制訊號；第二電晶體的第一端用以接收第一電壓源，第二電晶體的控制端用以接收第二控制訊號；第三電晶體的第一端電性耦接至第二電晶體的第二端，第三電晶體的控制端電性耦接至第一電晶體的第二端；第四電晶體的第一端電性耦接至第三電晶體的第二端，第四電晶體的控制端用以接收第三控制訊號；第一電容的一端電性耦接至第一電晶體的第二端，另一端電性耦接至第三電晶體的第一端；第二電容的一端電性耦接至第三電晶體的第一端，另一端用以接收第一電壓源；發光元件的一端電性耦接至第四電晶體的第二端，另一端則用以接收第二電壓源。
本發明還提出一種自發光顯示器。此自發光顯示器包含多個前述的像素結構、資料驅動器、掃瞄驅動器以及電源供應器。其中，資料驅動器電性耦接各像素結構，用以提供每一像素結構的資料訊號；掃描驅動器電性耦接至像素結構，用以提供每一像素結構的第一控制訊號、第二控制訊號以及第三控制訊號；電源供應器則電性耦接各像素結構，用以提供每一像素結構的第一電壓源以及第二電壓源。
本發明另外提出一種像素結構的驅動方法，其適於驅動前述之像素結構。此驅動方法於第一時段中，在資料線上提供參考電位並設定第一控制訊號線與第二控制訊號線的電位，藉此導通第一電晶體與第二電晶體；之後則在第二時段中設定第二控制訊號線與第三控制訊號線的電位，藉此截止第二電晶體但導通第四電晶體；接下來在第三時段中維持第二電晶體為截止，並在第三時段內提供資料電位至資料線，且設定第一控制訊號線的電位以使資料電位經過第一電晶體而被導入至第三電晶體的控制端；之後再於第四時段中設定第一、第二與第三控制訊號線的電位，使第一電晶體截止且第二電晶體與第四電晶體導通。
在本發明的一個實施例中，上述的第四電晶體在第一、第二、第三與第四時段內皆保持為導通。
在本發明的另一個實施例中，上述的第三控制訊號線的電位被設定以使第四電晶體僅在第二與第四時段內保持為導通，而在第一與第三時段中則保持為截止。
本發明另外提出一種像素結構的驅動方法，其適於驅動前述之像素結構。此驅動方法於第一時段中，在資料線上提供參考電位並設定第一、第二及第三控制訊號線的電位，藉此導通第一電晶體與第二電晶體、第四電晶體；之後則在第二時段中設定第二控制訊號線與第三控制訊號線的電位，藉此截止第二電晶體但導通第四電晶體；接下來在第三時段中維持第二電晶體為截止且關閉第四電晶體，並在第三時段內提供資料電位至資料線，且設定第一控制訊號線的電位以使資料電位經過第一電晶體而被導入至第三電晶體的控制端；之後再於第四時段中設定第一、第二與第三控制訊號線的電位，使第一電晶體截止且第二電晶體與第四電晶體導通。
本發明因採用上述的像素結構，因此可以有效的依據不同需求而分別採用不同的驅動方式；再者，無論在哪一種顯示方式中，影像亮度補償的機制都以同樣的方式在操作，因此可以同時適用於同步與非同步顯示方式的顯示裝置中。
為讓本發明之上述和其他目的、特徵和優點能更明顯易懂，下文特舉較佳實施例，並配合所附圖式，作詳細說明如下。
請參照圖1，其為根據本發明一實施例之像素結構的電路圖。此實施例所示的像素結構包括四個P型電晶體M1 、M2 、M3 與M4 、兩個電容C1 與C2 以及一個發光元件O1 。如圖所示，P型電晶體M1 的一端接收資料訊號Data，P型電晶體M1 的控制端接收控制訊號SCAN，而P型電晶體M1 的另一端則電性耦接至電容C1 的其中一端以及P型電晶體M3 的控制端。P型電晶體M2 的一端電性耦接至電壓源OVDD以及電容C2 的其中一端，P型電晶體M2 的控制端接收控制訊號EM，而P型電晶體M2 的另一端則電性耦接至電容C1 的其中一端、電容C2 的其中一端以及P型電晶體M3 的一端。P型電晶體M3 除了上述的電性耦接關係之外，還有一端是電性耦接至P型電晶體M4 的其中一端。P型電晶體M4 除了電性耦接至P型電晶體M3 之外，還有一端電性耦接至發光元件O1 的一端，並有控制端電性耦接至控制訊號BP。最後，發光元件O1 的另一端電性耦接至電源電壓OVSS。
上述的像素結構是完全使用P型電晶體所完成的，除此之外，也可以完全使用N型電晶體來完成本發明所提供的像素結構。請參照圖2，其為根據本發明另一實施例之像素結構的電路圖。此實施例所示的像素結構包括四個N型電晶體N1 、N2 、N3 與N4 、兩個電容C1 與C2 以及一個發光元件O1 。
如圖所示，N型電晶體N1 的一端接收資料訊號Data，N型電晶體N1 的控制端接收控制訊號SCAN，而N型電晶體N1 的另一端則電性耦接至電容C1 的其中一端以及N型電晶體N3 的控制端。N型電晶體N2 的一端電性耦接至電壓源OVSS以及電容C2 的其中一端，N型電晶體N2 的控制端接收控制訊號EM，而N型電晶體N2 的另一端則電性耦接至電容C1 的其中一端、電容C2 的其中一端以及N型電晶體N3 的一端。N型電晶體N3 除了上述的電性耦接關係之外，還有一端是電性耦接至N型電晶體N4 的其中一端。N型電晶體N4 除了電性耦接至N型電晶體N3 之外，還有一端電性耦接至發光元件O1 的一端，並有控制端電性耦接至控制訊號BP。最後，發光元件O1 的另一端電性耦接至電源電壓OVDD。
此外，上述的P型電晶體與N型電晶體可以使用其他的電晶體元件來替換，但應能符合製程上的相關規定，上述的電晶體可以例如是場效電晶體、薄膜電晶體或薄膜場效電晶體。此外，上述的發光元件可以例如是發光二極體或是有機發光二極體。
接下來請參照圖3，其為根據本發明一實施例的自發光顯示裝置的電路方塊圖。在本實施例中，自發光顯示裝置30包含了多個像素結構P11 、P12 、P1m 、P21 、P22 、P2m 、Pn1 、Pn2 ...與Pnm 等，多個資料驅動器310至318(也可僅使用單一個資料驅動器310)，一個掃瞄驅動器320，以及一個電源供應器330。其中，像素結構Pxy 表示的是位於第x列第y欄處的像素結構，且圖中各元件的數量並不限於所示之圖式中的數量。資料驅動器310與312透過資料線D1 、D2 ...與Dm 來傳遞資料訊號Data。掃瞄驅動器320透過控制訊號線SCAN1 、SCAN2 ...與SCANn 來傳遞控制訊號SCAN，透過控制訊號線EM1 、EM2 ...與EMn 來傳遞控制訊號EM，並透過控制訊號線BP1 、BP2 ...與BPn 來傳遞控制訊號BP。電源供應器330則透過電源線OVDD1 、OVDD2 ...與OVDDm 來傳遞電壓源OVDD所提供的電位，並透過電源線OVSS1 、OVSS2 ...與OVSSm 來傳遞電壓源OVSS所提供的電位。其中電源線OVDD1 、OVDD2 ...與OVDDm 傳遞的電壓源OVDD可以是相同電壓大小的電壓源。相同的，電源線OVSS1 、OVSS2 ...與OVSSm 傳遞的電壓源OVSS可以是相同電壓大小的電壓源。
如圖所示，一個像素結構會分別電性耦接至一條資料線DT 、一條控制訊號線SCANS 、一條控制訊號線EMS 、一條控制訊號線BPS 、一條電源線OVDDT 與一條電源線OVSST 。其中，1Sn且1Tm。
舉例來說，像素結構P12 會電性耦接至資料線D2 、控制訊號線SCAN1 、EM1 與BP1 ，以及電源線OVDD2 與OVSS2 。設若像素結構P12 是採用如圖1所示的像素結構，則P型電晶體M1 的一端會電性耦接至資料線D2 以接收資料訊號，且P型電晶體M1 的控制端會電性耦接至控制訊號線SCAN1 以接收控制訊號SCAN，並根據控制訊號SCAN而使資料訊號被選擇性地提供至P型電晶體M1 與P型電晶體M3 之控制端電性耦接的一端。再者，P型電晶體M2 的一端會電性耦接至電源線OVDD2 以接收電壓源OVDD的電位，且P型電晶體M2 的控制端會電性耦接至控制訊號線EM1 以接收控制訊號EM，並根據控制訊號EM而使電壓源OVDD的電位被選擇性地提供至P型電晶體M2 與P型電晶體M3 、電容C1 及電容C2 電性耦接的一端。此外，P型電晶體M3 會根據其控制端上的電位，使電容C1 與P型電晶體M2 電性耦接的一端能選擇性地電性耦接至P型電晶體M3 與P型電晶體M4 電性耦接的一端；P型電晶體M4 的控制端會電性耦接至控制訊號線BP1 以接收控制訊號BP，並根據控制訊號BP而使P型電晶體M4 與P型電晶體M3 電性耦接的一端能選擇性地電性耦接至發光元件O1 的一端。
接下來請參照圖4，其為根據本發明一實施例的像素結構的驅動方法在同步(simultaneously)顯示方式下所得波形的時序圖。請同時參照圖1、圖3與圖4，以下將使用像素結構P11為例來進行說明。
首先，在時段T1中，資料驅動器310會在資料線D1 上提供一個參考電位Vref 做為資料訊號Data的電位，而且控制訊號線SCAN1 所提供之控制訊號SCAN的電位會被設定為邏輯低，控制訊號線EM1 所提供之控制訊號EM的電位會被設定為邏輯低，控制訊號線BP1 所提供之控制訊號BP的電位則會被設定為邏輯高。藉此，P型電晶體M1 與M2 都會因為控制端上的電位為邏輯低而導通，但P型電晶體M4 則會因為控制端上的電位為邏輯高而截止。P型電晶體M1 的導通會使資料訊號Data(此時電位為Vref )被傳送到P型電晶體M3 的控制端，換言之，根據電位Vref 而設定P型電晶體M3 的控制端的電位，而P型電晶體M2 的導通則會使電壓源OVDD的電位被傳送到P型電晶體M2 與P型電晶體M3 電性耦接的一端，換言之，根據電壓源OVDD的電位而設定P型電晶體M2 與P型電晶體M3 電性耦接的一端的電位。
接下來，在時段T2 之中，資料線D1 與控制訊號線SCAN1 上的電位保持不變，但是控制訊號線EM1 所提供之控制訊號EM的電位會被設定為邏輯高，而控制訊號線BP1 所提供之控制訊號BP的電位則會被設定為邏輯低。如此一來，P型電晶體M2 會變成截止，但P型電晶體M4 則會被導通。此時，P型電晶體M3 的控制端上的電位會被維持在Vref ，而P型電晶體M3 與P型電晶體M2 電性耦接的一端上面的電位，則會從原本為電壓源OVDD的電位逐漸改變，直到電位變成Vref -Vth 而使P型電晶體M3 截止才會停止變化。其中，Vth 是P型電晶體M3 的閥值(threshold value)。
接下來，在時段T3 之中，控制訊號線EM1 所提供之控制訊號EM的電位會被維持在邏輯高，而控制訊號線BP1 所提供之控制訊號BP的電位則會被設定為邏輯高。在此條件下，P型電晶體M2 會維持在截止的狀況，而P型電晶體M4 也會成為截止的狀況。
由於所示者為進行同步顯示的狀況，所以在時段T3 中，不同位置的像素結構在被寫入電壓時需要保持在不發光的狀態，於是P型電晶體M4 必須在時段T3 中被維持在截止的狀況下。另外，在時段T3 中必須對各像素結構進行資料訊號的充電操作，所以在時段T3 中會有一段時間使得控制訊號SCAN的電位變成邏輯低，並且在同時於資料線D1 上提供正確的資料訊號DA(假設電位為Vdata )，以使資料訊號DA能被傳遞到P型電晶體M3 的控制端上，換言之，根據資料訊號DA設定P型電晶體M3 的控制端的電位。由於一條資料線會同時電性耦接到多個像素結構，所以在同一條資料線上勢必要有不同的時段來分別提供資料訊號到這些像素結構中。因此，在資料線上所傳遞的資料訊號是要提供給特定像素結構的時段內，電性耦接到這一條資料線上的其他像素結構中的P型電晶體M1 就必須被截止，以防止這些像素結構接收到錯誤的資料訊號。這些時段被稱為資料維持(data holding)時段，其正如圖4所示的時段TH1 與TH2 處。
隨著資料訊號DA被傳遞到P型電晶體M3 的控制端，P型電晶體M3 與P型電晶體M2 電性耦接的一端會因為電容C1 與C2 的分壓而使得電位變成Vref -Vth +dV，其中dV為(Vdata -Vref )*C1 /(C1 +C2 )。
當所有的資料訊號都被寫入對應的像素結構之後，像素結構的操作期間就會離開時段T3 並進入時段T4 。在時段T4 中，控制訊號線SCAN1 所提供之控制訊號SCAN的電位會被設定為邏輯高，而控制訊號線EM1 所提供之控制訊號EM的電位會被設定為邏輯低，控制訊號線BP1 所提供之控制訊號BP的電位也會被設定為邏輯低。藉此，P型電晶體M1 就不會導通，而P型電晶體M2 與M4 則會被導通，並使得發光元件O1 開始發光。
在時段T4 中，因為P型電晶體M2 被導通，所以P型電晶體M2 與P型電晶體M3 電性耦接的一端上的電位會再度變成電壓源OVDD所提供的電位。因此，P型電晶體M3 的控制端上的電位會因為電容C1 的耦合效應而被從原先的資料訊號的電位Vdata 變為Vdata +OVDD-Vref +Vth -dV。
由於發光元件的亮度與流通的電流有關，而發光元件上所流通的電流I又跟P型電晶體M3 的控制端與源極端的電位差異VGS 以及其閥值Vth 有關，具體如下：
I=k*(VGS -Vth )2
因此，若將VGS 以上述的P型電晶體M3 的控制端與源極端的電位分別代入，則發光元件O1 上的電流I就會變成：
I=k*[(Vdata +OVDD-Vref +Vth -dV)-(OVDD)-Vth ]2
也就是說：
I=k*[(Vdata -Vref -dV)]2
因此，發光元件O1 的發光能力就與各電晶體之間的特性差異變化無關。
除了上述的做法之外，本發明還可以進一步適用於非同步(non-simultaneously)顯示方式。由於在非同步顯示方式中不需要在全部的像素結構都被充電之後才一起進行顯示，所以P型電晶體M4 在時段T1 與T3 中不需要變成截止的狀態。也就是說，除了P型電晶體M4 在時段T1 與時段T3 中變成導通狀態之外(換言之，BP可一值維持邏輯低準位)，其餘的操作方式及操作原理都與圖4所示的實施例相同，在此不再贅述。
經過實驗，發明人證明了上述像素結構及相關操作方法的確對於因為電晶體閥值的變異所造成的亮度不均勻現象有良好的改善效果。請參照圖5A與5B，其中，圖5A為對本發明所提供之像素結構進行對應的驅動操作後所得的資料訊號電壓與發光元件電流間的關係曲線圖，圖5B則是對如圖6所示之像素結構進行對應的驅動操作後所得的資料訊號電壓與發光元件電流間的關係曲線圖。由圖5A可知，在不同的電晶體閥值下，例如電晶體閥值沒有飄移(shift)、飄移+0.3V或飄移-0.3V的情況下，其資料訊號電壓與發光元件電流間的關係幾近是一致的。對比起圖5B而言，其改善程度甚為明顯。
綜上所述，本發明所提供的像素結構可以同時在同步及非同步顯示方式中進行顯示亮度的補償，並且可以補償因為電晶體閥值的變異所造成的亮度不均勻現象，但在實際使用上有更大的適用範圍。
雖然本發明已以較佳實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
30‧‧‧自發光顯示裝置
310~318‧‧‧資料驅動器
320‧‧‧掃瞄驅動器
330‧‧‧電源供應器
C1 、C2 ‧‧‧電容
CS ‧‧‧儲存電容
M1 ~M4 ‧‧‧P型電晶體
N1 ~N4 ‧‧‧N型電晶體
Data‧‧‧資料訊號
EM、BP、SCAN‧‧‧控制訊號
OVDD、OVSS‧‧‧電壓源
O1 ‧‧‧發光元件
T1 、T2 、T3 、T4 、TH1 、TH2 ‧‧‧時段
TR1 、TR2 ‧‧‧電晶體
EM1 ~EMn 、BP1 ~BPn 、SCAN1 ~SCANn ‧‧‧控制訊號線
D1 ~Dm ‧‧‧資料線
OVDD1 ~OVDDm 、OVSS1 ~OVSSm ‧‧‧電源線
P11 ~Pnm ‧‧‧像素結構
Vth ‧‧‧閥值
Vref ‧‧‧參考電位
DA‧‧‧資料訊號
Vdata ‧‧‧資料訊號的電位
圖1為根據本發明一實施例之像素結構的電路圖。
圖2為根據本發明另一實施例之像素結構的電路圖。
圖3為根據本發明一實施例的自發光顯示裝置的電路方塊圖。
圖4為根據本發明一實施例的像素結構的驅動方法在同步顯示方式下所得波形的時序圖。
圖5A為對本發明所提供之像素結構進行對應的驅動操作後所得的資料訊號電壓與發光元件電流間的關係曲線圖。
圖5B為對2T1C像素結構進行對應的驅動操作後所得的資料訊號電壓與發光元件電流間的關係曲線圖。
圖6為先前技術中所常用的2T1C像素結構的電路方塊圖。
C1 、C2 ‧‧‧電容
M1 ~M4 ‧‧‧P型電晶體
O1 ‧‧‧發光元件
Data‧‧‧資料訊號
EM、BP、SCAN‧‧‧控制訊號
OVDD、OVSS‧‧‧電壓源

Claims (10)

  1. 一種自發光顯示器的像素結構，電性耦接至一資料線、一第一電壓源線、一第二電壓源線、一第一控制訊號線、一第二控制訊號線與一第三控制訊號線，該像素結構包括：一第一電晶體，具有第一端、第二端與控制端，該第一電晶體的第一端電性耦接至該資料線，該第一電晶體的控制端電性耦接至該第一控制訊號線；一第二電晶體，具有第一端、第二端與控制端，該第二電晶體的第一端電性耦接至該第一電壓源，該第二電晶體的控制端電性耦接至該第二控制訊號線；一第三電晶體，具有第一端、第二端與控制端，該第三電晶體的第一端電性耦接至該第二電晶體的第二端，該第三電晶體的控制端電性耦接至該第一電晶體的第二端；一第四電晶體，具有第一端、第二端與控制端，該第四電晶體的第一端電性耦接至該第三電晶體的第二端，該第四電晶體的控制端電性耦接至該第三控制訊號線；一第一電容，具有第一端與第二端，該第一電容的第一端電性耦接至該第一電晶體的第二端，該第一電容的第二端電性耦接至該第三電晶體的第一端；一第二電容，具有第一端與第二端，該第二電容的第一端電性耦接至該第三電晶體的第一端，該第二電容的第二端電性耦接至該第一電壓源線；以及一發光元件，一端電性耦接至該第四電晶體的第二端，另一端電性耦接至該第二電壓源線。
  2. 如申請專利範圍第1項所述之像素結構，其中該第一、第二、第三與第四電晶體皆為P型電晶體。
  3. 如申請專利範圍第1項所述之像素結構，其中該第一、第二、第三與第四電晶體皆為N型電晶體。
  4. 一種自發光顯示器的像素結構，接收一第一電壓源與一第二電壓源，該像素結構包括：一第一電晶體，具有第一端、第二端與控制端，該第一電晶體的第一端用以接收一資料訊號，該第一電晶體的控制端用以接收一第一控制訊號；一第二電晶體，具有第一端、第二端與控制端，該第二電晶體的第一端用以接收該第一電壓源，該第二電晶體的控制端用以接收一第二控制訊號；一第三電晶體，具有第一端、第二端與控制端，該第三電晶體的第一端電性耦接至該第二電晶體的第二端，該第三電晶體的控制端電性耦接至該第一電晶體的第二端；一第四電晶體，具有第一端、第二端與控制端，該第四電晶體的第一端電性耦接至該第三電晶體的第二端，該第四電晶體的控制端用以接收該第三控制訊號；一第一電容，具有第一端與第二端，該第一電容的第一端電性耦接至該第一電晶體的第二端，該第一電容的第二端電性耦接至該第三電晶體的第一端；一第二電容，具有第一端與第二端，該第二電容的第一端電性耦接至該第三電晶體的第一端，該第二電容的第二端用以接收該第一電壓源；以及 一發光元件，一端電性耦接至該第四電晶體的第二端，另一端用以接收該第二電壓源。
  5. 如申請專利範圍第4項所述之像素結構，其中：該第一電晶體係用以使該資料訊號選擇性提供至該第一電容的第一端；該第二電晶體係用以使第一電壓源選擇性提供至該第三電晶體的第一端、該第二電容的第二端與該第一電容的第二端；該第三電晶體係用以使該第一電容的第二端選擇性電性耦接至該第四電晶體的第一端；以及該第四電晶體係用以使該第三電晶體的第二端選擇性電性耦接至該發光元件的第一端。
  6. 一種自發光顯示器，包含：複數如申請專利範圍第4項所述的像素結構；一資料驅動器，電性耦接該些像素結構，用以提供每一該些像素結構的該資料訊號；一掃描驅動器，電性耦接該些像素結構，用以提供每一該些像素結構的該第一控制訊號、該第二控制訊號以及該第三控制訊號；以及一電源供應器，電性耦接該些像素結構，用以提供每一該些像素結構的該第一電壓源以及該第二電壓源。
  7. 一種像素結構的驅動方法，適於驅動如申請專利範圍第1項所述之像素結構，該驅動方法包括： 於一第一時段中，在該資料線上提供一參考電位並設定該第一控制訊號線與該第二控制訊號線的電位，藉此導通該第一電晶體與該第二電晶體；在該第一時段後的一第二時段中，設定該第二控制訊號線與該第三控制訊號線的電位，藉此截止該第二電晶體但導通該第四電晶體；在該第二時段後的一第三時段中，維持該第二電晶體為截止，並在該第三時段內，提供一資料訊號至該資料線，且設定該第一控制訊號線的電位以使該第三電晶體的控制端的電位根據該資料電位經過該第一電晶體而被設定；以及在該第三時段後的一第四時段中，設定該第一控制訊號線、該第二控制訊號線與該第三控制訊號線的電位，使該第一電晶體截止且該第二電晶體與該第四電晶體導通。
  8. 如申請專利範圍第7項所述的驅動方法，其中該第四電晶體在該第一、第二、第三與第四時段內皆保持為導通。
  9. 如申請專利範圍第7項所述的驅動方法，其中該第三控制訊號線的電位被設定以使該第四電晶體僅在該第二與第四時段內保持為導通，而在該第一與第三時段中則保持為截止。
  10. 如申請專利範圍第9項所述的驅動方法，其中提供該資料電位至該資料線，且設定該第一控制訊號線的電位以使該資料電位經過該第一電晶體而被導入至該第三電晶體的控制端的時間長度，僅為該第三時段中的一部分時段。
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