CN101257772A - 印刷电路板的制造方法、印刷电路板以及电子装置 - Google Patents
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Abstract
一种印刷电路板的制造方法、印刷电路板以及电子装置,该制造方法包括以下步骤:孔形成步骤,其在将于加工后成为印刷电路板的部件的基板中形成通孔;以及插入夹具步骤,其在孔形成步骤中所形成的通孔中插入夹具,以使夹具附着在该通孔的内壁的一部分上,且该内壁具有连接到通孔的外部的部分。该方法还包括导电膜形成步骤,其在插入夹具步骤中夹具插入通孔之后,仅在该通孔的内壁的、连接到该通孔的外部的部分上形成导电膜。
Description
技术领域
本发明涉及特别在通孔形成过程中具有特征的印刷电路板的制造方法、由该制造方法制成的印刷电路板、以及配备有这种印刷电路板的电子装置。
背景技术
普遍地,通过在印刷电路板上安装电子元件来制作电子电路。电子电路通过电子元件内的多个电路和印刷电路板上的信号线之间的布线来执行所需的操作。
在印刷电路板上形成通孔,以用于安装电子元件或连接形成在印刷电路板的不同层上的引线,并且通过诸如电镀之类的工艺在通孔内壁上形成导电膜,用以连接多个层中的引线。而且,在将电子元件的导线插入通孔后,通过焊接使电子元件连接到印刷电路板的引线。
这里,在连接多个层中的引线并利用通孔内壁的导电膜高速传送信号的情况下,为了减少因通孔的导电膜而导致的传输损耗,通孔内壁的导电膜并没有形成在通孔的、从印刷电路板的表面到底面的整个范围上,而是除去了非必要位置上的导电膜,只留下用于连接穿越多个层进行高速传输用的引线所必需的部分。
图1示出了去除形成在印刷电路板的通孔内的导电膜的外观。图2示出了除去形成在印刷电路板的通孔内的导电膜的一部分之后的外观。在图1和图2中,作为示例只示出了印刷电路板10的一个通孔11。
这里,在通孔11的内壁上形成导电膜111,并且将位于四个高度的引线101,102,103,104之中的位于两个高度的引线101和引线102设置为与导电膜111连接。这时,首先是在通孔11的内壁的整个区域上,即在从印刷电路板10的表面到其底面的整个区域上一次形成导电膜,之后如图1所示,通过钻孔机20除去形成在通孔11内壁上的导电膜111,且如图2所示仅留下通孔11的内壁上的、与两层中的引线101和102连接的部分导电膜111。在此情况下,即使不考虑导电膜111,在通孔11的内壁的经钻孔机处理的部分和未被钻孔机处理的部分之间也会形成位差112。这样能够减少通孔11中通过引线101和102传输高速信号的传输损耗。
然而,在这种方法中,在通孔内壁中形成导电层后还要将该导电层除去。这增加了加工过程的次数,因而成本提高,并且还涉及由于导电膜除去不充分而产生的残余物非常容易引起多个引线之间发生短路的问题。
为了解决上述问题,日本专利申请第2003-204157号公报中提出了一种技术:在印刷电路板中埋设电镀阻止层(plating prevention layer),其中导电膜不能通过电镀或类似方法附着在该电镀阻止层上,并且在通孔的内壁上露出电镀阻止层的部分切断导电膜。
此外,日本专利申请第1990-143588号公报中提出了一种技术:在较大的印刷电路板中形成绝缘板的中间单层,该绝缘板由不可电镀处理的材料制成,因而防止了导电膜形成在通孔内壁的、露出绝缘板的部分上。
然而,在上述日本专利申请第2003-204157号公报中提出的技术中,由于通孔内壁的导电膜仅被薄的电镀阻止层的端面分隔,故在高速信号的情况下会发生电子耦合,因此很容易产生不能充分地减少传输损耗的情况。
而在上述日本专利申请第1990-143588号公报中提出的技术中,由于多个通孔之间的导电膜仅依靠绝缘板分隔,因此即使在高速信号情况下也非常容易发生耦合,这可以减少传输损耗。然而,应用此技术,由于在任何通孔中内壁上的导电膜都被绝缘板分隔,因而不可能仅分隔与处理高速信号传输的引线相连接的通孔的导电膜。因此,该技术不能应用于以下情况,即,在印刷电路板中内壁的导电膜应该被分隔的通孔和内壁的导电膜不应被分隔的通孔散置。
发明内容
鉴于以上问题构思出本发明,本发明提供一种印刷电路板的制造方法、由该制造方法制成的印刷电路板、以及配备有该印刷电路板的电子装置,该印刷电路板的制造方法用以制造这样一种印刷电路板,其中在不需要后续处理的情况下仅在必要的通孔的内壁的一部分上形成导电膜。
根据本发明的印刷电路板的制造方法包括以下步骤:
孔形成步骤,即,在一基板中形成通孔,该基板将在制造后成为印刷电路板的部件;
插入夹具步骤,即,在孔形成步骤中所形成的通孔中插入夹具,以使夹具附着在通孔的内壁的一部分上,该内壁具有连接到通孔的外部的部分;以及
导电膜形成步骤,即,在夹具插入步骤中夹具插入通孔之后,仅在通孔内壁的、连接到该通孔的外部的部分上形成导电膜。
根据本发明的印刷电路板的制造方法,在形成通孔之后,在该孔内插入夹具以附着在该孔内壁的一部分上之后形成导电膜,因此能够仅在该通孔的内壁的、该夹具未附着到的部分上形成导电膜。因而,不仅能够省略随后的诸如上述钻孔之类的后续加工,而且还能够省略如日本专利申请第2003-204157号公报和日本专利申请第1990-143588号公报中所使用的特殊材料。从而,可以仅在必要的通孔的内壁的一部分上形成导电膜。
这里,根据本发明的印刷电路板的制造方法中,导电膜形成步骤是通过电镀形成基板的外表面,以及在通孔的内壁的、连接到通孔的外部的部分上形成导电膜的步骤。
而且,根据本发明的印刷电路板是内部形成有通孔的印刷电路板,其中:至少在该印刷电路板的、形成该通孔的内壁的一部分上不使用阻碍导电膜附着的材料;以及
仅在通孔的内壁的一部分上形成导电膜,并且当不考虑导电膜时,通孔的内壁的、形成导电膜的部分与通孔的内壁的、未形成导电膜的部分齐平。
本发明的印刷电路板不需要应用如日本专利申请第2003-204157号公报和第1990-143588号公报所提出的、阻碍导电膜附着在通孔内壁上的材料。而且,在本发明的这种印刷电路板中,通孔的内壁上没有形成位差,而当进行钻孔操作时,会因为钻孔而不可避免地形成这种位差。
这里,在根据本发明的印刷电路板中,形成在通孔的内壁上的导电膜电连接至多个层的信号传递图案。
此外,根据本发明的电子装置包括:上述印刷电路板;以及安装在该印刷电路板上的电子元件。
利用上述的本发明,不必使用后续的处理,此外,可以仅在需要形成导电膜的、通孔内壁的一部分上形成导电膜。
附图说明
图1示出了对印刷电路板的通孔内形成的导电膜的一部分进行去除的状态。
图2示出了印刷电路板的通孔内形成的导电膜的一部分已被去除后的状态。
图3示出了在形成于基板中的孔内插入夹具的状态。
图4示出了在孔内插入夹具的状态下实施电镀步骤加工之后的印刷电路板。
图5示出了在形成于基板中的孔内插入与图3中示出的夹具类型不同的夹具的状态。
图6示出了在形成于基板中的孔内插入夹具的状态的另一示例。
图7示出了通过在图6中所示的状态下实施电镀步骤而形成的印刷电路板。
图8示出了印刷电路板的制造方法的第一示例。
图9示出了印刷电路板的制造方法的第二示例。
图10示出了印刷电路板的制造方法的第三示例。
图11示出了印刷电路板的制造方法的第四示例。
具体实施方式
以下将描述本发明的实施例。首先描述本发明的特征,然后描述印刷电路板的整个制造过程。
图3示出了在形成于基板中的孔内插入夹具的状态。
图3中所示的基板30A是将在制造后成为印刷电路板的基板,且该基板30A中已形成有多条引线301至305。该基板30A中形成有孔40A,该孔40A在加工后将作为通孔,且该孔40A插有夹具50。该夹具50具有附着至孔40A内壁上的大直径部501,以及不接触该内壁的小直径部502。如图3所示,夹具50插入孔40A中,以使小直径部502位于孔40A的内壁的、露出两条信号线301和302的端面的部分上,而大直径部分501则附着在该内壁的其余部分上。
这里,在夹具50插入孔40A的情况下,仅在孔40A的内壁的、夹具50的小直径部502所在的区域上通过电镀形成由铜等制成的导电膜。
图4示出了在孔内插入夹具的状态下实施电镀步骤加工之后的印刷电路板。
印刷电路板30B是在如图3所示夹具50插入孔40A的状态下实施电镀而制成的印刷电路板,并且并不是在通孔40B的内壁的、从表面到底面的整个区域上形成导电膜401,而是仅在连接两条信号线301和302的区域上形成导电膜401。而且,这里也示出了通过电镀形成在印刷电路板30B的表面和底面上的引线306和307的状态。
在本实施例中,由于应用了上述制造方法,因此如果完全忽略通孔内壁的导电膜401,则除了由于插入时夹具压向内壁而可能发生的微不足道的直径增大以外,将形成不存在位差的内壁。
图5示出了在形成于基板中的孔内插入与图3中示出的夹具类型不同的夹具的状态。
图5中的基板30A与图3中的基板30A相同。
在图5中,设置了形成有通孔511的中空夹具51,以便附着在露出两条信号线301和302的各自端部的孔40A的、内壁的一个区域上。
这里,由于应用了中空夹具51,因此能够在电镀时使电镀液流过孔40A,改善了流动,从而能够更加可靠地在孔40A的内壁上形成导电膜层。
图6示出了在形成于基板中的孔内插入夹具的状态的另一个示例。图7示出了通过在图6中所示的状态下实施电镀步骤形成的印刷电路板。
在图6中所示的基板30C中形成孔40C,且在孔40C的中央部分露出两条信号线301′和302′的端面,所述两条信号线301′和302′待连接于形成在孔40C内壁上的导电膜。因此,分别具有通孔531和541的夹具53和54从孔40C的两端插入,并附着至孔40C的、除了露出两条信号线301′和302′的端面的中央部分以外的两侧。如图7中所示,当在这一状态下实施电镀时,形成印刷电路板30D,在该印刷电路板中仅在通孔40D的内表面的中央区域形成导电膜402。
以下将概述印刷电路板的制造过程。这里,应用具有图3的夹具50的类型的夹具。
图8示出了印刷电路板的制造方法的第一示例。
在这里所描述的图8和稍后描述的图9-图11中,印刷电路板的内层的布线并不示出,因此不予说明。
这里,如图8的部分(A)中所示,首先通过在树脂601的表面和底面上形成铜层602而制备基板60,然后实施成孔加工,以在同一基板60上形成孔61。
然后,如图8的部分(B)中所示,在孔61中插入夹具50,并通过电镀形成铜层603。
之后,如图8的部分(C)中所示,移除夹具50,形成阻镀膜(plate resistfilm)604,以及如图8的部分(D)中所示,通过在未形成阻镀膜604的区域上实施电镀而形成铜层605和位于铜层605上的焊剂层606。
接着,如图8的部分(E)中所示,通过蚀刻除去阻镀膜604和阻镀膜604下方的铜层,且如图8的部分(F)中所示,通过印刷形成抗蚀膜607。此外,如图8的部分(G)中所示,实施抗锈蚀(anti-tarnish)处理608。
在这一方式中,通过在如图8的部分(B)中所示的电镀步骤中插入夹具50的状态下实施电镀,制造出印刷电路板,其具有仅在内壁的一部分上形成铜膜的通孔。
图9示出了印刷电路板的制造方法的第二示例。
图9中的部分(A)-(E)中的步骤与图8中的部分(A)-(E)中的步骤相同,故在此不再赘述。
在图9的部分(F)中,在焊剂层606的表面上实施剥离处(avulsiontreatment)。
图9中的部分(G)-(H)中的步骤与图8中的部分(F)-(G)中的步骤相同。
在图9中所示的制造方法的情况下,与图8中所示的制造方法相比较,由于加入了如图9的部分(F)中所示的对焊剂层606的剥离处理,因此能够形成比图8的制造方法中的引线宽度的极限值(130微米)更细的引线。
图10示出了印刷电路板的制造方法的第三示例。
图10中的部分(A)-(G)中的步骤与图9中的部分(A)-(G)中的步骤相同,故在此不再赘述。
在图10的部分(H)中,通过使用焊料(solder spray)代替图9的部分(G)和(H)中的抗锈蚀处理而形成焊剂层609。
图11示出了印刷电路板的制造方法的第四示例。
在图11的部分(A)和(B)中,以与图8的部分(A)和(B)的方式相同的方式,通过在树脂601的表面和底面上形成铜层602而制备基板60,然后通过对基板60实施成孔加工而形成孔61,并在孔61中插入夹具50的状态下通过电镀形成铜层603。
之后,如图11的(C)部分所示,通过干膜光刻(dry-film lithography)和显像而形成抗蚀膜611,并且如图11的(D)部分中所示,通过蚀刻除去未被抗蚀膜611覆盖的区域的铜层,然后除去抗蚀膜611。之后,以与图8中的部分(F)和部分(G)的方式相同的方式形成抗蚀膜607(图11中的部分(E)),并实施抗锈蚀处理。
如图8-图11所示,本发明能够应用至许多不同的印刷电路板的制造方法。
Claims (5)
1.一种印刷电路板的制造方法,包括以下步骤:
孔形成步骤,即,在一基板中形成通孔,该基板将在制造后成为印刷电路板的部件;
插入夹具步骤,即,在该孔形成步骤中所形成的该通孔中插入夹具,以使该夹具附着在该通孔的内壁的一部分上,该内壁具有连接到该通孔的外部的部分;以及
导电膜形成步骤,即,在该插入夹具步骤中该夹具插入该通孔之后,仅在该通孔的内壁的、连接到该通孔的外部的部分上形成导电膜。
2.如权利要求1所述的印刷电路板的制造方法,其中,该导电膜形成步骤是通过电镀形成该基板的外表面,以及在该通孔的内壁的、连接到该通孔的外部的部分上形成该导电膜的步骤。
3.一种内部形成有通孔的印刷电路板,其中:至少在该印刷电路板的、形成该通孔的内壁的一部分上不使用阻碍导电膜附着的材料;以及
仅在该通孔的内壁的一部分上形成导电膜,并且当不考虑该导电膜时,该通孔的内壁的、形成该导电膜的部分与该通孔的内壁的、未形成该导电膜的部分齐平。
4、如权利要求3所述的印刷电路板,其中,形成在该通孔的内壁上的所述导电膜电连接至多个层的信号传递图案。
5、一种电子装置,包括:如权利要求3所述的印刷电路板;以及安装在该印刷电路板上的多个电子元件。
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Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN107396534A (zh) * | 2016-05-16 | 2017-11-24 | 明泰科技股份有限公司 | 传输线的阻抗匹配架构 |
CN114390804A (zh) * | 2022-03-24 | 2022-04-22 | 苏州浪潮智能科技有限公司 | 一种无残桩的过孔制作方法、pcb板及电子设备 |
CN114900995A (zh) * | 2022-06-28 | 2022-08-12 | 生益电子股份有限公司 | 多级防镀结构、具有多层网络的通孔制作方法及pcb |
CN114980570A (zh) * | 2022-06-28 | 2022-08-30 | 生益电子股份有限公司 | 一种通孔部分金属化的制作工艺及pcb |
CN114980501A (zh) * | 2022-06-28 | 2022-08-30 | 生益电子股份有限公司 | 一种塞孔结构、双面压接孔的制作方法及pcb |
CN115066093A (zh) * | 2022-06-28 | 2022-09-16 | 生益电子股份有限公司 | 一种塞孔结构、埋孔制作方法及pcb |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7672140B2 (en) * | 2008-01-22 | 2010-03-02 | Tensolite LLC | Circuit board configuration |
KR101483875B1 (ko) * | 2013-07-31 | 2015-01-16 | 삼성전기주식회사 | 글라스 코어기판 및 그 제조방법 |
US10440814B2 (en) | 2016-05-06 | 2019-10-08 | Alpha Networks Inc. | Impedance matching structure of transmission line in multilayer circuit board |
TWI619302B (zh) | 2016-05-06 | 2018-03-21 | 明泰科技股份有限公司 | 傳輸線的阻抗匹配架構 |
CN112752399B (zh) * | 2020-11-26 | 2022-06-14 | 苏州浪潮智能科技有限公司 | 印制电路板及其通孔的加工方法 |
Family Cites Families (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS631373U (zh) * | 1986-06-20 | 1988-01-07 | ||
JPH0716097B2 (ja) | 1988-11-25 | 1995-02-22 | 日本電気株式会社 | 多層印刷配線板の製造方法 |
JP2666470B2 (ja) * | 1989-05-09 | 1997-10-22 | 日立化成工業株式会社 | 無電解めっき法 |
JPH05211384A (ja) * | 1991-11-20 | 1993-08-20 | Nec Corp | 印刷配線板のめっき方法 |
JPH07154070A (ja) * | 1993-12-01 | 1995-06-16 | Nec Corp | 印刷配線板の製造方法 |
US5953629A (en) * | 1995-06-09 | 1999-09-14 | Vacuum Metallurgical Co., Ltd. | Method of thin film forming on semiconductor substrate |
AU696221B2 (en) * | 1995-09-21 | 1998-09-03 | Asahi Kasei Kogyo Kabushiki Kaisha | Hollow fiber membrane module |
JPH10215072A (ja) * | 1997-01-30 | 1998-08-11 | Nec Toyama Ltd | 多層印刷配線板の製造方法 |
JP3756041B2 (ja) * | 1999-05-27 | 2006-03-15 | Hoya株式会社 | 多層プリント配線板の製造方法 |
US7183650B2 (en) * | 2001-07-12 | 2007-02-27 | Renesas Technology Corp. | Wiring glass substrate for connecting a semiconductor chip to a printed wiring substrate and a semiconductor module having the wiring glass substrate |
JP2003204157A (ja) | 2001-12-28 | 2003-07-18 | Toshiba Corp | 多層プリント配線板、多層プリント配線板を搭載した電子機器および多層プリント配線板の製造方法 |
JP2003204015A (ja) * | 2002-01-10 | 2003-07-18 | Oki Electric Ind Co Ltd | 半導体装置、半導体装置の製造方法、及びインターポーザ基板の製造方法 |
JP4099501B2 (ja) * | 2004-10-04 | 2008-06-11 | 株式会社丸和製作所 | プリント基板の製造方法 |
KR100663265B1 (ko) * | 2005-05-10 | 2007-01-02 | 삼성전기주식회사 | 다층 기판 및 그 제조 방법 |
JP4520392B2 (ja) * | 2005-05-12 | 2010-08-04 | 株式会社丸和製作所 | プリント基板の製造方法 |
JP4800666B2 (ja) * | 2005-05-27 | 2011-10-26 | 富士フイルム株式会社 | 液体吐出ヘッド及びその製造方法 |
CN101189921A (zh) * | 2005-06-01 | 2008-05-28 | 松下电器产业株式会社 | 电路基板和其制造方法以及使用该电路基板的电子部件 |
JP2007067216A (ja) * | 2005-08-31 | 2007-03-15 | Sanyo Electric Co Ltd | 半導体装置およびその製造方法、回路基板およびその製造方法 |
-
2007
- 2007-02-28 JP JP2007050023A patent/JP5023738B2/ja not_active Expired - Fee Related
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- 2007-12-26 CN CNB2007103053227A patent/CN100574572C/zh not_active Expired - Fee Related
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN107396534A (zh) * | 2016-05-16 | 2017-11-24 | 明泰科技股份有限公司 | 传输线的阻抗匹配架构 |
CN107396534B (zh) * | 2016-05-16 | 2019-10-18 | 明泰科技股份有限公司 | 传输线的阻抗匹配架构 |
CN114390804A (zh) * | 2022-03-24 | 2022-04-22 | 苏州浪潮智能科技有限公司 | 一种无残桩的过孔制作方法、pcb板及电子设备 |
CN114390804B (zh) * | 2022-03-24 | 2022-07-08 | 苏州浪潮智能科技有限公司 | 一种无残桩的过孔制作方法、pcb板及电子设备 |
WO2023179135A1 (zh) * | 2022-03-24 | 2023-09-28 | 苏州浪潮智能科技有限公司 | 无残桩的过孔制作方法、pcb板、电子设备及存储介质 |
CN114900995A (zh) * | 2022-06-28 | 2022-08-12 | 生益电子股份有限公司 | 多级防镀结构、具有多层网络的通孔制作方法及pcb |
CN114980570A (zh) * | 2022-06-28 | 2022-08-30 | 生益电子股份有限公司 | 一种通孔部分金属化的制作工艺及pcb |
CN114980501A (zh) * | 2022-06-28 | 2022-08-30 | 生益电子股份有限公司 | 一种塞孔结构、双面压接孔的制作方法及pcb |
CN115066093A (zh) * | 2022-06-28 | 2022-09-16 | 生益电子股份有限公司 | 一种塞孔结构、埋孔制作方法及pcb |
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