TWI676710B - 半導體裝置的製造方法、基板處理裝置及記錄媒體 - Google Patents

半導體裝置的製造方法、基板處理裝置及記錄媒體 Download PDF

Info

Publication number
TWI676710B
TWI676710B TW107129055A TW107129055A TWI676710B TW I676710 B TWI676710 B TW I676710B TW 107129055 A TW107129055 A TW 107129055A TW 107129055 A TW107129055 A TW 107129055A TW I676710 B TWI676710 B TW I676710B
Authority
TW
Taiwan
Prior art keywords
gas
tungsten film
film
substrate
processing
Prior art date
Application number
TW107129055A
Other languages
English (en)
Other versions
TW201920763A (zh
Inventor
中山雅則
Masanori Nakayama
舟木克典
Katsunori Funaki
上田立志
Tatsushi Ueda
坪田康寿
Yasutoshi Tsubota
竹島雄一郎
Yuichiro Takeshima
井川博登
Hiroto Igawa
山角宥貴
Yuki YAMAKADO
Original Assignee
日商國際電氣股份有限公司
Kokusai Electric Corporation
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 日商國際電氣股份有限公司, Kokusai Electric Corporation filed Critical 日商國際電氣股份有限公司
Publication of TW201920763A publication Critical patent/TW201920763A/zh
Application granted granted Critical
Publication of TWI676710B publication Critical patent/TWI676710B/zh

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76838Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
    • H01L21/76886Modifying permanently or temporarily the pattern or the conductivity of conductive members, e.g. formation of alloys, reduction of contact resistances
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
    • H01L21/28008Making conductor-insulator-semiconductor electrodes
    • H01L21/28017Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
    • H01L21/28026Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon characterised by the conductor
    • H01L21/28079Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon characterised by the conductor the final conductor layer next to the insulator being a single metal, e.g. Ta, W, Mo, Al
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/56After-treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32009Arrangements for generation of plasma specially adapted for examination or treatment of objects, e.g. plasma sources
    • H01J37/32082Radio frequency generated discharge
    • H01J37/321Radio frequency generated discharge the radio frequency energy being inductively coupled to the plasma
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32431Constructional details of the reactor
    • H01J37/32532Electrodes
    • H01J37/32568Relative arrangement or disposition of electrodes; moving means
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32431Constructional details of the reactor
    • H01J37/32715Workpiece holder
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32431Constructional details of the reactor
    • H01J37/32715Workpiece holder
    • H01J37/32724Temperature
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02164Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon oxide, e.g. SiO2
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/02227Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process
    • H01L21/02252Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by plasma treatment, e.g. plasma oxidation of the substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/321After treatment
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67098Apparatus for thermal treatment
    • H01L21/67103Apparatus for thermal treatment mainly by conduction
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67098Apparatus for thermal treatment
    • H01L21/67115Apparatus for thermal treatment mainly by radiation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76838Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
    • H01L21/76841Barrier, adhesion or liner layers
    • H01L21/76853Barrier, adhesion or liner layers characterized by particular after-treatment steps
    • H01L21/76861Post-treatment or after-treatment not introducing additional chemical elements into the layer
    • H01L21/76862Bombardment with particles, e.g. treatment in noble gas plasmas; UV irradiation
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05HPLASMA TECHNIQUE; PRODUCTION OF ACCELERATED ELECTRICALLY-CHARGED PARTICLES OR OF NEUTRONS; PRODUCTION OR ACCELERATION OF NEUTRAL MOLECULAR OR ATOMIC BEAMS
    • H05H1/00Generating plasma; Handling plasma
    • H05H1/24Generating plasma
    • H05H1/46Generating plasma using applied electromagnetic fields, e.g. high frequency or microwave energy

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Chemical & Material Sciences (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Power Engineering (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Computer Hardware Design (AREA)
  • Manufacturing & Machinery (AREA)
  • General Physics & Mathematics (AREA)
  • Plasma & Fusion (AREA)
  • Analytical Chemistry (AREA)
  • General Chemical & Material Sciences (AREA)
  • Metallurgy (AREA)
  • Mechanical Engineering (AREA)
  • Materials Engineering (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Organic Chemistry (AREA)
  • Toxicology (AREA)
  • Health & Medical Sciences (AREA)
  • Spectroscopy & Molecular Physics (AREA)
  • Electromagnetism (AREA)
  • Chemical Vapour Deposition (AREA)
  • Electrodes Of Semiconductors (AREA)
  • Plasma Technology (AREA)

Abstract

本發明的課題是在於提供一種改質成大幅度減低被形成於基板上的鎢膜的薄膜電阻值,形成被適用於電極等之具有良好的特性的鎢膜之技術。   其解決手段,具有:   將在表面形成有鎢膜的基板搬入至處理室內之工程;   藉由電漿激發含有氫及氧的處理氣體來產生反應種之工程;及   將反應種供給至基板而改質鎢膜之工程,   在改質鎢膜的工程中,將鎢膜改質成為構成鎢膜的鎢的結晶粒徑比進行該工程之前更大。

Description

半導體裝置的製造方法、基板處理裝置及記錄媒體
本發明是有關半導體裝置的製造方法、基板處理裝置及記錄媒體。
有關被適用在構成DRAM或快閃記憶體等的裝置之電極等的含金屬膜,對於該膜質提升的要求高漲。例如在專利文獻1及2是揭示利用含有氧及氫的氣體的電漿來抑制氮化鈦(TiN)膜的薄膜電阻(sheet resistance)值的增加之技術。
[專利文獻1]日本特開2010-232240   [專利文獻2]日本特開2011-23730
(發明所欲解決的課題)
本發明的目的是在於提供一種改質成大幅度減低被形成於基板上的金屬膜的鎢膜的薄膜電阻值,形成被適用於電極等之具有良好的特性的鎢膜之技術。 (用以解決課題的手段)
若根據本發明之一形態,則提供一種具有:   將在表面形成有鎢膜的基板搬入至處理室內之工程;   藉由電漿激發含有氫及氧的處理氣體來產生反應種之工程;及   將前述反應種供給至前述基板而改質前述鎢膜之工程,   在改質前述鎢膜的工程中,將前述鎢膜改質成為構成前述鎢膜的鎢的結晶粒徑比進行該工程之前更大。 [發明的效果]
若根據本發明,則提供一種改質成大幅度減低被形成於基板上的鎢膜的薄膜電阻值,形成被適用於電極等之具有良好的特性的鎢膜之技術。
<本發明的第1實施形態> (1)基板處理裝置的構成   利用圖1~圖3,在以下說明有關本發明的第1實施形態的基板處理裝置。
(處理室)   處理裝置100是具備電漿處理晶圓200的反應爐202。在反應爐202是設有構成處理室201的處理容器203。處理容器203是藉由第1容器的圓頂型的上側容器210及第2容器的碗型的下側容器211所構成。藉由上側容器210蓋到下側容器211上,形成處理室201。上側容器210是例如以氧化鋁(Al 2O 3)或石英(SiO 2)等的非金屬材料所形成,下側容器211是例如以鋁(Al)所形成。
並且,在下側容器211的下部側壁是設有閘閥244。閘閥244是被構成為開啟時,利用搬送機構(未圖示),經由搬出入口245,往處理室201內搬入晶圓200,或可往處理室201外搬出晶圓200。
處理室201是具有:   在周圍設有線圈212的電漿產生空間201a;及   連通至電漿產生空間201a,處理晶圓200的基板處理空間201b。   電漿產生空間201a是意指產生電漿的空間,即處理室內,比線圈212的下端上方,且比線圈212的上端下方的空間。另一方面,基板處理空間201b是意指基板利用電漿來處理的空間,比線圈212的下端下方的空間。在本實施形態中,電漿產生空間201a與基板處理空間201b的水平方向的直徑是被構成為大致相同。
(基座)   在處理室201的底側中央是配置有作為載置晶圓200的基板載置台(基板載置部)之基座217。基座217是例如由氮化鋁(AlN)、陶瓷、石英等的非金屬材料所形成。
在基座217的內部是一體地埋入有作為加熱機構的加熱器217b。加熱器217b是被構成為一旦被供給電力,則可加熱晶圓200表面。
基座217是與下側容器211電性絕緣。阻抗調整電極217c是為了使被載置於基座217的晶圓200上所產生的電漿的密度的均一性更提升,而被設在基座217內部,經由阻抗可變機構275來接地。阻抗可變機構275是由線圈或可變電容器所構成,藉由控制線圈的電感及電阻以及可變電容器的電容值,被構成可使阻抗從約0Ω變化於處理室201的寄生阻抗值的範圍內。藉此,可經由阻抗調整電極217c及阻抗可變機構275來控制晶圓200的電位(偏壓電壓)。
在基座217是設有具備使基座昇降的驅動機構之基座昇降機構268。並且,在基座217中設有貫通孔217a,且在下側容器211的底面設有晶圓頂起銷266。藉由基座昇降機構268來使基座217下降時,晶圓頂起銷266是被構成與基座217為非接觸的狀態,穿過貫通孔217a。   主要藉由基座217及加熱器217b、電極217c來構成本實施形態的基板載置部。
(氣體供給部)   在處理室201的上方,亦即上側容器210上部是設有氣體供給頭236。氣體供給頭236是具備:蓋狀的蓋體233、氣體導入口234、緩衝室237、開口238、遮蔽板240及氣體吹出口239,被構成為可將反應氣體供給至處理室201內。緩衝室237是持有作為分散藉由氣體導入口234所導入的反應氣體之分散空間的機能。
在氣體導入口234是連接氣體供給管232,該氣體供給管232是以供給作為含氧氣體的氧(O 2)氣體之含氧氣體供給管232a的下游端、及供給作為含氫氣體的氫(H 2)氣體之含氫氣體供給管232b的下游端及供給作為惰性氣體的氬(Ar)氣體之惰性氣體供給管232c合流的方式連接者。在含氧氣體供給管232a是設有O 2氣體供給源250a、作為流量控制裝置的質量流控制器(MFC)252a、作為開閉閥的閥253a。在含氫氣體供給管232b是設有H 2氣體供給源250b、MFC252b、閥253b。在惰性氣體供給管232c是設有Ar氣體供給源250c、MFC252c、閥253c。在含氧氣體供給管232a、含氫氣體供給管232b及惰性氣體供給管232c合流後的下游側是設有閥243a,連接至氣體導入口234的上游端。藉由使閥253a、253b、253c、243a開閉,被構成為可一面藉由MFC252a、252b、252c來調整各個的氣體的流量,一面經由氣體供給管232a、232b、232c來將含氧氣體、含氫氣體、惰性氣體等的處理氣體往處理室201內供給。
主要藉由氣體供給頭236、含氧氣體供給管232a、含氫氣體供給管232b、惰性氣體供給管232c、MFC252a,252b,252c、閥253a,253b,253c,243a來構成本實施形態的氣體供給部(氣體供給系)。
並且,藉由氣體供給頭236、含氧氣體供給管232a、MFC252a、閥253a,243a來構成本實施形態的含氧氣體供給系。而且,藉由氣體供給頭236、含氫氣體供給管232b、MFC252b、閥253b,243a來構成本實施形態的氫氣體供給系。而且,藉由氣體供給頭236、惰性氣體供給管232c、MFC252c、閥253c,243a來構成本實施形態的惰性氣體供給系。
(排氣部)   在下側容器211的側壁是設有從處理室201內排除反應氣體的氣體排氣口235。在氣體排氣口235是連接氣體排氣管231的上游端。在氣體排氣管231是從上游側依序設有作為壓力調整器(壓力調整部)的APC(Auto Pressure Controller)242、作為開閉閥的閥243b、作為真空排氣裝置的真空泵246。   主要藉由氣體排氣口235、氣體排氣管231、APC242、閥243b來構成本實施形態的排氣部。此外,亦可將真空泵246含在排氣部。
(電漿產生部)   在處理室201的外周部,亦即在上側容器210的側壁的外側,以包圍處理室201的方式,設有作為第1電極的螺旋狀的共振線圈212。共振線圈212是連接RF感測器272、高頻電源273、進行高頻電源273的阻抗或輸出頻率的匹配的匹配器274。
高頻電源273是對共振線圈212供給高頻電力(RF電力)者。RF感測器272是被設在高頻電源273的輸出側,監視被供給的高頻的行進波或反射波的資訊。藉由RF感測器272來監視的反射波電力是被輸入至匹配器274,匹配器274是根據從RF感測器272輸入的反射波的資訊,以反射波成為最小的方式,控制高頻電源273的阻抗或被輸出的高頻電力的頻率者。
高頻電源273是具備:包含用以規定振盪頻率及輸出的高頻振盪電路及前置放大器的電源控制手段(控制電路)、及用以放大至預定的輸出的放大器(輸出電路)。電源控制手段是經由操作面板,根據有關預先被設定的頻率及電力的輸出條件來控制放大器。放大器是經由傳送線路來供給一定的高頻電力至共振線圈212。
共振線圈212是為了形成預定的波長的駐波,而以能共振於一定的波長之方式設定捲徑、捲繞間距、捲數。亦即,共振線圈212的電性長度是被設定成相當於從高頻電源273供給的高頻電力的預定頻率的1波長的整數倍之長度。
具體而言,考慮施加的電力或使產生的磁場強度或適用的裝置的外形等,共振線圈212是以能藉由例如800kHz~50MHz、0.5~5KW的高頻電力來產生0.01~10高斯程度的磁場之方式,設為50~300mm 2的有效剖面積且200~500mm的線圈直徑,在形成電漿產生空間201a的室的外周側捲繞2~60次程度。
在本實施形態中,將高頻電力的頻率設定成27.12MHz,且將共振線圈212的電性長度設定成1波長的長度(約11米)。共振線圈212的捲繞間距是被設成例如以24.5mm間隔來成為等間隔。並且,共振線圈212的捲徑(直徑)是被設定成比晶圓200的直徑更大。在本實施形態中,將晶圓200的直徑設為300mm,共振線圈212的捲徑是被設成比晶圓200的直徑更大的500mm。
共振線圈212的兩端是被電性接地,其中的至少一端是為了微調該共振線圈的電性長度,而經由可動分接頭213來接地。圖1中的符號214是表示另一方的固定接地。可動分接頭213是以使共振線圈212的共振特性形成與高頻電源273大致相等的方式調整位置。而且,為了微調共振線圈212的阻抗,在共振線圈212的被接地的兩端之間是藉由可動分接頭215來構成給電部。
遮蔽板223是遮蔽共振線圈212的外側的電場,且為了在與共振線圈212之間形成為了構成共振電路所必要的電容成分(C成分)而設。遮蔽板223一般是使用鋁合金等的導電性材料來構成圓筒狀。
主要藉由共振線圈212、RF感測器272、匹配器274來構成本實施形態的電漿產生部。此外,亦可含高頻電源273,作為電漿產生部。
在此,利用圖2來說明有關本實施形態的裝置的電漿產生原理及被產生的電漿的性質。   藉由共振線圈212所構成的電漿產生電路是以RLC的並列共振電路所構成。從高頻電源273供給的高頻電力的波長與共振線圈212的電性長度相同時,共振線圈212的共振條件是藉由共振線圈212的電容成分或感應成分所作出的電抗成分會被相抵,形成純電阻。然而,在上述電漿產生電路中,使電漿產生時,因為共振線圈212的電壓部與電漿之間的電容耦合的變動、或電漿產生空間201a與電漿之間的感應耦合的變動、電漿的激發狀態等,實際的共振頻率是稍微變動。
於是,在本實施形態中,為了在電源側補償電漿產生時的共振線圈212的共振的偏差,而在RF感測器272檢測出電漿產生時之來自共振線圈212的反射波電力,匹配器274具有根據被檢測出的反射波電力來修正高頻電源273的輸出之機能。
具體而言,匹配器274是根據在RF感測器272中檢測出的電漿產生時之來自共振線圈212的反射波電力,以反射波電力成為最小的方式,使高頻電源273的阻抗或輸出頻率增加或減少。控制阻抗的情況,匹配器274是藉由修正預先被設定的阻抗之可變電容器控制電路所構成,控制頻率的情況,匹配器274是藉由修正預先被設定的高頻電源273的振盪頻率之頻率控制電路所構成。此外,高頻電源273與匹配器274是亦可一體構成。
藉由如此的構成,由於在本實施形態的共振線圈212是如圖2所示般,被供給依據含電漿的該共振線圈的實際的共振頻率之高頻電力(或以能匹配於含電漿的該共振線圈的實際的阻抗之方式供給高頻電力),因此形成相位電壓與逆相位電壓經常被相抵的狀態的駐波。共振線圈212的電性長度與高頻電力的波長相同時,在線圈的電性中點(電壓為零的節點)產生最高的相位電流。因此,在電性中點的附近是與處理室壁或基座217的電容耦合幾乎無,形成電性電位極低的甜甜圈狀的感應電漿。
(控制部)   作為控制部的控制器221是被構成經由訊號線A來控制APC242、閥243b及真空泵246,經由訊號線B來控制基座昇降機構268,經由訊號線C來控制加熱器電力調整機構276及阻抗可變機構275,經由訊號線D來控制閘閥244,經由訊號線E來控制RF感測器272、高頻電源273及匹配器274,經由訊號線F來控制MFC252a~252c及閥253a~253c,243a。
如圖3所示般,控制部(控制手段)的控制器221是作為具備CPU(Central Processing Unit)221a、RAM(Random Access Memory)221b、記憶裝置221c、I/O埠221d的電腦被構成。RAM221b、記憶裝置221c、I/O埠221d是被構成為可經由內部匯流排221e來與CPU221a交換資料。控制器221是連接例如作為觸控面板或顯示器等被構成的輸出入裝置222。
記憶裝置221c是例如以快閃記憶體、HDD(Hard Disk Drive)等所構成。在記憶裝置221c內是可讀出地儲存有控制基板處理裝置的動作之控制程式、或記載有後述的基板處理的程序或條件等的程式處方等。程式處方是以使後述的基板處理工程的各程序實行於控制器221,可取得預定的結果之方式被組合者,作為程式作用。以下,亦將此程式處方或控制程式等總簡稱為程式。此外,在本說明書中使用稱為程式的言詞時,有只包含程式處方單體時,只包含控制程式單體時,或包含其雙方時。並且,RAM221b是作為暫時性地保持藉由CPU221a所讀出的程式或資料等的記憶區域被構成。
I/O埠221d是被連接至上述的MFC252a~ 252c、閥253a~253c、243a、243b、閘閥244、APC閥242、真空泵246、RF感測器272、高頻電源273、匹配器274、基座昇降機構268、阻抗可變機構275、加熱器電力調整機構276等。
CPU221a是被構成為讀出來自記憶裝置221c的控制程式而實行,且按照來自輸出入裝置222的操作指令的輸入等,從記憶裝置221c讀出製程處方。而且,CPU221a是被構成為按照被讀出的製程處方的內容,經由I/O埠221d及訊號線A來控制APC閥242的開度調整動作、閥243b的開閉動作及真空泵246的起動・停止,經由訊號線B來控制基座昇降機構268的昇降動作,經由訊號線C來控制藉由加熱器電力調整機構276之對加熱器217b的供給電力量調整動作(溫度調整動作)或藉由阻抗可變機構275之阻抗值調整動作,經由訊號線D來控制閘閥244的開閉動作,經由訊號線E來控制RF感測器272、匹配器274及高頻電源273的動作,經由訊號線F來控制藉由MFC252a~252c之各種氣體的流量調整動作及閥253a~253c、243a的開閉動作等。
控制器221是可藉由將被儲存於外部記憶裝置(例如磁帶、軟碟或硬碟等的磁碟、CD或DVD等的光碟、MO等的光磁碟、USB記憶體或記憶卡等的半導體記憶體)223的上述程式安裝於電腦來構成。記憶裝置221c或外部記憶裝置223是作為電腦可讀取的記錄媒體被構成。以下,亦將該等總簡稱為記錄媒體。在本說明書中,使用稱為記錄媒體的言詞時,有只包含記憶裝置221c單體時,只包含外部記憶裝置223單體時,或包含其雙方時。此外,往電腦之程式的提供是亦可不使用外部記憶裝置223,利用網際網路或專用線路等的通訊手段來進行。
(2)基板處理工程   其次,主要利用圖4所示的流程圖來說明有關本實施形態的基板處理工程。本實施形態的基板處理工程是作為例如快閃記憶體的記憶格等的半導體裝置的製造工程之一工程被實施。   並且,本基板處理工程是藉由處理裝置100來實施。在以下的說明中,構成處理裝置100的各部的動作是藉由控制器221來控制。
本實施形態的基板處理工程之以下的電漿改質工程(S110~S160)是對於至少構成閘極電極等的金屬膜露出於表面的晶圓200(基板)進行電漿改質處理(電漿退火處理)。在本實施形態中,該金屬膜是鎢(W)膜。
並且,在本實施形態中,以構成絕緣膜等的矽氧化膜(SiO 2膜)會與該金屬膜一起露出於表面的方式形成於晶圓200上。以下的電漿改質工程是在將金屬膜改質的處理中,對於SiO 2膜,使作為氧化膜的膜質提升的氧化・修復處理也同時進行。
在本實施形態的晶圓200上是層疊有W膜與SiO 2膜,更從該層疊膜的上面藉由蝕刻處理等來形成貫通孔(through hole)。然後,W膜及SiO 2膜是成為在貫通孔的內側露出的構造。
並且,本實施形態的W膜是藉由利用作為原料氣體的六氟化鎢(WF 6)氣體及作為還原氣體的H 2氣體等之CVD法(此情況也包含原料氣體與還原劑的同時供給或交替供給的哪個的形態)來形成於晶圓200上的膜。一般,藉由CVD法所形成的金屬膜是相較於藉由濺射法等的手法所形成的金屬膜,對於複雜的裝置構造之階梯覆蓋(Step Coverage)佳,但另一方面,也有原料氣體或還原氣體等中所含的成分(例如氟(F)或H等)在膜中作為雜質含有多量的缺點。該等的膜中的雜質是有成為使金屬膜的薄膜電阻值增大的一個原因的情況。   而且,在W膜之朝貫通孔的內側的露出層是也有蝕刻氣體等中所含的雜質會藉由蝕刻處理來取入的情況。
又,同樣,本實施形態的SiO 2膜之朝貫通孔的內側的露出面會因蝕刻處理而受損(物理性的粗糙),蝕刻氣體等中所含的雜質被取入至露出的表層的情形會成為課題之一。
此外,在本實施形態中,藉由利用上述的電漿產生部所形成的電性電位極低的感應電漿,來產生後述的自由基或未被加速的離子等的反應種。因此,不僅記憶格等的裝置為平面形狀的情況,構造更複雜,寬高比大,具有本實施形態般的3次元構造的情況也可形成階梯覆蓋良好的改質膜。
(基板搬入工程(基板準備工程)S110)   首先,將被形成為W膜與SiO 2膜會分別露出於表面的晶圓200搬入至處理室201內(準備)。具體而言,基座昇降機構268會使基座217下降至晶圓200的搬送位置,晶圓頂起銷266會設為比基座217表面更只突出預定的高度部分的狀態。接著,開啟閘閥244,從鄰接於處理室201的真空搬送室將晶圓200搬入至處理室201內,載置於從基座217的表面突出的晶圓頂起銷266上。然後,關閉閘閥244,將處理室201內密閉,基座昇降機構268會使基座217上昇成為共振線圈212的下端與搬出入口245的上端245a之間的預定的位置。其結果,晶圓200是被支撐於基座217的上面。
(昇溫・真空排氣工程S120)   接著,進行被搬入至處理室201內的晶圓200的昇溫。加熱器217b是預先被加熱,藉由在埋入有加熱器217b的基座217上保持被搬入的晶圓200,將晶圓200加熱至例如室溫(25℃)以上,900℃以下的範圍內的預定值。晶圓200的處理溫度,在更提高對W膜及SiO 2膜的改質效果之目的,最好為儘可能高的溫度,在本實施形態是設為600~900℃的範圍內,特別是700℃以上的預定值。但,在需要抑制對於晶圓200上所形成的裝置圖案的熱損傷時,晶圓200的處理溫度是只要為可安定產生電漿的程度高的溫度即可,理想是150℃以上即可。在本實施形態中,加熱成晶圓200的溫度為700℃。
並且,在進行晶圓200的昇溫的期間,藉由真空泵246,經由氣體排氣管231來將處理室201內真空排氣。真空泵246是至少使作動至後述的基板搬出工程S160終了為止。
(反應氣體供給工程S130)   其次,開始作為反應氣體(處理氣體)的O 2氣體及H 2氣體的供給。首先,開啟閥253a,253b,將O 2氣體與H 2氣體的混合氣體經由緩衝室237來導入(供給)至處理室201內。此時,以O 2氣體與H 2氣體的混合氣體的合計流量、及O 2氣體與H 2氣體的流量比(混合比)形成預定的值之方式,控制MFC252a、252b。
在本實施形態中,混合氣體的合計流量是設為1000sccm,H 2氣體對於兩氣體的合計流量之流量比是設為20%以上,未滿100%的範圍的預定的比率。當H 2氣體的流量比為未滿20%時,在電漿處理工程中,W膜的氧化進展,W膜的薄膜電阻增加。並且,為了以實效性的速度(速率)來進行對於SiO 2膜的氧化・改質處理,最好H 2氣體的流量比是90%以下。又,如後述般,在本實施形態中,在H 2氣體的流量比為40%以上70%以下的範圍的條件下,特別是藉由擴大W膜的結晶粒徑之特性改善的效果顯著,因此尤其最好H 2氣體的流量比是設為該範圍的預定的比率。藉由H 2氣體的流量比設為40%以上70%以下的範圍,對於SiO 2膜的氧化・改質處理也可也更大的速度進行。   此外,在本實施形態中。反應氣體的混合氣體中所含的氫(H)與氧(O)的含有比率(濃度比率)是等於上述的氣體流量比。
在上述混合氣體的供給前,亦可將H 2氣體導入至處理室201內,來調整處理室201內成為預定的壓力。藉由如此,混合氣體供給開始時,在保持處理室201內的壓力的狀態下,可抑制發生對於W膜的氧化。
此外,在本實施形態是說明有關只將O 2氣體及H 2氣體作為反應氣體供給至處理室201內的形態,但亦可同時導入惰性氣體的Ar氣體,使能供給O 2氣體、H 2氣體及Ar氣體的混合氣體。此情況也是混合氣體中所含的H與O的比率如上述般。
並且,以混合氣體供給後的處理室201內的壓力成為預定的壓力,例如50Pa以上250Pa以下(在本實施形態是120Pa)的方式,調整APC閥242的開度。
(電漿處理工程S140) (a)反應種產生階段(工程)   開始混合氣體的導入,經過預定時間後(例如經過數秒後),對於共振線圈212,從高頻電源273經由匹配器272來開始高頻電力的施加。在本實施形態中,從高頻電源273供給27.12MHz、1.5kW的高頻電力至共振線圈212。高頻電力的大小是設定100~5000W的範圍的預定的值。藉此,在電漿產生空間201a內形成高頻電場,以涉及的電場,在相當於電漿產生空間的共振線圈212的電性中點的高度位置激發甜甜圈狀的感應電漿。電漿狀的O 2氣體、H 2氣體解離,產生氧活性種(氧自由基、O *)、氫氧基活性種(氫氧基自由基、OH *)、氫活性種(氫自由基、H *)、氧離子、氫離子等的反應種。
如前述般,形成相位電壓與逆相位電壓經常被相抵的狀態的駐波,在線圈的電性中點(電壓為零的節點)產生最高的相位電流。因此,在上述的電性中點被激發的感應電漿是幾乎無與處理室201的壁或基座217的電容耦合,在電漿產生空間201a中是可形成電性電位極低的甜甜圈狀的電漿。
而且,如上述般,被附設於高頻電源273的電源控制手段會補償電漿的電容耦合或感應耦合的變動所造成共振線圈212的共振點的偏差,更正確地形成駐波,因此幾乎無電容耦合,可更確實地將電性電位極低的電漿形成於電漿產生空間201a中。
因為產生電性電位極低的電漿,所以可防止電漿產生空間201a的壁或基座217上的鞘層的發生。因此,電漿中的離子不被加速。
往共振線圈212之高頻電力的施加是在例如10~300秒的範圍的預定時間(在本實施形態是60秒)之間被繼續,在該之間產生上述的反應種。
(b)改質處理階段(工程)   然後,藉由H 2氣體與O 2氣體的混合氣體被電漿激發而產生的上述的反應種是分別被供給至晶圓200的表面所形成的W膜及SiO 2膜,對晶圓200實施電漿處理(改質處理)。
具體而言,在基板處理空間201b對被保持於基座217上的晶圓200,均一地供給O *、OH *、H *等的自由基或未被加速的狀態的離子至W膜及SiO 2膜的表面。由於被供給的自由基或離子會對於露出的W膜及SiO 2膜的表面均一供給而反應,因此即使是W膜及SiO 2膜為構成寬高比大的複雜的3次元構造的情況,也可(例如不依貫通孔等的構造的開口部的深度或方向等)將該等均一地改質。亦即,可形成階梯覆蓋佳的W膜及SiO 2膜的改質層。而且,可防止加速所產生的離子攻擊,因此可抑制離子所造成的晶圓損傷。
<對W膜的改質效果>   對於露出的表面供給反應種的W膜是從表層側被改質而形成W改質層。具體而言,被供給之含H及O的反應種會與W膜反應,藉此被改質成為構成W膜的W的結晶粒的大小(粒徑)會變大。若結晶粒徑變大,則一般電子容易流動於膜中。亦即,藉由W的結晶粒徑變大,W膜的薄膜電阻值會被減低。
在本實施形態的電漿處理中,構成膜的W以含O的反應種來被氧化成WOx之後,WOx藉由含H的反應種來還原而再度形成W之循環會被重複,推測此時產生W的原子彼此間的連結而粒徑擴大。亦即,推測本實施形態的處理氣體中所含的O及H的兩成分有助於W的結晶粒擴大。
利用圖5(A)(B)來說明有關實際W膜的結晶粒徑增大的效果。圖5(A)是利用透過型電子顯微鏡(TEM)來從上面側攝取本實施形態的電漿處理進行之前的W膜表面的結晶狀態(粒形)的照片圖。在此照片上,顯示以粗線所包圍的一個結晶粒作為結晶粒A。圖5(B)是利用同TEM來從上面側攝取本實施形態的電漿處理進行之後的W膜表面的結晶狀態的照片圖。在此照片上,顯示結晶粒A的電漿處理後的狀態(粒形)作為以粗線所包圍的結晶粒A´。   由結晶粒A及A´的大小的比較可明確得知,藉由本實施形態的電漿處理,被改質成為W膜的結晶粒徑變大。
又,如上述般在W膜中雜質含有多量時,反應種中所含的H *等會進入膜中,除去膜中的雜質的效果也被期待。而且,藉由W膜的結晶粒徑變大,結晶粒界會減少,偏在於結晶粒界的雜質有效地被除去的情形也被期待。   因此,推測藉由經過本實施形態的電漿處理,W膜的薄膜電阻值減低的效果可藉由W膜的結晶粒徑的增大及W膜中的雜質的除去之複數的主要因素來取得。
<對SiO 2膜的改質效果>   並且,對於露出的表面被供給反應種的SiO 2膜是從表層側被改質而形成SiO 2的改質層。具體而言,藉由被供給的反應種與SiO 2膜反應,SiO 2膜中所含有的雜質會被除去,且SiO 2膜的分子構造的缺陷會藉由反應種中所含的O原子來補全(亦即被氧化)。亦即,藉由本實施形態的電漿處理,SiO 2膜中所含的雜質會被除去,且因蝕刻處理等而受損的表層會被修補,SiO 2膜的膜特性(例如作為絕緣膜的特性等)會被改善。
然後,一旦經過上述的預定時間(60秒),則停止來自高頻電源273的電力的輸出,而停止處理室201內的電漿放電。並且,關閉閥243a、253a、253b,停止O 2氣體與H 2氣體之往處理室201內的供給。藉由以上,完成電漿處理工程S140。
(真空排氣工程S150)   若經過預定的處理時間而停止O 2氣體與H 2氣體的供給,則將處理室201內真空排氣。藉此,將處理室201內的O 2氣體、H 2氣體,或在電漿改質處理產生的其他的排氣體排除至處理室201外。然後,調整APC閥242的開度,將處理室201內的壓力調整成與鄰接於處理室201的真空搬送室相同的壓力(例如100Pa)。
(基板搬出工程S160)   一旦處理室201內成為預定的壓力,則使基座217下降至晶圓200的搬送位置,使晶圓200支撐於晶圓頂起銷266上。然後,開啟閘閥244,將晶圓200搬出至處理室201外。藉由以上,完成本實施形態的基板處理工程。
(3)本實施形態的效果   以下,根據圖6~9所示的實驗結果來詳述有關本實施形態之對W膜的改質效果。
<實施例1>   圖6是表示未進行本實施形態的電漿處理的狀態(A)的W膜及在本實施形態的電漿處理中將反應氣體中的H 2氣體流量比分別設為(B)100%、(C)80%、(D)65%而實施該處理的W膜之W結晶粒徑的最小值、最大值、平均值的表。
如圖6所示般可知,將反應氣體中的H 2氣體流量比設為80%的(C)的例子及設為65%的(D)的例子,W結晶粒徑的最小值、最大值及平均值的哪個皆比不進行電漿處理的(A)的例子,或將反應氣體中的H 2氣體流量比設為100%的(B)的例子,還產生W結晶粒徑被擴大的效果。   亦即,由該等的實驗例的結果,可謂在本實施形態的電漿處理中,相較於反應氣體中的H 2氣體流量比為100%(亦即,在反應氣體中不含O)的情況,在反應氣體中含有O,W結晶粒徑的擴大效果較大。
並且,在圖6所示的實驗例中可知,相較於將反應氣體中的H 2氣體流量比設為80%的(C)的實驗例,將同流量比設為65%的(D)的實驗例,從W結晶粒徑的最小值、最大值、及平均值的哪個值,皆W結晶粒徑擴大的效果大。   亦即,反應氣體中的O含有比率從0%越變大,此效果也越變大。但,在本實施形態的電漿處理中為了取得擴大W結晶粒徑的效果,藉由含O的反應種之氧化反應與藉由含H的反應種之還原反應的平衡重要。若O含有率過大,則藉由含O的反應種之氧化反應會過剩,W膜的薄膜電阻值增大。若考慮後述的圖7所示的薄膜電阻值的傾向,則最好O含有比率是設為60%程度以下。
<實施例2>   圖7是表示在本實施形態的反應氣體供給工程S130中使反應氣體(處理氣體)中的H 2氣體的流量比變化於20~100%的範圍,以各個的流量比來實行電漿處理時的W膜的薄膜電阻值(電漿處理的前後的W膜的薄膜電阻值的變化的比率)。亦即,當W膜的薄膜電阻值不變化時,縱軸的值是1.0,未滿1.0是表示薄膜電阻值被減低。H 2氣體的流量比以外的處理條件是與在上述的本實施形態者共通。
如圖7所示般,進行本實施形態的電漿處理的結果,可知將反應氣體中的H 2氣體的流量比設為20~100%的範圍時,W膜的薄膜電阻值皆比處理前更減低。
而且,在本實施形態中,相較於H 2氣體的流量比為100%(亦即不供給O 2氣體)時,將H 2氣體的流量比設為40~70%的範圍時,可確認W膜的薄膜電阻值更大幅度被減低。亦即,為了使W膜的薄膜電阻值更大幅度減低,比起使用不含有O 2氣體僅H 2氣體作為反應氣體,可謂最好使用將H 2氣體的流量比設為40~70%的範圍,且將O 2氣體設為30~60%的範圍含有的反應氣體。   換言之,藉由將處理氣體中的H與O的含有比率設為40:60~70:30的範圍,可將W膜改質成為W膜的薄膜電阻值要比處理氣體的H與O的含有比率為100:0時的值更低。
有關本實施形態的H 2氣體的流量比的如此的特性是被推測成為了本實施形態的W膜的薄膜電阻值的減低效果可藉由電漿處理之W膜的結晶粒徑的增大及W膜中的雜質的除去之複數的主要因素來取得而產生者。特別是在本實施形態中藉由使用含O的處理氣體來進行電漿處理,W膜的結晶粒徑的增大顯著,可想像此結晶粒徑的增大對於薄膜電阻值的減低貢獻大。
<其他的實施例>   圖8是表示在本實施形態的反應氣體供給工程S130中使反應氣體(處理氣體)中的H 2氣體的流量比變化於50~95%的範圍,以各個的流量比來實行電漿處理時的氮化鈦(TiN)膜的薄膜電阻值(電漿處理的前後的TiN膜的薄膜電阻值的變化的比率)。H 2氣體的流量比以外的處理條件是與在上述的本實施形態者共通。
在圖8所示的實施例中,進行本實施形態的電漿處理的結果,可知將反應氣體中的H 2氣體的流量比設為65~95%的範圍時,TiN膜的薄膜電阻值比處理前更被減低。
另一方面,可知在圖8所示的實施例中,相較於改質W膜的實施例2,藉由不僅H還使O含於反應氣體,更增大薄膜電阻值的減低量的效果未能取得或非常小。特別是在將反應氣體中的H 2氣體的流量比設為60%以下的範圍時,TiN膜的薄膜電阻值比處理前更大幅度上昇。因此,上述的本實施形態之使用含有O的反應氣體的電漿處理是可謂在對W膜的改質處理中特別合適。
<本發明的其他的實施形態>   在第1實施形態中是使用H 2氣體與O 2氣體的混合氣體,作為含有H與O的反應氣體,但亦可取代H 2氣體,而使用其他的含氫氣體(例如NH 3氣體等),取代O 2氣體,而使用其他的含氧氣體(NO氣體等)。而且,亦可使用H及O具有一個分子的化合物的氣體(例如H 2O氣體或H 2O 2氣體等),作為含有H與O的反應氣體。   該情況,反應氣體中所含的H與O的存在比率(濃度比率)是與第1實施形態的H 2氣體與O 2氣體的流量比同樣。
在第1實施形態中,作為使薄膜電阻值減低的改質對象的金屬膜,是對於W膜適用電漿處理,但對於藉由鈦(Ti)、釕(Ru)、鉬(Mo)等的金屬元素單體所構成的金屬膜也可適用同樣的電漿處理。亦即,藉由與第1實施形態同樣的電漿處理,期待藉由結晶粒徑的增大之薄膜電阻值的減低效果。
上述的實施形態是可適用在DRAM或快閃記憶體等的裝置的製造工程。又,特別是在快閃記憶體的一種的NAND型快閃記憶體,例如,三次元NAND型快閃記憶體(3D-NAND)的製造工程也可適用。
100:處理裝置 200:晶圓 201:處理室 212:共振線圈 217:基座 221:控制器
圖1是本發明的實施形態的基板處理裝置的剖面圖。   圖2是說明本發明的實施形態的基板處理裝置的電漿產生原理的說明圖。   圖3是說明本發明的實施形態的控制裝置的圖。   圖4是表示本發明的實施形態的基板處理工程的流程圖。   圖5(A)是攝取本發明的實施形態的電漿處理進行之前的金屬膜表面的結晶狀態的照片圖,(B)是攝取本發明的實施形態的電漿處理進行之後的金屬膜表面的結晶狀態的照片圖。   圖6是表示未進行本發明的實施形態的電漿處理的情況及在本發明的實施形態的電漿處理中將反應氣體中的H 2氣體流量比設為100%、80%、65%的情況的W結晶粒徑的最小值、最大值、平均值的表。   圖7是表示在本發明的實施例中,反應氣體中的H 2氣體流量比與改質處理前後的W膜的薄膜電阻值的變化量的關係的圖。   圖8是表示在本發明的其他的實施例中,反應氣體中的H 2氣體流量比與改質處理前後的TiN膜的薄膜電阻值的變化量的關係的圖。

Claims (10)

  1. 一種半導體裝置的製造方法,其特徵係具有:將在表面形成有鎢膜的基板搬入至處理室內之工程;將前述基板加熱至700~900℃的範圍內的預定的溫度之工程;藉由電漿激發含有氫及氧的處理氣體來產生反應種之工程;及將前述反應種供給至被加熱至前述預定的溫度的前述基板而改質前述鎢膜之工程,在改質前述鎢膜的工程中,將前述鎢膜改質成為構成前述鎢膜的鎢的結晶粒徑比進行該工程之前更大。
  2. 如申請專利範圍第1項之半導體裝置的製造方法,其中,前述處理氣體的氫與氧的含有比率為40:60~70:30的範圍內的預定的值。
  3. 如申請專利範圍第2項之半導體裝置的製造方法,其中,在改質前述鎢膜的工程中,將前述鎢膜改質成為前述鎢膜的薄膜電阻值比將前述處理氣體的氫與氧的含有比率設為100:0來進行改質前述鎢膜的工程時的薄膜電阻值更低。
  4. 如申請專利範圍第2或3項之半導體裝置的製造方法,其中,在前述基板的表面形成有SiO2膜,在改質前述鎢膜的工程中,同時進行藉由前述反應種來氧化前述SiO2膜的處理。
  5. 如申請專利範圍第1項之半導體裝置的製造方法,其中,前述處理氣體為含氫氣體與含氧氣體的混合氣體。
  6. 如申請專利範圍第1項之半導體裝置的製造方法,其中,前述處理氣體為氫氣體與氧氣體的混合氣體。
  7. 如申請專利範圍第5或6項之半導體裝置的製造方法,其中,在產生前述反應種的工程中,只電漿激發前述混合氣體。
  8. 如申請專利範圍第6項之半導體裝置的製造方法,其中,前述氫氣體與前述氧氣體的流量比為40:60~70:30的範圍內的預定的值。
  9. 一種基板處理裝置,其特徵係具有:處理室,其係收容有基板;處理氣體供給系,其係供給含有氧及氫的處理氣體至前述處理室內;電漿產生部,其係使前述處理室內的氣體電漿激發;加熱機構,其係加熱被收容於前述處理室的前述基板;控制部,其係被構成為控制前述處理氣體供給系、前述電漿產生部及前述加熱機構,而使實行下列處理,將前述基板加熱至700~900℃的範圍內的預定的溫度之處理;將前述處理氣體供給至前述處理室內之處理;藉由電漿激發前述處理氣體,產生反應種之處理;及對於被加熱至前述預定的溫度且在表面形成有鎢膜的前述基板供給前述反應種而改質前述鎢膜之處理,在改質前述鎢膜的處理中,將前述鎢膜改質成為構成前述鎢膜的鎢的結晶粒徑比進行該處理之前更大。
  10. 一種記錄媒體,係可藉由電腦來讀取的記錄媒體,其特徵為:記錄了藉由電腦來使下列程序實行於基板處理裝置的程式,將在表面形成有鎢膜的基板搬入至基板處理裝置的處理室內之程序;將前述基板加熱至700~900℃的範圍內的預定的溫度之程序;藉由電漿激發含有氫及氧的處理氣體來產生反應種之程序;將前述反應種供給至被加熱至前述預定的溫度的前述基板而改質前述鎢膜之程序;及在改質前述鎢膜的程序中,將前述鎢膜改質成為構成前述鎢膜的鎢的結晶粒徑比進行該程序之前更大之程序。
TW107129055A 2017-09-28 2018-08-21 半導體裝置的製造方法、基板處理裝置及記錄媒體 TWI676710B (zh)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2017-187994 2017-09-28
JP2017187994 2017-09-28

Publications (2)

Publication Number Publication Date
TW201920763A TW201920763A (zh) 2019-06-01
TWI676710B true TWI676710B (zh) 2019-11-11

Family

ID=65901428

Family Applications (1)

Application Number Title Priority Date Filing Date
TW107129055A TWI676710B (zh) 2017-09-28 2018-08-21 半導體裝置的製造方法、基板處理裝置及記錄媒體

Country Status (7)

Country Link
US (2) US11664275B2 (zh)
JP (1) JP6870103B2 (zh)
KR (1) KR102452913B1 (zh)
CN (1) CN110870047B (zh)
SG (1) SG11202002212YA (zh)
TW (1) TWI676710B (zh)
WO (1) WO2019065544A1 (zh)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7222946B2 (ja) * 2020-03-24 2023-02-15 株式会社Kokusai Electric 半導体装置の製造方法、基板処理装置、およびプログラム

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20080146041A1 (en) * 2005-02-01 2008-06-19 Tokyo Electron Limited Semiconductor Device Manufacturing Method and Plasma Oxidation Method
US20090311876A1 (en) * 2008-06-13 2009-12-17 Hitachi Kokusai Electric Inc. Manufacturing method of semiconductor device and substrate processing apparatus
TW201001543A (en) * 2008-02-08 2010-01-01 Tokyo Electron Ltd Method for modifying insulating film with plasma
TW201030847A (en) * 2008-10-29 2010-08-16 Hitachi Int Electric Inc Method of manufacturing a semiconductor device and a device for treating substrate
JP2010232240A (ja) * 2009-03-26 2010-10-14 Hitachi Kokusai Electric Inc 半導体装置の製造方法、及び半導体製造装置
TW201447018A (zh) * 2013-03-06 2014-12-16 Lam Res Corp 金屬晶種層上之金屬氧化物的還原方法與設備

Family Cites Families (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0521387A (ja) * 1991-07-14 1993-01-29 Sony Corp 金属薄膜の低抵抗化方法
JP3382031B2 (ja) * 1993-11-16 2003-03-04 株式会社東芝 半導体装置の製造方法
JPH11145148A (ja) 1997-11-06 1999-05-28 Tdk Corp 熱プラズマアニール装置およびアニール方法
KR100631937B1 (ko) * 2000-08-25 2006-10-04 주식회사 하이닉스반도체 텅스텐 게이트 형성방법
JP2011023730A (ja) 2008-06-13 2011-02-03 Hitachi Kokusai Electric Inc 半導体デバイスの製造方法及び基板処理装置
JP2012193457A (ja) * 2009-06-10 2012-10-11 Hitachi Kokusai Electric Inc 半導体装置の製造方法及び半導体装置の製造装置
TWI473726B (zh) * 2009-07-15 2015-02-21 Nat Univ Tsing Hua 形成圖案化金屬改質層之方法
TWI562204B (en) * 2010-10-26 2016-12-11 Hitachi Int Electric Inc Substrate processing apparatus, semiconductor device manufacturing method and computer-readable recording medium
US11511316B2 (en) 2010-11-04 2022-11-29 Nissan Chemical Industries, Ltd. Plasma annealing method and device for the same
JP2012151435A (ja) 2010-12-27 2012-08-09 Elpida Memory Inc 半導体装置の製造方法
JP2013182961A (ja) 2012-02-29 2013-09-12 Toshiba Corp 半導体製造装置及び半導体装置の製造方法
JP2014032986A (ja) * 2012-08-01 2014-02-20 Ps4 Luxco S A R L 半導体装置の製造方法
KR101990051B1 (ko) * 2012-08-31 2019-10-01 에스케이하이닉스 주식회사 무불소텅스텐 배리어층을 구비한 반도체장치 및 그 제조 방법
US9275865B2 (en) * 2012-10-31 2016-03-01 Applied Materials, Inc. Plasma treatment of film for impurity removal
KR20150093384A (ko) * 2014-02-07 2015-08-18 에스케이하이닉스 주식회사 저저항 텅스텐계 매립게이트구조물을 갖는 트랜지스터 및 그 제조 방법, 그를 구비한 전자장치
US11348908B2 (en) * 2016-08-17 2022-05-31 The Regents Of The University Of California Contact architectures for tunnel junction devices
WO2021055693A1 (en) * 2019-09-18 2021-03-25 Mattson Technology, Inc. Methods for the treatment of workpieces

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20080146041A1 (en) * 2005-02-01 2008-06-19 Tokyo Electron Limited Semiconductor Device Manufacturing Method and Plasma Oxidation Method
TW201001543A (en) * 2008-02-08 2010-01-01 Tokyo Electron Ltd Method for modifying insulating film with plasma
US20090311876A1 (en) * 2008-06-13 2009-12-17 Hitachi Kokusai Electric Inc. Manufacturing method of semiconductor device and substrate processing apparatus
TW201030847A (en) * 2008-10-29 2010-08-16 Hitachi Int Electric Inc Method of manufacturing a semiconductor device and a device for treating substrate
JP2010232240A (ja) * 2009-03-26 2010-10-14 Hitachi Kokusai Electric Inc 半導体装置の製造方法、及び半導体製造装置
TW201447018A (zh) * 2013-03-06 2014-12-16 Lam Res Corp 金屬晶種層上之金屬氧化物的還原方法與設備

Also Published As

Publication number Publication date
US11664275B2 (en) 2023-05-30
CN110870047A (zh) 2020-03-06
WO2019065544A1 (ja) 2019-04-04
JP6870103B2 (ja) 2021-05-12
TW201920763A (zh) 2019-06-01
US20200211858A1 (en) 2020-07-02
US20230307295A1 (en) 2023-09-28
JPWO2019065544A1 (ja) 2020-04-30
SG11202002212YA (en) 2020-04-29
CN110870047B (zh) 2024-03-05
KR102452913B1 (ko) 2022-10-11
KR20200035140A (ko) 2020-04-01

Similar Documents

Publication Publication Date Title
JP6649473B2 (ja) 基板処理装置、半導体装置の製造方法及びプログラム
JP6636677B2 (ja) 基板処理装置、半導体装置の製造方法及び記録媒体
JP6552780B1 (ja) 基板処理装置、半導体装置の製造方法、及び静電シールド
KR102315002B1 (ko) 반도체 장치의 제조 방법, 프로그램 및 기판 처리 장치
US20230307295A1 (en) Method of manufacturing semiconductor device, substrate processing apparatus, and recording medium
JPWO2018179352A1 (ja) 半導体装置の製造方法、基板処理装置およびプログラム
JP6436886B2 (ja) 半導体装置の製造方法及びプログラム
JP7165743B2 (ja) 半導体装置の製造方法、基板処理装置、及びプログラム
TWI808628B (zh) 基板處理裝置、半導體裝置之製造方法及程式
JP6281964B2 (ja) 半導体装置の製造方法、プログラム及び基板処理装置
TWI749506B (zh) 基板處理裝置,半導體裝置的製造方法及程式
TWI785297B (zh) 基板處理裝置、半導體裝置的製造方法及程式
TWI814137B (zh) 基板處理裝置,半導體裝置的製造方法,基板處理方法及程式
JP7393376B2 (ja) 半導体装置の製造方法、基板処理方法、プログラム及び基板処理装置
WO2023095374A1 (ja) 基板処理装置、半導体装置の製造方法及び基板処理方法