TW202022945A - 晶圓的加工方法 - Google Patents
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- 238000000034 method Methods 0.000 title abstract description 10
- 238000000227 grinding Methods 0.000 claims abstract description 38
- 238000005530 etching Methods 0.000 claims abstract description 25
- 235000012431 wafers Nutrition 0.000 claims description 246
- 239000007789 gas Substances 0.000 claims description 50
- 238000003672 processing method Methods 0.000 claims description 24
- 230000015572 biosynthetic process Effects 0.000 claims description 21
- 230000001681 protective effect Effects 0.000 claims description 19
- 239000011261 inert gas Substances 0.000 claims description 12
- 239000003507 refrigerant Substances 0.000 description 16
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 5
- 238000001816 cooling Methods 0.000 description 5
- 230000007547 defect Effects 0.000 description 5
- 238000004519 manufacturing process Methods 0.000 description 5
- 239000000463 material Substances 0.000 description 5
- 238000001514 detection method Methods 0.000 description 4
- 229910052751 metal Inorganic materials 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 239000010703 silicon Substances 0.000 description 4
- 229910052814 silicon oxide Inorganic materials 0.000 description 4
- 229910052581 Si3N4 Inorganic materials 0.000 description 3
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 3
- 238000005229 chemical vapour deposition Methods 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 3
- 238000002161 passivation Methods 0.000 description 3
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 3
- JBRZTFJDHDCESZ-UHFFFAOYSA-N AsGa Chemical compound [As]#[Ga] JBRZTFJDHDCESZ-UHFFFAOYSA-N 0.000 description 2
- 229910002601 GaN Inorganic materials 0.000 description 2
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 2
- JMASRVWKEDWRBT-UHFFFAOYSA-N Gallium nitride Chemical compound [Ga]#N JMASRVWKEDWRBT-UHFFFAOYSA-N 0.000 description 2
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 2
- 239000002390 adhesive tape Substances 0.000 description 2
- 239000004020 conductor Substances 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 239000011521 glass Substances 0.000 description 2
- 150000002500 ions Chemical class 0.000 description 2
- 239000002184 metal Substances 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 description 2
- 229910010271 silicon carbide Inorganic materials 0.000 description 2
- 239000004575 stone Substances 0.000 description 2
- 239000000853 adhesive Substances 0.000 description 1
- 230000001070 adhesive effect Effects 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 239000000919 ceramic Substances 0.000 description 1
- 238000004140 cleaning Methods 0.000 description 1
- 239000000470 constituent Substances 0.000 description 1
- 238000002788 crimping Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000005520 cutting process Methods 0.000 description 1
- 230000006837 decompression Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000009713 electroplating Methods 0.000 description 1
- 230000003028 elevating effect Effects 0.000 description 1
- 238000005538 encapsulation Methods 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- 230000001678 irradiating effect Effects 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 150000004767 nitrides Chemical class 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 239000010453 quartz Substances 0.000 description 1
- 239000011347 resin Substances 0.000 description 1
- 229920005989 resin Polymers 0.000 description 1
- 239000010980 sapphire Substances 0.000 description 1
- 229910052594 sapphire Inorganic materials 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
- 229910052718 tin Inorganic materials 0.000 description 1
- 238000009966 trimming Methods 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
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- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76898—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics formed through a semiconductor substrate
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- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02002—Preparing wafers
- H01L21/02005—Preparing bulk and homogeneous wafers
- H01L21/02008—Multistep processes
- H01L21/0201—Specific process step
- H01L21/02013—Grinding, lapping
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/304—Mechanical treatment, e.g. grinding, polishing, cutting
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/306—Chemical or electrical treatment, e.g. electrolytic etching
- H01L21/3065—Plasma etching; Reactive-ion etching
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/322—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections
- H01L21/3221—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to modify their internal properties, e.g. to produce internal imperfections of silicon bodies, e.g. for gettering
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Abstract
[課題]將對埋設有通孔電極之晶圓進行加工來製造元件晶片之步驟簡化。
[解決手段]一種晶圓的加工方法,是對埋設有通孔電極且形成有覆蓋該通孔電極的第1絕緣膜的晶圓進行加工,前述晶圓的加工方法具備以下步驟::磨削步驟,將該晶圓從該背面側磨削到不使覆蓋該通孔電極的該第1絕緣膜露出於背面側的程度;電極突出步驟,蝕刻該晶圓的該背面而讓被該第1絕緣膜所覆蓋的該通孔電極突出於該背面側;應變層形成步驟,對突出有該通孔電極的該晶圓的背面供給已電漿化之非活性氣體,而在該晶圓的該背面形成應變層;絕緣膜形成步驟,在該晶圓的該背面形成第2絕緣膜;及電極形成步驟,在與該通孔電極重疊的區域中去除該第1絕緣膜與該第2絕緣膜,並形成連接到露出於該晶圓的背面側之通孔電極的背面側電極。
Description
發明領域
本發明是有關於一種埋設有通孔(Via)電極之晶圓的加工方法。
發明背景
搭載於電子機器的元件晶片,是藉由在由半導體等材料所形成的晶圓的正面設定複數條交叉的分割預定線,並在以該分割預定線所區劃出的各區域中形成元件,且沿著分割預定線分割該晶圓而形成。近年來,為了元件晶片的省空間化而要求有薄型的元件晶片,且將晶圓在分割之前從背面側磨削來薄化至預定的成品厚度。
此外,近年來,要求有對預定的組裝對象組裝元件晶片時的組裝面積的省面積化、或元件晶片的高性能化。於是,製造有以下之封裝晶片:積層有複數個元件晶片,且將元件晶片的積層體容納在1個封裝中。
但是,以往雖然已可將包含在該封裝晶片的複數個元件晶片藉由打線接合(wire bonding)等之方法來相互連接,但在這種情況下,不得不與變得必須用於接線之區域的量相應來加大封裝,而元件晶片的多層化早已到達極限。
於是,已開發有例如以下之技術:將於厚度方向上貫穿元件晶片的通孔電極(貫通電極)形成於該元件晶片,並以該通孔電極在複數個元件晶片之間進行連接。例如,藉由形成於分割矽晶圓而製作出的元件晶片的通孔電極來連接上下的元件晶片之技術稱為TSV(矽穿孔,Through-silicon via)。該通孔電極因為可以形成得比接合引線(bonding wire)更短,所以TSV技術也有助於封裝晶片的處理的高速化。
具有通孔電極之元件晶片,是藉由以下所說明的順序來製作。首先,準備圓板狀的晶圓,並於形成元件之前或之後,在藉由分割預定線所區劃的各區域中將通孔電極從正面埋入到超過該元件晶片的成品厚度之預定的深度。再者,為了使通孔電極和晶圓之間絕緣,又,依通孔電極之形成製程之情形,可在埋入通孔電極的孔(通孔(Via hole))的內壁形成氧化矽膜等絕緣膜。
並且,從背面側磨削該晶圓,之後使通孔電極露出於背面側。此外,在通孔電極的露出部分形成成為端子的電極(凸塊),並且沿著分割預定線分割該晶圓(參照專利文獻1)。
先前技術文獻
專利文獻
專利文獻1:日本專利特開2014-33160號公報
發明概要
發明欲解決之課題
在使已埋入晶圓的通孔電極露出於背面側時,首先,是從該晶圓的背面側照射於構成晶圓的材料中穿透之波長的紅外線等,以檢測通孔電極的底部與晶圓的背面之間的距離(深度)。接著,從背面側將晶圓磨削到不使覆蓋通孔電極之絕緣膜露出於背面側的程度。此外,藉由蝕刻晶圓的背面側,以將晶圓薄化至元件晶片的成品厚度,同時使被該絕緣膜所覆蓋的通孔電極突出於晶圓的背面側。
之後,在晶圓的背面側形成成為去疵層之氮化矽膜,並進一步在晶圓的背面側形成成為鈍化膜的氧化矽膜,其中前述去疵層是防止金屬元素等從外部擴散到晶圓(元件晶片)的內部之情形的層。之後,藉由CMP(化學機械研磨,Chemical Mechanical Polishing)來去除與通孔電極重疊之去疵層、鈍化膜與覆蓋該通孔電極的絕緣膜,而使通孔電極露出於晶圓的背面側。此外,在所露出之通孔電極形成成為端子的電極(凸塊)。
像這樣,因為具備通孔電極的元件晶片是經過大量的步驟而形成,所以存有容易使該元件晶片之製造成本變高的傾向,所要求的是步驟的簡化。例如,因為在形成成為去疵層之氮化膜的步驟上會花費很多的成本,所以為了減少該元件晶片之製造成本,所期望的是省略該步驟。
本發明是有鑒於所述的問題點而作成的發明,其目的在於提供一種晶圓的加工方法,其可以將對埋設有通孔電極之晶圓進行加工來製造具有通孔電極之元件晶片的步驟簡化並低成本化。
用以解決課題之手段
根據本發明之一態樣,可提供一種晶圓的加工方法,是對以下之晶圓進行加工的加工方法:於正面設定有交叉之複數條分割預定線、在藉由該分割預定線所區劃出的各區域中形成有元件、在該各區域中埋設有沿著厚度方向的通孔電極、且形成有覆蓋該通孔電極的第1絕緣膜之晶圓,前述晶圓的加工方法的特徵在於具備以下步驟:
保護構件配設步驟,在該晶圓的該正面配設保護構件;
磨削步驟,以工作夾台保持該晶圓的該保護構件側,並從該背面側將該晶圓磨削到不使覆蓋該通孔電極的該第1絕緣膜露出於背面側的程度;
電極突出步驟,在實施磨削步驟之後,將該晶圓容置於第1真空腔室,並對該晶圓的背面供給已電漿化之第1蝕刻氣體來蝕刻該晶圓的該背面而讓被該第1絕緣膜所覆蓋的該通孔電極突出於該背面側;
應變層形成步驟,在該電極突出步驟之後,對突出有該通孔電極的該晶圓的該背面供給已電漿化之非活性氣體,而在該晶圓的該背面形成應變層;
絕緣膜形成步驟,在該應變層形成步驟之後,在形成有該應變層的該晶圓的該背面形成第2絕緣膜;及
電極形成步驟,在該絕緣膜形成步驟之後,在與該通孔電極重疊的區域中去除該第1絕緣膜、該第2絕緣膜,並形成連接到露出於該晶圓的該背面側之該通孔電極的背面側電極。
較佳的是,在該應變層形成步驟中,是讓在該電極突出步驟中之該晶圓原樣容置在用以容置該晶圓的該第1真空腔室並將該第1蝕刻氣體排氣之後,對該第1真空腔室供給已電漿化的該非活性氣體。
又,較佳的是,更具備氧化膜去除步驟,前述氧化膜去除步驟是在該電極突出步驟後,且在該應變層形成步驟之前,將該晶圓容置於第2真空腔室,並對該晶圓的該背面供給已電漿化的第2蝕刻氣體來去除形成在該晶圓的該背面的自然氧化膜,在該應變層形成步驟中,是讓該晶圓原樣容置於該第2真空腔室並將該第2蝕刻氣體排氣之後,將已電漿化的該非活性氣體供給至該第2真空腔室。
發明效果
在本發明之一態樣的晶圓的加工方法中,是從背面側磨削已被第1絕緣膜所覆蓋之埋設有通孔電極的晶圓,之後,供給已電漿化的第1蝕刻氣體來蝕刻晶圓的背面,而使該通孔電極突出於背面側。之後,對突出有該通孔電極的該晶圓的背面供給已電漿化的非活性氣體,而在該晶圓的該背面形成應變層。
因為該應變層是作為對欲從外部進入到該晶圓之金屬元素進行去疵的去疵層而發揮功能,所以不需要另外形成作為去疵層而發揮功能的氮化矽膜,而可將步驟簡化。之後,當沿著分割預定線分割形成有作為去疵層而發揮功能之應變層的晶圓後,即可以製造具有通孔電極之一個個的元件晶片。
從而,根據本發明之一態樣,可提供一種晶圓的加工方法,其可以將對埋設有通孔電極之晶圓進行加工來製造具有通孔電極之元件晶片的步驟簡化並低成本化。
用以實施發明之形態
參照附加圖式,說明本發明的一個態樣之實施形態。首先,針對本實施形態之晶圓的加工方法中的被加工物即晶圓,利用圖1(A)及圖1(B)來說明。圖1(A)是示意地顯示晶圓1的立體圖,圖1(B)是將晶圓1放大而示意地顯示的立體圖。
晶圓1是例如由Si(矽)、SiC(碳化矽)、GaN(氮化鎵)、GaAs(砷化鎵)、或者是其他之半導體等的材料、又或是藍寶石、玻璃、石英等的材料所構成之大致圓板狀的基板等。
於晶圓1的正面1a設定有交叉的複數條分割預定線3,且在以該分割預定線3所區劃出的各區域中形成有IC(積體電路,Integrated Circuit)或LSI(大型積體電路,Large Scale Integrated circuit)等的元件5。藉由沿著分割預定線3分割晶圓1,可以形成具備元件5的元件晶片。
近年來,為了元件晶片的薄型化,而將晶圓1在分割前從背面1b側加工來薄化到預定的成品厚度。此外,為了元件晶片的高性能化,又,為了安裝該元件晶片時的組裝面積的省面積化,而形成有如下的封裝晶片:積層複數個元件晶片,且將元件晶片的積層體容納在1個封裝中。所積層之元件晶片間的電連接,是例如藉由通孔電極(貫通電極)而實現,前述通孔電極是在厚度方向上貫穿各個元件晶片的電極。
在藉由晶圓1之分割預定線3所區劃出的各區域中,亦即形成有元件5的區域中,是如圖1(B)所示,沿著晶圓1的厚度方向埋設通孔電極9,並且連接於元件5所具備的電極7。通孔電極9是形成到深度超過1片元件晶片的成品厚度為止。
之後,將晶圓1薄化到該成品厚度,而使通孔電極9露出於背面側,並進一步在露出的通孔電極9上形成成為端子的電極(凸塊)。接著,藉由沿著分割預定線3分割晶圓1而形成具備元件5的元件晶片。然後,在積層複數個該元件晶片而形成封裝晶片時,通過通孔電極9來電連接各元件晶片的元件5。
通孔電極9是在比元件5更之前或之後形成於晶圓1。形成通孔電極9之時,首先,是在晶圓1的正面1a側形成被稱為通孔的凹部,前述通孔是用於在藉由晶圓1的分割預定線3所區劃出的各區域中於預定的位置埋設通孔電極9。通孔是形成到深度超過元件晶片的成品厚度為止。
在通孔的底部及內壁可形成第1絕緣膜13(參照圖3(B)等)。該第1絕緣膜13是例如氧化矽膜,且以CVD(化學氣相沉積,Chemical Vapor Deposition)等方法來形成。其次,在通孔中埋入Cu、W、Al或多晶矽等,而形成通孔電極9。之後,當加工晶圓1的背面1b側時,若將晶圓1薄化,通孔電極9即露出於該背面1b側。
接著,說明在本實施形態之晶圓的加工方法中所使用的電漿處理裝置之一例。該電漿處理裝置是藉由對晶圓1的背面1b側供給已電漿化的蝕刻氣體,而蝕刻晶圓1的背面1b側。又,藉由對晶圓1的背面1b側供給已電漿化的非活性氣體,而在晶圓1的背面1b側形成應變層。圖4是示意地顯示電漿處理裝置16的構成例的截面圖。
電漿處理裝置16具備形成處理空間18的第1真空腔室20。第1真空腔室20是形成為長方體狀,前述長方體狀包含底壁20a、上壁20b、第1側壁20c、第2側壁20d、第3側壁20e、及第4側壁(未圖示),且在第2側壁20d設置有用於將晶圓1搬入搬出的開口22。
於開口22的外側設置有將開口22打開關閉的閘門24。此閘門24是藉由開閉機構26而朝上下移動。開閉機構26包含有汽缸28及活塞桿30。汽缸28是透過托架32而固定於第1真空腔室20的底壁20a,活塞桿30的前端是連結於閘門24的下部。
藉由以開閉機構26打開閘門24,可以通過開口22將晶圓1搬入至第1真空腔室20的處理空間18中、或者將晶圓1從該處理空間18中搬出。於第1真空腔室20的底壁20a形成有排氣口34。此排氣口34是與真空泵等排氣機構36相連接。
在第1真空腔室20的處理空間18中,是將下部電極38與上部電極40配置成相向。下部電極38是藉由導電性的材料所形成,並包含圓盤狀的保持部42、及從保持部42的下表面中央朝下方突出之圓柱狀的支撐部44。
支撐部44是被插通於形成於第1真空腔室20的底壁20a之開口46。在開口46內,且在底壁20a與支撐部44之間配置有環狀的絕緣構件48,而將第1真空腔室20與下部電極38絕緣。下部電極38是在第1真空腔室20的外部與高頻電源50相連接。
在保持部42的上表面形成有凹部,於此凹部中設置有可載置晶圓1的工作台52。在工作台52中形成有吸引路(未圖示),此吸引路是通過於下部電極38的內部所形成的流路54而與吸引源56相連接。
又,於保持部42的內部形成有冷卻流路58。冷卻流路58的一端是通過形成於支撐部44的冷媒導入路60而與冷媒循環機構62相連接,冷卻流路58的另一端是通過形成於支撐部44的冷媒排出路64而與冷媒循環機構62相連接。當使此冷媒循環機構62作動時,冷媒會依冷媒導入路60、冷卻流路58、冷媒排出路64的順序流動,而冷卻下部電極38。
上部電極40是以導電性的材料所形成,並包含圓盤狀的氣體噴出部66、以及從氣體噴出部66的上表面中央朝上方突出之圓柱狀的支撐部68。支撐部68是插通於形成在第1真空腔室20的上壁20b之開口70。在開口70內,且在上壁20b與支撐部68之間配置有環狀的絕緣構件72,而將第1真空腔室20與上部電極40絕緣。
上部電極40是在第1真空腔室20的外部與高頻電源74相連接。又,在支撐部68的上端部安裝有與升降機構76相連結的支撐臂78,且上部電極40是藉由此升降機構76及支撐臂78而朝上下移動。
在氣體噴出部66的下表面設置有複數個噴出口80。此噴出口80是通過形成於氣體噴出部66的流路82及形成於支撐部68的流路84,而連接於第1氣體供給源86及第2氣體供給源88。藉由第1氣體供給源86、第2氣體供給源88、流路82、84、及噴出口80,可構成對第1真空腔室20內導入氣體的氣體導入部。再者,構成電漿處理裝置16所具備的氣體導入部之氣體供給源並不限於2個。
開閉機構26、排氣機構36、高頻電源50、吸引源56、冷媒循環機構62、高頻電源74、升降機構76、第1氣體供給源86、及第2氣體供給源88等是連接於控制裝置90。
可從排氣機構36對控制裝置90輸入有關於處理空間18的壓力之資訊。又,可從冷媒循環機構62對控制裝置90輸入有關於冷媒的溫度之資訊(亦即,有關於下部電極38的溫度之資訊)。
再者,可從第1氣體供給源86、第2氣體供給源88對控制裝置90輸入有關於各氣體的流量之資訊。控制裝置90是依據這些資訊、或由使用者所輸入的其他資訊,而輸出控制上述之各構成要件的控制訊號。
其次,參照圖8(A)所示的流程圖來說明本實施形態之晶圓的加工方法。圖8(A)是顯示本實施形態之晶圓的加工方法的各步驟的流程之一例的流程圖。
在本實施形態之晶圓的加工方法中,首先是實施保護構件配設步驟S1。圖2(A)是示意地顯示保護構件配設步驟S1的立體圖。在保護構件配設步驟S1中,是在晶圓1的正面1a配設保護構件11。
保護構件11具有在實施本實施形態之晶圓的加工方法的期間,保護形成於晶圓1的正面1a的元件5等的功能。保護構件11是例如與晶圓1之直徑為相同程度的直徑的圓形的黏著膠帶,且在保護構件配設步驟S1中,是將該黏著膠帶貼附於晶圓1的正面1a。或者,保護構件11是以玻璃或樹脂、陶瓷等材料所形成之具有剛性的圓板狀的板,且在此情況下,可藉由接著構件而貼附於晶圓1的正面1a。
保護構件配設步驟S1之後,實施磨削步驟S2。在磨削步驟S2中,是從背面1b側對晶圓1進行磨削。在實施磨削步驟S2時,是事先實施以下之測定:測定從該背面1b到通孔電極9的前端為止之深度。之後,參照所測定出的該深度之值來從背面側磨削晶圓1,而將晶圓1薄化到不讓通孔電極9及第1絕緣膜13(參照圖3(B)等)露出的程度。圖2(B)是示意地顯示通孔電極的深度之測定情形的截面圖。
如圖2(B)所示,首先,將晶圓1的正面1a側朝向下方,來將該晶圓1載置於工作夾台4之上。其次,使用設置於工作夾台4之上方的高度檢測單元2來實施通孔電極9之前端的深度之測定。
高度檢測單元2及工作夾台4是配設在例如接下來所說明的磨削裝置(參照圖3(A))上。或者,亦可配設在獨立的高度測定裝置上。高度檢測單元2是例如紅外線相機單元,且讓穿透晶圓1之波長的紅外線從背面1b側照射於晶圓1,並於晶圓1的上方移動,來觀測被反射的紅外線並測定通孔電極9之自該背面1b起算的深度。
接著,說明實施晶圓1的磨削之磨削裝置。圖3(A)是示意地顯示磨削步驟的截面圖。圖3(A)所示之磨削裝置6具備工作夾台4、及配置於工作夾台4的上方的磨削單元6a。
工作夾台4的上表面是成為使多孔質構件露出的保持面。工作夾台4在內部具備有一端連接於該多孔質構件的吸引路(未圖示),且該吸引路的另一端是連接到吸引源(未圖示)。當將晶圓1以讓正面1a朝向下方的狀態來載置在工作夾台4的保持面上,並使該吸引源作動而通過該吸引路及該多孔質構件使負壓作用於晶圓1時,即可將晶圓1吸引保持於工作夾台4。再者,工作夾台4可繞著垂直於該保持面的軸而旋轉。
工作夾台4的上方之磨削單元6a具備沿著垂直於工作夾台4的保持面的方向之主軸8、固定在主軸8的下端之輪座10,及裝設於輪座10的下表面之磨削輪12。於磨削輪12之下表面裝設有磨削磨石14。主軸8的上端連接有未圖示的旋轉驅動源,且當使主軸8繞著垂直於該保持面的方向而旋轉時,磨削輪12即旋轉而使磨削磨石14在旋轉軌道上移動。
在磨削步驟S2中,是使工作夾台4及主軸8各自旋轉,並使磨削單元6a下降。當在旋轉軌道上移動的磨削磨石14接觸到已保持在工作夾台4的晶圓1的背面1b側時,晶圓1即被磨削。此外,使磨削單元6a下降至不使晶圓1的通孔電極9及第1絕緣膜13(參照圖3(B)等)露出於背面1b側之程度的預定高度位置。
圖3(B)是將已實施磨削步驟S2後的晶圓1放大並示意地顯示的截面圖。如圖3(B)所示,當實施磨削步驟S2時,是將晶圓1從背面1b側磨削至不使覆蓋通孔電極9的該第1絕緣膜13露出於背面1b側的程度。
再者,在以矽等所形成之圓板狀的晶圓1的外周部,已事先實施有倒角加工,前述倒角加工是為了防止該外周部的缺損而將角部去除的加工。因此,連接晶圓1之正面1a與背面1b的側面是成為曲面。在此情況下,當實施磨削步驟S2且從背面1b側磨削晶圓1後,會在晶圓1的外周部出現變尖成刀緣的形狀,而變得容易產生晶圓1的缺損。於是,亦可在磨削晶圓1前,實施去除晶圓1的外周部的邊緣修整加工。
在本實施形態之晶圓的加工方法中,是在實施磨削步驟S2之後,實施電極突出步驟S3,前述電極突出步驟S3是使被第1絕緣膜13所覆蓋之通孔電極9突出於晶圓1的背面1b側。電極突出步驟S3是以例如圖4所示之電漿處理裝置16來實施。
在電極突出步驟S3中,首先是藉由開閉機構26使電漿處理裝置16的閘門24下降。接著,通過開口22將晶圓1搬入第1真空腔室20的處理空間18,並以背面1b側朝上方露出的方式載置於下部電極38的工作台52。再者,在晶圓1的搬入時,宜事先以升降機構76使上部電極40上升,以先將下部電極38與上部電極40的間隔擴大。
之後,使吸引源56的負壓作用,以將晶圓1固定在工作台52上。又,藉由開閉機構26使閘門24上升,以將處理空間18密閉。此外,以升降機構76將上部電極40的高度位置調節成使上部電極40與下部電極38成為適合於電漿加工之預定的位置關係。又,使排氣機構36作動,而將處理空間18設為真空(低壓)。圖5(A)是示意地顯示在電極突出步驟S3中被搬入電漿處理裝置之晶圓1的截面圖。
再者,在處理空間18的減壓後,欲藉由吸引源56的負壓來保持晶圓1之作法較困難的情況下,是藉由電氣上的力(代表性的為靜電引力)等來將晶圓1保持於工作台52上。例如,藉由將電極埋入工作台52的內部,並對此電極供給電力,而使電氣上的力作用於工作台52與晶圓1之間。
接著,一邊以預定之流量來供給包含第1蝕刻氣體之電漿加工用的氣體,一邊將預定之高頻電力供給至下部電極38及上部電極40。在此,第1蝕刻氣體可為例如CF4
或SF6
,且可進一步將第1蝕刻氣體和氫氣或氧氣等以預定的比例混合來供給到晶圓1。
具體而言,在電極突出步驟S3中,是將處理空間18內維持為預定的壓力(例如5Pa以上且50Pa以下),並且一邊從第1氣體供給源86以預定的流量來供給第1蝕刻氣體,一邊對下部電極38及上部電極40賦與預定的高頻電力(例如1000W以上且3000W以下)。
藉此,可在下部電極38與上部電極40之間產生電漿,並可將從已電漿化的第1蝕刻氣體所產生的離子吸引至下部電極38側,且供給到晶圓1的背面1b。在此,蝕刻是以晶圓1和第1絕緣膜13之間的選擇比為較高的條件來實施。亦即,當實施電極突出步驟S3時,一方面讓晶圓1被蝕刻並逐漸地被去除,另一方面讓露出的第1絕緣膜13難以被蝕刻。
從而,如圖5(B)所示,當實施電極突出步驟S3後,是成為以下之狀態:晶圓1後退,通孔電極9及第1絕緣膜13相對於晶圓1的背面1b而突出。圖5(B)是將實施電極突出步驟後的狀態放大而示意地顯示之截面圖。
接著,在本實施形態之晶圓的加工方法中,實施應變層形成步驟S4,前述應變層形成步驟S4是對突出有通孔電極9之晶圓1的背面1b供給已電漿化之非活性氣體,而在晶圓1的背面1b形成應變層。
亦可讓在電極突出步驟S3中之晶圓1原樣容置在用以容置晶圓1的第1真空腔室20,並接續於電極突出步驟S3在第1真空腔室20中實施應變層形成步驟S4。此時,是將該第1蝕刻氣體排氣後,將已電漿化的該非活性氣體供給到第1真空腔室20。圖6(A)是示意地顯示在應變層形成步驟S4中,已固定於第1真空腔室20的內部的工作台52之晶圓1的截面圖。
亦即,在應變層形成步驟S4中,是一邊讓晶圓1原樣固定於工作台52並以預定的流量供給電漿加工用的非活性氣體,一邊將預定的高頻電力供給至下部電極38及上部電極40。在應變層形成步驟S4中,是將處理空間18內維持為預定的壓力(例如5Pa以上且50Pa以下),並且一邊從第2氣體供給源88以預定的流量來供給Ar、He、Ne等之非活性氣體,一邊對下部電極38及上部電極40賦與預定的高頻電力(例如1000W以上且3000W以下)。
藉此,可在下部電極38與上部電極40之間產生電漿,並可將從已電漿化的非活性氣體產生的離子吸引至下部電極38側,且供給到晶圓1的背面1b。並且,晶圓1的背面1b受到濺射,而在背面1b形成細微的凹凸或裂隙(應變)。形成有此應變的區域即成為應變層15。
圖6(B)是將已實施應變層形成步驟S4之晶圓1放大而示意地顯示的截面圖。如圖6(B)所示,當實施應變層形成步驟S4後,即在晶圓1之背面1b側形成應變層15。應變層15是作為去疵層而發揮功能,前述去疵層是捕捉欲從晶圓1的背面1b側進入晶圓1的內部之金屬元素。
在本實施形態之晶圓的加工方法中,因為可以藉由應變層形成步驟S4來形成作為去疵層而發揮功能的應變層15,所以變得不需要進行用於在晶圓1的背面1b側成膜由氮化矽膜等所形成的去疵層之成膜步驟。特別是,在電極突出步驟S3之後連續而實施應變層形成步驟S4的情況下,可以在已實施電極突出步驟S3之電漿處理裝置16中,僅切換供給至晶圓1的氣體種類來實施應變層形成步驟S4。
亦即,在本實施形態之晶圓的加工方法中,實施應變層形成步驟S4所需要的成本極少,且可以有效率地在晶圓1的背面1b側形成去疵層。亦即,可以將製造具有通孔電極9的元件晶片的步驟簡化,且可以用較高的加工效率來加工晶圓1。
再者,在應變層形成步驟S4中,雖然是使已電漿化的非活性氣體碰撞到晶圓1的背面1b而形成應變層15,但有以下之疑慮:在此過程中產生來自於晶圓1的屑,而附著於第1真空腔室20的內壁並堆積。在此,在第1真空腔室20中實施電極突出步驟S3與應變層形成步驟S4的情況下,在第1真空腔室20中,可在實施應變層形成步驟S4之後,對下一個被加工的晶圓實施電極突出步驟S3。
在電極突出步驟S3中,雖然是將已電漿化的第1蝕刻氣體供給至晶圓的背面1b,但是因為已電漿化的第1蝕刻氣體也會到達已附著於第1真空腔室20的內壁之該屑,所以可去除該屑。從而,當在第1真空腔室20中對複數個晶圓逐一地實施電極突出步驟S3與應變層形成步驟S4時,可將第1真空腔室20的清理的頻率降低,晶圓的加工效率即進一步提高。
在應變層形成步驟S4之後,實施絕緣膜形成步驟S5。在絕緣膜形成步驟S5中,是在形成有應變層15之晶圓1的背面1b形成第2絕緣膜。圖7(A)是將已實施絕緣膜形成步驟S5的晶圓放大而示意地顯示的截面圖。在絕緣膜形成步驟S5中,是藉由濺鍍法或CVD法等,在晶圓1的背面1b側形成氧化矽膜來作為第2絕緣膜17。第2絕緣膜17是作為保護晶圓1的背面側的鈍化膜而發揮功能。
在絕緣膜形成步驟S5之後,是實施電極形成步驟S6。在電極形成步驟S6中,是使通孔電極9露出於晶圓1的背面1b側,並形成連接於通孔電極9的背面側電極。在電極形成步驟S6中,是在形成該背面側電極之前預先在與通孔電極9重疊的區域中,去除第1絕緣膜13及第2絕緣膜17。圖7(B)是將已在與通孔電極9重疊的區域中去除第1絕緣膜13及第2絕緣膜17之晶圓1放大而示意地顯示的截面圖。
第1絕緣膜13及第2絕緣膜17的去除,是例如藉由CMP加工而實施。被第1絕緣膜13所覆蓋的通孔電極9,是藉由電極突出步驟S3而從晶圓1的背面1b突出。因此,可以藉由實施CMP加工來去除晶圓1之背面1b側的突出的部分,而去除與通孔電極9重疊的第1絕緣膜13及第2絕緣膜17來讓通孔電極9露出於背面1b側。如此一來,變得可進行電連接於通孔電極9之背面側電極的形成。
再者,因為晶圓1的背面1b的主要的區域是被第2絕緣膜17所保護,所以對形成於該背面1b側的應變層15不會產生由CMP加工所造成的損傷。又,通孔電極9亦可藉由光刻(Photolithography)而露出。
其次,形成連接於通孔電極9的電極。圖7(C)是將已實施電極形成步驟S6的晶圓1放大而示意地顯示的截面圖。電極19是以例如Au、Cu、Sn等金屬、或是這些積層體所形成之凸塊,且是藉由例如將金屬線壓接於通孔電極9並以短的長度切斷而形成。或者,在該背面1b形成具有使通孔電極9露出之開口的防護膜,且藉由電解鍍敷而在通孔電極9的露出的區域形成該電極19。
之後,可以藉由按每個元件來分割晶圓,而形成具備通孔電極9的元件晶片。然後,當藉由通孔電極9來連接複數個元件晶片並且使其積層而將其容納在1個封裝後,即可以形成封裝晶片。
再者,在上述實施形態中,雖然已針對在相同的第1真空腔室20中連續而實施電極突出步驟S3與應變層形成步驟S4的情形進行說明,但本發明的一態樣並非限定於此。例如,亦可不在第1真空腔室20中連續而實施電極突出步驟S3與應變層形成步驟S4,且亦可在真空腔室之外於兩個步驟之間實施任意的處理。在此情況下,亦可將應變層形成步驟S4在具備第2真空腔室的其他的電漿處理裝置中實施。
圖8(B)是顯示在以具備第2真空腔室的其他的電漿處理裝置中實施應變層形成步驟S4的情況下之本發明的一態樣之晶圓的加工方法的各步驟的流程之流程圖。在此,具備第2真空腔室的電漿處理裝置是與電漿處理裝置16同樣地構成。
再者,在電極突出步驟S3之後,在從具備第1真空腔室20的電漿處理裝置16搬出晶圓1,並將晶圓1搬入具備第2真空腔室的該電漿處理裝置的期間,有時會於晶圓1的背面1b形成自然氧化膜。於是,亦可在電極突出步驟S3之後,在應變層形成步驟S4之前,實施去除該自然氧化膜的氧化膜去除步驟S7。
在氧化膜去除步驟S7中,是將晶圓1容置在第2真空腔室中,並對晶圓1的背面1b供給已電漿化的第2蝕刻氣體來去除形成於晶圓1的背面1b的自然氧化膜。在此,第2蝕刻氣體是例如C4
F6
或C4
F8
等,且第2蝕刻氣體是進一步和氫氣等以預定的比例混合而供給至晶圓1。
在之後所實施的該應變層形成步驟S4中,是讓晶圓1原樣容置在第2真空腔室並將第2蝕刻氣體排氣之後,將已電漿化的非活性氣體供給至第2真空腔室。在此情況下,因為在已實施氧化膜去除步驟S7的電漿處理裝置中,只切換供給至晶圓1的氣體種類即可以實施應變層形成步驟S4,所以是有效率的。
另外,上述實施形態之構造、方法等,只要在不脫離本發明的目的之範圍下,均可適當變更而實施。
1:晶圓
1a:正面
1b:背面
3:分割預定線
5:元件
7、19:電極
9:通孔電極
11:保護構件
13、17:絕緣膜
15:應變層
2:高度檢測單元
4:工作夾台
6:磨削裝置
6a:磨削單元
8:主軸
10:輪座
12:磨削輪
14:磨削磨石
16:電漿處理裝置
18:處理空間
20:真空腔室
20a、20b、20c、20d、20e:壁
22:開口
24:閘門
26:開閉機構
28:汽缸
30:活塞桿
32:托架
34:排氣口
36:排氣機構
38、40:電極
42:保持部
44、68:支撐部
46、70:開口
48、72:絕緣構件
50、74:高頻電源
52:工作台
54、82、84:流路
56:吸引源
58:冷卻流路
60:冷媒導入路
62:冷媒循環機構
64:冷媒排出路
66:氣體噴出部
76:升降機構
78:支撐臂
80:噴出口
86、88:氣體供給源
90:控制裝置
S1:保護構件配設步驟
S2:磨削步驟
S3:電極突出步驟
S4:應變層形成步驟
S5:絕緣膜形成步驟
S6:電極形成步驟
S7:氧化膜去除步驟
圖1(A)是示意地顯示晶圓的立體圖,圖1(B)是將晶圓放大而示意地顯示的立體圖。
圖2(A)是示意地顯示保護構件配設步驟的立體圖,圖2(B)是示意地顯示通孔電極之深度的測定情形的截面圖。
圖3(A)是示意地顯示磨削步驟的截面圖,圖3(B)是示意地顯示已實施磨削步驟後之晶圓的截面圖。
圖4是示意地顯示電漿蝕刻裝置的截面圖。
圖5(A)是示意地顯示在電極突出步驟中固定於工作台之晶圓的截面圖,圖5(B)是示意地顯示實施電極突出步驟後之晶圓的截面圖。
圖6(A)是示意地顯示在應變層形成步驟中固定於工作台之晶圓之截面圖,圖6(B)是示意地顯示實施應變層形成步驟後之晶圓的截面圖。
圖7(A)是示意地顯示已實施絕緣膜形成步驟之晶圓的截面圖,圖7(B)是示意地顯示已在與通孔電極重疊的區域中去除第1絕緣膜及第2絕緣膜之晶圓的截面圖,圖7(C)是示意地顯示已實施電極形成步驟之晶圓的截面圖。
圖8(A)是顯示晶圓的加工方法之一例的流程圖,圖8(B)是顯示晶圓的加工方法之另一例的流程圖。
1:晶圓
1a:正面
1b:背面
5:元件
9:通孔電極
11:保護構件
13:絕緣膜
15:應變層
18:處理空間
38、40:電極
42:保持部
52:工作台
54:流路
60:冷媒導入路
64:冷媒排出路
66:氣體噴出部
80:噴出口
82、84:流路
Claims (3)
- 一種晶圓的加工方法,是對以下之晶圓進行加工的加工方法:於正面設定有交叉之複數條分割預定線、在藉由該分割預定線所區劃出的各區域中形成有元件、在該各區域中埋設有沿著厚度方向的通孔電極、且形成有覆蓋該通孔電極的第1絕緣膜之晶圓,前述晶圓的加工方法的特徵在於具備以下步驟: 保護構件配設步驟,在該晶圓的該正面配設保護構件; 磨削步驟,以工作夾台保持該晶圓的該保護構件側,並從該背面側將該晶圓磨削到不使覆蓋該通孔電極的該第1絕緣膜露出於背面側的程度; 電極突出步驟,在實施磨削步驟之後,將該晶圓容置於第1真空腔室,並對該晶圓的背面供給已電漿化之第1蝕刻氣體來蝕刻該晶圓的該背面而讓被該第1絕緣膜所覆蓋的該通孔電極突出於該背面側; 應變層形成步驟,在該電極突出步驟之後,對突出有該通孔電極的該晶圓的該背面供給已電漿化之非活性氣體,而在該晶圓的該背面形成應變層; 絕緣膜形成步驟,在該應變層形成步驟之後,在形成有該應變層的該晶圓的該背面形成第2絕緣膜;及 電極形成步驟,在該絕緣膜形成步驟之後,在與該通孔電極重疊的區域中去除該第1絕緣膜、該第2絕緣膜,並形成連接到露出於該晶圓的該背面側之該通孔電極的背面側電極。
- 如請求項1之晶圓的加工方法,其中在該應變層形成步驟中,是讓在該電極突出步驟中之該晶圓原樣容置在用以容置該晶圓的該第1真空腔室並將該第1蝕刻氣體排氣之後,對該第1真空腔室供給已電漿化的該非活性氣體。
- 如請求項1之晶圓的加工方法,其更具備氧化膜去除步驟,前述氧化膜去除步驟是在該電極突出步驟後,且在該應變層形成步驟之前,將該晶圓容置於第2真空腔室,並對該晶圓的該背面供給已電漿化的第2蝕刻氣體來去除形成在該晶圓的該背面的自然氧化膜, 在該應變層形成步驟中,是讓該晶圓原樣容置於該第2真空腔室並將該第2蝕刻氣體排氣之後,將已電漿化的該非活性氣體供給至該第2真空腔室。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2018226356A JP7210100B2 (ja) | 2018-12-03 | 2018-12-03 | ウェーハの加工方法 |
JP2018-226356 | 2018-12-03 |
Publications (2)
Publication Number | Publication Date |
---|---|
TW202022945A true TW202022945A (zh) | 2020-06-16 |
TWI788605B TWI788605B (zh) | 2023-01-01 |
Family
ID=70681494
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
TW108143764A TWI788605B (zh) | 2018-12-03 | 2019-11-29 | 晶圓的加工方法 |
Country Status (7)
Country | Link |
---|---|
US (1) | US10957593B2 (zh) |
JP (1) | JP7210100B2 (zh) |
KR (1) | KR20200067103A (zh) |
CN (1) | CN111261580B (zh) |
DE (1) | DE102019218774A1 (zh) |
SG (1) | SG10201911107SA (zh) |
TW (1) | TWI788605B (zh) |
Family Cites Families (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3991872B2 (ja) * | 2003-01-23 | 2007-10-17 | 松下電器産業株式会社 | 半導体装置の製造方法 |
JP5076429B2 (ja) * | 2006-10-02 | 2012-11-21 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
JP2010192867A (ja) * | 2009-01-20 | 2010-09-02 | Renesas Electronics Corp | 半導体集積回路装置および半導体集積回路装置の製造方法 |
JP5331500B2 (ja) * | 2009-01-29 | 2013-10-30 | 株式会社ディスコ | ウエーハの処理方法 |
JP2012209480A (ja) * | 2011-03-30 | 2012-10-25 | Disco Abrasive Syst Ltd | 電極が埋設されたウエーハの加工方法 |
JP5975621B2 (ja) * | 2011-11-02 | 2016-08-23 | リンテック株式会社 | ダイシングシートおよび半導体チップの製造方法 |
JP2013131652A (ja) * | 2011-12-21 | 2013-07-04 | Fujitsu Semiconductor Ltd | 半導体装置の製造方法、半導体ウェハの加工方法、半導体ウェハ |
JP5995599B2 (ja) | 2012-08-06 | 2016-09-21 | 株式会社ディスコ | ウエーハの加工方法 |
JP2014053348A (ja) * | 2012-09-05 | 2014-03-20 | Disco Abrasive Syst Ltd | ウエーハの加工方法 |
JP2014053351A (ja) * | 2012-09-05 | 2014-03-20 | Disco Abrasive Syst Ltd | ウエーハの加工方法 |
KR101936405B1 (ko) * | 2013-06-11 | 2019-04-03 | 에스케이하이닉스 주식회사 | 적층 반도체 패키지 및 이의 제조방법 |
JP6418794B2 (ja) * | 2014-06-09 | 2018-11-07 | 東京エレクトロン株式会社 | 改質処理方法及び半導体装置の製造方法 |
JP2016039186A (ja) * | 2014-08-05 | 2016-03-22 | 株式会社ディスコ | ウエーハの加工方法 |
SG10201903242QA (en) * | 2014-10-13 | 2019-05-30 | Utac Headquarters Pte Ltd | Methods for singulating semiconductor wafer |
JP2018056459A (ja) * | 2016-09-30 | 2018-04-05 | 株式会社ディスコ | ウエーハの加工方法 |
-
2018
- 2018-12-03 JP JP2018226356A patent/JP7210100B2/ja active Active
-
2019
- 2019-11-20 CN CN201911139490.2A patent/CN111261580B/zh active Active
- 2019-11-25 SG SG10201911107SA patent/SG10201911107SA/en unknown
- 2019-11-29 TW TW108143764A patent/TWI788605B/zh active
- 2019-12-02 KR KR1020190158354A patent/KR20200067103A/ko active Search and Examination
- 2019-12-02 US US16/700,324 patent/US10957593B2/en active Active
- 2019-12-03 DE DE102019218774.9A patent/DE102019218774A1/de active Pending
Also Published As
Publication number | Publication date |
---|---|
US20200176313A1 (en) | 2020-06-04 |
JP2020092106A (ja) | 2020-06-11 |
TWI788605B (zh) | 2023-01-01 |
CN111261580A (zh) | 2020-06-09 |
JP7210100B2 (ja) | 2023-01-23 |
US10957593B2 (en) | 2021-03-23 |
DE102019218774A1 (de) | 2020-06-04 |
SG10201911107SA (en) | 2020-07-29 |
CN111261580B (zh) | 2024-03-19 |
KR20200067103A (ko) | 2020-06-11 |
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