TW201017745A - Method for polishing both sides of a semiconductor wafer - Google Patents

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Description

201017745 六、發明說明: 【發明所屬之技術領域】 本發明係關於-種抛光半導體晶圓兩面的方法。 特疋〇之本發明係用於拋光下一技術世代的矽晶圓,主要是 直徑450毫米的晶圓。目前,在電子工業中大多數領域需要使用 直仏30G毫米之經拋光或蟲晶加工的半導體晶圓。直徑細毫来 的矽晶圓正逐漸被3〇〇毫米的晶圓取代。 【先前技術】 電子工業希望較大的基材來生產其元件(微處理器或記憶體晶 片)的主要在於它們所具有的巨大經濟優勢。在半導體工業 中’長期以來習慣聚焦於可獲得的基材面積,或者換句話說,係 考慮在個別基材上可容納多少數量的元件,即邏輯晶片或記憶體 曰曰片。這係與以下事實有關:元件製造商的多個加工步驟意欲在 整個基材上進行,但是也有個別步驟係用於使基材結構化,即製 造隨後可獲得個別晶片的元件結構,因此兩組加工步驟的製造成 本係非常特別地由基材尺寸決定的。基材尺寸相當大程度的影響 每個元件的製造成本,因此有重大的經濟重要性。 然而,增加基材直徑必須承擔巨大且有時是全新的、迄今仍未 知的技術問題。 最後,所有的處理步驟,無論他們是純機械處理(鋸切、研磨、 精研)、化學處理(蝕刻、清潔)或本質上的化學_機械處理(拋 光)以及熱處理(磊晶、退火),都需要完全的修正,尤其是它們 所用的機械和系統(設備)。 201017745 本發明係致力於當晶圓用於製造記憶體晶片時,作為半導體晶 圓之最後實質處理步驟的拋光,或者當晶圓用作生產微處理器之 磊晶圓(epi wafer)時,原則上是作為半導體晶圓之磊晶生長前的 倒數第二實質處理步驟的拋光。 本案發明人已經發現拋光450毫米晶圓的方法需要根本的改 變。以下將描述現有技術中已知的那些拋光方法,在界定新的拋 光方法時’已將它們納入考量。它們實質上包含對傳統上所用之 雙面拋光(DSP)和化學-機械拋光(CMP)方法的改良,其在一 種情況下包含在施加拋光劑的同時透過一拋光墊來拋光半導體晶 圓的兩面’以作為材料(stock)拋光(DSP步驟);而在另一種情 況下’僅在使用軟性拋光墊的同時,精整拋光(finishp〇lishing) 正面(元件面)’稱為無光霧拋光(haze-free polishing )( CMP步 驟,精整),但也有相對較新的「固定研磨拋光(FAP)」技術,其 中半導體晶圓係在一拋光墊上拋光,但是後者含有一固定在拋光 墊中的研磨劑(固定研磨劑墊)。其中,使用此類FAP墊的拋光步 ❹驟在下文―稱為FAP步驟。 WO 99/55491 A1描述了一種二階段拋光法,包含一第一 FAP拋 光步驟和一隨後的第二CMP拋光步驟。對於CMP而言,拋光墊 不含有固定研磨劑》如同在DSP步驟中,係在半導體晶圓和拋光 墊之間以懸浮液的形式引入研磨劑。此種二階段拋光法尤其用於 除去FAP步驟在基材之經拋光表面上所留下的刮痕。 EP 1 717 〇(U A1是用於拋光半導體晶圓的FAP步驟的例子,其 中在半導體晶圓表面上還沒有形成元件結構。此類半導體晶圓的 5 201017745 拋光之主要目的係在於製造至少一側是特別平整的表面,且該表 面具有最小可能微粗梭度和奈米形貌。 US 2002/00609967 A1係關於在製造電子元件期間,使形貌表面 平坦化的CMP法。其主要目的是當使用FAP拋光墊時,可緩和較 低除去速率的缺點。其提出了拋光步驟的順序,其中首先用一 FAP 墊結合一拋光劑懸浮液以實施拋光,隨後用一 FAP墊結合一拋光 劑溶液以實施拋光。謹慎地選擇步驟的順序,以便增加除去速率。 在該專利中並未揭露以一均質組合物的材料所製得之晶圓(例 如,石夕晶圓)的拋光。 同樣地,WO 03/074228 A1也揭露了一種在製造電子元件期間 使形貌表面平坦化的方法。在此,該發明的重點係在於CMP法的 終端檢測。眾所周知,終端檢測包含終止拋光,並因此在去除實 際上不準備拋光的區域之前迅速地終止材料的去除。為此,建議 使用二階段法來拋光一銅層。在第一步驟中,係使用一 FAP拋光 墊來實施拋光,在此情況下,拋光劑視需要可含有或不含有自由 研磨劑顆粒。然而,在同樣使用一 FAP墊的第二拋光步驟中,係 必須使用一不含有自由研磨劑顆粒的拋光劑。 申請號為102 007 035 266的德國專利申請案中,在本申請案之 優先權日時尚未公開,其描述了一種拋光由半導體材料所製得之 基材的方法,包含兩個FAP型拋光步驟,彼此之間的區別係在於: 在一拋光步驟中,在基材和拋光墊之間引入一含有固定研磨劑作 為一固體物質的拋光劑懸浮液;而在第二拋光步驟中,以一不含 固體之拋光劑溶液取代該拋光劑懸浮液。 201017745 浮液和拋光劑溶 在下文中所使用的術語拋光劑係涵蓋拋光劑懸 液0 現有技術中已知的所有方法,包含傳統的雙面拋光方法和fap 方法’在材料拋光方面都具有嚴重的缺點。 半導體晶圓的二面同時掘光,會導致不利的邊緣對稱,在傳統 的雙面拋光中係稱為「邊緣下降(edge roll-off)」,即相對於半導 體晶圓厚度的邊緣減少。實驗已顯示,當拋光具有較大直徑的晶 圓時’即拋光例如上述具有450毫米直徑的晶圓時,此問題會進 一步地惡化。較大的基材使得在晶圓邊緣處和在晶圓剩餘區域中 的拋光除去差異增加,從而使邊緣下降更加明顯。 這是有問題的’尤其是因為根據國際公認的藍圖(國際半導體 技術藍圖(International Technology Roadmap for Semiconductors (ITRS))的前段製程(Front End Processes)章節),半導體晶圓 的製造商必須增加可用於製造元件的晶圓面積,並降低無法供元 件使用的「邊緣排除(edge exclusion)」。 儘管2毫米的邊緣排除是目前認為可以接受的,最初此尺寸在 將來由於晶圓直徑增加到450毫米而變得更難以達成,且其隨後 將甚至降低到1毫米。這將只能透過顯著地降低邊緣下降而達成。 將其完全消除將是所欲者。 根據ITRS藍圖更嚴格要求的另一個量是半導體晶圓的奈米形 貌。奈米形貌通常係以面積為2毫米χ2毫米的正方形測量窗為基 準’以高度變化PV (=峰到谷)表示。 這裡再次提及’很久以前已發現先前的拋光方法不足以滿足半 7 201017745 導體晶圓的增加要求。 最後,除了邊緣幾何和奈米形貌,整體和局部平坦度,對於使 下一個及隨後的技術世代成為可能,也具有絕對重要性。 一個特別嚴格的性質是半導體晶圓在其正面上的局部平坦度或 局部幾何。現代投影式光機技術(modern stepper technology)在 半導體晶圓的正面子區域需要優良的局部平坦度,例如表示為 SFQR(「正面參考位置最小平方值/範圍」=對於具限定尺寸的元件 表面(測量窗,「位置」)而言,由最小平方值的最小化所確定之 正面的正偏差和負偏差的幅度。最大的局部平坦度值SFQRmax表 示在半導體晶圓上列入考量之元件表面的最高SFQR值。 最大局部平坦度值通常係藉由將2毫米的邊緣排除納入考量而 確定的。在半導體晶圓上之邊緣排除内的面積通常稱為「固定品 質面積」,簡稱為FQA。那些一部分面積在FQA之外、而中心位 於FQA之内的位置稱為「部分位置」。 通常公認的經驗法則表明半導體晶圓的SFQRmax值必須等於或 小於半導體晶圓供於其上製造半導體元件的可能線寬。超過此值 會導致投影式光機(stepper )的聚焦問題,從而導致相關元件的 損失。 目前,市場上可購得的符合於45奈米技術世代(線寬=45奈米) 的半導體晶圓,其正逐漸被已開發的32奈米技術取代,為此,製 造商也正逐漸改變他們的裝置製程。在此之後的22奈米技術世代 已經在開發中。已經發現傳統的拋光方法確實不足以滿足22奈米 之設計規則的要求。 201017745 因此,本發明之目的是在於提供一種新的拋光方法其既滿足 未來技術世代的要求,又適用於新一代的45〇亳米晶圓。 【發明内容】 上述目的係透過-種拋光半導體晶圓兩面的方法而實現,該方 法包含以下規定順序之步驟: a) 在-拋光塾上拋光該半導體晶圓之背面,該拋光塾含有一固 定在該拋光塾中之研磨劑,在該拋光步驟㈣、在該半導體晶圓 之背面和該拋光墊之間狀—不含固體之抛光劑溶液; b) —在-拋光墊上材料拋光該半導體晶圓之正面,雜光塾含有 一固定在雜光墊中之研磨劑,在該拋光步驟期間、在該半導體 晶圓之正面和該拋錄之間m含㈣之抛光劑溶液; 〇)藉由在-拋光塾上抛光該半導體晶圓之正面而自該半導體晶 圓t正面除去跡減和_傷,在雜光步襲間、在該半導 體晶圓之正面和該拋光塾之間引人-含有研磨劑之拋光劑懸浮
d)错由在-抛光塾上拖光半導體晶圓之正面而精整抛光該半導 體晶圓之正面,該拋光墊不含有固定在該拋光墊中之研磨劑在 入 該拋光步驟期間、在該半導體晶圓之正面和該拋光墊之間引 含有研磨劑之拋光劑懸浮液。 【實施方式】 人發明人已經發現只有半導體晶圓之正面和背面的依序拋光才適 :於此。迄今所用之批量拋光方法,其同時拋光多個由載具盤所 支承之半導體晶圓的兩面,係完全不適合於此且需要以單盤加工 201017745 所取代。 根據本發明,該半導體晶圓之正面和背面的單盤加工係依順序 進行且較佳係於相同的拋光機上進行,其包含相當於材料拋光的 拋光步驟(與傳統DSP中相同)和相當於無光霧拋光的拋光步驟 (與傳統CMP中相同)。 該背面的加工可在一第二拋光機或與該半導體晶圓正面加工所 用之相同拋光機上進行,後者可提供比先前在傳統順序中所用之 更少拋光設備的優點,該傳統順序總是包含一 DSP步驟和一 CMP 步驟,尤其是因為用於單盤加工的拋光機比現在所用的大批量型 拋光機小很多且空間需求也小很多,因此產生了具有前瞻性之生 產線重建的全新製造工廠計畫。為了使加工晶圓背面的第二拋光 機方案可更有效地設置,可想到設置一拋光機(例如來自Applied Materials的Reflection型),其在全部3個拋光板上具有固定研磨 劑之拋光墊,隨後進行該等晶圓的背面拋光。在一隨後步驟中, 已經經背面拋光的晶圓係於相同型號的另一台拋光機上拋光正 面,例如逐批進行,在此情況下,b)至d)點中所描述的拋光步驟 係依序進行。 該製造順序所伴隨的簡化可進一步節省額外的成本。 藉由改善邊緣下降,尤其是藉由改善部分位置,本發明可達成 經拋光之半導體晶圓的邊緣幾何之改良。關於奈米拓撲或奈米形 貌,已可達成滿足22奈米設計規則要求的值。 這是可能的,因為該半導體晶圓的兩面由於該順序拋光而可以 受控制的方式來彼此適應,以例如對邊緣區域的幾何產生正面的 201017745 影響。 本發明的方法無法由規有技術所預見,因為us 2002/00609967 A1所描述的方法實際上要求與正面的FAp步驟(即本發明方法的 步驟b)和c))相反的順序。由此公開著手,為了達成本發明, 本領域技術人員將因而必須超出該公開的教示内容。然而,在該 公開中並無任何該如何進行的明顯建議。 關於WO 03/074228 A1,應強調的是,其所述之方法並不包含 ❹ 銅的拋光,且在第一拋光步驟中,拋光劑含有或不含有自由研磨 劑顆粒係被視為不重要的。 在最簡單的情況下,根據本發明步驟a)和b)的拋光劑溶液是 水,較佳為去離子水(DIW) ’其具有半導體工業中所用的通常純 度。 但是,該拋光劑溶液也可以包含化合物,例如碳酸鈉(Na2C〇3)、 碳酸鉀(K2C〇3)、氫氧化鈉(Na0H)、氫氧化鉀(K0H)、氫氧化 銨(NH4〇H)、四甲基氫氧化銨(TMAH)或前述之任何混合物。 尤佳係使用碳酸鉀。在此情況下,該拋光劑溶液之pH值較佳為 10至12’且該拋光劑溶液中之該等化合物的比例較佳為〇.〇1重量 %至10重量%,尤佳為〇.〇1重量%至0.2重量%。 該拋光劑溶液可進一步包含一或多種其他添加劑,例如表面活 性添加劑(例如潤濕劑和表面活性劑)、起保護性膠體作用的穩定 劑、防腐劑、殺生物劑、醇和螯合劑。 在步驟b)和c)之間,較佳係進行一另外的FAP步驟,其係藉 由使用步驟c)中的拋光劑懸浮液、但使用一 FAP墊而進行的。 11 201017745 本發明方法之步驟C)和d)的拋光劑懸浮液中之研磨劑的比例 較佳為0.25重量%至20重量%,特別較佳為0.25重量%至1重量 %。 該研磨劑顆粒的尺寸分佈較佳為單峰形。 平均顆粒尺寸為5奈米至300奈米,特別較佳為5奈米至50奈 米。 該研磨劑係由一種可機械性去除基材材料的材料所構成,較佳 為鋁、鈽或矽元素之氧化物中的一或多種。 一含有膠體分散之二氧化矽的拋光劑懸浮液係尤佳的(矽溶 膠,參見表1和相關說明;Glanzox)。 該拋光劑懸浮液之pH值較佳為9至11.5,且較佳係透過選自以 下的添加劑來調節:碳酸鈉(Na2C03)、碳酸鉀(K2C03)、氫氧 化鈉(NaOH)、氫氧化鉀(KOH)、氫氧化銨(NH4OH)、四甲基 氫氧化銨(TMAH)或該等化合物之任何混合物。尤其更佳係使用 破酸卸。 該拋光劑懸浮液可進一步包含一或多種其他添加劑’例如表面 活性添加劑(例如潤濕劑和表面活性劑)、起保護性膠體作用的穩 定劑、防腐劑、殺生物劑、醇和螯合劑。 可根據本發明進行拋光的基材,尤其可考慮由諸如以下材料所 製得之半導體晶圓:矽、砷化鎵、SixGei_x、藍寶石和碳化矽。 尤其適合的基材是由矽所製得的半導體晶圓以及由其所衍生的 基材。該矽半導體晶圓之待拋光的正面可為當其係由一晶體切割 201017745 出該半導體晶圓之後、在精研該半導體晶圓之後、在研磨該半導 體晶圓之後、在钱刻該半導體晶圓之後或者在已經拋光之半導體 晶圓之後所得到的狀態。 由一石夕半導體晶圓所衍生的基材尤其意指具有一層結構的基 材,例如具有一透過磊晶沉積之層的半導體晶圓、SOI基材(“絕 緣體上覆石夕(Silicon On Insulator))和sSOI基材(應變型絕緣體 上覆石夕(Strained Silicon On Insulator)),以及前述之相應的中間 產物(例如SGOI=絕緣體上覆梦-錯(Silicon-Germanium On Insulator)) ° 該等中間產物亦可包含供體半導體晶圓,由該等供體半導體晶 圓將層轉移到其他基材上,尤其是在製造SOI基材的期間。為了 使其可被再使用,必須使因該層轉移而暴露之供體半導體晶圓的 表面平滑’其是相對較粗糙且在邊緣區域具有一特徵臺階 (characteristic step ) ° 該等待拋光之基材的表面不必須是由矽所構成或者僅由矽構 成。它們可例如為由一 IH_v化合物半導體(例如砷化鎵)所構成 的層’或由一矽與鍺的合金(SixGeix)所構成的層。 其他例子為磷化銦、氮化鎵和鋁_鎵砷化物的層。此類層目前係 相當受到關注的,尤其對於「發光二極體(Lighting Emitting Diodes=LEDs)」的生產。
SixGei_x層的表面通常係以一圖案為特徵,稱為「交叉影線(cr〇ss hatch)」且係因位錯而引起的,且原則上必須在於該表面上沉積一 或多個其他層之前使其平滑。 13 201017745 如果具有鍺或SixGei_x層的基材欲根據本發明拋光,那麼該拋光 劑懸浮液或該拋光劑溶液(或者二者)可含有一氧化劑作為其他 添加劑。 適合的氧化劑為過氧化氫(h2o2)和臭氧(03)。添加它們會使 鍺轉化為一水溶性化合物。 沒有添加它們,則在拋光的過程中可能會形成含有鍺的顆粒, 其會劃傷該經拋光之表面。 具有一大直徑的基材,例如直徑為300毫米的矽半導體晶圓或 ❹ 者尤其是直徑為450毫米的矽半導體晶圓,係根據本發明而個別 地被拋光。在正面和背面上都依順序實施各個拋光步驟(至少4 個根據本發明方法的步驟a)、b)、c)和d))。 本發明並未涉及在相同時間内同時拋光正面和背面(DSP)。根 據本發明,在各個加工步驟中僅分別加工半導體晶圓的一面。 藉助於「拋光頭」,該等半導體晶圓係實質上被加壓,使得該待 拋光之側表面與放置在一拋光板上的該拋光墊相對。 拋光頭亦具有一「卡環(retainer ring )」,其側向圈住該基材’ 並防止其在拋光期間自拋光頭滑脫。 在現代的拋光頭中,背向該拋光頭之半導體晶圓的側表面承載 在一彈性膜上,該彈性膜係傳送所施加的拋光壓力。該膜為一視 需要之細分室系統的一元件,其形成一氣體或液體墊。 然而,在有些使用中的拋光頭中,係以一彈性背襯(背襯墊) 取代該膜。此彈性背襯通常係施用於一牢固製造的板(背襯板) 14 201017745 在該背襯塾和該晶圓背面之間,-空氣塾可任選地在該晶圓 背面的各個區域產生。此外,也有些使用中的拋光頭中,該晶圓 係藉助於所謂的「樣板(template)」’即藉助於—背襯板及一施用 於一彈性背襯(背襯墊)上的卡環來進行拋光。使用具有一限定 厚度之卡環’以使該晶圓在拋光期間可保持其在該載具中的位 置。此卡環的厚度可經選擇,以使其比該晶圓本身厚(以「凹陷 型晶圓(recessed wafer )」來描述),或者更薄(在此情況下,係 使用術語「突起型晶圓(projecting wafer)」。 ® 該基材之拋光係藉由旋轉該拋光頭和該拋光墊,同時在該基材 和該拋光墊之間提供一拋光劑來進行。 此外,該拋光頭亦可在該拋光墊上轉換移動,從而實現該拋光 蟄表面的更廣泛使用。 再者,本發明的方法在單板拋光機和多板拋光機上均可妥善地 進行。 較佳係使用多板拋光機,其較佳具有兩個、尤佳具有三個拋光 ® 板和拋光頭。 亦可使用不同的拋光墊和不同的拋光劑。 在本發明方法中,在步驟a)和b)中分別使用一拋光墊’其含 有一固定在該拋光墊中之研磨劑(FAP或FA墊)。 適合的研磨劑包含例如鈽、鋁、矽或鍅元素之氧化物的顆粒’ 以及例如碳化矽、氮化硼和金剛石之堅硬物質的顆粒。 特別適合的拋光墊具有一透過複雜的微結構而賦予的表面形 15 201017745 貌。舉例而言,這些微結構(柱(p0StS))具有一含圓柱形或多邊 形截面之柱狀,或者這些微結構具有棱錐體(pyramids)或截棱錐 體(pyramid frustums )的形狀。 此類拋光墊係商業可購得的,且可由例如3M Corp.,USA提供 (例如來自3M的「ESP 001」)。此類拋光塾的更詳細說明係例如 包含於 WO 92/13680 A1 及 US 2005/227590 A1 中。 在步驟c )中’較佳係使用一材料拋光塾。舉例言之,來自 & Haas之SUBATM範圍的抛光勢係適用於此、例如SUBATM 1250 (材料墊)、或例如來自Rodel®的SPM 3100之典型的CMP拋光 墊(精整墊)。然而,亦可為本發明方法之步驟b)中的一 FAP拋 光墊’即不同於材料拋光墊和CMP拋光墊之一含有固定研磨劑的 抛光塾。 加工步驟b)和c)因此可使用相同的拋光墊,或者也可使用不同 的拋光墊。在步驟c)中,例如可使用一 FAP拋光墊。然而,其 亦較佳係使用一CMP拋光墊。 在步驟d)中係使用一 CMP拋光墊,例如來自R〇del®的SPM 3100 ’其不含有固定研磨劑。步驟d)係對應於一傳統CMP拋光 步驟。該CMP拋光墊可透過標準拋光調節而調節。例如,來自 KINIC的鑽石整形器(diamond dresser)可適用於此。 [實施例] 例示性之實施態樣係使用一來自3M Corp., USA的FAP墊,其 具有固定在該FAP墊中之由氧化鈽(Ce02)所製得的研磨劑顆粒 且平均粒徑為0.55微米(ESP 001)。 16 201017745 表1所示為具有所有重要參數之正面拋光的加工順序例子。 該測試係使用一多板拋光機(來自Applied Materials, Inc.的 AMAT Reflection)。 該拋光機包含一 5-區域之膜載具,其可使該載具的壓力量變曲 線在5個區域内係設置為不同的。 表1中所規定之加工參數對於拋光技術領域人員而言係已知 的,以至於在此省略了詳細說明。多數參數係被歸為現有技術, ^ 該等參數(壓力、速度)的最佳化是在本領域技術人員的能力範 圍内。本發明之精髓係在於加工順序和各順序中所分別使用之拋 光墊(FAP或CMP,固定研磨劑:是/否)和拋光劑(溶液、懸浮 液)。 首先在板1上藉由使用一 FA拋光墊和一拋光劑溶液(碳酸鉀 (K2C03))來進行一材料拋光步驟。隨後於該相同之拋光板上進 行一平滑步驟,同樣地係使用一 FAP墊,但是使用一拋光劑懸浮 液。 在板2和板3上所進行之步驟3和4係對應傳統的CMP步驟。 表1 抛光板 板1 板2 板3 步驟順序 材料 (步驟1) 平滑 (步驟2) 平滑 (步驟3) 平滑 (步驟4) 膜載具區域 1至5的壓 力量變曲線 [磅/平方英 寸] 4.1/3.2/ 3.4/ 4.0/4.0 4.1/3.2/ 3.4/4.0/ 4.0 4.1/3.2/ 3.4/4.0/ 4.0 4.1/3.2/ 3.4/4.0/ 4.0 17 201017745 卡環施加壓 力[磅/平方 英寸] 7.5 7.5 175~ 7.5 劑 K2C〇3 0.2重量% Glanzox 39001) 0.8重量% Glanzox 3900” 〇·8重量。/。 Glanzox 39001) 0.8重量% 流速[公升/ 分] 0.5 0.5 0.5 0.5 拋光時間 [秒] 33 127 160 160 板/頭速率 [rpm]/rrpml 119/123 119/123 119/123 119/123 墊調節類型 - 原位 原位 整調節單元 的施加壓力 [磅] ~4 '~ 4 墊調節速率 [rpml " Too~~ 100 抛光塾 FAP墊 0.55微米 FAP墊 0.55微米 CMP墊 SPM3100 CMP墊 SPM3100
18 1 ) Glanzox 3900是一拋光劑懸浮液的產品名稱,可自Fujimi Incorporated,Japan購得其濃縮液。該濃縮液之pH值為10.5,含 有約9重量%之膠體Si〇2,其平均顆粒尺寸為3〇奈米至40奈米。 表1中所示之Si02含量以該拋光劑表示。 使用KLA Tencor的Nanomapper®儀器來研究奈米形貌。此干涉 計係適用於測量一半導體晶圓之正面上的-20奈米和+20奈米之間 的形貌。在該測量期間,該半導體晶圓係放置於一軟且平坦的晶 圓支架(夾盤(chuck ))上。所得之峰-谷(pv )值係經過漁(^ 斯高通滤波器(Gaussian high-pass filter )),並在直徑為2毫米之 圓上分析(此外,亦在直徑為10毫米之圓上分析)峰谷偏差。在 THA分析(臨界高度分析(threshold height analysis))中,細節 201017745 凊參半導體工業標準(SEMI Standard) M43,最後從所有pv值的 分佈來計算出3-Σ PV值’作為一所稱之THA值。 根據本發明所拋光之晶圓可提供1〇奈米或更好的Tha值。當 使用表1所規定之拋光參數時,可獲得51奈米之THA值。該分 析範圍係對應於刖述之直後為2毫米的圓。此THa值通常亦稱為 THA-2值,使其可明顯看出係使用2毫米之小分析窗。該參數的 其他改良可預期將從拋光方法的最佳化而得到。 根據本發明所拋光之半導體晶圓因此具有_ 1奈米至1〇奈米之 奈米形貌,較佳為1奈米至5奈米之奈米形貌,該奈米形貌係以 THA-2表示。 藉助於第1圖,以下將解釋透過改善所稱「部分位置」之局部 平坦度而改善該邊緣幾何。 第1圖所示為在該等部分位置所發現之SFQR值的分佈(頻 率),其一為一實施本發明方法之前的晶圓,另一種情況為已根據 本發明拋光後之該晶圓。 研究一直徑為300毫米之單晶石夕之經DSP拋光的晶圓。為了證 實本發明方法於該邊緣幾何方面之影響’對相同的晶圓進行正面 的相應拋光,為此而使用以下參數(參見表1中之步驟順序广 -板卜其具有FAP塾:步驟1 : 33秒,僅k2c〇3溶液(〇.2重 量% );接著步驟2 : 8秒,Glanzox (二氧化發溶膠)。 -板2和3’其具有無光霧抛光塾(CMP「spm 3100」)且僅具 有Glanzox作為拋光劑;在各個情況下43秒。 在整個分佈中,可發現約0.01微米之顯著改善。該等部分位置 19 201017745 之SFQRmax亦約改善了這個量。 本發明之方法因此係適用於改善邊緣區域之局部幾何。 【圖式簡單說明】 第1圖所示為在部分位置所發現之SFQR值的分佈(頻率),其 申之一為一實施本發明方法之前的晶圓,另一種情況為該晶圓已 根據本發明方法拋光之後。 【主要元件符號說明】 (無)

Claims (1)

  1. 201017745 七、申請專利範圍: 1. 一種拋光半導體晶圓兩面的方法’其包含以下規定順序之步 驟: a) 在一拋光墊上拋光該半導體晶圓之背面,該拋光墊含 有一固定在該拋光墊中之研磨劑,在該拋光步驟期間、在該 半導體晶圓之背面和該拋光墊之間引入一不含固體之拋光劑 溶液; b) 在一拋光墊上材料拋光(stock polishing)該半導體晶 ® 圓之正面,該拋光墊含有一固定在該拋光墊中之研磨劑,在 該拋光步驟期間、在該半導體晶圓之正面和該拋光墊之間引 入一不含固體之拋光劑溶液; c) 藉由在·^拋光墊上拋光該半導體晶圓之正面而自該半 導體晶圓之正面除去微粗糙度和微損傷,在該拋光步驟期 間、在該半導體晶圓之正面和該抛光塾之間引入一含有研磨 劑之抛光劑懸洋液,以及 ❹ d)藉由在一拋光墊上拋光該半導體晶圓之正面而精整拋 光(finish polishing)該半導體晶圓之正面,該拋光塾不含有 固定在該拋光墊中之研磨劑,在該拋光步驟期間、在該半導 體晶圓之正面和該拋光塾之間引入一含有研磨劑之拋光劑懸 浮液。 2·如請求項1所述之方法,其中步驟a)和b)之該拋光劑溶液 為水或為以下化合物之水溶液:碳酸鈉(NazCO3)、碳酸钟 (K2C03)、氫氧化鈉(NaOH)、氫氧化鉀(K0H)、氫氧化 銨(NH4〇H)、四曱基氫氧化銨(TMAH)或前述之任何混合 21 201017745 物。 3. 如請求項2所述之方法,其中該拋光劑溶液ipH值為1〇至 1 2 ’且該拋光劑溶液中之該等化合物的比例為〇〇 1重量%至 10重量。/。。 4. 如請求項1至3中任一項所述之方法,其中在步驟b)和c) 之間、在一拋光墊上進行一另外的拋光步驟,該拋光墊含有 一固定在該拋光墊中之研磨劑,在該拋光步驟期間、在該半 導體aa圓之正面和該拋光替之間引入一含有研磨劑之拋光劑 懸洋液。 0 5,如請求項1至3中任一項所述之方法,其中步驟e)和d)之 該抛光劑懸浮液中之該研磨劑的比例為0.25重量%至20重量 %。 6. 如請求項1至3中任一項所述之方法,其中步驟和d)之 該拋光劑懸浮液中之該研磨劑的比例為〇.25重量%至丨重量 %。 7. 如凊求項6所述之方法,其中該研磨劑之平均顆粒尺寸為5 奈米至300奈米。 @ •如凊求項7所述之方法,其令該研磨劑之平均顆粒尺寸為5 奈米至50奈米。 9. 如請求項1至3中任-項所述之方法,其中該拋光劑懸浮液 t之該研磨劑係由鋁、鈽或矽元素之氧化物中的一或多種所 構成。 10, 如請求項9所述之方法,其中該拋光劑懸浮液含有膠體分散 ^ 乳化碎。 22 201017745 11. 如請求項1至3中任一項所述之方法,其中該拋光劑懸浮液 之pH值為9至11.5。 12. 如請求項1至3中任一項所述之方法,其中該拋光劑懸浮液 之pH值係透過選自碳酸納(Ν&2〇〇3 )、碳酸钟(K2CO3 )、鼠 氧化鈉(NaOH)、氳氧化鉀(ΚΟΗ)、氫氧化銨(ΝΗ4ΟΗ)、 四甲基氫氧化銨(ΤΜΑΗ)或該等化合物之任何混合物之添 加劑來調節。
    13. 如請求項1至3中任一項所述之方法,其中步驟a)和b)中 所用之拋光墊含有研磨劑,該等研磨劑係選自元素鈽、鋁、 矽或锆之氧化物的顆粒,或係堅硬物質之顆粒。 14. 如請求項13所述之方法,其中該堅硬物質係氮化矽、氮化硼 或鑽石。 15. 如請求項1至3中任一項所述之方法,其中在步驟c)中係使 用一不含有固定研磨劑之拋光墊。 16. 如請求項1至3中任一項所述之方法,其中在步驟c)中係使 用一含有固定研磨劑之拋光墊。 17. 如請求項16所述之方法,其中係如請求項13使用一具有研 磨劑之拋光墊。 18. 如請求項1至3中任一項所述之方法,其中該半導體晶圓係 一直徑為300毫米或以上之矽晶圓。 19. 一種直徑為300毫米或以上之矽晶圓,其包含一經請求項1 所述之方法拋光的正面和背面,以及一以THA-2 (半導體工 業標準(SEMI Standard) M43)表示之1奈米至10奈米之正 面奈米拓撲。 23 201017745 20. 如請求項19所述之矽晶圓,其具有一 1奈米至5奈米之正面 奈米拓撲-以 THA-2 (SEMI Standard M43)表示。 21. 如請求項19或20所述之矽晶圓,其直徑為450毫米。
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Families Citing this family (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR101133355B1 (ko) * 2009-10-28 2012-04-06 실트로닉 아게 반도체 웨이퍼의 연마 방법
DE102009051007B4 (de) 2009-10-28 2011-12-22 Siltronic Ag Verfahren zum Polieren einer Halbleiterscheibe
DE102009057593A1 (de) 2009-12-09 2011-06-16 Siltronic Ag Verfahren zur Herstellung einer Halbleiterscheibe
DE102011083041B4 (de) 2010-10-20 2018-06-07 Siltronic Ag Stützring zum Abstützen einer Halbleiterscheibe aus einkristallinem Silizium während einer Wärmebehandlung und Verfahren zur Wärmebehandlung einer solchen Halbleiterscheibe unter Verwendung eines solchen Stützrings
JP5750877B2 (ja) * 2010-12-09 2015-07-22 株式会社Sumco ウェーハの片面研磨方法、ウェーハの製造方法およびウェーハの片面研磨装置
JP5614397B2 (ja) * 2011-11-07 2014-10-29 信越半導体株式会社 両面研磨方法
KR102028217B1 (ko) * 2011-11-25 2019-10-02 가부시키가이샤 후지미인코퍼레이티드 연마용 조성물
JP6077209B2 (ja) * 2011-11-25 2017-02-08 株式会社フジミインコーポレーテッド 研磨用組成物
DE102011089362B4 (de) * 2011-12-21 2014-01-16 Siltronic Ag Verfahren zum Polieren eines Substrates aus Halbleitermaterial
JP6100002B2 (ja) * 2013-02-01 2017-03-22 株式会社荏原製作所 基板裏面の研磨方法および基板処理装置
DE102013205448A1 (de) 2013-03-27 2014-10-16 Siltronic Ag Verfahren zum Polieren eines Substrates aus Halbleitermaterial
DE102013213838A1 (de) 2013-07-15 2014-09-25 Siltronic Ag Verfahren zum Polieren eines Substrates aus Halbleitermaterial
DE102015224933A1 (de) * 2015-12-11 2017-06-14 Siltronic Ag Monokristalline Halbleiterscheibe und Verfahren zur Herstellung einer Halbleiterscheibe
JP7125386B2 (ja) * 2017-03-23 2022-08-24 株式会社フジミインコーポレーテッド 研磨用組成物
DE102018221922A1 (de) 2018-12-17 2020-06-18 Siltronic Ag Verfahren zur Herstellung von Halbleiterscheiben mittels einer Drahtsäge, Drahtsäge und Halbleiterscheibe aus einkristallinem Silizium

Family Cites Families (34)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5152917B1 (en) 1991-02-06 1998-01-13 Minnesota Mining & Mfg Structured abrasive article
US5860848A (en) * 1995-06-01 1999-01-19 Rodel, Inc. Polishing silicon wafers with improved polishing slurries
JP3510036B2 (ja) 1996-02-22 2004-03-22 株式会社ルネサステクノロジ 半導体装置の製造方法
JP2000315665A (ja) * 1999-04-29 2000-11-14 Ebara Corp 研磨方法及び装置
US6722962B1 (en) * 1997-04-22 2004-04-20 Sony Corporation Polishing system, polishing method, polishing pad, and method of forming polishing pad
KR100243292B1 (ko) * 1997-05-07 2000-02-01 윤종용 연마액의ph를조정하는반도체제조를위한화학적기계연마방법
JPH11204467A (ja) 1998-01-19 1999-07-30 Sony Corp 半導体製造装置および半導体装置の製造方法
US5897426A (en) 1998-04-24 1999-04-27 Applied Materials, Inc. Chemical mechanical polishing with multiple polishing pads
JP3858462B2 (ja) * 1998-07-30 2006-12-13 株式会社日立製作所 半導体装置の製造方法
JP2000080350A (ja) * 1998-09-07 2000-03-21 Speedfam-Ipec Co Ltd 研磨用組成物及びそれによるポリッシング加工方法
US6270395B1 (en) * 1998-09-24 2001-08-07 Alliedsignal, Inc. Oxidizing polishing slurries for low dielectric constant materials
KR20010039590A (ko) * 1999-04-29 2001-05-15 마에다 시게루 작업대상물을 폴리싱하는 방법 및 장치
US6331135B1 (en) * 1999-08-31 2001-12-18 Micron Technology, Inc. Method and apparatus for mechanical and chemical-mechanical planarization of microelectronic substrates with metal compound abrasives
JP3439402B2 (ja) 1999-11-05 2003-08-25 Necエレクトロニクス株式会社 半導体装置の製造方法
US20010039101A1 (en) * 2000-04-13 2001-11-08 Wacker Siltronic Gesellschaft Fur Halbleitermaterialien Ag Method for converting a reclaim wafer into a semiconductor wafer
US6387289B1 (en) * 2000-05-04 2002-05-14 Micron Technology, Inc. Planarizing machines and methods for mechanical and/or chemical-mechanical planarization of microelectronic-device substrate assemblies
JP3950622B2 (ja) 2000-10-25 2007-08-01 スピードファム株式会社 ナノトポグラフィ評価用基準ウェーハとその製造方法
KR100842473B1 (ko) * 2000-10-26 2008-07-01 신에츠 한도타이 가부시키가이샤 웨이퍼의 제조방법 및 연마장치 및 웨이퍼
DE10054159A1 (de) 2000-11-02 2002-05-16 Wacker Siltronic Halbleitermat Verfahren zur Montage von Halbleiterscheiben
JP3617665B2 (ja) 2001-01-29 2005-02-09 三菱住友シリコン株式会社 半導体ウェーハ用研磨布
JP2002252189A (ja) 2001-02-26 2002-09-06 Mitsubishi Materials Silicon Corp 半導体ウェーハ用研磨液
DE10142400B4 (de) 2001-08-30 2009-09-03 Siltronic Ag Halbleiterscheibe mit verbesserter lokaler Ebenheit und Verfahren zu deren Herstellung
EP1472047A1 (en) 2002-01-17 2004-11-03 Nutool, Inc. Advanced chemical mechanical polishing system with smart endpoint detection
JPWO2003071592A1 (ja) * 2002-02-20 2005-06-16 株式会社荏原製作所 ポリッシング方法および装置
DE10328842B4 (de) * 2003-06-26 2007-03-01 Siltronic Ag Suszeptor für eine chemische Gasphasenabscheidung, Verfahren zur Bearbeitung einer Halbleiterscheibe durch chemische Gasphasenabscheidung und nach dem Verfahren bearbeitete Halbleiterscheibe
JP4608856B2 (ja) 2003-07-24 2011-01-12 信越半導体株式会社 ウエーハの研磨方法
US20050121969A1 (en) * 2003-12-04 2005-06-09 Ismail Emesh Lubricant for wafer polishing using a fixed abrasive pad
US20050227590A1 (en) 2004-04-09 2005-10-13 Chien-Min Sung Fixed abrasive tools and associated methods
JP2006093655A (ja) 2004-08-24 2006-04-06 Disco Abrasive Syst Ltd 研磨液,及び研磨装置
DE102004054566B4 (de) * 2004-11-11 2008-04-30 Siltronic Ag Verfahren und Vorrichtung zum Einebnen einer Halbleiterscheibe sowie Halbleiterscheibe mit verbesserter Ebenheit
JP4820108B2 (ja) 2005-04-25 2011-11-24 コマツNtc株式会社 半導体ウエーハの製造方法およびワークのスライス方法ならびにそれらに用いられるワイヤソー
JP4942516B2 (ja) 2007-03-07 2012-05-30 信越ポリマー株式会社 基板収納容器用の収容槽
JP5037974B2 (ja) 2007-03-14 2012-10-03 株式会社岡本工作機械製作所 研磨加工ステージにおける半導体基板の監視機器および監視方法
DE102007035266B4 (de) * 2007-07-27 2010-03-25 Siltronic Ag Verfahren zum Polieren eines Substrates aus Silicium oder einer Legierung aus Silicium und Germanium

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