SU754412A1 - Устройство для умножения 1 - Google Patents
Устройство для умножения 1 Download PDFInfo
- Publication number
- SU754412A1 SU754412A1 SU701412260D SU1412260D SU754412A1 SU 754412 A1 SU754412 A1 SU 754412A1 SU 701412260 D SU701412260 D SU 701412260D SU 1412260 D SU1412260 D SU 1412260D SU 754412 A1 SU754412 A1 SU 754412A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- digit
- adder
- output
- multiplication
- input
- Prior art date
Links
Landscapes
- Complex Calculations (AREA)
Description
Изобретение относится к вычислительной технике и может быть применено В' цифровых вычислительных машинах и устройствах обработки данных для систем счисления с основанием больше двух. 5
Известны устройства для умножения, в которых сигнал частичного произведения формируется посредством последовательного умножения цифры множителя на все цифры множимого с учетом на ю каждом шаге сигнала переноса от предыдущего шага умножения одноразрядных цифр, либо при формировании сигналов произведений одноразрядных цифр запоминают все сигналы переноса произве- 15 дений одноразрядных цифр и затем суммируют их с сигналом накоплений суммы частичных произведений [ϊ] и [2].
Недостаток устройств - недостаточное быстродействие, обусловленное на- 20 личием операций с сигналами переносов.
Известно устройство для умножения, содержащее регистры множимого и мно2
жителя, накапливающий сумматор для накопления частных произведений и блок управления, выходы которого соединены с управляющими входами регистров и накапливающего сумматора. Умножения осуществляется в· произвольной системе счисления. В таком устройстве в каждом такте умножения производится несколько суммирований накопленной суммы частичных произведений с множимым, число таких сложений соответствует значению очередной цифры множителя [3].
Недостаток устройства - низкое быстродействие.
Наиболее близким по технической сущности к предлагаемому является устройство для умножения, содержащие одноразрядные узлы умножения, одноразрядные узлы сложения, образующие блоки формирования частичных произведений и суммирования частичных произведений [4].
Недостатком такого устройства является большое количество оборудования.
3 754412
Цель изобретения - сокращение количества оборудования.
Для достижения поставленной цели устройство для умножения, содержащее регистры множимого и множителя, одно- 5 разрядные узлы умножения, комбинационный сумматор и блок управления,, причем первый вход каждого одноразрядного узла умножения соединен с выходом соответствующего разряда регистра множимого, ю второй вход соединен с выходом первого разряда регистра множителя, первый выход ί -го одноразрядного узла умножения ( ί -1, ... П , где Π - разрядность множимого) подключен к первому 15 входу соответствующего разряда комбинационного сумматора, второй выход } -го одноразрядного узла умножения (} =2,..., П ) подключен ко второму входу () -1)-го разряда комбинационного ' 20
сумматора, выходы блока управления соединены с управляющими входами регистров множимого и множителя и одноразрядных узлов умножения, содержит накапливающий сумматор, вход пер- 25 вого разряда которого соединен со вторым выходом первого одноразрядного узла умножения, входы последующих разрядов накапливающего сумматора соединены с выходами комбинационного 39 сумматора, управляющий вход накапливающего сумматора соединен с выходом блока управления.
На чертеже изображена структурная схема устройства. 35
Устройство для умножения содержит регистры 1 и 2 множителя и множимого, накапливающий сумматор 3, одноразрядные узлы 4 умножения, комбинационный сумматор 5 и блок 6 управления. Выход 49 кажого из И- разрядов регистра ι 2 множимого подключен к первому входу соответствующего одноразрядного узла 4 умножения, второй вход которого соединен с выходом первого разряда ре- 45 гистра 1 множителя (старшего или младшего, в зависимости от принятого вари*1' анта выполнения операции умножения начиная со старших или младших разрядов множителя) . Каждый одноразрядный узел 4 умножения имеет выход сигнала старшего разряда произведения и выход сигнала младшего разряда. Входы каждого разряда комбинационного сумматора 5 соединил,! с выходом сигнала старшего разряда соот- 5$ ветствующего одноразрядного узла 4 умножения и с выходом сигнала младшего разряда произведения одноразрядного узла 4 умножения, смежного с
предыдущим и находящегося со стороны старших разрядов множителя. Вход первого (младшего) разряда накапливающего сумматора 3 соединен с выходом: сигнала младшего разряда первого одноразрядного узла 4 умножения. Входы остальных разрядов накапливающего сумматора 3 соединены с выходами разрядов комбинационного сумматора 5. Выходы блока 6 управления соединены с управляющими входами регистров 1, 2 множителя и множимого, накапливающего сумматора 3 и одноразрядных узлов 4 умножения.
Линия, соединяющая выход одного блока со, входом другого, обозначает столько проводов, сколько необходимы для представления всех цифр в заданной системе счисления и заданном способе представления сигналов шфр, при. чем все соединения выполнены так, как этого требует данное представление сигналов цифр.
Цепи сдвига в регистрах, цепи приема информации в регистры, источники питания и. т.д. на чертеже опущены.
Не рассмотрены также конкретные схемы одноразрядных узлов умножения, сумматоров и т.д. на основании предположения, что их конструкция выбрана в соответствии с теми требованиями, которые предъявлены к устройству. ,
Устройство'работает следующим образом.
Сигналы исходных чисел помещают в регистры 1 и 2, Затем блок 6 управления подает команду формирования сигналов одноразрядных произведений в узлах
4. Эти сигналы поступают на входы разрядов комбинационного сумматора 5 и после окончания перекосов блок 6 управления подает сигнал на суммирование сигналов с выходов сумматора 5 с сигналами накопленной суммы частичных произведений в накапливающем сумматоре
3. По окончании суммирования в накапливающем сумматоре 3, блок 6 управления сдвигает сигналы содержимого регистра 1 и накапливающего сумматора 3 (направление сдвигов определяется по выбранному варианту выполнения умножения) и цикл повторяется до тех пор, пока не будет отработан сигнал последней цифры в регистре 1.
Количество одноразрядных узлов 4
умножения может быть и меньше п, но
при этом соответственно будет снижена
скорость работы устройства; так как
формирование сигнала частичного про5 754412 6
изведения будет выполняться за несколь ко приемов. В этом случае в регистр множимого необходимо ввести регистр цепи сдвига.
Под одноразрядной цифрой подразумевается одна или несколько цифр в системе $ счисления с основанием у ·
За счет введения в предлагаемое устройство накапливающего сумматора, который осуществляет потахтное суммирование частичных произведений, коли- ю чество оборудования в данном устройстве сокращено по сравнению с известным.
Claims (1)
- Формула изобретения ,5Устройство для умножения, содержащее регистры множимого и множителя, одноразрядные узлы умножения, комбинационный сумматор и блок управления, 20 причем первый вход каждого одноразрядного узла умножения соединен с выходом соответствующего разряда регистрра множимого, второй вход соединен с выходом первого разряда регистра мно- 25 жителя, первый выход к -го одноразрядного узла умножения ( < -1,.., η >где П - разрядность множимого) подключен к первому входу соответствующего разряда комбинационного сумматора, вто-30 рой выход ) -го одноразрядного узлаумножения ( ϊ -2,... и ) подключен ко второму входу -1)-го разряда комбинационного сумматора, выходы блока управления соединены с управляющими входами регистров множимого и множителя й одноразрядных узлов умножения, отличающееся тем, что, с целью сокращения количества оборудования, устройство содержит накапливающий сумматор, вход первого разряда которого соединен со вторым выходом первого одноразрядного .узла умножения, -входы последующих разрядов накапливающего сумматора соединены с выходами комбинационного сумматора, управляющий вход накапливающего сумматора соединен с выходом блока управления.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU1412260A SU383044A1 (ru) | 1970-03-10 | 1970-03-10 | Устройство умножения последовательного |
Publications (1)
Publication Number | Publication Date |
---|---|
SU754412A1 true SU754412A1 (ru) | 1980-08-07 |
Family
ID=20450626
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU701412260D SU754412A1 (ru) | 1970-03-10 | 1970-03-10 | Устройство для умножения 1 |
SU1412260A SU383044A1 (ru) | 1970-03-10 | 1970-03-10 | Устройство умножения последовательного |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU1412260A SU383044A1 (ru) | 1970-03-10 | 1970-03-10 | Устройство умножения последовательного |
Country Status (1)
Country | Link |
---|---|
SU (2) | SU754412A1 (ru) |
-
1970
- 1970-03-10 SU SU701412260D patent/SU754412A1/ru active
- 1970-03-10 SU SU1412260A patent/SU383044A1/ru active
Also Published As
Publication number | Publication date |
---|---|
SU383044A1 (ru) | 1973-05-25 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU754412A1 (ru) | Устройство для умножения 1 | |
US4996527A (en) | Pipelined residue to mixed base converter and base extension processor | |
US3373269A (en) | Binary to decimal conversion method and apparatus | |
JPS6226723B2 (ru) | ||
US4570056A (en) | Automatically adaptable radix conversion system for use with variable length input numbers | |
SU1756887A1 (ru) | Устройство дл делени чисел в модул рной системе счислени | |
JPH0869372A (ja) | 2進乗算器 | |
SU1667059A2 (ru) | Устройство дл умножени двух чисел | |
SU363119A1 (ru) | Регистр сдвига | |
SU1137479A1 (ru) | Устройство дл преобразовани по функци м Уолша | |
SU985783A1 (ru) | Устройство дл умножени п-разр дных чисел | |
SU888110A1 (ru) | Последовательное множительное устройство | |
SU1179322A1 (ru) | Устройство дл умножени двух чисел | |
SU577528A1 (ru) | Накапливающий сумматор | |
SU1481747A1 (ru) | Устройство дл умножени двоичных чисел | |
SU1667061A1 (ru) | Устройство дл умножени | |
SU734669A1 (ru) | Преобразователь правильной двоичной дроби в двоично-дес тичную дробь и целых двоично-дес тичных чисел в двоичные | |
SU1035600A1 (ru) | Устройство дл умножени | |
SU541168A1 (ru) | Устройство дл возведени двоичных чисел в степень | |
SU583433A1 (ru) | Устройство дл умножени | |
RU1791813C (ru) | Устройство дл делени чисел на константу типа 2 @ + 1 | |
SU1262480A1 (ru) | Устройство дл делени | |
SU409222A1 (ru) | Устройство для умножения | |
SU717754A1 (ru) | Преобразователь двоично-дес тичных чисел в двоичные | |
SU1283979A1 (ru) | Преобразователь двоично-дес тичного кода в двоичный |