KR970076274A - 마이크로컴퓨터 - Google Patents

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키타오카 타카시
미쓰비시 덴키 가부시끼가이샤
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Abstract

명령을 프리패치하는 큐 버퍼가 제공되어 있으면, ROM내의 프로그램에서 발생된 버그를 제거하는 메카니즘이 올바르게 수행하지 못하는 문제점이 있다.
따라서, 본 발명의 마이크로컴퓨터에 따른 비교 회로(46)는 레지스터(44)에 저장되어 있는 어드레스 정보와 어드레스(48)상의 어드레스 데이타를 비교한다. 래치 회로(14)는 비교 회로(46)로부터의 정합 신호에 의해 세트 상태로 되고, 분리 발생 신호(68) 또는 JMP 명령 코드 종료 신호(70)에 의해 리셋 상태로 된다. 리셋 상태에 의해, 데이타는 JMP 명령 코드 ROM(120)로 부터 데이타 버스(50)로 출력되지 못하게 된다.

Description

마이크로컴퓨터
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1실시예에 의한 제공된 마이크로컴퓨터의 구성을 도시한 도면.

Claims (3)

  1. 제1ROM에 저장된 프로그램의 각각의 명령을 CPU의 실행 이전에 프리패치(prefetching)하고, 이와 동시에 상기 CPU가 분기 명령을 실행했음을 나타내는 분기 발생 신호에 의해 클리어(clear)되는 큐 버퍼(a queue buffer)와, 상기 제1ROM의 어드레스 공간 이외의 어드레스 공간에 분기하는 명령을 저장하는 제2ROM과, 어드레스 정보를 저장하는 어드레스 정보 저장부가 구비된 마이크로컴퓨터에 있어서, 상기 어드레스 정보 저장부에 저장되어 있는 어드레스 정보와 상기 큐버퍼의 프로그램 카운터(a program counter)의 값을 비교해서, 그 결과가 일치되는 경우 상기 제2ROM으로부터 데이타 출력을 허용하고 이와 동시에 상기 제1ROM으로부터의 데이타 출력을 차단하고, 상기 분기 발생 신호 또는 상기 제2ROM이 명령을 출력했음을 나타내는 명령 코드 종료 신호를 입력하여 상기 제1ROM으로부터의 데이타 출력을 허용하고 이와 동시에 상기 제2ROM으로부터의 데이타 출력을 차단하는 ROM 출력 스위칭부(a ROM－output switching unit)를 포함하는 것을 특징으로 하는 마이크로컴퓨터.
  2. 제1항에 있어서, 상기 ROM 출력 스위칭부는, 상기 어드레스 정보 저장부에 저장되어 있는 어드레스 정보와 어드레스 버스상의 어드레스 데이타를 비교하는 비교 회로와, 상기 비교 회로로부터의 정합 신호에 의해 세트 상태로 되고, 분기 발생 신호 또는 명령 코드 종료 신호에 의해 리셋 상태로 되는 래치 회로를 포함하는 것을 특징으로 하는 마이크로컴퓨터.
  3. 제1ROM에 저장된 프로그램의 각각의 명령을 CPU의 실행 이전에 프리 패치하고 이와 동시에 상기 CPU가 분기 명령을 실행했음을 나타내는 분기 발생 신호에 의해 클리어되는 큐 버퍼와, 상기 제1ROM 어드레스 공간 이외의 어드레스 공간에 분기하는 명령을 저장하는 제2ROM과, 어드레스 정보를 저장하는 어드레스 정보 저장부와, 상기 어드레스 정보 저장부에 저장되어 있는 어드레스 정보와 CPU의 프로그램 카운터의 값을 비교하는 비교 회로가 구비된 마이크로컴퓨터에 있어서, 상기 비교 회로가 상기 어드레스 정보와 상기 CPU의 프로그램 카운터의 값이 정합했음을 나타내는 정합 신호를 출력하면 세트 상태로 되고, 제2ROM이 명령을 출력했음을 나타내는 명령 코드 종료 신호에 의해 리셋 상태로 되는 래치 회로와, 상기 래치 회로가 셋트 상태인 경우 상기 큐 버퍼로부터의 명령이 상기 CPU에 입력되는 것을 차단하고 이와 동시에 상기 제2ROM으로부터의 명령이 상기 CPU에 입력되도록 하는 스위칭 회로를 포함하는 것을 특징으로 하는 마이크로컴퓨터.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019970000104A 1996-05-31 1997-01-06 마이크로컴퓨터 KR100252432B1 (ko)

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