KR970071443A - 액정표시장치의 출력인에이블 신호 발생회로 - Google Patents
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Abstract
이 발명은 액정표시장치(LCD : Liquid Crystal Display)의 출력인에이블(Output Enable) 신호 발생회로에 관한 것으로서, 카운터부(1); 상기 카운터부(1)의 출력/반전출력 라인을 외부선택신호(S1, S2, S3)에 의해 비트별로 선택할 수 있도록 연결된 멀티플렉싱부(2); 상기 멀티플렉싱부(2)의 출력을 논리곱하는 논리곱소자(31)와 상기 카운터부(1)의 출력 중 비트별로 미리 지정된 소정의 신호를 반전논리곱하는 반전논리곱소자(32)로 구성된 디코딩부(3) 및; 상기 논리곱소자(31)의 출력을 세트단에 입력하고 상기 반전논리곱소자(32)의 출력을 리세트단에 입력하여 상기 세트단 신호와 세트단 신호에 의해 펄스폭이 결정되는 출력인에이블 신호를 생성하는 플립플롭(4)을 포함하며, 선택신호를 조절함으로써 상기 플립플롭(4)의 세트 타이밍을 제어할 수 있도록 하여 상기 카운터부(1) 클럭신호의 주파수가 변화하더라도 플립플롭(4)에서 생성되는 출력인에이블 신호의 펄스폭을 의도하는 대로 유지시킬 수 있는 액정표시장치의 출력인에이블 신호 발생회로를 제공할 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 이 발명의 제1실시예에 따른 액정표시장치의 출력인에이블 신호 발생회로, 제2도는 상기 제1도의 카운터부를 상세히 도시한 회로도, 제3도는 상기 제1도의 멀티플렉싱부를 상세히 도시한 회로도, 제4도 및 제5도는 임의의 선택신호에 따른 제1도 회로도의 각부 파형도.
Claims (6)
- 클럭신호와 리세트신호에 따라 소정 값까지의 카운트 동작을 반복하며, 소정 수의 출력 비트별로 구비된 출력/반전출력 라인을 통해 카운트된 데이타 및 그의 반전 데이타를 출력하는 카운터부와; 선택신호에 따라 상기 카운터부의 각 출력 비트별로 상기 출력/반전출력 라인 중의 하나를 선택하며, 각 선택된 라인의 데이타를 출력하는 멀티플렉싱부와; 상기 멀티플렉싱부의 출력 비트라인의 데이타를 입력하고, 이 입력데이타를 논리곱하여 출력인에이블 신호의 세트점을 결정하기 위한 제1펄스파형을 생성하고, 상기 카운터부의 비트별로 미리 지정된 출력라인의 데이타를 입력하고, 이 입력데이타를 반전논리곱하여 출력인에이블 신호의 리세트점을 결정하기 위한 제2펄스파형을 생성하는 디코딩부와; 상기 디코딩부의 제1펄스파형이 세트단에 입력되고, 제2펄스파형이 리세트단에 입력되도록 연결되며, 상기 세트단의 신호와 리세트단의 신호에 의해 세트 상태와 리세트 상태를 반복하는 출력인에이블 신호를 생성하는 플립플롭을 포함하여 이루어지는 액정표시장치의 출력인에이블 신호 발생회로.
- 제1항에 있어서, 상기한 카운터부는 J, K입력단자, 클럭단자, 출력단자 및 반전출력단자를 가지는 적어도 두개 이상의 JK-플립플롭으로 구성되며, 각 JK-플립플롭은 직렬 연결되고, 각 JK-플립플롭의 출력단과 반전출력단 신호는 상기 각 비트별로 구비된 출력/반전출력 라인에 제공되는 액정표시장치의 출력인에이블 신호 발생회로.
- 제1항 또는 제2항에 있어서, 상기한 멀티플렉싱부는 선택신호의 갯수와 동일한 수의 멀티플렉서로 구성되며, 각 멀티플렉서에서는 대응하는 선택신호 중의 하나에 의해 입력신호의 선택동작이 제어되는 액정표시장치의 출력인에이블 신호 발생회로.
- 제3항에 있어서, 상기한 디코딩부는 상기 멀티플렉싱부의 출력 비트라인의 데이타를 입력하고, 상기 입력신호의 논리곱연산을 수행하며, 그 결과로 얻어지는 신호를 상기 플립플롭의 세트단에 제공하도록 연결되는 논리곱소자와; 상기 카운터부의 비트별로 미리 지정된 출력라인의 데이타를 입력하고, 상기 입력신호의 반전논리곱연산을 수행하며, 그 결과로 얻어지는 신호를 상기 플립플롭의 리세트단에 제공하도록 연결되는 반전논리곱소자로 구성되는 액정표시장치의 출력인에이블 신호 발생회로.
- 클럭신호와 리세트신호에 따라 소정 값까지의 카운트 동작을 반복하며, 소정 수의 출력 비트별로 구비된 출력/반전출력 라인을 통해 카운트된 데이타 및 그의 반전 데이타를 출력하는 카운터부와; 선택신호에 따라 상기 카운터부의 각 출력 비트별로 상기 출력/반전출력 라인 중의 하나를 선택하며, 각 선택된 라인의 데이타를 출력하는 멀티플렉싱부와; 상기 카운터부의 비트별로 미리 지정된 출력라인의 데이타를 입력하고, 이 입력데이타를 논리곱하여 출력인에이블 신호의 세트점을 결정하기 위한 제1펄스파형을 생성하고, 상기 멀티플렉싱부의 출력 비트라인의 데이타를 입력하고, 이 입력데이타를 반전논리곱하여 출력인에이블 신호의 리세트점을 결정하기 위한 제2펄스파형을 생성하는 디코딩부와; 상기 디코딩부의 제1펄스파형이 세트단에 입력되고, 제2펄스파형이 리세트단에 입력되도록 연결되며, 상기 세트단의 신호와 리세트단의 신호에 의해 세트 상태와 리세트 상태를 반복하는 출력인에이블 신호를 생성하는 플립플롭을 포함하여 이루어지는 액정표시장치의 출력인에이블 신호 발생회로.
- 클럭신호와 리세트신호에 따라 소정 값까지의 카운트 동작을 반복하며, 소정 수의 출력 비트별로 구비된 출력/반전출력 라인을 통해 카운트된 데이타 및 그의 반전 데이타를 출력하는 카운터부와; 제1선택신호에 따라 상기 카운터부의 각 출력 비트별로 상기 출력/반전출력 라인 중의 하나를 선택하며, 각 선택된 라인의 데이타를 출력하는 제1멀티플렉싱부와; 제2선택신호에 따라 상기 카운터부의 각 출력 비트별로 상기 출력/반전출력 라인 중의 하나를 선택하며, 각 선택된 라인의 데이타를 출력하는 제2멀티플렉싱부와; 상기 제1멀티플렉싱부의 출력 비트라인의 데이타를 입력하고, 이 입력데이타를 논리곱하여 출력인에이블 신호의 세트점을 결정하기 위한 제1펄스파형을 생성하며, 상기 제2멀티플렉싱부의 출력 비트라인의 데이타를 입력하고, 이 입력데이타를 반전논리곱하여 출력인에이블 신호의 리세트점을 결정하기 위한 제2펄스파형을 생성하는 디코딩부와; 상기 디코딩부의 제1펄스파형이 세트단에 입력되고, 제2펄스파형이 리세트단에 입력되도록 연결되며, 상기 세트단의 신호와 리세트단의 신호에 의해 세트 상태와 리세트 상태를 반복하는 출력인에이블 신호를 생성하는 플립플롭을 포함하여 이루어지는 액정표시장치의 출력인에이블 신호 발생회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019960010421A KR100188115B1 (ko) | 1996-04-08 | 1996-04-08 | 액정표시장치의 출력인에이블 신호 발생회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019960010421A KR100188115B1 (ko) | 1996-04-08 | 1996-04-08 | 액정표시장치의 출력인에이블 신호 발생회로 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR970071443A true KR970071443A (ko) | 1997-11-07 |
KR100188115B1 KR100188115B1 (ko) | 1999-06-01 |
Family
ID=19455210
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019960010421A KR100188115B1 (ko) | 1996-04-08 | 1996-04-08 | 액정표시장치의 출력인에이블 신호 발생회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100188115B1 (ko) |
-
1996
- 1996-04-08 KR KR1019960010421A patent/KR100188115B1/ko not_active IP Right Cessation
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KR100188115B1 (ko) | 1999-06-01 |
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