KR970008878A - 클럭 스위칭 회로 - Google Patents

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KR970008878A
KR970008878A KR1019950023488A KR19950023488A KR970008878A KR 970008878 A KR970008878 A KR 970008878A KR 1019950023488 A KR1019950023488 A KR 1019950023488A KR 19950023488 A KR19950023488 A KR 19950023488A KR 970008878 A KR970008878 A KR 970008878A
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KR
South Korea
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clock
switching circuit
multiplexer
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nand gate
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KR1019950023488A
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Inventor
윤성희
Original Assignee
김광호
삼성전자 주식회사
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/125—Discriminating pulses
    • H03K5/1252—Suppression or limitation of noise or interference

Abstract

1. 청구 범위에 기재된 발명이 속한 기술분야
클럭 주파수의 변경이 발생되는 글리치 현상을 방지할 수 있는 클럭 스위칭 회로에 관한 것이다.
2. 발명이 해결하려고 하는 기술적 과제
클럭을 사용하는 전자디바이스에 있어서, 특히 클럭 주파수의 변경이 발생되는 글리치 현상을 방지할 수 있는 클럭 스위칭 회로를 제공한다.
3. 발명의 해결방법의 요지
인가되는 클럭과 상기 클럭을 분주한 분주클럭을 선택적으로 출력하는 멀티플렉서를 구비한 클럭 스위칭 회로는 : 상기 멀티플렉서의 출력단에 연결되어, 상기 선택적으로 출력되는 상기 클럭 또는 상기 분주클럭의 펄스 폭이 미리 설정된 폭 이하일 경우에 이를 제거한 후 출력클럭으로써 출력하는 필터링 수단을 가짐을 특징으로 한다.
4. 발명의 중요한 용도
클럭을 사용하는 전자디바이스에 사용된다.

Description

클럭 스위칭 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 클럭 스위칭 회로도, 제4도는 제3도에 따른 동작 타이밍도.

Claims (4)

  1. 인가되는 클럭과 상기 클럭을 분주한 분주클럭을 선택적으로 출력하는 멀티플렉서를 구비한 클럭 스위칭 회로에 있어서 : 상기 멀티플렉서의 출력단에 연결되어, 상기 선택적으로 출력되는 상기 클럭 또는 상기 분주클럭의 펄스폭이 미리 설정된 폭 이하일 경우에 이를 제거한 후 출력클럭으로써 출력하는 필터링 수단을 가짐을 특징으로 하는 회로.
  2. 제1항에 있어서, 상기 클럭 스위칭회로는 상기 분주클럭을 생성하는 T형 플립플롭을 가짐을 특징으로 하는 회로.
  3. 제1항에 있어서, 상기 멀티플렉서는 상기 클럭과 상기 분주클럭을 선택적으로 출력하기 위해 선택단으로 D형플립플롭으로 제공되는 선택신호를 수신하는 것을 특징으로 하는 회로.
  4. 제1항에 있어서, 상기 필터링 수단은, 상기 멀티플렉서의 출력단에 연결된 인버퍼 및 낸드게이트 오아게이트와, 상기 낸드 게이트 및 오아게이트의 타측 입력은 버퍼의 출력이 수신되며, 상기 오아게이트 및 상기 낸드게이트의 출력단에 연결되어 래치동작을 하는 래치와, 상기 래치의 출력을 인버팅하는 인버터로 구성됨을 특징으로 하는 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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