KR970054509A - 박막트랜지스터 제조 방법 - Google Patents
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Abstract
본 발명은 박막 트랜지스터 제조 방법에 있어서; 소오스/드레인용 폴리실리콘막을 형성하고 채널이 형성될 지역의 상기 폴리실리콘막을 식각 제거하는 단계; 전체구조 상부에 채널용 비정질 실리콘막, 게이트 산화막, 게이트용 전도막을 차례로 형성하는 단계; 게이트 마스크를 사용하여 상기 게이트용 전도막, 상기 게이트 산화막 및 상기 비정질 실리콘막을 식각하여 패터닝하여 단계; 및 노출된 상기 폴리실리콘막 상에 소오스/드레인 마스크를 사용하여 소오스/드레인 이온주입을 실시하는 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조 방법에 관한 것으로, 소오스/드레인 층과 채널층을 다른 박막으로 하기 때문에 채널은 얇게 형성하고 소오스/드레인은 두껍게 형성할 수 있어, 소오스/드레인간의 시리즈 저항을 낮추므로서써 박막 트랜지스터의 온/오프 전류 비를 향상시켜 소자의 전기적 특성을 향상시키는 효과가 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2A도 내지 제2D도는 본 발명의 일실시예에 따른 박막 트랜지스터의 제조 공정도.
Claims (2)
- 박막 트랜지스터 제조 방법에 있어서; 소오스/드레인용 폴리실리콘막을 형성하고 채널이 형성될 지역의 상기 폴리실리콘막을 식각 제거하는 단계; 전체구조 상부에 채널용 비정질 실리콘막, 게이트 산화막, 게이트용 전도막을 차례로 형성하는 단계; 게이트 마스크를 사용하여 상기 게이트용 전도막, 상기 게이트 산화막 및 상기 비정질 실리콘막을 식각하여 패터닝하여 단계; 및 노출된 상기 폴리실리콘막 상에 소오스/드레인 이온주입을 실시하는 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제1항에 있어서, 상기 소오스/드레인용 폴리실리콘막은 상기 비정질 폴리실리콘막보다 상대적으로 두껍게 형성하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950062131A KR970054509A (ko) | 1995-12-28 | 1995-12-28 | 박막트랜지스터 제조 방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950062131A KR970054509A (ko) | 1995-12-28 | 1995-12-28 | 박막트랜지스터 제조 방법 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR970054509A true KR970054509A (ko) | 1997-07-31 |
Family
ID=66621762
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950062131A KR970054509A (ko) | 1995-12-28 | 1995-12-28 | 박막트랜지스터 제조 방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR970054509A (ko) |
-
1995
- 1995-12-28 KR KR1019950062131A patent/KR970054509A/ko not_active Application Discontinuation
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