KR970051277A - 반도체 메모리 장치의 센스 앰프 제어 회로 및 그 센싱 방법 - Google Patents

반도체 메모리 장치의 센스 앰프 제어 회로 및 그 센싱 방법 Download PDF

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KR970051277A
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semiconductor memory
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amplifier control
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강경우
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김광호
삼성전자 주식회사
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Abstract

파워 노이즈의 피크(PEAK)를 줄일 수 있는 반도체 메모리 장치의 센스 앰프 제어회를 대시한다.
반도체 메모리 장치의 한번에 활성화는 수개의 단위 셀 어레에 블록들을 센싱하는 경우 수개의 뒤의 셀 어레이 블록들을 비타라인 센싱시점을 칼럼 어드레스 신호를 이용하요 서초 차이를 두어 센싱하도록 PMOS센스 앰프를 인에이블 시키는 것을 특징르로 하는 반도체 메모리 장치의 센스 엠프 제어회로를 제공한다.
따라서 본 발명에 의하면 반도체 메모리 장치의 수개의 단위 셀 어레이 비트라인 센싱시점을 서로 차이를 두어 센싱하므로써 전류 소모의 분산을 유도하여 파워 노이즈의 피크(PEAK)를 줄을 수 있다.

Description

반도체 메모리 장치의 센스 앰프 제어회로 및 그센상 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 의한 세스엠프 제어 회로의 회로도를 나타낸다.

Claims (3)

  1. 반도체 메모리 장치의 한번에 활성화되는 수개의 단위 셀 어레이 블록들을 센싱하는 경우 상기 수개의 단위 셀 어레이 블록들의 비트라인 센싱 시점을 칼럼 어드레스 신호를 이용하여 서로 차리를 두어 센싱하도록PMOS센스 앰프를 인에이블스키는 것을 특징으로 하는 반도체 메모리 장치의 센스 앰프 제어회로.
  2. 제1항에 있어서 상기 센스 앰프 제어회로는 센싱 인에이블 클록 신호 ФS와 단위 어레이 블록 칼럼 어드레스 신호 CAIO를 입력으로 하는 NOR게이트 ; 상기 NOR게이트 출력을 입력으로 하는 제1인버터 ; 상기 제1인버터의 출력을 입력으로 하는 제1NAND 게이트 ; 상기 제1NAND게이트의 출력을 제2인버터; 상기 제2인버터 출력과 블록 선택신호ФBLSi를 입력으로 하여 PMOS센스앰프 구동시호인 LAPG를 출려하는 제2NAND게이트로 구성된 것을 특징으로 하는 반도체 메모리 장치의 센스앰프 제어회로.
  3. 반도체 메모리 장치의 센스 앰프 제어회로를 사용한 비트라인 센싱 방법은 한번에 활성화되는 수개의 단위 셀 어레이 블록들의 비트라인 센싱 시점을 칼럼 어드레스 신호를 이용하여 서로차리를 두어 센싱하는 것을 특징으로 하는 반도에 메모리 장치의 비트라인 센싱방법
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950066920A 1995-12-29 1995-12-29 반도체 메모리 장치의 센스 앰프 제어 회로 및 그 센싱 방법 KR970051277A (ko)

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