KR970006390B1 - 컴퓨터 시스템의 전력 소모 감소 장치 - Google Patents

컴퓨터 시스템의 전력 소모 감소 장치 Download PDF

Info

Publication number
KR970006390B1
KR970006390B1 KR1019890014811A KR890014811A KR970006390B1 KR 970006390 B1 KR970006390 B1 KR 970006390B1 KR 1019890014811 A KR1019890014811 A KR 1019890014811A KR 890014811 A KR890014811 A KR 890014811A KR 970006390 B1 KR970006390 B1 KR 970006390B1
Authority
KR
South Korea
Prior art keywords
signal
computer system
power
input
flip
Prior art date
Application number
KR1019890014811A
Other languages
English (en)
Other versions
KR900006842A (ko
Inventor
리차드 카아터 로버트
엠.가아너 폴
제이.세펄리스 다아렌
에이. 부운 캐롤라인
Original Assignee
콤파크 컴퓨터 코오포레이숀
윌슨 디. 파아고
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Family has litigation
First worldwide family litigation filed litigation Critical https://patents.darts-ip.com/?family=22978492&utm_source=google_patent&utm_medium=platform_link&utm_campaign=public_patent_search&patent=KR970006390(B1) "Global patent litigation dataset” by Darts-ip is licensed under a Creative Commons Attribution 4.0 International License.
Application filed by 콤파크 컴퓨터 코오포레이숀, 윌슨 디. 파아고 filed Critical 콤파크 컴퓨터 코오포레이숀
Publication of KR900006842A publication Critical patent/KR900006842A/ko
Application granted granted Critical
Publication of KR970006390B1 publication Critical patent/KR970006390B1/ko

Links

Images

Classifications

    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26—Power supply means, e.g. regulation thereof
    • G06F1/32—Means for saving power
    • G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3206—Monitoring of events, devices or parameters that trigger a change in power modality
    • G06F1/3215—Monitoring of peripheral devices
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26—Power supply means, e.g. regulation thereof
    • G06F1/32—Means for saving power
    • G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3234—Power saving characterised by the action undertaken
    • G06F1/3237—Power saving characterised by the action undertaken by disabling clock generation or distribution
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26—Power supply means, e.g. regulation thereof
    • G06F1/32—Means for saving power
    • G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3234—Power saving characterised by the action undertaken
    • G06F1/325—Power saving in peripheral device
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B19/00—Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B19/00—Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
    • G11B19/02—Control of operating function, e.g. switching from recording to reproducing
    • G11B19/06—Control of operating function, e.g. switching from recording to reproducing by counting or timing of machine operations
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00—Error detection; Error correction; Monitoring
    • G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
    • G06F11/0751—Error or fault detection not based on redundancy
    • G06F11/0754—Error or fault detection not based on redundancy by exceeding limits
    • G06F11/0757—Error or fault detection not based on redundancy by exceeding limits by exceeding a time limit, i.e. time-out, e.g. watchdogs
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00—Error detection; Error correction; Monitoring
    • G06F11/30—Monitoring
    • G06F11/34—Recording or statistical evaluation of computer activity, e.g. of down time, of input/output operation ; Recording or statistical evaluation of user activity, e.g. usability assessment
    • G06F11/3466—Performance evaluation by tracing or monitoring
    • G06F11/349—Performance evaluation by tracing or monitoring for interfaces, buses
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D30/00—Reducing energy consumption in communication networks
    • Y02D30/50—Reducing energy consumption in communication networks in wire-line communication networks, e.g. low power modes or reduced link rate

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Power Sources (AREA)
  • Direct Current Feeding And Distribution (AREA)

Abstract

내용없음.

Description

컴퓨터 시스템의 전력 소모 감소 장치
제1도는 본 발명에 따른 컴퓨터 시스템의 블럭도.
제2도, 제3도, 제4도 및 제5도는 제1도의 컴퓨터 시스템의 각 부분에 대한 상세도.
제6a도, 제6b도 및 제6c도는 본 발명을 사용하도록 제1도의 컴퓨터 시스템을 준비하는 순서를 설명하는 플로우차트.
제7a도, 제7b도 및 제7c도는 본 발명에 따라 제1도의 컴퓨터 시스템의 각부를 제어하는 순서를 설명하는 플로우차트.
* 도면의 주요부분에 대한 부호의 설명
20 : 시스템 버스 22 : 중앙처리장치
26 : CMOS 메모리 28 : 직접 메모리 액세스 제어기
29 : 직렬 인터페이스 32 : 플로피 디스크 제어기
34 : 하드 디스크 제어기 80 : 크리스탈
150 : 멀티플렉서 202, 210 : 래치 회로
220 : 타이머
본 발명은 밧데리 전원인 컴퓨터 시스템에 관한 것으로, 특히 컴퓨터 시스템의 전력 소모를 감소시키기 위한 회로 및 방법에 관한 것이다.
휴대용 컴퓨터 시스템은 종래 탁상용 퍼스널컴퓨터 시스템의 능력을 빠르게 발전시키고 있다. 많은 응용 프로그램의 크기가 방대하고 처리되는 정보의 양이 많기 때문에 휴대용 컴퓨터에는 하드 디스크 장치가 집적되어진다. 하드 디스크가 설치된 경우에도 정보를 로딩하고 응용 요구 키이 디스크 및 진단 프로그램을 사용할수 있도록 대부분의 휴대용 컴퓨터는 적어도 하나의 플로피 디스크 장치가 구성된다. 어떤 경우에는 사용자와 리모트위치, 예를 들면 홈 오피스 사이의 통신 및 정보 전송을 위하여 휴대용 컴퓨터에 모뎀을 구성하였다. 휴대용 컴퓨터 시스템에서의 디스플레이는 휠씬 더 정교하고 판독이 용이하게 되었다. 사용되는 표준액정표시(LCD)에 의존하는 화소는 증가하고 있으며, 관측 각(Viewing angle)도 마찬가지이다. 배광(backlighting)을 사용하면 LCD를 낮은 빛의 분위기에서 사용할 수 있으며 디스플레이의 콘트라스트비를 개선한다. 휴대용 컴퓨터에는 이러한 개선된 주변장치를 보조하기 위하여, 그리고 휴대용 컴퓨터 시스템에서 사용된 마이크로 프로세서의 용량 및 증가된 속도를 보조하기 위하여 더 복잡한 회로가 설치된다.
상기한 여러가지 주변 장치 및 고속 회로는 동작시에 큰 전력을 소모한다. 이것은 이용 가능한 모든 기능을 제공하는 것을 매우 어렵게 하지만 휴대용 컴퓨터 시스템이 밧데리 전원일때에 수용할만한 밧데리 수명을 가지며, 이로써 교류 전류가 없는 곳에서도 이용될 수가 있다. CMOS부품을 사용하면 회로의 전력 소모 감소에 도움이 되지만, CMOS부품을 사용한다 해도 이용하는 회로의 클럭 소독 및 성능 레벨에서 불충분하다. 그러므로 밧데리 수명을 길게 하면서 보다 적은 기능을 갖도록 할 것인지 아니면 밧데리 수명을 짧게하면서 또는 밧데리를 사용하지 않으면서 보다 많은 기능을 갖도록 할 것인지에 환한 딜레마가 발생한다.
이 문제를 해결하기 위하여 많은 대안이 시도되었다. 예를 들어 IBM코오포레이숀의 PC콘버터블은 사용자가 컴퓨터 시스템을 스탠바이 모드에 두기 위해 누를수 있는 스위치를 포함하는데, 그 PC콘버터블은 비교적 간단하고 현재 사용중인 것에 비하여 기능 수준이 더 낮으며, 사용자 행동의 필요 조건은 사용자가 그 스위치를 억압하는 것을 기억해야 한다. 키이보드의 비활동 주기후에 표시장치를 소동하면 전력 소모를 줄이고 표시장치의 수명을 연장시킬수 있으며, 이러한 방법이 널리 사용되고 있다. 하드 디스크 장치는 제어전자장치에 의해 사용되는 전력을 감소시켜 왔는데, 서보 정보에 대한 트랙의 일부만을 사용함으로써, 그리고 서보 버스트가 예상되는 바로 전까지 판독 채널 회로를 턴 오프함으로써 감소시켜 왔다. 또한, 프로그래머블 값은, 이 값에 의해 정해진 주어진 비활동 기간후에 하드 디스크가 장치가 동작하고 몇몇 인터페이스 회로만이 동작이 중지되도록 하드 디스크 장치에 제공될 수 있다. 이러한 대안이 어떤 구원을 제공하지만 딜레마를 만족스럽게 해소하기 위한 완전한 해결책은 되지 못하며 설계상의 교환(tradeoff)은 아직도 발생하고 있다.
본 발명에 따른 밧데리 전원 휴대용 컴퓨터 시스템은 주변 장치의 동작을 모니터링 함으로써 그리고 주어진 비활동기간 후에 시스템을 차단 시킴으로써 컴퓨터 시스템이 사용중에 있지 않을때를 결정하며, 따라서 스탠바이 모드에 들어간다. 그 스탠바이 모드에 들어가는 것은 사용자의 행동에 의존하지 않고 자동적으로 발생한다.
시스템 모니터는 시스템이 동작중인지를 판정하기 위해 하드 디스크 장치, 플로피 디스크 장치, 키이보드, 직렬 포트 및 프린터에 대하여 액세스한다. 만일 동작중에 있으면 타이머는 각각의 액세스시 재개시된다. 타이머가 제로를 카운트하면 시스템은 비활동에 있는 것으로 판정되어 하드 디스크 장치, 플로피 디스크 장치, LCD 및 기타 회로로부터의 전력을 차단하고, 시스템 마이크로 프로세서 및 회로의 다른 부분에 제공된 시스템 클럭은 중단된다. 클럭의 중단은 회로에 의한 전력 소모를 크게 감소시키는데, 이는 본 실시예에서도 사용되는 CMOS소자가 제로 주파수 동작에서 전력 소모가 거의 없기 때문이다.
컴퓨터 시스템을 스탠바이 모드에서 벗어나게 하기 위하여 사용자는 스위치를 눌러서 소생 동작을 시작시킨다. 그러나, 만일 밧데리 잔류 전하가 저 밧데리2라고 인용하는 주어진 레벨 이하이면 시스템은 소생하지 않고 스탠바이 동작을 계속 유지한다. 이것은 전력 상승 과정에서 밧데리의 나머지 에너지가 소모될 때 장치내의 데이타가 소멸되는 것을 방지한다.
비활동 간격 타이머는 컴퓨터 시스템이 턴온될때 첫번째 값으로 설정되어 있으며, 그 후 간격값은 사용자에 의해 변화될수 있다. 간격값은 밧데리 전하가 저 밧데리1이라 인용되는 레벨에 도달하였을때 자동 감소되며 밧데리 전하가 저 밧데리2에 도달하였을때 매우 작은 값으로 감소된다. 간격은 사용자가 스탠바이 스위치를 눌러서 이들 시스템이 동작할때에 매우 짧은 간격으로 설정된다. 비활동 간격은 컴퓨터 시스템이 교류 전원, 예를 들면 교류 어댑터/밧데리 충전기 또는 교배 신장장치(mating expansion unit)로 부터 전원 공급될때에는 사용되지 않는다.
본 발명은 컴퓨터 시스템의 밧데리 전원 동작 시간이 크게 연장되도록 하고, 따라서 만족스러운 밧데리 동작 간격을 가지면서 용량 및 기능이 증대될 수 있게 한다.
본 발명에 대한 보다 구체적인 사항은 첨부도면과 함께 본 발명의 일실시예를 설명하는 이하의 기술내용으로부터 이해할 수 있을 것이다.
제1도를 참조하면 부호C는 일반적으로 본 발명과 관련된 컴퓨터 시스템을 나타낸다. 어드레스 및 데이터 버스(20)는 컴퓨터 시스템(C)의 기본 통신로가 되며, 이 어드레스 및 데이터 버스(20)에는 중앙처리장치 또는 마이크로 프로세서(22), 메모리장치(24), CMOS메모리 및 클럭(26), 직접 메모리 액세스(DMA)제어기(28), 직렬 인터페이스(29), 모뎀(30), 플로피 디스크 제어기(32), 하드 디스크 제어기(34), 병렬 프린터 인터페이스(26), 디스크 제어기 및 어댑터(38), 키이보드 인터페이스(40) 및 전력 제어논리회호(42)를 포함한 많은 장치가 연결된다.
마이크로 프로세서 또는 CPU(22)로는 인텔 코오포레이숀80286 마이크로 프로세서의 CMOS형이 바람직하다. CMOS형 프로세서는 동작중 전력 소모가 적고 제로 주파수 클럭으로 동작할 수 있으며 어떠한 데이터의 손실도 없는 완전한 정적 장치이기 때문에 바람직하다. 메모리장치(24)는 판독 전용 메모리(ROM)와 랜덤 액세스 메모리(FAM)로 구성된다. 제기된 실시예에서의 RAM은 각각 자신의 소생회로를 포함하므로써 저전력 소모 모드에 있을때 메모리에 소생신호를 제공하기 위해 컴퓨터(C)의 다른 부분을 활성화 시킬 필요가 없는 의사 정적 장치(pseudostatic device)인 것이 좋다. CMOS메모리(26)는 자신의 개별 밧데리(44)에 의해 전원 공급되는 것이 좋으며 이로써 어떤 임계의 또는 유용한 시스템 구성 정보가 항상 유지될 수 있고 디스크 장치에 기억되지 않으며 컴퓨터 시스템(C)이 턴온될 때마다 자극될 수 있다. 직렬 인터페이스(29)는 비동기 인터페이스인 것이 좋으며, 통상의 유니버설 비동기 수신기 전송기(UART)와 적당한 버퍼링 및 레벨 시프링 회로를 포함한다. 모뎀(30)은 또한 필요한 병렬/직렬 변환을 수행하기 위해 적당한 UART를 포함하고 모뎀(30)이 종래의 전화선을 통하여 통신할 수 있도록 전화선 인터페이스 회로와 필요한 음질 발생 및 수신 회로를 포함한다.
플로피 디스크 제어기(FDC)(32)는 플로피 디스크(46)드라이브에 연결된다. 하드 디스크 제어기(HDC)(34)는 하드 디스크장치(48)에 연결된다. 본 실시예의 하드 디스크 장치(48)는 종래 기술의 설명에서 언급했듯이 저전력 소모 응용에 적합하도록 설계된 것이다. 표시 제어기 및 어댑터(38)는 액정표시소자(LCD)(50)에 연결된다. 본 실시예의 LCD(50)는 배광을 포함한다. 표시 제어기 및 어댑터(38)는 키이 입력없이 일정기간의 시간이 경과된 후에 LCD(50)를 공백으로 할 수 있어서 LCD(50)의 수명을 보존하고 전력소모를 감소시킨다. 본 실시예에 있어서, 표시 제어기 및 어댑터(38)는 VG표준이라 하는 표준형과 호환성을 갖도록 설계된다. 표시 제어기 및 어댑터(38)는 외부의 고질 칼라 모니터에 선택적으로 접속되도록 설계되며 따라서 모니터의 활용을 위해 RAMDAC 또는 칼라파레트 장치등의 필요한 회로를 구비한다. 키이보드 인터페이스(키이보드I/F)(40)는 CPU(22)를 키이보드(52)에 연결하며, 키이보드(52)는 키이주사기능 및 키이보드(40)와의 통신을 위한 공용 마이크로 프로세서를 구비하고 전력 제어 논리회로(42)로부터의 전력 하강 신호를 수신하는 선을 갖는다.
전력 제어 논리회로(42)는 어드레스 및 데이터 버스(20)를 모니터하고 직렬포트(29), 모뎀(30), 하드 디스크 제어기(34), 프린터 인터페이스(36) 또는 키이보드 인터페이스(40)로의 최종 액세스 또는 프로피 디스크 제어기(32)로의 적당한 액세스 이후의 간격을 결정하는 기능을 수행한다. 전력 제어 논리회로(42)는 ACPWR이라 하는 선의 상태를 모니터하는데 이 선은 컴퓨터 시스템(C)에 의해 소모되는 전력이 교류 전원에 의해 공급되는지 또는 내부 밧데리(54)에 의해 공급되는지를 나타낸다. 전원 제어 논리회로(42)는 SWNo*선이라 하는 선을 감시하며, 이 선은 저항(56)에 의해 고레벨로 되고 스탠바이 스위치(58)에 의해 접지된다. 신호 또는 선 뒤에 별표(*)가 있는 것은 신호 또는 선이 종래의 능동 또는 진리 고레벨 보다는 능동 또는 진리 제레벨 신호 또는 선 임을 나타낸다. 스탠바이 스위치(58)는 사용자에 의해 일시적으로 폐쇄되고 보통은 개방되어 있는 스위치이며 컴퓨터 시스템(C)을 스탠바이 모드에 또는 컴퓨터 시스템(C)를 스탠바이 모드로부터 소생시키는 역할을 한다. 또한 전원 제어 논리 회로(42)는 LOWBAT1과 LOWBAT2라 하는 두 신호의 상태를 감시하며 이 신호들은 밧데리(54)의 잔류 전하를 감시하는 밧데리 전압 로직(60)에 의해 발생된다. 전하가 전체 전하의 약10%만 잔류하는 것으로 나타내는 제1레벨이하이면, 이것은 LOWBAT1레벨이고 LOWBAT1신호가 이 상태를 나타내도록 설정된다. 밧데리가 계속하여 방전되면 밧데리는 결국 LOWBAT2레벨이라 하는 제2의 에너지 레벨에 도달하게 되고, 따라서 LOWBAT2신호가 설정된다. LOWBAT2레벨은 전체 전하의 약5%만이 밧데리(54)에 잔류할때의 레벨이다. 이들 레벨 신호는 사용자에게 밧데리의 고갈 이전에 이용가능한 시간에 관한 경보레벨을 표시하기 위해, 그리고 컴퓨터 시스템(C)에게 완전한 전력 레벨에서 권할만한 동작을 표시하기 위해 제공된다.
전원 제어 논리회로(42)는 많은 출력을 갖는다. 전원 발광 다이오드(LED)(62) 및 밧데리 상태 LED(64)를 구동하기 위해서는 2개의 출력이 사용된다. 전원 제어 논리회로(42)는 컴퓨터 시스템(C)이 턴온되고 스탠바이 모드에 있지 않으면 연속 형식으로 전원LED(62)를 구동한다. 컴퓨터 시스템(C)이 저전력 소모 모드에 있고 중지되었음을 나타내는 스탠바이 모드에 있으면 전원LED(62)가 발광하여 사용자에게 알린다. 밧데리 LED(64)는 밧데리가 충분히 충전되어 있을때 오프되고, LOWBAT1조건에 있을때 1Hz의 비교적 느린 제1의 속도로 바광하기 시작하며, LOWBAT2조건에 있을때 더 빠른 속도, 예를 들면 2Hz의 속도로 발광한다. 이러한 여러가지의 밧데리 레벨 경고는 밧데리의 잔류 에너지에 대하여 사용자에게 시각적으로 표시되는 것이다. 전원 제어 논리회로(42)는 몇개의 전계효과 트랜지스터(FET)(66,68,70)에 연결된 일련의 출력들을 가지며, 상기 FET들은 각각 모뎀(30), 하드 디스크(48) 및 LED(50)로 흐르는 전류를 제어하기 위해 사용된다.
전원 제어 논리회로는 SLEEP*신호라하는 출력을 가지며, 이는 SLEEP신호를 발생하도록 인버터(72)에 제공된다. 능동 또는 진리SLEEP신호가 존재함은 컴퓨터 시스템(C)이 휴지 또는 스탠바이 모드에 있음을 나타낸다. SLEEP신호는 키이보드(52)에 연결되어 키이보드 전자장치 또는 마이크로 프로세서가 저전력 조건으로 되게 한다. 또한 SLEEP신호는 FET(74)에 제공되어 컴퓨터 시스템(C)의 여러가지 보조회로(76)로부터 전원을 제거한다. 전원은 CPU(22)나 메모리(24)등 컴퓨터 시스템(C)의 많은 부분으로부터는 제거되지 않음을 알아야 한다. SLEEP신호는 메모리 장치(24)에 제공되어 RAM이 의사 정지 모드에 들어가서 자신의 소생을 제어하기 시작하도록 한다.
SLEEP신호는 또한 반전되어 시스템클럭을 디세이블 시키는데 사용되는 2입력 클럭 AND게이트(78)의 입력에 제공된다. 크리스탈(80)은 클럭(CLK)신호를 발생하는 클럭 발생기 회로(82)에 연결되며, CLK신호는 내부 클럭 작용을 하도록 전원 제어 논리회로(42)에 제공되고 또한 클럭 AND게이트(78)의 출력은 클럭 작용을 위해 컴퓨터 시스템(C)의 CPU(22)와 다른 부품에 의해 사용된다. 따라서 SLEEP신호가 고레벨에 있을때에 AND게이트(78)의 출력은 저레벨이며, 이로써 시스템 클럭을 중지하고 컴퓨터 시스템(C)에 위치된 클럭CMOS회로가 매우 낮은 전력 상태에 있게 한다. 대안으로써, 시스템 클럭이 고레벨에서 중지될 필요가 있으면, 클럭AND게이트(78)는 OR게이트로 교체될 수 있고 SLEEP신호는 직접 인가된다. CPU(22)에 대한 클럭 신호의 정지에 대한 상세한 사항을 위하여 해리스 코오포레이숀 ADC 286 하드웨어 레퍼런스 매뉴얼의 A-6 페이지를 참조한다.
클럭 발생기 회로(82)에 의해 발생된 CLK신호는 D형 플립플롭(100)(제2도)의 클럭 입력으로 제공된다. 플립플롭(100)의 D입력은 2입력NOR게이트(102)의 출력으로부터 제공된다. NOR게이트(102)에는 전원 제어 논리회로(42)에서 발생된 SLEEP*신호와 전원 제어 논리회로(42)에 제공되는 SWNO*신호가 입력된다. NOR게이트(102)는 시스템이 스탠바이 모드에 있을때에 스탠바이 스위치(58)를 눌러서 소생절차가 시작되는 것을 지시하고 수신하기 위해 사용된다. 두신호가 컴퓨터 시스템(C)이 스탠바이 모드에 있고 사용자가 컴퓨터 시스템(C)을 소생시키고자 함을 나타내는 저레벨 상태에 있을때에 D입력의 저레벨신호는 CLK신호의 다음 상승 엣지에서 플립플롭(100)의 Q 또는 비반전 출력에 클럭된다. 플립플롭(100)의 비반전 출력은 D형 플립플롭(104)의 D입력으로 제공된다. 제2D플립플롭(104)의 클럭신호도 역시 CLK신호이다. 플립플롭(100)의 반전 출력과 플립플롭(104)의 비반전 출력은 2입력 NAND게이트(106)에 입력된다. 능동조건이 스탠바이 스위치(58)가 해제된 후 길이에 있어서 저레벨 펄스의 1CLK신호 주기인 2입력 NAND게이트(106)의 출력은 AND게이트(108)의 일 입력으로 제공되고, 그 출력은 슬립D형 플립플롭(110)의 리세트 입력으로 공급된다.
슬립플립플롭(110)은 전원 제어 레지스터(109)라하는 레지스터에서 1비트를 처리한다. 전원 제어 레지스터(109)는 어떤 주변장치 및 시스템이 파워 온 되는지를 나타내고 제어하는 기억소자들을 포함한다. 전원 제어 레지스터(109)는 컴퓨터 시스템(C)에 의해 판독될 수 있고 컴퓨터 시스템(C)에 의해 기입될 수 있다. 전원 제어 레시스터(109)를 구성하는 여러가지의 추가 기억소자로는 모뎀D형 플립플롭(112), RAMDAC D형 플립플롭(113), 하드 디스크 D형 플립플롭(114) 및 LCD D형 플립플롭(116)이 있다. 전원 제어 레지스터(109)의 모든 플립플롭은 버퍼(비도시)를 통하여 데이타 버스(20)의 적당한 선에 연결된 D입력을 가지며 또한 PWRCTLWR*이라하는 신호를 수신하는 클럭 입력을 갖는다. PWRCTLWR*신호는 기입동작이 전원 제어 레지스터(109)에 지시되었음을 나타내는 신호이고, 각종 플립플롭의 입력에서 데이타가 유효할때 신호의 상승 엣지를 이용할 수 있도록 하는 위상을 갖는 신호이다. 전원 제어 레지스터 플립플롭의 비반전 출력들은 결합되어 PWRCTL데이타 선을 형성하고 적당한 버퍼장치(비도시)를 거쳐 시스템 어드레스 및 데이타 버스에 연결된다.
컴퓨터 시스템(C)이 수면이라하는 스탠바이모드에 있고 오퍼레이터가 스탠바이 스위치(58)를 누르면, 스탠바이 스위치(58)가 해제될때 NAND게이트(106)의 출력에서 1CLK신호 길이 펄스가 발생되어 슬립플립플롭(110)의 비반전 출력을 리세트한다. 슬립플립플롭(110)의 비반전 출력은 2입력NAND게이트(118)의 한 입력에 접속된다. NAND게이트(118)의 다른 입력은 LCD플립플롭(160)의 반전출력에 연결된다. LCD(50)의 전원인가 순서에 관한 제한 때문에 본 실시예에서는 슬립플립플롭(110)출력과 LCD플립플롭(116)출력의 이러한 이중 접속을 사용한다. 따라서 슬립플립플롭(110)의 출력이 저레벨로 되면, NAND게이트(118)의 출력은 하이로 되고, 따라서 D형 플립플롭(120)의 D입력신호는 고레벨로 된다. 이 플립플롭(120)은 인버터(122)에 의해 반전된 CLK신호에 의해 클럭된다. CLK신호의 다음 하강 엣지가 들어오면 플립플롭(120)의 비반전 출력인 SLEEP*신호는 고레벨로되어 컴퓨터 시스템(C)이 더이상 스탠바이 모드가 아님을 나타낸다. 신호는 NOR게이트(120)로 궤환되어 NAND게이트(106)에 의해 제공된 펄스를 클리어한다.
플립플롭(120)의 반전 출력은 D플립플롭(124)의 d입력에 연결된다. 플립플롭(124)의 클럭 입력에는 CLK신호가 인가되며, 따라서 CLK신호의 다음 상승 엣지에서 플립플롭(124)의 비반전 출력은 저레벨로 된다. 상기 플립플롭(124)의 출력은 2입력 OR게이트(126)의 한 입력으로 되고 CLK게이트(126)의 다른 한 입력은 CLK신호이다. 따라서 플립플롭(124)의 비반전 출력이 저레벨일때, OR게이트(126)의 출력은 CLK신호에 따라 변화하며, 이 신호는 BCLK신호라 한다. 이 신호는 전원 제어 논리회로(42)에서 사용하는 블록 클럭 또는 정지된 클럭 신호이며 컴퓨터 시스템(C)이 스탠바이 모드에 있을때, 정지될 수 있는 전원 제어 논리회로(42)의 부분까지도 정지된다.
컴퓨터 시스템(C)이 스탠바이 모드에 들어가면, LCD플립플롭(116)이 반전 출력은 고레벨로 되는데, 이는 본 실시예에서 컴퓨터 시스템(C)의 여러가지 부품으로부터 클럭을 제거하기 전에 LCD전원이 턴오프 되기 때문이다. 슬립 플립플롭(110)의 비반전 출력은 전원 제어 레지스터에 대한 CPU(22)의 다음 액세스시에 고레벨로 설정되며, 그리하여 2입력 NAND게이트(118)의 양입력은 고레벨로 되고 플립플롭(120)의 입력으로는 저레벨신호가 인가된다. CLK신호의 다음 하강 엣지에서 SLEEP*신호는 저레벨로되어 컴퓨터 시스템(C)이 스탠바이 모드에 있음을 나타내고, 플립플롭(120)의 반전 출력은 고레벨로 되는데 이 출력은 그다음 플립플롭(124)을 통하여 클럭되어 OR게이트(126)에 의해 전원 제어 논리회로(42)의 다른 부분에 대한 클럭인가를 정지시킨다.
RAMDAC플립플롭(113)의 비반전 출력은 OR게이트(128)의 한 입력으로 공급된다. OR게이트(128)의 제1입력은 ACPWR신호이며, 이 신호는 교류전원이 인가됨을 나타내는 신호이다. OR게이트(128)의 출력은 RAMDACON신호로서 전원이 지연 제어 어댑터(38)에 위치된 RAMDAC를 턴온 시켜야함을 나타낸다. 상기한 바와같이 RAMDAC는 LCD표시가 칼라가 아니고 따라서 RAMDAC에 의해 수행된 필요한 칼라 팔레트 조사를 수행할 필요가 없기 때문에 본 실시예에서 외부 모니터에만 사용한다. 따라서 RAMDAC비트가 세트온되거나 컴퓨터 시스템(C)에 외부 교류전원으로부터 전원이 인가되면 RAMDAC는 턴온된다. 그렇지 않으면 RAMDAC는 턴오프되어 전력을 보존한다.
모뎀 플립플롭(112)의 비반전 출력은 D플립플롭(130)의 D입력으로 인가된다. 이 플립플롭의 클럭 신호는 필립플롭(130)에 대해 약13마이크로 초 클럭신호를 제공하는 CLK13㎲라하는 신호이다. 플립플롭(130)의 출력은 MODEMON신호이고 제2의 D플립플롭(132)의 D입력 및 2입력EQUAL게이트(134)의 한 입력으로 공급된다. MODEMON신호는 FET(66)에 공급되어 모뎀(300으로의 전원을 제어한다. 제2플립플롭(132)은 또한 CLK13㎲신호에 의해 클럭되며 그 비반전 출력은 EQUAL게이트(134)의 제2입력에 연결된다. EQUAL게이트(134)의 출력은 2입력 NAND게이트(136)의 한 입력으로 공급된다. NAND게이트(136)의 출력은 MODEMRST신호이며, 이는 모뎀리세트 신호이다. NAND게이트(136)의 제2입력은 RESET*신호에 연결되며, 이 신호는 컴퓨터 시스템(C)에 존재하는 메인 리세트 신호이다. RESET*신호가 고레벨이라고 가정하면, MODEMRST신호는 모뎀 플립플롭(112)의 출력이 변화할때 하나의 13마이크로초 CLK신호 주기동안 고레벨로 펄스된다. 따라서 모뎀(30)이 턴온된 후에 모뎀(30)을 적당히 초기화시티는 리세트 펄스가 존재한다.
하드 디스크 플립플롭(114)의 비반전 출력은 HDISKON신호이고 하드 디스크 장치(48)에 공급되는 전원을 제어하도록 FET(68)에 연결된다.
슬립플립플롭(110)의 비반전 출력과 LCD플립플롭(116)의 반전출력은 NOR게이트(138)의 두 입력에 공급된다. NOR게이트(138)의 출력은 LCDON신호이고 LCD(50)에 대한 전원 공급을 제어하도록 FET(70)에 연결된다. 슬립 및 LCD플립플롭의 출력신호를 결합하면 LCD전원이 부적당한 순서로 제거되는 것 및 LCD(50)의 손상을 방지할 수 있다.
컴퓨터 시스템(C)은 병렬 프린터 인터페이스(36)를 포함한다. 본 실시예에 있어서, 상기 병렬 프린터 인터페이스(36)는 일반적으로, LTP1,LTP2및 LTP3라하는 3개의 선택적 어드레스의 어느하나에서 어드레스될 수 있다. 3개의 프린터 위치중에서의 선택은 주변 제어 레지스터에서 2비트의 상태에 의해 정해지며 상기 2비트에 대응하는 두 신호는 PCR6과 PCR5라고 인용한다. 이들 두 신호는 4 : 1멀티플렉서(150)의 게이팅 입력에 제공되며, 상기 멀티플렉서(150)는 반전출력을 갖는다(제4도). LTP1 *신호라하는 신호는 멀티플렉서(150)의 제로채널 입력으로 인가되며, 본 실시예에서 3BC~3BF)의 어드레스를 갖는 LTP1프린터의 어드레스에 대한 호출이 이루어질때에 참(true)이다. 포트어드레스(37A~37F)에 대한 호출을 나타내는 신호(LPT2 *)는 멀티플렉서(150)의 제2입력에 연결된다. 어드레스 278~27F에 대한 호출이 이루어질때에 저레벨로되는 신호(LPT3 *)는 멀티플렉서(150)의 제3입력에 연결된다. 멀티플렉서(150)의 제4입력에는 항상 고레벨이 인가된다. 멀티플렉서(150)의 출력은 PTR이라하는 신호이며, 이 신호는 선택된 프린터 위치에 대한 호출이 이루어졌음을 나타낼때에 고레벨이다. PTR신호(150)는 4입력 OR게이트(152)의 한 입력으로 공급된다. 4입력 OR게이트(152)으 다른 하나의 입력은 다른 하나의 4입력 OR게이트(154)의 출력이 인가된다. 4입력 OR게이트(154)의 4개 입력에는 HDISK신호, MODEM신호, UART신호 및 KEYBD신호가 인가된다. 이들 신호들은 각각 1F0~1F7, SF8~2FF, 3F8~3FF 및 060과 064에 대한 액세스를 나타낸다. 이들 신호중 어느하나가 존재하면, 이것은 버스를 제어하는 CPU(22) 또는 다른 장치가 이들 지정된 어드레스중 하나를 액세스함을 나타낸다.
FLOPPY라고 표시된 신호는 3개의 NOR게이트(156,158,160)의 한 입력으로 공급된다. FLOPPY신호는 본 실시예에서 플로피 디스크 제어기(32)에 대한 완전한 액세스 범위인 어드레스 범위(3F0-3F7)에서의 액세스 요구를 나타낸다. 그러나 호환성의 이유때문에 유지되어야 할 것으로 컴퓨터 시스템(C)에 존재하는 다른 제어순서에 대한 어떤 특징 때문에, 범위내의 한 어드레스는 이 어드레스가 다른 전위 시스템의 문제발생 방지에 기초하여 비교적 자주 액세스되고 필요에 따라 시스템 능동성을 표시하지 않기 때문에 비능동성 모니터링을 위해서는 사용될 수 없다. 그러므로, FLOPPY신호는 지정된 소망하는 어드레스가 존재하지 않다는 것을 판정하도록 어드레스의 다른 비트를과 결합되어야 한다. FLOPPY신호는 최초에 NOR게이트(160)에 의해 제로 또는 최하위 어드레스 신호와 결합되며 이로서 홀수 어드레스에 대한 어떠한 액세스도 고레벨신호를 발생하여 OR게이트(152)의 한 입력에 인가한다. 어드레스의 두번째 최하위 비트를 나타내는 ADD2신호는 FLOPPY 신호와 함께 NOR게이트(158)의 입력으로 공급되며, 이로써 4-7범위의 최하위 16진 디지트를 갖는 모든 어드레스가 선택된다. NOR게이트(158)의 출력은 2입력 OR게이트(162)의 한 입력으로 공급되고, 그 출력은 4입력 OR게이트(152)의 제4입력으로 공급된다. OR게이트(162)의 제2입력은 ADD1신호 또는 어드레스의 다음 최하위 비트와 FLOPPY신호가 입력되는 세번째 NOR게이트(156)로부터 공급되며, 이로써 NOR게이트(156)의 출력은 최하위 16진 디지트(0,1,4 또는 5)를 갖는 어드레스가 존재할 때만 고레벨로 된다. 따라서 NOR게이트(156,158,160)는 어드레스가 상기 주어진 문제에 의해 액세스된 어드레스인 3F2일때를 제외하고 3F0-3F7범위의 어드레스에 대하여 고레벨 신호를 발생한다.
4입력 OR게이트(152)의 출력은 모니터된 장치의 적당한 어드레스가 어드레스 버스(20)에 존재함을 나타낸다. 이 신호는 2개의 다른 2입력 NAND게이트(164,166) 각각의 한 입력으로 제공된다. NAND게이트(164)의 제2입력은 I/ORD라하는 신호로써 유효 I/O어드레스 스페이스 또는 포트 판독동작이 진행중임을 나타낸다. 다른 NAND게이트(166)의 제2입력은 I/OWR신호로써 유효 I/O어드레스 스페이스 기입동작이 진행중임을 나타내는 신호이다. 이들 두 신호의 사용은 모니터된 장치가 실제로 액세스 되는 지를 결정하기 위해 어드레싱정보와 함께 필요하다. NAND게이트(164,166)의 출력은 AND게이트(168)의 두 입력에 공급되고 그 출력은 DEVACT*신호로써 모니터된 장치가 액세스될때 저레벨로 된다. DEVACT*신호는 I/O제어신호가 어드레스 정보보다 더 짧은 기간동안 존재하기 때문에 본 실시예에서 I/ORD 또는 I/OWR신호의 길이동안만 저레벨이다.
DEVACT*신호는 2입력 NAND게이트(200)(제3도)의 한 입력으로 공급된다. NAND게이트(200)의 다른 입력은 ACTMONWR*신호로써 능동성 모니터 간격 레지스터에 대해 기입동작이 발생함을 나타내는 신호이다. ACTMONWR*신호는 또한 래치회로(202)의 인에이블 입력으로 제공된다. 래치회로(202)의 데이타 입력신호는 데이타 버스(20)에 의해 공급되며, 이로써 래치회로(202)는 능동성 메모리 타이머(T)에 포함된 제1레지스터 또는 버퍼가 된다.
NAND게이트(202)의 출력은 D플립플롭(204)의 클럭입력으로 공급된다. D입력은 모니터된 장치에 대한 액세스가 막 완료되었음을 나타내는 고레벨신호로 DEVACT*신호가 해제될때마다 플립플롭(204)이 클럭되도록 고레벨신호에 연결된다. 플립플롭(204)의 비반전 출력은 두번째의 D플립플롭(206)의 D입력에 연결된다. 플립플롭(206)의 클럭입력으로는 BCLK신호가 공급된다. 플립플롭(206)의 반전출력은 2입력 AND게이트(208)의 한입력에 연결되고 그 출력은 제2래치회로(210)의 반전된 칩 인에이블 입력에 연결된다. 이와 같이 2개의 래치회로(202,210)를 사용함으로써 능동성 모니터 타이머(T)가 이중으로 보호될 수 있다. 또한, 애지스터(210)는 래치회로(210)에 래치된 값이 제로가 아님을 나타내는 출력을 포함한다. 제2래치회로(210)의 클럭 입력 신호는 BCLK신호이다.
AND게이트(208)의 출력은 또한 2입력 OR게이트(212)의 한 입력에 연결되고, OR게이트(212)의 다른 입력에는 BCLK신호가 공급된다. OR게이트(212)의 출력은 플립플롭(204)의 리세트 입력으로 궤환되어 DEVACT*신호가 두 필립플롭(204,206)을 통하여 전파될때마다 제1플립플롭(204)이 클리어된다.
제2플립플롭(206)의 반전출력은 또한 2입력 NAND게이트(214)의 한 입력으로 제공된다. NAND게이트(214)의 출력은 D플립플롭(216)의 D입력에 연결되고 플립플롭(216)의 클럭입력에는 BCLK신호가 공급된다. 플립플롭(216)의 반전출력은 AND게이트(218)의 한 입력에 연결되고 AND게이트(218)의 출력은 하강계수(countdown)타이머(220)의 반전된 로드 입력에 연결되며 하강 계수 타이머(220)는 능동성 모니터 타이머(T)의 타이밍 소자의 로드 기능부를 형성한다. 타이머(220)는 타이머(220)가 제로값에 도달했을때를 나타내는 출력을 갖는다. AND게이트(218)의 출력은 또한 4입력 NAND게이트(222)의 한 입력에 연결되고 그 출력은 ACTIVE*신호로써 장치가 동작 상태이고 능동성 모니터 타이머(T)가 제로를 계수하지 않았음을 나타낸다. 래치회로(210)에 의해 제공된 NOTZERO신호는 NAND게이트(222)의 한 입력에 연결되고 타이머 카운터(220)로부터의 ZERO신호 출력은 NAND게이트(222)의 다른 한 입력으로 제공된다. NAND게이트(222)의 제4 및 마지막 입력은 IRQ15CLR이라 하는 신호로서 인터럽트 요구(15)가 클리어 됨을 나타내는 신호이다. NAND게이트(222)의 입력은 능동성 모니터 타이머(T)가 제로가 아닌 래치회로(210)의 값에 의해 인에이블되고, 장치가 AND게이트(218)의 출력에 의해 지시된대로 동작상태로 되지 않으며, 하강 계수 타이머(220)가 제로를 계수하지 않고 레벨 15인터럽트가 클리어 되었을때만 고레벨이다. 이것은 능동성 모니터 타이머(T)가 카운트 다운 하기 시작하는 값에 의해 나타낸 시간의 충분한 기간동안 컴퓨터 시스템(C)이 비동작 상태로 있는 일반 조건이다.
IRQ15CLR신호와 NOTZERO신호는 3입력 AND게이트(224)의 두 입력으로 제공된다. AND게이트(224)의 제3입력은 1BCLK신호 주기의 폭을 갖는 펄스이고 매5초마다 발생되는 신호(5SEC)이다. 이 펄스는 필요한 펄스폭을 방생하기 위한 한 입력과, 5초 주기로 분할되는 초기 클럭주기를 발생하기 위한 CLK13㎲신호의 제2신호 입력과 AND게이트(218)의 출력에 의해 제공된 리세트 신호로서 BCLK신호를 갖는 리플 카운터(226)에 의해 발생된다. AND게이트(224)의 출력은 하강 계수 타이머(220)의 인에이블 입력에 제공되며 하강 계수 타이머(220)의 클럭 입력인 BCLK신호에 동기된다. 이로써 하강 계수 타이머(220)는 5초당 1회의 계수만을 증가 또는 감소한다. 제1래치회로(202)의 데이타 출력은 제2래치회로(210)의 데이타 입력에 병렬 연결되고, 제2래치회로(210)의 출력은 하강 계수 타이머(220)의 반전 데이타 입력에 연결된다. 타이머(220)의 반전된 데이타 출력은 ACTMN데이타 선이라 하는 선 또는 일련의 선을 통하여 데이타 버스(20)에 제공되고 CPU(22)에 능동성 모니터 타이머의 값을 제공한다. 이러한 방식으로 CPU(22)는 슬립 또는 스탠바이 상태에 들어가기전에 잔류하는 실제의 하강 계수 시간을 결정할 수 있다.
ACTIVE*신호는 NAND게이트(214)의 제2입력에 연결되고 ACTIVE*신호가 저레벨일때 NAND게이트(214)의 출력을 고레벨로 하여, 모니터된 장치가 액세스된 후 제2의 BCLK신호의 상승 엣지에서 하강 계수 타이머(220)가 재로드되고 처리가 재개시되며 ACTIVE*신호는 고레벨로 복귀한다. 상기 ACTIVE*신호의 펄스폭은 스탠바이 모드로 되기에 적당한지 아닌지 및 그때를 결정하는 인터럽트 루틴을 수행하기 시작하기 위해 필요에 따라 레벨15인터럽트 동안 발생되기에 충분한다. 2개의 래치회로(202,210) 및 두 개의 플립플롭(206,216)은 저레벨의 RESET*신호에 의해 리세트된다.
따라서 플립플롭(204,206,216)과 각종 논리 게이트(200,208,212,214,218)의 결합은 모니터된 장치가 활성화될때마다 하강 계수 타이머(220)를 리세트하고 재트리거 시킨다. 예를 들어, 클럭신호는 플립플롭(204)에 나타나고, 플립플롭(204)은 그다음 플립플롭(206)의 D입력에 고레벨신호를 제공하며 플립플롭(206)의 반전 출력은 BCLK신호의 다음 상승 엣지에서 저레벨로 된다. 플립플롭(206)의 반전 출력에서의 이러한 저레벨출력은 BCLK신호의 다음 상승 엣지에서 재로드되고 같은 BCLK신호 엣지에서 플립플롭(216)의 출력이 저레벨로 되도록 제2래치회로(210)를 인에이블 시킨다. 그후 다음의 BCLK신호 상승 엣지에서 하강 계수 타이머(220)는 재로드되고 따라서 하강 계수 과정은 재개시된다.
ACTIVE*신호는 2입력 NAND게이트(250)(제5도)의 한 입력으로 공급된다. 이 NAND게이트(250)의 추력은 D플립플롭(252)의 D입력에 연결된다. 이 플립플롭(252)은 BCLK신호에 의해 클럭된다. 플립플롭(252)의 비반전 출력은 인터럽트 요구 래지스터의 능동 상태 비트이고 IRQDATA(7-0)선 및 적당한 버퍼링에 의해 프로세서에 제공된다. 플립플롭(252)의 비반전 출력은 또한 플립플롭(254)의 D입력으로 제공되고, 플립플롭(254)은 또한 BCLK신호에 의해 클럭된다. 제1플립플롭(252)의 반전 출력은 NAND게이트(250)의 제2입력 및 NOR게이트(256)의 제1입력에 연결된다. 이와 같이 연결함으로써 플립플롭(252)의 D입력은 컴퓨터 시스템(C)의 능동상태의 상태가 언제든지 결정될 수 있도록 ACTIVE*신호에서 초기 펄스를 수신한 후에 고레벨을 유지한다. 제2플립플롭(254)의 출력은 NOR게이트(256)의 제2입력으로 제공되고 NOR게이트(256)의 출력은 6입력 NOR게이트(258)의 한 입력으로 연결된다. 2입력 NOR게이트(256)의 출력은 하나의 BCLK신호 주기의 길이를 갖는 펄스이다. 이러한 방법으로 비능동 타임아웃이 되었을때 IRQ15REQ신호를 발생하도록 하나의 짧은 펄스만이 형성되어 NOR게이트(258)에 제공된다.
NOR게이트(258)에 6개의 입력이 있다는 사시로써 알수 있는 바와같이 IRQ15REQ신호를 발생시키는데는 여러가지의 다른 방법이 있다. 본 실시예에서는 이러한 여러가지의 방법들을 제공하여 컴퓨터 시스템(C)이 전원 사용에 관한 여러가지 사건 및 스위치의 상태를 인식하도록 하고 적당한 시간에 사용자에게 경보하도록 한다. 예를 들어, ACPWR*신호는 D플립플롭(260)의 D입력으로 제공되며 플립플롭(260)의 클럭신호는 BCLK신호이다. 플립플롭(260)의 비반전 출력은 D플립플롭(262)의 D입력 및 2입력 XOR게이트(264)의 한 입력에 연결된다. XOR게이트(264)의 제2입력은 제2플립플롭(262)의 비반전 출력에 의해 제공되고 그 플립플롭은 BCLK신호에 의해 클럭된다. 따라서 XOR게이트(264)의 출력은 교류전원의 상태가 변화할때마다 발생되어 IRQ15REQ신호를 발생하도록 BCLK게이트(258)에 공급되는 하나의 BCLK신호 주기 길이 펄스이다. ACPWR*신호의 상태는 플립플롭(260)에 기억되었다가 그 반전출력에 의해 IRQDATA선으로 전송된다. 따라서, NOR게이트(258)는 예를 들면 교류 어댑터가 제공될때 등, 교류 전원 상태의 어떤 변화를 컴퓨터 시스템(C)이 인식할 수 있도록 사용된다. 이것은 컴퓨터 시스템(C)이 밧데리 전원 동작으로 될때를 인식하도록 하고 따라서 전원 보호 모드가 적절하게 된다. 이 동작은 컴퓨터 시스템(C)의 동작 순서를 설명하는 플로우차트에 의해 더 자세하게 알 수 있다.
LOWBAT1및 LOWBAT2신호를 사용하기 위하여 유사한 플립플롭 회로가 주어진다. 따라서 NOR게이트(258)의 두 입력은 컴퓨터 시스템(C)이 LOWBAT1또는 LOWBAT2로/로부터 밧데리 충전상태를 변경시킬 때를 나타낸다. 실제의 LOWBAT신호는 제1의 D플립플롭(290,292)에 의해 직렬로 래치되고 비반전 출력은 IRQDATA선에 제공된다. 제2의 D플립플롭(294,296)은 BCLK신호에 의해 폐쇄되고 그 D입력은 플립플롭(290,292)의 비반전 출력에 연결된다. 플립플롭(290,292,294,296)의 비반전 출력은 XOR게이트(297,298)의 입력이 되며, XOR게이트(297,298)의 출력은 XOR게이트(258)에 연결되어 레벨15인터럽트를 트리거 시키기 위한 필요한 신호를 발생한다.
5SEC신호는 AND게이트(266)에 의해 래치된 LOWBAT2및 LOWBAT1신호와 결합되고 AND게이트(266)의 출력은 NOR게이트(258)에 입력되며, 이로써 컴퓨터 시스템(C)이 LOWBAT2조건에 있을때마다 매5초의 레벨15인터럽트를 수신하여 사용자로 하여금 그가 LOWBATW2조건에 있고 밧데리(54)에는 매우 적은 에너지가 잔류함을 기억하도록 한다.
NOR게이트(258)의 최종 입력은 SLEEP*신호와 SWNO*신호에 기인한다. 결합된 신호들은 컴퓨터 시스템(C)이 동작중에 있는 동안 사용자가 스탠바이 스위치(588)를 누르고 컴퓨터 시스템(C)은 사용자의 요구에 응하여 비동작 상태 또는 스탠바이 상태로 됨을 나타내기 위해 사용된다. D플립플롭(268)의 D입력에는 SLEEP*신호가 제공되고 그 클럭단자에는 SWNO*신호가 입력된다. 이러한 방법으로, 만일 SLEEP*신호가 컴퓨터 시스템(C)의 동작을 표시하는 고레벨이라면, 스탠바이 스위치(58)가 눌러졌을때 플립플롭(268)의 비반전 출력으로 전송되는 비반전 출력에서 고레벨신호가 발생되고 이 신호는 다음의 D플립플롭(270)의 D입력으로 공급된다. 제2플립플롭(270)의 클럭신호는 BCLK신호이다. 플립플롭(270)의 비반전 출력은 IRQDATA선에 제공되고 CPU(22)에 의해 번역되는 스탠바이 스위치 신호가 된다. 플립플롭(270)의 반전 출력은 NOR게이트(272)의 한 입력으로 제공된다. 비반전 출력은 또한 BCLK신호에 의해 클럭되는 제3의 D플립플롭(274)의 D입력으로 공급된다. 플립플롭(274)의 비반전 출력은 NOR게이트(272)의 제2입력에 연결되며, ACTIVE*신호에 관한 회로와 유사한 방법으로 단펄스의 1BCLK신호 주기 길이만이 NOR게이트(258)에 주어져서 컴퓨터 시스템(C)을 스탠바이 모드에 두고자 하는 사용자의 요구를 표시한다.
NOR게이트(258)의 출력은 NAND게이트(276)의 한 입력에 연결되고 그 출력은 IRQ15D플립플롭(278)의 D입력에 연결된다. IRQ15플립플롭(278)은 BCLK신호에 의해 클럭되며 그 반전 출력은 NAND게이트(276)의 제2입력에 연결된다. 이러한 방법으로, NOR게이트(258)에서 펄스를 수신할때마다 신호는 IRQ15플립플롭(278)에 의해 검출되고 IRQ15플립플롭(278)이 리세트될때까지 래치된다. IRQ15플립플롭(278)의 비반전 출력은 IRQ15REQ신호이며, 이 신호는 CPU(22)에 인터페이스 접속되고 인터럽트 요구의 처리를 관장하는 인터럽트 제어기에 공급된다.
인터럽트 회로에 관련한 전원 보존 회로에서 사용되는 것으로 나머지 2개의 플립플롭이 있으며, 이들은 IRQ15EN D형 플립플롭(280) 및 IRQ15CLR D형 플립플롭(282)이다. IRQ15EN플립플롭은 데이타 버스(20)로부터 D입력을 수신하며, IRQ15레지스터에 대해 기입동작이 발생함을 나타내는 신호(IRQ15WR*)에 의해 클럭된다. IRQ15레지스터 위치는 판독동작중에 IRQDATA선을 형성하는 신호의 상태를 제공하고 기입동작 중에 IRQ15EN 및 IRQ15CLR플립플롭(280,282)에 데이타가 기입되도록 한다. 데이타 버스상의 데이타는 이대 래치되고 IRQ15EN플립플롭(280)의 출력은 IRQDATA선에 제공되는 IRQ15EN신호이다.
IRQ15WR*신호에 의해 클럭되는 신호는 데이타 버스(20)의 다른 비트이며 IRQ15CLR신호이다. 이 신호의 고레벨 상태가 클럭되면, IRQ15CLR플립플롭(282)의 비반전 출력은 IRQ15CLR신호이고 고레벨 상태로 되며 CPU(22)에 의한 평가를 위해 IRQDATA선으로 궤환된다. IRQ15CLR플립플롭(282)의 반전출력은 IRQ15CLR*신호이며 2입력 AND게이트(284)의 한 입력으로써 제공된다. AND게이트(284)의 나머지 입력은 RESET*신호이며 이 신호는 또한 IRQ15EN 및 IRQ15CLR플립플롭(280,282)의 리세트 입력과 회로에 있어서 LOWBAT1, LOWBAT2및 ACPWR이 입력되는 부분의 플립플롭의 리세트 입력으로 제공된다. AND게이트(284)의 출력은 IRQ15플립플롭(278)과 능동 플립플롭(252,254) 및 스탠바이 스위치 플립플롭(268,270,274)을 클리어 시키는데 사용되는 클리어 신호이다.
이것으로 본 발명의 전력 보존 특징을 제공하기 위해 본 발명에 따라 컴퓨터 시스템(C)에서 사용되는 회로에 관한 상세한 설명은 종료한다. 이 회로는 본 발명의 전력 보존 기능을 수행하도록 컴퓨터 시스템(C)의 판독전용메모리에 제공된 어떤 동장 순서와 함께 사용된다.
컴퓨터 시스템(C)에 대한 전원이 초기 공급되면 제6a도의 전원 온 순서(300)가 시작된다. 전원 온 순서(300)의 최초 단계는 단계302이며 여기에서 IRQDATA선을 판독함으로써 컴퓨터 시스템(C)이 LOWBAT2조건에 있는지를 판정한다. 컴퓨터 시스템(C)이 LOWBAT2조건에 제어는 단계304로 진행하고 여기에서 사용자에게 이 상태를 경보하기 위해 12회의 경보음을 발생한다. 그다음, 제어는 단계305로 진행하여 컴퓨터 시스템(C)을 중지시킨다. 따라서, 컴퓨터 시스템(C)이 LOWBAT2조건에 있을때는 컴퓨터 시스템이 이 조건에서 벗어날때까지 사용될 수 있다. 이것은 컴퓨터 시스템(C)의 어떤 중요한 동작을 허용할 만큼 밧데리(54)의 에너지가 충분하지 않은 것으로 가정되고 데이타손실 가능성이 허용되지 않기 때문에 수행된다.
컴퓨터 시스템(C)이 LOWBAT2조건에 있지 않으면, 제어는 단계302에서 단계306으로 진행하고 여기에서 시스템의 전원 상승에 관한 다른 동작이 수행된다. 이러한 동작이 완료된 후 제어는 단계308로 진행하여 CMOS RAM(26)에 포함된 값이 유료한지를 판단한다. CMOS RAM(26)은 시스쳄(C)의 구성에 관한 어떤 값을 기억하기 위해 사용되는데 그 구성은 컴퓨터 시스템(C)이 사용자에게 이 정보를 요청하지 않거나 또는 디스크에 포함된 파일에 기억된 정보를 갖게하는 것이다. CMOS정보가 유효하면 제어는 단계310으로 진행되며, 여기에서 컴퓨터 시스템(C)은 전력보존동작이 수행되어야 하는지를 판정한다. 컴퓨터 시스템(C)의 레지스터에는 전력보존 시스템의 소망하는 초기상태를 나타내기 위한 두 비트가 기억된다. 이용가능한 3가지 상태는 전력보존 기술은 항상 이용된다. 전력보존 오프상태에 있어서, 전력보존 기술은 이용되지 않는다. 제기된 초기 상태는 전력보존 자동상태이며, 이것은 부양동작이 완료된 후에 어떤 동작시스템이 기계의 동작을 제어할 것인지를 컴퓨터 시스템(C)이 판정할 수 있도록 이용된다. 따라서 자동상태에 있어서의 전력 보존은 어떤 동작 시스템이 사용될때 인에이블되고 어떤 다른 동작 시스템이 사용될때는 동작하지 않는다. 이것은 가장 큰 동작상의 호환성을 가능케 한다.
컴퓨터 시스템(C)이 단계310에서 전력보존이 온이 되도록 선택되었다고 판정하면, 제어는 단계312로 진행하고 여기에서 전력보존 모드는 인에이블 되고 시스템 비능동 타이머 또는 능동성 모니터 타이머(T)는 CMOS(26)로부터 얻어진 값으로 설정된다. 그다음 제어는 단계314로 진행한다.
단계310에서 전력보존 모드가 항상 인에이블되지 않았다고 판정되면, 제어는 단계316으로 진행하고 여기에서 전력보존 특성이 턴오프 되었는지를 판정한다. 만일 그렇다면 제어는 단계318로 진행하여 차후 동작에서의 사용을 위해 전력보존 오프 플래그를 설정한다. 그다음 제어는 단계314로 진행한다. 단계316에서 전력보존 오프상태가 선택되지 않았으면, 또는 단계308에서 CMOS값이 무효한 것으로 판정되면 제어는 단계320으로 진행하고, 여기에서 전력 상승 푸틴의 나머지부 및 동작 시스템이 시행 및 로크되도록 컴퓨터 시스템(C)은 충분한 시간, 예컨대 70-85초 동안 자동 지연 카운터를 설정하고 그 시간후에 인터럽트가 발생된다. 이것은 동작 시스템의 충분한 시간이 컴퓨터 시스템(C)에 설치되도록 하고 컴퓨터 시스템(C)의 제어 동작이 시작되도록 한다. 동작 시스템이 자동 지연 입터럽트 루틴이 위치된 ROM메모리부에 대한 호출을 허용하지 않으면 그 선택 인터럽트에 대한 적당한 입력은 얻어지지 않을 것이고 전력보존은 인에이블되지 않는다. 또한, 단계320에서 IRQ15는 클리어되고 적당한 값을 IRQ15레지스터에 기입함으로써 디세이블된다.
마지막으로 단계320에서 시스템 비능동 타이머(T)는 디폴트 값으로 설정된다.
그다음, 제어는 단계320에서 단계314호 진행하고, 여기에서 컴퓨터 시스템(C)은 컴퓨터 시스템이 밧데리(54)에 의해 전원 공급되는지를 판단한다. 만일 그렇다면, 제어는 단계322로 진행하여 CMOS(26)가 유효한지를 확인하기 위하여 두번째의 체크를 행한다. COMS가 유효하면 제어는 단계324(제6B도)로 진행하고 여기에서 시스템 비능동 타이머(T)가 CMOS(26)에 저장된 값으로 설정된다. CMOS(26)가 유효하지 않으면 제어는 단계326으로 진행하고 시스템 비능동 타이머(T)는 디폴트 값으로 설정된다. 그다음 제어는 단계326 또는 단계324로부터 단계328로 진행한다.
단계314에서 시스템이 밧데리에 의해 전원 공급되지 않고 교류 어댑터 또는 외부 베이스 장치로부터 전원 공급되면, 제어는 단계314에서 단계330으로 진행하고, 여기에서 외부 전원으로부터 전력이 공급될때에는 전력을 보존할 필요가 없고 래치회로(210)의 제로 값은 ACTIVE*신호가 출력되는 것을 방지하므로 시스템 비능동 타임은 제로로 설정된다. 그다음 제어는 단계330에서 단계328로 진행하며, 여기에서 다른 필요한 전력 상승 및 자체 시험 동작을 수행한다. 제어는 단계328에서 단계331로 진행하고 여기에서 컴퓨터 시스템(C)은 LOWBAT2상태가 존재하는지에 대한 두번째 판정을 행한다. 만일 존재하면, 제어는 단계332로 진행하여 LOWBAT2조건이 존재함을 나타내는 가칭신호로써 12회의 경보음을 사용자에게 다시 발송한다. 그다음 제어는 단계334로 진행하여 동작 시스템이 기억 매체로부터 로드되는 부양순서를 개시한다.
컴퓨터 시스템(C)이 LOWBAT2조건에 있지 않으면, 제어는 단계331에서 단계336으로 진행하고 여기에서 컴퓨터 시스템이 LOWBAT1조건에 있는지를 확인하기 위한 시험을 행한다. 만일 그렇다면, 제어는 단계338로 진행하여 6회의 경보음을 발생하고, 따라서 사용자가 LOWBAT1과 LOWBAT2조건을 청각적으로 구별할 수 있게 한다. 그다음 제어는 단계338에서 단계334로 진행하고 또한, 컴퓨터 시스템(C)이 LOWBAT1조건에 있지 않으면 단계336으로부터 단계334로 진행한다. 여기에서 컴퓨터는 전력 부양동작 및 동작 시스템로드를 시행한다.
선택된 전원 보존 모드가 자동이었으면 단계320에서 타이머는 자동 지연 인터럽트 시간으로 설정되고 결국은 자동 지연 인터럽트가 발생한다. 그때의 기계의 제어에 있어서 동작 시스템이 적당한 루틴을 포함하는 컴퓨터 시스템(C)의 판독 전용 메모리 부로의 액세스를 허용하는 것이면, 제어는 자동 지연 인터럽트 순서(340)(제6C도)로 진행한다. 순서340에서의 제어는 단계342에서 IRQ15가 인에이블 되었는지를 컴퓨터 시스템(C)이 판정함으로써 시작된다. IRQ15가 인에이블 되었으면, 이것은 전력보존 모드가 이미 능동상태로 되고 따라서 동작에 대하여 인식되었음을 나타낸다. IRQ15가 인에이블 되었으면, 제어는 단계344로 진행하여 제어가 인터럽트 순서로 복귀된다. 단계342에서 IRQ15가 인에이블 되지 않았으면, 제어는 단계346으로 진행하고, 여기에서 소망하는 전력보존 모드가 오프되었는지를 판정한다. 만일 오프되었으면, 제어는 단계344로 진행하여 복귀된다. 전력보존 모드가 오프가 아니면, 제어는 단계348로 진행하여 전력보존을 인에이블 할 시간인지를 확인한다. 인에이블 할 시간이 아니면 제어는 단계344로 진행하고, 인에이블할 시간이면 제어는 단계350으로 진행하여 IRQ15가 인에이블되고 차후 사용을 위하여 IRQ15DATA선 또는 상태 값이 세이브된다. 그다음 제어는 단계344로 진행하여 인터럽트 순서의 동작이 재개된다.
비능동성 타이머가 스탠바이 모드에 들어갈 시점에서 타임아웃되거나 전원, 밧데리 조건, 또는 스탠바이 상태에 대한 사용자요구등 전력보존에 관한 여러가지 파라메터중 하나가 발생되면, 레벨15인터럽트 또는 IRQ15가 요구되고 IRQ15인터럽트 순서(400)가 수행된다. IRQ15는 일반적으로 정해진 인터럽트가 아니고 따라서 응용소프트웨어와의 최소 수를 이용할 수 있기 때문에 본 실시예에서는 이러한 목적으로 IRQ15를 사용한다. IRQ15순서(400)는 컴퓨터 시스템(C)이 IRQDATA선으로부터 IRQ15상태값을 판독하고 메모리의 세이브 위치로부터 구(old)IRQ15상태값을 검색하는 단계402에서 시작된다. 제어는 단계402로부터 단계404로 진행하고 여기에서 IRQ레지스터에 대한 기입동작이 수행되어 계류중인 IRQ15가 클리어 되고 인에이블 상태를 유지한다. 그다음, 제어는 단계406으로 진행하여 시스템에 미리 교류전원이 인가되어 있는지에 대한 판정을 행한다. 교류전원이 인가되어 있으면, 제어는 단계407로 진행되어 컴퓨터 시스템(C)이 밧데리 전원 동작으로 절환되어 있는지에 대한 판정을 행한다. 만일 외부 전원에 의해 전원 공급되면, 제어는 단계408로 진행하여 구 및 신IRQ15상태값이 같은지를 판정한다. 만일 같으면, 제어는 단계410으로 진행하고 여기에서 이 순서의 실행을 개시한 첫번째후 두번째로 스탠바이 키를 누름으로써 사용자가 스탠바이 요구를 취소하였는지를 판정한다. 취소하지 않았으면, 제어는 단계414로 진행하여 밧데리가 LOWBAT2조건에 있는지를 컴퓨터 시스템이 판정한다. 밧데리 전하가 LOWBAT2조건에 있지 않으면, 제어는 단계414에서 단계412로 진행하여 순서는 복귀된다. 그러나 LOWBAT2조건에 있으면 제어는 단계416으로 진행하여 사용자에게 LOWBAT2상태를 알리기 위하여 12회의 경보음을 발생한다. 이 통로는 5초동안 실행되는데 이는 5초 카운터가 AND게이트(266)를 통하여 IRQ15 NOR게이트(258)에 입력되고 컴퓨터 시스템(C)에 의한 직접 판정을 위해 IRQDATA선에 제공되지 않기 때문이다.
구 및 신IRQ15상태값이 상이하면, 제어는 단계408에서 단계418로 진행하여 LOWBAT1조건의 상태가 변화되었는지의 확인을 위한 판정을 행한다. 만일 변화되었으면, 이것은 일반적으로 LOWBAT1조건이 발생되었음을 나타내고, 제어는 단계420으로 진행하며, 여기에서 사용자에게 LOWBAT1조건이 있음을 알리기 위해 6회의 경보음을 발생하고, 밧데리 충전 LED(64)는 1Hz속도의 불꽃을 발하며, 시스템 비능동성 타이머(T)는 2분에 해당하는 값으로 설정된다. 시스템 능동성 타이머는 낮은 밧데리 조건이 존재하기 전에 밧데리에 잔류하는 에너지의 증가된 보존을 허용하기 위해 사용되는 일반적으로 10분으로부터의 이러한 낮은 값으로 설정된다. 제어는 단계420으로부터 단계422로 진행하고 제어는 인터럽트 순서로 복귀된다.
IRQ15상태 레지스터에서 LOWBAT1비트의 상태가 변화되지 않으면, 제어는 단계418에서 단계424(제7b도)로 진행한다. 단계424에서 컴퓨터 시스템(C)은 LOWBAT2비트의 상태가 변화되었는지를 판정한다. 만일 변화되었으면, 제어는 단계416으로 진행하며, 여기에서 컴퓨터 시스템(C)은 시스템(C)이 현재 LOWBAT2조건임을 알리기 위하여 12회의 경보음을 발생케하고 밧데리 충전LED(64)는 상태의 긴급성을 알리기 위해 2Hz의 속도로 점등된다. 또한 단계426에서, 시스템 비능동성 타임이 매우 짧은 연속적인 20초 간격으로 설정되어 어떤 모니터된 장치가 20초동안 사용되지 않으면 시스템은 자동적으로 스탠바이 모드로 들어가게하고, LOWBAT2조건으로부터 일단 스탠바이 모드로 들어가면 외부 전원 공급없이는 장치의 소생 또는 재시동이 불가능하다. 상기 매우 짧은 시간은 밧데리(54)에 극소량의 에너지만이 남아있고 각종 주변 장치에서 어떤 중요한 사용이 발생하면 메모리에 기억된 어떤 정보가 손실될 우려가 있기 때문이다. 그다음, 제어는 단계426에서 단계422로 진행하여 인터럽트 프로그램으로 복귀된다.
LOWBAT2비트가 변화되지 않았으면 제어는 단계424로부터 단계428로 진행하고, 여기에서 CPU(22)는 스탠바이 스위치(58)가 사용자에 의해 눌러졌는지를 판정한다. 만일 눌러졌으면, 스위치 눌러짐을 알리기 위해 2회경보음을 발생하고 시스템 비능동성 타임은 10초로 설정된다. 이때 시스템은 동작할 수 있는 모든 동작이 완료될 수 있도록 즉시 비동작 상태로 되지 않는다. 예를 들어, 사용자는 파일전송 프로그램을 시작하거나 그 응용프로그램으로부터의 세이브 동작을 시작할 수 있으며, 스탠바이 버튼(58)을 눌러서 장치의 동작을 개시시키고 장치를 그 상태로 유지시킬 준비가 되어 있다. 만일 시스템이 즉시 스탠바이 모드로 들어가면, 데이타는 필요에 따라 적당한 매체에 세이브되지 않지만, 사용자가 상당한 시간동안 방치해두면 손실될 수 있다. 그러므로 시스템은 먼저 모든 파일 전송 동작이 완료될 때까지 대기하였다가 스탠바이 모드로 들어간다. 그후 제어는 단계430에서 단계422로 진행하고 제어는 인터럽트 프로그램에서 복귀된다.
만일 단계428에서 스탠바이 스위치(58)가 눌러지지 않았다고 판정되면 제어는 단계432로 진행하고, 여기에서 밧데리를 충전하기 위하여 컴퓨터 시스템(C)에 교류전원 또는 외부전원이 인가되었는지를 확인한다. 만일 인가되었으면 시스템은 더이상 전원 보존 모드에 있을 필요가 없고 또한 시스템 비능동성 인터럽트를 수신할 필요가 없다. 따라서 단계434에서 시스템 비능동성 타임을 제로로 설정한다. 레지스터(210)의 NOTZERO신호가 발생되어 4입력 NAND게이트(222)의 한 입력으로 제공되며, 이로써 제로값이 시스템 비능동성 레치회로(202,210)에 기입될때 NAND게이트(222)의 출력은 NOTZERO신호가 저레벨로 되기 때문에 고레벨로 된다. 따라서 플립플롭(252,254)에 제공된 능동성 모니터릴 사건은 없으며, 비능동성 인터럽트는 발생되지 않는다. 그러나 전원 변환 및 밧데리 모니터링 기능은 능동상태로 유지된다. 단계434가 완료된 후 제어는 단계422로 진행하여 인터럽트 순서로 복귀한다.
단계432에서 교류 전원이 인가되지 않았으면, 제어는 단계 436으로 진행하고 여기에서 교류 전원이 제거되었는지에 대한 판정을 행한다. 만일 교류 전원이 제거되었으면 이것은 밧데리 전원 동작이 시작되었음을 나타내며, 단계438에서 CMOS(26)값이 유효한지에 대한 확인 판정을 행한다. 만일 유효하면 단계440에서 시스템 비능동성 타임은 CMOS값으로부터 설정되고, 만일 유효하지 않다면 단계442에서 시스템 비능동성 타임은 디폴트 값으로 설정된다. 그 다음 제어는 단계440 또는 442로부터 단계442로 진행하여 인터럽트프로그램으로 복귀된다.
만일 교류 전원이 제거되지 않았으면, 이것으로 비능동성 타이머를 제외한 모든 가능성이 완료되며 따라서 제어는 단계436에선 단계444(제7c도)로 진행한다. 단계444에서는 시스템이 막 스탠바이 모드로 들어감을 나타내기 위해 2회의 경보음을 발생하고 비능동성 레지스터가 클리어되며 마스크 불능 인터럽트(NMI)가 디세이블된다. 그다음, 제어는 단계446으로 진행하고 여기에서 하드 디스크(48)는 하드 디스크 제어기(34)에 적당한 명령을 제공함으로써 스탠바이 모드로 된다. 이 상태는 하드 디스크(48)가 적당한 방법으로 회전을 시작하도록 한다. 그다음 제어는 단계448로 진행하여 LCD(50) 및 배광으로의 전원이 턴오프된다. 전원이 턴오프된 후 제어는 단계450으로 진행하여 1초간 지연된다. 이때 하드 디스크가 회전될 수 있다. 2초지연이 완료된후 제어는 단계452로 진행하고 여기에서 플로피 디스크 제어기(32)의 전원을 오프시키도록하는 명령 플로피 디스크 제어기(32)에 제공된다. 단계454에서는 모뎀(30)과 하드 디스크(48)에 대한 전원이 턴오프되며, 이로써 전력 강하될 수 있는 컴퓨터 시스템의 주요 장치에 대한 전원 차단 동작이 완료된다. 그다음 단계456에서는 전원 제어 레지스터의 SLEEP비트가 설정되고, 따라서 플로피 디스크 장치(46)를 포함한 보조회로의 전원 제거 및 클럭 중단등 일련의 사건에 대한 트리거링이 행하여진다.
단계458에서는 다수의 비동작 명령이 CPU(22)에 의해 수행된다. 일련의 비동작 명령은 시스템이 이 기간동안 확실히 정지되고 어떤 이유 때문에 데이타가 전송될 필요가 있는 포텐셜 명령중에는 정지되지 않도록 하기 위해 수행된다. 비동작명령이 수행될때 시스템은 이단계(458)의 중간에서 정지되는 것으로 가정한다. CPU(22)로의 클럭이 중단되고 CPU(22)는 어떠한 동작도 지시하지 않기 때문에 시스템은 정지된다. 그 다음 시스템은 스탠바이 모드로 되고 사용자가 스탠바이 스위치(58)를 누름으로써 시스템을 소생시키고자 할때까지 최소 전력소모 모드에서 유지된다. 상기 스탠바이 스위치(58)를 누르면 제1도 및 제2도에 도시한 회로에 따라 클럭이 연속적으로 발생된 후에도 어떤 임계 명령이 수행됨이 없이 시스템이 완전한 동작상태로 될때까지 일련의 비동작 명령이 수행된다. 따라서 시스템이 안전하게 동작상태로 되고 비동작 명령이 완료된 후에 단계460에서 컴퓨터 시스템(C)이 현재 LOWBAT2모드에 있는지를 판정한다. 만일 매우 낮은 에너지가 남아 있는 조건인 LOWBAT2모드에 있으면, 제어는 단계456으로 진행하고 컴퓨터 시스템(C)은 재차 스탠바이 모드로 된다. 그러므로 컴퓨터 시스템(C)은 LOWBAT2조건에 있을때는 소생되지 않는다. 장치가 LOWBAT2조건에서 재시동되도록 시도된다면 적당한 장치에 공급되어질 에너지가 잔류 에너지에서 추출될 것이고 이때 메모리(24)에 기억된 데이타가 손실되어진다.
컴퓨터 시스템이 IRQ15상태에 있지 않다고 가정하면 제어는 단계462로 지행하고, 여기에서 현재의 CMOS상태값이 세이브되고, 메모리(24)에 기억된 시간 및 데이타 값이 CMOS(26)에 기억된 실시간 클럭으로부터 갱신되며 마스크 불능 인터럽트가 인에이블된다. 스탠바이 모드중에 통보받을 필요가 있기 때문에 시간을 갱신할 필요가 있다. 이것은 불연속성을 포함하고 있지만 다른 선택방안에 비하여 더 나은 것으로 생각된다.
그후, 제어는 단계464로 진행하며, 여기에서 모뎀(30) 및 하드 디스크(48)에 공급되는 전원이 턴온되어 이들이 동작을 시작한다. 단계466에서는 플로피 디스크 보조 시스템이 리세트되어 그 동작을 시행하도록 하고 디스크 변환선이 세트된다. 디스크 변환선은 플로피 디스크 장치(46)내에 있는 플로피 디스크가 변환되어짐을 나타내는 선이고 따라서 디스크에 포함된 디렉토리 정보 및 다른 정보를 재결정할 필요가 있다. 이 선은 스탠바이 상태중에 사용자가 플로피 디스크를 교체할 수 있기 때문에 이 단계에서 설정되어야 하며, 시스템이 스탠바이 상태에 있기 때문에 그 변화는 통보되지 않는다. 컴퓨터 시스템(C)은 구 플로피 디스크 정보를 사용하는 신 플로피 디스크를 잘못된 결과로써 호출하려고 할 것이다.
그다음, 제어는 단계466에서 단계468로 진행하여 LCD(50) 및 그 배광으로의 전원이 턴온된다. 단계470에서는 스탠바이 순서중에 발생되거나 여러가지 아이템에 대한 여러가지 전원 공급 때문에 발생되는 어떤 가능한 키이 스트로크 또는 스트레이 키이 스트로크를 제거하도록 키이보트 버퍼가 플러쉬된다. 또한 단계470에서는 시스템 비능동성 타임이 주어진 최종값으로 설정되고 그다음 제어는 단계472로 진행하여 인터럽트 프로그램으로 복귀된다. 이로써 스탠바이 순서의 동작이 완료된다.
따라서 본 발명에 따른 컴퓨터 시스템은 여러가지 전력 소모 관련 사건들을 모니터하고, 사용자에게 어떤 변화를 통지하며 모니터된 시스템 장치가 사용된 후 적절한 시간에 비능동 상태로 된다.
본 발명에 대하여 지금까지 행한 설명은 단지 설명을 위한 것이며, 본 발명의 취지에서 일탈함이 없이 그 크기, 모양, 물질, 구성부품, 회로소자, 배선 접속 및 접점 뿐만아니라 회로 구성 및 그 동작방법에 있어서 여러가지로 변화시킬수 있음을 알아야 한다.

Claims (13)

  1. 밧데리 전원인 컴퓨터 시스템의 전력소모 감소 장치에 있어서, 컴퓨터 시스템에서 어드레스 및 데이타 정보를 전송하는 어드레스 및 데이타버스와; 상기 어드레스 및 데이타 버스상에 액세스 될 수 있고 각각 전원 차단될 수 있는 복수의 주변장치와; 상기 어드레스 및 데이타 버스상에 어드레스를 제공함으로써 상기주변장치를 액세스하는 수단과; 상기 주변장치중의 하나가 액세스되는지를 판정하기 위하여 상기 액세스 수단에 의해 상기 어드레스 및 데이타 버스에 제공된 어드레스를 분석하고 분석결과를 나타내는 신호를 발생하는 수단과; 상기 주변장치중 어느하나가 액세스된 후 상기 분석수단의 신호에 응하여 시간간격을 정하는 수단과; 상기 시간간격이 소정치를 초과할 때에 전력소모 감소상태에 들어가도록 상기 주변장치의 전원을 차단하는 수단을 구비한 것을 특징으로하는 전력소모감소장치.
  2. 제1항에 있어서, 복수의 회로장치에 대한 전원을 인에이블 시키는 수단과; 상기 시간간격이 소정치를 초과할 때에 상기 복수의 회로장치에 대한 전원을 디세이블 시키는 수단을 아울러 구비한 것을 특징으로 하는 전력소모감소장치.
  3. 제1항에 있어서, 컴퓨터 시스템을 구성하는 회로의 일부에 시스템 클럭을 제공하는 시스템 클럭 수단과; 상기 시간간격이 소정치를 초과할 때 상기 회로 부분에 대한 시스템 클럭을 디세이블 시키는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  4. 제1항에 있어서, 컴퓨터 시스템이 교류 전원으로부터 전원 공급될때 상기 전원차단 수단을 디세이블시키는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  5. 제1항에 있어서, 상기 주변장치가 상기 전원차단 수단에 의해 전원차단된후 상기 주변장치에 전원을 공급하는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  6. 제5항에 있어서, 상기 전원공급 수단은 전력소모감소 상태로 유지하고자함을 지시하기 위하여 사용자가 작동시키는 스위치를 구비한 것을 특징으로하는 전력소모감소장치.
  7. 제5항에 있어서, 컴퓨터 시스템의 밧데리 잔류에너지가 소정치 이하일때 상기 주변장치에 대한 전원공급 수단을 디세이블시키는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  8. 제1항에 있어서, 사용자가 희망할때 상기 전원차단 수단을 디세이블 시키는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  9. 제1항에 있어서, 상기 전원차단 수단을 초기 디세이블 시키는 수단과; 동작 시스템으로 하여금 컴퓨터 시스템의 동작을 제어하도록하는 수단과; 동작시스템의 제어후 컴퓨터 시스템의 동작을 중단시키는 수단과; 동작시스템이 상기 중단에 응답할때 상기 중단에 응답하여 상기 전원차단 수단을 인에이블시키는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  10. 제1항에 있어서, 컴퓨터 시스템의 밧데리 잔류에너지가 제1의 주어진 레벨이하일때 상기 소정치의 시간간격을 감소시키는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  11. 제10항에 있어서, 밧데리 잔류에너지가 제2의 주어진 레벨 이하이고 상기 제2의 주어진 레벨이 상기 제1의 주어진 레벨 이하일때 상기 소정치의 시간간격을 더욱 감소시키는 수단을 아울러 구비한 것을 특징으로 하는 전력소모감소장치.
  12. 제1항에 있어서, 사용자로부터 제공된 신호에 응답하여 상기 소정치의 시간간격을 감소시키는 수단을 아울러 구비한 것을 특징으로하는 전력소모감소장치.
  13. 제1항에 있어서, 사용자로부터의 명령에 응답하여 상기 소정치의 시간간격을 수정하는 수단을 아울러 구비한 것을 특징으로 하는 전력소모감소장치.
KR1019890014811A 1988-10-14 1989-10-14 컴퓨터 시스템의 전력 소모 감소 장치 KR970006390B1 (ko)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
US257,954 1988-10-14
US257954 1988-10-14
US07/257,954 US4980836A (en) 1988-10-14 1988-10-14 Apparatus for reducing computer system power consumption

Publications (2)

Publication Number Publication Date
KR900006842A KR900006842A (ko) 1990-05-09
KR970006390B1 true KR970006390B1 (ko) 1997-04-28

Family

ID=22978492

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019890014811A KR970006390B1 (ko) 1988-10-14 1989-10-14 컴퓨터 시스템의 전력 소모 감소 장치

Country Status (7)

Country Link
US (2) US4980836A (ko)
EP (2) EP0623869B1 (ko)
JP (1) JP3260355B2 (ko)
KR (1) KR970006390B1 (ko)
CA (1) CA1332005C (ko)
DE (2) DE68921405T3 (ko)
ES (1) ES2068900T3 (ko)

Families Citing this family (249)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5590343A (en) * 1988-12-09 1996-12-31 Dallas Semiconductor Corporation Touch-sensitive switching circuitry for power-up
US5182810A (en) * 1989-05-31 1993-01-26 Dallas Semiconductor Corp. Isolation gates to permit selective power-downs within a closely-coupled multi-chip system
US5227981A (en) * 1989-04-20 1993-07-13 Sanyo Electric Co., Ltd. Initial process system after cutoff of power source and process system at the time of cutoff of power source
US5155809A (en) * 1989-05-17 1992-10-13 International Business Machines Corp. Uncoupling a central processing unit from its associated hardware for interaction with data handling apparatus alien to the operating system controlling said unit and hardware
US5293494A (en) * 1989-06-23 1994-03-08 Kabushiki Kaisha Toshiba Personal computer for setting, in a software setup operation normal/reverse display, connection of an external device, and an automatic display off function
DE479887T1 (de) * 1989-06-30 1992-12-17 Poqet Computer Corp., Santa Clara, Calif. Stromversorgungsmanagementsystem fuer rechner.
US5167024A (en) * 1989-09-08 1992-11-24 Apple Computer, Inc. Power management for a laptop computer with slow and sleep modes
JP2877378B2 (ja) * 1989-09-29 1999-03-31 株式会社東芝 パーソナルコンピュータ
KR910006834A (ko) * 1989-09-29 1991-04-30 아오이 죠이치 전원회로의 제조건에 의해 휘도를 변경시킬수 있는 디스플레이 제어장치
JPH03119416A (ja) * 1989-10-03 1991-05-21 Toshiba Corp コンピュータシステム
US5218704A (en) * 1989-10-30 1993-06-08 Texas Instruments Real-time power conservation for portable computers
US6158012A (en) * 1989-10-30 2000-12-05 Texas Instruments Incorporated Real-time power conservation and thermal management for computers
US5247655A (en) * 1989-11-07 1993-09-21 Chips And Technologies, Inc. Sleep mode refresh apparatus
US5201059A (en) * 1989-11-13 1993-04-06 Chips And Technologies, Inc. Method for reducing power consumption includes comparing variance in number of time microprocessor tried to react input in predefined period to predefined variance
US5287525A (en) * 1989-11-29 1994-02-15 Linear Technology Corporation Software controlled power shutdown in an integrated circuit
JPH03171310A (ja) * 1989-11-30 1991-07-24 Toshiba Corp パーソナルコンピュータ
JPH03245180A (ja) * 1990-02-23 1991-10-31 Toshiba Corp パネルディスプレイの輝度制御装置
US5355501A (en) * 1990-03-09 1994-10-11 Novell, Inc. Idle detection system
EP0448350B1 (en) * 1990-03-23 1996-12-27 Matsushita Electric Industrial Co., Ltd. Hand held data processing apparatus having reduced power consumption
US6804791B2 (en) 1990-03-23 2004-10-12 Matsushita Electric Industrial Co., Ltd. Data processing apparatus
GB9009703D0 (en) * 1990-04-30 1990-06-20 Hewlett Packard Co Computer log-on device
JPH0413179A (ja) * 1990-05-07 1992-01-17 Mitsubishi Electric Corp 表示制御装置
US5396635A (en) * 1990-06-01 1995-03-07 Vadem Corporation Power conservation apparatus having multiple power reduction levels dependent upon the activity of the computer system
SG63562A1 (en) * 1990-06-18 1999-03-30 Seiko Epson Corp Flat display device and display body driving device
JPH04107623A (ja) * 1990-08-28 1992-04-09 Seiko Epson Corp 表示装置
EP0474963A3 (en) * 1990-09-13 1992-04-15 Kabushiki Kaisha Toshiba Computer system having sleep mode function
US5175853A (en) * 1990-10-09 1992-12-29 Intel Corporation Transparent system interrupt
US5410712A (en) * 1990-10-16 1995-04-25 Kabushiki Kaisha Toshiba Computer system equipped with extended unit including power supply
US5280283A (en) * 1990-11-09 1994-01-18 Ast Research, Inc. Memory mapped keyboard controller
US5237692A (en) * 1990-11-09 1993-08-17 Ast Research Inc. Internal interrupt controller for a peripheral controller
US5414860A (en) * 1991-01-29 1995-05-09 International Business Machines Incorporated Power management initialization for a computer operable under a plurality of operating systems
FI88657C (fi) * 1991-02-12 1993-06-10 Nokia Mobile Phones Ltd Foerfarande foer att minska stroemfoerbrukningen i en mobiltelefon
US5410711A (en) * 1991-02-14 1995-04-25 Dell Usa, L.P. Portable computer with BIOS-independent power management
US5566340A (en) * 1991-02-14 1996-10-15 Dell Usa L.P. Portable computer system with adaptive power control parameters
US5504907A (en) * 1991-02-14 1996-04-02 Dell Usa, L.P. Power management system with adaptive control parameters for portable computer
US5987613A (en) * 1991-02-14 1999-11-16 Dell Computer Corporation Portable computer with time-sensitive tri-modal power management switch
US5203003A (en) * 1991-03-28 1993-04-13 Echelon Corporation Computer architecture for conserving power by using shared resources and method for suspending processor execution in pipeline
US5432946A (en) * 1991-04-11 1995-07-11 International Business Machines Corp. LAN server personal computer with unattended activation capability
US5303171A (en) * 1992-04-03 1994-04-12 Zenith Data Systems Corporation System suspend on lid close and system resume on lid open
US5652890A (en) * 1991-05-17 1997-07-29 Vantus Technologies, Inc. Interrupt for a protected mode microprocessor which facilitates transparent entry to and exit from suspend mode
US5394527A (en) * 1991-05-17 1995-02-28 Zenith Data Systems Corporation Method and apparatus facilitating use of a hard disk drive in a computer system having suspend/resume capability
EP0584257B1 (en) 1991-05-17 2004-08-04 Packard Bell NEC, Inc. Power management capability for a microprocessor having backward compatibility
US5446904A (en) 1991-05-17 1995-08-29 Zenith Data Systems Corporation Suspend/resume capability for a protected mode microprocessor
FR2677470B3 (fr) * 1991-06-04 1993-05-21 Datatech Enterprises Co Ltd Dispositif de commande d'alimentation en courant pour un micro-ordinateur.
JP3096489B2 (ja) * 1991-07-09 2000-10-10 富士通株式会社 ディスク装置
US5414861A (en) * 1991-09-11 1995-05-09 Fujitsu Limited Data protection system using different levels of reserve power to maintain data in volatile memories for any period of time
US5532935A (en) * 1991-10-02 1996-07-02 Kabushiki Kaisha Toshiba Electronic device capable of automatically controlling power assumption of components employed in accordance with operating time period by user
JPH05108218A (ja) * 1991-10-11 1993-04-30 Toshiba Corp コンピユータシステム
US5935253A (en) * 1991-10-17 1999-08-10 Intel Corporation Method and apparatus for powering down an integrated circuit having a core that operates at a speed greater than the bus frequency
US5842029A (en) * 1991-10-17 1998-11-24 Intel Corporation Method and apparatus for powering down an integrated circuit transparently and its phase locked loop
GB2260631B (en) * 1991-10-17 1995-06-28 Intel Corp Microprocessor 2X core design
JP3237926B2 (ja) * 1991-12-04 2001-12-10 シャープ株式会社 デジタル電子機器用電力制御装置、該電力制御装置を備えた処理装置、及び該処理装置を備えたデジタル電子機器用電力管理システム
US5832286A (en) * 1991-12-04 1998-11-03 Sharp Kabushiki Kaisha Power control apparatus for digital electronic device
WO1993012480A1 (en) 1991-12-17 1993-06-24 Compaq Computer Corporation Apparatus for reducing computer system power consumption
US5369771A (en) * 1991-12-23 1994-11-29 Dell U.S.A., L.P. Computer with transparent power-saving manipulation of CPU clock
JPH05324139A (ja) * 1992-01-16 1993-12-07 Intel Corp Ｍｃｕのパワーダウン制御方式
US5554966A (en) * 1992-01-20 1996-09-10 Pioneer Electronic Corporation Car-stereo with removable control panel, alarm, and power conservation
US5640176A (en) * 1992-01-24 1997-06-17 Compaq Computer Corporation User interface for easily setting computer speaker volume and power conservation levels
GB2264794B (en) * 1992-03-06 1995-09-20 Intel Corp Method and apparatus for automatic power management in a high integration floppy disk controller
US6343363B1 (en) 1994-09-22 2002-01-29 National Semiconductor Corporation Method of invoking a low power mode in a computer system using a halt instruction
JP3058986B2 (ja) * 1992-04-02 2000-07-04 ダイヤセミコンシステムズ株式会社 コンピュータシステムの節電制御装置
US6193422B1 (en) 1992-04-03 2001-02-27 Nec Corporation Implementation of idle mode in a suspend/resume microprocessor system
JP2986299B2 (ja) * 1992-04-15 1999-12-06 インターナショナル・ビジネス・マシーンズ・コーポレイション 周辺装置接続検出システム
US5349668A (en) * 1992-04-15 1994-09-20 International Business Machines Battery operated computer having improved battery monitor and cell reversal protection circuit
US5423045A (en) * 1992-04-15 1995-06-06 International Business Machines Corporation System for distributed power management in portable computers
JPH0651727A (ja) * 1992-06-04 1994-02-25 Toshiba Corp 表示制御方法及び表示制御装置
US5452434A (en) * 1992-07-14 1995-09-19 Advanced Micro Devices, Inc. Clock control for power savings in high performance central processing units
DE4226704A1 (de) * 1992-08-12 1994-02-17 Becker Autoradio Verfahren zum Betreiben einer Anlage mit mehreren an ein Bus-System angeschlossenen Komponenten und Schnittstellen-Schaltungsanordnung zur Durchführung des Verfahrens
US5821924A (en) * 1992-09-04 1998-10-13 Elonex I.P. Holdings, Ltd. Computer peripherals low-power-consumption standby system
US5389952A (en) * 1992-12-02 1995-02-14 Cordata Inc. Low-power-consumption monitor standby system
US5416726A (en) * 1992-10-06 1995-05-16 Microsoft Corporation Method and system for placing a computer in a reduced power state
JP2737571B2 (ja) * 1992-10-07 1998-04-08 日本電気株式会社 フロッピィ・ディスク・コントローラ
US5473767A (en) * 1992-11-03 1995-12-05 Intel Corporation Method and apparatus for asynchronously stopping the clock in a processor
US5392437A (en) * 1992-11-06 1995-02-21 Intel Corporation Method and apparatus for independently stopping and restarting functional units
US7064749B1 (en) 1992-11-09 2006-06-20 Adc Technology Inc. Portable communicator
JP3313848B2 (ja) * 1992-11-10 2002-08-12 インフィニット テクノロジー コーポレーション ロジックネットワーク
US5339445A (en) * 1992-11-16 1994-08-16 Harris Corporation Method of autonomously reducing power consumption in a computer sytem by compiling a history of power consumption
US5867720A (en) * 1992-12-14 1999-02-02 Canon Kabushiki Kaisha Printing apparatus and a method therefor, and information processing apparatus and a method therefor
US5335168A (en) * 1993-01-13 1994-08-02 Compaq Computer Corporation Computer system with power-down mode for monitor
US5603036A (en) * 1993-02-19 1997-02-11 Intel Corporation Power management system for components used in battery powered applications
US5396637A (en) * 1993-03-02 1995-03-07 Hewlett-Packard Company Data processing system with power-fail protected memory module
US5485623A (en) * 1993-03-10 1996-01-16 Hitachi, Ltd. Information processor having high speed and safety resume system
US5586332A (en) * 1993-03-24 1996-12-17 Intel Corporation Power management for low power processors through the use of auto clock-throttling
US5337285A (en) * 1993-05-21 1994-08-09 Rambus, Inc. Method and apparatus for power control in devices
EP0633518A1 (en) * 1993-05-27 1995-01-11 Picopower Technology Inc. Circuit for generating modular clocking signals
US5488565A (en) * 1993-05-28 1996-01-30 Abb Power T&D Company Inc. Tamper detection methods and apparatus for load management terminals
US5446906A (en) * 1993-06-30 1995-08-29 Intel Corporation Method and apparatus for suspending and resuming a keyboard controller
US5638083A (en) * 1993-07-07 1997-06-10 Chips And Technologies, Inc. System for allowing synchronous sleep mode operation within a computer
US5477476A (en) * 1993-07-14 1995-12-19 Bayview Technology Group, Inc. Power-conservation system for computer peripherals
US5408668A (en) * 1993-07-28 1995-04-18 Tornai; Richard Method and apparatus for controlling the provision of power to computer peripherals
US5428765A (en) * 1993-08-12 1995-06-27 Databook Incorporated Method and apparatus for disabling and restarting clocks
US5440747A (en) * 1993-09-27 1995-08-08 Hitachi America, Ltd. Data processor with control logic for storing operation mode status and associated method
US5412585A (en) * 1993-10-25 1995-05-02 Hamilton; Scott L. Ultrasonic control disk drive system
US5542035A (en) * 1993-10-27 1996-07-30 Elonex Technologies Timer-controlled computer system shutdown and startup
US6061803A (en) * 1993-11-15 2000-05-09 International Microcircuits, Inc. Variable frequency clock for an electronic system and method therefor
US5442794A (en) * 1993-12-01 1995-08-15 Advanced Micro Devices, Inc. Disable technique employed during low battery conditions within a portable computer system
US6865684B2 (en) * 1993-12-13 2005-03-08 Hewlett-Packard Development Company, L.P. Utilization-based power management of a clocked device
US5481732A (en) * 1993-12-14 1996-01-02 Shahbazi; Horyeh D. CRT monitor power control unit
JPH07182857A (ja) * 1993-12-24 1995-07-21 Toshiba Corp マイコンシステム
US5706407A (en) * 1993-12-28 1998-01-06 Kabushiki Kaisha Toshiba System for reallocation of memory banks in memory sized order
US5617576A (en) * 1993-12-29 1997-04-01 Intel Corporation Method of slowing down code execution in a microprocessor including an internal cache memory
US5452277A (en) * 1993-12-30 1995-09-19 International Business Machines Corporation Adaptive system for optimizing disk drive power consumption
KR0141675B1 (ko) * 1993-12-30 1998-07-15 김광호 전자 사진 기록장치의 절전 프린팅방법
DE69517712T2 (de) * 1994-01-10 2001-03-08 Sun Microsystems, Inc. Verfahren und Vorrichtung zur Reduzierung der Leistungsaufnahme in einem Rechnersystem
US5535400A (en) * 1994-01-28 1996-07-09 Compaq Computer Corporation SCSI disk drive power down apparatus
EP0666525B1 (en) * 1994-02-04 2001-09-12 Intel Corporation Method and apparatus for control of power consumption in a computer system
US5632038A (en) * 1994-02-22 1997-05-20 Dell Usa, L.P. Secondary cache system for portable computer
FR2717278B1 (fr) * 1994-03-10 1996-06-07 Van Trong Nguyen Alimentation pour l'unité centrale et les périphériques de micro-ordinateurs possédant une logique de gestion du fonctionnement du ventilateur et des tensions de sorties.
KR0130621B1 (ko) * 1994-04-27 1998-04-09 김광호 전자사진 현상 방식 프린터의 절전 프린팅 방법
WO1995031029A2 (en) * 1994-05-10 1995-11-16 Apple Computer, Inc. A method and apparatus for controlling power for subsystems
CA2186349C (en) * 1994-05-12 2008-09-23 James C. Bunnell Cpu activity monitoring through cache watching
JP2858542B2 (ja) * 1994-06-03 1999-02-17 インターナショナル・ビジネス・マシーンズ・コーポレイション コンピュータ用ディスク・ドライブの電力消費を節減する方法及び装置
US5481733A (en) * 1994-06-15 1996-01-02 Panasonic Technologies, Inc. Method for managing the power distributed to a disk drive in a laptop computer
US5752011A (en) * 1994-06-20 1998-05-12 Thomas; C. Douglas Method and system for controlling a processor's clock frequency in accordance with the processor's temperature
US7167993B1 (en) 1994-06-20 2007-01-23 Thomas C Douglass Thermal and power management for computer systems
US5721934A (en) * 1994-06-29 1998-02-24 Intel Corporation Retrofit external power saving system and method for use
US5513361A (en) * 1994-07-25 1996-04-30 Intel Corporation Method and apparatus for reducing power consumption of a fan in a computer system
US5630142A (en) * 1994-09-07 1997-05-13 International Business Machines Corporation Multifunction power switch and feedback led for suspend systems
US5603038A (en) * 1994-09-07 1997-02-11 International Business Machines Corporation Automatic restoration of user options after power loss
AU3313795A (en) * 1994-10-14 1996-04-26 Compaq Computer Corporation Circuit for placing a cache memory into low power mode in response to special bus cycles
DE69522633T2 (de) * 1994-10-19 2002-07-04 Advanced Micro Devices, Inc. Integrierte Prozessorsysteme für tragbare Informationsgeräte
US5585792A (en) * 1994-10-24 1996-12-17 Usar Systems Inc. Enegry-saving keyboard
US20040113794A1 (en) * 1994-10-27 2004-06-17 Dan Schlager Self-locating personal alarm system equipped parachute
JPH08235761A (ja) * 1994-11-17 1996-09-13 Integral Peripherals Inc ディスク駆動装置における電力節減の方法
KR0145653B1 (ko) * 1994-12-01 1998-09-15 김광호 절전기능을 구비한 액정표시장치 구동회로
US5594441A (en) * 1994-12-30 1997-01-14 Psc, Inc. D/A converter with constant gate voltage
US5625569A (en) * 1995-01-23 1997-04-29 Trimmer Engineering, Inc. Low power flow measuring device
JPH08202468A (ja) * 1995-01-27 1996-08-09 Hitachi Ltd マルチプロセッサシステム
JP2892963B2 (ja) * 1995-02-28 1999-05-17 キヤノン株式会社 バッテリ駆動型コンピュータ
US5692197A (en) * 1995-03-31 1997-11-25 Sun Microsystems, Inc. Method and apparatus for reducing power consumption in a computer network without sacrificing performance
US5737615A (en) * 1995-04-12 1998-04-07 Intel Corporation Microprocessor power control in a multiprocessor computer system
TW327707B (en) * 1995-05-18 1998-03-01 Motorola Inc Method for producing power consumption in a portable electronic device with a liquid crystal display screen
KR0135453B1 (ko) * 1995-05-18 1998-05-15 김광호 전자사진 현상 방식 화상형성 장치의 전원 절약 방법
JP3075957B2 (ja) * 1995-05-30 2000-08-14 株式会社東芝 コンピュータシステム
JPH08328684A (ja) 1995-05-30 1996-12-13 Toshiba Corp コンピュータシステム
EP0749063A3 (en) * 1995-06-07 1999-01-13 International Business Machines Corporation Method and apparatus for suspend/resume operation in a computer
US5682273A (en) * 1995-06-30 1997-10-28 International Business Machines Corporation Disk drive for portable computer with adaptive demand-driven power management
US5877483A (en) * 1995-07-18 1999-03-02 Dell Usa, L.P. Method and apparatus for automatically implementing computer power on and logon functions using encoded ID card
JP2974950B2 (ja) * 1995-10-26 1999-11-10 インターナショナル・ビジネス・マシーンズ・コーポレイション 情報処理システム
KR0167648B1 (ko) * 1995-10-10 1999-01-15 김광호 일체형 컴퓨터의 전원 공급 제어 장치 및 그 방법
FR2741487B1 (fr) * 1995-11-17 1998-01-02 Moulinex Sa Procede de commande de puissance d'une charge via un systeme a reglage de phase et dispositif de mise en oeuvre de ce procede
DE19543942B4 (de) * 1995-11-25 2004-04-08 Grundig Ag I.Ins. Statusanzeige für ein Bildschirmsichtgerät
US5744944A (en) * 1995-12-13 1998-04-28 Sgs-Thomson Microelectronics, Inc. Programmable bandwidth voltage regulator
US5796992A (en) * 1995-12-20 1998-08-18 Compaq Computer Corporation Circuit for switching between synchronous and asynchronous memory refresh cycles in low power mode
US5721935A (en) * 1995-12-20 1998-02-24 Compaq Computer Corporation Apparatus and method for entering low power mode in a computer system
US5740454A (en) 1995-12-20 1998-04-14 Compaq Computer Corporation Circuit for setting computer system bus signals to predetermined states in low power mode
US5834956A (en) 1995-12-29 1998-11-10 Intel Corporation Core clock correction in a 2/N mode clocking scheme
US5802132A (en) * 1995-12-29 1998-09-01 Intel Corporation Apparatus for generating bus clock signals with a 1/N characteristic in a 2/N mode clocking scheme
US5821784A (en) * 1995-12-29 1998-10-13 Intel Corporation Method and apparatus for generating 2/N mode bus clock signals
KR100189781B1 (ko) * 1996-05-07 1999-06-01 윤종용 디스플레이 장치 및 그의 전원공급제어방법
US6115799A (en) * 1996-07-19 2000-09-05 Canon Kabushiki Kaisha Information processing apparatus and associated method for managing a memory using a next fit and for reducing a memory fragmentation problem
US5826067A (en) * 1996-09-06 1998-10-20 Intel Corporation Method and apparatus for preventing logic glitches in a 2/n clocking scheme
US5862373A (en) * 1996-09-06 1999-01-19 Intel Corporation Pad cells for a 2/N mode clocking scheme
US5847698A (en) * 1996-09-17 1998-12-08 Dataventures, Inc. Electronic book device
US5903746A (en) * 1996-11-04 1999-05-11 Texas Instruments Incorporated Apparatus and method for automatically sequencing clocks in a data processing system when entering or leaving a low power state
US5790609A (en) * 1996-11-04 1998-08-04 Texas Instruments Incorporated Apparatus for cleanly switching between various clock sources in a data processing system
US5831805A (en) * 1997-02-13 1998-11-03 Sony Corporation Local power failure detection and clock disabling circuit
US6201580B1 (en) 1997-03-31 2001-03-13 Compaq Computer Corporation Apparatus for supporting multiple video resources
US6295090B1 (en) 1997-03-31 2001-09-25 Compaq Computer Corporation Apparatus for providing video resolution compensation when converting one video source to another video source
US6314523B1 (en) 1997-04-09 2001-11-06 Compaq Computer Corporation Apparatus for distributing power to a system of independently powered devices
US6115823A (en) 1997-06-17 2000-09-05 Amphus, Inc. System and method for task performance based dynamic distributed power management in a computer system and design method therefor
US5987614A (en) * 1997-06-17 1999-11-16 Vadem Distributed power management system and method for computer
US6411156B1 (en) * 1997-06-20 2002-06-25 Intel Corporation Employing transistor body bias in controlling chip parameters
US6928559B1 (en) * 1997-06-27 2005-08-09 Broadcom Corporation Battery powered device with dynamic power and performance management
JP3720986B2 (ja) * 1997-07-22 2005-11-30 株式会社東芝 デジタル放送受信装置
US5954820A (en) * 1997-09-26 1999-09-21 International Business Machines Corporation Portable computer with adaptive demand-driven power management
KR19990041695A (ko) * 1997-11-24 1999-06-15 윤종용 컴퓨터 시스템에 있어서 옵션 카드의 전원 강제 차단 장치
US5987615A (en) * 1997-12-22 1999-11-16 Stmicroelectronics, Inc. Programmable load transient compensator for reducing the transient response time to a load capable of operating at multiple power consumption levels
JPH11212687A (ja) * 1998-01-26 1999-08-06 Fujitsu Ltd バス制御装置
JP4028064B2 (ja) * 1998-02-13 2007-12-26 富士通株式会社 ディスプレイ装置
KR100306697B1 (ko) 1998-07-23 2001-11-30 윤종용 유니버설시리얼버스의전원공급을제어하는휴대용컴퓨터시스템및그제어방법
US20020040377A1 (en) * 1998-09-25 2002-04-04 Newman Edward G. Computer with audio interrupt system
US6484265B2 (en) 1998-12-30 2002-11-19 Intel Corporation Software control of transistor body bias in controlling chip parameters
US6317839B1 (en) 1999-01-19 2001-11-13 International Business Machines Corporation Method of and apparatus for controlling supply of power to a peripheral device in a computer system
JP4325817B2 (ja) 1999-04-05 2009-09-02 株式会社日立製作所 ディスクアレイ装置
US6408397B1 (en) 1999-05-24 2002-06-18 Dell Usa, L.P. Using RTC wake-up to enable recovery from power failures
WO2000077785A1 (fr) * 1999-06-15 2000-12-21 Hitachi, Ltd. Systeme de reproduction et circuit integre
US6611920B1 (en) * 2000-01-21 2003-08-26 Intel Corporation Clock distribution system for selectively enabling clock signals to portions of a pipelined circuit
US6635014B2 (en) 2000-01-21 2003-10-21 Timothy J. Starkweather Ambulatory medical apparatus and method having telemetry modifiable control software
US6665802B1 (en) 2000-02-29 2003-12-16 Infineon Technologies North America Corp. Power management and control for a microcontroller
US7822967B2 (en) * 2000-09-27 2010-10-26 Huron Ip Llc Apparatus, architecture, and method for integrated modular server system providing dynamically power-managed and work-load managed network devices
USRE40866E1 (en) 2000-09-27 2009-08-04 Huron Ip Llc System, method, and architecture for dynamic server power management and dynamic workload management for multiserver environment
US7228441B2 (en) 2000-09-27 2007-06-05 Huron Ip Llc Multi-server and multi-CPU power management system and method
US20070245165A1 (en) 2000-09-27 2007-10-18 Amphus, Inc. System and method for activity or event based dynamic energy conserving server reconfiguration
US7032119B2 (en) 2000-09-27 2006-04-18 Amphus, Inc. Dynamic power and workload management for multi-server system
FR2818396B1 (fr) * 2000-12-15 2003-04-11 Thomson Csf Terminal de paiement electronique fixe avec une fonction de sauvegarde d'alimentation
FR2818397B1 (fr) * 2000-12-15 2003-04-11 Thomson Csf Terminal de paiement electronique equipe d'un dispositif permettant d'economiser de l'energie
US6704061B2 (en) * 2001-01-04 2004-03-09 Rhomson Licensing S.A. Temporary simulated off state in a restart of a video display
US20030196126A1 (en) 2002-04-11 2003-10-16 Fung Henry T. System, method, and architecture for dynamic server power management and dynamic workload management for multi-server environment
US7058834B2 (en) * 2001-04-26 2006-06-06 Paul Richard Woods Scan-based state save and restore method and system for inactive state power reduction
US6701283B2 (en) * 2001-05-15 2004-03-02 Dell Products L.P. Apparatus for processing items of electronic equipment
US7245725B1 (en) * 2001-05-17 2007-07-17 Cypress Semiconductor Corp. Dual processor framer
US7034814B2 (en) 2001-07-13 2006-04-25 Apple Computer, Inc. Methods and apparatuses using control indicators for data processing systems
US7003682B2 (en) * 2001-07-17 2006-02-21 Koninklijke Philips Electronics N.V. Power management method for setting clock circuit into power down mode if analog front end circuit is sampling input signals in an electronic device
US7139565B2 (en) 2002-01-08 2006-11-21 Seven Networks, Inc. Connection architecture for a mobile network
TW561332B (en) * 2002-02-01 2003-11-11 Via Tech Inc Method for determining power-saving mode
JP2003270368A (ja) * 2002-03-13 2003-09-25 Seiko Instruments Inc 電子時計
US7670224B2 (en) * 2002-04-03 2010-03-02 Igt Gaming apparatus with power saving feature
US7143275B2 (en) * 2002-08-01 2006-11-28 Hewlett-Packard Development Company, L.P. System firmware back-up using a BIOS-accessible pre-boot partition
US7372928B1 (en) 2002-11-15 2008-05-13 Cypress Semiconductor Corporation Method and system of cycle slip framing in a deserializer
JP3962924B2 (ja) * 2003-03-20 2007-08-22 セイコーエプソン株式会社 半導体装置、半導体回路、電子機器及びクロック供給制御方法
US7454643B2 (en) * 2003-04-30 2008-11-18 Marvell World Trade Ltd. Pre-emptive power supply control system and method
TW591372B (en) * 2003-05-15 2004-06-11 High Tech Comp Corp Power control method of portable electronic device, portable electronic device and electronic system
KR100737887B1 (ko) * 2003-05-20 2007-07-10 삼성전자주식회사 구동회로, 이를 갖는 평판표시장치 및 이의 구동방법
US20050044449A1 (en) * 2003-08-19 2005-02-24 Dunstan Robert A. Power button and device wake event processing methods in the absence of AC power
JP4003727B2 (ja) * 2003-09-22 2007-11-07 ブラザー工業株式会社 通信手段を備えた携帯型プリンタ
JP4486348B2 (ja) * 2003-11-26 2010-06-23 株式会社日立製作所 ドライブの稼働時間を抑止するディスクアレイ
TWI242133B (en) * 2003-12-02 2005-10-21 Via Tech Inc Interrupt signal control method
US7185229B2 (en) * 2003-12-04 2007-02-27 International Business Machines Corporation Method and system for performing remote maintenance operations on a battery powered computer
GB2411269B (en) * 2004-01-16 2005-12-07 Hitachi Ltd Disk array apparatus and disk array apparatus controlling method
JP4518541B2 (ja) 2004-01-16 2010-08-04 株式会社日立製作所 ディスクアレイ装置及びディスクアレイ装置の制御方法
JP4634049B2 (ja) 2004-02-04 2011-02-16 株式会社日立製作所 ディスクアレイ装置における異常通知制御
US7609472B2 (en) * 2004-06-01 2009-10-27 Hewlett-Packard Development Company, L.P. Power and thermal management for a hard drive
US7173450B2 (en) * 2004-06-01 2007-02-06 Hewlett-Packard Development Company, L.P. Bus controller
US7190121B2 (en) * 2004-08-19 2007-03-13 Intel Corporation Systems and methods to control light-emitting diodes
US20060046804A1 (en) * 2004-08-31 2006-03-02 Schultz Charles P Method and system for selectively controlling the operation of a power source
US20060046806A1 (en) * 2004-08-31 2006-03-02 Schultz Charles P Power system for affecting gaming conditions
JP2006099666A (ja) * 2004-09-30 2006-04-13 Hitachi Global Storage Technologies Netherlands Bv 記録メディア・ドライブ及び記録メディア・ドライブにおけるパワー・セーブ・モードの制御方法
KR100790035B1 (ko) * 2005-08-31 2008-01-02 엘지전자 주식회사 전원제어장치 및 방법
CN100419637C (zh) * 2005-11-25 2008-09-17 鸿富锦精密工业（深圳）有限公司 电脑周边设备供电装置的驱动电路
US7770118B2 (en) * 2006-02-13 2010-08-03 Research In Motion Limited Navigation tool with audible feedback on a handheld communication device having a full alphabetic keyboard
US7724696B1 (en) * 2006-03-29 2010-05-25 Amazon Technologies, Inc. Predictive reader power management
WO2008010795A1 (en) 2006-07-18 2008-01-24 Agere Systems Inc. Systems and methods for modular power management
US8688933B2 (en) 2006-08-31 2014-04-01 Hewlett-Packard Development Company, L.P. Firmware component modification
US7746054B2 (en) * 2007-02-26 2010-06-29 Elster Electricity, Llc System and method for detecting the presence of an unsafe line condition in a disconnected power meter
US20080204953A1 (en) * 2007-02-26 2008-08-28 Elster Electricity Llc. System and method for detecting the presence of an unsafe line condition in a disconnected power meter
DE102007062705A1 (de) 2007-12-27 2009-07-02 Robert Bosch Gmbh Verfahren zur Steuerung des Energieverbrauchs elektrischer und/oder elektronischer Komponenten und Vorrichtung
US7772829B2 (en) * 2008-04-21 2010-08-10 Elster Electricity, Llc Power meter and method for measuring power consumption
US8656198B2 (en) * 2010-04-26 2014-02-18 Advanced Micro Devices Method and apparatus for memory power management
US8433937B1 (en) * 2010-06-30 2013-04-30 Western Digital Technologies, Inc. Automated transitions power modes while continuously powering a power controller and powering down a media controller for at least one of the power modes
CA2806557C (en) 2010-07-26 2014-10-07 Michael Luna Mobile application traffic optimization
US20120149352A1 (en) 2010-07-26 2012-06-14 Ari Backholm Context aware traffic management for resource conservation in a wireless network
US8736308B2 (en) 2011-07-06 2014-05-27 Advanced Micro Devices, Inc. Pipeline power gating
US8436647B2 (en) * 2011-07-06 2013-05-07 Advanced Micro Devices, Inc. Pipeline power gating for gates with multiple destinations
US8862909B2 (en) 2011-12-02 2014-10-14 Advanced Micro Devices, Inc. System and method for determining a power estimate for an I/O controller based on monitored activity levels and adjusting power limit of processing units by comparing the power estimate with an assigned power limit for the I/O controller
US8924758B2 (en) 2011-12-13 2014-12-30 Advanced Micro Devices, Inc. Method for SOC performance and power optimization
US9360918B2 (en) 2012-12-21 2016-06-07 Advanced Micro Devices, Inc. Power control for multi-core data processor
US9223383B2 (en) 2012-12-21 2015-12-29 Advanced Micro Devices, Inc. Guardband reduction for multi-core data processor
KR101481243B1 (ko) * 2012-12-28 2015-01-09 현대자동차주식회사 환경차량용 완속충전기의 초기 구동 시스템 및 방법
US9430150B2 (en) * 2013-01-28 2016-08-30 Dell Products, Lp Power control for data storage devices and method therefor
US9661577B2 (en) 2014-10-03 2017-05-23 Nxp Usa, Inc. Power management module and method therefor
CN104490478A (zh) 2015-01-09 2015-04-08 王小楠 医用射线定位薄膜及定位便捷的病变处拍照方法
KR102618563B1 (ko) * 2016-07-01 2023-12-27 삼성전자주식회사 집적 회로 장치와 이를 포함하는 전자 장치
US10955901B2 (en) 2017-09-29 2021-03-23 Advanced Micro Devices, Inc. Saving power in the command processor using queue based watermarks
US10671148B2 (en) 2017-12-21 2020-06-02 Advanced Micro Devices, Inc. Multi-node system low power management
US11054887B2 (en) 2017-12-28 2021-07-06 Advanced Micro Devices, Inc. System-wide low power management
US11435813B2 (en) 2018-08-29 2022-09-06 Advanced Micro Devices, Inc. Neural network power management in a multi-GPU system
US11100698B2 (en) 2019-06-28 2021-08-24 Ati Technologies Ulc Real-time GPU rendering with performance guaranteed power management
CN112925592A (zh) 2019-12-05 2021-06-08 超威半导体公司 渲染主页面的内核软件驱动的颜色重新映射

Family Cites Families (34)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3941989A (en) * 1974-12-13 1976-03-02 Mos Technology, Inc. Reducing power consumption in calculators
US4285043A (en) * 1976-09-21 1981-08-18 Sharp Kabushiki Kaisha Power transmission controller for electronic calculators
US4203153A (en) * 1978-04-12 1980-05-13 Diebold, Incorporated Circuit for reducing power consumption in battery operated microprocessor based systems
US4381552A (en) * 1978-12-08 1983-04-26 Motorola Inc. Stanby mode controller utilizing microprocessor
US4365290A (en) * 1979-03-12 1982-12-21 Medtronic, Inc. Computer system with power control circuit
US4316247A (en) * 1979-10-30 1982-02-16 Texas Instruments, Inc. Low power consumption data processing system
US4293927A (en) * 1979-12-12 1981-10-06 Casio Computer Co., Ltd. Power consumption control system for electronic digital data processing devices
US4317181A (en) * 1979-12-26 1982-02-23 Texas Instruments Incorporated Four mode microcomputer power save operation
US4518961A (en) * 1980-10-01 1985-05-21 Motorola, Inc. Universal paging device with power conservation
JPS5775335A (en) * 1980-10-27 1982-05-11 Hitachi Ltd Data processor
JPS57196267A (en) * 1981-05-28 1982-12-02 Konishiroku Photo Ind Co Ltd Power supply circuit
US4568934A (en) * 1981-06-09 1986-02-04 Adec, Inc. Computer controlled energy monitoring system
JPS5955526A (ja) * 1982-09-24 1984-03-30 Sharp Corp インタ−フエ−ス回路
US4545030A (en) * 1982-09-28 1985-10-01 The John Hopkins University Synchronous clock stopper for microprocessor
US4649373A (en) * 1983-08-10 1987-03-10 International Business Machines Corporation Powered conservation system in battery powered keyboard device including a microprocessor
US4698748A (en) * 1983-10-07 1987-10-06 Essex Group, Inc. Power-conserving control system for turning-off the power and the clocking for data transactions upon certain system inactivity
US4510398A (en) * 1983-12-13 1985-04-09 Honeywell Inc. Add/shed load control according to multiple add/shed sequences
US4568988A (en) * 1984-02-22 1986-02-04 Rodime Plc Micro hard-disk drive system
JPS60177466A (ja) * 1984-02-22 1985-09-11 Sharp Corp フロツピ−・デイスク・ドライブ制御方式
US4724528A (en) * 1984-05-08 1988-02-09 Hewlett-Packard Company Battery charge level monitor in a computer system
US4670837A (en) * 1984-06-25 1987-06-02 American Telephone And Telegraph Company Electrical system having variable-frequency clock
JPS6152722A (ja) * 1984-08-22 1986-03-15 Nippon Data General Kk 電力節約システム
US4654821A (en) * 1984-09-26 1987-03-31 Q-Com, Inc, Automatic restart apparatus for a processing system
JPS61223916A (ja) † 1985-03-28 1986-10-04 Nec Corp 電源制御方式
US4709234A (en) * 1985-05-06 1987-11-24 Halliburton Company Power-conserving self-contained downhole gauge system
US4656318A (en) * 1985-05-09 1987-04-07 Hewlett-Packard Company Modem with power-off ring detection
US4685056A (en) * 1985-06-11 1987-08-04 Pueblo Technologies, Inc. Computer security device
US4851987A (en) * 1986-01-17 1989-07-25 International Business Machines Corporation System for reducing processor power consumption by stopping processor clock supply if a desired event does not occur
JPH0817539B2 (ja) * 1986-07-16 1996-02-21 株式会社東芝 電動機等の負荷群制御装置
US4751653A (en) * 1986-08-25 1988-06-14 American Standard Inc. Fault detector for a three-phase alternating current supply
JPS63163912A (ja) * 1986-12-26 1988-07-07 Toshiba Corp マイクロコンピユ−タシステム
US4922450A (en) * 1987-10-08 1990-05-01 Rose Frederick A Communications management system having multiple power control modes
US4933795A (en) * 1987-12-07 1990-06-12 Fujitsu America, Inc. Floppy disc read and write head having two separate read and write cores for multiple track density and recording frequencies
US5402200A (en) * 1988-02-04 1995-03-28 Conner Peripherals, Inc. Low-power hard disk drive system architecture

Also Published As

Publication number Publication date
JPH02176921A (ja) 1990-07-10
CA1332005C (en) 1994-09-13
DE68929449D1 (de) 2003-02-13
USRE36189E (en) 1999-04-13
EP0623869B1 (en) 2003-01-08
JP3260355B2 (ja) 2002-02-25
DE68921405T3 (de) 2001-11-15
KR900006842A (ko) 1990-05-09
EP0364222A3 (en) 1990-11-22
EP0364222A2 (en) 1990-04-18
US4980836A (en) 1990-12-25
EP0364222B1 (en) 1995-03-01
DE68929449T2 (de) 2003-10-02
DE68921405T2 (de) 1995-09-21
ES2068900T3 (es) 1995-05-01
DE68921405D1 (de) 1995-04-06
EP0364222B2 (en) 2001-06-13
EP0623869A1 (en) 1994-11-09

Similar Documents

Publication Publication Date Title
KR970006390B1 (ko) 컴퓨터 시스템의 전력 소모 감소 장치
JP3442810B2 (ja) チップの消費電力を自動的に減少する方法および装置
US5465367A (en) Slow memory refresh in a computer with a limited supply of power
JP3406594B2 (ja) コンピュータ電力管理システム
US5634131A (en) Method and apparatus for independently stopping and restarting functional units
US5708819A (en) Process and apparatus for generating power management events in a computer system
US5504910A (en) Power management unit including software configurable state register and time-out counters for protecting against misbehaved software
EP0496536B1 (en) Battery operated computer power management system
US5446906A (en) Method and apparatus for suspending and resuming a keyboard controller
EP0889387B1 (en) Controlling a power state of a computer
US5623677A (en) Apparatus and method for reducing power consumption in a computer system
CA2120055C (en) Desktop computer system having multilevel power management
EP0617812A1 (en) Apparatus for reducing computer system power consumption
CA2120053A1 (en) Method for saving and restoring the state of a cpu executing code in protected mode
KR20030097637A (ko) 클럭 주파수 변환 회로
US6216187B1 (en) System for powering down a portable computer in a docking station
KR19980014709A (ko) 씨디-롬(cd-rom) 드라이브의 동작상태 체크방법
US5867718A (en) Method and apparatus for waking up a computer system via a parallel port
US6865684B2 (en) Utilization-based power management of a clocked device
JPH0588795A (ja) データ処理装置
JP3058070B2 (ja) 情報処理装置
JPH0566863A (ja) 情報処理装置
JPH10161624A (ja) 表示制御装置
JPH0588798A (ja) データ処理装置

Legal Events

Date Code Title Description
A201 Request for examination
G160 Decision to publish patent application
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20110810

Year of fee payment: 15

EXPY Expiration of term