KR960035981A - 반도체 장치의 금속배선 콘택부 형성방법 - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 9
- 239000002184 metal Substances 0.000 title claims abstract description 5
- 239000004065 semiconductor Substances 0.000 title claims abstract description 5
- 239000011229 interlayer Substances 0.000 claims abstract 7
- 239000010410 layer Substances 0.000 claims abstract 6
- 230000001681 protective effect Effects 0.000 claims abstract 6
- 238000005530 etching Methods 0.000 claims abstract 5
- 239000011810 insulating material Substances 0.000 claims abstract 5
- 125000006850 spacer group Chemical group 0.000 claims abstract 5
- 238000001465 metallisation Methods 0.000 claims abstract 3
- 239000000758 substrate Substances 0.000 claims abstract 2
- 230000015572 biosynthetic process Effects 0.000 claims 2
- 238000001312 dry etching Methods 0.000 claims 2
- 238000000151 deposition Methods 0.000 claims 1
- 239000005368 silicate glass Substances 0.000 claims 1
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
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Abstract
본 발명에 의한 금속배선 콘택부 형성방법은 반도체 기판상에 층간절연막과 표면보호막을 순차적으로 형성시키는 단계와, 금속콘택 부위의 표면보호막과 층간절연막을 부분적으로 제거하여 홈을 형성시키는 단계와, 표면보호막과 홈의 상면에 절연물질산화막을 형성시키는 단계와, 절연물질산화막을 에치백하여 홈의 측벽에 측벽스페이서를 형성시키는 단계와, 측벽스페이서 사이의 홈을 저면을 식각하여 콘택홀을 형성시키는 단계와, 표면보호막과 콘택홀의 상면에 금속층을 형성시키는 단계를 포함하여 이루어진다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 반도체 장치의 금속배선 콘택부 형성방법을 설명하기 위한도면.
Claims (4)
- 반도체 장치의 금속배선 콘택부 형성방법에 있어서, 1)반도체 기판상에 층간절연막과 표면보호막을 순차적으로 형성시키는 단계와 2)콘택부형성부위의 상기 표면보호막과 상기 층간절연막을 소정의 식각공정으로 부분적으로 제거하여 홈을 형성시키는 단계와, 3) 상기 표면보호막과 상기 홈의 표면에 절연물질산화막을 형성시키는 단계와 4)상기 절연물질산화막을 에치백하여 상기 홈의 측벽에 측벽스페이서를 형성시키는 단계와 5) 상기 측벽스페이서 사이의 상기 홈의 저면을 식각하여 콘택홀을 형성시키는 단계와 6)상기 표면보호막과 상기 콘택홀의 표면에 금속층을 형성시키는 단계를 포함하여 이루어진 반도체 장치의 금속배선 콘택부 형성방법.
- 제1항에 있어서, 상기 1) 단계에서 상기 층간절연막으로 BPSG(Borphospher Silicate Glass)를 형성시키고, 그 상면에 표면보호막으로는 NH3Si4을 증착하여 형성시키는 특징으로 하는 반도체 장치의 금속배선 콘택부 형성방법.
- 제1항에 있어서, 상기 2) 단계에서 상기 홈은 등방성 건식식각으로 상기 표면보호막과 상기 충간절연막을 부분적으로 제거하여 형성시키는 것을 특징으로 하는 반도체 장치의 금속배선 콘택부 형성방법.
- 제1항에 있어서, 상기 4) 단계에서 상기 표면보호막을 식각저지층으로 하여 상기 층간절연막을 보호하면서 상기 절연물질산화막을 에치백하여 상기 홈의 측벽에 측벽스페이서를 형성시키고, 상기 5) 단계에서 사이 홈의 저면을 등방성 건식식각하여 콘택홀을 형성시키는 것을 포함하는 반도체 장치의 금속 배선 콘택부 형성방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950005249A KR0147196B1 (ko) | 1995-03-14 | 1995-03-14 | 반도체 장치의 금속배선 콘택부 형성방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950005249A KR0147196B1 (ko) | 1995-03-14 | 1995-03-14 | 반도체 장치의 금속배선 콘택부 형성방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR960035981A true KR960035981A (ko) | 1996-10-28 |
KR0147196B1 KR0147196B1 (ko) | 1998-11-02 |
Family
ID=19409765
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950005249A KR0147196B1 (ko) | 1995-03-14 | 1995-03-14 | 반도체 장치의 금속배선 콘택부 형성방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR0147196B1 (ko) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20030052815A (ko) * | 2001-12-21 | 2003-06-27 | 동부전자 주식회사 | 반도체소자의 제조방법 |
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1995
- 1995-03-14 KR KR1019950005249A patent/KR0147196B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR0147196B1 (ko) | 1998-11-02 |
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