KR960019058A - 시프트 레지스터 및 표시 장치 - Google Patents

시프트 레지스터 및 표시 장치 Download PDF

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Abstract

본 발명은 시프트 레지스터 및 표시 장치에 관한 것으로, 상세하게는 복수 계열의 시프트 레지스터를 구비한 드라이버 일체형의 액티브 매트릭스 방식에 LCD에 관한 것이다.
본 발명은 복수 계열의 시프트 레지스터로 구성된 복수의 시프트 레지스터 블럭과, 상기 복수 계열의 시프트 레지스터에 대해 각각 설치되어, 각 계열의 시프트 레지스터를 각각 접속하는 복수의 접속부를 구비하여, 상기 복수의 시프트 레지스터 블럭과 접속부를 일렬로 배열한 시프트 레지스터에서, 상기 각 게열의 접속부를 적어도 1개의 계열의 접속부가 다른 게열의 접속부와 이간한 위치에 배치한다.

Description

시프트 레지스터 및 표시 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 한 실시 형태의 시프트 레지스터의 블럭도,
제2도는 액티브 매트릭스 방식 LCD의 블럭 회로도,
제3도는 시프트 레지스터의 주요부 블럭 회로도,
제4도는 시프트 레지스터의 접속을 도시하는 모식도,
제5도는 레지스터 블럭의 구성을 도시하는 설명도.

Claims (8)

  1. 복수 계열의 시프트 레지스터(11∼14)로 구성된 복수의 시프트 레지스터 블럭(RB1∼RBm)과, 상기 복수계열의 시프트 레지스터(11∼14)에 각각 설치되고 각 계열의 시프트 레지스터(11∼14)를 각각 접속하는 복수의 접속부(S1∼S4)를 구비하여, 상기 복수의 시프트 레지스터 블럭(RB1∼RBm)과 접속부(S1∼S4)를 일렬로 배열한 시프트 레지스터에 있어서, 상기 각 계열의 접속부(S1∼S4)를 적어도 1개의 접속부가 다른 계열의 접속부와 이간한 위치에 배열한 것을 특징으로 하는 시프트 레지스터.
  2. 제1항에 있어서, 상기 각 시프트 레지스터 블럭(RB1∼RBm)간에는 각 계열의 접속부(S1∼S4)가 번호순으로 각각 1개씩 배치된 것을 특징으로 하는 시프트 레지스터.
  3. 제1항에 있어서, 상기 접속부(S1∼S4)는 복수의 시프트 레지스터 블럭마다 배치된 것을 특징으로 하는 시프트 레지스터.
  4. 제1항 내지 제3항 중 어느 한 항에 있어서, 상기 복수 계열의 시프트 레지스터(11∼14)는 각각 정규 시프트 레지스터(SR1, SR3)과 용장 시프트 레지스터(SR2, SR4)로 구성되고, 상기 접속부는 각 계열의 정규 시프트 레지스터(SR1, SR3)이 정상인 시프트 동작을 행하고 있는지의 여부를 검출하고, 그 검출 결과에 기초하여 정규 시프트 레지스터(SR1, SR3)이 정상인 시프트 동작을 행하고 있는 경우에는 그 정규 시프트 레지스터(SR1, SR3)으로부터의 출력을 다음 시프트 레지스터 블럭의 대응하는 계열의 정규 시프트 레지스터(SR1, SR3) 및 용장 시프트 레지스터(SR2, SR4)로 출력하고, 정규 시프트 레지스터(SR1, SR3)이 정상인 시프트 동작을 행하고 있지 않는 경우에는 용장 시프트 레지스터(SR2, SR4)로부터의 출력을 다음 시프트 레지스터 블럭의 대응하는 계열의 정규 시프트 레지스터(SR1, SR3) 및 용장 시프트 레지스터(SR2, SR4)로 출력하도록 한 것을 특징으로 하는 시프트 레지스터.
  5. 화소 셀(GC)에 접속된 복수의 데이타선(D1∼D16m), 제1항∼제4항 중 어느 한 항에 기재한 시프트 레지스터로 구성된 시프트 레지스터군(5), 및 상기 시프트 레지스터군(5)에 의해 온오프 제어되고, 비디오 라인(VL)에 전달되는 비디오 신호를 각 데이타선(D1∼D16m)으로 전송하는 샘플링 트랜지스터군(4)로 구성된 데이타 드라이버(3)을 구비한 것을 특징으로 하는 표시 장치.
  6. 제5항에 있어서, 상기 시프트 레지스터군(5)의 각 계열의 시프트 레지스터(11∼14)는 각각 좌 시프트 정규 시프트 레지스터(SR1)과 좌 시프트 용장 시프트 레지스터(SR2)와 우 시프트 정규 시프트 레지스터(SR3)와 우 시프트 용장 시프트 레지스터(SR4)로 구성된 것을 특징으로 하는 표시 장치.
  7. 제1항 내지 제4항 중 어느 한 항에 있어서, 상기 시프트 레지스터는 다결정 실리콘막을 능동층으로 하는 박막 트랜지스터에 의해 구성되는 것을 특징으로 하는 시프트 레지스터.
  8. 제5항에 또는 제6항에 있어서, 상기 데이타 드라이버는 다결정 실리콘막을 능동층으로 하는 박막 트랜지스터에 의해 구성되는 것을 특징으로 하는 표시 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950043599A 1994-11-29 1995-11-24 시프트 레지스터 및 표시장치 KR100342794B1 (ko)

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