KR940008306A - 신호전송방법과 신호전송회로 - Google Patents

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Abstract

신호전성방법과 신호전송회로에 관한 것으로써, 간단한 구성에 의해 장거리전송에서의 안정된 고속전송을 실현하기 위해, 송신측에서는 전송해야 할 펄스신호의 상승에지와 하강에지에 각각 동기한 짧은 펄스폭의 펄스를 발생시키고, 이 펄스에 따라서 3가로 이루어지는 차동 형태의 출력신호를 형성하고 직렬저항을 거쳐서 1쌍의 전송선로를 통해서 송출시키고, 수신측에서는 수신단에 전송선로의 특성임피던스에 대응한 종단저항을 마련함과 동시에 1쌍의 전송선로둥의 다른쪽의 전송선로를 통과한 신호를 기준으로 해서 한쪽의 전송선로를 통과한 신호를 검출하고, 한쪽의 전송선로를 통과한 신호를 기준으로 해서 다른쪽의 전송선로를 통과한 신호를 기준으로 해서 한쪽의 전송선로를 통과한 신호를 검출하고, 한쪽의 전송선로를 통과한 신호를 기준으로 해서 다른쪽의 전송선로를 통과한 신호를 검출해서 본래의 펄스신호를 복원재생한다.
이러한 방법과 회로를 이용하는 것에 의해, 1쌍으로 이루어지는 전송선로에 전달되는 신호는 전송해야할 펄스 신호의 상승시와 하강시에만 상보적인 소진폭이고, 또 직류분을 포함하지 않으므로 장거리신호전송로에서도 선간용량의 차지나 디스차지의 현상 및 직류시프트가 없으므로 장거리에서의 고속전송이 가능하게 된다.

Description

신호전송방법과 신호전송회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 제8도의 디지탈신호 처리장치에 있어서의 1쌍으로 이루어지는 신호전송회로와 신호수신회로의 단위회로의 1실시예를 도시한 회로도.
제4도는 수신측의 단위회로 UBR의 제1실시예를 도시한 회로도.
제5도 (a)∼(d)는 제4도에 도시된 단위회로 UBR의 동작의 1예를 설명하기 위한 파형도.
제6도는 송신측의 단위회로 UBD의 다른 1실시예를 도시한 회로도.
제7도는 수신측의 단위회로 UBR의 다른 1실시예를 도시한 회로도.
제8도는 본 발명에 관한 신호전송방법이 사용되는 디지탈 신호 처리장치의 1실시예를 도시한 기본적인 블럭도.

Claims (10)

  1. 송신측에서는 전송해야 할 펄스신호의 상승에지와 하강에지에 각각 동기한 짧은 펄스폭의 펄스를 발생시키고, 이 펄스에 따라서 3가로 이루어지는 차동 형태의 출력신호를 형성하고 직렬저항을 거쳐서 1쌍의 전송선로를 통해서 송출시키고, 수신측에서는 수신단에 전송선로의 특성임피던스에 대응한 종단저항을 마련함과 동시에 상기 1쌍의 전송선로중 다른쪽의 전송선를 통과한 신호를 기준으로 해서 한쪽의 전송선로중 다른쪽의 전송선로를 통과한 신호를 기준으로 해서 한쪽의 전송선로중 다른쪽의 전송선로를 통과한 신호를 기준으로 해서 한쪽의 전송선로를 통과한 신호를 검출하고, 마찬가지로 상기 한쪽의 전송선로를 통과한 이들 검출신호에 따라서 본래의 펄스신호를 복원재생하는 것을 특징으로 하는 신호전송방법.
  2. 제1항에 있어서, 상기 전송해야 할 펄스신호는 2가의 직렬데이타중의 1 또는 0에 대응해서 그때마다 레벨이 변화시켜지는 신호인 것을 특징으로 하는 신호전송방법.
  3. 전송해야할 펄스신호의 상승에지에 동기한 짧은 펄스폭의 펄스를 발생시키는 제1의 신호발생회로, 전송해야 할 펄스신호의 하강에지에 동기한 짧은 펄스폭의 펄스를 발생시키는 제2의 신호발생회로, 상기 제1과 제2의 신호발생회로의 출력신호를 받아서 출력신호를 형성하는 구동회로, 상기 구동회로의 출력신호를 사용해서 3가의 차동형태의 신호로 하는 합성회로, 합성회로에 의해 형성된 3가의 차동형태의 출력신호를 1쌍의 전송선로에 전달하는 직렬저항으로 이루어지는 송신회로,전송선로의 특성임피던스에 대응한 종단저항, 상기 1쌍의 전송선로 중의 다른쪽의 전송선로를 통과한 신호를 기준으로 해서 다른쪽의 전송선로를 통과한 신호를 검출하는 제2의 신호검출회로, 상기 한쪽의 전송선로를 통과한 신호를 기준으로 해서 다른쪽의 전송선로를 통과한 신호를 검출하는 제2의 신호검출회로 및 이 제1및 제2의 검출신호에 따라서 본래의 펄스신호를 복원 재생하는 펄스재생회로로 이루어지는 수신회로를 구비해서 이루어지는 것을 특징으로 하는 신호전송회로.
  4. 제1항에 있어서, 상기 제1및 제2의 신호발생회로는 입력신호와 그 지연신호를 형성하는 지연회로 및 상기 입력신호와 지연신호를 받아서 지연시간에 대응한 펄스폭의 출력신호를 형성하는 논리게이트회로로 이루어지는 것을 특징으로 하는 신호전송회로.
  5. 제3항 또는 제4항에 있어서, 상기 구동회로는 제1과 제2의 신호발생회로에 의해 형성되고 펄스신호와 그 반전신호를 받아서 전류신호를 출력하는 MOSFET로 이루어지고, 신호합성회로는 전류신호의 조합에 있어서 2배의 전류, 1배의 전류, 무전류로 이루어지는 3가의 전류신호를 1쌍의 전송선로에 대해서 차동형태로 출력시키는 것을 특징으로 하는 신호전송회로.
  6. 제3항, 제4항 또는 제5항에 있어서, 상기 전송해야 할 펄스신호는 2가의 직렬데이타중의 1 또는 0에 대응해서 레벨이 변화시켜지는 신호인 것을 특징으로 하는 신호전송회로.
  7. 제3항, 제4항, 제5항 또는 제6항에 있어서, 상기 제1과 제2의 신호검출회로는 차동증폭회로이고, 그 자체 또는 그 전단에 마련된 레벨시프트회로에 의해 입력이 오프셋이 마련되는 것을 특징으로 하는 신호전송회로.
  8. 제7항에 있어서, 상기 레벨시프트회로는 MOSFET의 콘덕턴스비에 의해 차동증폭회로의 가장 감도가 높은 영역에 입력신호를 레벨시프트해서 전달하는 기능을 갖는 것을 특징으로 하는 신호전송회로.
  9. 제3항,제4항, 제5항, 제6항, 제7항 또는 제8항에 있어서, 상기 송신회로와 신호수신회로는 복수 비트로 이루어지는 병렬데이타를 NRZ형식의 직렬데이타로 변환해서 송신회로에 전달하는 제1의 데이타변환회로 및 수신회로를 통해서 폐치된 직렬데이타를 병렬데이타로 변환하는 제2의 데이타변환회를 입출력인터페이스로 하는 디지탈회로와 함께 1개의 반도체 집적회로장치에 구성되는 것을 특징으로 하는 신호전송회로.
  10. 제9항에 있어서, 상기 디지탈회로는 데이타처리기능과 메모리기능을 갖는 것을 특징으로 하는 신호전송회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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