KR940003178A - 펄스발생회로 - Google Patents

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KR940003178A
KR940003178A KR1019930012614A KR930012614A KR940003178A KR 940003178 A KR940003178 A KR 940003178A KR 1019930012614 A KR1019930012614 A KR 1019930012614A KR 930012614 A KR930012614 A KR 930012614A KR 940003178 A KR940003178 A KR 940003178A
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pulse generating
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신이치 기요타
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사토 후미오
가부시키가이샤 도시바
나카무라 노부히데
도시바 에이브이이 가부시키가이샤
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Abstract

본 발명은, 임의로 설정된 시간폭에 따른 펄스를 출력하는 펄스발생회로에 관한 것으로, 게이트수의 삭감에 의해 회로구성을 간소화함과 더불어 게이트 지연시간에 의한 영향을 작게 하여 보다 높은 기본 클로주파수에 대응하기 위한 것이다.
본 발명은, 1개의 카운트 이네이블신호 입력단자(E)를 구비하면서 1주기를 기본단위 시간폭으로 하는 클록신호(CLK)에 의해 입력데이터(DATA)를 계수하는 프리세트식 클록동기형 카운터(1)와, 상기 프리세트식 클록동기형 카운터(1)의 출력 (CO)을 디코드하여 제1상태신호(B)를 생성하는 제1논리수단(NAND1), 상기 카운트 이네이블신호(EN) 및 상기 클로신호(CLK1)를 기초로 제2상태신호(C)를 생성하는 제2논리수단(DF1) 및, 상기 제1논리수단(NAND1) 및 제2논리수단(DF1)의 각각의 출력(B) 및 출력(C)의 논리곱을 취하는 게이트(AND1)를 갖추어 구성된다.

Description

펄스발생회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1실시예에 따른 펄스발생회로의 구성도,
제2도는 제1실시예에 있어서 N=4비트로 한 경우의 동작을 설명하는 타이밍차트,
제3도는 본 발명의 제2실시예로서, 제1실시예의 펄스발생회로를 열프린트헤드(thermal print head) 구동에 적용한 경우의 구성도,
제4도는 제2실시예의 동작을 설명하는 타이밍차트.

Claims (2)

1개의 카운트 이네이블신호 입력단자(E)를 구비하면서 1주기를 기본단위 시 간폭으로 하는 클록신호에 의해 입력데이터를 계수하는 프리세트식 클록동기형 카운터(1)와, 상기 프리세트식 클록동기헝 카운터(1)의 출력을 디코드하여 제1상태 신호를 생성하는 제1논리수단(NAND1) 및, 상기 카운트 이네이블신호 및 상기 클로신호를 기초로 제2상태신호를 생성하는 제2논리수단(DF1)을 갖춘 것을 특징으로 하는 펄스발생회로.
제1항에 있어서, 상기 펄스발생회로는 상기 제1논리수단(NAND1) 및 제2논리수단(DF1)의 각각의 출력의 논리곱을 취하는 게이트(AND1)를 갖추면서 상기 게이트(AND1)로부터 펄스를 출력하는 것을 특징으로 하는 펄스발생회로.
※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930012614A 1992-07-06 1993-07-06 펄스발생회로 KR0139764B1 (ko)

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JP92-178576 1992-07-06

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